PT97813B - Dispositivo de sincronizacao de campo de manutencao de integridade entralacada - Google Patents

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Description

RESUMO presente invento refere-se a primeiro e segundo detectores de tipo de campo para primeiro e segundo sinais video, tendo saídas indicando se os sinais video têm primeiro ou segundo tipos de campo. 0 primeiro sinal video é sincronizado com o segundo sinal video, para um visor combinado por uma memória de campo síncrona e uma memória de linha múltipla assíncrona. 0 tipo de campo do segundo sinal video é alterado, guando necessário para fazer coincidir com o tipo de campo do primeiro sinal video, para manter a integridade entrelaçada no visor combinado. Um circuito de alteração de tipo de campo, que controla a sincronização, tem um primeiro modo de operação que retarda a escrita num campo corrente do primeiro tipo de campo de um período de linha horizontal, um segundo modo de operação, que avança a escrita de um campo corrente, de um segundo tipo de campo de um período de linha horizontal e um terceiro modo de operação, que mantém um tipo de campo corrente. A comparação do tipo de campo do segundo sinal com o tipo de campo de um primeiro sinal, resulta num sinal de saída, que indica uma de uma pluralidade de saídas de comparação, em que os primeiro e segundo sinais video têm o mesmo tipo de campo, em que o primeiro sinal video tem o primeiro tipo de campo e o segundo sinal video tem o segundo tipo de campo, e em que o primeiro sinal video tem o segundo tipo de campo e o segundo sinal video tem o primeiro tipo de campo. Uma pluralidade
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de sinais de correcção de entrelaçamento seleccionáveis são gerados, sendo cada um deles apropriado para uma de uma pluralidade de saídas de comparação.
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MEMÓRIA DESCRITIVA presente invento refere-se ao campo das televisões que têm visores de imagem múltipla para sinais de video assíncronos, e em particular, para televisões que têm écran com uma relação larga de formato de visionamento. A maioria das televisões actuais têm uma relação de formato de visionamento com largura horizontal por altura vertical de 4:3. Uma relação larga de formato de visionamento corresponde aproximadamente, à relação de formato de visionamento dos filmes para cinema, que é, por exemplo, de 16:9. O invento é aplicável tanto para as televisões de visão directa como para as de projecção.
As televisões com uma relação de formato de visionamento de 4:3, muitas vezes designada como 4x3, estão limitadas com a maneira como as fontes de sinal video singulares ou múltiplas podem ser visionadas. Transmissões do sinal de televisão dos emissores comerciais, excepto para material experimental, são emitidas com uma relação de formato de visionamento de 4x3. Muitos espectadores acham que o formato de visionamento 4x3 é menos atraente que a relação larga de formato de visionamento associada aos filmes para cinema. As televisões com relação de formato de visionamento larga apresentam não só um visor mais atraente como são capazes de apresentar fontes de sinal com largo formato de visionamento num correspondente largo formato de visionamento. Os filmes já se parecem com o cinema e não versões cortadas ou distorcidas desses filmes. A fonte de video não necessita de ser cortada nem na conversão de filme para video, como por exemplo, utilizando um aparelho de telecinema, nem usando processadores internos na televisão.
As televisões com uma relação de formato de visionamento larga estão também preparadas para uma grande variedade de visionamentos, tanto para sinais de formato convencional de visionamento como para sinais com formato de visionamento largo, assim como, usando combinações desses sinais para visores de imagem múltipla. Porém, o uso de écrans com relação de visionamento larga inclui numerosos problemas. Mudar as relações
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de formato de visionamento das múltiplas fontes de sinal, criar sinais de sincronismo consistentes, resultantes de fontes assíncronas e simultaneamente visionadas, comutar entre fontes múltiplas de modo a gerar visores de imagem múltipla, e proporcionar imagens de alta resolução derivadas da compressão de sinais de dados, são categorias gerais deste tipo de problemas. Tais problemas, ficam resolvidos numa televisão de écran largo, de acordo com este invento. Uma televisão de écran largo, segundo as diversas características deste invento, é capaz de proporcionar alta resolução, visores de imagem singular e múltipla resultantes de fontes assíncronas singulares e múltiplas, com semelhantes ou diferentes relações de formato e com relações de formato de visionamento seleccionáveis.
Quando uma imagem auxiliar é uma pequena inserção, vários artefactos a partir da sincronização imprecisa do sinal principal são toleráveis. No entanto, para alguns formatos particularmente adequados para uma televisão de écran largo tais como duas imagens lado a lado de tamanho igual, tal imprecisão e artefactos não podem ser tolerados. A dimensão larga da imagem auxiliar pode contornar tais artefactos demasiadamente óbvios. Em geral o dispositivo de visor video e deflexão para visionamentos de imagem compósita é sincronizado com o sinal video principal. 0 sinal video auxiliar deve ser sincronizado verticalmente com o ) sinal video principal e o visor video. Num dispositivo relativamente barato o sinal video pode ser atrasado de uma fracção de um período de campo numa memória de campo e em seguida acelerado numa memória de linha. Num dispositivo caro e sofisticado tal como é utilizado usualmente em estúdios de qualidade de rádio difusão, um dispositivo de quatro campos de sincronização utiliza quatro memórias de campo assíncronas de acesso duplo. As memórias assíncronas, isto é, as que têm acessos de relógio de escrita e leitura independentes, são em geral mais caras do que as memórias síncronas.
De acordo com os arranjos do invento aqui descritos, um certo grau de sincronização de campo pode ser alcançado, o qual coincide substancialmente com o desempenho de um dispositivo de
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quatro campos, mas utiliza apenas uma RAM video síncrona como uma memória de campo e um dispositivo de memórias de linha múltipla primeira a entrar primeira a sair, (FIFO) assíncrono. Se a FIFO é uma memória de cinco linhas, podem ser encontrados os seguintes artefactos: (1) dois deslocamentos de linha de quadro e um deslocamento de linha de campo ocorrerão cada vez que os dois sinais precessam através de um quadro video; e (2) o video de canal auxiliar fica embaralhado no fundo da imagem sempre que a velocidade de precessão entre os sinais principal e auxiliar é maior do que duas linha por quadro. Verificou-se que esta frequência de precessão não era provável de ocorrer no ambiente dos aparelhos electrónicos de consumo. A economia de custo numa dispositivo de quatro campos é aproximadamente 4:1 sem se incorrer em qualquer sacrifício significativo do desempenho. A dimensão da FIFO está relacionada com a capacidade de linha mínima pensada como sendo a razoavelmente necessária para evitar colisões de ponteiro de leitura/escrita. As colisões de ponteiro de leitura/escrita ocorrem quando os dados antigos são lidos da FIFO antes dos novos dados terem uma oportunidade de serem escritos na FIFO. As colisões de ponteiro de leitura/escrita ocorrem também quando os novos dados se sobrepõem na memória antes dos dados antigos terem uma oportunidade de serem lidos da FIFO. A dimensão da FIFO aqui utilizada por exemplo 2048x8 corresponde a aproximadamente a 5 linhas.
Um dispositivo de sincronização de campo para sinais videos assíncronos compreende um visor video sincronizado com um primeiro sinal video. 0 primeiro sinal video tem um primeiro componente de frequência de linha e um primeiro componente de frequência de campo correspondendo aos componentes de sincronização horizontal e vertical do primeiro sinal video. Uma memória de campo, tendo acessos síncronos de escrita e leitura é proporcionada para um segundo sinal video. 0 segundo sinal video tem um segundo componente de frequência de linha, que corresponde ao componente de sincronização horizontal do segundo sinal video. Uma memória de linha múltipla (FIFO) para o segundo sinal video tem acessos de escrita e leitura assíncronos e ponteiros de escrita e leitura reposicionáveis independentemente. 0 segundo
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sinal video, subamostrado, se necessário, é armazenado na memória de campo e escrito na memória de campo sincronizadamente com o segundo componente de frequência de linha. 0 segundo sinal video, subamostrado, se necessário, é escrito na memória de linha múltipla sincronizadamente com o segundo componente de frequência de linha. Os dados que correspondem ao segundo sinal video e, consequentemente, completamente ortogonais, tendo sido subamostrados e armazenados sincronizadamente com os seus próprios componentes de sincronização. 0 segundo sinal video subamostrado se necessário é lido da memória de linha múltipla sincronizadamente com o primeiro componente de frequência de linha. Um circuito de amostragem e atraso controla a reposição dos ponteiros de escrita e leitura. É gerado um sinal de reposição de ponteiro de escrita por amostragem no primeiro componente de frequência de campo com o segundo componente de frequência de linha: 0 ponteiro de escrita é reposto para um período de linha de um segundo sinal video após cada início do campo do primeiro sinal video. Um sinal de reposição de ponteiro de leitura é gerado por amostragem do primeiro componente de frequência de campo com o primeiro componente de frequência de linha. 0 ponteiro de leitura é reposto nos dois períodos de linha do primeiro sinal video após cada início de campo do primeiro sinal video, e mais particularmente, pelo menos, em dois, mas não mais do que três períodos de linha do primeiro sinal video, após cada início de campo do primeiro sinal video.
Os blocos de dados da RAM video são escritos na FIFO de 2048x8 com o mesmo relógio que foi o utilizado para amostrar os dados video, por exemplo, um relógio de 640fH que é bloqueado para o sinal auxiliar, em vez de para o sinal principal. A FIFO é lida utilizando uma frequência de relógio de visor, por exemplo, lO24fH, que é bloqueada para o componente de sincronização horizontal do canal video principal. A utilização de uma memória de linha múltipla (FIFO) que tem relógios de acesso de leitura e escrita independentes permite aos dados que foram amostrados ortogonalmente a uma primeira frequência serem amostrados ortogonalmente a uma segunda frequência. A utilização da FIFO assíncrona para o canal auxiliar não resolve todos os problemas
associados à sincronização video. Uma vez que a leitura e a escrita de dados do canal auxiliar FIFO é síncrono, existe a possibilidade que a integridade de entrelaçamento entre os sinais seja comprometida. A integridade de entrelaçamento requer que o mesmo tipo de campo em cada sinal seja visionado ao mesmo tempo. É também possível encontrar colisões de ponteiro de leitura/escrita na FIFO. Ocorre uma colisão de ponteiro de leitura/escrita, quando o sinal de permissão de leitura é recebido antes dos dados antigos, que já tinham sido lidos anteriormente, sejam substituídos por dados escritos de novo.
. A manutenção da integridade de entrelaçamento do video de F canal auxiliar é um problema que se opõe à leitura e escritas da
FIFO no trajecto de sinal auxiliar em relação assíncrona ao sinal ao sinal principal. Uma vez que o visor é bloqueado para o video de canal principal, o tipo de campo corrente a ser visionado, que é o campo superior ou inferior será determinado pelo sinal principal. 0 tipo de campo que é armazenado numa memória RAM video no trajecto ou canal de sinal auxiliar para sincronização com o sinal principal, e pronto para ser lido no início do campo de canal auxiliar, pode ou não ser o mesmo que o tipo do campo visionado. Pode ser necessário alterar o tipo de campo de sinal auxiliar armazenado na RAM video para coincidir com o do visor de canal principal.
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Geralmente, o processo de digitalização para um sinal NTSC quantificará 262,5 campos de linha do sinal NTSC em 263 campos superiores de linha (U, algumas vezes referidos como campos ímpares) e 262 campos inferiores de linha (L, algumas vezes chamados campos pares). Isto é devido ao facto de o sincronismo vertical é amostrado com impulsos que representam o sincronismo horizontal. Os campos superiores incluem linhas ímpares de 1 a 263. Os campos inferiores incluem linhas pares de 2 a 262.
Os tipos de campo superior e inferior são reconhecidos de acordo com um arranjo do invento. Três indicadores de tipo de campo correspondem a três modos de operação, designados por A, B e C. Um primeiro indicador de tipo de campo U/L (A) representa o
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tipo de campo armazenado na RAM video de canal auxiliar, se cada linha de canal auxiliar for escrita normalmente”. 0 termo normal é aqui utilizado para indicar que as linhas ímpares 1-263 são escritas na RAM video, quando o campo superior está a ser recebido e descodificado. Um segundo indicador de tipo de campo U/L(B) representa o tipo de campo armazenado na RAM video, se a primeira linha do campo superior não é escrita na RAM video durante a recepção de um campo superior. Em vez disso, a primeira linha é efectivamente colada à última linha (número 262) do campo inferior. Isto inverte efectivamente o tipo de campo desde que a linha 2 seja a primeira linha visionada e a linha 3 seja a segunda linha visionada no quadro. O campo superior recebido torna-se agora o campo inferior e vice-versa. Um terceiro indicador de tipo de campo U/L(C) representa o tipo de campo armazenado na RAM video se a última linha do campo superior for adicionada à RAM video, durante a recepção do campo inferior. Isto inverte efectivamente o tipo de campo, uma vez que a linha 263 seja a primeira linha visionada e a linha 1 seja a segunda linha visionada. A adição e a subtracção das linhas nos modos B e C não degrada a imagem de canal auxiliar porque estas linhas ocorrem durante o retorno vertical ou sobrexploração.
À medida que os sinais de canal principal e auxiliar precessam, o tipo de campo U/L mudará em relação aos indicadores de tipo de campo de canal auxiliar U/L(A,B,C). De acordo com um arranjo do invento o tipo de campo muda quando necessário para manter a integridade de entrelaçamento, quando o tipo de campo é detectado continuamente durante a precessão de sinal. Um dispositivo de sincronização para sinais video assíncronos de acordo com este arranjo do invento compreende primeiro e segundo detectores de tipo de campo para primeiro e segundo sinais video, respectivamente, tendo cada um uma saída que indica se o respectivo sinal video tem um primeiro ou segundo tipo de campo. Uma memória video, por exemplo, uma RAM video síncrona e uma FIFO de linha múltipla assíncrona, sincronizam o segundo sinal video com o primeiro sinal video durante um visionamento combinado. Um circuito de inversão de campo muda o tipo de campo do segundo sinal video, quando necessário para fazer incidir o tipo de campo
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-9do primeiro sinal video, para manter a integridade de entrelaçamento no visionamento combinado.
De acordo, adicionalmente, com este arranjo do invento, o circuito de inversão de campo controla a escrita na memória, tendo um primeiro modo de operação que atrasa a escrita num campo corrente do primeiro tipo de campo de um período de linha horizontal, um segundo modo de operação que avança a escrita num campo corrente do segundo tipo de campo de um período de linha horizontal e um terceiro modo de operação que mantém um tipo de campo corrente. Um comparador compara o tipo de campo do segundo sinal com o tipo de campo de um primeiro sinal e gera um sinal de saída que indica uma de uma pluralidade de saídas de comparação em que o primeiro e o segundo sinais video têm campos correntes do mesmo tipo de campo, o primeiro sinal video tem um campo corrente do primeiro tipo de campo e o segundo sinal video tem um campo corrente do segundo tipo de campo ou o primeiro sinal video tem um campo corrente do segundo tipo de campo e o segundo sinal video tem um campo corrente do primeiro tipo de campo. Um gerador de sinal desenvolve uma pluralidade de sinais de correcção de entrelaçamento sendo cada um deles apropriado para uma de uma pluralidade de saídas de comparação.
As figuras l(a)-l(i) são úteis para explicar diferentes formatos de visionamento numa televisão de écran largo.
A figura 2 é um diagrama de blocos de uma televisão de écran largo de acordo com características deste invento, e adaptada para funcionamento com exploração horizontal de 2fH.
A figura 3 é um diagrama de blocos do processador de écran largo, representado na figura 2.
A figura 4 é um diagrama de blocos que mostra outros detalhes do processador de écran largo, representado na figura 3.
A figura 5 é um diagrama de blocos do processador imagem em imagem representado na figura 4.
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A figura 6 é um diagrama de blocos da disposição de portas representado na figura 4 e que representa os trajectos do sinal principal, do sinal auxiliar e do sinal de saída.
As figuras 7 e 8 são diagramas de sincronismo, úteis para explicar a geração do formato de visionamento, representado na figura l(d), usando sinais completamente cortados.
A figura 9 é um diagrama de blocos dum circuito que gera o sinal interno 2fH na conversão de lfH para 2fH.
A figura 10 é uma combinação de circuito e diagrama de blocos para o circuito de deflexão representado na figura 2.
A figura 11 é um diagrama de blocos do interface RGB, representado na figura 2.
A figura 12 é um diagrama de blocos mostrando a saída de sinal auxiliar e uma porção do circuito de sinal principal em maior detalhe.
A figura 13 é um diagrama de uma memória de linha FIFO de cinco linhas útil para explicar a maneira de evitar as colisões de ponteiro de leitura/escrita.
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A figura 14 é um diagrama de blocos de um circuito simplificado para implementar um circuito de sincronização auxiliar para a disposição de portas.
A figura 15 é um diagrama de temporização que representa a correspondência de um indicador de campo superior/inferior para as linhas horizontais de um quadro video.
As figuras 16-18 são úteis para a explicação de um processo para manter a integridade de entrelaçamento para sinais video visionados simultaneamente apresentando precessão relativa.
As figuras 19 (a) - 19 (b) são formas de onda úteis para
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-11explicar a operação do circuito mostrado na figura 20.
A figura 20 é um diagrama de blocos de um circuito para manter a integridade de entrelaçamento, como se explicou em ligação com as figuras 16-18.
As várias partes da figura 1 representam algumas, mas não todas das várias combinações dos formatos de visionamento de imagem simples e múltipla que podem ser implementadas de acordo com as diferentes arranjos do invento. Os seleccionados para representação pretendem facilitar a descrição de circuitos particulares, que compreendem televisões de écran largo de acordo com os arranjos do invento. Para efeitos de conveniência na representação e explicação nisto aqui, uma relação de formato de visionamento convencional de entre largura por altura para uma fonte video ou sinal é geralmente julgada ser de 4x3, enquanto que uma relação de formato de visionamento de écran largo de entre largura por altura é geralmente julgado ser de 16x9. As arranjos do invento não estão limitadas por estas definições.
A figura l(a) representa uma televisão, de visão directa ou de projecção, que tem uma relação de formato de visionamento convencional de 4x3. Quando uma imagem de relação de formato de visionamento de 16x9 é transmitida, como um sinal de relação de ) formato de visionamento de 4x3, aparecem barras pretas no topo e no fundo. Isto é usualmente designado como formato letra de forma. Neste exemplo, a imagem visionada é um pouco mais pequena relativamente à área de visionamento total disponível. Alternativamente, a fonte de relação de formato de visionamento de 16x9 é convertida antes da transmissão, para que ela encha a extensão vertical de uma superfície de formato de visionamento de 4x3. Contudo, muita informação será cortada dos lados esquerdo e/ou direito. Como uma alternativa adicional, a imagem letra de forma pode ser expandida verticalmente mas não horizontalmente, pelo que a imagem resultante evidenciará distorção por alongamento vertical. Nenhuma das três alternativas é particularmente atraente.
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-12A figura l(b) mostra um écran de 16x9. Uma fonte video de relação de formato de visionamento de 16x9 será totalmente visionada, sem cortes e sem distorção. Uma imagem letra de forma de relação de formato de visionamento de 16x9, que está ela própria num sinal de relação de formato de visionamento de 4x3, pode ser progressivamente explorada por duplicação de linha ou adição de linha, de modo a proporcionar um visionamento mais largo com suficiente resolução vertical. Uma televisão de écran largo de acordo com este invento pode visionar um tal sinal de relação de formato de visionamento de 16x9 quer da fonte principal, da fonte auxiliar quer de uma fonte externa RGB.
A figura l(c) representa um sinal principal de relação de formato de visionamento de 16x9 no qual é visionada uma imagem inserida de relação de formato de visionamento de 4x3. Se tanto o sinal video principal como o auxiliar forem fontes de relação de formato de visionamento de 16x9, a imagem inserida pode também ter uma relação de formato de visionamento de 16x9. A imagem inserida pode ser visionada em posições muito diferentes.
A figura l(d) representa um formato de visionamento, em que os sinais video principal e auxiliar são visionados com a imagem da mesma dimensão. Cada zona de visionamento tem uma relação de formato de visionamento de 8x9, que é com certeza diferente tanto da de 16x9 como da de 4x3. A fim de exibir uma fonte de relação de formato de visionamento de 4x3 numa tal zona de visionamento, sem distorção horizontal ou vertical, o sinal deve ser cortado nos lados esquerdo e/ou direito. A maior parte da imagem pode ser exibida, com menos cortes, se for tolerada alguma distorção da relação de aspecto por compressão horizontal da imagem. Compressão horizontal resulta no alongamento vertical de objectos na imagem. A televisão de écran largo de acordo com este invento pode proporcionar qualquer mistura de corte e distorção de relação de aspecto a partir de corte máximo com nenhuma distorção de relação de aspecto a nenhum corte com máxima distorção de relação de aspecto.
Limitações de amostragem de dados no trajecto de
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RCA 86 343 processamento do sinal video auxiliar complicam a geração de uma imagem de alta resolução a qual é tão larga em dimensão quanto o visionamento do sinal video principal. Podem ser desenvolvidos vários processos para superar estas complicações.
A figura l(e) é um formato de visionamento em que uma imagem de relação de formato de visionamento de 4x3 é visionada no centro de um écran de relação de formato de visionamento de 16x9. Barras escuras são evidentes nos lados esquerdo e direito.
A figura l(f) representa um formato de visionamento em que são visionadas simultaneamente uma imagem grande de relação de formato de visionamento de 4x3 e três imagens mais pequenas de relação de formato de visionamento de 4x3. Uma imagem mais pequena fora do perímetro da imagem grande é algumas vezes designada como uma POP, isto é uma imagem fora de imagem, em vez de um PIP, uma imagem em imagem. Os termos PIP ou imagem em imagem são utilizados nisto aqui para ambos os formatos de visionamento. Naquelas circunstâncias em que é fornecido televisão de écran largo com dois sintonizadores quer ambos internos quer um interno e um externo, por exemplo num gravador de cassetes video, duas das imagens visionadas podem visionar movimento em tempo real de acordo com a fonte. As restantes imagens podem ser visionadas no formato de quadro de imobilização. Será apreciado que a adição de sintonizadores adicionais e trajectos de processamento de sinal auxiliar adicionais podem proporcionar mais do que duas imagens em movimento. Será também apreciado que a imagem grande por um lado, e as três imagens pequenas por outro lado, podem ser comutadas em posição, como mostrado na figura l(g).
A figura l(h) representa uma alternativa em que a imagem de relação de formato de visionamento de 4x3 está centrada, e seis imagens mais pequenas de relação de formato de visionamento de 4x3 são visionadas em colunas verticais em ambos os lados. Como no formato anteriormente descrito, uma televisão de écran largo fornecido com dois sintonizadores pode proporcionar duas imagens em movimento. As restantes onze imagens estarão em formato de
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J quadro imóvel. r
A figura l(i) mostra um formato de visionamento que tem uma grelha de doze imagens de relação de formato de visionamento de 4x3. Um tal formato de visionamento é particularmente apropriado para um guia de selecção de canal, em que cada imagem é pelo menos um quadro de imobilização de um canal diferente. Como antes, o número de imagens em movimento dependerá do número de sintonizadores disponíveis e trajectos de processamento de sinal.
Os vários formatos mostrados na figura 1 são representativos, e não limitativos, e podem ser implementados por televisões de écran largo mostrado nos restantes desenhos e descrita em detalhe mais abaixo.
Um diagrama de blocos global para uma televisão de écran largo de acordo com os arranjos do invento, e adaptado para operar com exploração horizontal 2fH, é mostrada na figura 2 e designado geralmente por 10. A televisão 10 compreende geralmente uma secção de entrada de sinais video 20, uma base ou microprocessador TV 216, um processador de écran largo 30, um conversor de lfH a 2fH 40, um circuito de deflexão 50, uma interface RGB 60, um conversor de YUV para RGB 240, um accionador de cinescópio 242, tubos de projecção ou de visão directa 244 e uma fonte de energia 70. 0 agrupamento de vários circuitos em diferentes blocos funcionais é feita para efeitos de conveniência na descrição, e não pretende ser limitador da posição física relativa de tais circuitos entre si.
A secção de entrada de sinais video 20 está adaptada para receber uma pluralidade de sinais video compostos de diferentes fontes video. Os sinais video podem ser comutados selectivamente para visionamento como sinais video principais e auxiliares. Um comutador RF 204 tem duas entradas de antena ANTI e ANT2. Estas representam entradas para a recepção tanto por antena aérea distante como por cabo. O comutador RF 204 controla qual a entrada de antena que é fornecida a um primeiro sintonizador 206 e a um segundo sintonizador 208. A saída do primeiro sintonizador
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206 é uma entrada para uma monopastilha 202, que executa um número de funções relativas à sintonia, deflexão horizontal e vertical e controlos video. A monopastilha particular apresentada é designada industrialmente como do tipo TA7730. O sinal video de banda de base VIDEO OUTPUT (saída video) desenvolvido na monopastilha e que resulta do sinal do primeiro sintonizador 206 é uma entrada tanto para o comutador video 200 como para a entrada TV1 do processador de écran largo 30. Outras entradas video de banda de base para o comutador video 200 são designadas por AUX1 e AUX2. Estas podem ser utilizadas para câmaras video, reprodutores de discos laser, reprodutores de cassetes video, jogos video e semelhantes. A saída do comutador video 200, que é controlada pelo base ou microprocessador TV 216 é designado por SWITCHED VIDEO (video comutado), 0 SWITCHED VIDEO é uma outra entrada para o processador de écran largo 30.
Com referência adicional à figura 3, um processador comutador SW1 de écran largo selecciona entre os sinais TV1 e SWITCHED VIDEO, como sinal video SEL COMP OUT (saída composta seleccionada) que é uma entrada para um descodificador Y/C 210. 0 descodificador Y/C 210 pode ser implementado como um filtro pente em linha adaptativo. Duas fontes video adicionais SI e S2 são também entradas para o descodificador Y/C 210. Cada um dos SI e S2 representam diferentes fontes S-VHS, e cada uma consiste de sinais de luminância e crominância separados. Um comutador, que pode ser incorporado como parte do descodificador Y/C, ou que pode ser implementado como um comutador separado, que responde ao microprocessador TV 216 para seleccionar um par de sinais de luminância e crominância como saídas designadas por Y_M e C_IN respectívamente. O par seleccionado dos sinais de luminância e crominância é consequentemente considerado o sinal principal e é processado ao longo de um trajecto de sinal principal. As designações do sinal incluindo _M ou _MN referem-se ao trajecto de sinal principal. 0 sinal de crominância C_IN é redireccionado pelo processador de écran largo de volta à monopastilha, para desenvolver sinais de diferença de cor U_M e V_M. Neste contexto, U é uma designação equivalente para ((R-Y) e V é uma designação equivalente para (B-Y). Os sinais Y_M, U_M, e V_M são convertidos
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J para o formato digital no processador de écran largo para processamento de sinal adicional.
O segundo sintonizador 208, definido funcionalmente como parte do processador de écran largo 30, desenvolve um sinal video de banda de base TV2. Um comutador SW selecciona entre os sinais SWITCHED VIDEO e TV2 como uma entrada para um descodificador Y/C 220. 0 descodificador Y/C 220 pode ser implementado como um filtro pente em linha adaptativo. Os comutadores SW3 e SW4 seleccionam entre as saídas de luminância e crominância do descodificador Y/C 220 e os sinais de luminância e crominância de uma fonte video externa Y_EXT e C_EXT respectívamente. Os sinais * Y_EXT e C_EXT correspondem à entrada S-VHS Sl. O descodificador Y/C 220 e os comutadores SW3 e SW4 pode estar combinados como em alguns filtros pente em linha adaptativos. A saída dos comutadores SW3 e SW4 é consequentemente considerada o sinal auxiliar e é processado ao longo de um trajecto de sinal auxiliar. A saída de luminância seleccionada é designada Y_A. As designações de sinal incluindo _A, _AX e _AUX referem-se ao trajecto de sinal auxiliar. A crominância seleccionada é convertida para sinais de diferença de cor U_A e V_A. Os sinais Y_A, U_A e V_A são convertidos para formato digital para processamento de sinal adicional. A disposição de fonte de sinal video que comuta nos trajecto de sinal principal e auxiliar, ) maximiza flexibilidade gerindo a selecção da fonte para as diferentes partes dos diferentes formatos de visionamento de imagem.
Um sinal de sincronização composto COMP SYNC, correspondendo a Y_M é fornecido pelo processador de écran largo a um separador síncrono 212. Os componentes de sincronização horizontal e vertical H e V respectívamente são entradas para um circuito de contagem decrescente vertical 214. 0 circuito de contagem decrescente vertical desenvolve um sinal de VERTICAL RESET (reposicionamento vertical) que é dirigido para dentro do processador de écran largo 30. O processador de écran largo gera um sinal de saída de reposicionamento vertical interno INT VERT RST OUT dirigido para a interface RGB 60. Um comutador na
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interface RGB 60 seleccion reposicionamento vertical interno e o componente de sincronização vertical da fonte externa RGB. A saída deste comutador é um componente de sincronização vertical seleccionado SEL_VERT__SYNC dirigido para o circuito de deflexão 50. Os sinais de sincronização horizontal e vertical do sinal video auxiliar são desenvolvidos pelo separador síncrono 250 no processador de écran largo.
conversor de lfjj para 2fjj 40 é responsável por converter sinais video entrelaçados para sinais não entrelaçados explorados progressivamente, por exemplo um em que cada linha horizontal é gerada por interpolação das linhas horizontais adjacentes do mesmo campo. Em alguns casos, a utilização de uma linha anterior ou a utilização de uma linha interpolada dependerá do nível de movimento que é detectado entre campos adjacentes ou quadros. 0 circuito conversor 40 funciona em conjunto com uma RAM (memória apenas de leitura) video 420. A RAM video pode ser utilizada para armazenar um ou mais campos de um quadro para possibilitar o visionamento progressivo. Os dados video convertidos como sinais Y_2fH, U_2fH e V_2fjj são fornecidos à interface RGB 60.
A interface RGB 60, mostrada mais detalhadamente na figura 15, possibilita a selecção dos dados video convertidos ou dados video externos RGB para visionamento pela secção de entrada de sinais video. 0 sinal RGB externo é julgado ser um sinal de relação de formato de visionamento largo adaptado para exploração 2fH. A componente de sincronização vertical do sinal principal é fornecido à interface RGB pelo processador de écran largo como INT VERT RST OUT, possibilitando que uma sincronização vertical seleccionada (fVm ou fvext) esteja disponível ao circuito de deflexão 50. O funcionamento da televisão de écran largo possibilita a selecção pelo utilizador de um sinal RGB externo, gerando-se um sinal de controlo interno/externo INT/EXT. Contudo, a selecção de uma entrada de sinal RGB externo, na ausência de um tal sinal, pode resultar no colapso vertical do quadro, e danos no tubo de raios catódicos ou tubos de projecção. Consequentemente, o circuito interface RGB detecta um sinal de
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-18sincronização externo, a fim de anular a selecção de uma entrada externa RGB não existente. 0 microprocessador WSP 340 fornece também controlos de cor e matiz para o sinal RGB externo.
O processador de écran largo 30 compreende um processador de imagem em imagem 320 para processamento de sinal especial do sinal video auxiliar. 0 termo imagem em imagem é algumas vezes abreviado como PIP ou pix-in-pix. Uma disposição de portas 300 combina os dados de sinal principal e auxiliar num grande variedade de formatos de visionamento, como mostrado pelos exemplos das figuras de l(b) a l(i). O circuito de imagem em imagem 320 e a disposição de portas 300 estão sob o controlo de um microprocessador de écran largo (WSP μΡ) 340 . 0 microprocessador 340 que responde ao microprocessador TV 216 através de um bus série. O bus série inclui quatro linhas de sinal, para dados, sinais de relógio, sinais de autorização e sinais de reposicionamento+.. O processador de écran largo 30 gera também um sinal vertical composto de apagamento/reposicionamento, como um sinal castelo de areia de três níveis. Alternativamente, os sinais de apagamento e reposicionamento verticais podem ser gerados como sinais separados. Um sinal de apagamento composto é fornecido à interface RGB pela secção de entrada de sinal video.
| 0 circuito de deflexão 50, exposto com maior detalhe na figura 14, recebe um sinal de reposicionamento vertical do processador de écran largo, um sinal de sincronização horizontal 2fH seleccionado a partir da interface RGB 60 e sinais de controlo adicional a partir do processador de écran largo. Estes sinais de controlo adicional dizem respeito ao faseamento horizontal, ajustamento de dimensão vertical e ajustamento de cavilha este-oeste.. O circuito de deflexão 50 fornece impulsos de retorno 2fH ao processador de écran largo 30, o conversor de lfH para 2fH 40 e o conversor de YUV para RGB 240.
As tensões de funcionamento para toda a televisão de écran largo são geradas por uma fonte de energia 70 que pode ser alimentada por uma fonte principal de corrente alternada.
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-190 processador de écran largo 30 está mostrado com maior detalhe na figura 3. Os principais componentes do processador de écran largo são uma disposição de portas 300, um circuito de imagem em imagem 301, conversores de analógico para digital e de digital para analógico, o segundo sintonizador 208, um microprocessador processador de écran largo 340 e um codificador de saída de écran largo 227. Detalhes adicionais do processador de écran largo, que são comuns tanto à base lfH como ao 2fH, por exemplo o circuito PIP, estão mostrados na figura 4. Um processador de imagem em imagem 320, que constitui uma parte significativa do circuito PIP 301, é mostrada com maior detalhe na figura 5. A disposição de portas 300 está mostrada com mais detalhe na figura 6. Uma pluralidade dos componentes mostrados na figura 3, que constituem partes dos trajectos de sinal principal e auxiliar, foram já descritos em detalhe.
segundo sintonizador 208 tem associado nele um andar IF 224 e um andar audio 226. 0 segundo sintonizador 208 opera também em conjunção com o WSP μΡ 340. 0 WSO μΡ 340 compreende uma secção de entrada saída 1/0 340A e uma secção de saída analógica 340B. A secção 1/0 340B fornece sinais de controlo de matiz e cor, o sinal INT/EXT para seleccionar a fonte video RGB externa e sinais de controlo para os comutadores de SW1 a SW6. A secção I/O controla também o sinal EXT SYNC DET da interface RGB para ) proteger o circuito de deflexão e tubo(s) de raios catódicos. A secção de saída analógica 340B fornece sinais de controlo para dimensão vertical, ajustamento este-oeste e fase horizontal, através dos respectivos circuitos de interface 254, 256 e 258.
A disposição de portas 300 é responsável para combinar informação video dos trajectos de sinal principal e auxiliar para implementar um visionamento de écran largo composto, por exemplo por um dos mostrados nas diferentes partes da figura 1. A informação de relógio para a disposição de portas é fornecida por circuito fechado de bloqueio de fase 374, que funciona em conjunção com filtro de passagem de baixas frequências 376. 0 sinal video principal é fornecido ao processador de écran largo no formato analógico, e formato YUV, como sinais designados por
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-20Υ_Μ, U_M e V_M. Estes sinais principais sao convertidos do formato analógico para o formato digital por conversores de analógico para digital 342 e 346, mostrados com mais detalhe na figura 4.
Os sinais de componente de cor são designados pelas designações genéricas U e V, que pode ser atribuídos quer aos sinais R-Y ou B-Y, quer aos sinais I e Q. A largura de banda da luminância amostrada está limitada a 8 MHz porque a frequência do dispositivo de relógio é de 1024fH, que é aproximadamente de 16 MHz. Um conversor simples de analógico para digital e um comutador analógico podem ser utilizados para amostrar os dados de componente de cor porque os sinais U e V estão limitados a 500 kHz, ou 1,5 MHz para a largura I. A linha seleccionada UV_MUX para o comutador analógico, ou dispositivo de multiplexação 344, é um sinal de 8 MHz derivado dividindo-se o relógio do dispositivo por 2. Um início largo mono relógio de impulso de linha SOL restabelece sincronizadamente este sinal a zero no começo de cada linha video horizontal. A linha UV_MUX varia então de estado em cada ciclo de relógio através da linha horizontal. Dado que o comprimento de linha é um número ímpar de ciclos de relógio, o estado do UVMUX, uma vez iniciado, variará consistentemente 0, 1, 1, 1, ..., sem interrupção. Os fluxos de dados Y e UV fora dos conversores de analógico para digital 342 e 346 estão deslocados porque os conversores de analógico para digital têm cada um 1 ciclo de relógio de atraso. A fim de se adaptar a esta mudança de dados, a informação do acesso relógio do trajecto de processamento de sinal principal 304 deve ser atrasado de maneira semelhante. Se a informação do acesso relógio não fosse atrasada, os dados UV não seriam correctamente emparelhados quando apagados. Isto é importante porque cada par UV representa um vector. Um elemento U de um vector não pode ser emparelhado com um elemento V de um outro vector sem originar uma mudança de cor. Em vez disso, uma amostra V de um par anterior seria apagado juntamente com a amostra corrente U. Este processo de multiplexação UV é referido como 2:1:1, dado que há duas amostras de luminância para todos os pares de amostras de componente de cor (U,V). A frequência Nyquist tanto para U como
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RCA 86 343 para V é efectivamente reduzida para um meio da frequência Nyquist de luminância. Consequentemente, a frequência Nyquist da saída do conversor de analógico para digital para o componente de luminância é de 8 MHz, enquanto que a frequência Nyquist da saída do conversor analógico para digital para o componente de cor é de 4 MHz.
circuito PIP e/ou a disposição de portas podem incluir também meios para aumentarem a resolução dos dados auxiliares não opondo-se à compressão de dados. Uma pluralidade de esquemas de redução de dados e de restauração de dados foram desenvolvidos, incluindo por exemplo compressão de pixel (ponto) emparelhada e excitação e não excitação. Além do mais, são contempladas diferentes sequências de excitação envolvendo diferentes números de bits e diferentes compressões de pixel (ponto) emparelhados envolvendo números diferentes de bits. Um de uma pluralidade de esquemas de redução e restauração de dados particulares pode ser seleccionado pelo WSP μΡ 340 a fim de maximizar a resolução do video visionado para cada tipo particular de formato de visionamento de imagem.
A disposição de portas inclui interpoladores que funcionam em conjunção com memórias de linha, que podem ser implementados como FIFO 356 e 3558. O interpolador e as FIFO são utilizados para reamostrar o sinal principal como desejado. Um interpolador adicional pode reamostrar o sinal auxiliar. Circuitos de sincronização e de relógio na disposição de portas controlam a manipulação dos dados de ambos os sinais principal e auxiliar, incluindo a sua combinação num único sinal video de saída tendo componentes Y_MX, U_MX e V_MX. Estes componentes de saída são convertidos para o formato analógico pelos conversores de digital para analógico 360, 362 e 364. 0 formato analógico dos sinais, designados Y, U e V, são fornecidos ao conversor de lfH para 2fH 40 para conversão para exploração não entrelaçada. Os sinais Y, U e V são também codificados para o formato Y/C pelo codificador 227 para definir um sinal de saída de relação de formato largo Y_OUT_EXT/C_OUT_EXT disponível nas tomadas do painel. 0 comutador SW5 selecciona um sinal de sincronização para o codificador 227
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RCA 86 343 quer da disposição de portas, C_SYNC_MN, quer do circuito PIP, csyncaux. o comutador SW6 selecciona entre Y_M e C_SYNC_AUX como sinal de sincronização para a saída de painel de écran largo.
Porções do circuito de sincronismo horizontal, são representadas com mais detalhe na figura 9. O comparador de fase 228, é parte de um inversor de bloqueio de fase, incluindo um filtro de baixa frequência 230, um oscilador de tensão controlada 232, um divisor 234 e um condensador 236. O oscilador de tensão controlada 232, funciona a 32fH e em ligação a um ressonador de cerâmica, ou similar, 238. A saída do oscilador de tensão controlada é dividida por 32, de modo a proporcionar uma conveniente frequência, do segundo sinal de entrada, para o comparador de fase 228. A saída do divisor 234, é um sinal de sincronismo lfH REF. Os sinais de sincronismo 32fH REF e lfH REF, são fornecidos a um contador 400, que divide por 16. Uma saída 2fH, é fornecida a um circuito de duração de impulso 402. Um divisor 400 pré-estabelecido pelo sinal lfH REF assegura que o divisor funcione sincronizadamente com o inversor de bloqueio de fase da secção de entrada dos sinais video. 0 circuito de duração de impulso 402, assegura que um sinal 2fjj REF, tem uma duração de impulso adequada, para assegurar um funcionamento conveniente do comparador de fase 404, por exemplo, um do tipo CA 1391, que é | parte de um segundo inversor de bloqueio de fase, que inclui um filtro de baixa frequência 406 e um oscilador de tensão controlada 2fH 408. O oscilador de tensão controlada 408, gera um sinal interno de sincronismo 2fH, que é usado para conduzir a exploração contínuo do visor. 0 outro sinal de entrada para o comparador de fase 404, são os impulsos de retorno 2fH, ou um sinal de sincronismo com ele relacionado. 0 uso do segundo inversor de bloqueio de fase, que inclui o comparador de fase 404, é útil, porque assegura que cada período de exploração 2fH, é simétrico com cada período lfH do sinal de entrada. De outro modo, o visor pode apresentar uma abertura no quadro, por exemplo, onde metade das linhas video estão deslocadas para a direita e metade para a esquerda.
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O circuito de deflexão 50, é representado com mais detalhe na figura 10. Um circuito 500, é fornecido, para ajuste do comprimento vertical do quadro, de acordo com a quantidade desejada de sobrexploração vertical, necessária para a implementação de diferentes formatos de visionamento. Como representado no diagrama, uma fonte de corrente contínua 502 fornece uma quantidade constante de corrente IramP' 3ue carrega um condensador de rampa vertical 504. Um transístor 506, está ligado em paralelo com o condensador de rampa vertical, e descarrega periodicamente o condensador, que funciona em ligação com o sinal de reposição vertical. Na falta de ajustamento, a corrente IramP' k fornece o máximo comprimento vertical disponível, ao quadro. -F Isto, pode corresponder ao ponto de sobrexploração vertical necessário ao preenchimento do visor de écran largo, por uma fonte de sinal com relação expandida de formato de visionamento 4x3, como representado na figura l(a). Até ao ponto em que menos comprimento vertical de quadro é requerido, uma fonte de corrente ajustável 580, diversifica uma quantidade variável de corrente ^ADJ de l-RAMP' de modo a Que ° condensador de rampa vertical 504, carregue mais devagar e para um menor valor de pico. A fonte de corrente variável 508, funciona em ligação com um sinal de afinação de comprimento vertical, por exemplo, em forma analógica, gerado pelo circuito de controlo do comprimento vertical 1030, mostrado na figura 12. O ajuste do comprimento ) vertical 500, é independente de um ajuste manual de comprimento vertical 510, que pode ser implementado por um potenciómetro ou por um botão de ajuste na parte traseira do quadro de instrumentos. Em qualquer dos casos, a(s) bobina(s) de deflexão vertical 512 recebe(m) corrente de excitação com a intensidade conveniente. A deflexão horizontal é fornecida pelo circuito de ajuste de fase 518, pelo circuito de correcção do eixo este-oeste 514, pelo inversor do bloqueio de fase 2fjj 520 e pelo circuito de saída horizontal 516.
circuito interface RGB 60, é mostrado com mais detalhe na figura 11. 0 sinal que vai ser exibido em último lugar, vai ser seleccionado entre a saída do conversor lfH para 2fH 40, e uma entrada RGB exterior. Para finalidade da televisão de écran
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largo, aqui descrita, a entrada exterior RGB é suposta ter uma fonte de exploração contínuo, com relação larga de formato de visionamento. Os sinais RGB exteriores, e um sinal composto de bloqueio, provenientes da secção de entrada dos sinais video 20, dão entrada num conversor de RGB para YUV 610. 0 sinal exterior composto de sincronismo 2fH para o sinal RGB exterior, é uma entrada para o separador de sinal exterior de sincronismo, 600. A selecção do sinal de sincronismo vertical é implementada pelo comutador 608. A selecção do sinal de sincronismo horizontal é implementada pelo comutador 604. A selecção do sinal video é implementada pelo comutador 606. Cada um dos comutadores 604, 606 e 608, age em resposta a um sinal de controlo interno/externo, gerado pelo WSP μΡ 340. A selecção de fontes de video internas ou externas, é uma selecção a fazer pelo utilizador. Porém, se um utilizador, inadvertidamente, selecciona uma fonte exterior RGB, quando tal fonte não está ligada ou activada, ou se a fonte exterior se desliga, o quadro vertical vai-se deformar e podem resultar sérios estragos no(s) tubo(s) de raios catódicos. Em conformidade, um detector de sincronismo exterior 602, verifica a presença de um sinal exterior de sincronismo. Na inexistência desse sinal, um sinal de controlo do comutador de cancelamento, é transmitido para cada um dos comutadores 604, 606 e 608, de modo a evitar a escolha duma fonte exterior RGB, se o sinal daí resultante não estiver presente. O conversor de RGB para YUV 610, também recebe sinais de controlo de cor e matiz do WSP μΡ 340.
A figura 4 é um diagrama de blocos, representando outros detalhes do processador de écran largo 30, mostrado na figura 3. Os sinais Y_A, U_A e V_A são entradas para o processador de imagem em imagem 320 , que pode incluir um circuito de processamento de resolução 370. A televisão de écran largo, de acordo com características deste invento, pode expandir ou comprimir o video. Os efeitos especiais, incorporados pelos diversos formatos compostos de visionamento representados, em parte, na figura 1, são criados pelo processador imagem em imagem 320, que pode receber sinais de dados de resolução, processados, Y_RP, U_RP e V_RP do circuito de processamento de resolução 370. 0 processamento da resolução não necessita de ser sempre
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RCA 86 343 utilizado, mas apenas durante os formatos de visionamento seleccionados. O processador imagem em imagem 320, é representado com mais detalhe na figura 5. Os componentes principais do processador imagem em imagem são, uma secção de conversão analógica digital 322, uma secção de entrada 324, um comutador rápido (FSW) e uma secção de bus 326, uma secção de controlo e sincronismo 328 e uma secção conversora digital analógica 330.
O processador imagem em imagem 320, pode ser concretizado como uma variação melhorada dum circuito integrado básico CPIP, criado pela Thompson Consumer Electronics, Inc. 0 circuito integrado básico CPIP é descrito com maior precisão numa publicação com o título The CTC 140 Picture in Picture (CPIP) Technical Training Manual, disponível através da Thomson Consumer Electronics, Inc., Indianapolis, Indiana. Um número de caracteristicas especiais ou efeitos especiais são possíveis, sendo os próximos, representativos. 0 efeito especial básico é uma imagem grande, tendo uma imagem pequena sobrepondo uma porção dessa imagem grande, como representado na figura l(c). As imagens grande e pequena podem resultar do mesmo sinal video, de sinais videos diferentes e podem ser trocadas ou mudadas de posição entre si. Falando de um modo geral, o sinal audio é comutado de modo a corresponder sempre à imagem grande. A imagem pequena pode ser movimentada para qualquer posição no écran, ou pode saltar ) por um número de posições predeterminadas. Uma característica da ampliação progressiva, é a de aumentar e diminuir o tamanho da imagem pequena, para, por exemplo, um qualquer número de tamanhos pré-fixados. Numa dada situação, como por exemplo, no formato de visionamento mostrado na figura l(d), temos as imagens pequena e grande com o mesmo tamanho.
Num modo de imagem única, como por exemplo a mostrada nas figuras l(b), l(e) ou l(f), um utilizador pode ampliar progressivamente, no conteúdo da imagem única, por exemplo, em saltos com uma relação de 1,0:1 para 5,0:1. Enquanto que no modo de ampliação progressiva, um utilizador pode procurar ou usar um efeito panorâmico através do conteúdo da imagem, permitindo que a imagem, no écran, se mova através de diferentes áreas da cena. Em
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RCA 86 343 qualquer dos casos, tanto a imagem pequena, como a imagem grande, como a imagem ampliada, podem ser visionadas num quadro em estado estacionário (formato de imagem parada). Esta função permite um formato estroboscópico, onde os últimos nove quadros do video podem ser repetidos no écran. A velocidade de repetição do quadro, pode ser mudada de 30 quadros por segundo, para zero quadros por segundo.
processador de imagem em imagem, usado na televisão de écran largo, de acordo com outra disposição do invento, difere da presente configuração do circuito integrado básico CPIP, descrito acima. Se o circuito integrado básico CPIP, fosse usado com uma televisão com écran 16x9, e sem um circuito de aceleração de video, as imagens inseridas exibiriam distorção do formato de imagem devido à efectiva expansão 4/3 vezes horizontal, resultante da exploração ao longo do écran mais largo 16x9. Os objectos na imagem, ficariam alongados horizontalmente. Se um circuito de aceleração exterior fosse utilizado, não haveria distorção do formato de imagem, mas a imagem não preencheria a totalidade do écran.
Os processadores imagem em imagem existentes, baseados no circuito integrado básico CPIP, que são usados em televisões convencionais, funcionam de uma maneira particular, tendo consequências indesejáveis. 0 sinal video recebido é amostrado por um relógio de 640fH, que é bloqueado por um sinal de sincronismo horizontal da fonte video principal. Noutras palavras, os dados armazenados na RAM video, associada com o circuito integrado CPIP, não são amostrados ortogonalmente, no que diz respeito à fonte auxiliar de video recebida. Isto é uma limitação fundamental no método de sincronismo de quadro do CPIP básico. A natureza não ortogonal da velocidade de amostragem da entrada, resulta em erros de desvio dos dados amostrados. A limitação resulta da utilização da RAM video com o circuito integrado CPIP, que deve usar o mesmo relógio para escrever e ler dados. Quando os dados da RAM video, tal como a RAM video 350, são exibidos, os erros de desvio são vistos como distorção aleatória da imagem, ao longo das margens verticais da imagem e
processador de imagem em imagem 320, de acordo com arranjos do invento e, ao contrário do circuito integrado básico CPIP, está adaptado para compressão assimétrica dos dados video, numa pluralidade de modos de visionamento seleccionáveis. Neste modo de funcionamento, as imagens são comprimidas 4:1 na direcção horizontal e 3:1 na direcção vertical. Este modo assimétrico de compressão produz formatos de imagem distorcidos para armazenamento na RAM video. Os objectos, nas imagens, são apertados horizontalmente. Porém, se estas imagens forem lidas normalmente, como por exemplo no modo de exploração de canal para exibição num écran com relação de formato de visionamento de 16x9, a imagem aparece correctamente. A imagem preenche o écran e não há distorção do formato de imagem. 0 modo de compressão assimétrica, de acordo com características deste invento, torna possível a criação de formatos especiais de visionamento, num écran 16x9, sem circuitos de aceleração exteriores.
Em modos PIP de écran cheio, o processador imagem em imagem, em conjunto com um oscilador de livre funcionamento 348, vai buscar a entrada Y/C de um descodificador, por exemplo, um filtro de pente de linha adaptável, descodifica o sinal em componentes de cor, Y, U e V, e gera impulsos de sincronismo horizontal e vertical. Estes sinais são processados no processador imagem em imagem para os diversos modos de écran cheio, tais como, modo de ampliação progressiva, modo estacionário e modo de exploração de canal. Durante o modo de exploração de canal, por exemplo, o sincronismo horizontal e vertical, presentes pela secção de entrada dos sinais video, terão muitas descontinuidades, porque os sinais amostrados (canais diferentes) terão impulsos de sincronismo não relacionados e serão comutados em momentos semelhantemente aleatórios no tempo. Portanto, o relógio de amostragem (e o relógio de leitura/escrita da RAM video) é determinado pelo oscilador de livre funcionamento. Para os modos estacionário e de ampliação progressiva, o relógio de amostragem será bloqueado através do sincronismo horizontal video recebido, o qual, nestes casos especiais, é o mesmo que para a frequência
-2872 644 RCA 86 343 do relógio de visionamento.
Referindo novamente a figura 4, as saídas Y, U e V, e C_SYNC, (sincronismo composto), do processador imagem em imagem, em forma analógica, podem ser recodifiçados em componentes Y/C, pelo circuito codificador 366, que funciona em conjugação com um oscilador 380, de 3,58 MHz. Este sinal Y/C_PIP_ENC pode ser ligado a um comutador Y/C, que não é mostrado na figura, o que permite aos componentes recodifiçados Y/C, serem substituídos por componentes Y/C do sinal principal. Daqui para a frente, os sinais Y,U,V PIP, codificados e os sinais de sincronismo, seriam a base para sincronização horizontal e vertical no resto do chassis. Este modo de funcionamento é apropriado para a implementação de um modo de ampliação progressiva para o PIP, baseado no funcionamento do interpolador e da FIFO, no trajecto do sinal principal.
Com referência adicional à figura 5, o processador imagem em imagem 320, compreende uma secção de conversão analógica digital 322, uma secção de entrada 324, um comutador rápido FSW e uma secção de controlo de bus 326, uma secção de controlo e sincronismo 328 e uma secção de conversão digital analógica 330. De modo geral, o processador imagem em imagem 320, digitaliza o sinal de video em luminância (Y) e em diferentes sinais de cor (U,V), subamostrando e armazenando os resultados numa RAM video 350, de 1 megabit, como acima descrito. A RAM video 350, associada com o processador imagem em imagem 320, tem uma capacidade de memória de 1 megabit, que não é suficientemente espaçosa para armazenar um campo completo de dados video, com amostras de 8 bits. Capacidade de memória aumentada tende a ser cara e pode necessitar de circuitos de controlo mais complexos. 0 menor número de bits por amostra, no canal auxiliar, representa uma redução na resolução de quantificação, ou na largura de banda, no que diz respeito ao sinal principal, que é inteiramente processado com amostras de 8 bits. Esta redução efectiva da largura de banda, não é, normalmente, um problema quando a imagem auxiliar visionada é relativamente pequena, mas pode causar problemas se a imagem auxiliar visionada for maior, se por
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exemplo, tiver o mesmo tamanho da imagem principal visionada. 0 circuito de processamento de resolução 370, pode implementar selectivamente, um ou mais esquemas para realçar a resolução de quantificação ou a largura de banda efectiva, ou os dados auxiliares de video. Um determinado número de esquemas de redução e recuperação de dados foram criados, incluindo, por exemplo, compressão de pontos de imagem emparelhados, oscilação e não oscilação. Um circuito de não oscilação seria disponível a jusante da RAM video 350, por exemplo, no trajecto do sinal auxiliar da disposição de portas, como abaixo explicado com mais detalhe. Além disso, são contempladas diferentes sequências de oscilação e não oscilação, envolvendo diferentes números de bits e diferentes compressões de pontos de imagem emparelhados envolvendo um diferente número de bits. Um número particular de esquemas de redução e recuperação de dados, pode ser seleccionado pelo WSP μΡ, de modo a maximizar a resolução do visionamento video para cada espécie particular de formato de visionamento da imagem.
Os sinais de luminância e diferença de cor, do sinal auxiliar, são armazenados, com o modelo 8:1:1, Y,U,V de seis bits, numa RAM video 350, que é parte de um processador de imagem em imagem. Noutras palavras, cada componente é quantificado em amostras de seis bits. Existem oito amostras de luminância para cada par de diferentes amostras de cor. Em resumo, o processador imagem em imagem 320, é operado num modo onde os dados video recebidos são amostrados com uma velocidade de relógio de 640fH, bloqueado pelo sinal de sincronismo video auxiliar. Neste modo, os dados armazenados na RAM video 350, são amostrados ortogonalmente. Quando os dados são lidos à saída da RAM video 350 do processador imagem em imagem, são lidos usando o mesmo relógio de 640fH bloqueado pelo sinal auxiliar de video recebido. Porém, embora estes dados sejam amostrados e armazenados ortogonalmente, e possam ser lidos à saída ortogonalmente, não podem ser enviados direetamente da RAM video 350, para visionamento ortogonal, visto que as fontes de video auxiliares e principais são de natureza assíncrona. As fontes de video auxiliares e principais só podem ser síncronas no caso de serem
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sinais de visionamento resultantes da mesma fonte video.
Os trajectos do sinal principal 304, do sinal auxiliar 306 e do sinal de saída 312, da disposição de portas 300, são mostrados no diagrama de blocos da figura 6. A disposição de portas, também inclui um circuito de relógio/sincronismo 320, e um descodif icador do WSP μΡ 310. As linhas de saída de dados e de endereços do descodificador WSP μΡ 310, identificadas como WSP DATA, são fornecidas para cada um dos circuitos e trajectos principais acima identificados, assim como, para o processador imagem em imagem 320, e para o circuito de processamento de * resolução 370. Será bom, que se alguns circuitos fizerem, ou * não, parte da disposição de portas, tal se deva, na maior parte dos casos, a razões de conveniência, para que seja mais fácil explicar os arranjos do invento.
A disposição de portas é responsável pelo aumento, compressão e corte dos dados video do canal video principal, quando e se necessário, para implementar diferentes formatos de visionamento de imagem. O componente de luminância Y_MN é armazenado numa memória de linha primeiro a entrar, primeiro a sair (FIFO) 356, durante um período de tempo que depende da natureza da interpolação do componente de luminância. Os componentes combinados de crominância U/V_MN são armazenados na ) FIFO 358. Os componentes de luminância e crominância do sinal auxiliar Y_PIP U_PIP e V_PIP, são criados pelo desmultiplexador 355. O componente de luminância sofre um processamento de resolução, como desejado, no circuito 357 e é aumentado tanto quanto o necessário pelo interpolador 359 criando um sinal de saída Y_AUX.
Nalguns casos, o sinal auxiliar do visionamento será tão grande quanto o sinal principal do visionamento, como representado na figura l(d). As limitações de memória associadas com o processador imagem em imagem e com a RAM video 350, não conseguem arranjar um número suficiente de pontos de dados, ou pontos de imagem, de modo a preencher uma tão grande área de visionamento. Nestas circunstâncias, o circuito de processamento
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RCA 86 343 de resolução 357, pode ser usado para recuperar pontos de imagem para o sinal video auxiliar, para substituir os que foram perdidos durante a compressão ou redução de dados. 0 processamento de resolução pode corresponder ao processamento de resolução levado a cabo pelo circuito 370 representado na figura 4. Como exemplo, o circuito 370, pode ser um circuito de oscilação e o circuito 357 um circuito sem oscilação.
Com referência adicional à figura 12, os dados de entrada video auxiliares são amostrados a uma frequência de 240fjj e armazenados na RAM video 350. Os dados auxiliares são lidos na RAM video 350 são designados por VRAM__OUT. 0 circuito PIP 301 tem também a capacidade de reduzir a imagem auxiliar por factores interior iguais horizontal e verticalmente, bem como assimetricamente. Os dados de canal auxiliar são separados e sincronizados para o video digital de canal principal por trincos de 4 bits 352A e 352B, pela FIFO auxiliar 354, pelo circuito de temporização 369 e pelo circuito de sincronização 368. Os dados VRAM_OUT são dispostos em Y(luminância) U, V, (componentes de cor), e FSW_DAT (dados de comutação rápida pelo desmultiplexador 355. 0 FXW_DAT indica que o tipo de campo foi escrito na RAM video. 0 sinal PIP_FSW é recebido directamente do circuito PIP e aplicado ao circuito de controlo de saída 321 para determinar qual o campo lido da RAM video que é para ser visionado durante os modos de imagem pequena.
O canal auxiliar é amostrado à velocidade de 640fH, enquanto que o canal principal é amostrado à velocidade de 1024fH. 0 canal auxiliar FIFO 354, converte os dados recebidos à velocidade de amostragem do canal auxiliar, para a velocidade de relógio do canal principal. Neste processo, o sinal video sofre uma compressão de 8/5 (1024/640). Isto é mais que a compressão de 4/3 necessária para a exibição correcta do sinal do canal auxiliar. Portanto, o canal auxiliar deve ser aumentado pelo interpolador 359, para que a exibição duma imagem pequena em 4x3 seja correcto. 0 interpolador 359 é controlado pelo circuito de controlo do interpolador 371, o qual, por sua vez, funciona em ligação com o WSP μΡ 340 . A quantidade de expansão do
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-32interpolador, requerida, é de 5/6. O factor de expansão X é determinado da seguinte maneira:
X = ( 640/1024 ) * ( 4/3 ) = 5/6
Os componentes de crominância U_PIP e VPIP, são atrasados pelo circuito 367, por um período de tempo dependente da natureza da interpolação do componente de luminância, gerando sinais de saída U_AUX e V_AUX. Os respectivos componentes Y, U e V dos sinais principal e auxiliar são combinados nos respectivos multiplexadores 315, 317 e 319 no trajecto do sinal de saída 312, . através do controlo dos sinais de permissão de leitura provenientes das FIFO 354, 356 e 358. Os multiplexadores 315, 317 e 319 funcionam em ligação com o circuito de controlo de saída dos multiplexadores 321. O circuito de controlo de saída dos multiplexadores 321, funciona em ligação com um sinal de relógio, um sinal de início de linha, um sinal de contador de linha horizontal, o sinal de reposição do bloqueio vertical e com a saída do comutador rápido do processador imagem em imagem e do WSP μΡ 340. Os componentes de luminância e de crominância, multiplexados, Y_MX, U_MX e V_MX, são fornecidos aos respectivos conversores digitais analógicos 360, 362 e 364, respectivamente. Os conversores analógicos digitais são seguidos por filtros de baixa frequência 341, 343 e 345 respectivamente, representados na
I figura 4. As diversas funções do processador imagem em imagem, da disposição de portas e do circuito de redução de dados, são controlados pelo WSP μΡ 340. O WSP μΡ 340, funciona em ligação com o TV μΡ 216, sendo ligado através de um bus em série. 0 bus em série pode ser um bus de quatro fios, como mostrado, tendo linhas para dados, sinais de relógio, sinais de permissão e sinais de reposição. 0 WSP μΡ 340, comunica com os diferentes circuitos da disposição de portas através do descodificador WSP^P 310.
Num caso, é necessário comprimir o video 4x3 NTSC com um factor de 4/3, para evitar distorção do formato de imagem da imagem exibida. Noutro caso, o video pode ser expandido de modo a realizar operações de ampliação horizontal, normalmente
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-33acompanhados por ampliação vertical. Operações de ampliação horizontal até 33%, podem ser conseguidas reduzindo as compressões para menos de 4/3. Um interpolador de amostragem é utilizado para recalcular o video recebido, para novas posições dos pontos de imagem, porque a largura de banda da luminância video, até 5.5 MHz para o formato S-VHS, ocupa uma grande percentagem da frequência de distorção de imagem de Nyquist, que é de 8 MHz para um relógio de 1024 fH‘
Como representado na figura 6, os dados de luminância Y_MN são dirigidos através de um interpolador 337, no trajecto do sinal principal 304, que recalcula valores de amostragem baseado na compressão ou expansão do video. A função dos comutadores ou selectores de trajecto, 323 e 331, é de inverter a topologia do trajecto do sinal principal 304 no que diz respeito às posições relativas da FIFO 356, e do interpolador 337. Em particular, estes comutadores seleccionam se o interpolador 337 precede a FIFO 356, como requerido para compressão da imagem, ou se a FIFO 356 precede o interpolador 337, como requerido para expansão da imagem. Os comutadores 323 e 331, funcionam em ligação com um circuito de controlo de trajecto 335, que por sua vez funciona em ligação com o WSP μΡ 340. Será lembrado que o sinal auxiliar de video é comprimido para armazenamento na RAM video 350, e só a expansão é necessária para fins práticos. Em conformidade, não são requeridos comutadores com funções semelhantes no trajecto do sinal auxiliar.
De maneira a implementar compressões video, através da utilização de uma FIFO, por exemplo, cada quarta amostra pode ser inibida de ser escrita na FIFO 356. Isto constitui uma compressão 4/3. É função do interpolador 337, o recálculo das amostras de luminância a serem escritas na FIFO, de modo a que a leitura de dados à saída da FIFO seja uniforme em vez de irregular. As expansões podem ser realizadas, exactamente da maneira oposta das compressões. No caso das compressões, o sinal de permissão de escrita, tem informação para o relógio de selecção de sinais a ele ligado, em forma de impulsos de inibição. Para expansão de dados, a informação para o relógio de selecção de sinais é
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aplicada ao sinal de permissão de leitura. Isto vai suspender os dados enquanto estiverem a ser lidos da FIFO 356. Neste caso, a função do interpolador 337, que vem a seguir à FIFO 356, durante este processo, é de recalcular os dados amostrados, de irregulares para uniformes. No caso da expansão, os dados devem ser suspensos, enquanto forem lidos da FIFO 356, e enquanto forem cronometrados para o interpolador 337. Isto é diferente do caso em que há compressão, onde os dados são continuamente cronometrados através do interpolador 337. Para ambos os casos, compressão e expansão, as operações da selecção de sinais pelo relógio, podem ser executadas facilmente dum modo síncrono, isto é, os acontecimentos podem ocorrer baseados nas margens ascendentes do relógio do dispositivo 1024 fH.
A interpolação do sinal auxiliar acontece no trajecto do sinal auxiliar 306. o circuito PIP 301, manipula uma memória de quadro Y,U,V, 8:1:1, com 6 bits, RAM video 350, para armazenar dados video recebidos. A RAM video 350, guarda dois quadros de dados video numa diversidade de posições de memória. Cada posição de memória guarda oito bits de dados. Em cada posição de 8 bits, há uma amostra de Y (luminância) com 6 bits (amostrada a 640fH) e 2 outros bits. Estes dois outros bits, guardam os dados do comutador rápido, ou uma parte da amostra U ou V (amostrada a 80fH). Os valores de dados do comutador rápido indicam que tipo de quadro foi introduzido na RAM video. Uma vez que há dois quadros com dados armazenados na RAM video 350, e toda a RAM video 350 é lida durante o período de visionamento, ambos os quadros são lidos durante a exploração do visor. 0 circuito PIP 301, vai determinar qual o quadro que vai ser lido da memória, para ser visionado, através da utilização dos dados do comutador rápido. 0 circuito PIP, lê sempre o tipo de quadro oposto ao que está a ser escrito, para ultrapassar um problema de interrupção de movimento. Se o tipo de quadro que está a ser lido é o tipo oposto do quadro que está a ser exibido, então o quadro par, armazenado na RAM video 350, é invertido, apagando a linha de cima do quadro, quando o quadro estiver a ser lido da memória. 0 resultado é que a imagem pequena mantém um entrelaçamento correcto sem interrupção de movimento.
-3572 644
RCA 86 343 circuito de relógio/sincronismo 320, gera sinais de leitura, de escrita e de permissão, necessários para operar as FIFO 354, 356 e 358. As FIFO para os canais principal e auxiliar têm permissão para escrever dados para armazenamento, para aquelas porções de cada linha video, que é requerida para subsequente visionamento. Os dados são escritos ou do canal principal ou do auxiliar, mas não de ambos, como seja necessário, de modo a combinar os dados de cada fonte na mesma linha ou linhas video do visor. A FIFO 354, do canal auxiliar é escrita sincronizadamente com o sinal auxiliar de video, mas é lido à saída da memória, sincronizadamente com o sinal principal de video. Os componentes do sinal principal de video são lidos para a FIFO 356 e 358, sincronizadamente com o sinal principal de video e são lidos à saída da memória, sincronizadamente com o video principal. Quantas vezes a função de leitura é ligada para trás e para a frente entre os canais principal e auxiliar é uma função do efeito especial particular que for escolhido.
A geração de diferentes efeitos especiais tais como imagens cortadas de lado a lado, é conseguida através da manipulação dos sinais de controlo de permissão de leitura e escrita para a memória de linha FIFO 0 processo para este formato de visionamento está representado nas figuras 7 e 8. No caso da exibição de imagens cortadas lado a lado, o sinal de controlo de permissão de escrita (WR_EN_AX) para a FIFO 354, 2048x8, do canal auxiliar está activo para (1/2)x(5/12) = 5/12 ou, aproximadamente 41% do período de visionamento da linha útil (pós-aceleração), ou 67% do período de linha útil do canal auxiliar (pré-aceleração), como representado na figura 7. Isto corresponde a, aproximadamente, 33% de corte (aproximadamente 67% de imagem útil) e a uma expansão de sinal do interpolador de 5/6. No canal video principal, representado na parte superior da figura 8, o sinal de controlo de permissão de escrita (WR_EN_MN_Y), para a FIFO 356 e 358 910x8, está activo para (l/2)x(4/3) = 0,67 ou 67% do período de visionamento da linha útil. Isto corresponde a, aproximadamente, 33% de corte e uma relação de compressão de 4/3 a ser executada no canal video principal pelas FIFO 910x8.
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Em cada uma das FIFO, os dados video £ac£ar^zÕnados temporariamente de modo a serem lidos num determinado ponto, particular, no tempo. A região activa do tempo, onde os dados podem ser lidos à saída de cada FIFO, é determinada pelo formato de visionamento escolhido. No exemplo representado, do modo cortado lado a lado, o canal principal de video é exibido na metade esquerda do visor, e o canal auxiliar de video é exibido na metade direita do visor. As porções arbitrárias das formas de onda do video são diferentes, como representado, para os canais principal e auxiliar. 0 sinal de controlo de permissão de leitura (RD_EN_MN) das FIFO 910x8 do canal principal está activo para 50% do período de visionamento da linha útil, do visor, começando com o início do video activo seguindo imediatamente a entrada posterior de video. O sinal de controlo de permissão de leitura, do canal auxiliar (RDEN ΑΧ), está activo para os outros 50% do período de visionamento da linha útil, começando com a margem descendente do sinal RD_EN_MN e acabando com o início da entrada dianteira do canal principal de video. Pode ser constatado que os sinais de controlo de permissão de escrita, estão sincronizados com os seus respectivos dados de entrada FIFO (principal ou auxiliar), enquanto que os sinais de controlo de permissão de leitura estão sincronizados com o canal principal de video.
formato de visionamento representado na figura l(d) é particularmente desejado, uma vez que permite às duas imagens que preenchem quase completamente o visor, a exibição num formato lado a lado. 0 visionamento é particularmente eficaz e apropriado para um visor com relação larga de formato de visionamento, por exemplo em 16x9. A maioria dos sinais NTSC, são representados com um formato 4x3, o que, claro, corresponde a 12x9. Duas imagens NTSC com relação de formato de visionamento de 4x3, podem ser apresentadas no mesmo visor com relação de formato de visionamento de 16x9, ou cortando as imagens em 33% ou comprimindo as imagens em 33% e introduzindo distorção do formato de imagem. Dependendo da preferência do utilizador, a relação corte de imagem distorção do formato de imagem, pode ser ajustada algures entre os limites de 0% e de 33%. Como exemplo, duas imagens lado a lado podem ser apresentadas com 16,7% de
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compressão e 16,7% de corte.
tempo de visionamento horizontal para um visor com relação de formato de visionamento de 16x9 é o mesmo que para um visor com relação de formato de visionamento de 4x3, porque ambos têm uma duração nominal de linha de 62,5 microssegundo. Em conformidade, um sinal de video NTSC deve ser acelerado com ^m factor de 4/3, de modo a preservar um formato de imagem correcto, sem distorção. 0 factor 4/3 é calculado como uma divisão de dois formatos de visionamento:
4/3 = (16/9)/(4/3)
Interpoladores variáveis são utilizados, de acordo com as características deste invento, para acelerar os sinais video. No passado, as FIFO com diferentes velocidades de relógio nas entradas e saídas, foram usadas para executar funções semelhantes. Usando termos de comparação, se dois sinais NTSC com relação de formato de visionamento 4x3, forem exibidos num único visor com relação de formato de visionamento 4x3, cada imagem deve ser distorcida ou cortada, ou alguma combinação entre estas, em 50%. Uma aceleração comparável a essa, necessária para uma aplicação em écran largo, é desnecessária.
Geralmente, o sistema de visionamento e deflexão de video está sincronizado com o sinal principal de video. 0 sinal principal de video deve ser acelerado, como explicado acima, para encher o visor de écran largo. 0 sinal auxiliar de video deve ser sincronizado verticalmente com o primeiro sinal video e com o visor video. O sinal auxiliar de video pode ser atrasado numa fracção de um período do quadro numa memória de quadro, e depois expandido numa memória de linha. 0 sincronismo dos dados auxiliares de video com os dados principais do video é conseguida, utilizando a RAM video 350 como memória de quadro e um aparelho, primeiro a entrar primeiro a sair (FIFO), de memória de linha 354, para expandir o sinal.
A natureza assíncrona dos relógios de leitura e escrita,
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porém, requer que certos passos sejam dados para evitar colisões dos ponteiros de leitura/escrita. Colisões de ponteiros de leitura/escrita ocorrem quando os dados velhos são lidos à saída da FIFO antes dos dados novos terem uma oportunidade de serem escritos na FIFO. A dimensão do FIFO está relacionada com a mínima capacidade de armazenamento da linha que se julga razoavelmente necessária para evitar colisões dos ponteiros de leitura/escrita. Um dispositivo de sincronização de campo, para evitar as colisões de ponteiro de leitura/escrita e manter a integridade de entrelaçamento, é explicado mais completamente em ligação com as figuras 12-20.
processador imagem em imagem funciona de maneira que os dados auxiliares do video são amostrados com um relógio 640fH bloqueado pelo componente de sincronismo horizontal do sinal auxiliar de video recebido. Esta operação permite aos dados ortogonalmente amostrados, o armazenamento na RAM video 350. Os dados devem ser lidos à saída da RAM video 350, à mesma velocidade de 640fH. Os dados não podem ser exibidos ortogonalmente da RAM video, sem a modificação devida à natureza geralmente assíncrona das fontes video principal e auxiliar. De modo a facilitar o sincronismo entre o sinal auxiliar e o sinal principal, uma memória de linha, com relógios de acesso de leitura e escrita, independentes, é disposta no trajecto do sinal auxiliar, depois da saída da RAM video 350.
Mais em particular, como representado na figura 4, a saída da RAM video 350, é uma entrada para o primeiro de dois trincos de 4 bits, 352A e 352B. A saída VRAM_0UT é em blocos de dados de 4 bits. Os trincos de 4 bits são utilizados para recombinar o sinal auxiliar de volta aos blocos de dados de 8 bits. Os trincos também reduzem a velocidade do relógio de dados de 1280fH para 640fjj. Os blocos de dados de 8 bits são escritos para a FIFO 354, pelo mesmo relógio 640fH, usado para amostrar os dados auxiliares de video, para armazenamento na RAM video 350. A dimensão da FIFO 354 é 2048x8. Os blocos de dados de 8 bits são lidos à saída da FIFO 354, pelo relógio de visionamento 1024fH, que é bloqueado pelo componente de sincronismo horizontal do sinal video
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-39principal. Esta configuração básica, que usa uma memória múltipla de linha com relógios de acesso de leitura e escrita independentes, permite que os dados que foram amostrados ortogonalmente, sejam exibidos ortogonalmente. Os blocos de dados de 8 bits são divididos em diferentes amostras de 6 bits de luminância e de cor, pelo desmultiplexador 355. As amostras de dados, podem então ser interpoladas quantas vezes for necessário para obter a desejada relação de formato de visionamento e para serem escritas como dados de saída do video.
Uma memória suficientemente grande deve ser escolhida no primeiro caso para evitar colisão de ponteiro de leitura/escrita na FIFO de canal auxiliar. Para visionamento video de relação de visionamento de formato normal cortado por 33%, a FIFO auxiliar, que tem a dimensão 2048x8, é capaz de armazenar 5,9 linhas de dados video calculado como se segue, onde N é o número de vezes e L é o comprimento de cada linha:
N = (2/3) * (0,82) * (640) = 350 com base no período de linha activo de 82%
L = 2048/350 = 5,9
Um aspecto do invento reconhece que velocidades de precessão maiores do que duas linhas/campo não são provavelmente encontradas. Consequentemente, um critério de projecto de uma FIFO de cinco linhas para o canal auxiliar pode ser suficiente para evitar colisões de ponteiro de leitura/escrita.
A utilização de memória da FIFO de canal auxiliar pode ser mapeada como mostrado na figura 13. Um diagrama de blocos para um circuito simplificado formado por biestáveis tipo D para gerarem atrasos de linha (Z_l) e impulsos de reposição para controlo da escrita e da leitura na FIFO 354 no trajeeto de sinal auxiliar, está mostrado na figura 14. No início de um campo de sinal principal novo, o ponteiro de escrita é reposto para o inicio da FIFO. Este impulso de reposição indicado por WR_RST_AX_ é a combinação do V_SYNC_MN amostrado por H_SYNC_AX. Por outras
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-40palavras, WR_RST_AX ocorre no primeiro impulso de sincronização horizontal do sinal video auxiliar que ocorre após um impulso de sincronização vertical do sinal principal. Duas linhas horizontais de sinal principal mais tarde, o ponteiro de leitura é reposto no inicio da FIFO 354. Este impulso de reposição está indicado por RDRSTAX. Por outras palavras, o RD_RST_AX ocorre no terceiro impulso de sincronização horizontal do sinal video principal que ocorre após o impulso de sincronização vertical do sinal principal ou iniciado ainda de outro modo, no segundo impulso de sincronização horizontal do sinal principal que ocorre após o impulso de WR_RST_AX.
Uma vez que os sinais principal e auxiliar são assíncronos existe alguma ambiguidade acerca da exactidão onde o ponteiro de escrita está quando o ponteiro de leitura é reposto, é conhecido que o ponteiro de escrita conduz o ponteiro de leitura por, pelo menos duas linhas. No entanto, se a frequência do sincronismo horizontal de canal auxiliar é mais alta do que a frequência do sincronismo horizontal de canal principal, então o ponteiro de escrita terá avançado para além da marcador de duas linhas mostrado, é desta maneira que uma colisão de ponteiro é evitada para dois sinais com menos do que a frequência de precessão de duas linhas/campo. A FIFO de canal auxiliar 354 é dividida em cinco peças de linha através de sinais de reposição de leitura e escrita apropriadamente temporizados. Neste esquema, os ponteiros de leitura e escrita são iniciados no começo de cada campo de visionamento, pelo menos, duas linhas afastados entre si.
Se a FIFO não tivesse um comprimento de cinco linhas completas, o dispositivo sacrificaria a distância de memória desde o ponteiro de escrita até ao ponteiro de leitura. Isto é o caso dos diferentes modos de compressão, por exemplo um compressão de 16%:
16% de compressão
N = (5/6) * (0,82) * 640 = 437
L = 2048(5
437) = 4,7
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Nestes casos comprimento. reflecte uma factor (0,8) na equação de N da compressão de 335 limitação operacional da pastilha CPIP.
Uma vez que as reposições de leitura e escrita da FIFO estão espaçadas por um mínimo de duas linhas de video activo, o sacrifício vem sempre á custa de permitir o ponteiro de leitura alcançar o ponteiro de escrita. Além disso apenas 805 da linha video é considerada activa porque o processador de imagem em imagem não é capar de armazenar mais do que 512 amostras video na RAM video 350. Na prática isto proporciona ainda uma linha video activa boa. Nestas casos, a frequência de precessão vai ser sacrificada para o conteúdo de imagem mais visível. Adicionalmente, existe mais distorção no video auxiliar. No pior dos casos, até uma linha por campo de precessão pode ser tolerada entre as fontes principal e auxiliar. Isto é ainda mais do que é necessário para a maioria das fontes video, e a tolerância de frequência de precessão é sacrificada para os modos característicos que podem ser esperados serem utilizados por último.
Um outro problema que se destaca da leitura e escrita assíncrona da FIFO é manutenção da integridade de entrelaçamento do video de canal auxiliar. Uma vez que o visor é bloqueado para o video de canal principal, o tipo de campo corrente a ser visionado, que é o campo superior ou inferior será determinado pelo sinal principal. 0 tipo de campo que é armazenado na RAM video 350 e pronto para ser lido no inicio do campo de canal principal pode ou não ser o mesmo que o tipo de campo visionado. Pode ser necessário mudar o tipo de campo auxiliar armazenado na RAM video 350 para alinhar com o do visor de canal principal.
processador de imagem em imagem, 320 e a disposição de portas 300 quantificam 262,5 campos de linha do sinal NTSC em 263 campos de linha superiores (algumas vezes referidos como campos ímpares) e 262 campos de linha inferiores (algumas vezes chamados campos pares). Isto é devido ao facto que o sincronismo vertical é amostrado com impulsos representando o sincronismo vertical.
Isto está representado pelo diagrama da figura 15. o indicador de tipo de campo superior/inferior tem um valor 1 para campos superiores e um valor 0 para campos inferiores. Os campos superiores incluem linhas ímpares de 1 a 263. Os campos inferiores incluem linhas pares de 2 a 262. Na figura 16, o indicador de tipo de campo U/L MAIN SIGNAL representa o tipo de campo do canal video principal O sinal HSYNCAX representa os sinais de sincronismo horizontais para cada linha do canal auxiliar.
O indicador de tipo de campo U/L(A) representa o tipo de campo armazenado na RAM video 350 se cada linha de canal auxiliar fosse escrita em normalmente. O termo normal é utilizado aqui para indicar que as linhas ímpares 1_263 são escritas na RAM video 350 quando o campo superior está ser recebido e descodificado. O indicador de tipo de campo U/L(B) representa o tipo de campo armazenado na RAM video 350, se a primeira linha do campo superior não fosse escrita na RAM video 350 durante a recepção de um campo superior. Em vez disso a primeira linha é efectivamente tomada á última linha (número 262) do campo inferior. Isto inverte efectivamente o tipo de campo uma vez que a linha 2 será a primeira linha visionada e a linha 3 será a segunda linha visionada no quadro. 0 campo superior recebido torna-se agora o campo inferior e vice-versa. 0 indicador de tipo de campo U/L (C) representa o tipo de campo armazenado na RAM video 350 se a última linha do campo superior é adicionada à RAM video 350 durante a recepção do campo inferior. Isto inverte efectivamente o tipo de campo uma vez que a linha 263 será a primeira linha visionada e a linha 1 será a segunda linha visionada.
A adição e subtracção de linhas nos modos B e C não degrada a imagem de canal auxiliar, porque estas linhas ocorrem durante o retorno vertical ou sobrexploração. A ordem das linhas visionadas está mostrada na figura 18, onde as linhas a cheio representam linhas de campo superior e as linhas a ponteado representam as linhas de campo inferior.
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A medida que sinais de canal principal e auxiliar precessam, o U/LMAIN SIGNAL deslocar-se-á para a esquerda ou para a direita em relação aos indicadores de tipo de campo U/L (A, B, C) de canal auxiliar. Na posição mostrada no diagrama, devem ser escritos dados na RAM video 350 utilizando o modo A, porque o bordo de decisão está na zona A. 0 modo a é apropriado porque quando o processador de imagem em imagem recebe sincronismo vertical, o mesmo escreverá o mesmo tipo de campo na RAM video 350 como será requerido pelo visor para ler desde a RAM video 350 começando com o V_SYNC_MN (sincronismo vertical de canal principal). Como os sinais precessão o modo mudará de acordo com as suas posições relativas. Os modos válidos estão mostrados graficamente no topo da figura 16 e na tabela da figura 17. Existe uma sobreposição entre os modos B e C, uma vez que a maioria do tempo que o modo B é válido, o modo C é também válido e vice-versa. Isto é verdadeiro para todas excepto duas linhas fora das 262 linhas. Pode ser utilizado qualquer dos modos B ou C quando ambos são válidos.
Está mostrado na figura 20 um diagrama de blocos de um circuito 700 para manter a integridade de entrelaçamento de acordo com o arranjo do invento. Os sinais de saída do circuito 700 são sinais de controlo de reposição de escrita e leitura para a RAM video 350, para a FIFO 354 no trajecto de sinal auxiliar e para a FIFO 356 no trajecto de sinal principal como mostrado na figura 12. 0 tipo de campo do sinal video principal é determinado a partir de um par de sinais, VSYNC_MN e HSYNC_MN. O tipo de campo do sinal video auxiliar é determinado a partir de um par correspondente de sinais, VSYNC_AX_HS e NC_AX. Cada par de sinais tem uma relação de face predeterminada, que é posta na disposição de portas. Esta relação está mostrada nas figuras 19(a) - 19(c), que se aplicam a ambos os pares de sinais. Em cada caso, HSYNC é uma onda quadrada, cujo bordo elevado corresponde ao início da linha horizontal do respectivo sinal. Em cada caso, VSYNC tem apenas um bordo elevado por campo que corresponde ao inicio de um campo vertical do respectivo sinal. A relação entre os bordos elevados dos respectivos pares de sinais é testado pelo circuito 700 para determinar quais os passos, se existirem que são
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-44necessários para alinharem o tipo de campo do sinal auxiliar com o tipo de campo do sinal principal. Para evitar ambiguidade, os bordos dianteiros do par principal de sinais nunca estão mais próximos de que 1/8 de um período de linha horizontal. Os bordos dianteiros do par de sinais auxiliares nunca estão mais próximos do que 1/10 de um período de linha horizontal. Isto evita a instabilidade dos bordos dianteiros em relação um ao outro. Esta relação é assegurada pelos circuitos de temporização da disposição de portas.
par dos sinais principais VSYNC_MN e HSYNC_MN são entradas para um primeiro circuito de tipo de campo 702, que compreende dois biestáveis tipo T. Num caso, HSYNC_MN é amostrado por VSYNC__MN, isto é, VSYNC_MN é a entrada de relógio. A saída deste biestável é um indicador de campo superior/inferior UL_MN para o sinal principal que pode ser um lógico Hl para um tipo de campo superior e um lógico LO para um tipo de campo inferior apesar de isto ser arbitrário. No outro caso VSYNC_MN é amostrado por HSYNC_MN precisamente como no biestável 252 explicado em ligação com a figura 14. Isto proporciona uma saída VH, que é sincronizada verticalmente com a horizontal.
O par dos sinais auxiliar SYNC_AX e HSYNC_AX são entradas para um primeiro circuito de tipo de campo 710 que compreende também dois biestáveis tipo D. Num caso HSYNC_AX é amostrado por VSYNC_AX isto é VSYNC_AX é a entrada de relógio. A saída deste biestável é o indicador de campo superior/inferior ULAX para o sinal auxiliar, que pode ser um lógico Hl para um tipo de campo superior e um lógico LO para um tipo de campo inferior, apesar disto ser arbitrário. No outro caso, VSYNC_AX é amostrado por HSYNC_AX precisamente como no biestável 852 explicado em ligação com a figura 14. Isto proporciona uma saída VH que é sincronizada verticalmente com a horizontal.
A determinação de tipo de campo para ambos os sinais está mostrada na figura 19 (a) -19(c). Se o inicio elevado do bordo de campo ocorre na primeira metade de período de linha horizontal, como na figura 19(b), o campo é um tipo de campo inferior. Se o
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45início elevado do bordo de campo ocorre na segunda metade no período de linha horizontal, como na figura 19(c), o campo é um tipo de campo superior.
VH para o sinal principal e o HSYNC_MN são entradas para circuitos de atraso 704, 706 e 708, que proporcionam atrasos de período de linha horizontais para assegurarem a relação de fase apropriada dos sinais de saída WR_RST_FIFO_MN, RD_RST_FIFO_MN e RD_RST_FIFO_AX. 0 atraso de operação que pode ser implementado pelos biestáveis tipo D é similar ao circuito mostrado na figura 14. Dois a três período de linha horizontal de atraso são proporcionados entre os ponteiros de escrita e leitura.
indicador de tipo de campo superior/inferior UL_MN corresponde ao U/L MAIN SIGNAL mostrado no topo da figura 16 e é uma entrada para um comparador UL_SEL 714. As outras entradas para o comparador 714 são fornecidas pelo gerador de teste UL_AX 712. O gerador de teste 712 tem o indicador de campo ULAX como uma entrada bem, como o HSYNC_AX como uma entrada de relógio. 0 gerador de teste 712 proporciona sinais U/L (A), U/L (B), e U/L (C) mostrados no fundo da figura 16, correspondendo aos três modos possíveis A, B e C. Cada um dos sinais U/L (A), U/L (B) e U/L (C) é comparado com o L_MN, no instante do bordo de decisão de U/L_MN, também mostrado na figura 16. Se UL_MN se alinha com U/L(A), os tipos de campos alinham-se e não é necessária a acção para manter a integridade de entrelaçamento. Se UL_MN se alinha com U/L(B), os tipos de campos não se alinham. É necessário atrasar a escrita do campo superior de uma linha para manter a integridade de entrelaçamento. Se UL_MN coincide com U/L(C), os tipos de campo não coincidem. É necessário avançar a escrita do campo inferior de uma linha para manter a integridade de entrelaçamento.
Os resultados desta comparação uma entrada para o circuito selector RST_AX_SEL 718. As outras entradas são os três sinais de sincronização vertical RST_A_, RST_B e RST_C gerados pelo gerador RST_AX_GEN 716. Os três sinais de sincronização verticais RST_A, RSTB e RST_C têm fases diferentes relativamente uns aos outros,
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-46J para implementarem a acção correctiva ou a acção não correctiva ou para manterem a integridade de entrelaçamento de acordo com a saída do comparador 714. 0 circuito de retardo 722 sincroniza de novo o sinal de sincronização vertical seleccionado com a entrada video auxiliar para gerar WR_RST_VRAM_AX. 0 circuito de atraso 720 executa uma função similar para gerar RD_RST_VRAM_AX e WR_RST_FIFO_AX. Como se vê na figura 16, os modos B e C sobrepõem-se a maioria do tampo. De facto, apenas duas comparações fora de 525 comparações requererão apenas um dos modos B ou C em vez de ambos. O comparador 714 pode ser disposto para favorecer o modo C sobre o modo B quando ambos os modos são κ válidos. Esta escolha pode ser arbitrária ou baseada noutras considerações de circuito.
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Claims (24)

1 - Dispositivo de sincronização, caracterizado por compreender :
primeiros e segundos meios de detecção de tipo de campo para primeiro e segundo sinais video, respectivamente, tendo cada um deles uma saída, indicando se o dito respectivo sinal video tem um primeiro ou um segundo tipo de campo;
meios para sincronizarem o dito segundo sinal video com o dito primeiro sinal video para um visor combinado; e meios para alterarem o dito tipo de campo do dito segundo sinal video, quando necessário para fazer coincidir o dito campo do dito primeiro sinal video, para manter a integridade entrelaçada no dito visor combinado.
2 - Dispositivo de acordo com a reivindicação 1, caracterizado por os ditos meios de alteração controlarem os ditos meios de sincronização.
3 - Dispositivo de acordo com a reivindicação 1, caracterizado por os ditos meios de sincronização compreenderem meios para armazenarem o dito segundo sinal video, sendo o dito segundo sinal video escrito nos ditos meios de armazenagem e sendo lidos dos ditos meios de armazenagem, de uma maneira que sincroniza o dito segundo sinal video com o dito primeiro sinal video.
4 - Dispositivo de acordo com a reivindicação 3, caracterizado por o dito segundo sinal video ser escrito nos ditos meios de armazenagem sincronamente com o dito segundo sinal video, e ser lido dos meios de armazenagem sincronamente com o dito primeiro sinal video.
5 - Dispositivo de acordo com a reivindicação 1, caracterizado por os ditos meios de sincronização compreenderem:
uma memória de campo síncrona, tendo acessos de escrita e leitura operáveis sincronamente com o dito segundo sinal video; e uma memória de linha múltipla assíncrona para leitura de dados da dita memória de campo, tendo um acesso de escrita operável sincronamente com o dito segundo sinal video e um acesso de leitura operável sincronamente com o dito primeiro sinal video.
6 - Dispositivo de acordo com a reivindicação 3, caracterizado por os ditos meios de operação controlarem a dita escrita nos ditos meios de armazenagem.
7 - Dispositivo de acordo com a reivindicação 1, caracterizado por os ditos meios de alteração terem um modo de operação que retarda os campos de escrita do dito primeiro tipo de campo de um período de linha horizontal.
8 - Dispositivo de acordo com a reivindicação 1, caracterizado por os ditos meios de alteração terem um modo de operação que avança os campos de escrita do dito segundo tipo de campo de um período de linha horizontal.
9 - Dispositivo de acordo com a reivindicação 1, caracterizado por os ditos meios de alteração terem um primeiro modo de alteração que retarda a escrita num campo corrente do dito primeiro tipo de campo de um período de linha horizontal, um segundo modo de operação que avança a escrita num campo corrente do dito segundo tipo de campo por um período de linha horizontal e um terceiro modo de operação que mantém um tipo de campo corrente.
10 - Dispositivo de acordo com a reivindicação 1, caracterizado por os ditos meios de alteração compreenderem meios para compararem o dito tipo de campo do dito segundo sinal com o dito tipo de campo do dito primeiro sinal e gerarem um sinal de saída indicando uma de uma pluralidade de saídas de comparação.
11 - Dispositivo de acordo com a reivindicação 10, caracterí72 644
RCA 86 343 o compreendezado por a dita pluralidade de saídas de comp rem:
os ditos primeiro e segundo sinais video, tendo campos correntes do mesmo tipo de campo;
o dito primeiro sinal video, tendo um campo corrente do dito primeiro tipo de campo e o segundo sinal video, tendo um campo corrente do dito segundo tipo de campo.
o dito primeiro sinal video, tendo um campo corrente do dito segundo tipo de campo e o dito segundo sinal video, tendo um campo corrente do dito primeiro tipo de campo.
12 - Dispositivo de acordo com a reivindicação 10, caracterizado por os ditos meios de alteração compreenderem meios para gerarem uma pluralidade de sinais de correcção de entrelaçamento seleccionáveis, sendo cada um deles apropriado para uma da dita pluralidade de saídas de comparação.
13 - Dispositivo de acordo com a reivindicação 10, caracterizado por os ditos meios de alteração compreenderem meios para fixarem um tempo de comparação relacionado com um bordo do dito tipo de campo, indicando a saída do dito primeiro sinal video.
14 - Dispositivo de acordo com a reivindicação 1, caracterizado por os ditos meios de alteração compreenderem meios para gerarem uma pluralidade de sinais de correcção de entrelaçamento seleccionáveis, sendo cada um deles apropriado para um modo diferente da correcção de entrelaçamento.
15 - Dispositivo de acordo com a reivindicação 1, caracterizado por cada um dos ditos meios de detecção de tipo de campo compreender meios para amostrarem um componente de sincronização horizontal do dito respectivo sinal video, através de um componente de sincronização vertical do dito respectivo sinal video, para gerar um sinal de saída de tipo de campo.
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-50>
16 - Dispositivo para manter a integridade entrelaçada, caracterizado por compreender:
primeiros meios de detecção de tipos de campo para um primeiro sinal video, tendo uma saída indicando se o dito primeiro sinal video tem um primeiro ou segundo tipo de campo;
segundos meios de detecção de tipo de campo para um segundo sinal video, tendo uma saída indicando se o dito segundo sinal video tem o dito primeiro ou segundo tipo de campo;
meios para armazenarem o dito segundo sinal video, para sincronizarem o dito segundo sinal video com o dito primeiro sinal video, sendo o dito segundo sinal video escrito nos ditos meios de armazenagem sincronamente com o dito segundo sinal video e sendo lido dos ditos meios de armazenagem sincronamente com o dito primeiro sinal video;
meios para compararem o dito tipo de campo do dito segundo sinal ao dito tipo de campo do dito primeiro sinal; e meios para alterarem o dito tipo de campo do segundo sinal video como necessário, para fazer coincidir o dito tipo de campo do dito primeiro sinal video, que responde aos ditos meios de comparação.
17 - Dispositivo de acordo com a reivindicação 16, caracterizado por os ditos meios para alterarem o dito tipo de campo do dito segundo sinal video controlarem a dita escrita do dito segundo sinal video nos ditos meios de armazenagem.
18 - Dispositivo de acordo com a reivindicação 17, caracterizado por os meios para alterarem o dito tipo de campo do dito segundo sinal video retardarem, a escrita do dito primeiro tipo de campo de um período de linha horizontal.
19 - Dispositivo de acordo com a reivindicação 17, caracterizado por os ditos meios para alterarem o dito tipo de campo do
72 644
RCA 86 343 segundo sinal video avançarem a escrita do dito segunao ripo ae campo de um período de linha horizontal.
20 - Dispositivo de acordo com a reivindicação 16, caracterizado por os ditos meios de alteração compreenderem meios para compararem o dito tipo de campo do dito segundo sinal para o dito tipo de campo do dito primeiro sinal e gerarem um sinal de saída indicando uma de uma pluralidade de saídas de comparação.
21 - Dispositivo de acordo com a reivindicação 20, caracterizado por a dita pluralidade de saídas de comparação compreender:
os ditos primeiro e segundo sinais video, tendo campos correntes do mesmo tipo de campo;
o dito primeiro sinal video, tendo um campo corrente do dito primeiro tipo de campo e o dito segundo sinal video, tendo um campo corrente do dito segundo tipo de campo; e o dito primeiro sinal video, tendo um campo corrente do tipo segundo tipo de campo e o dito segundo sinal video, tendo um campo corrente do dito primeiro tipo de campo.
22 - Dispositivo de acordo com a reivindicação 20, caracterizado por os ditos meios de alteração compreenderem meios para gerarem uma pluralidade de sinais de correcção de entrelaçamento seleccionáveis, sendo cada um deles apropriado para uma da dita pluralidade de saídas de comparação.
23 - Dispositivo de acordo com a reivindicação 20, caracterizado por os ditos meios de alteração compreenderem meios para fixarem um tempo de comparação relacionado com um bordo do dito tipo de campo, indicando a saída do dito primeiro sinal video.
24 - Dispositivo de acordo com a reivindicação 16, caracterizado por os ditos meios de alteração compreenderem meios para gerarem uma pluralidade de sinais de correcção de entrelaçamento seleccionáveis, sendo cada um deles apropriado para um modo
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Families Citing this family (131)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5351135A (en) * 1990-06-01 1994-09-27 Thomson Consumer Electronics, Inc. Managing letterbox signals with logos
US5249049A (en) * 1990-06-01 1993-09-28 Thomson Consumer Electronics, Inc. Managing letterbox displays
US5369444A (en) * 1990-06-01 1994-11-29 Thomson Consumer Electronics Field type matching system
US5345270A (en) * 1990-06-01 1994-09-06 Thomson Consumer Electronics, Inc. Managing letterbox signals with logos and closed captions
US5309234A (en) * 1991-05-29 1994-05-03 Thomson Consumer Electronics Adaptive letterbox detector
JPH04365278A (ja) * 1991-06-13 1992-12-17 Matsushita Electric Ind Co Ltd 多画面表示回路
US5414463A (en) * 1991-09-18 1995-05-09 Hitachi, Ltd. Video cameras capable of switching an aspect ratio and view finders for use in the same
JPH05183833A (ja) * 1992-01-07 1993-07-23 Sony Corp 表示装置
EP0616466B1 (en) * 1992-01-07 2000-06-07 Thomson Consumer Electronics, Inc. Horizontal panning for wide screen television
US5287188A (en) * 1992-01-07 1994-02-15 Thomson Consumer Electronics, Inc. Horizontal panning for wide screen television
TW220024B (pt) * 1992-01-08 1994-02-01 Thomson Consumer Electronics
GB9200281D0 (en) * 1992-01-08 1992-02-26 Thomson Consumer Electronics A pip horizontal panning circuit for wide screen television
JPH05236377A (ja) * 1992-02-18 1993-09-10 Sony Corp 映像セレクタ
GB9205614D0 (en) * 1992-03-14 1992-04-29 Innovision Ltd Sample rate converter suitable for converting between digital video formats
JP3435172B2 (ja) * 1992-06-02 2003-08-11 株式会社東芝 テレビジョン信号処理回路
JP2759727B2 (ja) * 1992-04-22 1998-05-28 日本ビクター株式会社 ディスプレイ装置
GB2254977B (en) * 1992-04-23 1996-01-17 Philips Electronics Nv Receiver for letterbox television signals
JPH0638128A (ja) * 1992-06-19 1994-02-10 Sony Corp 映像表示装置
US5262864A (en) * 1992-07-10 1993-11-16 Thomson Consumer Electronics, Inc. Frame based vertical panning system
TW234806B (pt) * 1992-07-10 1994-11-21 Thomson Consumer Electronics
US5294987A (en) * 1992-07-10 1994-03-15 Thomson Consumer Electronics, Inc. Field to field vertical panning system
EP0603535A1 (en) * 1992-11-23 1994-06-29 Thomson Consumer Electronics, Inc. Tuner signal switching apparatus
TW335241U (en) * 1992-11-30 1998-06-21 Thomson Consumer Electronics A video display system
US9286294B2 (en) 1992-12-09 2016-03-15 Comcast Ip Holdings I, Llc Video and digital multimedia aggregator content suggestion engine
US7168084B1 (en) 1992-12-09 2007-01-23 Sedna Patent Services, Llc Method and apparatus for targeting virtual objects
DE69333713T2 (de) 1992-12-09 2005-07-21 Sedna Patent Services, Llc Vorrichtung und Verfahren zur Bereitstellen von Rundfunkdatendiensten
US5369341A (en) * 1992-12-11 1994-11-29 Thomson Consumer Electronics, Inc. Vertical retrace with zoom and centered fast retrace
US5614952A (en) 1994-10-11 1997-03-25 Hitachi America, Ltd. Digital video decoder for decoding digital high definition and/or digital standard definition television signals
TW274673B (pt) * 1993-02-10 1996-04-21 Thomson Consumer Electronics
EP0685139B1 (en) * 1993-02-17 2001-07-18 Thomson Consumer Electronics, Inc. Adaptive letterbox detection
WO1994019911A1 (en) * 1993-02-17 1994-09-01 Thomson Consumer Electronics, Inc. Managing letterbox displays
JPH06311449A (ja) * 1993-02-26 1994-11-04 Sony Corp テレビジョン受像機
EP0656727B1 (en) * 1993-11-03 1999-04-28 SONY-WEGA PRODUKTIONS GmbH Teletext receiver
DE69328824T2 (de) * 1993-03-15 2000-10-19 Thomson Consumer Electronics, Inc. Horizontale Panoramierung für ein Breitbildschirmfernsehen
JPH06292148A (ja) * 1993-03-30 1994-10-18 Sony Corp 倍速映像表示装置
GB2308266B (en) * 1993-03-30 1997-08-20 Sony Corp Video signal display apparatus and video signal processing circuit therefor
CN1050255C (zh) * 1993-04-03 2000-03-08 汤姆森消费电子有限公司 用于宽屏电视的水平画面摄取***
CN1051896C (zh) * 1993-04-21 2000-04-26 汤姆森消费电子有限公司 视频显示控制***
CN1042786C (zh) * 1993-04-21 1999-03-31 汤姆森消费电子有限公司 视频显示控制***
BE1007167A3 (nl) * 1993-05-13 1995-04-11 Philips Electronics Nv Zendstation voor het uitzenden van een pluraliteit van televisie programma's, en een ontvanger voor het ontvangen daarvan.
US5363143A (en) * 1993-09-03 1994-11-08 Thomson Consumer Electronics, Inc. Side by side picture display with reduced cropping
JP3022713B2 (ja) * 1993-09-30 2000-03-21 日本ビクター株式会社 画像信号処理方法
KR960012492B1 (ko) * 1993-11-03 1996-09-20 엘지전자 주식회사 와이드 티브이 수상기의 수직 위치 가변회로
SG93754A1 (en) * 1993-11-26 2003-01-21 Thomson Consumer Electronics Emulation of computer monitor in a wide screen television
JP2554450B2 (ja) * 1993-12-16 1996-11-13 日本テレビ放送網株式会社 フレームシンクロナイザおよびこれを使用した信号切り替え装置
TW312076B (pt) * 1993-12-21 1997-08-01 Thomson Consumer Electronics
JPH07184138A (ja) * 1993-12-24 1995-07-21 Toshiba Corp ２画面映像処理回路
BR9408481A (pt) * 1994-01-12 1997-10-28 Thomson Consumer Electronics Sistema de descompressão de sinais para descomprimir um sinal de vídeo submetido à compressão em uma pluralidade de modos e resoluções espaciais e conversor de mútliplos modos para a conversão de um sinal de vídeo para cima na dimensão espacialmente vertical
CN1048138C (zh) * 1994-01-12 2000-01-05 汤姆森消费电子有限公司 用于电视接收机的多方式内插滤波器
US5790197A (en) * 1994-01-12 1998-08-04 Thomson Consumer Electronics,. Inc. Multimode interpolation filter as for a TV receiver
TW307971B (pt) * 1994-03-31 1997-06-11 Matsushita Electric Ind Co Ltd
US5719636A (en) * 1994-04-28 1998-02-17 Kabushiki Kaisha Toshiba Letter-box screen detection apparatus
EP0697787A3 (de) * 1994-08-20 1996-05-29 Loewe Opta Gmbh Verfahren und Schaltungsanordnung zur Darstellung eines 16:9-Fernsehbildes nach dem PAL-Plus-Verfahren auf dem Bildschirm eines Fernsehempfängers mit einer 16:9-formatigen Bildröhre
DE4432169A1 (de) * 1994-09-09 1996-03-14 Bosch Siemens Hausgeraete Fernsehgerät
US5574508A (en) * 1994-11-02 1996-11-12 Rca Thomson Licensing Corporation Vertical panning for interlaced video
ATE190792T1 (de) * 1994-12-12 2000-04-15 Sony Wega Produktions Gmbh Verfahren und vorrichtung zur gleichzeitigen darstellung von zwei bildern
EP0737004A1 (en) * 1995-04-05 1996-10-09 Thomson Consumer Electronics, Inc. Field type detector for video signal
GB9508289D0 (en) * 1995-04-24 1995-06-14 Rca Thomson Licensing Corp Deflection circuits for changing display format on wide screen picture tubes
JP3617130B2 (ja) * 1995-07-21 2005-02-02 ソニー株式会社 映像信号処理回路及び画像表示装置
EP0758184B1 (fr) * 1995-08-09 2000-07-12 Koninklijke Philips Electronics N.V. Appareil d'affichage d'images avec décalage de bas d'image
KR0176825B1 (ko) * 1995-08-16 1999-05-01 구자홍 티브이의 영상 모드 선택 방법 및 그 장치
CA2184121A1 (en) * 1995-08-30 1997-03-01 John R. Reder Sampling analog video signal for secondary images
JPH0993505A (ja) * 1995-09-26 1997-04-04 Toshiba Corp 文字多重デコーダを有するテレビ受信機
JPH0993548A (ja) * 1995-09-27 1997-04-04 Toshiba Corp 文字情報表示機能付きテレビ受信機
JPH09116821A (ja) * 1995-10-18 1997-05-02 Toshiba Corp テレビジョン受像機
FR2742279B1 (fr) * 1995-12-06 1998-01-09 Thomson Multimedia Sa Dispositif de decimation de sequences de donnees numeriques
US6008860A (en) * 1995-12-29 1999-12-28 Thomson Consumer Electronics, Inc. Television system with provisions for displaying an auxiliary image of variable size
JP3575153B2 (ja) * 1996-01-17 2004-10-13 ソニー株式会社 アスペクト比判別回路及び映像モニタ装置
CA2191632A1 (en) * 1996-02-13 1997-08-14 James Lee Combs Video processor for processing two analog composite video signals
CN1065396C (zh) * 1996-02-17 2001-05-02 明碁电脑股份有限公司 宽屏幕电视的屏幕检测***
JPH09284671A (ja) * 1996-04-18 1997-10-31 Toshiba Corp 走査線変換装置
EP0802671B1 (en) * 1996-04-18 2000-03-01 Matsushita Electric Industrial Co., Ltd. Digital signal processing circuit for a television receiver
JPH09326958A (ja) * 1996-06-05 1997-12-16 Sony Corp 画像処理装置および処理方法
EP0822711A3 (en) * 1996-08-02 1998-07-01 SANYO ELECTRIC Co., Ltd. Internet information displaying apparatus
KR100206802B1 (ko) * 1996-08-20 1999-07-01 구자홍 텔레비젼수상기의 자동 와이드화면 디스플레이 방법 및 장치
KR100678355B1 (ko) * 1996-09-27 2007-05-14 소니 가부시끼 가이샤 영상표시및제어장치와그의방법
US5854902A (en) * 1996-10-31 1998-12-29 Sensormatic Electronics Corporation Video data capture and formatting in intelligent video information management system
DE19652362A1 (de) * 1996-12-17 1998-06-18 Thomson Brandt Gmbh Verfahren und Vorrichtung zur Kompensation der durch die Verarbeitung von Chrominanz-Signalen entstehenden Luminanzdefekte
JPH1198422A (ja) * 1997-09-19 1999-04-09 Sony Corp 映像信号判別回路
JP3464924B2 (ja) * 1998-03-13 2003-11-10 株式会社東芝 同期制御回路
US6501507B1 (en) * 1998-05-13 2002-12-31 Barth Alan Canfield Multimode interpolation filter as for a TV receiver
GB9817421D0 (en) * 1998-08-11 1998-10-07 Danmere Limited Interactive television control/operating system
CN1096181C (zh) * 1998-08-13 2002-12-11 汤姆森消费电子有限公司 视频显示控制***
DE19911947C2 (de) * 1999-03-17 2003-04-24 Infineon Technologies Ag Verfahren zur Farbkantenverbesserung bei einer Bildeinblendung
GB2349288B (en) 1999-04-16 2003-10-22 Quantel Ltd A video editing system
US6791578B1 (en) 2000-05-30 2004-09-14 Apple Computer, Inc. 16:9 aspect ratio and anamorphic image processing
US7181416B2 (en) * 2000-06-08 2007-02-20 Blackstone Corporation Multi-function transaction processing system
US7908628B2 (en) 2001-08-03 2011-03-15 Comcast Ip Holdings I, Llc Video and digital multimedia aggregator content coding and formatting
US7793326B2 (en) 2001-08-03 2010-09-07 Comcast Ip Holdings I, Llc Video and digital multimedia aggregator
US20030204457A1 (en) * 2002-04-26 2003-10-30 Arias Luis A. Payee account payment system
DE10226071A1 (de) * 2002-06-12 2004-01-08 Fujitsu Siemens Computers Gmbh Verfahren und Vorrichtung zum Darstellen eines digitalisierten Bildes
US20060032911A1 (en) * 2002-10-07 2006-02-16 Arias Luis A Prepaid card issuing system
CN100341325C (zh) * 2003-03-08 2007-10-03 中兴通讯股份有限公司 会议电视***数字多画面回传的终端名显示的方法
CN101702756B (zh) 2003-04-28 2013-04-17 松下电器产业株式会社 记录介质和方法、再现装置和方法、程序和集成电路
JP3968587B2 (ja) * 2004-03-30 2007-08-29 船井電機株式会社 液晶テレビジョン、バックライト制御装置およびバックライト制御方法
CN100385926C (zh) * 2004-03-31 2008-04-30 凌阳科技股份有限公司 具有储存功能的液晶显示***
JP4537107B2 (ja) * 2004-04-06 2010-09-01 キヤノン株式会社 映像表示装置、映像表示方法、及びコンピュータプログラム
US7113200B2 (en) * 2004-05-21 2006-09-26 Polycom, Inc. Method and system for preparing video communication image for wide screen display
JP4646556B2 (ja) * 2004-06-25 2011-03-09 三洋電機株式会社 ディスプレイ駆動装置
US7427704B2 (en) * 2004-09-09 2008-09-23 Huwaldt David A Stringed instrument fingering guide
CN100584166C (zh) 2005-05-07 2010-01-20 富准精密工业(深圳)有限公司 液冷散热装置
US20070008338A1 (en) * 2005-05-28 2007-01-11 Young-Chan Kim Display system, display apparatus, and method of controlling video source and display apparatus
CN100580765C (zh) * 2005-06-30 2010-01-13 康佳集团股份有限公司 一种图像点阵显示格式变换的方法
MX2008001485A (es) * 2005-08-05 2008-04-04 Samsung Electronics Co Ltd Aparato para proporcionar pantallas multiples y metodo para configurar dinamicamente pantallas multiples.
US8949894B2 (en) 2005-08-05 2015-02-03 Samsung Electronics Co., Ltd. Apparatus for providing multiple screens and method of dynamically configuring multiple screens
WO2007057875A2 (en) 2005-11-15 2007-05-24 Nds Limited Digital video zooming system
WO2007114675A1 (en) * 2006-04-06 2007-10-11 Samsung Electronics Co., Ltd. Apparatus for providing multiple screens and method for dynamic configuration of the same
FR2901947A1 (fr) * 2006-05-30 2007-12-07 Nds Technologies France Soc Pa Procede de gestion de l'affichage d'une video retaillee notamment pour la television haute definition
CN101946500B (zh) * 2007-12-17 2012-10-03 伊克鲁迪控股公司 实时视频包含***
CN101483034B (zh) * 2008-02-22 2010-10-13 青岛海信电器股份有限公司 多画面显示方法和装置
JP5096247B2 (ja) * 2008-07-08 2012-12-12 ルネサスエレクトロニクス株式会社 画像処理装置、及び方法
US9218792B2 (en) 2008-12-11 2015-12-22 Nvidia Corporation Variable scaling of image data for aspect ratio conversion
US8508449B2 (en) * 2008-12-18 2013-08-13 Sharp Corporation Adaptive image processing method and apparatus for reduced colour shift in LCDs
BRPI1011302A2 (pt) * 2009-06-17 2016-03-22 Sharp Kk registrador de deslocamento, circuito de excitação de vídeo, painel de exibição e dispositivo de exibição
WO2010146752A1 (ja) * 2009-06-17 2010-12-23 シャープ株式会社 シフトレジスタ、表示駆動回路、表示パネル、表示装置
BR112012008070A2 (pt) * 2009-07-29 2016-03-01 Sharp Kk dispositivo de exibição de imagem e método de exibição de imagem
JP2013514430A (ja) 2009-12-18 2013-04-25 エクソンモービル リサーチ アンド エンジニアリング カンパニー 炭化水素精製プロセスにおける汚れ軽減のためのポリアルキレンエポキシポリアミン添加剤
CN102107040B (zh) * 2009-12-25 2013-05-01 朝日英达科株式会社 导线
KR101682147B1 (ko) * 2010-04-05 2016-12-05 삼성전자주식회사 변환 및 역변환에 기초한 보간 방법 및 장치
US8698958B2 (en) 2010-06-16 2014-04-15 Silicon Image, Inc. Mechanism for memory reduction in picture-in-picture video generation
JP5672862B2 (ja) 2010-08-27 2015-02-18 ソニー株式会社 撮像装置、撮像システム及び撮像方法
RU2452125C1 (ru) * 2011-06-23 2012-05-27 Федеральное государственное унитарное предприятие "Научно-производственное объединение автоматики имени академика Н.А. Семихатова" Система обработки изображений
TWI486052B (zh) 2011-07-05 2015-05-21 Realtek Semiconductor Corp 立體影像處理裝置以及立體影像處理方法
CN103686064B (zh) * 2012-08-31 2017-05-03 杭州海康威视数字技术股份有限公司 画面分割显示的方法及客户端
CN104798129B (zh) * 2012-11-27 2018-10-19 索尼公司 显示装置、显示方法和计算机可读介质
US9723216B2 (en) 2014-02-13 2017-08-01 Nvidia Corporation Method and system for generating an image including optically zoomed and digitally zoomed regions
CN105389776B (zh) 2014-09-02 2019-05-03 辉达公司 图像缩放技术
CN107454283B (zh) * 2016-06-01 2020-12-01 联发科技股份有限公司 视频信号输出***与方法
CN106162262A (zh) * 2016-07-28 2016-11-23 王晓光 视频广告接收侧的接收方法及***
US11229135B2 (en) 2019-04-01 2022-01-18 Dell Products L.P. Multiple function chassis mid-channel
CN111179883B (zh) * 2020-01-03 2022-06-03 云谷（固安）科技有限公司 图像显示方法和装置、移动终端、计算机设备、存储介质

Family Cites Families (115)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
BE490074A (pt) * 1948-07-09
AT303141B (de) * 1970-01-20 1972-11-10 Siemens Ag Anordnung zum Auswerten bestimmter Bildteile
US3624289A (en) * 1970-08-26 1971-11-30 Data Plex Systems Apparatus for blanking portion of fields of television video signals
US3878327A (en) * 1973-10-17 1975-04-15 Westinghouse Electric Corp Television system for improving reading skills
US4079413A (en) * 1975-07-29 1978-03-14 Kabushiki Kaisha Daini Seikosha Portable electronic timepiece with selective display of time signal and television image
JPS5329019A (en) * 1976-08-30 1978-03-17 Toshiba Corp Color relevision receiver set
JPS6011875B2 (ja) * 1977-08-17 1985-03-28 日本電気株式会社 クロマキ−トラツキング装置
US4259690A (en) * 1977-10-06 1981-03-31 Sharp Kabushiki Kaisha Multi-picture tuning scheme of television receiver
US4266242A (en) * 1978-03-21 1981-05-05 Vital Industries, Inc. Television special effects arrangement
DK149879A (da) * 1978-04-12 1979-10-13 Data Recall Ltd Styreapparat til brug ved fremvisning af videosignaler
US4356511A (en) * 1978-05-23 1982-10-26 Sony Corporation Digital soft-edge video special effects generator
US4249213A (en) * 1978-09-14 1981-02-03 Hitachi, Ltd. Picture-in-picture television receiver
SE411007B (sv) * 1979-03-30 1979-11-19 Globe Computers Ab Forfarande och anordning for synkronisering av ett digitalt minne med ett befintligt tv-system
JPS5853791Y2 (ja) * 1979-05-08 1983-12-07 ソニー株式会社 画像デイスプレイ装置
US4282546A (en) * 1979-11-28 1981-08-04 Rca Corporation Television image size altering apparatus
GB2073536B (en) * 1980-04-09 1984-06-06 British Broadcasting Corp Television signal processing
US4399462A (en) * 1981-01-30 1983-08-16 Fairchild-Weston Systems Inc. Video split screen technique
JPS57208772A (en) * 1981-06-18 1982-12-21 Sony Corp Television receiver
US4460890A (en) * 1982-01-21 1984-07-17 Sony Corporation Direct digital to digital sampling rate conversion, method and apparatus
DE3233288A1 (de) * 1982-09-08 1984-03-08 Robert Bosch Gmbh, 7000 Stuttgart System zur zeitlichen kompression und/oder expansion von elektrischen signalen
US4651195A (en) * 1983-04-04 1987-03-17 Robot Research, Inc. Monochrome-compatible color slow scan television system
US4524447A (en) * 1983-05-25 1985-06-18 Rca Corporation Digital signal processing apparatus having digital dither
US4556900A (en) * 1983-05-25 1985-12-03 Rca Corporation Scaling device as for quantized B-Y signal
US4556906A (en) * 1983-11-15 1985-12-03 Rca Corporation Kinescope blanking scheme for wide-aspect ratio television
JPS60160780A (ja) * 1984-01-31 1985-08-22 Nec Corp 特殊効果用画像記憶装置
US4622577A (en) * 1984-02-03 1986-11-11 Rca Corporation Decoder for extracting a 4:3 aspect ratio signal from a high definition television signal
JPS60180383A (ja) * 1984-02-28 1985-09-14 Matsushita Electric Ind Co Ltd テレビジヨン受像機
GB2160051A (en) * 1984-04-26 1985-12-11 Philips Electronic Associated Video signal processing arrangement
GB2158318A (en) * 1984-04-26 1985-11-06 Philips Electronic Associated Fading circuit for video signals
US4707742A (en) * 1984-04-26 1987-11-17 U.S. Philips Corporation Video signal processing arrangement
US4573080A (en) * 1984-06-28 1986-02-25 Rca Corporation Progressive scan television receiver with adaptive memory addressing
GB2164518B (en) * 1984-09-14 1987-12-02 Philips Electronic Associated Rotating television pictures
JPH0712206B2 (ja) * 1984-10-01 1995-02-08 日本放送協会 映像信号処理用基本装置
JPH0646783B2 (ja) * 1984-10-15 1994-06-15 ソニー株式会社 マルチ走査形テレビジヨン受像機
US4594726A (en) * 1984-11-29 1986-06-10 Rca Corporation Dedithering circuitry in digital TV receiver
US4796086A (en) * 1984-11-30 1989-01-03 Fuji Photo Film Co., Ltd. Method for converting color picture signals
NL8403929A (nl) * 1984-12-24 1986-07-16 Philips Nv Kleurentelevisietransmissie- respektievelijk informatieopslagsysteem met tijdmultiplexkodering en daartoe geschikte informatiegever en -ontvanger.
JPS61193580A (ja) * 1985-02-21 1986-08-28 Hitachi Ltd ２画面テレビジヨン受像機
US4651208A (en) * 1985-03-18 1987-03-17 Scientific Atlanta, Inc. Compatibility of widescreen and non-widescreen television transmissions
US4656515A (en) * 1985-03-25 1987-04-07 Rca Corporation Horizontal compression of pixels in a reduced-size video image utilizing cooperating subsampling and display rates
US4652908A (en) * 1985-03-25 1987-03-24 Rca Corporation Filtering system for processing a reduced-resolution video image
US4656516A (en) * 1985-03-25 1987-04-07 Rca Corporation Vertical subsampling and memory synchronization system for a picture within a picture television receiver
US4654695A (en) * 1985-03-25 1987-03-31 Rca Corporation Apparatus for reducing the resolution of video samples by truncating the most significant bits
US4670784A (en) * 1985-04-15 1987-06-02 Cbs, Inc. Methods for coping with non-uniform phosphor aging in dual mode television receivers
GB2179828B (en) * 1985-08-14 1989-08-02 Rca Corp Selectable raster size for video display
US4763194A (en) * 1985-08-14 1988-08-09 Rca Licensing Corporation Selectable raster size for video display
JPS6239762A (ja) * 1985-08-16 1987-02-20 Nippon Mining Co Ltd 管状体の超音波探傷方法
US4729012A (en) * 1985-08-30 1988-03-01 Rca Corporation Dual mode television receiver for displaying wide screen and standard aspect ratio video signals
US4758893A (en) * 1985-09-23 1988-07-19 Quanticon Inc. Cinematic dithering for television systems
US4760455A (en) * 1985-11-29 1988-07-26 Canon Kabushiki Kaisha Picture output device
AU591743B2 (en) * 1985-12-28 1989-12-14 Sony Corporation Television receiver
GB8602644D0 (en) 1986-02-04 1986-03-12 British Broadcasting Corp Video systems
DE3663875D1 (en) * 1986-03-08 1989-07-13 Ant Nachrichtentech Motion compensating field interpolation method using a hierarchically structured displacement estimator
JPH07113821B2 (ja) * 1986-04-21 1995-12-06 日本テキサス・インスツルメンツ株式会社 半導体記憶装置
JPS62263780A (ja) * 1986-05-09 1987-11-16 Matsushita Electric Ind Co Ltd 高品位テレビジヨン受信装置
JPS62263781A (ja) * 1986-05-09 1987-11-16 Matsushita Electric Ind Co Ltd 高品位テレビジヨン受信装置
DE3787923T2 (de) * 1986-05-12 1994-05-26 Hitachi Ltd Bildverarbeitungssystem.
FR2599201A1 (fr) * 1986-05-23 1987-11-27 Trt Telecom Radio Electr Dispositif de codage a modulation differentielle par impulsions codees, dispositif de decodage associe et systeme de transmission comportant au moins un tel dispositif de codage ou de decodage
US4768093A (en) * 1986-06-05 1988-08-30 North American Philips Corporation Vertical pre-filter for pip television receivers
US4746981A (en) * 1986-06-16 1988-05-24 Imtech International, Inc. Multiple screen digital video display
JPH0797838B2 (ja) * 1986-09-30 1995-10-18 キヤノン株式会社 撮像装置
US4743970A (en) * 1986-10-20 1988-05-10 The Grass Valley Group, Inc. Picture transformation memory
US4689681A (en) * 1986-10-24 1987-08-25 The Grass Valley Group, Inc. Television special effects system
JPS63146671A (ja) * 1986-12-10 1988-06-18 Matsushita Electric Ind Co Ltd テレビジヨン受像機
JPS63146672A (ja) * 1986-12-10 1988-06-18 Matsushita Electric Ind Co Ltd テレビジヨン受信装置
US4761587A (en) * 1986-12-17 1988-08-02 Rca Licensing Corporation Multiple frequency horizontal oscillator for video apparatus
JPH0824355B2 (ja) * 1987-01-27 1996-03-06 松下電器産業株式会社 テレビジヨン受信装置
GB8701770D0 (en) * 1987-01-27 1987-03-04 Thorn Emi Home Electron Video processing
JP2506718B2 (ja) * 1987-02-06 1996-06-12 松下電器産業株式会社 テレビジヨン受像機
JPS63282790A (ja) * 1987-02-14 1988-11-18 株式会社リコー 表示制御装置
US4724487A (en) * 1987-02-17 1988-02-09 Rca Corporation Interlace inversion detector for a picture-in-picture video signal generator
US4991014A (en) * 1987-02-20 1991-02-05 Nec Corporation Key signal producing apparatus for video picture composition
US4839728A (en) * 1987-03-23 1989-06-13 Rca Licensing Corporation Picture-in-picture video signal generator
EP0285902A3 (de) * 1987-04-07 1990-10-10 Siemens Aktiengesellschaft Verfahren zur Datenreduktion digitaler Bildsequenzen
US5005080A (en) * 1987-05-15 1991-04-02 Pioneer Electronic Corporation Method and apparatus of image processing
US4769705A (en) * 1987-06-30 1988-09-06 Rca Licensing Corporation Deflection synchronizing apparatus
DE3722172A1 (de) * 1987-07-04 1989-01-12 Thomson Brandt Gmbh Verfahren und vorrichtung zur ausschnittvergroesserung eines fernsehbildes
JPS6429178A (en) * 1987-07-24 1989-01-31 Matsushita Electric Ind Co Ltd Image display device
JP2595551B2 (ja) * 1987-08-14 1997-04-02 ソニー株式会社 画像信号処理装置
DE3728444A1 (de) * 1987-08-26 1989-03-09 Thomson Brandt Gmbh Verfahren und schaltungsanordnung zur verbesserung der aufloesung von digitalen signalen
GB8722394D0 (en) * 1987-09-23 1987-10-28 British Telecomm Video coder
US4766355A (en) * 1987-09-25 1988-08-23 Zenith Electronics Corporation Automatic vertical size control
US4821086A (en) * 1987-10-28 1989-04-11 Rca Licensing Corporation TV receiver having in-memory switching signal
US4831447A (en) * 1987-11-16 1989-05-16 The Grass Valley Group, Inc. Method and apparatus for anti-aliasing an image boundary during video special effects
US4891705A (en) * 1987-11-30 1990-01-02 Nec Corporation Apparatus for generating a picture signal at precise horizontal position
JP2578852B2 (ja) * 1987-12-14 1997-02-05 松下電器産業株式会社 高品位テレビジョン受信装置
JPH01157181A (ja) * 1987-12-14 1989-06-20 Matsushita Electric Ind Co Ltd 高品位テレビジョン受信装置
JPH01157182A (ja) * 1987-12-14 1989-06-20 Matsushita Electric Ind Co Ltd 高品位テレビジョン受信装置
JPH01205688A (ja) * 1988-02-10 1989-08-18 Nec Corp テレビ受像機
JPH01221067A (ja) * 1988-02-29 1989-09-04 Sony Corp 画像表示装置
JPH01248879A (ja) * 1988-03-30 1989-10-04 Toshiba Corp アドレス制御回路
JP2829962B2 (ja) * 1988-04-28 1998-12-02 松下電器産業株式会社 テレビジョン受像機
US4903269A (en) * 1988-05-16 1990-02-20 General Electric Company Error detector for encoded digital signals
US4829378A (en) * 1988-06-09 1989-05-09 Bell Communications Research, Inc. Sub-band coding of images with low computational complexity
US4910585A (en) * 1988-06-29 1990-03-20 General Electric Company Frequency selective video signal intraframe processor
JPH0216881A (ja) * 1988-07-05 1990-01-19 Sony Corp スーパーインポーズ装置
KR950010887B1 (en) * 1988-07-08 1995-09-25 Samsung Electronics Co Ltd Multi-screen producting image control circuit
NL8801802A (nl) * 1988-07-15 1990-02-01 Philips Nv Videosignaalverwerkingsschakeling.
JPH0813126B2 (ja) * 1988-08-12 1996-02-07 沖電気工業株式会社 画像通信装置
US4916525A (en) * 1988-08-29 1990-04-10 Hughes Aircraft Company High definition TV system
US4984078A (en) * 1988-09-02 1991-01-08 North American Philips Corporation Single channel NTSC compatible EDTV system
US4941045A (en) * 1988-10-11 1990-07-10 Scientific-Atlanta, Inc. Method and apparatus for improving vertical definition of a television signal by scan conversion
JPH02132980A (ja) * 1988-11-14 1990-05-22 Sony Corp Ｔｖ受像機
JPH02137585A (ja) * 1988-11-18 1990-05-25 Sony Corp テレビジョン受像機
US4984081A (en) * 1989-01-24 1991-01-08 Matsushita Electric Industrial Co., Ltd. Apparatus for receiving and selecting high-definition television (HDTV) signals and standard television (NTSC) signals
GB2231460B (en) * 1989-05-04 1993-06-30 Sony Corp Spatial interpolation of digital video signals
US5008752A (en) * 1989-06-16 1991-04-16 Eastman Kodak Company Digital image interpolator with multiple interpolation algorithms
US4992874A (en) * 1989-07-03 1991-02-12 Rca Licensing Corporation Method and apparatus for correcting timing errors as for a multi-picture display
US4987493A (en) * 1989-08-01 1991-01-22 Rca Licensing Corporation Memory efficient interlace apparatus and method as for a picture in a picture display
HU217387B (hu) * 1989-08-23 2000-01-28 Thomson Consumer Electronics Inc. Elrendezés konvergáltatás vezérlésére különböző, függőleges formátumú kijelzések létrehozásánál, és képernyős megjelenítőkészülék
US5027078A (en) * 1989-10-10 1991-06-25 Xerox Corporation Unscreening of stored digital halftone images by logic filtering
US4965668A (en) * 1989-11-09 1990-10-23 The Grass Valley Group, Inc. Adaptive rounder for video signals
US5027212A (en) * 1989-12-06 1991-06-25 Videologic Limited Computer based video/graphics display system
US5021887A (en) * 1989-12-13 1991-06-04 Samsung Electronics Co., Ltd. Method and circuit for composing still image of picture-in-picture
US5018090A (en) * 1990-03-13 1991-05-21 Rca Licensing Corporation Digital interpolation circuitry

Also Published As

Publication number Publication date
PT97816B (pt) 1998-12-31
US5285282A (en) 1994-02-08
DE4191166T (pt) 1993-04-01
CN1057148A (zh) 1991-12-18
MY115270A (en) 2003-05-31
WO1991019397A1 (en) 1991-12-12
EP0532665B1 (en) 1997-05-02
ES2134196T3 (es) 1999-10-01
MY105289A (en) 1994-09-30
CA2082260A1 (en) 1991-12-02
AU8084591A (en) 1991-12-31
JP3310667B2 (ja) 2002-08-05
PT97818B (pt) 1998-12-31
EP0532653A4 (en) 1993-11-24
KR100195360B1 (en) 1999-06-15
PT97814B (pt) 1998-12-31
JPH05507824A (ja) 1993-11-04
CN1034460C (zh) 1997-04-02
CN1057560A (zh) 1992-01-01
PL167644B1 (pl) 1995-10-31
DE69128784T2 (de) 1998-05-14
JPH05507831A (ja) 1993-11-04
WO1991019387A1 (en) 1991-12-12
AU7909591A (en) 1991-12-31
JP4227950B2 (ja) 2009-02-18
PT97810A (pt) 1993-08-31
PT97812B (pt) 1998-12-31
WO1991019386A1 (en) 1991-12-12
EP0831645B1 (en) 2000-08-16
JP3338048B2 (ja) 2002-10-28
AU7983391A (en) 1991-12-31
SG75762A1 (en) 2000-10-24
JPH05508065A (ja) 1993-11-11
KR100195358B1 (ko) 1999-06-15
WO1991019385A1 (en) 1991-12-12
CN1057140A (zh) 1991-12-18
JPH05507595A (ja) 1993-10-28
JP2007129728A (ja) 2007-05-24
KR100195363B1 (ko) 1999-06-15
SG64307A1 (en) 1999-04-27
EP0532682B1 (en) 1997-10-08
JP3140774B2 (ja) 2001-03-05
JPH05507825A (ja) 1993-11-04
CN1057139A (zh) 1991-12-18
ES2103814T3 (es) 1997-10-01
ES2148152T3 (es) 2000-10-16
DE69132349T2 (de) 2000-12-28
JPH05507830A (ja) 1993-11-04
EP0831645A1 (en) 1998-03-25
CN1057141A (zh) 1991-12-18
TR25549A (tr) 1993-05-01
PT97808B (pt) 1998-12-31
CN1034466C (zh) 1997-04-02
DE69129806D1 (de) 1998-08-20
CN1053310C (zh) 2000-06-07
CN1041878C (zh) 1999-01-27
JP2002125171A (ja) 2002-04-26
EP0532667A1 (en) 1993-03-24
DE69125936T2 (de) 1997-08-21
DE69125936D1 (de) 1997-06-05
MY108640A (en) 1996-10-31
DE69131501D1 (de) 1999-09-09
AU7907391A (en) 1991-12-31
EP0532667A4 (en) 1993-12-22
PT97818A (pt) 1993-06-30
PT97816A (pt) 1993-06-30
GB2259830B (en) 1994-11-16
ES2108046T3 (es) 1997-12-16
AU8072591A (en) 1991-12-31
SG79895A1 (en) 2001-04-17
EP0532635B1 (en) 1997-08-06
PT97811B (pt) 1999-05-31
EP0532672A1 (en) 1993-03-24
EP0533748A1 (en) 1993-03-31
DE69126665D1 (de) 1997-07-31
MY106816A (en) 1995-07-31
EP0532592B1 (en) 1998-01-21
JPH05507832A (ja) 1993-11-04
JPH05507823A (ja) 1993-11-04
EP0532672B1 (en) 1998-12-09
KR100195589B1 (ko) 1999-06-15
JPH05507593A (ja) 1993-10-28
WO1991019390A1 (en) 1991-12-12
EP0532652B1 (en) 1999-02-10
PT97815B (pt) 1998-12-31
JP2780869B2 (ja) 1998-07-30
ES2151217T3 (es) 2000-12-16
AU7996791A (en) 1991-12-31
EP0532592A4 (pt) 1994-01-05
JPH05507596A (ja) 1993-10-28
DE69130892D1 (de) 1999-03-25
PT102241A (pt) 2000-07-31
EP0533748B1 (en) 2001-11-21
SG64872A1 (en) 1999-05-25
EP0532682A1 (en) 1993-03-24
CN1036430C (zh) 1997-11-12
WO1991019388A1 (en) 1991-12-12
JP3145703B2 (ja) 2001-03-12
HU9203768D0 (en) 1993-04-28
IN177990B (pt) 1997-03-01
EP0532711A4 (en) 1993-12-15
RU2119187C1 (ru) 1998-09-20
KR0183367B1 (ko) 1999-05-01
SG81864A1 (en) 2001-07-24
JPH05507827A (ja) 1993-11-04
DE69127193T2 (de) 1997-12-18
MY107482A (en) 1995-12-31
EP0533738B1 (en) 1997-08-13
PT97813A (pt) 1993-06-30
DE69127286T2 (de) 1998-01-02
EP0532676B1 (en) 1999-08-04
HK1004588A1 (en) 1998-11-27
EP0540548A1 (en) 1993-05-12
EP0532635A4 (en) 1993-12-22
CA2082260C (en) 2002-01-22
SG96156A1 (en) 2003-05-23
EP0540548A4 (en) 1993-11-24
EP0532652A1 (en) 1993-03-24
EP0532676A4 (en) 1993-11-24
CN1041879C (zh) 1999-01-27
JPH05508521A (ja) 1993-11-25
CN1057149A (zh) 1991-12-18
MY106666A (en) 1995-07-31
CN1057142A (zh) 1991-12-18
JP3420234B2 (ja) 2003-06-23
CN1057373A (zh) 1991-12-25
MY106812A (en) 1995-07-31
EP0532711A1 (en) 1993-03-24
CN1057147A (zh) 1991-12-18
DE4191157C2 (de) 1996-06-13
PT97810B (pt) 1998-12-31
SG91239A1 (en) 2002-09-17
AU8083991A (en) 1991-12-31
CN1034465C (zh) 1997-04-02
PT97809A (pt) 1993-06-30
TW252257B (pt) 1995-07-21
WO1991019394A1 (en) 1991-12-12
AU8064391A (en) 1991-12-31
CN1057144A (zh) 1991-12-18
WO1991019400A1 (en) 1991-12-12
DE69132376D1 (de) 2000-09-21
TW243575B (pt) 1995-03-21
KR100191409B1 (en) 1999-06-15
EP0532635A1 (en) 1993-03-24
DE69132349D1 (de) 2000-09-07
WO1991019384A1 (en) 1991-12-12
EP0533738A1 (en) 1993-03-31
CN1057372A (zh) 1991-12-25
EP0532615A1 (en) 1993-03-24
EP0532592A1 (en) 1993-03-24
CN1039372C (zh) 1998-07-29
ES2124703T3 (es) 1999-02-16
FI925436A (fi) 1992-11-30
DE4191157T1 (de) 1993-10-07
MY106821A (en) 1995-07-31
KR100190247B1 (ko) 1999-06-15
EP0532653A1 (en) 1993-03-24
MY111161A (en) 1999-09-30
WO1991019381A1 (en) 1991-12-12
MY106517A (en) 1995-06-30
WO1991019399A1 (en) 1991-12-12
WO1991019398A1 (en) 1991-12-12
AU8211591A (en) 1991-12-31
CN1057150A (zh) 1991-12-18
GB2259830A (en) 1993-03-24
JP3354927B2 (ja) 2002-12-09
EP0532667B1 (en) 1997-08-06
DE69125834T2 (de) 1997-07-31
WO1991019380A1 (en) 1991-12-12
KR100195591B1 (ko) 1999-06-15
KR100195361B1 (ko) 1999-06-15
SG55018A1 (en) 1998-12-21
PT97817B (pt) 1998-12-31
WO1991019378A1 (en) 1991-12-12
HUT64662A (en) 1994-01-28
AU7960791A (en) 1991-12-31
DE4191166C2 (de) 2002-07-18
GB9012326D0 (en) 1990-07-18
CN1034461C (zh) 1997-04-02
EP0533748A4 (en) 1993-11-24
AU8087191A (en) 1991-12-31
EP1130909A2 (en) 2001-09-05
JP3247373B2 (ja) 2002-01-15
KR100195364B1 (ko) 1999-06-15
WO1991019393A1 (en) 1991-12-12
JPH05507597A (ja) 1993-10-28
JPH05507822A (ja) 1993-11-04
EP0532583A1 (en) 1993-03-24
AU8186091A (en) 1991-12-31
JP2005130515A (ja) 2005-05-19
DE69130892T2 (de) 1999-07-01
DE69127897D1 (de) 1997-11-13
PT97808A (pt) 1993-06-30
JPH05508061A (ja) 1993-11-11
CN1034545C (zh) 1997-04-09
DE69127193D1 (de) 1997-09-11
KR100195359B1 (ko) 1999-06-15
DE69132376T2 (de) 2001-02-01
ES2128319T3 (es) 1999-05-16
KR930701061A (ko) 1993-03-16
MY110220A (en) 1998-03-31
CN1057143A (zh) 1991-12-18
EP0540548B1 (en) 1997-04-23
CN1052601C (zh) 2000-05-17
CN1034544C (zh) 1997-04-09
EP0532665A4 (en) 1993-11-24
DE69127286D1 (de) 1997-09-18
EP0532665A1 (en) 1993-03-24
KR100195590B1 (ko) 1999-06-15
WO1991019379A1 (en) 1991-12-12
JP3699373B2 (ja) 2005-09-28
PT97811A (pt) 1993-08-31
AU8185891A (en) 1991-12-31
ES2100232T3 (es) 1997-06-16
EP0532676A1 (en) 1993-03-24
DE69127897T2 (de) 1998-03-05
MY106670A (en) 1995-07-31
JP3228420B2 (ja) 2001-11-12
SG82550A1 (en) 2001-08-21
KR100195357B1 (ko) 1999-06-15
PT97809B (pt) 1998-12-31
US5289284A (en) 1994-02-22
DE69132822D1 (de) 2002-01-03
DE69125834D1 (de) 1997-05-28
AU8076891A (en) 1991-12-31
CN1052600C (zh) 2000-05-17
PT97819B (pt) 1998-12-31
DE69127194T2 (de) 1997-12-18
CN1034462C (zh) 1997-04-02
EP0532672A4 (en) 1993-12-22
EP1130909A3 (en) 2001-10-24
PT97814A (pt) 1993-06-30
JP3373509B2 (ja) 2003-02-04
WO1991019395A1 (en) 1991-12-12
ES2165841T3 (es) 2002-04-01
DE69132822T2 (de) 2002-04-11
PT97817A (pt) 1993-08-31
TW223215B (pt) 1994-05-01
DE69128784D1 (de) 1998-02-26
EP0532583B1 (en) 1998-07-15
KR100195362B1 (ko) 1999-06-15
DE69129806T2 (de) 1998-11-19
SG63585A1 (en) 1999-03-30
KR100202157B1 (ko) 1999-06-15
DE69127194D1 (de) 1997-09-11
ES2118085T3 (es) 1998-09-16
FI925436A0 (fi) 1992-11-30
HU225277B1 (en) 2006-08-28
MY110244A (en) 1998-03-31
AU8059091A (en) 1991-12-31
BR9106539A (pt) 1993-05-25
SG80522A1 (en) 2001-05-22
DE69131501T2 (de) 1999-11-18
DE69130610T2 (de) 1999-05-06
ES2106082T3 (es) 1997-11-01
CN1057146A (zh) 1991-12-18
JP3298876B2 (ja) 2002-07-08
JP3251581B2 (ja) 2002-01-28
EP0532583A4 (en) 1993-11-24
JPH05508522A (ja) 1993-11-25
CN1057138A (zh) 1991-12-18
KR100195588B1 (ko) 1999-06-15
JP3333191B2 (ja) 2002-10-07
PT97815A (pt) 1993-08-31
EP0532615B1 (en) 2000-08-02
GB9223471D0 (en) 1993-01-13
DE69130610D1 (de) 1999-01-21
PT97819A (pt) 1993-06-30
EP0532615A4 (en) 1993-11-24
EP0532653B1 (en) 1997-06-25
FI100931B (fi) 1998-03-13
DE69126665T2 (de) 1997-12-11
ES2106083T3 (es) 1997-11-01
PT97812A (pt) 1993-06-30
JP3333189B2 (ja) 2002-10-07
PT102241B (pt) 2003-07-31
JPH06502748A (ja) 1994-03-24
KR930701064A (ko) 1993-03-16
EP0532682A4 (en) 1993-12-01
MY107487A (en) 1995-12-30
EP0533738A4 (en) 1993-12-01

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Effective date: 19980902