JPH05507831A - スキューイングディザシーケンス - Google Patents

Abstract

(57)【要約】本公報は電子出願前の出願データであるため要約のデータは記録されません。

Description

【発明の詳細な説明】 スキューイングディザシーケンス この発明は異なる源からの実質的に同じサイズで同等の画質を持つ画面を横に並 べて表示することができるテレビジョンの分野に関し、特に、ワイド表示フォー マット比のスクリーンを有する上記のようなテレビジョンに関するものである。

今日のテレビジョンのほとんどのものは、水平な幅対垂直の高さが４：３のフォ ーマット表示比を持っている。ワイドフォーマット表示比は映画の表示７オーマ ノト比、例えば１６・９により近く対応する。

この発明は直視型テレビジョン及び投写型テレビジョンの両方にＭ泪可能である 。

４：３、しばしば４Ｘ３とも称するフォーマット表示比を持つテレビジョンは、 単一のビデオ信号源と複数のビデオ信号源を表示する方法に限界がある。実験的 なものを除いて、商業放送局のテレビジョン信号の伝送は４×３のフォーマット の表示比で放送される。多くの視聴者は、４×３表示フォーマントは、映画に関 係するより広いフォーマット表示比よりも良くないと考える。ワイドフォーマッ ト表示比のテレビジョンは、より心地よい表示を行うだけでなく、ワイド表示フ ォーマットの信号源を対応するワイド表示フォーマットで表示することができる 。映画は、切り詰められたり、歪められたりすることなく、映画のように見える 。ビデオ源は、例えばテレン不装置によってフィルムからビデオに変換される場 合、あるいは、テレビジョンのプロセッサによっても、切り詰める必要がない。

ワイド表示フォーマット比のテレビジョンは、通常の表示フォーマット信号とワ イド表示フォーマット信号の両方を種々の形で表示すること、及びこれらのフォ ーマントの信号を多画面表示の形で表示するのに適している。

しかし、ワイド表示比のスクリーンを用いることには多くの問題が伴う。そのよ うな問題の中で一般的なものには、複数の信号源の表示フォーマット比の変更、 非同期ではなるが同時表示されるビデオ信号源から一致したタイミング信号を生 成すること、多画面表示を行うための、複数信号源間の切換え、圧縮データ信号 から高解像度の画面を生成することがある。この発明の種々の構成によるワイド スクリーンテレビジョンは、同じまたは異なるフォーマット比を有する単−及び 複数ビデオ信号源から高解像度の単−及び複数画面表示を、選択可能な表示フォ ーマット比で表示できる。この発明は、特に、圧縮データ信号から高解像度の画 面を提供することを目的とする。

通常のフォーマット表示比を有するテレビジョン装置を、例えば２つのビデオ源 からの複数画面の表示が行えるようにすることができる。これらのビデオ源は、 テレビジョンのチューナ、ビデオカセットレコーダのチューナ、ビデオカメラそ の他である。しばしばピクチャ・イン・ピクチャ（画面白画面）（ＰＩＦ）と称 されるモードでは、テレビジョンのチューナが、スクリーンあるいは表示額域の 大部分を占める画面を供給し、副ビデオ源が、概して、大きい方の画面の境界内 に入る小さい挿入画面を供給する。ワイドスクリーンテレビジョン装置における ＰＩＦ表示モードか第１図（Ｃ）に示されている。

多くの場合、挿入画面は多数の異なる位置に配置させることかできる。別の表示 モードは、しばしばチャンネル走査と呼ばれるもので、各々が異なるチャンスル 源から供給される多数の小さな画面が、静止画面（フリーズフレーム）合成（モ ンタージュ）として、スクリーンを埋める。この場合、少なくともサイズに関し て主となる画面はない。ワイドスクリーンテレビジョン装置におけるチャンネル 走査表示モードが第１図（ｉ）に示されている。ワイドスクリーンテレビジョン 装置では、この他の表示モードも可能である。その１つは、ピクチャ・アウトサ イド・ピクチャ（画面外画面）（ＰＯＰ）と呼ばれるものである。このモードで は、数枚の挿入副画面が主画面と共通の境界を共有するようにできる。ワイドス クリーンテレビジョン装置におけるＰＯＰモードを第１図（ｆ）に示す。特にワ イドスクリーンテレビジョンに適した別のモードは、異なるビデオ源、例えば、 ２つの異なるチャンネルからの実質的に同じサイズの画面を横に並べて表示する サイド・パイ・サイド（並置）画面である。ワイドスクリーンテレビジョンにお けるこのモードを、２つの４：３ビデオ源について第１図（ｄ）に示す。

このモードはＰＯＰモードの特殊なケースと考えることができる。

非同期ビデオ信号の同期化には、しばしば、一方の信号の相続くフィールドを１ またはそれ以上のフィールドメモリに記憶しなければならない。メモリのスペー スに制限がある場合、容量に制限のあるフィールドメモリへの記憶を可能とする ために記憶信号のデータを圧縮したり、あるいは、他方のビデオ信号よりも低い サンプリング周波数でデータをサンプルする必要が生じることがある。その結果 、特に、記憶された画面が普通は小さいＰＩＦあるいはＰＯＰより大きい場合、 画面を表示する時の、記憶ビデオ信号に対する量子化解像度が低くなってしまう 。主及び副ビデオ信号が横に並べられて同じ大きさで表示される、前述した並置 画面モードでは、２つの画面を簡朧に見較べただけでも、副画面の量子化解像度 の方が低いことが明らかである。この発明の構成によれば、異なるビデオ源から の画面を、例えばワイドスクリーンテレビジョン上に、一方の信号の量子化解像 度が低い場合でも実質的に同等の画質で横に並べて表示することができる。

この発明の別の構成によれば、異なる状況下で最適の画質が得られるように、複 数の解像度増強構成の中の１つを選択できるようにされている。これら解像度増 強構成には、ディザリング、ディザリングとディザリング（ｄｅｄｉｔｈｅｒｉ ｎｇ）　、ディザ・シーケンスのスキューイング、及び、ペアド（ｐａｉｒｅｄ ）・ピクセルの置換及び再構成が含まれている。デジタルビデオ信号においてビ ットを節約するためのディザリング技術は、例えば、ライリス氏に与えられた米 国特許第４．５９４．７２６号に記載されている。

通常、これらの解像度増強構成は、広帯域信号においては１サンプルにつき１ビ ツト、広帯域ビデオ信号中で搬送される狭帯域信号においてはｌサンプル当たり 数ビットを節約しようとするものである。

この発明の構成によるディザリング技法は、広帯域ビデオ信号においてｌサンプ ルにつき２ビツトを節約する。

この構成によれば、ディザ信号がｎビットのビデオ信号に加えられる。加算器は オーバフローを防止するためにリミッタを含む必要がある。サンプルは加算後に 切捨てが行われる。切捨て処理においては、単純に最下位の２ビツトが切捨てら れる。通常、ディザ値は信号の直流成分を増加させる傾向のある小さい正の整数 である。切捨て処理は直流成分を減少させる傾向があり、事実、一般には、ディ ザ信号は上記増加を減少で相殺するために生成される。サブサンプルされた信号 を大幅に改善することのできるディザ信号は２周波数ディザで、高い方の周波数 が高い振幅を持つものである。この発明の構成によれば、ディザ信号は、任意の 順序の数ＯＳ　ｌ　２．３からなる繰返しシーケンスと定義できる。そのような ディザノーケンスの１つは、 ０．２．１，３．０．２．１．３、・・・・等である。このディザシーケンスは 別の２つの７−ケンス、特表千５−５０７８３１　（３） 即ち ０．２．０．２．０．２．０，２、・・・・と、 ０．０．１，１．０．０．１．１１・・・・の和である。例えば、０．２．１． ３．０．２、ｌ、３、・・・・によるディザリングの選択は、より高い周波数の ディザの方が、低い周波数のディザよりも感知されにくいという結論に基づいて いる。

４分の１周波数成分は２分の１周波数成分の２分の１の振幅しかないにもかかわ らず、２分の１周波数成分よりも不快である。従って、ディザリング構成は４分 の１周波数成分のみを抑圧するように選択できる。ディザリング回路の第１の信 号路は遅延及び振幅整合用である。

第２の信号路は、反転帯域通過フィルタとリミタとの組合わせを含んでいる。反 転帯域通過フィルタは、通過帯域の中心の周波数が、遅延及び振幅整合された元 の信号に加算される時、この周波数を打消す。リミタは、ディザサイズの振幅の みが打消されるようにするものである。

このディザリング構成は、ディザリング処理された信号のサンプル周波数の２分 の１の周波数の成分には何らの影響も及ぼさない。２分の１周波数信号成分は、 振幅が低く、信号のナイキスト限界にあり、従って、その可視性は、問題の発生 を避けるに充分に低い。

ある場合には、ディザシーケンスをスキューすることにより、ディザ処理あるい はディザ／デディザ処理されたビデオ信号知覚される画質を改善することができ る。

１ビツトシーケンスであれ、２ピットン−ケンスであれ、ディザシーケンスは、 ある与えられた線では連続的に繰返えされるか、異なる線では位相シフトされる 。多くのスキューイング構想が可能である。２つのスキニーイングシーケンスが ディザリング処理自体によって生じる表示中のアーティファクトを隠すために特 に有用である。

１ビクセル・フィールド−フィールド・スキュー及び２ビクセル・フィールド− フィールド・スキューというのは、１つのフィールドの線の全てが同じ位相を持 ち、次のフィールドの線の全てが第１のフィールドに対してｌビクセルまたは２ ビクセル分スキニーされているものである。２ビツトデイザ処理された信号に対 するフィールド間スキニーは静止画面に対して最も有効に働く。生のビデオにお いては、動きの中に平板な領域がある時に、ある程度の線構造が見えることがあ る。信号にデデイザ処理が施される場合には、２ビツトデイザにはｌピクセルス キューが特に有効であるが、信号がデディザ処理されない場合には、現在のとこ ろでは、２ピクセルスキユーが推奨される。信号をデデイザすべきか否かは、表 示フォーマットによって決まる。

第１図（ａ）〜（ｉ）は、ワイドスクリーンテレビジョンの種々の表示フォーマ ットの説明に有用である。

第２図は、この発明の種々の態様に従うワイドスクリーンテレビジョンの２ｆａ の水平走査で動作するようにしたもののブロック図である。

第３図は、第２図に示すワイドスクリーンプロセッサのブロック図である。

第４図は、第３図に示すワイドスクリーンプロセッサの詳細を示すブロック図で ある。

第５図は、第４図に示す画面内画面プロセッサのブロック図である。

第６図は、第４図に示すゲートアレーのブロック図で、主信号路、副信号路、出 力信号路を示している。

第７図と第８図は、充分に切り詰めた信号を用いた第１図（ｄ）に示す表示フォ ーマットの発生の説明に用いるタイミング図である。

第９図は、第６図の主信号路をより詳細に示すブロック図である。

第１Ｏ図は、第６図の副信号路をより詳細に示すブロック図である。

第１１図は、第５図の画面内画面プロセッサのタイミング−制御部のブロック図 である。

第１２図は、ｉｆイー２ｆｌＩ変換における内部２ｆ、Ｉ信号を発生する回路の ブロック図である。

第１３図は、第２図に示す偏向回路用の組合わせブロック及び回路図である。

第１４図は、第２図に示すＲＧＢインターフェースのブロックである。

第１５図と第１６図は、それぞれ、第４図と第１０図の解像度処理回路を具体化 するための、１ビツトディザリング回路と１ビットデディザリング回路のブロッ ク図である。

第１７図と第１８図は、それぞれ、第４図と男ＩＣ・文の解像度処理回路を具体 化するための、２ビツトディザリング回路と２ビットデディザリング回路のブロ ック図である。

第１９図は、第１５図〜第１８図に示す回路の動作を増強するためのスキューイ ング構成を説明するための表である。

第２０図は、第４図と第１０ｒＩ！Ｊの解像度処理回路を具体化するための別の 代替構成を説明するための表である。

第１図のそれぞれは、この発明の異なる構成に従って実現できる単−及び複数画 面表示フォーマットの種々の組合わせの中のいくつかのものを示す。説明のため に選んだこれらのものは、この発明の構成に従うワイドスクリーンテレビジョン を構成するある特定の回路の記述を容易にするためのものである。図示と、説明 の便宜上、一般に、ビデオ源、あるいは、ビデオ信号に関する通常の表示フォー マットの幅対高さ比は４×３であるとし、一般に、ビデオ源、あるいは、ビデオ 信号に関するワイドスクリーン表示フォーマットの幅対高さ比は、１６×９であ るとする。この発明の構成は、これらの定義によって制限されるものではない。

第１図（ａ）は、４×３の通常のフォーマントの表示比を有する直視型、あるい は、投写型テレビジョンを示す。１６×９フオ一マツト表示比画面が４×３フオ 一マツト表示比信号として伝送される場合は、上部と下部に黒符表千５−５０７ ８３１　（４） のバーが現れる。これを一般に郵便受け（レターボックス）７オーマツトと呼ぶ 。この場合、観察される画面は表示に使用できる表示面積に関して小さい。別の 方法としては、１６×９フオ一マツト表示比の源が伝送に先立って変換されて、 ４Ｘ３フオ一マツト表示器の観察面の垂直方向を満たすようにされる。しかし、 その場合は、かなりの情報が左及び／または右側から切捨てられてしまう。さら に別の方法では、郵便受はフォーマットを水平方向には引伸ばさずに、垂直方向 に引伸ばすことができるが、こうすると、垂直方向に引伸ばしたことにより歪み が生ずる。これらの３つの方法のどれも特に魅力的であるとはいえない。

第１図（ｂ）は１６×９のスクリーンを示す。１６×９のフォーマットの表示比 のビデオ源は、切り詰めすることなく、歪みを伴うことなく完全に表示される。

１６×９フオ一マント表示比の郵便受は画面（これは、元来４×３フオ一マｙト 表示比信号であるカリは、充分な垂直解像度を有する大きな表示を行うように、 線倍化（ラインダブリング）または線追加（ラインアディション）によって順次 走査される。この発明によるワイドスクリーンテレビジョンは、主ビデオ源、副 ビデオ源、あるいは外部ＲＧＢ源に関係なく、このような１６×９フオ一マツト 表示比信号を表示できる。

第１図（Ｃ）は、４×３フオ一マツト表示比の挿入画面か挿入表示されている１ ６×９フオ一マツト表示比の主信号を示す。主及び副のビデオ信号か両方共、１ ６×９フオ一マツト表示比源である場合は、挿入画面も１６×９フオ一マツト表 示比を持つ。挿入画面は多数の異なる位置に表示することができる。

第１図（ｄ）は、主及び副ビデオ信号が同じサイズの画面として表示されてる表 示フォーマットを示す。各表示領域は８×９のフォーマット表示比を有し、これ は、当然ながら、１６×９とも４×３とも異なる。このような表示領域に、水平 あるいは垂直歪みを伴うことなく４×３フオ一マント表示比源を表示するために は、信号の左及び／または右側を切り詰めねばならない。画面を水平方向に詰込 む（ｓｑｕｅｅｚｅン　ことによるある程度のアスペクト比歪みを我慢するなら 、画面のもっと多くの部分を表示できる。水平方向の詰め込みの結果、画面中の 事物は垂直方向に細長くなる。この発明のワイドスクリーンテレビジョンは、ア スペクト比歪みを全く伴わない最大の切り詰め処理から最大のアスペクト比歪み を伴う無切り詰めまでの、切り詰めと７スペクト比歪みの任意の組合わせを行う ことができる。

Ｗ１１ビデオ信号処理路のデータサンプリング制限があると、主ビデオ信号から の表示と同じ大きさの高解像度画面の生成が複雑になる。このような複雑化を解 消するために種々の方法を開発できる。

第１図（ｅ）は、４×３フオーマツトの表示比画面が１６×９フオ一マツト表示 比スクリーンの中央に表示されている表示フォーマットを示す。黒色のバーか左 右両側に現れている。

第１図（ｆ）は、１つの大きな４×３フオ一マツト表示比画面と３つの小さい４ ×３フオ一マツト表示比画面か同時に表示される表示フォーマットを示す。大き い画面の周辺の外側の小さい画面は、時には、ＰＩＦ、即ち、画面内画面（親子 画面）ではなく、ＰＯＰ、即ち、画面外画面と呼ばれる。ＰＩＦまたは画面内画 面（ピクチャ・イン・ピクチャ）という語は、この明細書中では、これら２つの 表示フォーマントに用いられている。ワイドスクリーンテレビジョンに２つのチ ューナか設けられている場合、両方共内部に設けられている場合でも１つが内部 に、１つが外部、例えば、ビデオカセットレコーダに設けられている場合でも、 表示画面の中の２つは、ビデオ源に従ってリアルタイムで動きを表示できる。残 りの画面は静止画面フォーマットで表示できる。さらにチューナと副信号処理路 とを付加すれば、３以上の動画面を表示できることは理解できよう。また、大画 面と３つの小画面の位置を第１図（ｇ）に示すように切換えることも可能である 。

第１図（ｈ）は、４×３フオ一マツト表示比画面を中央に表示して、６つの小さ い４×３フオ一マツト表示比画面を両側に縦列に表示した別のものを示す。上述 したフォーマットと同様、２つのチューナを備えたワイドスクリーンテレビジョ ンであれば、２つの動画面を表示できる。そして、残りの１１画面は静止画面フ ォーマットで表示されることになる。

第１図（ｉ）は、１２の４×３フオ一マツト表示比画面の基盤目状表示フォーマ ントを示す。このような表示フォーマットは、特に、チャンネル選択ガイドに適 しており、その場合、各画面は異なるチャンネルからの少なくとも静止した画面 である。前の例と同様、動きのある画面の数は、利用できるチューナと信号処理 路の数によって決まる。

第１図に示した種々のフォーマットは一例であって、限定的なものではなく、残 りの図面に示され、以下に詳述するワイドスクリーンテレビジョンによって実現 できる。

この発明の構成によるワイドスクリーンテレビジョンで、２ｆ、Ｉ水平走査用と されたものの全体的なブロック図が第２図に示されており、全体をｌＯで示され ている。

テレビジョン１０は、概略的に言えば、ビデオ信号入力部２０、シャーンまたは ＴＶマイクロプロセッサ２１６、ワイドスクリーンプロセッサ３０．１　ｆ　Ｍ 　−２ｆイ変換器４０、偏向回路５０、ＲＧ　Ｂ　イン９７　ニー　７．６０、 ＹＵＶ−ＲＧＢ変換器２４０、映像管駆動回路２４２、直視型または投写型１ｆ ２４４　、及び、電源７０を含んでいる。種々の回路の異なる機能ブロックへの グループ化は、説明の便宜を図るためのものであって、このような回路相互間の 物理的位置関係を限定することを意図するものではない。

ビデオ信号入力部２０は、異なるビデオ源からの複数の複合ビデオ信号を受信す るようにされている。ビデオ信号は主ビデオ信号及び副ビデオ信号として、選択 的に切換えることができる。ＲＦスイッチ２０４は２つのアンチ線放送アンテナ による受信とケーブルからの受信の両方のための入力を表わす。ＲＦスイッチ２ ０４は、第１のチューナ２０６と第２のチューナ２０８に、どちらのアンテナ入 力を供給するかを制御する。第１のチューナ２０６の出力は、ワンチップ２０２ への入力となる。ワンチップ２０２は、同調制御、水平及び垂直偏向制御、ビデ オ制御に関係する多数の機能を果たす。図示のワンチップは産業用のＴ　Ａ　７ ７７７である。第１のチューナ２０６からの信号からワンチップで生成されたベ ースバンドビデオ信号ＶＩＤＥＯＯＵＴはビデオスイッチ２００とワイドスクリ ーンプロセッサ３０のＴＶ１入力への入力となる。ビデオスイッチ２００への他 のベースバンドビデオ入力はＡＵＸＩとＡＵＸ　２で示されている。これらの入 力は、ビデオカメラ、レーザディスクプレーヤ、ビデオテーププレーヤビデオゲ ーム等に用いることができる。シャーシまたはＴＶマイクロプロセッサ２１６に よって制御されるビデオスイッチ２００の出力は５ＷＩＴＣＨＥＤ　ＶＩＤＥＯ と示されている。この５ＷＴＴＣＨＥＤ　ｖＩＤＥＯはワイドスクリーンプロセ ッサ３０へ別の入力として供給される。

第３図を参照すると、スイッチＳＷＩワイドスクリーンプロセッサは、Ｙ／Ｃデ コーダ２】０への入力となるＳＥＬ　ＣＯＭＰ　ＯＵＴビデオ信号として、ＴＶ ｌ信号と５ＷＩＴＣＨＥＤ　ＶＴＤＥＯ信号の一方を選択する。

Ｙ／Ｃデコーダ２１０は適応型線くし形フィルタの形で実現できる。Ｙ／Ｃデコ ーダ２１０へは、さらに２つのビデオ源Ｓｌと８２も入力される。ＳＬと８２の 各々は異なる５−ＶＨ３源を表わし、各々、別々のルミナンス信号及びクロミナ ンス信号から成っている。い（つかの適応型線くし形フィルタでＹ／Ｃデコーダ の一部として組込まれているような、あるいは、別のスイッチとして実現しても よいスイッチがＴＶマイクロプロセッサ２１６に応答して、ＹＭ及びＣＩＮとし て示した出力として、一対のルミナンス及びクロミナンス信号を選択する。選択 された対をなすルミナンス及びクロミナンス信号は、その後は、主信号として見 なされ、主信号路に沿って処理される。−Ｍあるいは−ＭＮを含む信号表記は主 信号路を表わす。クロミナンス信号ＣＩＮはワイドスクリーンプロセッサによっ て、再びワンチップに返され、色差信号ＵＭ及びＶ　Ｍか生成される。ここで、 Ｕは（Ｒ−Ｙ）と同等のものを表わし、■は（Ｂ−Ｙ）と同等である。ＹＭ、Ｕ Ｍ及びＶＭ倍信号、その後の信号処理のために、ワイドスクリーンプロセッサで デジタル形式に変換する。

機能的にはワイドスクリーンプロセッサ３０の一部と定義される第２のチューナ ２０８がベースバンドビデオ信号ＴＶ２を生成する。スイッチＳＷ２が、Ｙ／Ｃ デコーダ２２０への入力として、ＴＶ２信号とＳＷＭ　ＴＣＨＥＤＶＩＤＥＯ信 号の１つを選ぶ。Ｙ／Ｃデコーダ２２０は適応型線くし形フィルタとして実施で きる。スイッチＳＷ３とＳＷ４が、Ｙ／Ｃデコーダ２２０のルミナンス及びクロ ミナンス出力と、それぞれＹ　ＥＸＴとＣＥＸＴで示す外部ビデオ源のルミナン ス及びクロミナンス信号の一方を選択する。Ｙ　ＥＸＴ及びＣＥＸＴ信号は、５ −ＶＨ３人力人力Ｓ対応するＹ／Ｃデコーダ２２０とスイッチＳＷ３とＳＷ４は 、いくつかの適応型線くし形フィルタで行われているように、組合わせてもよい 。スイッチＳＷ３とＳＷ４の出力は、この後は、副信号と考えられて、副信号路 に沿って処理される。選択されたルミナンス出力はＹＡとして示されている。− Ａ、ＡＸ及び−ＡＵＸを含む信号表記は副信号路に関して用いられている。選択 されたクロミナンスは色差信号ＵＡとＶ−Ａに変換される。ＹＡ信号、ＵＡ倍信 号びＶＡ倍信号、その後の信号処理のためにデジタル形式に変換される。主及び 副信号路中でビデオ信号源の切換えを行う構成により、異なる画面表示フォーマ ットの異なる部分についてのビデオ源選択をどのようにするかについての融通性 が大きくなる。

ＹＭに対応する複合同期信号ＣＯＭＰ　５ＹＮＣがワイドスクリーンプロセッサ から同期分離器２１２に供給される。水平及び垂直同期成分ＨとＶが垂直カウン トダラン回路２１４に入力される。垂直カウントダウン回路はワイドスクリーン プロセッサ３０に供給されるＶＥＲＴ　ＩＣＡＬ　ＲＥＳＥＴ（垂直リセット） 信号を発生する。

ワイドスクリーンプロセッサは、ＲＧＢインタフェース６０に供給される内部垂 直リセット出力信号ＩＮＴ　ＶＥＲＴ　Ｒ３Ｔ　ＯＵＴを発生する。ＲＧＢイン タフェース６０中のスイッチが、内部垂直リセット出力信号と外部ＲＧＢ源の垂 直同期成分との間の選択を行う。このスイッチの出力は偏向回路５０に供給され る選択された垂直同期成分ＳＥＬ　ＶＥＲＴ　５ＹＮＣである。副ビデオ信号の 水平及び垂直同期信号は、ワイドスクリーンプロセッサ中の同期分離器２５０に よって生成される。

ｌ　ｆＭ　−２ｆＭ変換器４０は、飛越し走査ビデオ信号を順次走査される非飛 越し信号に変換する働きをする。例えば、水平線の各々が２度表示されるとか、 あるいは、同じフィールド中の隣接水平線の補間によって付加的な水平線の組が 生成される。いくつかの例においては、前の線を用いるか、補間した線を用いる かは、隣接フィールドまたは隣接フレーム間で検出される動きのレベルに応じて 決められる。変換回路４０はビデオＲＡ　Ｍ　４２０と関連して動作する。ビデ オＲＡＭは、順次表示を行うために、フレームの１またはそれ以上のフィールド を記憶するために用いられる。Ｙ　２ｆ、、Ｕ　２ｆ、及びＶ−２ｆ＋信号とし ての変換されたビデオデータはＲＧＢインタフェース６０に供給される。

第１４図に詳細に示されているＲＧＢインタフェース６０は、ビデオ信号入力部 による表示のための、変換ビデオデータまたは外部ＲＧＢビデオデータの選択を 可能とする。外部ＲＧＢ信号は２ｆＭ走査用に適合させられたワイドフォーマッ ト表示比信号とする。主信号の垂直同期成分はワイドスクリーンプロセッサによ ってＲＧＢインタフエースニ対し、ＩＮＴ　ＶＥＲＴ　Ｒ３Ｔ　ＯＵＴとして供 給されて、選択された垂直同期（ｆ　Ｙｓまたはｆ　ｖ、、、）を偏向回路５０ に供給できるようにする。このワイドスクリーンテレビ）５１ンの動作によって 、内部／外部制御信号ＩＮＴ／ＥＸＴを発生させて、外部ＲＧＢ信号の使用者に よる選択を可能とする。しかし、このような外部ＲＧＢ信号が存在しない場合に 、外部ＲＧＢ信号入力を選択すると、ラスタの垂直方向の崩壊、及び、陰極線管 または投写型管の損傷が生じる可能性がある。従って、ＲＧＢインタフェース回 路は存在しない外部ＲＧＢ入力の選択を無効とするために、外部同期信号を検出 する。ＷＳＰマイクロプロセッサ３４０も、外部ＲＧＢ信号に対するカラー及び 色調制御を行う。

ワイドスクリーンプロセッサ３０は、副ビデオ信号の特殊な信号処理を行うピク チャ・イン・ピクチャプロセッサ３２０を含んでいる。画面内画面という用語は 、時には、ＰＩＦあるいはピクス・イン・ピクス（ｐｉｘ−ｉｎ　ｐｉｘ）と省 略される。ゲートアレー３００が、第１図（ａ）〜第１図（１）の例で示されて いるような、種々の表示フォーマットで主及び副ビデオ信号データを組合わせる 。画面内画面プロセッサ３２０とゲートアレー３００はワイドスクリーンマイク ロプロセッサ（ＷＳＰ　μＰ）３４０の制御下にある。マイクロプロセッサ３４ ０は、直列バスを介してＴＶマイクロプロセッサ２１６に応動する。この直列バ スは、データ、クロック信号、イネーブル信号及びリセ・ノド信号用の４本の信 号ラインを含んでいる。ワイドスクリーンプロセッサ３０は、また、３レベルの サンドキャッスル（砂で作った城）信号として、複合垂直ブランキング／リセッ ト信号を発生する。あるいは、垂直ブランキング信号とリセット信号は別々の信 号として生成してもよい。複合ブランキング信号はビデオ信号入力部によってＲ ＧＢインタフェースに供給される。

第１３図にさらに詳細に示す偏向回路５０はワイドスクリーンプロセッサから垂 直リセット信号を、ＲＧＢインタフェース６０から選択された２ｆ１＋水平同期 信号を、また、ワイドスクリーンプロセッサから付加的な制御信号を受けとる。

この付加制御信号は、水平位相合わせ、垂直サイズ調整及び左右ビン調整に関す るものである。偏向回路５０は２ｆイフライバツクパルスをワイドスクリーンプ ロセッサ３０．１　ｆＭ−２ｆＭ変換器４０及びＹＵＶ−ＲＧＢ変換器２４０に 供給する。

ワイドスクリーンテレビジョン全体に対する動作電圧は、例えば、ＡＣ主電源に より付勢するようにできる電源７０によって生成される。

ワイドスクリーンプロセッサ３０を第３図により詳細に示す。ワイドスクリーン プロセッサの主要な成分は、ゲートアレー３００、画面白画面回路３０１、アナ ログ−デジタル変換器とデジタル−アナログ変換器、第２のチューナ２０８、ワ イドスクリーンプロセッサ・マイクロプロセッサ３４０及びワイドスクリーン出 力エンコーダ２２７である。１ｆｌＩおよび２ｆｏシヤーンの両方に共通のワイ ドスクリーンプロセッサの詳細な部分、例えば、ＰＩＦ回路、が第４図に示され ている。ＰＩＦ回路３０１の重要な部分を構成する画面内画面プロセッサ３２０ は第５図により詳細に示されている。また、第６図には、ゲートアレー３００が より詳細に示されている。第３図に示した、主及び副信号路の部分を構成する多 数の素子については、既に詳細に記述した。

第２のチューナ２０８には、ＩＦ段２２４とオーディオ段２２６が付設されてい る。また、第２のチューナ２０８はＷＳＰ　μＰ３４０と共に動作する。ＷＳＰ 　μＰ３４０は入／出力Ｉ１０部３４０Ａとアナログ出力部３４０Ｂとを含んで いる。１１０部３４０Ａは色調（ティント）制御信号とカラー制御信号、外部Ｒ ＧＢビデオ源を選択するためのＩＮＴ／ＥＸＴ信号、及び、スイッチ５ＷＩ−３ ＷＳ用の制御信号を供給する。Ｉ１０部は、また、偏向回路と陰極線管を保護す るために、ＲＧＢインタフェースからのＥＸＴ　５ＹＮＣＤＥＴ信号をモニタす る。アナログ出力部３４０Ｂは、それぞれのインタフェース回路２５４、２５６ および２５８を通して、垂直サイズ、左右調整及び水平位相用制御信号を供給す る。

ゲートアレー３００は主及び副信号路からのビデオ情報を組合わせて、複合ワイ ドスクリーン表示、例えば、第１図の異なる部分に示されているものの１つを作 る働きをする。ゲートアレー用のクロック情報は、低域通過フィルタ３７６と協 同して動作する位相ロックループ３７４によって供給される。主ビデオ信号はア ナログ形式で、ＹＭ、ＵＭ及びＶＭで示した信号として、ＹＵＶフォーマットで ワイドスクリーンプロセッサに供給される。

これらの主信号は、第４図により詳細に示すアナログ−デジタル変換器３４２と ３４６によってアナログからデジタでおり、これらは、Ｒ−Ｙまたは、Ｂ−Ｙ信 号、あるいは、Ｉ及びＱ信号に付すことができる。システムクロック周波数は１ ０２４ｆＮ、これは約１６ＭＨｚである、なので、サンプルされたルミナンスの 帯域幅は８　Ｍ　Ｈｚに制限される。Ｕ及びＶ信号は５００ＫＨｚ、あるいは、 ワイド■については１．５　Ｍ　Ｈｚ　ｌ：制限されるので、カラー成分データ のサンプルは、１つのアナログ−デジタル変換器とアナログスイッチで行うこと ができる。このアナログスイッチ、即ち、マルチプレクサ３４４のための選択線 ＵＶＭＵＸは、システムクロックを２で除して得た８ＭＨ２の信号である。１ク ロック幅の線開始ＳＯＬパルスが、特表千５−５０７８３１　（７） 各水平ビデオ線の始点でこの信号を同期的にＯにリセットする。ついで、ＵＶ　 ＭＵＸ線は、その水平線を通して、各クロックサイクル毎に状態が反転する。線 の長さはクロックサイクルの偶数倍なので、−見切期化されると、ＵＶ　ＭＵＸ の状態は、中断されることなく、０、ｌ、０、ｌ・・・・と変化する。アナログ −デジタル変換器３４２と３４６からのＹ及びＵＶデータストリームは、アナロ グ−デジタル変換器が各々、ｌクロックサイクルの遅延を持っているので、シフ トしている。このデータシフトに対応するために、主信号処理路３０４の補間器 制御器からのクロックゲート情報も同じように遅延させられなければならない。

このクロックゲート情報が遅延していないと、削除が行われた時、ＵＶデータは 正しく対をなすように組合わされない。この点は、各ＵＶ対が１つのベクトルを 表すので、重要なことである。１つのベクトルからＵ成分は、他のベクトルから のＶ成分と対にすると、カラーシフトが生じてしまう。先行する対からのＶサン プルは、その時のリサンプルと共に削除される。このＵＶマルチプレクス法は、 各カラー成分（Ｕ、Ｖ）サンプル対に対しで２つのルミナンスサンプルがあるの で、２：１：１と称される。Ｕ及びＶの双方に対するナイキスト周波数はルミナ ンスのナイキスト周波数の２分の１に実効的に減じられる。従って、ルミナンス 成分に対するアナログ−デジタル変換器の出力のナイキスト周波数は８ＭＨｚと なり、一方、カラー成分に対するアナログ−デジタル変換器の出力のナイキスト 周波数は４　Ｍ　Ｈｚとなる。

ＰＩＦ回路及び／またはゲートアレーは、データ圧縮をしても副データの解像度 か増強されるようにする手段を含むことかできる。例えば、対（ベアド）ビクセ ル圧縮及びディザリングとディザリングを含む、多くのデータ減縮及びデータ回 復構想が開発されている。さらに、ビット数が異なる異なったディザリングシー ケンスや、ビット数が異なる異なった対ピクセル圧縮が考えられている。多数の 特定のデータ減縮及び回復構想の１つをＷＳＰ　μＰ３４０によって選択して、 各特定の画面表示フォーマントについて表示ビデオの解像度を最大にするように することができる。これらの構想は第１５図〜第２０図に関連して、詳細に説明 する。

ゲートアレーは、ＦＩＦＯ３５６と３５８として実現できる線メモリと協同して 動作する補間器を含んでいる。補間器とＦＩＦ○は主信号を必要に応じて再サン プル（リサンプル）するために使用される。別に設けた補間器によって、副信号 を再サンプルできる。ゲートアレー中のクロック及び同期回路が主及び副信号を 組合わせて、ＹＭＸ、ＵＭＸ及びＶ　ＭＸ成分を有する１つの出力ビデオ信号を 作ることを含む、主及び副の両信号のデータ操作を制御する。上記出力成分はデ ジタル−アナログ変換器３６０　、３６２及び３６４によってアナログ形式に変 換される。Ｙ、Ｕ及びＶで示すアナログ形式の信号は、非飛越し走査への変換の ために、１　ｆ、Ｉ　２　ｆＭ変換器４０に供給される。また、Ｙ、Ｕ及びＶ信 号はエンコーダ２２７によってＹ／Ｃフォーマットに符号化されて、パネルのジ ャックに、ワイドフォーマット比出力信号ＹＯＵＴ　ＥＸＴ　／ＣＯＵＴ　ＥＸ Ｔが生成される。スイッチＳＷ５が、エンコーダ２２７のための同期信号を、ゲ ートアレーからのＣ５ＹＮＣＭＮと、ＰＩＦ回路からのＣ５ＹＮＣＡＵＸから選 択する。スイッチＳＷ６は、ワイドスクリーンパネル出力用の同期信号として、 ＹＭとＣ５ＹＮＣＡＵＸのどちらかを選択する。

水平同期回路の部分がより詳細に第１２図に示されている。位相比較器２２８は 、低域通過フィルタ２３０、電圧制御発振器２３２、除算器２３４及びキャパシ タ２３６を含む位相ロックループの一部をなしている。電圧制御発振器２３２は 、セラミック共振器または同等のもの２３８に応動して、３２ｆＩＩで動作する 。電圧制御発振器の出力は、３２で除算されて、適切な周波数の第２の入力信号 として位相比較器２２８に供給される。分周器２３４の出力はｌｆＭＲＥＦタイ ミング信号である。３２ｆ＋＋ＲＥＦタイミング信号と１ｆＩＩＲＥＦタイミン グ信号は１６分の１カウンタ４００に供給される。２ｆ、出力がパルス幅回路４ ０２に供給される。分周器４００を１ｆ、ＩＲＥＦ信号によってプリセットする ことにより、この分局器は、確実に、ビデオ信号入力部の位相ロックループと同 期的に動作する。パルス幅回路４０２は２ｆイ−ＲＥＦ信号が、位相比較器４０ ４、例えば、ＣＡ　１３９１が適正な動作を行うようにするために充分なパルス 幅を持つようにする。位相比較器４０４は、低域通過フィルタ４０６と２ｆＩ＋ 電圧制御発振器４０８を含む第２の位相ロックループの一部を構成している。電 圧制御発振器４０８は内部２ｆ、Ｉタイミング信号を発生し、この信号は順次走 査される表示器を駆動するために用いられる。位相比較器４０４への他方の入力 信号は、２ｆ、フライバックパルスまたはこれに関係付けられたタイミング信号 である。位相比較器４０４を含む第２の位相ロックループを用いることは、入力 信号の各ｌｆｉ期間内で各２ｆｓ走査周期を対称になるようにするために役立つ 。このようにしなかった場合は、ラスタの分離、例えば、ビデオ線の半分が右に シフトし、ビデオ線の半分か左にシフトするというようなことが起きる。

第１３図には、偏向回路５０が詳細に示されている。回路５００は、異なる表示 フォーマットを実現するために必要な垂直過走査の所要量に応じてラスタの垂直 のサイズを調整するために設けられている。線図的に示すように、定電流源５０ ２が垂直ランプキャパシタ５０４を充電する一定量の電流１　貢ｈｍｐを供給す る。トランジスタ５０６が垂直ランプキャパシタに並列に結合されており、垂直 リセット信号に応じて、このキャパシタを周期的に放電させる。

いかなる調整もしなければ、電流Ｉ　ＲＡＭＰは、ラスタに最大可能な垂直サイ ズを与える。これは、第１図（ａ）に特表千５−５０７８３１　（８） 示すような、拡大４×３フオ一マツト表示比信号源によりワイドスクリーン表示 を満たすに必要とされる垂直過走査の大きさに対応する。より小さな垂直ラスタ サイズが必要とされる場合は、可調整電流源５０８がＩ　ＲＡＭＰから可変量の 電流Ｉ　ＡＩＪを分流させて、垂直ランプキャパシタ５０４をよりゆっくりと、 より小さなピーク値まで充電する。可変電流源５０８は、垂直サイズ制御回路に よって生成された、例えば、アナログ形式の、垂直サイズ調整信号に応答する。

垂直サイズ調整５００は手動垂直サイズ調整５１０から独立しており、この手動 垂直サイズ調整は、ボテンンヨメータあるいは背面パネル調整ノブによって行う ことができる。いずれの場合でも、垂直偏向コイル５１２は適切な大きさの駆動 電流を受ける。水平偏向は、位相調整回路５１８、左右ピン補正回路５１４．２ ｆ、位相ロックループ５２０及び水平出力回路５１６によって与えられる。

第１４図には、ＲＧＢインタフェース６０がより詳しく示されている。最終的に 表示される信号が、１ｆ１１−２ｆ。

変換器４０の出力と外部ＲＧＢ入力から選択される。ここで述べるワイドスクリ ーンテレビジョンを説明するために、外部ＲＧＢ入力をワイドフォーマット表示 比の順次走査源であるとする。外部ＲＧＢ信号とビデオ信号入力部２０からの複 合ブランキング信号がＲＧＢ−ＹＵＶ変換器６１０に入力される。外部ＲＧＢ信 号に対する外部２ｆＨ複合同期信号が外部同期信号分離器６００に入力される。

垂直同期信号の選択はスイノ千６０８によって行われる。

水平同期信号の選択はスイッチ６０４によって行われる。

ビデオ信号の選択はスイッチ６０６によって行われる。スイッチ６０４．６０６ ．６０８の各々はＷＳＰ　μＰ３４０によって生成される内部／外部制御信号に 応答する。内部ビデオ源を選択するか外部ビデオ源を選択するかは、利用者の選 択である。しかし、外部ＲＧＢ源が接続されていない、あるいは、ターンオンさ れていない時に、使用者か不用意にそのような外部源を選択した場合、あるいは 、外部源がなくなった場合は、垂直ラスタが崩れ、陰極線管に重大な損傷を生じ させる可能性がある。そこで、外部同期検出器６０２が外部同期信号の存在を検 出する。この信号がない場合には、スイッチ無効化制御信号が各スイッチ６０４ ．６０６．６０８に送られ、外部ＲＧＢ源からの信号がない時に、このような外 部ＲＧＢ源が選択されることを防止する。ＲＧＢ−ＹＵＶ変換器６１０も、ＷＳ ＰμＰ３４０から色調及びカラー制御信号を受ける。

この発明の構成によるワイドスクリーンテレビジョンを、図示はしていないが、 ２ｆｏ水平走査の代わりにｌｆＨ水平走査で実施することもできる。Ｉｆ、回路 を用いれば、ｌｆｉ　２ｆｇ変換器もＲＧＢインタフェースも不要となる。従っ て、２ｆｓ走査周波数の外部ワイドフォーマット表示比ＲＧＢ信号の表示のため の手段はなくなることになる。Ｉｆ□回路用のワイドスクリーンプロセッサと画 面内画面プロセッサは非常に類似したちのとなる。ゲートアレーは実質的に同じ でよいが、全ての入力と出力を用いることはないであろう。ここに記載する種々 の解像度増強構想は、一般的に言って、テレビジョンかｌｆ、Ｉ走査で動作しよ うと、２ｆ、走査で動作しようと関係なく採用できる。

第４図は、Ｉｆ、Ｉ及び２ｆｇンヤーシの両方について同じとすることができる 、第３図に示したワイドスクリーンプロセッサ３０をさらに詳細に示すブロック 図である。

ＹＡＳＵＡ及びＶＡ倍信号、解像度処理回路３７０を含むことのできる画面内画 面プロセッサ３２０の入力となる。この発明の一態様によるワイドスクリーンテ レビジョンは、ビデオの伸張及び圧縮ができる。第１図にその一部を示した種々 の複合表示フォーマブトにより実現される特殊効果は画面内画面プロセッサ３２ ０によって生成される。このプロセッサ３２０は、解像度処理回路３７０からの 解像度処理されたデータ信号Ｙ　ＲＰ、Ｕ　ＲＰ及びＶ　ＲＰを受信するように 構成できる。解像度処理は常に必要なわけではなく、選択された表示フォーマッ ト中に行われる。第５図に、画面内画面プロセッサ３２０がさらに詳細に示され ている。画面内画面プロセッサの主要成分は、アナログ−デジタル変換器部３２ ２、入力部３２４、高速スイッチ（ＦＳＷ）及びバス部３２６、タイミング及び 制御部３２８、及びデジタル−アナログ変換部３３０である。タイミング及び制 御部３２８の詳細が第１１図に示されている。

画面白画面プロセッサ３２０は、例えば、トムソン・コンンユーマ争エレクトロ ニクス・インコーホレーテッドにより開発された基本ＣＰＩＰチップを改良した ものとして実施できる。この基本ＣＰＩＰチップの詳細は、インディアナ州イン ディアナポリスのトムソン・コンシューマ・エレクトロニクス・インコーホレー テッドから発行されているｒＴｈｅ　ＣＴＣ１４０Ｐｉｃｔｕｒｅ　ｉｎ　Ｐｉ ｃｔｕｒｅ　（ＣＰＩＰ）Ｔｅｃｈｎｉｃａｌ　Ｔｒａｉｎｉｎｇ　Ｍａｎｕａ ｌ　（ＣＴＣ１４０画面内画面（ＣＰＩＰ）技術トレーニング　マニュアル）」 に記載されている。

多数の特徴あるいは特殊効果が可能である。次はその一例である。基本的な特殊 効果は、第１図（ｃ）に示すような、大きい画面上に小さい画面が置かれたもの である。

これらの大小の画面は同じビデオ信号あるいは別のビデオ信号からでもよく、ま た、入れ換えもできる。一般に、オーディオ信号は常に大きい画面に対応するよ うに切換えられる。小画面はスクリーン上の任意の位置に動がすこともできるし 、あるいは、多数の子め定められた位置に移させることができる。ズーム効果は 、小画面のサイズを、例えば、多数の子め設定されたサイズの任意のものへ大き くしたり小さくする。ある点において、例えば、第１図（ｄ）に示す表示フォー マットの場合、大小の画面は同じ大きさとなる。

単一画面モード、例えば、第１図（ｂ）、第１図（ｅ）あるいは第１図（ｆ）に 示すモードの場合、使用者は、その単一画面の内容を、例えば、１．０１〜５． １１の特表千５−５０７８３１　（９） 比の範囲でステップ状にズーム・インすることができるズームモードでは、使用 者は画面内容をサーチし、あるいは、パンして、スクリーン上の画像を画面の異 なる領域内で動かすことができる。いずれの場合でも、小さい画面、大きい画面 あるいはズームした画面を静止画面（静止画面フォーマット）として表示できる 。この機能により、ビデオの最後の９フレームを繰返しスクリーン上に表示する ストロボフォーマットが可能となる。フレームの繰返し率は、１秒につき３ｏフ レームから０フレームまで変えることができる。

この発明の別の構成によるワイドスクリーンテレビジョンで使用される画面白画 面プロセッサは上述した基本的なＣＰＩＰチップの現在の構成とは異なる。基本 的ＣＰＩＰチップを１６×９スクリーンを有するテレビジョンと使用する場合で 、ビデオスピードアップ回路を用いない場合は、広いＩ６×９スクリーンを走査 することによって、実効的に水平方向に４７３倍の拡大が生じ、そのために、ア スペクト比歪みが生じてしまう。画面中の事物は水平方向に細長くなる。外部ス ピードアップ回路を用いた場合は、アスペクト比歪みは生じないが、画面がスク リーン全体に表示されない。

通常のテレビジョンで使用されているような基本ＣＰＩＰチップを基にした既存 の画面白画面プロセッサは、ある望ましくない結果を伴う特別な態様で動作させ られる。入来ビデオは、主ビデオ源の水平同期信号にロックされた６４０ｆＩ＋ のクロックでサンプルされる。即ち、ＣＰＩＰチンプに関連するビデオＲＡＭに 記憶されたデータは、入来するＷ１１ビデオ源に対しオーソゴナルに（ｏｒｊｈ −ｏｇｏｎａｌｌｙ）にサンプルされない。これが基本ＣＰＩＰ法によるフィー ルド同期に対する根本的な制限である。入力サンプリング率の非オーソゴナルな 性質のために、サンプルされたデータにスキニーエラーが生じてしまう。

この制限は、ビデオＲＡＭを、データの書込みと読出しに同じクロックを使わね ばならないＣＰＩチップと共に用いた結果である。例えばビデオＲＡ　Ｍ　３５ ０のようなビデオＲＡＭからのデータが表示される時は、スキューエラーは、画 面の垂直端縁に沿ったランダムなジッタとして現れ、一般には、非常に不快であ ると考えられる。

基本ＣＰＩＰチップと異なり、この発明の構成に従う画面白画面プロセッサ３２ ０は、複数の選択可能な表示モードの１つで、ビデオデータを非対称に圧縮する ように変更されている。この動作モードでは、画面は水平方向に４＝１で圧縮さ れ、垂直方向には３：１で圧給される。

この非対称圧縮モードにより、アスペクト比歪みを有する画面が生成されて、ビ デオＲＡＭに記憶される。画面中の事物は水平方向に詰め込まれる。しかし、こ れらの画面が通常の通り、例えば、チャンネル走査モードで、読出されて、１６ Ｘ９フオ一マツト表示比スクリーン上に表示されると、画面は正しく見える。こ の画面はスクリーンを満たし、アスペクト比歪みはない。この発明のこの態様に よる非対称圧縮モードを用いると、外部スピードアップ回路を用いることなく、 １６×９のスクリーン上に特別の表示フォーマットを生成することが可能となる 。

第１Ｉ図は、例えば、上述したｃｐｒｐチップを変更した画面白画面プロセッサ のタイミング及び制御部３２８のブロック図であり、このタイミング及び制御部 ３２８は、複数の選択可能な表示モードの１つとしての非対称圧縮を行うための デシメーション（ｄｅｃｉｍａｔｉｏｎ）回路３２８ｃを含んでいる。残りの表 示モードは異なるサイズの副画面を生成できる。水平及び垂直デシメーション回 路の各々はＷＳＰ　μＰ３４０の制御の下に値のテーブルから圧縮係数をめるよ うにプログラムされたカウンタを含んでいる。値の範囲は１．１．２：１．３： １等とすることができる。圧縮係数は、テーブルをどのように構成するかに応じ て対称的にも非対称にもできる。圧縮比の制御は、ＷＳＰ　μＰ３４０の制御下 で、完全にプログラマブルな汎用デシメーション回路によって行うことができる 。

全スクリーンＰＩＦモードでは、自走発振器３４８と共に働（画面白画面プロセ ッサは、例えば適応影線くし形フィルタとすることのできるデコーダからＹ／Ｃ 入力を受取り、この信号をＹ、Ｕ、Ｖカラー成分に復号し、水平及び垂直同期パ ルスを生成する。これらの信号は、ズーム、静止、チャンネル走置などの種々の 全スクリーンモードのために、画面白画面プロセッサで処理される。

例えば、チャンネル走査モード中、ビデオ信号久方部からの水平及び垂直同期は 、サンプルされた信号（異なるチャンネル）が互いに関連性のない同期パルスを 有し、また、見かけ上、時間的にランダムな時点で切換えられるので、何度も中 断するであろう。従って、サンプルクロック（及び読出し／書込みビデオＲＡＭ クロック）は自走発振器によって決められる。静止及びズームモード用には、サ ンプルクロックは入来ビデオ水平同期信号にロックされる。これらの特別なケー スでは、入来ビデオ水平同期の周波数は表示クロック周波数と同じである。

再び第４図を参照すると、画面内画面プロセッサからのアナログ形式のＹ、Ｕ、 ＶおよびＣ５ＹＮＣ（複合同期）出力は、エンコーダ回路３６６でＹ／Ｃ成分へ 再符号化することができる。エンコーダ回路３６６は３．５８ＭＨｚ発振器３８ ０と協同して動作する。このＹ／ＣＰＩＰＥＳＣ信号は、再符号化Ｙ／Ｃ成分を 主信号のＹ／Ｃ成分の代わりに用いることを可能とするＹ／Ｃスイッチ（図示せ ず）に接続してもよい。この点以後、ＰＩＦ符号化骨化Ｕ、Ｖおよび同期信号が 、シャーシの残部における水平及び垂直タイミングの基礎となる。この動作モー ドは、主信号路中の補間器及びＦＩＦ○の動作に基づ＜ＰＩＦのズームモードの 実行に適している。

マルチチャンネルモード、例えば、第１図（ｉ）に示すモードでは、予め定めら れた走査リストの１２のチャンネルを同時に１２枚の小さな画面に表示できる。

画面内画面プロセッサは、３．５８ＭＨｚ発振器３４８に応答する内部クロック を持っている。入来副信号はアナログ形式からデジタル形式に変換され、選ばれ た特殊効果に応じて、ビデオＲＡ　Ｍ　３５０にロードされる。前述した技術ト レーニングマニュアルの例では、コンパイルされた特殊効果は、主信号ビデオデ ータと組合わせる前に、画面内画面プロセッサでアナログ形式に再変換される。

しかし、ここに記述するワイドスクリーンテレビジョンでは、１つには、利用で きる異なるクロック周波数の数に制限かあることにより、副データは、それ以上 画面内画面プロセッサ３２０による処理を受けることなく、ビデオＲＡＭ３５０ からの直接出力される。クロック信号の数を少なくすることにより、テレビジョ ンの回路中での無線周波数干渉を減じることができるという利点がある。

さらに第５図を参照すると、画面内画面プロセッサ３２０は、アナログ−デジタ ル変換部３２２、入力部３２４、高速スイッチＦＳＷ及びバス制御部３２６、タ イミング及び制御部３２８、及びデジタル−アナログ変換部３３０を含んでいる 。一般に、画面内画面プロセッサ３２０は、ビデオ信号をデジタル化してルミナ ンス（Ｙ）及び色差信号（ＵＳＶ）とし、その結果をサブサンプルして、上述し たような１メガビツトのビデオＲＡ　Ｍ　３５０に記憶させる。

画面内画面プロセッサ３２０に付設されているビデオＲＡＭ３５０は１メガビツ トのメモリ容量を持つが、これは、８ビツトサンプルでビデオデータの１フィー ルド全部を記憶するには充分な大きさではない。メモリ容量を増すことは、費用 がかかり、さらに複雑な操作回路構成が必要となるであろう。副チャンネルのサ ンプル当たりのビット数を少なくすることは、全体を通じて８ビツトサンプルで 処理される主信号に対して、量子化解像度、あるいは、帯域幅の減少を意味する 。この実効的な帯域幅減少は、副表示画面が相対的に小さい時は、通常問題とは ならないが、副表示画面が相対的に大きい、例えば、主表示画面と同じサイズの 場合は、問題となる可能性がある。解像度処理回路３７０が、副ビデオデータの 量子化解像度あるいは実効帯域幅を増強させるための１つまたはそれ以上の構想 を選択的に実施することができる。例えば、対ピクセル圧縮及びディザリングと 逆ディザリングを含む多数のデータ減縮及びデータ回復構想が開発されている。

ディザリング回路は、ビデオＲＡＭ３５０の下流、例えば、以下に詳述するよう に、ゲートアレーの副信号路中に配置する。さらに、異なるビット数を伴う異な るディザリングと逆ディザリングシーケンス、及び、異なるビット数の異なる対 ピクセル圧縮が考えられる。各特定の画面表示フォーマットに対して表示ビデオ の解像度を最大にするために、多数の特定データ減縮及び回復構想の１つをＷＳ Ｐ　μＰによって選ぶことができる。

ルミナンス及び色差信号は、８：１：１の６ビツトＹ１Ｕ、Ｖ形式で記憶される 。即ち、各成分は６ビツトサンプルに量子化される。色差サンプルの多対に対し ８個のルミナンスサンプルがある。画面内画面プロセッサ３２０は、入来ビデオ データが、入来副ビデオ同期信号にロックされた６４０ｆ＋＋クロック周波数で サンプルされるようなモードでは動作させられる。このモードでは、ビデオＲＡ Ｍに記憶されたデータはオーソゴナルにサンプルされる。データが画面内画面プ ロセッサのビデオＲＡＭ３５０から読出される時は、このデータは入来副ビデオ 信号にロックされた同じ６４０ｆ、クロックを用いて読出される。しかし、この データはオーソゴナルにサンプルされ記憶されるが、そして、オーソゴナルに読 出せるが、主及び副ビデオ源の非同期性のために、ビデオＲＡＭ３５０から直接 オーソゴナルには表示できない。主及び副ビデオ源は、それらが同じビデオ源か らの信号を表示している時のみ、同期していると考えられる。

ビデオＲＡＭ３５０からのデータの出力である副チャンネルを主チャンネルに同 期させるには、さらに処理を行う必要がある。第４図を再び参照すると、ビデオ ＲＡＭの４ビツト出力ポートからの８ビツトデータブロツクを耳組合わせするた めに、２つの４ビツトラツチ３５２Ａと３５２Ｂが用いられる。この４ビツトラ ツチは、データクロック周波数を１２８０ｆＭから６４Ｏｆ、Ｉに下げる。

一般には、ビデオ表示及び偏向系は主ビデオ信号に同期化される。前述したよう に、ワイドスクリーン表示を満たすようにするためには、主ビデオ信号はスピー ドアップされねばならない。副ビデオ信号は、第１のビデオ信号とビデオ表示と に、垂直同期せねばならない。副ビデオ信号は、フィールドメモリ中で１フィー ルド周期の何分の１かだけ遅延させ、線メモリで伸張させるようにすることがで きる。副ビデオデータの主ビデオデータへの同期化は、ビデオＲＡ　Ｍ　３５０ をフィールドメモリとして利用し、先入れ先出しくＦ　Ｉ　ＦＯ）線メモリ装！ ３５４を信号の伸張に利用することにより行われる。ＦＩＦＯ３５４のサイズは ２０４８Ｘ　８である。ＦＩＦＯのサイズは、読出し／書込みポインタの衝突（ ｃｏｌｌｉｓｉｏｎ）を避けるに必要であると合理的に考えられる最低線記憶容 量に関係する。読出し／書込みポインタの衝突は、新しいデータがＦＩＦＯに書 込まれ得る時がくる前に、古いデータがＦＩＦＯから読出される時に生じる。読 出し／書込みポインタの衝突は、また、古いデータがＦＩＦＯから読出される時 がくる前に、新しいデータがメモリを重ね書き（ｏｖｅｒｗｒｉｔｅ）する時に も生じる。。

ビデオＲＡ　Ｍ　３５０からの８ビツトのＤＡＴＡ　ＰＩＦデータブロックは、 ビデオデータをサンプルするために用いたものと同じ画面内画面プロセッサ６４ ０ｆＭクロック、即ち、主信号ではなく副信号にロックされた６４０ｆｇクロッ クを用いて２０４８ｘ　８　Ｆ　ｒ　Ｆ　Ｏ３５４に書込まれる。ＦＩＦＯ３５ ４は、主ビデオチャンネルの水平同期成分にロックされた１１０２４ｆの表示ク ロックを用いて読出される。互いに独立した読出し及び書込みボートクロックを 持った複数線メモリ（Ｆ　Ｉ　ＦＯ）を用いることにより、第１の周波数でオー ソゴナルにサンプルされたデー特表千５−５０７８３１　（１１） 夕を第２の周波数でオーソゴナルに表示することができる。しかし、読出し及び 書込み両クロックが非同期の性質を持っていることにより、読出し／書込みポイ ンタの衝突を避けるための対策をとる必要がない。

ゲートアレー３００は、ワイドスクリーンプロセッサ３０と３１の両方に共通で ある。主信号路３０４　、ＭＩＩ信号路３０６及び出力信号路３１２がブロック 図の形で第６図に示されている。ゲートアレーはさらに、クロック／同期回路３ ２０とＷＳＰ　ａＰデコーダ３１０を含んでいる。ＷＳＰμＰデコーダ３１０の ＷＳＰ　ＤＡＴＡで示したデータ及びアドレス出力ラインは、画面内画面プロセ ッサ３２０と解像度処理回路３７０と同様に、上述した主回路及び信号路にも供 給される。ある回路がゲートアレーの一部をなすかなさないかは、殆ど、この発 明の詳細な説明を容易にするための便宜上の事項である。

ゲートアレーは、異なる画面表示フォーマットを実行するために、必要に応じて 、主ビデオチャンネルを伸張し、圧縮し、あるいは、切り詰める作用をする。ル ミナンス成分Ｙ　ＭＮが、ルミナンス成分の補間の性質に応じた長さの時間、先 入れ先出しくＦ　Ｉ　ＦＯ）線メモリ３５６に記憶される。組合わされたクロミ ナンス成分Ｕ／Ｖ　ＭＮはＦＩＦＯ３５８に記憶される。副信号のルミナンス及 びクロミナンス成分Ｙ　ＰＩＰ、Ｕ　ＰＩＰ及びＶ　ＰＩＦはデマルチプレクサ ３５５によって生成される。

ルミナンス成分は、必要とあれば、回路３５７で解像度処理を受け、必要とあれ ば、補間器３５９によって伸張されて、出力として信号Ｙ　ＡＵＸが生成される 。

ある場合には、ｉｌ１表示が第１図（ｄ）に示すように主信号表示と同じ大きさ となることがある。画面内画面プロセッサ及びビデオＲＡ　Ｍ　３５０に付随す るメモリの制限のために、そのような大きな面積を満たすには、データ点、即ち 、ピクセルの数が不足することがある。そのような場合には、解像度処理回路３ ５７を用いて、データ圧縮あるいは減縮の際に失われたピクセルに置き代えるべ きピクセルを副ビデオ信号に回復することができる。この解像度処理は第４図に 示された回路３７θによって行われるものに対応させることができる。例えば、 回路３７０はディザリング回路とし、回路３５７をディザリング回路とすること ができる。

副ビデオ入力データは６４０ｆｎの周波数でサンプルされ、ビデオＲＡ　Ｍ　３ ５０に記憶される。副データはビデオＲＡＭ３５０から読出され、ＶＲＡＭ　Ｏ ＵＴとして示されている。ＰｉＰ回路３０１は、また、副画面を水平及び垂直方 向に、非対称に減縮することができると同時に、同じ整数の係数分の１に減縮す ることもできる。第１０図を参照すると、副チヤンネルデータは、４ビットラッ チ３５２Ａ、！：　３５２Ｂ、副Ｆ■Ｆｏ３５４、タイミング回路３６９及び同 期回路３６８によって、バッファされ主チヤンネルデジタルビデオに同期化され る。ＶＲＡＭ　ＯＵＴデータは、デマルチプレクサ３５５によって、Ｙ（ルミナ ンス）　、Ｕ、　Ｖ　（カラー成分）及びＦＳＷ　ＤＡＴ　（高速スイッチデー タ）に分類される。ＦＳＷ　ＤＡＴは、どのフィールド型式がビデオＲＡＭに書 込まれたかを示す。

ＰＩＰ　ＦＳＷ信号がＰＩＦ回路から直接供給され、ビデオＲＡＭから読出され たどのフィールドが小画面モード時に表示されるべきかを決めるために、出力制 御回路３２１に供給される。

副チャンネルは６４０ｆｘでサンプルされ、−畜生チヤンネルは１０２４　ｆ　 ｗでサンプルされる。ｉｌチャンネルＦＩＦ　Ｏ３５４は、データを、副チヤン ネルサンプル周波数から主チヤンネルクロック周波数に変換する。この過程にお いて、ビデオ信号は８１５（１０２４／６４０　）の圧縮を受ける。これは、副 チャンネル信号を正しく表示するに必要な４／３の圧縮より大きい。従って、副 チャンネルは、４×３の小画面を正しく表示するためには、補間器３５９によっ て伸張されねばならない。補間器３５９は補間器制御回路３７１によって制御さ れ、補間器制御回路３７１自身はＷ　Ｓ　Ｐ　ｕ　Ｐ　３４０に応答する。必要 とされる補間器による伸張の量は５／６である。伸張係数Ｘは次のようにして決 められる。

Ｘ＝　（６４０／１０２４）　＊　（４／３）　＝５／６クロミナンス成分Ｕ　 ＰＩＰとＶ　ＰＩＦは回路３６７によって、ルミナンス成分の補間の内容に応じ て決まる長さの時間遅延され、信号Ｕ　ＡＵＸとＶ　ＡＵＸが出力として生成さ れる。主信号と副信号のそれぞれのＹ１Ｕ及びＶ成分は、Ｆ　Ｉ　Ｆ　０３５４ ．３５６及び３５８ノ読出し縮することが必要となる。別のケースでは、通常は 垂直るスイッチは不要である。

す、データをＰＩＦ０３５６に書込むことができる。４個ジョン及びデータ繰返 しは同期的に行うことができる。

切換可能なビデオデータのトポロジーを用いて補間器とＦＩＦＯの位置の切換え を行わなければ、データの中断または繰返しのために、書込みまたは読出しクロ ックはダブルクロｙり（ｄｏｕｂｌｅ　ｃｌｏｃｋ）されねばならなくなってし まう。この「ダブルクロックされる」という語は、１つのクロックサイクル中に ２つのデータ点がＦＩＦＯに書込まれる、あるいは、１つのクロックサイクル中 に２つのデータ点がＦＩＦＯから読出されねばならないという意味である。その 結果、書込みまたは読出しクロック周波数がシステムクロック周波数の２倍とな らねばならないので、回路構成をシステムクロックに同期して動作するようにす ることはできない。さらに、この切換可能なトポロジーは圧縮と伸張の両方のｇ 的に対して、１つの補間器と１つのＦＩＦＯしか必要としない。ここに記載した ビデオ切換構成を用いなければ、圧縮と伸張の両機能を達成するために、２つの ＦＩＦＯを用いた場合のみ、ダブルクロッキングを避けることができる。その場 合は、伸張用の１つのＦＩＦＯを補間器の前に置き、圧縮用の１つのＦＩＦＯを 補間器の後に！く必要がある。

副信号の補間は副信号路３０６で行われる。ＰＩＦ回路３０１が、６ビツトＹＳ Ｕ、Ｖ、８　：　ｌ　：　１メモリであるビデオＲＡ　Ｍ　３５０を操作して、 入来ビデオデータを記憶させる。ビデオＲＡ　Ｍ　３５０はビデオデータの２フ ィールド分を複数のメモリ位置に保持する。各メモリ位置はデータの８ビツトを 保持する。各８ビツト位置には、１つの６ビツトＹ（ルミナンス）サンプルＣ６ ４０ｆＨでサンプルゴれたもの）と他に２つのビットがある。これら他の２ビツ トは、高速スイッチデータ（ＦＳＷ　ＤＡＴ）か、ＵまたはＶサンプル（８０ｆ ｇでサンプルされたもの）の一部かのいずれか一方を保持している。ＦＳＷ　Ｄ ＡＴの値は、どの型のフィールドがビデオＲＡＭに書込まれたかを示す。ビデオ ＲＡ　Ｍ　３５０にはデータの２フィールド分が記憶されており、全ビデオＲＡ 　Ｍ　３５０は表示期間中に読出されるので、両方のフィールドが表示走査期間 中に読出される。ＰＪＰ回路３０１は、高速スイッチデータを用いることにより 、どちらのフィールドをメモリから読出して表示すべきかを決める。２１２回路 は、動きの分断という問題を解決するために、常に、書込まれているものと反対 のフィールドの型を読出す。読出されているフィールドの型が表示中のものと逆 である場合は、ビデオＲＡＭに記憶されている偶数フィールドが、そのフィール ドがメモリから読出される時に、そのフィールドの最上部の線を削除して反転さ れる。その結果、小画面は動きの分断を伴うことなく正しいインターレースを維 持する。

クロック／同期回路３２０はＦ　Ｉ　Ｆ　０３５４．３５６及び３５８を動作さ せるために必要な読出し、書込み、及びイネーブル信号を発生する。主及び副チ ャンネルのためのＦＩＦＯは、各ビデオ線の後で表示するのに必要な部分につい てデータを記憶のために書込むようにイネーブルされる。データは、表示の同じ １つまたはそれ以上の線上で各課からのデータを組合わせるために必要とされる 、主及び副チャンネルのうちの一方（両方ではなく）から書込まれる。副チャン ネルのＦＩＦＯ３５４は副ビデオ信号に同期して書込まれるが、読出しは主ビデ オ信号に同期して行われる。主ビデオ信号成分は主ビデオ信号と同期してＦＩＦ Ｏ３５６と３５８に読込まれ、主ビデオに同期してメモリから読出される。主チ ャンネルと副チヤンネル間で読出し機能が切換えられる頻度は、選択された特定 の特殊効果の関数である。

切り詰め形の並置画面のような別の特殊効果の発生は、線メモリＦＩＦＯに対す る読出し及び書込みイネーブル制御信号を操作して行われる。この表示フォーマ ットのための処理が第７図と第８図に示されている。切り詰め並置表示画面の場 合は、副チャンネルの２０４８Ｘ　８　Ｆ　Ｉ　ＦＯ３５４に対する書込みイネ ーブル制御信号（ＷＲＥＮＡＸ）は、第７図に示すように、表示有効線期間の（ １／２）本（５／１２）　＝　５　／１２、即ち、約４１％（ポスト・スピード アップ（ｐｏｓｔ　５ｐｅｅｄ　ｕｐ）の場合）、または、副チャンネルの有効 線期間の６７％（ブリ・スピードアップ（ｐｒｅ　５ｐｅｅｄ　ｕｐ）の場合） の間、アクティブとなる。これは、約３３％の切り詰め（約６７％が有効画面） 及び補間器による５／６の信号伸張に相当する。第８図の上部に示す主ビデオチ ャンネルにおいては、９１０ｘ８ＦＴＰＯ３５６と３５８に対する書込みイネー ブル制御信号（ＷＲ−ＥＮ　ＭＮ　Ｙ）は、表示を動線期間の（１／２）＊（４ ／３）＝０．６７、即ち、６７％の間、アクティブとなる。

これは、約３３％の切り詰め、及び、９１０ｘ８ＦＩＦＯにより主チヤンネルビ デオに対して施される４／３の圧縮比に相当する。

ＦＩＦＯの各々において、ビデオデータは、ある特定の時点で読出されるように バッファされる。データを各ＦＩＦＯから読出すことのできる時間の有効領域は 、選んだ表示フォーマットによって決まる。図示した並置切り詰めモードの例に おいては、主チヤンネルビデオは表示の左半部に表示されており、副チヤンネル ビデオは表示の右半部に表示される。各波形の任意のビデオ部分は、図示のよう に、主及び副チャンネルで異なっている。主チャンネルの９１０ｘ８ＦＩＦＯの 読出しイネーブル制御信号（ＲＤ　ＥＮ　ＭＮ）は、ビデオバックポーチに直ち に続く有効ビデオの開始点で始まる表示の表示有効線期間の５０％の間、アクテ ィブである。副チヤンネル読出しイネーブル制御信号（ＲＤ　ＥＮ　ＡＸ）は、 ＲＤ−ＥＮ　ＭＮ信号の立下がりエツジで始まり、主チヤンネルビデオのフロン トポーチの開始点で終わる表示を動線期間の残りの５０％の間、アクティブとさ れる。書込みイネーブル制御信号は、それぞれのＦＩＦＯ入カデータ（主または 副）と同期しており、一方、読出゛しイネーブル制御信号は主チヤンネルビデオ と同期している。

第１図（ｄ）に示す表示フォーマットは、２つのほぼ全フィールドの画面を並置 フォーマットで表示できるので、特に望ましい。この表示は、特にワイドフォー マット表示比の表示、例えば、１６Ｘ９に有効でかつ適している。はとんどのＮ ＴＳＣ信号は４×３フオーマツトで表わされており、これは、勿論、１２×９に 相当する。２つの４×３フオ一マツト表示比のＮＴＳＣ画面を、これらの画面を ３３％切り詰めるか、または、３３％詰め込め、アスペクト比歪みを導入して、 同じ１６×９フオ一マツト表示比の表示器上に表示することができる。使用者の 好みに応じて、画面切り詰めとアスペクト比歪みとの比を０％と３３％の両限界 間の任意の点に設定できる。例えば、２つの並置画面を１６．７％詰め込み、１ ６．７％切り詰めて表示することができる。

コノ装置の動作を、スピードアップと切り詰めの一般的な比として説明すること ができる。ビデオ表示手段は、ＭＡＮの幅対高さの表示フォーマット比を持つと 考え、第１のビデオ信号源はＡ：Ｂの表示フォーマット比を持ち、第２ビデオ信 号源をＣ−Ｄの表示フォーマット比を持つと考えることができる。第１のビデオ 信号は、約１〜（Ｍ／Ｎ＋Ａ／Ｂ）の第１の範囲内にある係数で選択的にスピー ドアップされ、約０〜（（Ｍ／Ｎ＋Ａ／Ｂ）−１〕の第２の範囲内の係数で水平 方向に選択的に切り詰めることができる。第２のビデオ信号は約１〜（Ｍ／Ｎ　 ：　Ｃ／　Ｄ　）の第３の範囲内の係数で選択的にスピードアップされ、約Ｏ〜 Ｃ（Ｍ／Ｎ＋Ｃ／Ｄ）−１）の第４の範囲内の係数で選択的に水平方向に切り詰 めることができる。

１６×９７オーマプトの表示比の表示に要する水平表示時間は４Ｘ３フオーマツ トの表示比の表示の場合と同じである。なぜなら、両方共、正規の線の長さが６ ２．５μ秒だからである。従って、ＮＴＳＣビデオ信号は、歪みを生じさせるこ となく正しいアスペクト比を保持するためには、４／３倍にスピードアップされ ねばならない。この４／３という係数は、２つの表示フォーマットの比、４／３ ＝　（＋６／９）／　（４／３）として計算される。ビデオ信号をスピードアッ プするために、この発明の態様に従って可変補間器が用いられる。

過去においては、入力と出力において異なるクロック周波数を持つＦＩＦＯが、 同様の機能の遂行のために用いられていた。比較のために、２つのＮＴＳＣＸ３ フォーマット表示比信号が１つの４×３フオ一マツト表示比の表示器上に表示す るとすれば、各画面は５０％だけ、歪ませるか、切り詰めるか、あるいはその両 方を組合わせなければならない。ワイドスクリーン関係で必要とされるスピード アップに相当するスピードアップは不要である。

データ減縮、即ち、圧縮、及びデータ回復、即ち、伸張は、この発明の種々の構 成に従って、色々な方法で行うことかできる。１つの方法によれば、副信号を解 像度処理回路３７０で「ディザ」処理し、解像度処理回路３５７において「デデ ィザ（ｄｅｄｉｔｈｅｒ）Ｊ処理する。解像度処理回路３７０は、データ減縮回 路と考えることもでき、解像度処理回路３５７は、データ回復回路と考えること もできる。ディザリング（ディザ処理）は、ｎビットの信号にｍビットのディザ リングされたシーケンスが付加され、その後で、ｍ個の最下位ビットが切捨てら れる。第１５図と第１６図に、１ビツトディザリング回路とそれに対応する１ビ ットデディザリング回路が示されている。また、２ビツトディザリング回路と対 応する２ビットデデイザリング回路が、それぞれ第１７図と第１８図に示されて いる。

第１５図と第１６図を参照すると、加算回路３７２がｎビットの信号を１ビツト のディザシーケンスと組合わせる。

着用な１ビツトデイザシーケンスは、０１０１０１０１等である。このディザシ ーケンスをｌビット信号に加算した後、最下位ビットが回路３７４で切捨てられ る。次いで、ｎ−１ビツトのディザ処理された信号が画面白画面モジュール３２ ０１ラッチ３５２Ａ　、３５２Ｂ　、及びＦＩＦＯ３５４で処理される。画面白 画面デコーディング回路３０６Ｂの出力が１ビットディザ処理済信号である。デ ータ回復回路３５７においては、ｎ−１ビツトのディザ処理された信号が加算回 路８０２とＡＮＤゲート８０４の一方の入力に供給される。ＡＮＤゲート８０４ の他方の入力の信号は、ディザ処理された信号の最下位ビットをマスクする。Ａ ＮＤゲート８０４の出力は、排他的ＯＲゲート８０８の一方の入力に直接供給さ れ、また、回路８０６によって１クロック分、即ち、１ピクセル分の遅延を与え られた後に、他方の入力として排他的ＯＲゲート８０８に供給される。

排他的ＯＲゲート８０８の出力は、ＡＮＤゲート８１０への一方の入力となると 同時に、デディザ処理された信号の新しい最下位ビットとして、Ｙ補間器３５９ に入力される。

ＡＮＤゲート８１Ｏの他方の入力は、加算点３７２に供給されたディザリング信 号と同じディザシーケンスと同じ位相とを持った信号である。ＡＮＤゲート８１ ０の出力は加算回路８０２への減算入力となる。加算回路８０２の出力は、排他 的ＯＲゲート８０８の出力から供給される付加ビットと組合わされ、Ｙ補間器３ ５９への入力となるｎビットのデディザ処理された信号が生成される。

第１７図を参照すると、２ビツトディザリング回路３７０′は、ｎビット信号と ２ビツトのディザシーケンスとを組合わせる加算回路３７６を含んでいる。この 発明の構成によると、このディザ信号は、数０．１．２．３がシーケンス中で任 意の順序に配列された繰返しシーケンスと定義できる。この定義は、表１にリス トした次のシーケン特に、有利な２ビツトデイザシーケンスは、０２１３０２１ ３・・・・で、これは第１７図に示されている。加算回路３７６の出力であるｎ ビット信号は、その２つの最下位ビットが回路３７８によって切捨てられる。ｎ −２ビットディザ処理済信号は、画面白画面プロセッサ３２０、ラッチ３５２Ａ 、３５２Ｂ、　Ｆ　Ｉ　Ｆ　０３５４　、及び、画面白画面デコーディング回路 ３０６Ｂによって処理される。

４分の１周波数成分は２分の１周波数成分の振幅の２分の１であるにもかかわら ず、通常は、４分の１周波数成分の方が２分の１周波数成分よりも、不快である と思われる。従って、ディザリング構想としては、この４分の１周波数成分のみ を抑圧するように選定することができる。デディザリング回路の第１の信号路は 、遅延及び振幅の整合用のものである。第２の信号路は、反転帯域通過フィルタ とリミタとの組合わせを含んでいる。反転帯域通過フィルタは、遅延及び振幅の 整合が施された元の信号に付加された時に通過帯域の中心の周波数を相殺する。

リミタは、ディザサイズの振幅のみが相殺されるようにする。このディザリング 構成は、ディザ処理済信号のサンプル周波数の２分の１の成分には何らの影響も 及ぼさない。この２分の１周波数信号は、振幅は充分に低く、周波数が充分高い ので、可視性が充分低く、問題を生じさせることはない。

そのようなデディザリング回路３０６Ｄ′を第１８図に示特表千５−５０’７８ ３１　（１５） す。画面白画面デコーディング回路３０６Ｂの出力のｎ−２ビット信号は、２ク ロツクまたは２ビクセル遅延回路８２２．２クロツクまたは２ビクセル遅延回路 ８１４、及び加算回路８１２に入力として供給される。遅延回路８１４の出力は 加算回路８１２への減算入力となり、加算回路８１２の出力はｎ−１ビット信号 である。この１ビットディザ処理済信号は制御回路８１６への入力である。制限 回路の出力値は、この場合、〔−１，０，１〕に制限される。

これはｌの絶対値である。制限回路８１６の出力は２ビツトの信号で、これは２ クロツクまたは２ビクセル遅延回路８１８への入力として、また、加算回路８２ ０への減算入力として供給される。遅延回路８１８と加算回路８２０は、中心周 波数、これはサンプル周波数の１／４である、において、２の利得を持つ帯域通 過フィルタを形成する。

２ビット信号は２の補数信号である。加算回路８２０の出力は３ピント信号で、 加算回路８２６への減算入力となる。

遅延回路８２２のｎ−２ビツト出力は乗算器８２４の入力である。乗算器８２４ の出力はｎビットの信号で、その２つの最下位ビットがＯに等しいものである。

この２つの最下位ビットに対する値（及びいくつかの補正）が回路８２６におけ る加算によって与えられる。加算回路８２６の出力はｎビットの半デディザ処理 された信号で、これはＹ補間器３５９への入力となる。

ある場合には、ディザシーケンスをスキニーすることにより、ディザ処理された ビデオ信号の解像度、即ち、知覚される画質を改善することができる。ｌビット ン−ケンスであれ、２ビツトシーケンスであれ、ディザシーケンスは、ある与え られた線では連続的に繰返えされるか、異なる線では位相シフトされる。多くの スキューインゲン想が可能である。２つのスキューイングシーケンスがディザリ ング処理自体によって生じる表示中のアーティファクトを隠すために特に有用で ある。これらのスキューインゲン−ケンスが第１９図に示されている。１ビクセ ル・フィールド−フィールド・スキュー及び２ピクセル・フィールド−フィール ド・スキューというのは、１つのフィールドの線の全てが同じ位相を持ち、次の フィールドの線の全てが第１のフィールドに対して１ピクセルまたは２ビクセル 分スキューされているものである。

２ビツトデイザ処理された信号に対するフィールド間スキューは静止画面に対し て最も有効に働く。生のビデオにおいては、動きの中に平板な領域がある時に、 ある程度の線構造が見えることがある。信号にデディザ処理が施される場合には 、２ビツトデイザにはｌピクセルスキューが特に有効であるが、信号がデデイザ 処理されない場合には、現在のところでは、２ビクセルスキユーが推奨される。

信号をデディザすべきか否かは、表示フォーマントによって決まる。

データ減縮のためのディザリングに代わるものとして、ペアド（ｐａｉｒｅｄ） ピクセル圧線がある。これを第２０図を参照して説明する。１つのフィールドが 第２０図の上部に示されている。このフィールドは線１２．３・・・・を含んで いる。各線のピクセルが文字で示されている。「Ｐ」で示したピクセルは保持さ れ、一方「Ｒ」で示したピクセルは置換される。保持ピクセルと置換されるピク セルは線間で１ビクセルずつスキューされる。即ち、奇数番号の線では、置換さ れるピクセルは、２番目、４番目、６番目・・・・である。偶数番号の線では、 置換されるピクセルは、１番目、３番目、５番目・・・・である。主たる２つの 方法は、各置換ピクセルの代わりに１ビツトコードまたは２ビツトコードを用い る方法である。これらのコードのためのビットは、保持ピクセルを規定するため に用いることのできる多数のビットから取る。ピクセルを規定するために用い得 るビットの数はビデオプロセッサの記憶容量によって制限される。この場合、Ｃ ＰＩＰチップとビデオＲＡ　Ｍ　３５０が、平均して１ピクセルにつき４ビツト という制限を謀す。各置換ピクセルに対し、１ビツトコードを代わりに用いた場 合、各保持ピクセルには７ビツトを用いることができる。同様に、各置換ビット を２ビツトコードで置き換えた場合は、各保持ピクセルの記述には６ビツトを利 用できる。いずれの場合でも、相続くピクセルからなる多対（１つの保持ピクセ ルと１つの置換ピクセル）には、合計８ビツトが必要である。

１対当たり計８ビットは、１ビクセル当たり平均４ビツトのみである。データ減 縮は６：４〜７．４の範囲内となる。置換シーケンスが３本の連続する線、ｎ− １、ｎ。

ｎ＋１を含むフィールドの一部に示されている。置換されるべきピクセルは、Ｒ １、Ｒ２、Ｒ３、Ｒ４及びＲ５で示されている。保持されるべきピクセルは、Ａ ＳＢ。

Ｃ及びＤで示されている。

１ビツトコード構想によれば、ある置換ビクセルの値がその両側に位置するピク セルの平均値よりも、その上側のピクセルの値の方に近い時には、その置換ピク セルの代わりに０が置かれる。第２０図の例でいえば、ピクセルＲ３に対する置 換コードは、ピクセルＲ３の値がピクセルＡの値の方よりも、ピクセルＢとＣの 平均の値の方に近い時に０となり、それ以外では、１ビツト置換コードは１とな る。データが再構成された時には、ピクセルＲ３’の値は、１ビツトコードが０ の時は、ピクセルＢとＣの値の平均に等しくなる。１ビツトコードが１に等しい 時は、ピクセルＲ３’の値はピクセルＡの値と同じである。

同じく、２ビツトコードによる置換再構成シーケンスも示されている。ピクセル Ｒ３についていえば、２ビツト置換コードは、Ｒ３の値がピクセルＡの値に最も 近ければ０と等しい。Ｒ３の値が値ＡとＢの平均に最も近ければ、２ビツト置換 コードは１に等しい。Ｒ３の値が値ＡとＣの平均に最も近い時は、２ビツト置換 コードは２に等しい。Ｒ３の値が値ＢとＣの平均に最も近ければ、２ビツト置換 コードは３に等しい。再構成シーケンスは置換シーケンスに従う。２ビツトコー ドが０であれば、ピクセルＲ３’の値はへの値に等しい。２ビツトコードが１に 等しければ、ピクセルＲ３’の値はＡとＢの値の平均に等しい。２ビツトコード が２に等しい場合は、ピクセルＲ３’の値はピクセルＡとＣの値の平均に等しい 。

２ビツトコードか３に等しい場合は、ピクセルＲ３’の値はピクセルＢとＣの値 の平均に等しい。

１ビツトコードは、保持ビクセルが１ビット多い解像度で記述される点で有用で ある。２ビツトコードは置換ビクセルがより大きな解像度で記述される点で利点 がある。計算を２本の線のみの値、即ち、例えば、ｎ−１とｎ、あるいは、ｎと ｎ＋１の値のみに基づいて行うことは、必要な線記憶容量を小さくする点で有利 である。一方、計算に値りを含めるようにすれば、付加された線の分のビデオ記 憶容量が必要となるが、もっと正確な置換シーケンスが生成できる。ペアド・ビ クセル圧縮は、良好な水平及び垂直解像度を得るためには特に有効であり、ある 場合には、ディザリング及びデディザリング法よりも良い。一方、斜め方向の遷 移の解像度は、一般には、ディザリング及びデディザリング法はど良くはない。

この発明の構成によれば、例えば、ペアド・ビクセル圧糟法やディザリング及び デディザリング法を含む多数のデータ減縮、データ回復構想が得られる。さらに 、異なるビット数を用いた異なるディザリングシーケンスや、異なるビット数を 用いた異なるペアド・ピクセル圧縮も可能である。特定のデータ減轄及び回復構 成は、各特定のビデオ表示フォーマットについて表示ビデオの解像度が最大とな るように、ＷＳＰ　μＰによって選択することができる。

特表平５−５０７８３１　（１８） ＋１　へ　−一 一一一一一一一　−一一一一一コ　＼ 特表千５−５０７８３１　（２０） トー、。

要　約　書 ある場合には、ディザシーケンスをスキニーすることにより、ディザ処理あるい はディザ／デディザ処理されたビデオ信号知覚される画質を改善することができ る。

■ビットシーケンスであれ、２ビツトシーケンスであれ、ディザシーケンスは、 ある与えられた線では連続的に繰返えされるが、異なる線では位相シフトされる 。多くのスキューイング構想が可能である。２つのスキューイングシーケンスが ディザリング処理自体によって生じる表示中のアーティファクトを隠すために特 に有用である。

１ピクセル・フィールド−フィールド・スキュー及び２ピクセル・フィールド− フィールド・スキニ〜というのは、１つのフィールドの線の全てが同じ位相を持 ち、次のフィールドの線の全てが第１のフィールドに対して１ピクセルまたは２ ピクセル分スキューされているものである。２ビツトデイザ処理された信号に対 するフィールド間スキューは静止画面に対して最も有効に働く。生のビデオにお いては、動きの中に平板な領域がある時に、ある程度の線構造が見えることがあ る。信号にデディザ処理が施される場合には、２ビツトデイザにはＩピクセルス キューが特に有効であるが、信号がデディザ処理されない場合には、２ピクセル スキユーが特に有利である。

推奨される。信号をデディザすべきか否かは、表示フォーマットによって決まる 。

補正書の翻訳文提出書 （特許法第１８４条の８） 平成４年稔月１゛日ワＡ

Claims (12)

【特許請求の範囲】
1. １．量子化されたビデオ信号をディザ信号と組合わせる手段と； 上記ディザされた信号に切り捨て処理を施す手段と；上記ディザ信号にスキュー する手段と；を含むディザリングシステム。
2. ２．上記ディザ信号が線毎にスキューされる、請求項１のシステム。
3. ３．上記ディザ信号がフィールド毎にスキューされる、請求項１のシステム。
4. ４．上記ディザ信号が１ピクセルだけスキューされる、請求項１のシステム。
5. ５．上記ディザ信号が２ピクセルだけスキューされる、請求項１のシステム。
6. ６．上記ディザ信号が少なくとも２ピクセルだけスキューされる、請求項１のシ ステム。
7. ７．上記ディザ信号が１ピクセルだけスキューされる、請求項２のシステム。
8. ８．上記ディザ信号が２ピクセルだけスキューされる、請求項２のシステム。
9. ９．上記ディザ信号が少なくとも２ピクセルだけスキューされる、請求項２のシ ステム。
10. １０．上記ディザ信号が１ピクセルだけスキューされる、請求項３のシステム。
11. １１．上記ディザ信号が２ピクセルだけスキューされる、請求項３のシステム。
12. １２．上記ディザ信号が少なくとも２ピクセルだけスキューされる、請求項３の システム。