JPS60160780A - 特殊効果用画像記憶装置 - Google Patents

特殊効果用画像記憶装置

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JPS60160780A
JPS60160780A JP59016441A JP1644184A JPS60160780A JP S60160780 A JPS60160780 A JP S60160780A JP 59016441 A JP59016441 A JP 59016441A JP 1644184 A JP1644184 A JP 1644184A JP S60160780 A JPS60160780 A JP S60160780A
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JP
Japan
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data
read
storage circuits
address
written
Prior art date
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Pending
Application number
JP59016441A
Other languages
English (en)
Inventor
Kazuo Kashiki
樫木　和雄
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
NEC Corp
Original Assignee
NEC Corp
Nippon Electric Co Ltd
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Publication date
Application filed by NEC Corp, Nippon Electric Co Ltd filed Critical NEC Corp
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Priority to US07/105,514 priority patent/US4746979A/en
Pending legal-status Critical Current

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    • H—ELECTRICITY
    • H04—ELECTRIC COMMUNICATION TECHNIQUE
    • H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
    • H04N5/00—Details of television systems
    • H04N5/222—Studio circuitry; Studio devices; Studio equipment
    • H04N5/262—Studio circuits, e.g. for mixing, switching-over, change of character of image, other special effects ; Cameras specially adapted for the electronic generation of special effects
    • G—PHYSICS
    • G11—INFORMATION STORAGE
    • G11C—STATIC STORES
    • G11C8/00—Arrangements for selecting an address in a digital store
    • H—ELECTRICITY
    • H04—ELECTRIC COMMUNICATION TECHNIQUE
    • H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
    • H04N5/00—Details of television systems
    • H04N5/76—Television signal recording
    • H04N5/907—Television signal recording using static stores, e.g. storage tubes or semiconductor memories

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  • Multimedia (AREA)
  • Signal Processing (AREA)
  • Microelectronics & Electronic Packaging (AREA)
  • Image Input (AREA)
  • Studio Circuits (AREA)
  • Television Signal Processing For Recording (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 本発明はテレビジョン特殊効果装置に関し、特にＰＣＭ
化されたテレビジョン信号を処理する特殊効果用画像記
憶装置に関する。
テレビジョン画像信号ｅＰｃＭ化して、デジタル化記憶
装置に書込み、読出す過程において、書込みアドレスあ
るいは読出しアドレスを操作することによって、いろい
ろの特殊効果を発生させることができる。例えば脱出し
アドレスの進行スピードを書込みアドレスの進行スピー
ドの１／２にすれば、情報はゆっくシ読出されることに
なり、画像金２倍に拡大することができる。この時入力
画素情報に番号音ふってみると例えば１，２，３゜４・
・・・・・となるが、読出された時は１，１，２，２゜
３．３，４．４・・・・・・の如く同じｉｍｉ累情報が
２度くり返して表われることになる。しかしこのような
状態では画質が劣化することになるので、これヲ避ける
ために、前後の情報から内挿によシ新しく画素を作シだ
すことが一般に行なわれている。このようにして生成さ
れた画素列は例えば１，１．５．２゜２．５，３，３．
５，４・・・・・・となシ画質劣化を防ぐことができる
。ここに下線を引いた画素列が内挿により生成されたも
のであって、例えば１．５というのは１と２の中央にあ
ると仮定される画素である。
上記の例では、画素列は必ず連続して読出されているの
で、内挿して生成しだい画素の前後には、内挿に必要な
画素が必ず読出されている。ところが特殊効果の種類に
よっては、例えば、１．２．５゜４．５．５，７，８．
５・・・・・・のように飛び飛びに画素列が必要とされ
る場合がある。この場合２，５の画素を生成するために
は２及び３のように隣シ合う画素が必要であり、５．５
の場合には５と６の画素が必要である。すなわち一般に
任意の画素を生成しようとする場合、生成する画素の少
くとも前後の隣り合う画素が必要となる。
ところが従来の記憶回路では、２つ以上の画素情報を同
時に読出すことはできない。このため２つ以との画素を
、時間をずらしてそれぞれ読出し後にタイミング調整し
た後内挿する方法もめるが、要求される画素列のスピー
ドが、記憶回路のアクセス時間に対して余裕のある場合
に限られる。
したがって、本発明の目的は、画素列読出しのスピード
を記憶回路のアクセス時間が許す範囲内で高速に、月つ
複数個の画素を同時に読出すことができる特殊効実用画
像記憶装Ｆｉｔ提供することである。
本発明は第１図に示すように、複数個の記憶回路Ａ及び
Ｂ（図では記憶回路が２つの場合を示した）Ｋ入力デー
タ及び書込みアドレスが共通に与えられる。書込制御回
路からコントロールＡ及びＢがそれぞれ記憶回路Ａ及び
Ｂに与えられる。読出制御からは読出しアドレスａ及び
ｂがそれぞれ記憶回路Ａ及びＢに与えられる。記憶回路
Ａ及びＢは、それぞれコントロールα、ｌ／によｌ’込
みが決定され、又書込与の時には書込みアドレスによシ
指定された場所に入力データが畳込まれ、読出しの時に
は読出しアドレスによシ指定された場所からデータが読
出されるよう構成されている。
次に本発明の実施例についてどのようにデータが記憶回
路Ａ、Ｈに書込まれ、どのように読出されるか図を用い
て説明する。今入力画素列が０゜１．２，３，４・・・
・・・のように来たとする。これら画素列は、第２図φ
）　、　ｔＢ）に示すように画素Ｏは記憶回路Ａの０番
地に、画素１は記憶回路Ｂの０番地に画素２は記憶回路
Ａの１番地に・・・・・・に書込捷れる。
すなわち、画素が来る毎に交互に記憶回路Ａ、Ｂに書込
まれる。この時記憶回路Ａ、ＢＫダＪ：き終えたら（記
憶回路が３ケ以上の場合には全ての記憶回路に１ケずつ
書き終えたら）書込みアドレスを１つ増加させる。この
ようにして一連の画素データを全て書込んだ状態では、
本例の場合隅数番目の画素データは記憶回路Ａに、奇数
番目のデータは記憶回路Ｂに１込まれていることになる
。
次に読出す場合に、例えば２．５に相当する画素データ
を得たい時には、２及び３のデータを同時に読出し、こ
れらのデータから内挿により２．５に相当するデータケ
生成しうる。この場合読出しアドレスにはｌを指定すれ
ばよい。この状態を第３図に示す。次に３．５に相当す
る画素データを得たい場合には、３及び４のデータを同
時に読出せば、内挿によす３，５を作りうる。この場合
読出しアドレスとして、記憶回路Ａには２を、記憶回路
Ｂには１を供給すればよい。この時の状態を第４図に示
す。このようにすれば、どのような点でも第３図あるい
は第４図の場合に分類することができるので、結果とし
て任意の点のデータを生成するに必要な２つのデータを
同時に読出すことができる。
ここで記憶回路Ａ、Ｈに供給する読出しアドレスａ、ｂ
は、第５図に示すような回路によシ得ることができる。
デジタル記憶回路に供給するアドレスは一般に２進表示
となるので、この場合も２進表示しである。読出しアド
レスの整数部のうち最も恵みの少ないビット（以下ＬＳ
Ｂと称す）に１に加え、得られた結果のうち１．ＳＢτ
切捨てることによシ読出しアドレスａを得ることができ
、文例の処理もせずＬＳＢｉ切捨てたものが読出しアド
レスｂである。例えば先の例で画素２．５の場合整数部
は２進で００１０で表示されるが、読出しアドレスａは
００１０＋１＝ＯＯ１１でＬＳＢを切捨て００１となる
。読出しアドレスｂは００１０のうちＬＳＢが切捨てら
れるので００１である。又画素３．５の場合整数部は、
２進で００１１と表示されるので、読出しアドレスａは
、００１１＋１＝０１００となシＬＳＢｆ切捨て０１０
なので２であり、読出しアドレスｂは、ＬＳＢが切捨て
られ００１となる。このようにして任意点をめるだめの
記憶回路Ａ、Ｂに対するアドレスをめることができる。
以上述べたように、第１図に示すような構成を用いた記
憶装置に於ては、任意の点のデータをめるに必要な複数
個のデータを同時にめることができる。
【図面の簡単な説明】
第１図は本発明の構成金示す図、第２図は入力画素デー
タが記憶回路にどのように記憶されているかを説明する
図、第３図及び第４図は記憶回路からどのようにデータ
が読出されるか説明する図、第５図は記憶回路Ａ、Ｈに
供給するアドレスがどのように作られるかを示す図であ
る。 ％／Ｉ￥１ ４６人アトしλ　壱屯記しアト［Ｘ 壺／Ｖ 叢、１図 １　■　ど　、３４　夕　と　７　÷アトしＸ気４図 ρ　／　■　３　４　５　乙　７−トアドレヌ心Ｓ図 各先セしアトしＺｂ　流出しアトＬスａ奮屯七ｔｙｒｂ
ｚ帳数部

Claims (1)

    【特許請求の範囲】
  1. 複数の記憶回路と、前記複数の記憶回路に入力情報を順
    次書きこむための書込制御回路と、前記複数の記憶回路
    から隣９合９画素情報を同時に読出すよう制御する読出
    し制御口°路とを具備することを特徴とする特殊効果用
    画像記憶装置。
JP59016441A 1984-01-31 1984-01-31 特殊効果用画像記憶装置 Pending JPS60160780A (ja)

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JP59016441A JPS60160780A (ja) 1984-01-31 1984-01-31 特殊効果用画像記憶装置
GB08502297A GB2155725B (en) 1984-01-31 1985-01-30 Video memory device
US07/105,514 US4746979A (en) 1984-01-31 1987-10-02 Video memory device capable of simultaneously reading a plurality of picture elements

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GB (1) GB2155725B (ja)

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