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Description
第1のトランジスタ乃至第3のトランジスタと、第1の信号入力部乃至第3の信号入力部と、信号出力部と、電源とを有するパルス出力回路であって、
前記第1乃至第3のトランジスタはいずれも同一導電型であり、
前記第1のトランジスタのゲート電極は、前記第1の信号入力部と電気的に接続され、
前記第1のトランジスタの第1の電極は、前記第2の信号入力部と電気的に接続され、
前記第1のトランジスタの第2の電極は、前記第2のトランジスタのゲート電極と電気的に接続され、
前記第2のトランジスタの第1の電極は、前記第3の信号入力部と電気的に接続され、
前記第2のトランジスタの第2の電極は、前記信号出力部と電気的に接続され、
前記第3のトランジスタのゲート電極は、前記第1の信号入力部と電気的に接続され、
前記第3のトランジスタの第1の電極は、前記電源と電気的に接続され、
前記第3のトランジスタの第2の電極は、前記信号出力部と電気的に接続され、
前記第2のトランジスタのゲート電極と第1の電極との間、あるいは前記第2のトランジスタのゲート電極と第2の電極との間に容量手段を有することを特徴としている。
前記第1乃至第3のトランジスタはいずれも同一導電型であり、
前記第1のトランジスタのゲート電極は、前記第1の信号入力部と電気的に接続され、
前記第1のトランジスタの第1の電極は、前記入力切替回路と電気的に接続され、
前記入力切替回路は、第2の信号入力部および第3の信号入力部と電気的に接続され、
前記第1のトランジスタの第2の電極は、前記第2のトランジスタのゲート電極と電気的に接続され、
前記第2のトランジスタの第1の電極は、前記第4の信号入力部と電気的に接続され、
前記第2のトランジスタの第2の電極は、前記信号出力部と電気的に接続され、
前記第3のトランジスタのゲート電極は、前記第1の信号入力部と電気的に接続され、
前記第3のトランジスタの第1の電極は、前記電源と電気的に接続され、
前記第3のトランジスタの第2の電極は、前記信号出力部と電気的に接続され、
前記第2のトランジスタのゲート電極と第1の電極との間、あるいは前記第2のトランジスタのゲート電極と第2の電極との間に容量手段を有することを特徴としている。
前記第1乃至第3のトランジスタはいずれも同一導電型であり、
前記第1のトランジスタのゲート電極は、前記第1の信号入力部と電気的に接続され、
前記第1のトランジスタの第1の電極は、前記入力切替回路と電気的に接続され、
前記入力切替回路は、第2の信号入力部および第3の信号入力部と電気的に接続され、
前記第1のトランジスタの第2の電極は、前記第2のトランジスタのゲート電極と電気的に接続され、
前記第2のトランジスタの第1の電極は、前記第4の信号入力部と電気的に接続され、
前記第2のトランジスタの第2の電極は、前記信号出力部と電気的に接続され、
前記第3のトランジスタのゲート電極は、前記第1の信号入力部と電気的に接続され、
前記第3のトランジスタの第1の電極は、前記電源と電気的に接続され、
前記第3のトランジスタの第2の電極は、前記信号出力部と電気的に接続され、
前記第2のトランジスタのゲート電極と第1の電極との間、あるいは前記第2のトランジスタのゲート電極と第2の電極との間に容量手段を有し、
前記入力切替回路が第1の状態のとき、前記第1のトランジスタの第1の電極は、前記第2の信号入力部と導通し、かつ前記第3の信号入力部と非導通となり、
前記入力切替回路が第2の状態のとき、前記第1のトランジスタの第1の電極は、前記第3の信号入力部と導通し、かつ前記第2の信号入力部と非導通となることを特徴としている。
前記入力切替回路は、
第4のトランジスタと、第5のトランジスタと、第5の信号入力部と、第6の信号入力部とを有し、
前記第4のトランジスタと、前記第5のトランジスタとは、いずれも前記第1のトランジスタ乃至前記第3のトランジスタと同一導電型であり、
前記第4のトランジスタのゲート電極は、前記第5の信号入力部と電気的に接続され、
前記第4のトランジスタの第1の電極は、前記第2の信号入力部と電気的に接続され、
前記第4のトランジスタの第2の電極は、前記第1のトランジスタの第1の電極と電気的に接続され、
前記第5のトランジスタのゲート電極は、前記第6の信号入力部と電気的に接続され、
前記第5のトランジスタの第1の電極は、前記第3の信号入力部と電気的に接続され、
前記第5のトランジスタの第2の電極は、前記第1のトランジスタの第1の電極と電気的に接続され、
前記第5の信号入力部に、入力切替信号が入力され、かつ前記第6の信号入力部に、入力切替反転信号が入力されるとき、前記第4のトランジスタが導通し、かつ前記第5のトランジスタが非導通となり、
前記入力切替信号の極性が反転し、かつ前記入力切替反転信号の極性が反転するとき、前記第4のトランジスタが非導通となり、かつ前記第5のトランジスタが導通することを特徴としている。
前記容量手段は、前記第2のトランジスタのゲート電極と、前記第2のトランジスタの活性層との間で形成されていても良いし、活性層材料、ゲート電極を形成する材料、あるいは配線材料のうちいずれか2つの材料の間で形成されていても良い。
第1のクロック信号乃至第4のクロック信号と、スタートパルスとにしたがって順次サンプリングパルスを出力することを特徴とするシフトレジスタが提供される。
第1のクロック信号線乃至第4のクロック信号線と、スタートパルス入力線とを有し、
4n−3段目(nは自然数、1≦n)の前記パルス出力回路において、
前記第1の信号入力部は、前記第1のクロック信号線と電気的に接続され、
前記第2の信号入力部は、n=1のとき、前記スタートパルス入力線と電気的に接続され、n≠1のとき、4(n−1)段目の前記パルス出力回路の前記信号出力部と電気的に接続され、
前記第3の信号入力部は、前記第3のクロック信号線と電気的に接続され、
4n−2段目の前記パルス出力回路において、
前記第1の信号入力部は、前記第2のクロック信号線と電気的に接続され、
前記第2の信号入力部は、前記4n−3段目の前期パルス出力回路の前期信号出力部と電気的に接続され、
前記第3の信号入力部は、前記第4のクロック信号線と電気的に接続され、
4n−1段目の前記パルス出力回路において、
前記第1の信号入力部は、前記第3のクロック信号線と電気的に接続され、
前記第2の信号入力部は、前記4n−2段目の前期パルス出力回路の前期信号出力部と電気的に接続され、
前記第3の信号入力部は、前記第1のクロック信号線と電気的に接続され、
4n段目の前記パルス出力回路において、
前記第1の信号入力部は、前記第4のクロック信号線と電気的に接続され、
前記第2の信号入力部は、前記4n−1段目の前期パルス出力回路の前期信号出力部と電気的に接続され、
前記第3の信号入力部は、前記第2のクロック信号線と電気的に接続され、
第1のクロック信号乃至第4のクロック信号と、スタートパルスとにしたがって順次サンプリングパルスを出力することを特徴としている。
第1のクロック信号線乃至第4のクロック信号線と、スタートパルス入力線とを有し、
4n−3段目(nは自然数、1≦n)の前記パルス出力回路において、
前記第1の信号入力部は、前記第1のクロック信号線と電気的に接続され、
前記第2の信号入力部は、n=1のとき、前記スタートパルス入力線と電気的に接続され、n≠1のとき、4(n−1)段目の前記パルス出力回路の前記信号出力部と電気的に接続され、
前記第3の信号入力部は、前記スタートパルス入力線、もしくは4n−2段目の前記パルス出力回路の前記信号出力部のいずれか一方と電気的に接続され、
前記第4の信号入力部は、前記第3のクロック信号線と電気的に接続され、
4n−2段目の前記パルス出力回路において、
前記第1の信号入力部は、前記第2のクロック信号線と電気的に接続され、
前記第2の信号入力部は、前記4n−3段目の前期パルス出力回路の前期信号出力部と電気的に接続され、
前記第3の信号入力部は、前記スタートパルス入力線、もしくは4n−1段目の前記パルス出力回路の前記信号出力部のいずれか一方と電気的に接続され、
前記第4の信号入力部は、前記第4のクロック信号線と電気的に接続され、
4n−1段目の前記パルス出力回路において、
前記第1の信号入力部は、前記第3のクロック信号線と電気的に接続され、
前記第2の信号入力部は、前記4n−2段目の前期パルス出力回路の前期信号出力部と電気的に接続され、
前記第3の信号入力部は、前記スタートパルス入力線、もしくは4n段目の前記パルス出力回路の前記信号出力部のいずれか一方と電気的に接続され、
前記第4の信号入力部は、前記第1のクロック信号線と電気的に接続され、
4n段目の前記パルス出力回路において、
前記第1の信号入力部は、前記第4のクロック信号線と電気的に接続され、
前記第2の信号入力部は、前記4n−1段目の前期パルス出力回路の前期信号出力部と電気的に接続され、
前記第3の信号入力部は、前記スタートパルス入力線、もしくは4n+1段目の前記パルス出力回路の前記信号出力部のいずれか一方と電気的に接続され、
前記第4の信号入力部は、前記第2のクロック信号線と電気的に接続され、
第1のクロック信号乃至第4のクロック信号と、スタートパルスとにしたがって順次サンプリングパルスを出力することを特徴としている。
Claims (4)
- ガラス基板上に画素部と、ソース信号線駆動回路を有し、
前記画素部は複数の薄膜トランジスタを有し、
前記ソース信号線駆動回路は、第1及び第2のレベルシフタとシフトレジスタとを有し、
前記第1のレベルシフタは少なくとも第1乃至第4の薄膜トランジスタを有し、
前記シフトレジスタは少なくとも第5乃至第10の薄膜トランジスタを有し、
前記第2のレベルシフタは少なくとも第11乃至第14の薄膜トランジスタを有し、
前記第1の薄膜トランジスタは、ゲートとソースまたはドレインの一方とが電気的に接続され、ソースまたはドレインの他方と前記第2の薄膜トランジスタのソースまたはドレインの一方とが電気的に接続され、
前記第2の薄膜トランジスタは、ゲートに第1の信号が入力され、ソースまたはドレインの他方と電源線とが電気的に接続され、
前記第3の薄膜トランジスタは、ゲートと前記第2の薄膜トランジスタのソースまたはドレインの一方とが電気的に接続され、ソースまたはドレインの一方と前記第1の薄膜トランジスタのソースまたはドレインの一方とが電気的に接続され、ソースまたはドレインの他方と前記第4の薄膜トランジスタのソースまたはドレインの一方とが電気的に接続され、
前記第4の薄膜トランジスタは、ゲートと前記第2の薄膜トランジスタのゲートとが電気的に接続され、ソースまたはドレインの他方と前記電源線とが電気的に接続され、
前記第3の薄膜トランジスタの前記ソースまたはドレインの他方と前記第1のレベルシフタの出力とが電気的に接続され、
前記第11の薄膜トランジスタは、ゲートとソースまたはドレインの一方とが電気的に接続され、ソースまたはドレインの他方と前記第12の薄膜トランジスタのソースまたはドレインの一方とが電気的に接続され、
前記第12の薄膜トランジスタは、ゲートに第4の信号が入力され、ソースまたはドレインの他方と前記電源線とが電気的に接続され、
前記第13の薄膜トランジスタは、ゲートと前記第12の薄膜トランジスタのソースまたはドレインの一方とが電気的に接続され、ソースまたはドレインの一方と前記第11の薄膜トランジスタのソースまたはドレインの一方とが電気的に接続され、ソースまたはドレインの他方と前記第14の薄膜トランジスタのソースまたはドレインの一方とが電気的に接続され、
前記第14の薄膜トランジスタは、ゲートと前記第12の薄膜トランジスタのゲートとが電気的に接続され、ソースまたはドレインの他方と前記電源線とが電気的に接続され、
前記第13の薄膜トランジスタの前記ソースまたはドレインの他方と前記第2のレベルシフタの出力とが電気的に接続され、
前記第5の薄膜トランジスタは、ゲートに前記第1のレベルシフタの出力が入力され、ソースまたはドレインの一方に第3の信号が入力され、
前記第6の薄膜トランジスタは、ゲートと前記第5の薄膜トランジスタのソースまたはドレインの他方とが電気的に接続され、ソースまたはドレインの一方に前記第2のレベルシフタの出力が入力され、ソースまたはドレインの他方と前記第7の薄膜トランジスタのソースまたはドレインの一方とが電気的に接続され、
前記第7の薄膜トランジスタは、ゲートと前記第5の薄膜トランジスタのゲートとが電気的に接続され、ソースまたはドレインの他方と前記電源線とが電気的に接続され、
前記第8の薄膜トランジスタは、ゲートに前記第2のレベルシフタの出力が入力され、ソースまたはドレインの一方と前記第7の薄膜トランジスタのソースまたはドレインの一方とが電気的に接続され、
前記第9の薄膜トランジスタは、ゲートと前記第8の薄膜トランジスタのソースまたはドレインの他方とが電気的に接続され、ソースまたはドレインの一方に前記第1のレベルシフタの出力が入力され、ソースまたはドレインの他方と前記第10の薄膜トランジスタのソースまたはドレインの一方とが電気的に接続され、
前記第10の薄膜トランジスタは、ゲートと前記第8の薄膜トランジスタのゲートとが電気的に接続され、ソースまたはドレインの他方と前記電源線とが電気的に接続され、
前記画素部の複数の薄膜トランジスタ及び前記第1乃至第14の薄膜トランジスタはNチャネル型薄膜トランジスタであることを特徴とする表示装置。 - ガラス基板上に画素部と、ソース信号線駆動回路を有し、
前記画素部は複数の薄膜トランジスタを有し、
前記ソース信号線駆動回路は、第1及び第2のレベルシフタとシフトレジスタとを有し、
前記第1のレベルシフタは少なくとも第1乃至第4の薄膜トランジスタを有し、
前記シフトレジスタは少なくとも第5乃至第10の薄膜トランジスタを有し、
前記第2のレベルシフタは少なくとも第11乃至第14の薄膜トランジスタを有し、
前記第1の薄膜トランジスタは、ゲートとソースまたはドレインの一方とが電気的に接続され、ソースまたはドレインの他方と前記第2の薄膜トランジスタのソースまたはドレインの一方とが電気的に接続され、
前記第2の薄膜トランジスタは、ゲートと第1の配線とが電気的に接続され、ソースまたはドレインの他方と電源線とが電気的に接続され、
前記第3の薄膜トランジスタは、ゲートと前記第2の薄膜トランジスタのソースまたはドレインの一方とが電気的に接続され、ソースまたはドレインの一方と前記第1の薄膜トランジスタのソースまたはドレインの一方とが電気的に接続され、ソースまたはドレインの他方と前記第4の薄膜トランジスタのソースまたはドレインの一方とが電気的に接続され、
前記第4の薄膜トランジスタは、ゲートと前記第2の薄膜トランジスタのゲートとが電気的に接続され、ソースまたはドレインの他方と前記電源線とが電気的に接続され、
前記第3の薄膜トランジスタの前記ソースまたはドレインの他方と前記第1のレベルシフタの出力線とが電気的に接続され、
前記第11の薄膜トランジスタは、ゲートとソースまたはドレインの一方とが電気的に接続され、ソースまたはドレインの他方と前記第12の薄膜トランジスタのソースまたはドレインの一方とが電気的に接続され、
前記第12の薄膜トランジスタは、ゲートと第4の配線とが電気的に接続され、ソースまたはドレインの他方と前記電源線とが電気的に接続され、
前記第13の薄膜トランジスタは、ゲートと前記第12の薄膜トランジスタのソースまたはドレインの一方とが電気的に接続され、ソースまたはドレインの一方と前記第11の薄膜トランジスタのソースまたはドレインの一方とが電気的に接続され、ソースまたはドレインの他方と前記第14の薄膜トランジスタのソースまたはドレインの一方とが電気的に接続され、
前記第14の薄膜トランジスタは、ゲートと前記第12の薄膜トランジスタのゲートとが電気的に接続され、ソースまたはドレインの他方と前記電源線とが電気的に接続され、
前記第13の薄膜トランジスタの前記ソースまたはドレインの他方と前記第2のレベルシフタの出力線とが電気的に接続され、
前記第5の薄膜トランジスタは、ゲートと前記第1のレベルシフタの出力線と電気的に接続され、ソースまたはドレインの一方と第3の配線とが電気的に接続され、
前記第6の薄膜トランジスタは、ゲートと前記第5の薄膜トランジスタのソースまたはドレインの他方とが電気的に接続され、ソースまたはドレインの一方と前記第2のレベルシフタの出力線とが電気的に接続され、ソースまたはドレインの他方と前記第7の薄膜トランジスタのソースまたはドレインの一方とが電気的に接続され、
前記第7の薄膜トランジスタは、ゲートと前記第5の薄膜トランジスタのゲートとが電気的に接続され、ソースまたはドレインの他方と前記電源線とが電気的に接続され、
前記第8の薄膜トランジスタは、ゲートと前記第2のレベルシフタの出力線が電気的に接続され、ソースまたはドレインの一方と前記第7の薄膜トランジスタのソースまたはドレインの一方とが電気的に接続され、
前記第9の薄膜トランジスタは、ゲートと前記第8の薄膜トランジスタのソースまたはドレインの他方とが電気的に接続され、ソースまたはドレインの一方と前記第1のレベルシフタの出力線とが電気的に接続され、ソースまたはドレインの他方と前記第10の薄膜トランジスタのソースまたはドレインの一方とが電気的に接続され、
前記第10の薄膜トランジスタは、ゲートと前記第8の薄膜トランジスタのゲートとが電気的に接続され、ソースまたはドレインの他方と前記電源線とが電気的に接続され、
前記画素部の複数の薄膜トランジスタ及び前記第1乃至第14の薄膜トランジスタはNチャネル型薄膜トランジスタであることを特徴とする表示装置。 - 請求項1または2において、
前記ソース信号線駆動回路は、第1乃至第4の容量を有し、
前記第1の容量の一方の端子は、前記第3の薄膜トランジスタのゲートと電気的に接続され、
前記第1の容量の他方の端子は、前記第3の薄膜トランジスタのソースまたはドレインの他方と電気的に接続され、
前記第2の容量の一方の端子は、前記第6の薄膜トランジスタのゲートと電気的に接続され、
前記第2の容量の他方の端子は、前記第6の薄膜トランジスタのソースまたはドレインの他方と電気的に接続され、
前記第3の容量の一方の端子は、前記第9の薄膜トランジスタのゲートと電気的に接続され、
前記第3の容量の他方の端子は、前記第9の薄膜トランジスタのソースまたはドレインの他方と電気的に接続され、
前記第4の容量の一方の端子は、前記第13の薄膜トランジスタのゲートと電気的に接続され、
前記第4の容量の他方の端子は、前記第13の薄膜トランジスタのソースまたはドレインの他方と電気的に接続されていることを特徴とする表示装置。 - 請求項1乃至3のいずれか一項において、
前記第1、第3、第11及び第13の薄膜トランジスタがダブルゲートであることを特徴とする表示装置。
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