KR19980032915A - 리라이터블 디스크 및 이 디스크에 데이터를 기록하기 위한 장치 - Google Patents

리라이터블 디스크 및 이 디스크에 데이터를 기록하기 위한 장치 Download PDF

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KR19980032915A
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Abstract

개서 가능한 디스크의 용량을 증가한다. 동시에 재생 전용 디스크와의 호환성을 유지한다.
클러스터와 클러스터 사이를 링크 프레임으로 결합한다. 링크 프레임에는 포스트앰블, 포스트가드, 및 Slice/PLL 에이리어를 형성한다.

Description

리라이터블 디스크 및 이 디스크에 데이터를 기록하기 위한 장치
본 발명은 기록 재생 장치 및 디스크에 관한 것으로 특히, 개서 가능한 디스크에 더욱 고밀도로 데이터를 기록 또는 재생할 수 있도록 한 기록 재생 장치 및 방법 및 디스크에 관한 것이다.
데이터를 재생할 수 있을 뿐만 아니라, 개서 가능한 광디스크(RAM 디스크)의 어드레스 방법으로서 데이터를 기록 또는 재생하기 위한 안내홈(그루브 트랙)을 어드레스 정보에 대응하여 워블링하는 것이 예를 들면, CDR(Compact Disk Recordable) 등으로 알려져 있다. 이 워블링에 의해 어드레스를 기록하는 방법은 엠보스 가공 등에 의해 프리피트로서 어드레스를 미리 기록하는 방법과 비교하여 용장성을 개선할 수 있는 장점을 가진다. 또한, 엠보스 가공에 의한 프리피트를 필요로 하지 않기 때문에 CLV 상에 기록되어 있는 재생 전용의 ROM 디스크와 호환성이 얻어지는 이점도 가지고 있다.
그런데, 개서 가능한 디스크에 있어서는 데이터가 반드시 연속적으로 기록된다고는 한정할 수 없기 때문에 클러스터와 클러스터간에 링크 에어리어를 형성하여 그 링크 에어리어에 데이터 기록 재생을 위한 클럭을 기록한 PLL 에어리어, 재생 RF 신호를 2치화하기 위한 슬라이스 레벨을 제어하는 데이터를 기록하는 슬라이스 컨트롤 에어리어 등을 형성할 필요가 있을 뿐만 아니라 프레임 동기를 얻기 위한 프레임 동기 신호를 기록할 필요가 있다.
그런, 링크 에어리어의 각 프레임에는 실질적인 데이터를 기록하고 있지 않기 때문에, 그 분량만큼 ROM 디스크와 비교하여 디스크의 용량을 크게 할 수 없는 과제가 있었다.
본 발명은 이러한 상황을 감안하여 이루어진 것으로 보다 고밀도로 데이터를 기록할 수 있도록 하는 것이다.
도 1a 및 1b는 본 발명의 디스크가 워블링(wobbling)된 상태를 설명하는 도면.
도 2는 워블링 어드레스 프레임의 구성 예를 나타내는 도면.
도 3은 워블링 신호 발생 회로의 구성 예를 나타내는 도면.
도 4는 도 3의 바이페이즈 변조 회로(13)가 출력하는 바이페이즈 신호의 에를 나타내는 도면.
도 5는 도 3의 바이페이즈 변조 회로(13)가 출력하는 바이페이즈 신호의 다른 예를 나타내는 도면.
도 6은 도 3의 FM 변조 회로(15)가 행하는 주파수 변조를 설명하는 도면.
도 7은 도 3의 FM 변조 회로(15)의 출력하는 주파수 변조파를 나타내는 도면.
도 8은 프리그루브(groove)를 갖는 디스크(1)를 제조하기 위한 기록 장치의 구성 예를 나타내는 도면.
도 9a 내지 9d는 도 8의 합성 회로(22)의 동작을 설명하는 도면.
도 10은 본 발명의 기록 재생 장치를 응용한 광디스크 기록 재생 장치의 구성 예를 나타내는 블럭도.
도 11은 디스크에 있어서의 존을 설명하는 설명도.
도 12는 각 존의 파리미터를 설명하는 도면.
도 13는 각 존의 파리미터를 설명하는 도면.
도 14는 각 존의 파리미터를 설명하는 도면.
도 15는 각 존의 파리미터를 설명하는 도면.
도 16은 도 10의 실시 형태에 있어서 클럭 전환 처리를 설명하는 흐름도.
도 17은 1섹터분의 데이터 포맷을 설명하는 도면.
도 18은 32k바이트의 데이터 구성을 설명하는 도면.
도 19는 도 18의 외부호를 인터리브한 상태를 설명하는 설명도.
도 20은 32k바이트의 블럭 데이터의 구성을 설명하는 도면.
도 21은 ROM 디스크의 프레임과 프레임 동기신호의 구성의 일례를 나타내는 도면.
도 22는 RAM 디스크의 프레임과 프레임 동기신호의 구성 일례를 나타내는 도면.
도 23은 링크 데이터의 기록 재생 단위의 포맷을 설명하는 도면.
도 24는 도 21과 도 22에 나타내는 프레임 동기신호의 일례를 나타내는 도면.
도 25는 링크 에어리어의 구성 예를 나타내는 도면.
* 도면의 주요 부분에 대한 부호의 설명 *
1 : 광디스크2 : 프리그루브
11 : 발생 회로12, 14 : 나눗셈기
13 : 바이페이즈 변조 회로15 : FM 변조 회로
21 : 워블링 신호 발생 회로22 : 합성 회로
23 : 마크 신호 발생 회로24 : 기록 회로
25 : 광헤드26 : 원반
27 : 스핀들 모터31 : 스핀들 모터
32 : 광헤드33 : 기록 재생 회로
34 : 메모리35 : 어드레스 발생 판독 회로
36 : 마크 검출 회로37 : 어드레스 검출 회로
38 : 제어 회로39 : 슬레드 모터
40 : 마크 주기 검출 회로41 : PLL 회로
42 : 위상 비교기43 : LPF
44 : VCO45 : 분주기
46 : 클러스터 카운터47 : ROM
도 1a는 본 발명의 디스크를 응용한 광디스크의 구성 예를 도시한다. 상기 도면에 나타낸 바와 같이 디스크(광디스크, 1)에는 프리그루브(2)가 나선상으로 내주에서 외주를 향하여 미리 형성되어 있다. 물론, 이 프리그루브(2)는 동심원상으로 형성되는 것도 가능하다.
또한, 이 프리그루브(2)는 도 1b에서 그 일부를 확대하여 나타낸 바와 같이 좌우의 측벽이 어드레스 정보에 대응하여 워블링되며 주파수 변조파에 대응하여 사행하고 있다. 1개의 트랙은 복수의 워블링 어드레스 프레임을 갖는다.
도 2는 워블링 어드레스 프레임의 구성(포맷)을 나타낸다. 상기 도면에 나타낸 바와 같이, 워블링 어드레스 프레임은 48비트로 구성되어 최초의 4비트는 워블링 어드레스 프레임의 스타트를 나타내는 동기 신호(Sync)가 된다. 다음 4비트는 복수 기록층중 어느 층인지를 나타내는 레이어(Layer)로 되어 있다. 다음 20비트는 트랙 어드레스(트랙 번호)가 된다. 또한 다음 4비트는 어드레스 프레임의 세그먼트이며, 디스크의 둘레 방향 위치를 나타낸다. 다음의 2비트는 앞으로를 위해 예비로 확보되어 있다. 그 뒤의 14비트는 오류 검출 부호(CRC)가 되며, 동기 신호(Sync)를 제외한 데이터에 대한 에러 검출부호가 기록된다.
1트랙(1회전)당 예를 들면 8개의 워블링 어드레스 프레임이 디스크의 회전각속도(CAV)가 일정한 디스크상에 기록된다. 따라서, 도 2의 세그먼트 번호로서는 예를 들면 0 내지 7의 값이 기록된다.
도 3은 도 2에 나타내는 포맷의 어드레스에 대응하여 프리그루브(2)를 워블링시키기 위한 워블링 신호를 발생하는 워블링 신호 발생 회로의 구성 예를 나타낸다. 발생 회로(11)는 372.4㎑의 주파수 신호를 발생한다. 발생 회로(11)가 발생하는 신호는 나눗셈기(12)로 공급되며, 값 15로 나눈후 주파수 24.8㎑의 바이페이즈 클럭 신호로서 바이페이즈 변조 회로(13)로 공급되고 있다. 바이페이즈 변조 회로(13)에는 또한, 도 2에 나타내는 프레임 포맷의 ADIP(Address In Pre-groove)데이터가 공급되고 있다.
바이페이즈 변조 회로(13)는 나눗셈기(12)로부터 공급되는 바이페이즈 클럭을 도시하지 않는 회로에서 공급되는 ADIP 데이터(어드레스 데이터)로 바이페이즈 변조하여 바이페이즈 신호를 FM 변조 회로(15)에 출력한다. FM 변조 회로(15)에는 또, 발생 회로(11)가 발생한 372.4㎑의 신호를 나눗셈기(12)에 의해 값 4로 나눗셈하여 얻어진 주파수 93.1㎑의 캐리어가 입력되어 있다. FM 변조 회로(15)는 이 나눗셈기(14)로부터 입력되는 캐리어를 바이페이즈 변조 회로(13)로부터 입력되는 바이페이즈 신호로 주파수 변조하고, 그 결과 얻어지는 주파수 변조 신호를 출력한다. 디스크(1)의 프리그루브(2)의 좌우 측벽은 이 주파수 변조 신호에 대응하여 형성(워블링)된다.
도 4와 도 5는 바이페이즈 변조 회로(13)가 출력하는 바이페이즈 신호의 예를 나타낸다. 이 실시 형태에서는 선행하는 비트가 0일때, 도 4에 나타낸 바와 같이 동기 패턴(SYNC)으로서, 11101000이 사용되고, 선행하는 비트가 1일 때, 동기패턴으로서, 도 5에 나타낸 바와 같이 도 4에 나타내는 경우와 역상의 10111 이 사용된다. SYNC는 변조에서는 나타나지 않는 규칙 외의 독특한 패턴이 된다.
어드레스 데이터(ADIP 데이터)의 데이터 비트(Data Bits)중, 0은 바이페이즈 변조되어, 11 (앞의 패널 비트가 0일때) 또는 0 (앞의 채널 비트가 1일 때)의 채널 비트(Channel Bits)로 변환된다. 또한, 1은 10 (앞의 채널 비트가 0일 때) 또는 1 (앞의 채널 비트가 1일 때)의 채널 비트로 변환된 2개의 패턴중 어디로 변환될지는 앞의 부호에 의존한다. 즉, 도 4와 도 5의 「Wave Form」은 채널 비트의 1, 0의 패턴을 1을 고레벨, 0을 저레벨의 신호로서 나타낸 것이지만, 이 파형이 연속되도록 2개의 패턴의 어느 하나가 선택된다.
FM 변조 회로(15)는 도 4 또는 도 5에 나타낸 바와 같이 바이페이즈 신호에 대응하여 나눗셈기(12)로부터 공급되는 캐리어를 도 6에 나타낸 바와 같이 주파수 변조한다.
즉, 채널 비트 데이터(바이페이즈 신호)가 0일 때, FM 변조 회로(15)는 1데이터 비트의 반의 길이에 대응하는 기간에 3.5파의 캐리어를 출력한다. 이 3.5파의 캐리어는 양의 반파 또는 음의 반파로부터 시작된다.
이것에 대하여, 패널 비트 데이터(바이페이즈 신호)가 1일 때, 1데이터 비트의 반의 길이에 대응하는 기간에 4파의 캐리어가 출력된다. 이 4파의 캐리어도 양의 반파로부터 시작되는 캐리어 또는 음의 반파로부터 시작되는 캐리어가 된다.
따라서, FM 변조 회로(15)는 데이터(0)에 대응하여 채널 데이터 비트(00)가 입력되면 데이터 비트의 길이에 대응하는 기간에 7파(=3.5+3.5)의 주파수 변조파를 출력하고, 채널 데이터 비트(11)가 입력되면, 8파(=4+4)의 주파수 변조파를 출력한다. 또한, 데이터(1)에 대응하여 채널 데이터 비트 10 또는 01이 입력되면 7.5파(=4+3.5=3.5+4)의 주파수 변조파가 출력된다.
FM 변조 회로(15)에 입력되는 93.1㎑의 캐리어는 7.5파에 대응하고, FM 변조 회로(15)는 데이터에 대응하며, 이 7.5파의 캐리어 또는 이것을 ±6.67%(=0.5/7.5)만큼 물려 놓은 7파 또는 8파의 주파수 변조파를 생성한다.
상술한 바와 같이, 채널 데이터 0과 채널 데이터 1에 대응하는 각각 양의 반파로부터 시작되는 캐리어와 음의 반파로부터 시작되는 캐리어는 앞의 신호와 연속하는 쪽이 선택된다.
도 7은 이렇게 하여 FM 변조 회로(15)로부터 출력되는 주파수 변조파의 예를 나타낸다. 이 예에 있어서는 최초의 데이터 비트가 0으로 되어 있고, 그 채널 데이터 비트는 00으로 되어 있다. 최초의 채널 데이터 비트 0에 대하여 시점에서 양의 반파로 시작되는 3.5파의 캐리어가 선택되고 있다. 그 결과, 그 캐리어의 종점은 양의 반파로 종료한다. 그래서 다음 채널 데이터 비트 0에 대하여 음의 반파로부터 시작되는 3.5파가 선택되어 데이터 비트(0)에 대하여 합계 7파의 주파수 변조파가 된다.
이 데이터 비트 0의 다음에는 데이터 비트 1(채널 비트 10)이 계속되고 있다. 앞의 데이터 비트(0)에 대응하는 채널 데이터 비트(0)의 3.5파는 음의 반파로 종료하고 있기 때문에 데이터 비트(1)에 대응하는 최초의 채널 데이터 비트(1)의 4파의 캘어로서는 양의 반파로부터 시작되는 것이 선택된다. 이 채널 데이터 비트 1의 4파는 음의 반파로 종료하기 때문에 다음 채널 데이터 비트(0)의 4파는 양의 반파로부터 시작되는 것이 선택된다.
이하 동일하게 하여, 데이터 비트 1(채널 비트 10), 데이터 비트 0(채널 데이터 비트 11), 데이터 비트 0(채널 데이터 비트 00에 대응하여 7.5파, 8파, 7파의 캐리어가 데이터 비트의 경계부(시점과 종점)에 있어서 연속하도록 형성 출력된다.
도 7에 나타낸 바와 같이 이 실시 형태에 있어서는 채널 비트의 길이는 7파, 7.5파, 또는 8파의 캐리어의 어느 쪽의 경우에 있어서도, 캐리어의 파장의 1/2의 정수배 길이로 되어 있다. 즉, 채널 비트의 길이는 7파의 캐리어(주파수 변조파)의 파장의 1/2의 7배의 길이로 되고, 또한, 8파의 캐리어(주파수 변조파)의 1/2의 8배의 길이로 되어 있다. 그리고, 채널 비트의 길이는 7.5파의 캐리어 파장의 1/2의 7배(채널 비트가 0일 때), 또는 8배(채널 비트가 1일 때)가 된다.
또한, 이 실시 형태에 있어서는 바이페이즈 변조된 채널 비트의 경계부(종점 또는 시점)가 주파수 변조파의 제로 크로스점이 되도록 이루어져 있다. 이것에 의해, 어드레스 데이터(채널 비트 데이터)와 주파수 변조파의 위상이 일치하여 그 비트 경계부의 식별이 용이하게 되어 어드레스 데이터 비트의 오류 검출을 방지할 수 있으며 그 결과, 어드레스 정보의 정확한 재생이 용이하게 된다.
또한, 이 실시 형태에 있어서는 데이터 비트의 경계부(시점과 종점)와, 주파수 변조파의 에지(제로 크로스점)가 대응하도록 이루어져 있다. 이것에 의해, 주파수 변조파의 에지를 기준으로 하여 클럭을 생성하는 것도 가능하다. 단, 이 실시 형태에 있어서는 도 9a 내지 9d를 참조하여 후술하는 바와 같이 클럭 동기 마크를 기준으로 하여 클럭이 생성된다.
도 8은 프리그루브를 갖는 디스크(1)를 제조하기 위한 기록 장치(디스크 형성 장치)의 구성 예를 나타낸다. 워블링 신호 발생 회로(21)는 상술한 도 3에 나타내는 구성을 가지며 FM 변조 회로(15)가 출력하는 주파수 변조 신호를 합성 회로(22)로 공급하고 있다. 마크 신호 발생 회로(23)는 소정의 타이밍에 있어서 클럭 동기 마크 신호를 발생하여 합성 회로(22)에 출력하고 있다. 합성 회로(22)는 워블링 신호 발생 회로(21)가 출력하는 주파수 변조 신호와, 마크 신호 발생 회로(23)가 출력하는 클럭 동기 마크 신호를 합성하여 기록 회로(24)에 출력하고 있다.
합성 회로(22)는 클럭 동기 마크 신호가 공급되었을 때, 그 클럭 동기 마크(Fine Clock Mark)를 도 9a 내지 9d에 나타낸 바와 같이 워블링 신호 발생 회로(21)로부터 공급되는 캐리어에 합성한다. 기록 재생 데이터의 변조를 DVD 등의 EFM(Eight To Fourteen Modulation: (8-14) 변조)으로 한 경우, 클럭 동기 마크의 길이는 6 내지 14T(T는 비트셀의 길이)의 길이가 된다.
즉, 도 9a 내지 9d에 나타낸 바와 같이 채널 비트 데이터가 00(데이터0), 11(데이터0), 10(데이터1) 또는 01(데이터1) 일 때, 각각 데이터의 중심(채널 비트의 전환점)의 캐리어의 제로크로스점에 있어서, 어드레스 정보의 변조 주파수(33.1㎑)보다 높은 주파수의 클럭 동기 마크를 합성시킨다. 이 클럭 동기 마크는 각 데이터 비트마다 혹은 소정 수의 데이터 비트마다 기록된다.
이와 같이, 어드레스 데이터 비트의 중심(채널 데이터 비트의 전환점)에 대응하는 워블링 주파수 변조파의 제로크로스점에 클럭 동기 마크를 삽입함으로써 클럭 동기 마크의 진폭 변동이 적어지며 그 검출이 용이하게 된다.
즉, FM 변조 회로(15)에 있어서, 채널 데이터가 0일 때, 예를 들면 중심 주파수로부터 -5%만큼 주파수를 몰려 놓도록 주파수 변조하여, 채널 데이터 비트가 1일 때, +5%만큼 중심 주파수로부터 어긋나도록 주파수 변조를 행하도록 한 경우, 데이터 비트 또는 채널 데이터 비트의 경계부와 주파수 변조파의 제로크로스점이 일치하지 않고, 채널 데이터 비트(또는 데이터 비트)를 오류 검출하기 쉽다. 또한, 클럭 동기 마크의 삽입 위치는 반드시 제로크로스점으로는 되지 않고, 주파수 변조파의 소정의 진폭치를 갖는 점에 중첩된다. 그 결과, 클럭 동기 마크의 레벨이 그 진폭치의 분만큼 증가 또는 감소하여 그 검출이 곤란하게 된다. 본 실시 형태에 의하면 항상 주파수 변조파의 제로크로스 위치에 클럭 동기 마크가 배치되기 때문에 그 검출 즉 주파수 변조파와의 식별이 용이하게 된다.
기록 회로(24)는 합성 회로(22)로부터 공급된 신호에 대응하여 광헤드(25)를 제어하여 원반(26)에 프리그루브(클럭 동기 마크를 포함한다)를 형성하기 위한 레이저광을 발생시킨다. 스핀들 모터(27)는 원반(26)을 일정한 각속도(CAV)로 회전시키도록 이루어진다.
즉, 워블링 신호 발생 회로(21)가 발생한 주파수 변조신호가 합성 회로(22)에 있어서 마크 신호 발생 회로(23)로부터 출력된 클럭 동기 마크 신호와 합성되어, 기록 회로(24)에 입력된다. 기록 회로(24)는 합성 회로(22)로부터 입력된 신호에 대응하여 광헤드(25)를 제어하여 레이저광을 발생시킨다. 광헤드(25)로부터 발생한 레이저광이 스핀들 모터(27)에서 일정한 각속도로 회전되고 있는 원반(26)에 조사된다.
원반(26)을 현상하여 이 원반(26)으로부터 원품을 작성하고, 원품으로부터 다수의 복사품으로서의 디스크(1)를 형성한다. 이것에 의해, 상술한 클럭 동기 마크를 갖는 프리그루브(2)가 형성된, 예를 들면, 상 변화형의 디스크(1)가 얻어지게 된다.
도 10은 이렇게 하여 얻어진 디스크(1)에 대하여 데이터를 기록 또는 재생하는 광디스크 기록 재생 장치의 구성 예를 나타낸다. 스핀들 모터(31)는 디스크(1)를 소정의 각속도로 회전하도록 이루어져 있다. 광헤드(32)는 디스크(1)에 대하여 레이저광을 조사하여 디스크(1)에 대하여 데이터를 기록하는 동시에 그 반사광으로부터 데이터를 재생하도록 이루어져 있다. 기록 재생 회로(33)는 도시하지 않는 장치로부터 입력되는 기록 데이터를 메모리(34)에 일단 기억시키고, 메모리(34)에 기록단위로서의 1클러스터분의 데이터(또는 1섹터분의 데이터라도 좋다)가 기억되었을 때, 이 1클러스터분의 데이터를 읽어 소정의 방식으로 변조하는 등으로, 광헤드(32)에 출력하도록 이루어져 있다. 또한, 기록 재생 회로(33)는 광헤드(32)로부터 입력된 데이터를 적당히 복조하여 도시하지 않는 장치에 출력하도록 이루어져 있다.
또, 기록 재생 회로(33)는 후술하는 바와 같이 기록 데이터에 전방 링크 에어리어 및 후방 링크 에어리어를 부가하는 동시에 이 링크 에어리어에 동기 신호와 기록 데이터를 부가하여, 출력하도록 이루어진다.
어드레스 발생 판독 회로(35)는 제어 회로(38)로부터의 제어에 대응하여 트랙(프리그루브(2))내에 기록하는 데이터 어드레스(섹터 어드레스) (도 17을 참조하여 후술한다)를 발생하여, 기록 재생 회로(33)에 출력한다. 기록 재생 회로(33)는 이 어드레스를 도시하지 않는 장치로부터 공급되는 기록 데이터에 부가하여 광헤드(32)에 출력한다. 또한, 기록 재생 회로(33)는 광헤드(32)가 디스크(1)의 트랙으로부터 재생하는 재생 데이터중에 어드레스 데이터가 포함될 때, 이것을 분리하여 어드레스 발생 판독 회로(35)에 출력한다. 어드레스 발생 판독 회로(35)는 판독한 어드레스를 제어 회로(38)에 출력한다.
또한, 마크 검출 회로(36)는 광헤드(32)가 재생 출력하는 RF 신호로부터 클럭 동기 마크에 대응하는 성분을 검출한다. 어드레스 검출 회로(37)는 광헤드(32)가 출력하는 RF 신호로부터 워블링 신호에 포함되는 어드레스 정보(도 2의 트랙 번호라든지 세그먼트 번호)를 판독하여 클러스터 카운터(46)와 제어 회로(38)로 공급하도록 이루어진다.
마크 주기 검출 회로(40)는 마크 검출 회로(36)가 클럭 동기 마크를 검출하였을 때 출력하는 검출 펄스의 주기성을 판정한다. 즉, 클럭 동기 마크는 일정한 주기로 발생하기 때문에 마크 검출 회로(36)로부터 입력되는 검출 펄스가 일정한 주기로 발생한 검출 펄스인지 아닌지를 판정하여 일정한 주기로 발생한 검출 펄스이면 그 검출 펄스에 동기한 펄스를 발생하여 후단의 PLL 회로(41)의 위상 비교기(42)에 출력한다. 또한, 마크 주기 검출 회로(40)는 일정한 주기로 검출 펄스가 입력되지 않는 경우에 있어서는 후단의 PLL 회로(41)가 잘못된 위상으로 로크하지 않도록 소정의 타이밍으로 유사 펄스를 발생한다.
PLL 회로(41)는 위상 비교기(42) 외에 로퍼스 필터(LPF, 43), 전압 제어 발진기(VCO, 44), 및 분주기(45)를 구비하고 있다. 위상 비교기(42)는 마크 주기 검출 회로(40)로부터의 입력과, 분주기(45)로부터의 입력의 위상을 비교하여 그 위상 오차를 출력한다. 로퍼스 필터(43)는 위상 비교기(42)가 출력하는 위상오차 신호를 평활하여 VCO(44)에 출력한다. VCO(44)는 로퍼스 필터(43)의 출력에 대응하는 위상의 클럭을 발생하여 분주기(45)에 출력한다. 분주기(45)는 VCO(44)로부터 입력되는 클럭을 소정의 값(제어 회로(38)에서 지정하는 값)으로 분주하는 분주한 결과를 위상 비교기(42)에 출력한다.
VCO(44)가 출력하는 클럭은 각 회로로 공급되며 동시에 클러스터 카운터(46)에도 공급된다. 클러스터 카운터(46)는 어드레스 검출 회로(37)로부터 공급되는 트랙 어드레스 트랙 번호를 기준으로 하여, 그 계수치가 미리 설정된 소정의 값(1클러스터의 길이에 대응하는 값)에 도달하였을 때, 클러스터 스타트 펄스를 발생하여 제어 회로(38)에 출력하고 있다.
슬레드 모터(39)는 제어 회로(38)에 제어되는 광헤드(32)를 디스크(1)의 소정의 트랙 위치로 이송하도록 이루어진다. 또한, 제어 회로(38)는 스핀들 모터(31)를 제어하여 디스크(1)를 소정의 각속도(CAV)로 회전시키도록 이루어져 있다.
ROM(47)에는 어드레스 프레임중의 트랙번호(도 2)와, 디스크(1)의 데이터 기록 영역을 구분한 존과의 대응 관계를 규정하는 테이블과, 필요에 따라서 존과 그 존이 대응하는 밴드의 관계를 규정하는 테이블이 기억되어 있다.
즉, 제어 회로(38)는 디스크(1)를 도 11에 나타낸 바와 같이 복수의 존(이 실시 형태의 경우, 제0존 내지 제m+1 존의 m+2 개의 존)으로 구분하여 데이터를 기록 또는 재생한다. 현재, 제0존의 1트랙당의 데이터 프레임(이 데이터 프레임은 도 2를 참조하여 설명한 어드레스 프레임과는 달리 데이터의 전송 블럭 단위이다)의 수를 n 개로 할 때, 다음 제 1존에 있어서는 1트랙당의 데이터 프레임수는 n+8이 된다. 이하, 마찬가지고, 보다 외주측의 존은 인접하는 내주측의 존과 비교하여 8개씩 데이터 프레임수가 증가하여 최외주의 제m+1 존에 있어서는 n+8×(m+1) 개의 데이터 프레임수가 된다.
제0존의 최내주 선밀도와 동일한 선밀도로 n+8 프레임의 용량이 얻어지는 반경 위치에서 제1존으로 전환된다. 이하 마찬가지고, 제m 존에서는 제0존의 최내주선밀도와 같은 선밀도로 n+8×m 프레임의 용량이 얻어지는 반경 위치에서 제m존이 된다.
예를 들면, 직경이 120㎜의 디스크(1)의 반경이 24㎜ 내지 58㎜의 범위를 기록 재생 에어리어로 하고, 트랙 피치를 0.83㎛, 선밀도를 0.32㎛/bit 로 하면, 기록 재생 에어리어는 도 12 내지 도 15에 나타내는 바와 같이 92개의 존으로 구분된다. 디스크 반경이 24㎜의 제0존에 있어서는 트랙(1회전)당 632프레임이 되며, 존이 1씩 증가함에 따라 1트랙당 8프레임이 증가된다.
후술하는 바와 같이 이 실시 형태의 경우 1섹터는 26프레임(데이터 프레임)으로써 구성되기 때문에 존마다 증가되는 프레임의 수(=8)는 이 1섹터를 구성하는 프레임의 수(=26)보다 작은 값으로 설정된다. 이것에 의해, 보다 세밀한 단위로 많은 존을 형성하는 것이 가능하며 디스크(1)의 용량을 크게 할 수 있다. 이 방식을 존 CLD (Constant Linear Dencity) 라고 칭한다.
또, 도 12 내지 도 15에 있어서, 각 열의 데이터는 도면 중 좌측으로부터 존번호, 존의 최내주 반경, 트랙당의 프레임수, 1존당의 트랙수, 1존당의 기록 재생 단위(블럭)수(클러스터수), 그 존내에서의 최단의 선밀도, 그 존의 용량, 그 존의 회전속도, 그 존의 최소 선속도, 또는 그 존의 최대 선속도를 각각 나타낸다. 또 회전 속도는 데이터 전송 레이트를 11.08Mbps 로 할 때의 매분의 회전수를 나타낸다.
이 실시의 형태에 있어서는 각 존에서의 트랙수는 442로 일정하게 되며, 이 트랙수는 1개의 기록 재생 단위의 프레임수(ECC 블럭의 프레임수) (도 20을 참조하여 후술한다)와 동일한 값이 된다.
또, 이 실시 형태에 있어서는 각 존의 트랙수를 기록 재생 단위를 구성하는 데이터 프레임수(442프레임)의 1배로 하였지만 정수배로 할 수 있다. 이것에 의해, 잉여 데이터 프레임이 발생하지 않게 되며, 각 존에 정수개의 기록 재생 단위(블럭)가 배치되며, 조닝 효율을 향상시킬 수 있다. 그 결과, CLV에 가까운 용량을 얻을 수 있다.
또한, 이와 같이 CLV에 가까운 조닝을 행함으로써 존과 다음 존에서의 클럭 주파수의 변화가 작게 되며, CLV전용의 재생 장치에 의해 재생된 경우에 있어서도, 클럭 주파수가 변화하는 존간에 있어서도 클럭의 추출이 가능하게 되어 존간을 연속하여 재생할 수 있다.
다음에, 도 10의 실시 형태의 동작에 대하여 설명한다. 여기에서는 데이터 기록시의 동작에 대하여 설명한다. 광헤드(32)는 강디스크(1)에 레이저광을 조사하여 그 반사광으로부터 얻어지는 RF 신호를 출력한다. 어드레스 검출 회로(37)는 이 RF 신호로부터 워블링 정보(어드레스 정보)를 판독하고, 그 판독 결과를 제어 회로(38)에 출력하는 동시에, 클러스터 카운터(46)에도 공급한다. 또한, 이 워블링 정보는 마크 검출 회로(36)에도 입력되며, 그래서, 클럭 동기 마크가 검출되어 그 검출 신호가 마크 주기 검출 회로(40)로 공급된다.
마크 주기 검출 회로(40)는 클럭 동기 마크의 주기성을 판정하여, 그것에 대응한 소정의 펄스를 발생하고, PLL 회로(41)에 출력한다. PLL 회로(41)는 이 펄스에 동기한 클럭(기록클럭)을 생성하여, 클러스터 카운터(46)로 공급한다.
제어 회로(38)는 어드레스 검출 회로(37)로부터 공급되는 세그먼트 어드레스(세그먼트 번호)로부터 1트랙(1회전)에 있어서 기준의 클럭 동기 마크의 위치를 검출할 수 있다. 예를 들면, 세그먼트 번호 0의 어드레스 프레임의 최초에 검출되는 클럭 동기 마크를 기준으로 하여, 기록 클럭의 카운트치보다 트랙상에 임의의 위치(1회전중의 임의의 위치)로 액세스하는 것이 가능하게 된다.
상기와 같이 하여, 트랙상의 임의의 위치에 액세스한 경우, 또한 그 액세스점이 어떤 존에 속하는지를 판정하여 그 존에 대응하는 주파수의 클럭을 VCO(44)에 발생시킬 필요가 있다. 그리하여, 제어 회로(38)는 도 16의 흐름도에 나타내는 바와 같은 클럭 전환 처리를 또한 행한다.
즉, 최초에 스텝(S1)에 있어서, 제어 회로(38)는 어드레스 검출 회로(37)가 출력한 액세스점의 프레임 어드레스중에서 트랙 번호를 판독한다. 그리고, 스텝(S2)에 있어서, 스텝(S1)에서 판독한 트랙 번호에 대응하여 존을 ROM(47)에 기억되어 있는 테이블로부터 판독한다. 상술한 바와 같이 ROM(47)의 테이블에는 각 번호의 트랙이 예를 들면 제0존 내지 제92존의 어느 존에 속하는지 미리 기억되어 있다.
그래서, 스탭(S3)에서, 지금 판독한 트랙 번호가 그곳까지 액세스하고 있는 존과 다른 새로운 존인지 아닌지를 판정한다. 새로운 존이라고 판정된 경우에는 스텝(S4)로 진행하고, 제어 회로(38)는 분주기(45)를 제어하며, 그 새로운 존에 대응하여 분주비를 설정시킨다. 이것에 의해, 각 존마다 다른 주파수의 기록 클럭이 VCO(44)로부터 출력된다.
또, 스텝(S3)에 있어서, 현재의 존이 새로운 존이 아니라고 판정된 경우에는 스텝(S4)의 처리는 생략된다. 즉, 분주기(45)의 분주비는 변경되지 않고 그대로가 된다.
다음에, 기록 재생 회로(33)에 의한 기록 데이터의 포맷화 처리에 대해서 설명한다. 이 실시 형태에서는 상술한 바와 같이 1클러스터(32k바이트)를 단위로서 데이터가 기록되지만 이 클러스터는 다음과 같이 구성된다.
즉, 메모리(34)에 기억되어 있는 데이터로부터 2k바이트(2048바이트)의 데이터가 1섹터분의 데이터로서 추출되고, 여기에 도 17에 나타내는 바와 같이 기록 재생 회로(33)에 있어서 16바이트의 오버 헤드가 부가된다. 이 오버 헤드에는 섹터 어드레스(도 10의 어드레스 발생 판독 회로(35)에서 발생되거나 혹은 판독되는 어드레스)와 에러 검출을 위한 에러 검출 부호 등이 포함된다.
기록 재생 회로(33)에서는 합계2064(=2048+16) 바이트의 데이터가 도 18에 나타내는 바와 같이 12×172(=2064) 바이트의 데이터가 된다. 그리고, 이 1섹터분의 데이터가 16개 모여져서 192(=12×16)×172바이트의 데이터가 된다. 이 192×172바이트의 데이터에 대하여 10바이트의 내부호(PI)와 16바이트의 외부호(PO)가 가로방향 및 세로방향의 각 바이트에 대하여 에러정정을 위한 패리티로서 부가된다.
또한, 이렇게 하여 208(=192+16)×182(=172+10) 바이트로 블럭화된 데이터중, 161182바이트의 외부호(PO)는 16개의 1×182바이트의 데이터로 구분되며, 도 19에 나타낸 바와 같이 12×182바이트의 번호0 내지 번호15의 16개의 섹터 데이터하에 1개씩 부가되어 인터리브된다. 그리고, 13(=12+1)×182바이트의 데이터가 1섹터의 데이터가 된다.
또, 도 19에 나타내는 280×182바이트의 데이터는 도 20에 나타낸 바와 같이 세로방향으로 2분할되어 1프레임이 91바이트의 데이터가 되며, 208×2프레임의 데이터가 된다. 그리고, 이 208×2프레임의 데이터의 선두에 13×2프레임의 링크 데이터(링크 에어리어 데이터)가 부가된다 (더욱 정확하게는 도 25를 참조하여 후술하는 바와 같이 26프레임분의 데이터의 일부가 전클러스터의 최후에 기록되며, 나머지는 현 클러스터의 선두에 기록된다.
91바이트의 프레임 데이터의 선두에는 또한 2바이트의 프레임 동기 신호(FS)가 부가된다. 그 결과는 도 20에 나타낸 바와 같이 1프레임의 데이터는 합계93(=91+2) 바이트의 데이터가 되며, 합계221(=208+13)×(93×2) 바이트(442프레임)의 블럭의 데이터가 된다. 이 1ECC 블럭 데이터가 1클러스터(기록의 단위로서의 블럭)분의 데이터가 된다. 그 오버 헤드 부분을 제외한 실데이터부의 크기는 32k 바이트(=2048×16/1024k바이트) 가 된다.
즉, 이 실시 형태의 경우, 1클러스터가 16섹터로써 구성되며, 1섹터가 26프레임으로써 조성된다.
도 21은 ROM 디스크(재생 전용 디스크)의, 도 22는 RAM 디스크(개서 가능형 디스크)의, 각각 클러스터와 다음 클러스터의 결합부에서의 프레임과, 프레임 동기 신호의 구성을 나타내고 있다. ROM 디스크에서는 클러스터와 다음 클러스터가 직접 결합되어 있다(링크 프레임을 사이에 두지 않고서 결합되어 있다). 1섹터는 13행의 데이터, 즉, 26프레임으로 구성되어 있고, 또한, 각 프레임의 선두에는 프레임 동기 신호(SY0 내지 SU7)가 부가되어 있다.
또한, RAM 디스크에 있어서는 클러스터와 다음 클러스터의 사이에 링크 에어리어가 배치되어 있다. 클러스터중의 최후의 13행의 데이터, 즉, 26프레임(1섹터)의 데이터에 계속해서 26프레임(1섹터)의 링크 에어리어가 부가되고, 계속해서, 다음 클러스터의 선두의 26프레임(1섹터)의 데이터가 부가되어 있다. 또, RAM 디스크의 클러스터중의 프레임 동기 신호와 ROM 디스크의 클러스터중의 프레임 동기 신호의 구성은 동일하게 되어 있다. 또한, RAM 디스크의 링크 에어리어의 프레임 동기 신호는 클러스터중 프레임 동기 신호와 동일한 구성으로 되어 있다. 즉, 클러스터이거나 링크 에어리어이거나 혹은 ROM 디스크이거나 RAM 디스크라도, 프레임 동기 신호는 동일한 패턴이 된다. 이러한 구성에 의해, RAM 디스크를 ROM 디스크 전용의 재생장치에 의해 용이하게 재생하는 것이 가능하다.
즉, ROM 디스크 전용의 재생장치에서는 데이터 블럭의 제 10행째 내지 제 13행째에 격납되어 있는 8개의 프레임 동기 신호(SY1, SY7, SY2, SY7, SY3, SY7, SY4, SY7)가 검출되면, 그 다음 데이터가 데이터 블럭의 선두부인 것을 인지하도록 이루어져 있기 때문에, 이들 8개의 프레임 동기 신호를 링크 에어리어에 격납함으로써 링크 에어리어의 다음에 연속하는 데이터 에어리어의 선두부를 재생장치에 인지시킬 수 있다.
ROM 디스크와 RAM 디스크의 클러스터에 있어서는 도면중, 공백 부분에서 나타내는 영역에 데이터가 기록된다. RAM 디스크의 링크 에어리어에 있어서는 그 앞측의 7행(14 프레임)의 공백부에 포스트앰블 데이터, 포스트가드 데이터, Slice/PLL 데이터 등이 기록되며, 뒤의 6행(12 프레임)은 링크 데이터 에어리어가 되며, 그 공백부에는 클러스터에서의 경우와 같이 데이터가 기록된다.
도 23은 링크 프레임내의 링크 데이터 에어리어내의 2프레임의 기록 재생 단위의 구성 예를 나타낸다. 상기 도면에 나타낸 바와 같이, 이 기록 재생 단위는 172바이트의 데이터에 10바이트의 내부호(PI)를 부가하였다. 2프레임에 의해 구성되어 있다. 즉, 이 단위는 도 19에 나타낸 ECC 블럭의 1행분과 동일한 구성으로 되어 있다. PI 계열만으로서는 ECC 블럭에서의 경우와 비교하여 에러 정정 능력이 뒤떨어지기 때문에 이 실시 형태의 경우, 도 22에 나타내는 6행의 링크 데이터 에어리어에 도 23에 나타내는 구성의 동일한 데이터가 6회 반복 기록된다.
도 24는 도 21과 도 22에 나타내는 프레임 동기 신호(SY0 내지 SY7)의 일례를 나타내고 있다. 또, 프레임 동기 신호는 2바이트의 데이터로 되어 있지만, 이 실시 형태에서는 채널 비트 데이터로 변환 후의 데이터를 나타내고 있기 때문에 각각 프레임 동기 신호의 데이터 길이는 32비트(4바이트)로 되어 있다. 예를 들면, SYO에는 스테이트 1 내지 스테이트4의 4종류가 존재하고, 91 바이트의 프레임 데이터(도 20참조)에 부가된 경우에 기록 재생 회로(33)에 의해서 DSV(Digitital Sum Value)가 최소가 되는 스테이트의 데이터가 선택되어 프레임 동기 신호로서 부가된다.
도 25는 클러스터와 클러스터 사이의 링크 에어리어의 보다 상세한 포맷을 나타낸다.
도 25에 나타낸 바와 같이 링크 에어리어(Link Frame)는 26프레임(1섹터)으로 이루어지고, 32k바이트의 데이터 블럭(클러스터)와 다음 32k바이트의 데이터 블럭(클러스터) 사이에 삽입되어 있다. 32k바이트 데이터 블럭의 전방의 링크 에어리어에는 Slicd/PLL 데이터와 링크 데이터가 기록되고, 32k바이트데이터 블럭의 후방의 링크 에어리어에는 포스트앰블(PA)과 포스트가드가 기록되어 있다.
Slice는 재생 데이터를 2치화하기 위한 시정수를 설정하기 위한 데이터이며, PLL은 클럭을 재생하기 위한 데이터이다. 링크 데이터는 클러스터에 있어서 기록되는 데이터와 실질적으로 동일한 데이터이다. 프레임 동기 신호(SY1 내지 SY7)는 도 24를 참조하여 상술한 바와 같이 스테이트1 내지 스테이트4 중의 어느 것이 선택되어 부가된다.
포스트앰블에는 최후의 데이터의 마크길이를 조절하여 신호 극성을 되돌리기 위한 데이터가 기록된다. 포스트가드는 디스크의 편심이라든지 디스크의 기록감도등에 따라서 발생하는 기록 지터를 흡수하는 에어리어이다. 또한, 포스트가드는 후술하는 바와 같이 데이터의 기록 개시 위치를 변경한 경우에 있어서도 다음에 기록되는 링크 에어리어와의 사이에서 데이터가 서로 간섭하는 것을 방지한다. 또 호스트가드는 지터가 전혀 없는 경우에서 또한, 후술하는 DPS(Data Position Shift)데이터가 0바이트인 경우 8바이트만큼 다음 데이터와 오버램되어 기록된다.
동기 신호(SYNC)는 4바이트의 데어터이며, 동기를 얻기 위한 신호이다. 또, 링크 에어리어의 최후의 4바이트는 앞으로의 이용을 위한 리서브 에어리어(res)이다.
각 크러스터의 기록은 스타트 포인트(Start Point)로부터 개시되며 스타트 포인트를 8바이트 초과(오버랩)한 곳에서 종료된다. 또한, 기록시에는 기록 재생 회로(33)는 0 내지 64바이트의 어느 값을 DPS 데이터의 값에 따라 링크 에어리어의 데이터와 32k바이트의 블럭 에이터의 기록 위치를 변경한다.
도 25에 확대하여 나타낸 바와 같이 예를 들면, DPS 데이터로서 0바이트가 선택된 경우, 전방 링크 에어리어의 최초의 프레임 동기 신호(SY1)의 앞에는 14바이트의 Slice/PLL 데이터가 부가되며, 또한, 후방 링크 에어리어의 최후의 프레임 동기 신호(SY1)의 뒤에는 85바이트의 포스트가드 데이터가 부가된다.
또한, DPS 데이터로서 32바이트가 선택된 경우, 전방 링크 에어리어의 최초의 프레임 동기 신호(SY1)의 앞에는 46바이트의 Slice/PLL 데이터가 부가되며, 후방 링크 에어리어의 최후의 프레임 동기 신호(SY5)의 뒤에는 53바이트의 포스트가드 데이터가 부가된다.
또한, DPS 데이터로서 64바이트가 선택된 경우, 전방 링크 에어리어의 최초의 프레임 동기 신호(SY1)의 앞에는 78바이트의 Slice/PLL 데이터가 부가되며, 후방 링크 에어리어의 최후의 프레임 동기 신호(SY5)의 뒤에는 21바이트의 포스트가드 데이터가 부가된다.
이와 같이 기록 재생 회로(33)가 선택되는 DPS 데이터의 값에 따라서 링크 에어리어와 클러스터에 있어서의 데이터의 기록되는 위치가 변화하게 된다. 따라서, 상 변화 디스크 등에 정보를 기록할 때에는 디스크의 같은 부분에 동일한 데이터(예를 들면 프레임 동기 신호 등)가 반복 기록되는 것을 방지할 수 있다. 또한, 그 때, 스타트 포인트는 고정으로 되어 있기 때문에 기록 타이밍의 발생은 종래와 같이 실시할 수 있다.
또, 상기 실시 형태에서의 각 영역의 길이(바이트수)는 일례이며, 적당히 소정의 값을 설정하는 것이 가능하다.
또한, 본 발명의 상 변화형의 디스크에 적용한 경우에는 특히 양호한 효과를 얻을 수 있다.
이상과 같은 특허청구범위 제 1항 기재된 기록 재생 장치 및 제 9항에 기재된 기록 재생 방법에 의하면, 제 2범위에 데이터를 기록 또는 재생하는 제 3범위를 규정하도록 하였기 때문에 재생 전용의 디스크와 호환성을 유지하면서 개서 가능한 디스크의 용량을 증가시킬 수 있다.
특허청구항 제 10항에 기재된 디스크에 의하면, 제 1범위와 제 1범위의 사이를 제 2범위에 의해 결합하여, 제 2범위의 속의 제 3범위에는 데이터를 기록하도록 하였기 때문에, 보다 고밀도로 데이터를 기록하는 것이 가능하다.

Claims (11)

  1. 데이터가 트랙을 따라서 기록되는 개서 가능한 디스크에 있어서,
    제 1사이즈를 갖는 섹터 데이터가 여러개 모여서 상기 트랙상에 형성된 제 2사이즈를 갖는 복수의 데이터 블럭과,
    각 데이터 블럭과 이 데이터 블럭에 연속하는 다음 데이터 블럭의 사이에 형성된 상기 제 1사이즈를 갖는 링크 에어리어를 구비하는 것을 특징으로 하는 디스크.
  2. 제 1항에 있어서,
    상기 제 2사이즈는 데이터의기록 또는 재생을 행하기 위한 단위인 것을 특징으로 하는 디스크.
  3. 제 1항에 있어서,
    상기 데이터 블럭은 제 1 및 제 2에러 정정 부호 계열에 의해서 각각 구성된 제 1 및 제 2에러 정정 블럭을 갖는 것을 특징으로 하는 디스크.
  4. 제 1항에 있어서,
    상기 링크 에어리어는 기록 개시 위치로서의 스타트 포인트와, 이 스타트 포인트로부터 기록되며, 랜덤인 값으로서 선택된 소정의 데이터량을 갖는 포지션 시프트 데이터를 포함하는 것을 특징으로 하는 디스크.
  5. 제 1항에 있어서,
    상기 트랙은 트랙 번호 및 둘레방향의 위치를 나타내는 세그먼트 번호를 포함하는 어드레스 정보에 대응하여 변조된 워블링홈으로 구성되는 것을 특징으로 하는 디스크.
  6. 제 1항에 있어서,
    상기 섹터 데이터는 각각의 프레임 동기 신호를 갖는 복수의 프레임 데이터로 구성되고, 이들 프레임 동기 신호는 복수 종류의 프레임 동기 신호내로부터 선택된 동기 데이터와 같은 순서로 배열된 프레임 데이터를 포함하는 것을 특징으로 하는 디스크.
  7. 데이터가 트랙을 따라서 기록되는 개서 가능한 디스크에 있어서,
    각각 소정의 프레임 동기 신호를 갖는 복수의 프레임 데이터로 이루어지는 섹터 데이터가 기록된 재생 전용 디스크와 동일한 프레임 구조를 가지며, 상기 섹터 데이터와 이것에 연속하는 섹터 데이터의 사이에 형성되어, 상기 프레임 동기 신호가 상기 섹터 데이터와 같은 순서로 배열된 프레임 데이터를 포함하는 링크 에어리어를 구비하는 것을 특징으로 하는 디스크.
  8. 개서 가능한 디스크에 데이터를 기록하기 위한 장치에 있어서,
    데이터를 상기 디스크에 형성된 트랙상에 기록된 데이터를 재생하기 위한 헤드와,
    입력된 데이터를 제 1사이즈를 갖는 데이터 블럭마다 상기 헤드로 출력하는 동시에, 이 데이터 블럭의 전후에 제 2사이즈를 갖는 링크 에어리어를 부가하여 출력하는 기록 회로를 구비하는 것을 특징으로 하는 장치.
  9. 제 8항에 있어서,
    상기 데이터 블럭은 복수의 상기 제 2사이즈를 갖는 섹터로 이루어지며, 이들 섹터에 부가하기 위한 섹터 어드레스를 발생하는 어드레스 발생 회로를 더 구비하는 것을 특징으로 하는 장치.
  10. 제 8항에 있어서,
    상기 링크 에어리어는 이 직전의 데이터 블럭의 뒤에 부가되는 전방 링크 에어리어와, 이 직후의 데이터 블럭에 부가되는 후방 링크 에어리어로 이루어지는 것을 특징으로 하는 장치.
  11. 제 8항에 있어서,
    상기 기록 회로는 상기 데이터 블럭에 제 1 및 제 2에러 정정 회로 부호 계열에 의해서 각각 구성된 제 1 및 제 2에러 정정 부호를 부가하는 것을 특징으로 하는 장치.
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