JP3079809B2 - 位相比較装置 - Google Patents
位相比較装置Info
- Publication number
- JP3079809B2 JP3079809B2 JP04301059A JP30105992A JP3079809B2 JP 3079809 B2 JP3079809 B2 JP 3079809B2 JP 04301059 A JP04301059 A JP 04301059A JP 30105992 A JP30105992 A JP 30105992A JP 3079809 B2 JP3079809 B2 JP 3079809B2
- Authority
- JP
- Japan
- Prior art keywords
- output
- frequency
- level
- expected value
- dividing
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired - Fee Related
Links
Landscapes
- Manipulation Of Pulses (AREA)
- Stabilization Of Oscillater, Synchronisation, Frequency Synthesizers (AREA)
Description
【０００１】
【産業上の利用分野】本発明は、位相比較装置に関し、
特にプログラム・デバイダとは別のカウンタを備え、該
カウンタにより入力信号をカウントし期待値とを比較す
ることにより位相比較手段からの出力信号（エラー・ア
ウト信号）を制御し、ロックアップタイムを短縮する位
相比較装置に関する。
特にプログラム・デバイダとは別のカウンタを備え、該
カウンタにより入力信号をカウントし期待値とを比較す
ることにより位相比較手段からの出力信号（エラー・ア
ウト信号）を制御し、ロックアップタイムを短縮する位
相比較装置に関する。
【０００２】
【従来の技術】従来の位相比較装置のブロック図を示す
図２を参照すると、この位相比較装置２００は、基準周
波数をつくる基準周波数発生器５と、被測定周波数を入
力する入力部４と、入力部４からの出力信号を分周する
ためのプログラム・デバイダ１と、このプログラム・デ
バイダ１へ分周値を設定する分周値設定レジスタ２と、
基準周波数発生器５の出力とプログラム・デバイダ１か
らの出力とを入力とする位相比較器３と、位相比較器３
の比較結果により所定のレベルを出力するチャージポン
プ６を有している。
図２を参照すると、この位相比較装置２００は、基準周
波数をつくる基準周波数発生器５と、被測定周波数を入
力する入力部４と、入力部４からの出力信号を分周する
ためのプログラム・デバイダ１と、このプログラム・デ
バイダ１へ分周値を設定する分周値設定レジスタ２と、
基準周波数発生器５の出力とプログラム・デバイダ１か
らの出力とを入力とする位相比較器３と、位相比較器３
の比較結果により所定のレベルを出力するチャージポン
プ６を有している。
【０００３】次に、従来技術の位相比較装置２００の動
作について説明する。
作について説明する。
【０００４】プログラム・デバイダ１への入力信号（ｆ
ｉｎ）を分周値設定レジスタ２により設定された分周値
（Ｎ）により分周された信号と基準周波数発生器５から
の基準周波数信号（ｆｒｅｆ）との位相を位相比較器３
で比較し、その結果によりチャージポンプ６からはｆｒ
ｅｆ＞ｆｉｎ／Ｎなら低レベルを出力し、ｆｒｅｆ＜ｆ
ｉｎ／Ｎなら高レベルを出力し、ｆｒｅｆ＝ｆｉｎ／Ｎ
なら高インピーダンスを出力する（図４参照）。
ｉｎ）を分周値設定レジスタ２により設定された分周値
（Ｎ）により分周された信号と基準周波数発生器５から
の基準周波数信号（ｆｒｅｆ）との位相を位相比較器３
で比較し、その結果によりチャージポンプ６からはｆｒ
ｅｆ＞ｆｉｎ／Ｎなら低レベルを出力し、ｆｒｅｆ＜ｆ
ｉｎ／Ｎなら高レベルを出力し、ｆｒｅｆ＝ｆｉｎ／Ｎ
なら高インピーダンスを出力する（図４参照）。
【０００５】また、図５に示すようにチャージポンプ６
からの出力２０１は、ローパスフィルタ１２にて高周波
成分が取り除かれた後、直流成分がＶＣＯ１３に入力さ
れ、その電圧レベルに応じた周波数がＶＣＯ１３より出
力される。また、ＶＣＯ１３からの出力信号は再び入力
部４に入力され、徐々に所定の周波数に近づくように動
作させながらこの動作を繰り返し行い出力２０１をロッ
クする。
からの出力２０１は、ローパスフィルタ１２にて高周波
成分が取り除かれた後、直流成分がＶＣＯ１３に入力さ
れ、その電圧レベルに応じた周波数がＶＣＯ１３より出
力される。また、ＶＣＯ１３からの出力信号は再び入力
部４に入力され、徐々に所定の周波数に近づくように動
作させながらこの動作を繰り返し行い出力２０１をロッ
クする。
【０００６】
【発明が解決しようとする課題】しかしながら、この従
来の位相比較装置では、チャージポンプからの出力であ
る高レベルおよび低レベルのそれぞれの間に高インピー
ダンス状態が存在していたため、大きく周波数を変化さ
せたときロックアップタイムが長くなる問題点があっ
た。
来の位相比較装置では、チャージポンプからの出力であ
る高レベルおよび低レベルのそれぞれの間に高インピー
ダンス状態が存在していたため、大きく周波数を変化さ
せたときロックアップタイムが長くなる問題点があっ
た。
【０００７】
【課題を解決するための手段】本発明の位相比較装置
は、基準周波数入力手段と、被測定周波数入力手段と、
前記被測定周波数を分周する可変分周手段と、前記可変
分周手段に分周値を設定するための分周値設定手段と、
前記基準周波数入力手段の出力と前記可変分周手段の出
力を入力とする位相比較手段と、前記位相比較手段の比
較結果により高レベルまたは低レベルまたは高インピー
ダンス状態を出力する第１のレベル出力出力手段を具備
する位相比較装置において、前記被測定周波数入力手段
の出力を所定の期間カウントするカウント手段と、期待
カウント値を記憶する期待値記憶手段と、前記カンウン
ト手段と前記期待値記憶手段の内容を比較する比較手段
と、前記比較手段の結果により、前記結果が前記期待値
に一致しないときは、高レベルまたは低レベル状態を出
力し、前記結果が前記期待値に一致したときは、高イン
ピーダンス状態を出力する第２のレベル出力手段とを有
する構成である。
は、基準周波数入力手段と、被測定周波数入力手段と、
前記被測定周波数を分周する可変分周手段と、前記可変
分周手段に分周値を設定するための分周値設定手段と、
前記基準周波数入力手段の出力と前記可変分周手段の出
力を入力とする位相比較手段と、前記位相比較手段の比
較結果により高レベルまたは低レベルまたは高インピー
ダンス状態を出力する第１のレベル出力出力手段を具備
する位相比較装置において、前記被測定周波数入力手段
の出力を所定の期間カウントするカウント手段と、期待
カウント値を記憶する期待値記憶手段と、前記カンウン
ト手段と前記期待値記憶手段の内容を比較する比較手段
と、前記比較手段の結果により、前記結果が前記期待値
に一致しないときは、高レベルまたは低レベル状態を出
力し、前記結果が前記期待値に一致したときは、高イン
ピーダンス状態を出力する第２のレベル出力手段とを有
する構成である。
【０００８】
【実施例】次に本発明の実施例について図面を参照して
説明する。
説明する。
【０００９】図１は本発明の第１の実施例の位相比較装
置のブロック図である。なお、従来技術の位相比較装置
と同一の構成要素については、同一参照番号を付してあ
る。
置のブロック図である。なお、従来技術の位相比較装置
と同一の構成要素については、同一参照番号を付してあ
る。
【００１０】この実施例の位相比較装置１００は、入力
部４より入力される周波数をカウンタ８により所定の期
間カウントを行い、期待値設定レジスタ１０に予め設定
されている期待値と一致検出回路９にて比較を行う。一
致検出回路９の結果により一致するまでは出力セレクタ
１１により選択された所定のレベル（高レベルまたは低
レベル）がチャージポンプ６′から出力され、一致した
ときには出力を高インピーダンス状態に保つ構成であ
る。
部４より入力される周波数をカウンタ８により所定の期
間カウントを行い、期待値設定レジスタ１０に予め設定
されている期待値と一致検出回路９にて比較を行う。一
致検出回路９の結果により一致するまでは出力セレクタ
１１により選択された所定のレベル（高レベルまたは低
レベル）がチャージポンプ６′から出力され、一致した
ときには出力を高インピーダンス状態に保つ構成であ
る。
【００１１】次に、本発明の第２の実施例の位相比較装
置について説明する。
置について説明する。
【００１２】この第２の実施例の位相比較装置３００
は、所定の周波数にロックするといいながらも実際には
ロックレンジには幅が有るため、前記期待値設定レジス
タ１０の下位ビットをマスクするマスクレジスタ１４を
有する以外は実施例１と同一の構成であるので図示する
に留め詳細な説明は省略する（図６参照）。
は、所定の周波数にロックするといいながらも実際には
ロックレンジには幅が有るため、前記期待値設定レジス
タ１０の下位ビットをマスクするマスクレジスタ１４を
有する以外は実施例１と同一の構成であるので図示する
に留め詳細な説明は省略する（図６参照）。
【００１３】以上、実施例１および２により出力される
チャージポンプ６の出力１０１およびチャージポンプ
６’の出力１０２の接続応用例を図７および図８に示
す。
チャージポンプ６の出力１０１およびチャージポンプ
６’の出力１０２の接続応用例を図７および図８に示
す。
【００１４】
【発明の効果】以上説明したように本発明は、所定の周
波数に一致するまでは高レベルまたは低レベルを出力し
たままにし、一致したならば出力を高インピーダンス状
態にするよう出力を制御したので、大きく周波数を変化
させたときにロックアップタイムを短縮するという効果
を有する。
波数に一致するまでは高レベルまたは低レベルを出力し
たままにし、一致したならば出力を高インピーダンス状
態にするよう出力を制御したので、大きく周波数を変化
させたときにロックアップタイムを短縮するという効果
を有する。
【図１】本発明の第１の実施例の位相比較装置のブロッ
ク図である。
ク図である。
【図２】従来技術の位相比較装置のブロック図である。
【図３】図１に示す位相比較器の回路図である。
【図４】図２に示す従来例のタイミングチャートであ
る。
る。
【図５】図２に示す従来例の応用例のブロック図であ
る。
る。
【図６】本発明の第２の実施例の位相比較装置のブロッ
ク図である。
ク図である。
【図７】図１に示す出力の応用接続例である。
【図８】図１に示す出力の他の応用接続例である。
１ プログラマブルデバイダ ２ 分周値設定レジスタ ３ 位相比較器 ４ 入力端子 ５ 基準周波数発生器 ６，６′ チャージポンプ ８ 周波数カウンタ ９ 一致検出回路 １０ 期待値設定レジスタ １１ セレクタ １２ ローパスフィルタ １３ ＶＣＯ １４ マスクレジスタ １００，２００，３００ 位相比較装置 １０１，１０２，２０１ チャージポンプ出力
Claims (1)
- 【請求項１】 基準周波数入力手段と、被測定周波数入
力手段と、前記被測定周波数を分周する可変分周手段
と、前記可変分周手段に分周値を設定するための分周値
設定手段と、前記基準周波数入力手段の出力と前記可変
分周手段の出力を入力とする位相比較手段と、前記位相
比較手段の比較結果により高レベルまたは低レベルまた
は高インピーダンス状態を出力する第１のレベル出力出
力手段を具備する位相比較装置において、前記被測定周
波数入力手段の出力を所定の期間カウントするカウント
手段と、期待カウント値を記憶する期待値記憶手段と、
前記カンウント手段と前記期待値記憶手段の内容を比較
する比較手段と、前記比較手段の結果により、前記結果
が前記期待値に一致しないときは、高レベルまたは低レ
ベル状態を出力し、前記結果が前記期待値に一致したと
きは、高インピーダンス状態を出力する第２のレベル出
力手段とを有することを特徴とする位相比較装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP04301059A JP3079809B2 (ja) | 1992-11-11 | 1992-11-11 | 位相比較装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP04301059A JP3079809B2 (ja) | 1992-11-11 | 1992-11-11 | 位相比較装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH06152398A JPH06152398A (ja) | 1994-05-31 |
| JP3079809B2 true JP3079809B2 (ja) | 2000-08-21 |
Family
ID=17892375
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP04301059A Expired - Fee Related JP3079809B2 (ja) | 1992-11-11 | 1992-11-11 | 位相比較装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP3079809B2 (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2009506246A (ja) * | 2005-08-25 | 2009-02-12 | ヨーマ−ポリュテック・クンストシュトッフテヒニーク・ゲーエムベーハー | オイルフィルタ |
-
1992
- 1992-11-11 JP JP04301059A patent/JP3079809B2/ja not_active Expired - Fee Related
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2009506246A (ja) * | 2005-08-25 | 2009-02-12 | ヨーマ−ポリュテック・クンストシュトッフテヒニーク・ゲーエムベーハー | オイルフィルタ |
Also Published As
| Publication number | Publication date |
|---|---|
| JPH06152398A (ja) | 1994-05-31 |
Similar Documents
| Publication | Publication Date | Title |
|---|---|---|
| CA2053748C (en) | Pll frequency synthesizer capable of changing an output frequency at a high speed | |
| JP3094977B2 (ja) | Ｐｌｌ回路 | |
| US6794944B2 (en) | Lock detection circuit | |
| US6798299B1 (en) | Crystal-less oscillator circuit with trimmable analog current control for increased stability | |
| US4264863A (en) | Pulse swallow type programmable frequency dividing circuit | |
| WO2002098005A1 (en) | Fractional-n synthesiser and method of synchronisation of the output phase | |
| JP3267260B2 (ja) | 位相同期ループ回路及びそれを使用した周波数変調方法 | |
| JP2002519904A (ja) | 位相ロック・ループのループ・フィルタ用充電ポンプ・ステアリング・システム及び方法 | |
| US6593787B2 (en) | Phase-locked loop circuit | |
| US5247265A (en) | PLL frequency synthesizer capable of changing an output frequency at a high speed | |
| JP3079809B2 (ja) | 位相比較装置 | |
| JP3079808B2 (ja) | 位相比較装置 | |
| JP2877185B2 (ja) | クロック発生器 | |
| JPH05276025A (ja) | 位相比較装置 | |
| KR100492691B1 (ko) | 펄스 스왈로 방식의 위상 제어 루프 회로 | |
| JP3079943B2 (ja) | Ｐｌｌ回路 | |
| US6310927B1 (en) | First order tuning circuit for a phase-locked loop | |
| JPH0461421A (ja) | Ｐｌｌ回路 | |
| JP3516785B2 (ja) | 周波数シンセサイザ装置 | |
| JP2004158940A (ja) | Ｐｌｌ回路とそれを用いた信号発生器 | |
| AU654628B2 (en) | PLL frequency synthesizer capable of changing an output frequency at a high speed | |
| JPH08148994A (ja) | ディジタルｐｌｌ回路 | |
| JPS5951788B2 (ja) | 位相比較装置 | |
| JP2959420B2 (ja) | 位相比較回路 | |
| JPH05122065A (ja) | Ｐｌｌ周波数シンセサイザ誤動作防止方式 |
Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 20000523 |
|
| LAPS | Cancellation because of no payment of annual fees |