KR20060000865A - 레지스터 제어형 지연 고정 루프 및 그의 제어 방법 - Google Patents
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Abstract
Description
Claims (22)
- 지연 고정 루프를 포함하는 반도체 소자에 있어서,상기 지연 고정 루프로부터 출력되는 내부 클럭 신호가 상기 지연 고정 루프에 인가되는 외부 클럭 신호에 대략 정렬되도록 거친 지연 동작을 수행하기 위한 거친 지연부; 및상기 거친 지연부로부터 출력되는 클럭 신호를 병렬로 입력받아 서로 다른 시간차를 가진 복수의 클럭 신호를 생성하고, 상기 외부 클럭 신호의 위상과 상기 내부 클럭 신호의 위상 비교에 따라 상기 복수의 클럭 신호를 혼합하여 미세한 지연 동작을 수행하기 위한 미세 지연부를 포함하는 레지스터 제어형 지연 고정 루프.
- 제1항에 있어서, 상기 미세 지연부는,상기 거친 지연부로부터 출력되는 클럭 신호를 병렬로 입력받아 서로 다른 지연 시간차를 갖는 제1 및 제2 클럭 신호를 출력하기 위한 복수의 미세 지연 라인;상기 외부 클럭 신호의 위상과 상기 내부 클럭 신호의 위상을 비교하여 위상 감지 신호를 출력하기 위한 위상 감지부;상기 위상 감지 신호에 따라 가중치를 결정하여 출력하기 위한 혼합 제어부; 및상기 가중치를 이용하여 입력되는 상기 제1 및 제2 클럭 신호의 위상을 혼합하기 위한 위상 혼합부를 포함하는 레지스터 제어형 지연 고정 루프.
- 제2항에 있어서,상기 복수의 미세 지연 라인은, 대략 상기 지연 고정 루프의 외부에서 발생하는 노이즈의 영향에 따라 변동될 수 있는 지연량에 대응할 수 있는 소정의 단위 지연 셀을 포함하는 레지스터 제어형 지연 고정 루프.
- 제3항에 있어서, 상기 복수의 미세 지연 라인은,순차적으로 연결된 N개의 단위 지연 셀을 구비하고, 상기 거친 지연 라인으로부터 출력되는 클럭 신호를 입력받아 H개(여기서, H≤N임)의 활성화된 단위 지연 셀을 통과시킬 수 있는 제1 미세 지연 라인; 및순차적으로 연결된 N+1개의 단위 지연 셀을 구비하고, 상기 거친 지연 라인으로부터 출력되는 클럭 신호를 입력받아 H+1개의 활성화된 단위 지연 셀을 통과시킬 수 있는 제2 미세 지연 라인을 포함하는 레지스터 제어형 지연 고정 루프.
- 제4항에 있어서, 상기 제1 미세 지연 라인은,상기 혼합 제어부로부터 출력되는 제어 신호에 따라 기수개의 단위 지연 셀이 활성화될 수 있는 레지스터 제어형 지연 고정 루프.
- 제5항에 있어서, 상기 제2 미세 지연 라인은,상기 혼합 제어부로부터 출력되는 제어 신호에 따라 상기 기수개의 단위 지연 셀보다 하나 많거나 적은 우수개의 단위 지연 셀이 활성화될 수 있는 레지스터 제어형 지연 고정 루프.
- 제4항 또는 제6항에 있어서, 상기 위상 혼합부는,상기 제1 미세 지연 라인으로부터 출력되는 제1 클럭 신호에 1에서 상기 가중치를 뺀 값을 승산한 결과와, 상기 제2 미세 지연 라인으로부터 출력되는 제2 클럭 신호에 상기 가중치를 승산한 결과를 가산하여 출력하는 레지스터 제어형 지연 고정 루프.
- 외부 클럭 신호를 소정 시간 동안 지연시킬 수 있는 거친 지연 라인;상기 거친 지연 라인으로부터 출력되는 클럭 신호를 병렬로 입력받아 서로 다른 지연 시간차를 갖는 제1 및 제2 클럭 신호를 출력하기 위한 복수의 미세 지연 라인;상기 외부 클럭 신호의 위상과 상기 지연 고정 루프로부터 출력되는 내부 클럭 신호의 위상을 비교하여 위상 감지 신호를 출력하기 위한 위상 감지부;상기 위상 감지 신호에 따라 가중치를 결정하여 출력하기 위한 혼합 제어부; 및상기 제1 및 제2 클럭 신호를 입력받아 상기 제1 및 제2 클럭 신호의 위상을 혼합하기 위한 위상 혼합부를 포함하는 레지스터 제어형 지연 고정 루프.
- 제8항에 있어서,상기 복수의 미세 지연 라인은, 대략 상기 지연 고정 루프가 노이즈의 영향에 따라 변동될 수 있는 지연량에 대응할 수 있는 소정의 단위 지연 셀을 포함하는 레지스터 제어형 지연 고정 루프.
- 제9항에 있어서, 상기 복수의 미세 지연 라인은,순차적으로 연결된 N개의 단위 지연 셀을 구비하고, 상기 거친 지연 라인으 로부터 출력되는 클럭 신호를 입력받아 H개(여기서, H≤N임)의 활성화된 단위 지연 셀을 통과시킬 수 있는 제1 미세 지연 라인; 및순차적으로 연결된 N+1개의 단위 지연 셀을 구비하고, 상기 거친 지연 라인으로부터 출력되는 클럭 신호를 입력받아 H+1개의 활성화된 단위 지연 셀을 통과시킬 수 있는 제2 미세 지연 라인을 포함하는 레지스터 제어형 지연 고정 루프.
- 제10항에 있어서, 상기 제1 미세 지연 라인은,상기 혼합 제어부로부터 출력되는 제어 신호에 따라 기수개의 단위 지연 셀이 활성화될 수 있는 레지스터 제어형 지연 고정 루프.
- 제11항에 있어서, 상기 제2 미세 지연 라인은,상기 혼합 제어부로부터 출력되는 제어 신호에 따라 상기 기수개의 단위 지연 셀보다 하나 많거나 적은 우수개의 단위 지연 셀이 활성화될 수 있는 레지스터 제어형 지연 고정 루프.
- 제10항 또는 제12항에 있어서, 상기 위상 혼합부는,상기 제1 미세 지연 라인으로부터 출력되는 제1 클럭 신호에 1에서 상기 가중치를 뺀 값을 승산한 결과와, 상기 제2 미세 지연 라인으로부터 출력되는 제2 클럭 신호에 상기 가중치를 승산한 결과를 가산하여 출력하는 레지스터 제어형 지연 고정 루프.
- 반도체 소자의 지연 고정 루프를 제어함에 있어서,상기 지연 고정 루프로부터 출력되는 내부 클럭 신호가 상기 지연 고정 루프에 인가되는 외부 클럭 신호에 대략적으로 정렬되도록 거친 지연 동작을 수행하여 클럭 신호를 출력하는 제1 단계; 및상기 제1 단계의 수행으로 출력되는 클럭 신호를 병렬로 입력받아 서로 다른 시간차를 가진 복수의 클럭 신호를 생성하고, 상기 외부 클럭 신호의 위상과 상기 내부 클럭 신호의 위상 비교에 따라 상기 복수의 클럭 신호를 혼합하여 미세한 지연 동작을 수행하는 제2 단계를 포함하는 레지스터 제어형 지연 고정 루프의 제어 방법.
- 제14항에 있어서, 상기 제2 단계는,상기 제1 단계의 수행으로 출력되는 클럭 신호를 병렬로 입력받아 서로 다른 지연 시간차를 갖는 제1 및 제2 클럭 신호를 출력하는 단계;상기 외부 클럭 신호의 위상과 상기 내부 클럭 신호의 위상을 비교하여 위상 감지 신호를 출력하는 단계;상기 위상 감지 신호에 따라 가중치를 결정하여 출력하는 단계; 및상기 가중치를 이용하여 입력되는 상기 제1 및 제2 클럭 신호의 위상을 혼합하는 단계를 포함하는 레지스터 제어형 지연 고정 루프의 제어 방법.
- 제15항에 있어서,상기 제1 클럭 신호는, 기수개의 단위 지연 셀을 통과하는 클럭 신호이고, 상기 제2 클럭 신호는, 상기 기수개의 단위 지연 셀보다 하나 많거나 적은 우수개의 단위 지연 셀을 통과하는 클럭 신호인 레지스터 제어형 지연 고정 루프의 제어 방법.
- 제15항 또는 제16항에 있어서, 상기 위상을 혼합하는 단계는,상기 제1 클럭 신호에 1에서 상기 가중치를 뺀 값을 승산한 결과와, 상기 제2 클럭 신호에 상기 가중치를 승산한 결과를 가산하여 출력하는 레지스터 제어형 지연 고정 루프의 제어 방법.
- 지연 고정 루프를 포함하는 반도체 소자에 있어서,상기 지연 고정 루프로부터 출력되는 내부 클럭 신호가 상기 지연 고정 루프에 인가되는 외부 클럭 신호에 대략 정렬되도록 거친 지연 동작을 수행하기 위한 거친 지연부;상기 거친 지연부로부터 출력되는 클럭 신호를 소정 시간 지연시켜 출력하기 위한 제1 미세 지연 라인; 및상기 거친 지연부로부터 출력되는 클럭 신호를 상기 소정 시간보다 1 단위 지연 시간 - 상기 1 단위 지연 시간은 1 단위 지연 셀에 의해 지연되는 시간임 - 만큼 더 지연시켜 출력하기 위한 제2 미세 지연 라인을 포함하는 레지스터 제어형 지연 고정 루프.
- 제18항에 있어서,상기 제1 및 제2 미세 지연 라인은, 대략 상기 지연 고정 루프의 외부에서 발생하는 노이즈의 영향에 따라 변동될 수 있는 지연량에 대응할 수 있는 소정의 단위 지연 셀을 포함하는 레지스터 제어형 지연 고정 루프.
- 제19항에 있어서,상기 제1 미세 지연 라인은, 순차적으로 연결된 N개의 단위 지연 셀을 구비하고, 상기 거친 지연 라인으로부터 출력되는 클럭 신호를 입력받아 H개(여기서, H≤N임)의 활성화된 단위 지연 셀을 통과시킬 수 있고,상기 제2 미세 지연 라인은, 순차적으로 연결된 N+1개의 단위 지연 셀을 구비하고, 상기 거친 지연 라인으로부터 출력되는 클럭 신호를 입력받아 H+1개의 활성화된 단위 지연 셀을 통과시킬 수 있는레지스터 제어형 지연 고정 루프.
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