JPS616849A - パワー用半導体モジユールの製造方法 - Google Patents
パワー用半導体モジユールの製造方法Info
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- 239000004065 semiconductor Substances 0.000 title claims description 43
- 238000000034 method Methods 0.000 title claims description 31
- 229910000679 solder Inorganic materials 0.000 claims description 74
- 238000002844 melting Methods 0.000 claims description 49
- 230000008018 melting Effects 0.000 claims description 49
- 239000002184 metal Substances 0.000 claims description 38
- 229910052751 metal Inorganic materials 0.000 claims description 38
- 239000000758 substrate Substances 0.000 claims description 37
- 238000004519 manufacturing process Methods 0.000 claims description 26
- 239000000919 ceramic Substances 0.000 claims description 14
- 238000000926 separation method Methods 0.000 claims description 12
- UFHFLCQGNIYNRP-UHFFFAOYSA-N Hydrogen Chemical compound [H][H] UFHFLCQGNIYNRP-UHFFFAOYSA-N 0.000 claims description 7
- 239000007789 gas Substances 0.000 claims description 7
- 230000004907 flux Effects 0.000 claims description 6
- 238000002156 mixing Methods 0.000 claims description 5
- 239000000463 material Substances 0.000 claims description 4
- 239000004576 sand Substances 0.000 claims description 4
- 239000010409 thin film Substances 0.000 claims description 4
- 238000005498 polishing Methods 0.000 claims description 3
- 238000005476 soldering Methods 0.000 description 20
- 238000010586 diagram Methods 0.000 description 6
- 238000010438 heat treatment Methods 0.000 description 4
- 230000000694 effects Effects 0.000 description 3
- 239000001257 hydrogen Substances 0.000 description 3
- 229910052739 hydrogen Inorganic materials 0.000 description 3
- RYGMFSIKBFXOCR-UHFFFAOYSA-N Copper Chemical compound [Cu] RYGMFSIKBFXOCR-UHFFFAOYSA-N 0.000 description 2
- PXHVJJICTQNCMI-UHFFFAOYSA-N Nickel Chemical compound [Ni] PXHVJJICTQNCMI-UHFFFAOYSA-N 0.000 description 2
- XUIMIQQOPSSXEZ-UHFFFAOYSA-N Silicon Chemical compound [Si] XUIMIQQOPSSXEZ-UHFFFAOYSA-N 0.000 description 2
- BQCADISMDOOEFD-UHFFFAOYSA-N Silver Chemical compound [Ag] BQCADISMDOOEFD-UHFFFAOYSA-N 0.000 description 2
- 229910052802 copper Inorganic materials 0.000 description 2
- 239000010949 copper Substances 0.000 description 2
- 239000010408 film Substances 0.000 description 2
- PCHJSUWPFVWCPO-UHFFFAOYSA-N gold Chemical compound [Au] PCHJSUWPFVWCPO-UHFFFAOYSA-N 0.000 description 2
- 238000005488 sandblasting Methods 0.000 description 2
- 229910052710 silicon Inorganic materials 0.000 description 2
- 239000010703 silicon Substances 0.000 description 2
- 229910052709 silver Inorganic materials 0.000 description 2
- 239000004332 silver Substances 0.000 description 2
- 230000008646 thermal stress Effects 0.000 description 2
- 101150071746 Pbsn gene Proteins 0.000 description 1
- ATJFFYVFTNAWJD-UHFFFAOYSA-N Tin Chemical compound [Sn] ATJFFYVFTNAWJD-UHFFFAOYSA-N 0.000 description 1
- 230000015572 biosynthetic process Effects 0.000 description 1
- 239000011248 coating agent Substances 0.000 description 1
- 238000000576 coating method Methods 0.000 description 1
- 239000004020 conductor Substances 0.000 description 1
- 238000001816 cooling Methods 0.000 description 1
- 125000004122 cyclic group Chemical group 0.000 description 1
- 238000009501 film coating Methods 0.000 description 1
- 239000010931 gold Substances 0.000 description 1
- 229910052737 gold Inorganic materials 0.000 description 1
- 229910000765 intermetallic Inorganic materials 0.000 description 1
- 238000005304 joining Methods 0.000 description 1
- 150000002739 metals Chemical class 0.000 description 1
- 238000012986 modification Methods 0.000 description 1
- 230000004048 modification Effects 0.000 description 1
- 229910052759 nickel Inorganic materials 0.000 description 1
- 238000007747 plating Methods 0.000 description 1
- 229920003002 synthetic resin Polymers 0.000 description 1
- 239000000057 synthetic resin Substances 0.000 description 1
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- H01L24/00—Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
- H01L24/80—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
- H01L24/83—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a layer connector
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- H01L23/00—Details of semiconductor or other solid state devices
- H01L23/48—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor
- H01L23/488—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor consisting of soldered or bonded constructions
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- H01L24/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L24/26—Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
- H01L24/31—Structure, shape, material or disposition of the layer connectors after the connecting process
- H01L24/33—Structure, shape, material or disposition of the layer connectors after the connecting process of a plurality of layer connectors
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- H01L25/00—Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof
- H01L25/03—Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof all the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/00, or in a single subclass of H10K, H10N, e.g. assemblies of rectifier diodes
- H01L25/04—Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof all the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/00, or in a single subclass of H10K, H10N, e.g. assemblies of rectifier diodes the devices not having separate containers
- H01L25/07—Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof all the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/00, or in a single subclass of H10K, H10N, e.g. assemblies of rectifier diodes the devices not having separate containers the devices being of a type provided for in group H01L29/00
- H01L25/072—Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof all the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/00, or in a single subclass of H10K, H10N, e.g. assemblies of rectifier diodes the devices not having separate containers the devices being of a type provided for in group H01L29/00 the devices being arranged next to each other
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- H01L2224/26—Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
- H01L2224/28—Structure, shape, material or disposition of the layer connectors prior to the connecting process
- H01L2224/29—Structure, shape, material or disposition of the layer connectors prior to the connecting process of an individual layer connector
- H01L2224/29001—Core members of the layer connector
- H01L2224/29099—Material
- H01L2224/291—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof
- H01L2224/29101—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof the principal constituent melting at a temperature of less than 400°C
- H01L2224/29111—Tin [Sn] as principal constituent
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- H01L2224/8319—Arrangement of the layer connectors prior to mounting
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
r音掌トの利用分野]
この発明は、多くの部分を互に異る融点を有する軟質は
んだを用いて接着する多くのステップを経て製造される
、分離構造を有するパワー用半導体モジュールの製造方
法及び 金属基板とセラミック製分離板との間に少くとも1個の
はんだによる接着部を有し、上記金属基板と上記はんだ
の薄膜と上記分離板がほぼ水平姿勢をとりつつ上下に積
重ねられ、融点以上に加熱された炉内に挿入される工程
を有するパワー用半導体モジュールの製造方法に関する
。
んだを用いて接着する多くのステップを経て製造される
、分離構造を有するパワー用半導体モジュールの製造方
法及び 金属基板とセラミック製分離板との間に少くとも1個の
はんだによる接着部を有し、上記金属基板と上記はんだ
の薄膜と上記分離板がほぼ水平姿勢をとりつつ上下に積
重ねられ、融点以上に加熱された炉内に挿入される工程
を有するパワー用半導体モジュールの製造方法に関する
。
分離構造を有するパワー用半導体モジュニルはすでに西
独国の実用新案明細書7513432に開示されている
。このようなパワー用半導体モジュール線通常多くの部
分をはんだによる接着すなわち、はんだ付けによ−って
結合される。
独国の実用新案明細書7513432に開示されている
。このようなパワー用半導体モジュール線通常多くの部
分をはんだによる接着すなわち、はんだ付けによ−って
結合される。
上記のはんだ付けはすべて同じはんだによって行なわれ
る場合もあり、又、半導体チップから基板にゆくに従っ
て次第に段階的に低下する融点を有する複数個のはんだ
を用いて行なわれることもある。いずれの場合にも低融
点を有するはんだとしては、pb Sn 63 のは
んだが用いられ、所要に応じて部分的にフラックスが使
用される。このようなモジュールは市販のパワー用半導
体モジュールとして用いられている。
る場合もあり、又、半導体チップから基板にゆくに従っ
て次第に段階的に低下する融点を有する複数個のはんだ
を用いて行なわれることもある。いずれの場合にも低融
点を有するはんだとしては、pb Sn 63 のは
んだが用いられ、所要に応じて部分的にフラックスが使
用される。このようなモジュールは市販のパワー用半導
体モジュールとして用いられている。
上記はんだpb Sn 63 は多くの錫成分を含み
、金属間化合物を形成してもろくなりやすく、特に銀被
覆された部分のはんだ付けを行なう場合には、その傾向
が強い。特に危険なはんだ付は場所は、大きな表面を有
し、大きな熱応力が生ずる場所である。このようなはん
だ付は場所は繰返し負荷に対して弱く、上記のようにフ
ラックスを使用する場合はこの好ま1.りない性質は増
大する。
、金属間化合物を形成してもろくなりやすく、特に銀被
覆された部分のはんだ付けを行なう場合には、その傾向
が強い。特に危険なはんだ付は場所は、大きな表面を有
し、大きな熱応力が生ずる場所である。このようなはん
だ付は場所は繰返し負荷に対して弱く、上記のようにフ
ラックスを使用する場合はこの好ま1.りない性質は増
大する。
パワー用半導体モジュールに於ては、異る什外からなり
、互にはんだ付される部分が有する多くの異る膨張係数
が強く注目される。このような場合異る膨張係数を有す
るはんだ付は部分が互に補償するように形成するために
は、比較的大きなはんだ層の厚さくたとえば100μm
)が必要である。上記のように厚いはんだ層は、比較的
厚い金属基板とその上にはんだ付けされるセラミック製
の分離板との接着に特に有効である。しかし厚いはんだ
層を介して金属とセラミックを結合することは困難であ
ることが知られている。それは、はんだ層が厚いと、は
んだが所定のはんだ付は領域の外に流出して、所定のは
んだ層の厚さが得られず、所望の繰返し負荷に対する強
度が得られないからである。又、その他はんだ付は部に
空洞ができたり、比較的大きなはんだ付は部の内側に空
所を生じたり、す、又繰返し負荷に対する強度が低下す
るという欠点を生ずることがある。
、互にはんだ付される部分が有する多くの異る膨張係数
が強く注目される。このような場合異る膨張係数を有す
るはんだ付は部分が互に補償するように形成するために
は、比較的大きなはんだ層の厚さくたとえば100μm
)が必要である。上記のように厚いはんだ層は、比較的
厚い金属基板とその上にはんだ付けされるセラミック製
の分離板との接着に特に有効である。しかし厚いはんだ
層を介して金属とセラミックを結合することは困難であ
ることが知られている。それは、はんだ層が厚いと、は
んだが所定のはんだ付は領域の外に流出して、所定のは
んだ層の厚さが得られず、所望の繰返し負荷に対する強
度が得られないからである。又、その他はんだ付は部に
空洞ができたり、比較的大きなはんだ付は部の内側に空
所を生じたり、す、又繰返し負荷に対する強度が低下す
るという欠点を生ずることがある。
この発明は従来のパワー用半導体モジュール製造方法に
よって生ずる上記不都合、すなわち繰返し負荷に対する
低強度を問題として取上げ、上記不都合を解消したパワ
ー用半導体モジエールの製造方法を提供することを目的
としている。
よって生ずる上記不都合、すなわち繰返し負荷に対する
低強度を問題として取上げ、上記不都合を解消したパワ
ー用半導体モジエールの製造方法を提供することを目的
としている。
上記問題を解決するために、多くの部分を互に異る融点
を有する軟質はんだを用いて接着する多くのステップを
経て製造される分離構造を有するこの発明のパワー用半
導体モジュールの製造方法にあっては、半導体モジュー
ルは、半導体サンドイッチと、金属基板からなる一℃ヤ
リャ部、セラミック製分離板及び接続板が、高融点のは
んだによって接着される第1のステップと、半導体サン
ドイッチとキャリヤ部は低融点のはんだによって接着さ
れる第2のステップを用いて製造され、上記両スデツブ
に於て、はんだ付けはフラックスを用することなく、水
素ガス又は成形ガス(FormI@rgas )を用い
て行なわれ、上記第2のステップに於ては適切な寸法と
配置を定められたことにより、高融点はんだと低融点は
んだの混合が生ぜぬように形成される第1の方法で型造
され、又、 金属基板の上面のはんだ付けされる部分が粗面に形成さ
れる第1のステップと、多くの半導体サンドイッチと、
金属基板とセラミックス製の分離板と接続板からなるキ
ャリヤ部との接着を高融点を有するはんだを用いて行な
う第2のステップと、半導体サンドイッチとキャリヤ部
が低融点のはんだを用いて互に接着される第3のステッ
プを具備し、上記第2及び第3のステップではフラック
スが使用されることなく、水素ガス又は成形ガス(Fo
rmiergas )の作用の下にはんだによる接着が
行なわれ、第3のステップでは、適切な寸法と配置を定
められることにより、高融点のはんだと低融点のはんだ
が混合せぬように形成される第2の方法によって製造さ
れる。
を有する軟質はんだを用いて接着する多くのステップを
経て製造される分離構造を有するこの発明のパワー用半
導体モジュールの製造方法にあっては、半導体モジュー
ルは、半導体サンドイッチと、金属基板からなる一℃ヤ
リャ部、セラミック製分離板及び接続板が、高融点のは
んだによって接着される第1のステップと、半導体サン
ドイッチとキャリヤ部は低融点のはんだによって接着さ
れる第2のステップを用いて製造され、上記両スデツブ
に於て、はんだ付けはフラックスを用することなく、水
素ガス又は成形ガス(FormI@rgas )を用い
て行なわれ、上記第2のステップに於ては適切な寸法と
配置を定められたことにより、高融点はんだと低融点は
んだの混合が生ぜぬように形成される第1の方法で型造
され、又、 金属基板の上面のはんだ付けされる部分が粗面に形成さ
れる第1のステップと、多くの半導体サンドイッチと、
金属基板とセラミックス製の分離板と接続板からなるキ
ャリヤ部との接着を高融点を有するはんだを用いて行な
う第2のステップと、半導体サンドイッチとキャリヤ部
が低融点のはんだを用いて互に接着される第3のステッ
プを具備し、上記第2及び第3のステップではフラック
スが使用されることなく、水素ガス又は成形ガス(Fo
rmiergas )の作用の下にはんだによる接着が
行なわれ、第3のステップでは、適切な寸法と配置を定
められることにより、高融点のはんだと低融点のはんだ
が混合せぬように形成される第2の方法によって製造さ
れる。
又、上述の金属基板とセラミック製の分離板との間に少
くとも1個のはんだによる接着部を有し、上記金属基板
と上記はんだの薄膜とセラミック製の上記分離板がそれ
ぞれ#1は水平姿勢をとりつつ上下に積重ねられて、融
点以上に加熱された炉内に挿入される工程を具備するパ
ワー用半導体モジュールの製造方法に於ては、上記半導
体モジュールは、金属基板の上面のはんだにより接着さ
れる部分のみを予め粗面に形成するステップを含む第3
の方法により製造される0 〔発明の効果〕 上述の第1の方法に於て得られる効果は下記の如くであ
る。すなわち、頑丈な金属基板、たとえば直接のボンデ
ィングによって形成された金属−セラミック基板を備え
、従来使用されていた勝れたモジコ、−ルの製造方法に
比較的僅かな変更を施すことによって、繰返し負荷に対
する強度を増加できることであり、又、金属基板の結合
に対して高融点はんだが使用されること、モジュールの
大きな部分、すなわち半導体サンドイッチ及びキャリヤ
部が平行に予め形成されているので、すぐれた加工を行
なうことができること、更にモジュール製造のステップ
のうち、引続いて施される2ステツプははんだ付は工程
のみであることである。それはおのおのの加熱工程に於
ては、予め定められたはんだ付は位置が加熱用容器の中
で動いたり、又、温度がはんだの融点に達しないことを
避けることができるからである。
くとも1個のはんだによる接着部を有し、上記金属基板
と上記はんだの薄膜とセラミック製の上記分離板がそれ
ぞれ#1は水平姿勢をとりつつ上下に積重ねられて、融
点以上に加熱された炉内に挿入される工程を具備するパ
ワー用半導体モジュールの製造方法に於ては、上記半導
体モジュールは、金属基板の上面のはんだにより接着さ
れる部分のみを予め粗面に形成するステップを含む第3
の方法により製造される0 〔発明の効果〕 上述の第1の方法に於て得られる効果は下記の如くであ
る。すなわち、頑丈な金属基板、たとえば直接のボンデ
ィングによって形成された金属−セラミック基板を備え
、従来使用されていた勝れたモジコ、−ルの製造方法に
比較的僅かな変更を施すことによって、繰返し負荷に対
する強度を増加できることであり、又、金属基板の結合
に対して高融点はんだが使用されること、モジュールの
大きな部分、すなわち半導体サンドイッチ及びキャリヤ
部が平行に予め形成されているので、すぐれた加工を行
なうことができること、更にモジュール製造のステップ
のうち、引続いて施される2ステツプははんだ付は工程
のみであることである。それはおのおのの加熱工程に於
ては、予め定められたはんだ付は位置が加熱用容器の中
で動いたり、又、温度がはんだの融点に達しないことを
避けることができるからである。
上記第2及び第3の方法のうち、第3の方法によれば、
金属基板の設けられた粗面の存在によって、はんだLは
んだ付は位置の外に流出することなく、従ってはんだを
所定のはんだ付は位置のみに耐着させられるという効果
を得ることができる。
金属基板の設けられた粗面の存在によって、はんだLは
んだ付は位置の外に流出することなく、従ってはんだを
所定のはんだ付は位置のみに耐着させられるという効果
を得ることができる。
又、第2の方法によれば、第1の方法によって実施され
る2段階のはんだ付けは上記第3の方法を利用すること
によって、金属基板に対するはんだ付けをすぐれたもの
に改善することができる。
る2段階のはんだ付けは上記第3の方法を利用すること
によって、金属基板に対するはんだ付けをすぐれたもの
に改善することができる。
次に図面を参照しつつ本発明の詳細な説明する。第1
a図、第1b図、第2a図、第2b図、及び第3図は前
述の特許請求範囲の第〔1〕項に対応する実施例であり
、第4図は特許請求の範囲の第〔4〕項に対応する実施
例であり、特許請求の範囲の第〔5〕項はすべての図と
関連する。上図のうちの第2a図に描かれている金属基
板8は第4図に描かれている金属基板8aに代置するこ
とができる。
a図、第1b図、第2a図、第2b図、及び第3図は前
述の特許請求範囲の第〔1〕項に対応する実施例であり
、第4図は特許請求の範囲の第〔4〕項に対応する実施
例であり、特許請求の範囲の第〔5〕項はすべての図と
関連する。上図のうちの第2a図に描かれている金属基
板8は第4図に描かれている金属基板8aに代置するこ
とができる。
第1a図には、半導体サンドイッチ(第1b図参照)を
形成するのに必要な部材を示す。上記半導体サンドイッ
チ7は第1a図に示すように、下から上に順次積重ねら
れ、モリブデン又はバーコン(Vacon ) によ
って形成された下側補償円板(4usgleiclls
ronde ) 1と、高融点を有する材料を用いて円
板状に形成された高融点はんだ2と、シリコン半導体チ
ップ3と、高融点を有する材料で中心に貫通孔を有し円
板状に形成された高融点はんだ2aと、硬質はんだによ
り陰極棒5に取付けられている上側補償円板4と、銅製
で予めはんだで被覆され、制御用に接続された導線6を
含んでいる。上記1〜60部材ははんだによる接着のた
めの型に挿入され、水素又は反応ガス(Formi・r
gaa )の下ではんだ付けされている。上記高融点は
んだ2は例えばpb an 5又はpb Ag an
によって形成される。
形成するのに必要な部材を示す。上記半導体サンドイッ
チ7は第1a図に示すように、下から上に順次積重ねら
れ、モリブデン又はバーコン(Vacon ) によ
って形成された下側補償円板(4usgleiclls
ronde ) 1と、高融点を有する材料を用いて円
板状に形成された高融点はんだ2と、シリコン半導体チ
ップ3と、高融点を有する材料で中心に貫通孔を有し円
板状に形成された高融点はんだ2aと、硬質はんだによ
り陰極棒5に取付けられている上側補償円板4と、銅製
で予めはんだで被覆され、制御用に接続された導線6を
含んでいる。上記1〜60部材ははんだによる接着のた
めの型に挿入され、水素又は反応ガス(Formi・r
gaa )の下ではんだ付けされている。上記高融点は
んだ2は例えばpb an 5又はpb Ag an
によって形成される。
第1b図は上記第1a図の部材1〜6を上記のようには
んだ付けにより結合した後の状態を示す。
んだ付けにより結合した後の状態を示す。
第2a図は第2b図のキャリヤ部11を構成する各部材
を示し、各部材は上下に間隔をへだでて描かれている。
を示し、各部材は上下に間隔をへだでて描かれている。
上記各部材は、ニッケルめっきされた銅からなる金属基
板8の上方に描かれた高融点はんだ2と、たとえばA/
、、O,又はBeQからなり、Mo Mg Ni Au
又はWo NI Au からなる薄膜被覆を施さ
れるが、又は直接ボンディングによって形成された金属
被覆を有する分離(アイ4レーシヨン)板9と、高融点
を有する材料で円板状に形成された高融点はんだ2と、
銀めっき又祉ニッケルめっきを施された接続板10を含
んでいる。これらの部材はめっき用の型内に挿入され水
素又は成形ガス(Formiergas )の下で、は
んだ付けされる。
板8の上方に描かれた高融点はんだ2と、たとえばA/
、、O,又はBeQからなり、Mo Mg Ni Au
又はWo NI Au からなる薄膜被覆を施さ
れるが、又は直接ボンディングによって形成された金属
被覆を有する分離(アイ4レーシヨン)板9と、高融点
を有する材料で円板状に形成された高融点はんだ2と、
銀めっき又祉ニッケルめっきを施された接続板10を含
んでいる。これらの部材はめっき用の型内に挿入され水
素又は成形ガス(Formiergas )の下で、は
んだ付けされる。
第2b図はこのようにして一体的に形成されたキャリヤ
部1ノを示す。キャリヤ部11は上記g 2 a図に示
された部材2,8.9及び10を含んでいる。
部1ノを示す。キャリヤ部11は上記g 2 a図に示
された部材2,8.9及び10を含んでいる。
半導体サンドイッチ7とキャリヤ部1ノをほぼ平行に配
置する第1のステップが行なわれた後に、上記半導体サ
ンドイッチ7とキャリヤ部1ノとを結合する第2のステ
ップが行なわれる。
置する第1のステップが行なわれた後に、上記半導体サ
ンドイッチ7とキャリヤ部1ノとを結合する第2のステ
ップが行なわれる。
第3図は上記結合後の状態を示す。第3図に示すように
、キャリヤ部のたとえば2個の半導体サンドイッチ7の
下には低融点はんだ13が配置されている。上記低融点
はんだとしては融点が約230℃ であるはんだsn
Ag 3 、5が用いられる。上記はんだ付けは水素又
は成形ガス(Formiergaa )の中で行なわれ
る0上記低融点はんだ13の形状は、第2のステップに
於て、該はんだ13が高融点はんだ2と全く接触しない
か、 又は接触したとしてもできるだけその接触が少くて、両
者の混合によってPb5n 63 が生ずるのが阻止さ
れるように定められている。なお、上記低融点はんだ1
3の上述の位置に於ての使用がこの発明の電力用半導体
モジュールの繰返し負荷に対する強度に対して大きな影
響を及ばずことは々い。大きな影響を与える位置は、広
い面ではんだ付けが行なわれる位置、す々わち、接続板
lθと分離板9との間、分離板9と金属基板8との間、
及び上側補償円板1及び下側補償円板4のそれぞれとシ
リコン半導体チップ、ノとの間のすべて高温はんだ2に
よって接着され、大きな熱応力が発生する場所である。
、キャリヤ部のたとえば2個の半導体サンドイッチ7の
下には低融点はんだ13が配置されている。上記低融点
はんだとしては融点が約230℃ であるはんだsn
Ag 3 、5が用いられる。上記はんだ付けは水素又
は成形ガス(Formiergaa )の中で行なわれ
る0上記低融点はんだ13の形状は、第2のステップに
於て、該はんだ13が高融点はんだ2と全く接触しない
か、 又は接触したとしてもできるだけその接触が少くて、両
者の混合によってPb5n 63 が生ずるのが阻止さ
れるように定められている。なお、上記低融点はんだ1
3の上述の位置に於ての使用がこの発明の電力用半導体
モジュールの繰返し負荷に対する強度に対して大きな影
響を及ばずことは々い。大きな影響を与える位置は、広
い面ではんだ付けが行なわれる位置、す々わち、接続板
lθと分離板9との間、分離板9と金属基板8との間、
及び上側補償円板1及び下側補償円板4のそれぞれとシ
リコン半導体チップ、ノとの間のすべて高温はんだ2に
よって接着され、大きな熱応力が発生する場所である。
第3図に示した接続板1θと陰極棒5の接続部12はそ
の後のス′アングに於て形成され、この接続によって、
図に示されない外部回路との接続が行なわれる。
の後のス′アングに於て形成され、この接続によって、
図に示されない外部回路との接続が行なわれる。
金(,4とセラミックの接続には、比較的厚い、たとえ
ば、100μmの厚さのはんだ層を用いるのがよい(第
4図参照)0 第4図は取付孔14と粗面の部分15を有する金属基板
8aを示す。上記粗面の部分15ははんだ伺げに適する
ように粗面とされた部分である。第4図では粗面の部分
15は局部的に設けられているが、金属基板8aの全表
面に設けることもできる。しかしこのとき、合成樹脂製
の容器が金属基板の上面の縁部に固着されることもある
。従っ−C1粗面の形成を金属基板8aのはんだ伺けを
予定された部分15の部分に限ることが好ましい。
ば、100μmの厚さのはんだ層を用いるのがよい(第
4図参照)0 第4図は取付孔14と粗面の部分15を有する金属基板
8aを示す。上記粗面の部分15ははんだ伺げに適する
ように粗面とされた部分である。第4図では粗面の部分
15は局部的に設けられているが、金属基板8aの全表
面に設けることもできる。しかしこのとき、合成樹脂製
の容器が金属基板の上面の縁部に固着されることもある
。従っ−C1粗面の形成を金属基板8aのはんだ伺けを
予定された部分15の部分に限ることが好ましい。
上記粗面の粗さは6〜50μmの範囲に選ばれるが、そ
の中でも6〜20μ211の範囲が量適である。上記粗
面の形成は種々の方式で行なうことができる。サンドプ
ラスト方式を用いるときは10μm程度の粗さが適当で
ある。又、多くの研究結果によれば、このようにして形
成されだ粗面に形成される沢山の凹所の深さは種々異る
もので形成されていることが好ましい。サンドプラスト
によって金属基板8aの表面を粗化した後は、該表面か
ら砂を除去するための次工程が必要なことは勿論である
。
の中でも6〜20μ211の範囲が量適である。上記粗
面の形成は種々の方式で行なうことができる。サンドプ
ラスト方式を用いるときは10μm程度の粗さが適当で
ある。又、多くの研究結果によれば、このようにして形
成されだ粗面に形成される沢山の凹所の深さは種々異る
もので形成されていることが好ましい。サンドプラスト
によって金属基板8aの表面を粗化した後は、該表面か
ら砂を除去するための次工程が必要なことは勿論である
。
又、たとえば20μmの粗さを得る上記と異る方法は研
磨による方法である。
磨による方法である。
又、サンドシラストに相当するm面を形成するためには
、スタンピングによる方法がある。
、スタンピングによる方法がある。
この方法では約50μmまでの種々の粗さの表面を寿る
ことができる。金属基板8aの表面はスタンピングによ
って比較的大きな凹所16を形成すること、又は小さな
凹所を形成することができるが、又第4図に示すように
、大きな凹所16と小さな凹所17を適宜に混合した粗
面を形成することもできる。スタンピングによる場合に
は、大きな凹所と小さな凹所は同時に行なうことができ
るし、又別々の引続いて行なうこともできる。、上記の
ようにスタンピングによる場合には、サンドプラストの
場合のように凹所形成後に引続−て砂を除去するために
必要な工程を設ける必要はない。
ことができる。金属基板8aの表面はスタンピングによ
って比較的大きな凹所16を形成すること、又は小さな
凹所を形成することができるが、又第4図に示すように
、大きな凹所16と小さな凹所17を適宜に混合した粗
面を形成することもできる。スタンピングによる場合に
は、大きな凹所と小さな凹所は同時に行なうことができ
るし、又別々の引続いて行なうこともできる。、上記の
ようにスタンピングによる場合には、サンドプラストの
場合のように凹所形成後に引続−て砂を除去するために
必要な工程を設ける必要はない。
この発明の方法を用いて、比較的厚いはんだ層を形成し
、繰返し負荷忙対して高い強度を有する金属−セラミッ
ク結合を行なう場合には次の(a)乃至(d)のステッ
プが必要である。
、繰返し負荷忙対して高い強度を有する金属−セラミッ
ク結合を行なう場合には次の(a)乃至(d)のステッ
プが必要である。
a)少くとも1個の粗面の部分15を有する金属基板8
aを製作するステップと、 b)粗面の部分15の上に薄いはんだ膜を配置するステ
ップと、 C)セラミック板を上記はんだ膜の上に配置するステッ
プと、 d)装置をはんだの融点以上に加熱し再び冷却するステ
ップ。
aを製作するステップと、 b)粗面の部分15の上に薄いはんだ膜を配置するステ
ップと、 C)セラミック板を上記はんだ膜の上に配置するステッ
プと、 d)装置をはんだの融点以上に加熱し再び冷却するステ
ップ。
第4図の金属基板を用いる製造方法には、既に説明され
た第1a図乃至第3図による方法と有効に組合わせるこ
とができる。この場合には前記金属基板8の代りに、粗
面の部分15を設けた金属基板8aが用いられる。
た第1a図乃至第3図による方法と有効に組合わせるこ
とができる。この場合には前記金属基板8の代りに、粗
面の部分15を設けた金属基板8aが用いられる。
第1a図は半導体サンドイッチの分解説明図、第1b図
は上記半導体サンドイッチのはんだ付けによる結合図、
H2a図はキャリヤ部の分解説明図、gzb図社上記キ
ャリヤ部のはんだ付けによる結合図、第3図は1個のキ
ャリヤ部と2個の半導体サンドイッチを結合した図、第
4図は粗面を形成された金属基板の図である。 2・・・高融点敵んだ、7・・・半導体サンドイッチ、
8.83・・・金属基板、9・・・分離板、1θ・・・
接続板、1ノ・・・キャリヤ部、13・・・低融点はん
だ、15・・・粗面の部分、16・・・大きい凹所、J
7・・・小さい凹所。
は上記半導体サンドイッチのはんだ付けによる結合図、
H2a図はキャリヤ部の分解説明図、gzb図社上記キ
ャリヤ部のはんだ付けによる結合図、第3図は1個のキ
ャリヤ部と2個の半導体サンドイッチを結合した図、第
4図は粗面を形成された金属基板の図である。 2・・・高融点敵んだ、7・・・半導体サンドイッチ、
8.83・・・金属基板、9・・・分離板、1θ・・・
接続板、1ノ・・・キャリヤ部、13・・・低融点はん
だ、15・・・粗面の部分、16・・・大きい凹所、J
7・・・小さい凹所。
Claims (1)
- 【特許請求の範囲】 〔1〕多くの部分を互に異る融点を有する軟質はんだを
用いて接着する多くのステップを経て製造される、分離
構造を有するパワー用半導体モジュールの製造方法に於
て、上記ステップのうちの第1のステップでは、半導体
サンドイッチ(7)と、金属基板(8)からなるキャリ
ヤ部(11)、セラミック製分離板(9)及び接続板(
10)が、高融点のはんだによって接着され; 第2のステップでは、半導体サンドイッチ(7)とキャ
リヤ部(11)は、低融点のはんだ(13)によって接
着され; 上記両ステップに於て、はんだによる接着はフラックス
を用いることなく、水素ガス又は成形ガス(Formi
rgas)を用いて行なわれ、第2のステップに於ては
適切な寸法と配置を定められたことにより、高融点はん
だ(2)と、低融点はんだ(3)の混合が生ぜぬように
形成されている、ことを特徴とするパワー用半導体モジ
ュールの製造方法。 〔2〕上記高融点はんだ(2)がたとえば、PbSn5
又はPbAgSnのような300℃以上の融点を有する
材料で形成されていること、を特徴とする特許請求の範
囲第〔1〕項に記載の製造方法。 〔3〕上記低融点はんだ(13)としてSnAg3、5
のはんだが用いられていること、を特徴とする特許請求
の範囲第〔1〕及び第〔2〕項のいずれか1に記載の製
造方法。 〔4〕金属基板とセラミック製分離板との間に少くとも
1個のはんだによる接着部を有し、上記金属基板と上記
はんだの薄膜と上記分離板が、それぞれほぼ水平姿勢を
とりつつ上下に積重ねられて、融点以上に加熱された炉
内に挿入される工程を有するパワー用半導体モジュール
の製造方法に於て、上記金属基板(8a)の上面のはん
だにより接着される部分(15)のみが予め粗面に形成
されていること、を特徴とするパワー用半導体モジュー
ルの製造方法。 〔5〕上記金属基板(8a)の上面のはんだにより接着
される上記部分(15)の粗さがほぼ6〜50μmであ
り、好ましくは6〜20μmであること、を特徴とする
特許請求の範囲第〔4〕項に記載の製造方法。 〔6〕上記部分(15)に形成される粗さがサンドプラ
ストにより付与されること、を特徴とする特許請求の範
囲第〔4〕項及び第〔5〕項のいずれか1に記載の製造
方法。 〔7〕上記部分(15)に形成される粗さが研磨によっ
て付与されること、を特徴とする特許請求の範囲第〔4
〕項及び第〔5〕項のいずれか1に記載の製造方法。 〔8〕上記部分(15)に形成される粗さが凹所を形成
するスタンピングによって付与されること、を特徴とす
る特許請求の範囲第〔4〕項及び第〔5〕項のいずれか
1に記載の製造方法。 〔9〕上記部分(15)に形成される粗さが大きい凹所
と小さい凹所を含むこと、を特徴とする特許請求の範囲
第〔8〕項に記載の製造方法。 〔10〕多くの部分が互に異る融点を有する軟質はんだ
を用いて接着される多くのステップを経て製造される、
分離構造を有するパワー用半導体モジュールの製造方法
に於て、上記多くのステップの中の第1のステップでは
、金属基板(8a)の上面のはんだにより接着される部
分(15)のみが粗面に形成され;第2のステップでは
、多くの半導体サンドイッチ(7)と;上記金属基板(
8a)とセラミック製の分離板(9)と接続板(10)
からなるキャリヤ部(11)との接着が、高融点を有す
るはんだ(2)を用いて行なわれること;第3のステッ
プでは、半導体サンドイッチ(7)とキャリヤ部(11
)が低融点のはんだ(13)を用いて接着され; 上記第2及び第3のステップでは、フラックスが使用さ
れることなく、水素ガス又は成形ガス(Formier
gas)の作用の下にはんだによる接着が行なわれ、第
3のステップでは、適切な寸法と配置を定められること
により、高融点のはんだ(2)と低融点のはんだ(13
)の混合が生ぜぬように形成されていること、を特徴と
するパワー用半導体モジュールの製造方法。 〔11〕上記金属基板(8a)の上面のはんだにより接
着される上記部分(15)の粗さがほぼ6〜50μmで
あり、好ましくは6〜20μmであること、を特徴とす
る特許請求の範囲第〔10〕項に記載の製造方法。 〔12〕上記部分(15)に形成される粗さがサンドプ
ラスによって付与されること、を特徴とする特許請求の
範囲第〔10〕項及び第〔11〕項のいずれか1に記載
の製造方法。 〔13〕上記部分(15)に形成される粗さが研磨によ
って付与されること、を特徴とする特許請求の範囲第〔
10〕項及び第〔11〕項のいずれか1に記載の製造方
法。 〔14〕上記部分(15)に形成される粗さが凹所を形
成するスタンピングによって付与されること、を特徴と
する特許請求の範囲〔10〕項及び第〔11〕項のいず
れか1に記載の製造方法。 〔15〕上記部分(15)に形成される粗さが大きい凹
所と小さい凹所を含むこと、を特徴とする特許請求の範
囲〔14〕項に記載の製造方法。
Applications Claiming Priority (4)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
DE3420364 | 1984-06-01 | ||
DE3513530.1 | 1985-04-16 | ||
DE3420364.8 | 1985-04-16 | ||
DE19853513530 DE3513530A1 (de) | 1984-06-01 | 1985-04-16 | Verfahren zur herstellung von leistungshalbleitermodulen mit isoliertem aufbau |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS616849A true JPS616849A (ja) | 1986-01-13 |
JPH0614531B2 JPH0614531B2 (ja) | 1994-02-23 |
Family
ID=25821722
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP60116852A Expired - Lifetime JPH0614531B2 (ja) | 1984-06-01 | 1985-05-31 | パワー用半導体モジユールの製造方法 |
Country Status (4)
Country | Link |
---|---|
US (1) | US4700879A (ja) |
EP (1) | EP0163163B1 (ja) |
JP (1) | JPH0614531B2 (ja) |
DE (2) | DE3513530A1 (ja) |
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- 1985-05-03 DE DE8585105435T patent/DE3580397D1/de not_active Expired - Fee Related
- 1985-05-03 EP EP85105435A patent/EP0163163B1/de not_active Expired - Lifetime
- 1985-05-31 JP JP60116852A patent/JPH0614531B2/ja not_active Expired - Lifetime
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JPH0614531B2 (ja) | 1994-02-23 |
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EP0163163A3 (en) | 1987-04-01 |
DE3580397D1 (de) | 1990-12-13 |
EP0163163B1 (de) | 1990-11-07 |
DE3513530A1 (de) | 1985-12-05 |
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