JPS58192359A - 半導体装置 - Google Patents
半導体装置Info
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- JPS58192359A JPS58192359A JP57075334A JP7533482A JPS58192359A JP S58192359 A JPS58192359 A JP S58192359A JP 57075334 A JP57075334 A JP 57075334A JP 7533482 A JP7533482 A JP 7533482A JP S58192359 A JPS58192359 A JP S58192359A
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- 239000000758 substrate Substances 0.000 claims abstract description 10
- 239000004020 conductor Substances 0.000 claims 1
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- 229910052782 aluminium Inorganic materials 0.000 description 1
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Classifications
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L27/00—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate
- H01L27/02—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers
- H01L27/04—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers the substrate being a semiconductor body
- H01L27/08—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers the substrate being a semiconductor body including only semiconductor components of a single kind
- H01L27/085—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers the substrate being a semiconductor body including only semiconductor components of a single kind including field-effect components only
- H01L27/088—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers the substrate being a semiconductor body including only semiconductor components of a single kind including field-effect components only the components being field-effect transistors with insulated gate
- H01L27/092—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers the substrate being a semiconductor body including only semiconductor components of a single kind including field-effect components only the components being field-effect transistors with insulated gate complementary MIS field-effect transistors
- H01L27/0925—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers the substrate being a semiconductor body including only semiconductor components of a single kind including field-effect components only the components being field-effect transistors with insulated gate complementary MIS field-effect transistors comprising an N-well only in the substrate
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は半導体装置、%KCMO8に関するものである
。
。
0MO8は−BK、例えばNgエピタキシ考ル層自体に
設けたPチャネルM I S F E T(Metal
Insulator Sem1conductor
Field EffectTransistor
)と、同エピタキシ今ル層に形成されたP〜ルウエル設
けたヘチャネルMISFETとからなっている。このよ
うなCMO8Y高速化するには、各MISFETのソー
ス又はドレイン領域の接合容量を減らすことが会費であ
るが、このために基板バイアス電圧(vBB)′lk:
印加することがある。ところが他方では、高集積化に伴
なう微細化の豊水によりMISFETのシ■−トチャネ
ル化を図ろうとする場合には、■□の印加はしきい値電
圧(Vth)の変動ン大きくしてしまう。
設けたPチャネルM I S F E T(Metal
Insulator Sem1conductor
Field EffectTransistor
)と、同エピタキシ今ル層に形成されたP〜ルウエル設
けたヘチャネルMISFETとからなっている。このよ
うなCMO8Y高速化するには、各MISFETのソー
ス又はドレイン領域の接合容量を減らすことが会費であ
るが、このために基板バイアス電圧(vBB)′lk:
印加することがある。ところが他方では、高集積化に伴
なう微細化の豊水によりMISFETのシ■−トチャネ
ル化を図ろうとする場合には、■□の印加はしきい値電
圧(Vth)の変動ン大きくしてしまう。
このため、接合容量の低減とシ冒−トチャネル化との双
方を両立させることは不可能である。
方を両立させることは不可能である。
本発明はこうした状況において、上記の両立を可能とな
し、高速化・を効果的に実現することン目的とし、この
ためKPMPェル及びNmウェルを共K11l囲から分
離して形成している。
し、高速化・を効果的に実現することン目的とし、この
ためKPMPェル及びNmウェルを共K11l囲から分
離して形成している。
以下、本発明+l−CMO8MIダイナミックランダム
アクセスメモリに関する実施例について詳細に説明する
。
アクセスメモリに関する実施例について詳細に説明する
。
図面に示した如く、本例によれば、P+型シリコン基板
lの一生面忙、通常の半導体技術によってN+諧棚込み
層2,3v弁しP型エピタキシ々ル層4が成長せしめら
れ、このエピタキシ今ル層4KNffiウェル5が拡散
法で形成されている。N諧つェル5はN+ tIi寝込
み層2に接して形成され、かつその側部には場込み層2
と一体の高湯度N+型半導体領域6が形成されており、
これによってN型ウェル5はその側部及び底部に存在す
るN+型領領域62のために、@部及び抵Sを包囲する
P型餉竣4,1から光分く分離されている。このN型ウ
ェル5には、周辺回路のCMO8Y構成するP?ヤネル
MISFETのソースヌはドレイン領域とじ℃のP+型
半導体餉領域、8が形成され、これら両領埴間のゲート
酸化膜9上にはゲート電極lOが設けられている。一方
、0MO8のへチャネルMISFETは、エピタキシキ
ル層4に形成されたN+淑半導体慎域11.12(ソー
ス又はドレイン領域)と、ゲート酸化膜9上のゲート電
極lOとによって構成されている。
lの一生面忙、通常の半導体技術によってN+諧棚込み
層2,3v弁しP型エピタキシ々ル層4が成長せしめら
れ、このエピタキシ今ル層4KNffiウェル5が拡散
法で形成されている。N諧つェル5はN+ tIi寝込
み層2に接して形成され、かつその側部には場込み層2
と一体の高湯度N+型半導体領域6が形成されており、
これによってN型ウェル5はその側部及び底部に存在す
るN+型領領域62のために、@部及び抵Sを包囲する
P型餉竣4,1から光分く分離されている。このN型ウ
ェル5には、周辺回路のCMO8Y構成するP?ヤネル
MISFETのソースヌはドレイン領域とじ℃のP+型
半導体餉領域、8が形成され、これら両領埴間のゲート
酸化膜9上にはゲート電極lOが設けられている。一方
、0MO8のへチャネルMISFETは、エピタキシキ
ル層4に形成されたN+淑半導体慎域11.12(ソー
ス又はドレイン領域)と、ゲート酸化膜9上のゲート電
極lOとによって構成されている。
また、メモリセル(図面には簡略化のために1つのNf
ヤネルMISFETのみt示している。)はエピタキシ
セル層4に設けられるが、その素子領域の側部及び底部
は高一度N+型拡散領域13及びN++埋込み層3によ
って包囲されている。
ヤネルMISFETのみt示している。)はエピタキシ
セル層4に設けられるが、その素子領域の側部及び底部
は高一度N+型拡散領域13及びN++埋込み層3によ
って包囲されている。
従って、その素子慣塚は周囲が浚導電型領域で囲まれた
PfMウェル4として用いられる。このウェル内にはソ
ース又はドレイン領域としてのNmm線域1112が形
成され、ゲート電極10と共にメモリセルのFET)l
構成している。なお、図中、14はフィールドS iQ
、膜、15はリンガラス膜、16.17はアルミニウム
配線である。なお、上記の各N+型領11I6.13は
共通の拡散工程で形成可能であるが、一方のN 島’I
I域6は必すしも形成すること)k’llない。
PfMウェル4として用いられる。このウェル内にはソ
ース又はドレイン領域としてのNmm線域1112が形
成され、ゲート電極10と共にメモリセルのFET)l
構成している。なお、図中、14はフィールドS iQ
、膜、15はリンガラス膜、16.17はアルミニウム
配線である。なお、上記の各N+型領11I6.13は
共通の拡散工程で形成可能であるが、一方のN 島’I
I域6は必すしも形成すること)k’llない。
上記の如く、各Pal!ウェル及びN型ウェルが夫々独
立したウェルとして形成されているので、各ウェルに作
成する個々のトランジスタに対し、必要に応じて他のウ
ェルのものとは別個に基板バイアス電圧(V、、 )’
t−ウ゛エルに印加することかできる。即ち、互いに独
立した各ウェルには選択的に■BBt印加できるから、
その印加されたウェル内では接合容量が減少し、高速化
ン効果的Kl!3nできることになる。他方、VBBY
印加した(ないウェルでは、基板バイアスケしないよう
にできるか (ら、シ、−)チャネル化ン遍
成でき、上記した接合容量の減少と両立させた構造とな
る。具体的には、メモリセルでは上記Palウェル4の
基板ノ(イアスによる接合@量の減少でその高速化Y図
れ、。
立したウェルとして形成されているので、各ウェルに作
成する個々のトランジスタに対し、必要に応じて他のウ
ェルのものとは別個に基板バイアス電圧(V、、 )’
t−ウ゛エルに印加することかできる。即ち、互いに独
立した各ウェルには選択的に■BBt印加できるから、
その印加されたウェル内では接合容量が減少し、高速化
ン効果的Kl!3nできることになる。他方、VBBY
印加した(ないウェルでは、基板バイアスケしないよう
にできるか (ら、シ、−)チャネル化ン遍
成でき、上記した接合容量の減少と両立させた構造とな
る。具体的には、メモリセルでは上記Palウェル4の
基板ノ(イアスによる接合@量の減少でその高速化Y図
れ、。
かつ周辺回路ではN型ウェル5ttむ基板)(イアスt
なくしてしきい値電圧(Vth)の変1thyt少なく
し、シ1−トチ々ネル化又は高速化ン図れることになる
。加えて、N型ウェル5はIn2囲の卜 層領域6,2
によってより低抵抗化することができるので、ノイズ、
電位変li!lY:抑えることかできる。
なくしてしきい値電圧(Vth)の変1thyt少なく
し、シ1−トチ々ネル化又は高速化ン図れることになる
。加えて、N型ウェル5はIn2囲の卜 層領域6,2
によってより低抵抗化することができるので、ノイズ、
電位変li!lY:抑えることかできる。
なお、上記の例において、エピタキシ々ル層4tN製と
し、これにPmウェルを拡散法で形成してよい。この場
合には、N”!!S!m込み層はP“湯濶込み層に変更
する必要がある。
し、これにPmウェルを拡散法で形成してよい。この場
合には、N”!!S!m込み層はP“湯濶込み層に変更
する必要がある。
図面は本発明の実施例によるCMO8型ダイ型ダイグミ
ツクランダムアクセスメモリの断面図である。 2.3・・・場込み層、4,5・・・ウェル、6,13
・・・高濃度領域。
ツクランダムアクセスメモリの断面図である。 2.3・・・場込み層、4,5・・・ウェル、6,13
・・・高濃度領域。
Claims (1)
- 1、所定の半導体層KP型ツウエルN型ウェルとが分離
して形成され、これらの各ウェルの側部及び底部が半導
体基板に対して、もしくは、ウェル領域に対し1逆導電
型の中導体慎域によって包囲されていることV*徴とす
る半導体装置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP57075334A JPS58192359A (ja) | 1982-05-07 | 1982-05-07 | 半導体装置 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP57075334A JPS58192359A (ja) | 1982-05-07 | 1982-05-07 | 半導体装置 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS58192359A true JPS58192359A (ja) | 1983-11-09 |
JPH0410227B2 JPH0410227B2 (ja) | 1992-02-24 |
Family
ID=13573248
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP57075334A Granted JPS58192359A (ja) | 1982-05-07 | 1982-05-07 | 半導体装置 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS58192359A (ja) |
Cited By (8)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS6050953A (ja) * | 1983-08-31 | 1985-03-22 | Toshiba Corp | 耐放射線半導体素子 |
JPS629665A (ja) * | 1985-07-05 | 1987-01-17 | Matsushita Electric Ind Co Ltd | 半導体記憶装置 |
EP0319047A2 (en) * | 1987-12-04 | 1989-06-07 | Nissan Motor Co., Ltd. | Power integrated circuit |
US4928157A (en) * | 1988-04-08 | 1990-05-22 | Kabushiki Kaisha Toshiba | Protection diode structure |
EP0384396A2 (en) * | 1989-02-20 | 1990-08-29 | Kabushiki Kaisha Toshiba | Bi-CMOS semiconductor device having memory cells formed in isolated wells |
EP0493659A2 (en) * | 1991-01-02 | 1992-07-08 | International Business Machines Corporation | PMOS wordline boost circuit for dram |
EP0498251A2 (en) * | 1991-02-05 | 1992-08-12 | International Business Machines Corporation | Word line driver circuit for dynamic random access memories |
WO2006127751A3 (en) * | 2005-05-23 | 2009-04-16 | Amalfi Semiconductor Inc | Electrically isolated cmos device |
Citations (6)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS5098791A (ja) * | 1973-12-27 | 1975-08-06 | ||
JPS5211881A (en) * | 1975-07-18 | 1977-01-29 | Toshiba Corp | Semiconductor integrated circuit device |
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JPS5575265A (en) * | 1978-12-01 | 1980-06-06 | Fujitsu Ltd | Complementary type field-effect metal-insulator- semiconductor device |
JPS5582461A (en) * | 1978-12-18 | 1980-06-21 | Matsushita Electric Ind Co Ltd | Semiconductor integrated circuit device |
JPS55111171A (en) * | 1979-02-20 | 1980-08-27 | Mitsubishi Electric Corp | Field-effect semiconductor device |
-
1982
- 1982-05-07 JP JP57075334A patent/JPS58192359A/ja active Granted
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WO2006127751A3 (en) * | 2005-05-23 | 2009-04-16 | Amalfi Semiconductor Inc | Electrically isolated cmos device |
Also Published As
Publication number | Publication date |
---|---|
JPH0410227B2 (ja) | 1992-02-24 |
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