JPH04196449A - 半導体集積回路 - Google Patents
半導体集積回路Info
- Publication number
- JPH04196449A JPH04196449A JP32803690A JP32803690A JPH04196449A JP H04196449 A JPH04196449 A JP H04196449A JP 32803690 A JP32803690 A JP 32803690A JP 32803690 A JP32803690 A JP 32803690A JP H04196449 A JPH04196449 A JP H04196449A
- Authority
- JP
- Japan
- Prior art keywords
- wiring layer
- insulating film
- pad
- semiconductor integrated
- integrated circuit
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Granted
Links
- 239000004065 semiconductor Substances 0.000 title claims description 23
- 230000002093 peripheral effect Effects 0.000 claims description 10
- 238000000034 method Methods 0.000 abstract description 9
- 101100008047 Caenorhabditis elegans cut-3 gene Proteins 0.000 abstract 3
- 230000015572 biosynthetic process Effects 0.000 abstract 1
- 239000010410 layer Substances 0.000 description 29
- 239000000758 substrate Substances 0.000 description 9
- 230000000694 effects Effects 0.000 description 5
- 230000001681 protective effect Effects 0.000 description 5
- 238000004519 manufacturing process Methods 0.000 description 3
- 230000005611 electricity Effects 0.000 description 2
- 230000009467 reduction Effects 0.000 description 2
- 230000003068 static effect Effects 0.000 description 2
- 230000000712 assembly Effects 0.000 description 1
- 238000000429 assembly Methods 0.000 description 1
- 239000003990 capacitor Substances 0.000 description 1
- 239000003795 chemical substances by application Substances 0.000 description 1
- 230000006866 deterioration Effects 0.000 description 1
- 238000009792 diffusion process Methods 0.000 description 1
- 230000005496 eutectics Effects 0.000 description 1
- 239000000463 material Substances 0.000 description 1
- 238000004806 packaging method and process Methods 0.000 description 1
- 239000002356 single layer Substances 0.000 description 1
- 238000005549 size reduction Methods 0.000 description 1
Classifications
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L24/00—Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
- H01L24/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L24/02—Bonding areas ; Manufacturing methods related thereto
- H01L24/04—Structure, shape, material or disposition of the bonding areas prior to the connecting process
- H01L24/05—Structure, shape, material or disposition of the bonding areas prior to the connecting process of an individual bonding area
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/02—Bonding areas; Manufacturing methods related thereto
- H01L2224/0212—Auxiliary members for bonding areas, e.g. spacers
- H01L2224/02122—Auxiliary members for bonding areas, e.g. spacers being formed on the semiconductor or solid-state body
- H01L2224/02163—Auxiliary members for bonding areas, e.g. spacers being formed on the semiconductor or solid-state body on the bonding area
- H01L2224/02165—Reinforcing structures
- H01L2224/02166—Collar structures
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/02—Bonding areas; Manufacturing methods related thereto
- H01L2224/04—Structure, shape, material or disposition of the bonding areas prior to the connecting process
- H01L2224/05—Structure, shape, material or disposition of the bonding areas prior to the connecting process of an individual bonding area
- H01L2224/05001—Internal layers
- H01L2224/05075—Plural internal layers
- H01L2224/0508—Plural internal layers being stacked
- H01L2224/05085—Plural internal layers being stacked with additional elements, e.g. vias arrays, interposed between the stacked layers
- H01L2224/05089—Disposition of the additional element
- H01L2224/05093—Disposition of the additional element of a plurality of vias
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01004—Beryllium [Be]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01033—Arsenic [As]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01039—Yttrium [Y]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01082—Lead [Pb]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/013—Alloys
- H01L2924/0132—Binary Alloys
- H01L2924/01322—Eutectic Alloys, i.e. obtained by a liquid transforming into two solid phases
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/10—Details of semiconductor or other solid state devices to be connected
- H01L2924/11—Device type
- H01L2924/14—Integrated circuits
Landscapes
- Engineering & Computer Science (AREA)
- Computer Hardware Design (AREA)
- Microelectronics & Electronic Packaging (AREA)
- Power Engineering (AREA)
- Wire Bonding (AREA)
- Internal Circuitry In Semiconductor Integrated Circuit Devices (AREA)
Abstract
め要約のデータは記録されません。
Description
回路のボンディングパッド部において、半導体集積回路
製造過程に形成される保護膜 または、絶縁j!(以下
絶縁膜と呼ぶ)の−部を、ボンディングワイヤーが接続
されるパッド部の配線層(以下パッド部の配線層と呼ぶ
)の形状に沿って除去し、パッド部の配線層の周辺部を
下方に向けることにより、パッド部の配線層周辺部分か
らのまくれを大幅に減少させると共にはがれ強度の大幅
な向上が図られ、半導体集積回路実装の品質の向上と、
回路パターン設計におけるボンディングパッドの形状
および、サイズ縮小への自由度が高まり、設計工数削減
、チップサイズの縮小によるコストダウンを実現したも
のである。
れる保護膜 または、絶縁膜(以下絶縁膜と呼ぶ)上に
、設計された回路パターン形状を実現するのみであり、
パッド部の配線1と絶縁膜の接触によってはがれ強度を
確保するものであった。
積回路の断面図である。
除かれた保護膜、2は配線層間を絶縁、保護する絶縁膜
、4はボンディングワイヤーとの接続を取るパッド部の
配線層、5はパッド部の下方に位置する基板である。
パッド部の配線層4と絶縁膜2の接触面積に依存するも
のであった。
れ強度は、絶縁膜とボンディングパッド部の配線材の接
触面積に比例するものであり、はがれ強度を確保するた
め、ボンディングパッドのサイズを大きくしなければな
らない。
ドの必要面積を確保することは、高密度 及び、多入出
力回路を保有するパターンを設計する上での制限となる
。更に、パッド部の配線層の周辺部分のはがれ強度につ
いては、パッド部の全体強度とは別に、周辺部としての
はがれ強度を必要としており、端面のめくれから発生す
るパッド全体のはがれ強度の劣化は、パッド面積の拡大
だけでは改善につながらない等の問題点を有する。
、その目的とするところは、パターン設計納期の短縮と
チップサイズの縮小によるコストの削減を実現し、品質
の寓い小型で低コストの半導体集積回路 及び、半導体
集積回路組立品を提供するところにある。
いて、パッド部の配線層の形状に合わせて絶縁膜の一部
を取り除き、配線層の周辺部を下方にむけることにより
周辺部からのめくれを排除し、積極的にはがれ強度を確
保することを特徴とする。
面図である。
除かれた保護膜、2は配線層間を絶縁、保護する絶縁膜
、3はパッド部の配線層の周辺部を下方に向けるために
絶縁膜を除去した部分、4はボンディングワイヤーとの
接続を取るパッド部の配線層、5はパッド部の下方に位
置する基板である。
線層4の周辺部を下方に向けるため絶縁膜2の一部をプ
ロセス処理の過程で除去することにより設ける。
ッド部の配線層4が形成される課程において、パッド部
の配線層4の周辺部が絶縁膜除去部3に形成されること
となり、パッド部の配線層4が、パッド部の配線層4の
下に位置する絶縁膜2を覆うように形成され、平坦な絶
縁[!2の上にパッド部の配線層4を形成する場合より
はがれに対する強度の向上が図れる。
去部3においてパッド部の配線層4と基板5の間で共晶
状態を生成して密接な接続を図り、第2図で示す従来の
半導体集積回路が、パッド部の配線層4と絶縁膜2の面
接触によって得るはがれ強度より、更に高いはがれ強度
を得ることが可能となり、ボンディングの品質向上が図
れる。
強度が得られるため、ボンディングパッド自体の占める
面積を小さくすることができると同時に、ボンディング
パッドの形状に対する自白層が高まり、半導体集積回路
の設計条件が緩和され、チップの小型化や各人出力対応
が容易となりコストダウンが図れる。
たのでは、複数のパッドと基板5は当然接続されること
となり、パッド間にショートが発生し、各パッドの信号
及び、電位の確保が不可能となる。この現象を回避す
るには、各パッド下の パッドと接続する基板領域の電
気的分離を行えばよい。
を造れば容易に実現可能である。
の パッドに接続される基板領域をP十拡散層とする方
法、また、P〜領領域する方法が考えられる。
実現可能である。但し、もとの基板の電位と同等のパッ
ドについては、この処理が不要であることは言うまでも
ない。
に対しても吸収することが可能であり、静電気耐圧の向
上と言った効果も得られる。
行的にコンデンサとしての効果を持たせることも可能で
ある。
、多層配線においても同様の効果を期待できる。
周辺部を下方に向ける事により、ボンディングパッドサ
イズの縮小が可能となり、従来と同様のチップサイズで
の多入出力の対応による付加価値の向上 または、チッ
プの小型化による低コスト化につながると共に、半導体
集積回路チップの品質向上と、ボンディング品質の高い
半導体集積回路を提供出来るという効果を有する。
要断面図。 第2図は、本発明を使用しない従来の例を示す半導体集
積回路の断面図。 101.半導体集積回路表面の保護膜 211.絶縁膜 31.、パッド部の配線層と下方の基板を接続するため
に絶縁膜を除去した部分 411.ボンディングワイヤーとの接続を取るパッド部
の配線層 5・ ・・基板 以 上 出願人 セイコーエプソン株式会社 代理人 弁理士 鈴木喜三部 他1名 第1図 第2図
Claims (1)
- 半導体集積回路のボンディングパッドにおいて、パッ
ド部の配線層の形状に合わせて絶縁膜の一部を取り除き
、パッド部の配線層の周辺部を下方に向けることにより
はがれ強度向上させる構造を有する事を特徴とする半導
体集積回路。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP32803690A JP2910231B2 (ja) | 1990-11-28 | 1990-11-28 | 半導体集積回路 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP32803690A JP2910231B2 (ja) | 1990-11-28 | 1990-11-28 | 半導体集積回路 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPH04196449A true JPH04196449A (ja) | 1992-07-16 |
JP2910231B2 JP2910231B2 (ja) | 1999-06-23 |
Family
ID=18205800
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP32803690A Expired - Lifetime JP2910231B2 (ja) | 1990-11-28 | 1990-11-28 | 半導体集積回路 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP2910231B2 (ja) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US8017959B2 (en) | 2006-02-17 | 2011-09-13 | Hitachi, Ltd. | Light source and liquid crystal display device using the same |
-
1990
- 1990-11-28 JP JP32803690A patent/JP2910231B2/ja not_active Expired - Lifetime
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US8017959B2 (en) | 2006-02-17 | 2011-09-13 | Hitachi, Ltd. | Light source and liquid crystal display device using the same |
Also Published As
Publication number | Publication date |
---|---|
JP2910231B2 (ja) | 1999-06-23 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
US7629689B2 (en) | Semiconductor integrated circuit having connection pads over active elements | |
CA2159243A1 (en) | Method of Manufacturing Chip-Size Package-Type Semiconductor Device | |
JP3898350B2 (ja) | 半導体装置 | |
US7411280B2 (en) | Chip support of a leadframe for an integrated circuit package | |
JPH04196449A (ja) | 半導体集積回路 | |
JPH0750708B2 (ja) | 半導体装置 | |
JP2004134459A (ja) | 半導体装置 | |
US5148249A (en) | Semiconductor protection device | |
JP2903668B2 (ja) | 半導体集積回路 | |
JP2864684B2 (ja) | 半導体集積回路 | |
JP2674169B2 (ja) | 半導体集積回路装置 | |
JP2000200892A (ja) | ホトダイオード内蔵半導体装置 | |
JPH0476927A (ja) | 半導体集積回路 | |
JPS605542A (ja) | 半導体装置 | |
JP3302810B2 (ja) | 半導体装置 | |
KR100230750B1 (ko) | 반도체 패키지 | |
JPH0574957A (ja) | 半導体装置 | |
JPH0430541A (ja) | 半導体装置 | |
JP2000200893A (ja) | ホトダイオード内蔵集積回路 | |
JPH03180052A (ja) | 半導体集積回路 | |
JPH0645566A (ja) | 半導体集積回路装置 | |
JPH04196461A (ja) | 半導体集積回路 | |
JPH04124844A (ja) | 半導体装置のボンディングパッド電極の構造 | |
JPH03273675A (ja) | 半導体装置 | |
KR19990056766A (ko) | 반도체 소자 |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20080409 Year of fee payment: 9 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20090409 Year of fee payment: 10 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20090409 Year of fee payment: 10 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20100409 Year of fee payment: 11 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20110409 Year of fee payment: 12 |
|
EXPY | Cancellation because of completion of term | ||
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20110409 Year of fee payment: 12 |