JP5048917B2 - シフトレジスタとこれを有するスキャン駆動回路及び表示装置 - Google Patents
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Description
である。
回路は、一つのシフトレジスタを含む。前記シフトレジスタの単位ステージは、一つのS−Rラッチと一つのアンドゲートを含む。
、次段ステージの出力信号である第2入力信号によって非活性化される(Deactivated)。アンドゲートは、前記S−Rラッチが活性化状態であり、第1クロックがハイレベルである時、ゲートパルス(又は、スキャン信号)を発生させる。
反対位相のクロックである。
号IN1が印加され、ソースが充電部の第1端に連結された第1トランジスタで構成される。充電部は、第1端が前記第1トランジスタのソースと放電部に連結され、第2端が駆動部に連結されたキャパシタで構成される。
シタの第1端に連結され、ソースがキャパシタの第2端及び出力端子に連結された第2トランジスタと、ドレーンが第2トランジスタのソース及びキャパシタの第2端に連結され、ソースが第1電圧に連結された第3トランジスタで構成される。前記クロック端子には、第1クロック又は前記第1クロックと位相が反対である第2クロックが印加される。
トと共通されて第2入力信号に連結され、ソースが前記第1電圧に連結された第4トランジスタで構成される。
号がハイレベルであると、充電された電荷が放電されてS−Rラッチ動作を行う。
複数のステージを含んで複数の出力信号を順次出力するシフトレジスタにおいて、前記各ステージは、
第1クロック又は前記第1クロックと位相が異なる第2クロックに応答して現在ステージの第1出力信号を出力する駆動部と、
スキャン開始信号又は前段ステージのうち、一つのステージの第2出力信号により電荷が充電される充電部と、
次段ステージのうち、一つのステージの第3出力信号に応答して前記充電部に充電された電荷を放電する放電部と、
前記第1出力信号が非アクティブ状態である場合、前記第1クロックまたは前記第2クロックのそれぞれに応答して前記第1出力信号を第1電圧以内に維持するホールディング部と、を含み、
前記駆動部は、第1電極に前記駆動部に印加された前記第1クロック信号又は第2クロック信号が印加され、第2電極を通じて前記第1出力信号をプル−アップ出力する駆動トランジスタを含み、
前記ホールディング部は、
第1電極が前記駆動トランジスタの制御電極に連結され、第2電極が前記駆動トランジスタの第2電極と連結され、制御電極に前記駆動部に印加された前記第1クロック信号又は第2クロック信号が印加される第1ホールドトランジスタを含むことを特徴とするシフトレジスタを提供する。
複数のステージを含んで複数の出力信号を順次出力するシフトレジスタにおいて、
前記各ステージは、
スキャン開始信号又は前段ステージのうち、一つのステージの第2出力信号により電荷が充電される充電部と、
前記充電された電荷及び第1クロック信号又は前記第1クロック信号と位相が異なる第2クロック信号のうち、一つのクロック信号に応答して現在ステージの第1出力信号をプル−アップして出力端子を通じて出力し、次段ステージのうち、一つのステージの第3出力信号に応答して前記第1出力信号をプル−ダウンする駆動部と、
前記第3出力信号に応答して前記充電部に充電された電荷を放電する放電部と、
前記第1出力信号が非アクティブ状態である場合、前記駆動部に印加された前記第1クロック信号又は第2クロック信号に応答してホールド制御信号を出力するホールディング制御部と、
前記ホールド制御信号に応答して前記第1出力信号を所定の第1電圧以内にホールドして前記出力端子のフローティングを防止するホールディング部と、を含み、
前記ホールディング制御部は、
前記第1クロック信号が印加される第1電極と制御電極が共通される第1ホールドトランジスタと、
前記第1クロック信号が印加される第1電極と、前記第1ホールドトランジスタの第2電極に連結される制御電極と、前記ホールディング部に連結される第2電極とを含む第2ホールドトランジスタと、
第1電極が前記第1ホールドトランジスタの第2電極及び第2ホールドトランジスタの制御電極に連結され、制御電極が前記第1出力信号が出力される出力端子に連結され、第2電極が前記第1電圧に連結された第3ホールドトランジスタと、
第1電極が前記第2ホールドトランジスタの第2電極及び前記ホールディング部に連結され、制御電極が前記出力端子に連結され、第2電極が前記第1電圧に連結された第4ホールドトランジスタと、を含むことを特徴とするシフトレジスタを提供する。
基板上に配置され、複数のデータライン及び複数のスキャンラインを含む表示セルアレー回路と、
複数のステージを含み、出力端が前記スキャンラインのうちの第1端に連結され、一番目ステージにはスキャン開始信号が入力され、各ステージの出力信号を前記複数のスキャンラインに順次印加するシフトレジスタを含む第1スキャン駆動回路と、
前記スキャンラインの第2端に連結され、前記スキャンラインを通じて伝達される前記出力信号によって形成された電荷を放電する第2スキャン駆動回路と、を含み、
前記各ステージは、
第1クロック信号又は前記第1クロック信号と位相が異なる第2クロック信号に応答して現在ステージの第1出力信号を出力する駆動部と、
スキャン開始信号又は前段ステージのうち、一つのステージの第2出力信号によって電荷が充電される充電部と、
次段ステージのうち、一つのステージの第3出力信号に応答して前記充電部に充電された電荷を放電する放電部と、
前記第1出力信号が非アクティブ状態である場合、前記第1クロックまたは前記第2クロックのそれぞれに応答して前記第1出力信号を第1電圧以内にホールドするホールディング部と、
前記スキャン開始信号又は前記第2出力信号を前記駆動部に提供するバッファー部と、
前記駆動部に印加された前記第1クロック信号又は第2クロック信号がアクティブ状態である時、ホールド制御信号を出力するホールディング制御部と、を含み、
前記ホールディング部は、
第1電極に前記第1出力信号が印加され、制御電極が前記ホールディング制御部に連結されて前記ホールド制御信号が印加され、第2電極に第1電圧が印加される第1ホールドトランジスタと、
第1電極に前記スキャン開始信号又は前記第2出力信号が印加され、制御電極に前記第2クロック信号が印加され、第2電極が前記充電部の第1端に連結された第2ホールドトランジスタと、
第1電極が前記充電部の第1端に連結され、制御電極に前記第1クロック信号が印加され、第2電極に前記第1出力信号が印加される第3ホールドトランジスタと、
第1電極に前記第1出力信号が印加され、制御電極に前記第2クロック信号が印加され、第2電極に前記第1電圧が印加される第4ホールドトランジスタと、を含むことを特徴とする表示装置を提供する。
前記放電部は、
前記第3出力信号に応答して前記充電部に充電された電荷を前記第1電圧に放電する第1放電トランジスタと、
最後ステージの第4出力信号に応答して前記充電部に充電された電荷を前記第1電圧に放電する第2放電トランジスタと、を含むことを特徴とする。
この際、互いに異なる位相を有する第1クロックCKV又は第2クロックCKVBが提供されることもできる。又、3つ以上のクロックがそれぞれ印加される3つ以上のステージが一つのユニットを形成することもできる。又、一つの単位ステージに一つのクロックが提供されることを説明したが、一つの単位ステージに2つ以上のクロックが提供されることもできる。
TFTを有するスキャン駆動回路を含む液晶パネルや前記液晶パネルを有するLCDの表示品質を高めることができる。
110 バッファー部
120 充電部
130 駆動部
140,540 放電部
150,250,360,460,560 ホールディング部
350 ホールディング制御部
600 セルアレー回路
610 第1スキャン駆動回路
620 第2スキャン駆動回路
700 アレー基板
710 表示セルアレー回路
720 データ駆動回路
722 第1データ端子部
724 第2データ端子部
726 シフトレジスタ
730 スキャン駆動回路
732 スキャン端子部
816 フレキシブル印刷回路基板
818 通合制御駆動回路
Claims (18)
- 複数のステージを含んで複数の出力信号を順次出力するシフトレジスタにおいて、前記各ステージは、
第1クロック又は前記第1クロックと位相が異なる第2クロックに応答して現在ステージの第1出力信号を出力する駆動部と、
スキャン開始信号又は前段ステージのうち、一つのステージの第2出力信号により電荷が充電される充電部と、
次段ステージのうち、一つのステージの第3出力信号に応答して前記充電部に充電された電荷を放電する放電部と、
前記第1出力信号が非アクティブ状態である場合、前記第1クロックまたは前記第2クロックのそれぞれに応答して充電ノードがフローティング状態にされることを防止するホールディング部と、を含み、
前記駆動部は、第1電極に前記駆動部に印加された前記第1クロック信号又は第2クロック信号が印加され、第2電極を通じて前記第1出力信号をプル−アップ出力する駆動トランジスタを含み、
前記ホールディング部は、
第1電極が前記駆動トランジスタの制御電極に連結され、第2電極が前記駆動トランジスタの第2電極と連結され、制御電極に前記駆動部に印加された前記第1クロック信号又は第2クロック信号が印加される第1ホールドトランジスタを含むことを特徴とするシフトレジスタ。 - 複数のステージを含んで複数の出力信号を順次出力するシフトレジスタにおいて、前記各ステージは、
第1クロック又は前記第1クロックと位相が異なる第2クロックに応答して現在ステージの第1出力信号を出力する駆動部と、
スキャン開始信号又は前段ステージのうち、一つのステージの第2出力信号により電荷が充電される充電部と、
次段ステージのうち、一つのステージの第3出力信号に応答して前記充電部に充電された電荷を放電する放電部と、
前記第1出力信号が非アクティブ状態である場合、前記第1クロックまたは前記第2クロックのそれぞれに応答して前記第1出力信号を第1電圧以内に維持すると共に、充電ノードがフローティング状態にされることを防止するホールディング部と、を含み、
前記駆動部は、第1電極に前記駆動部に印加された前記第1クロック信号又は第2クロック信号が印加され、第2電極を通じて前記第1出力信号をプル−アップ出力する駆動トランジスタを含み、
前記ホールディング部は、
第1電極が前記駆動トランジスタの制御電極に連結され、第2電極が前記駆動トランジスタの第2電極と連結され、制御電極に前記駆動部に印加された前記第1クロック信号又は第2クロック信号が印加される第1ホールドトランジスタを含むことを特徴とするシフトレジスタ。 - 前記駆動部は、前記充電部に充電された電荷と前記第1クロックと前記第2クロックのうち、一つのクロックに応答して前記第1出力信号をプル−アップ出力し、前記第3出力信号に応答して前記第1出力信号をプル−ダウンすることを特徴とする請求項2記載のシフトレジスタ。
- 前記各ステージは、
前記スキャン開始信号又は前記第2出力信号を前記駆動部に提供するバッファー部を更に含むことを特徴とする請求項1記載のシフトレジスタ。 - 前記第1クロックと第2クロックは、位相が反対であることを特徴とする請求項1記載のシフトレジスタ。
- 複数のステージを含んで複数の出力信号を順次出力するシフトレジスタにおいて、
前記各ステージは、
スキャン開始信号又は前段ステージのうち、一つのステージの第2出力信号により電荷が充電される充電部と、
前記充電された電荷及び第1クロック信号又は前記第1クロック信号と位相が異なる第2クロック信号のうち、一つのクロック信号に応答して現在ステージの第1出力信号をプル−アップして出力端子を通じて出力し、次段ステージのうち、一つのステージの第3出力信号に応答して前記第1出力信号をプル−ダウンする駆動部と、
前記第3出力信号に応答して前記充電部に充電された電荷を放電する放電部と、
前記第1出力信号が非アクティブ状態である場合、前記駆動部に印加された前記第1クロック信号又は第2クロック信号に応答してホールド制御信号を出力するホールディング制御部と、
前記ホールド制御信号に応答して前記第1出力信号を所定の第1電圧以内にホールドして前記出力端子のフローティングを防止するホールディング部と、を含み、
前記ホールディング制御部は、
前記第1クロック信号が印加される第1電極と制御電極が共通される第1ホールドトランジスタと、
前記第1クロック信号が印加される第1電極と、前記第1ホールドトランジスタの第2電極に連結される制御電極と、前記ホールディング部に連結される第2電極とを含む第2ホールドトランジスタと、
第1電極が前記第1ホールドトランジスタの第2電極及び第2ホールドトランジスタの制御電極に連結され、制御電極が前記第1出力信号が出力される出力端子に連結され、第2電極が前記第1電圧に連結された第3ホールドトランジスタと、
第1電極が前記第2ホールドトランジスタの第2電極及び前記ホールディング部に連結され、制御電極が前記出力端子に連結され、第2電極が前記第1電圧に連結された第4ホールドトランジスタと、を含むことを特徴とするシフトレジスタ。 - 前記スキャン開始信号又は前記第2出力信号の入力を受けて前記充電部に提供するバッファー部を更に含むことを特徴とする請求項6記載のシフトレジスタ。
- 前記ホールディング制御部は、前記駆動部に印加された前記第1クロック信号又は第2クロック信号がアクティブ状態である時、前記ホールド制御信号を出力することを特徴とする請求項6記載のシフトレジスタ。
- 前記駆動部は、第1電極に前記第1クロック信号が印加され、第2電極を通じて前記第1出力信号をプル−アップ出力する駆動トランジスタを含み、
前記ホールディング部は、
制御電極に前記ホールディング制御部を経由して前記第1クロック信号が印加され、第1電極が前記駆動トランジスタの第2電極に連結され、第2電極が第1電圧に連結された第5ホールドトランジスタを含むことを特徴とする請求項6記載のシフトレジスタ。 - 前記第5ホールドトランジスタは、前記第1クロック信号がアクティブ状態であり、前記第1出力信号が非アクティブ状態である時、ターンオンされて前記駆動トランジスタの第2電極を前記第1電圧以内にホールドすることを特徴とする請求項9記載のシフトレジスタ。
- 前記ホールディング部は、制御電極に前記第2クロック信号が印加され、第1電極が前記駆動トランジスタの第2電極に連結され、第2電極が前記第1電圧に連結された第6ホールドトランジスタを更に含むことを特徴とする請求項9記載のシフトレジスタ。
- 前記第5ホールドトランジスタは、前記第1クロック信号がアクティブ状態であり、前記第1出力信号が非アクティブ状態である時、ターンオンされて前記駆動トランジスタの第2電極を前記第1電圧以内にホールドすることを特徴とする請求項11記載のシフトレジスタ。
- 前記第6ホールドトランジスタは、前記第2クロック信号がアクティブ状態であり、前記第1出力信号が非アクティブ状態である時、ターンオンされて前記駆動トランジスタの第2電極を前記第1電圧以内にホールドすることを特徴とする請求項11記載のシフトレジスタ。
- 前記請求項1〜13のいずれかに記載のシフトレジスタからなる複数のステージを含んで複数の出力信号を順次出力するスキャン駆動回路。
- 基板上に配置され、複数のデータライン及び複数のスキャンラインを含む表示セルアレー回路と複数のステージを含んで複数の出力信号を順次出力する前記請求項1〜13のいずれかに記載のシフトレジスタに連結されたスキャン駆動回路を含む表示装置。
- 基板上に配置され、複数のデータライン及び複数のスキャンラインを含む表示セルアレー回路と、
複数のステージを含み、出力端が前記スキャンラインのうちの第1端に連結され、一番目ステージにはスキャン開始信号が入力され、各ステージの出力信号を前記複数のスキャンラインに順次印加するシフトレジスタを含む第1スキャン駆動回路と、
前記スキャンラインの第2端に連結され、前記スキャンラインを通じて伝達される前記出力信号によって形成された電荷を放電する第2スキャン駆動回路と、を含み、
前記各ステージは、
第1クロック信号又は前記第1クロック信号と位相が異なる第2クロック信号に応答して現在ステージの第1出力信号を出力する駆動部と、
スキャン開始信号又は前段ステージのうち、一つのステージの第2出力信号によって電荷が充電される充電部と、
次段ステージのうち、一つのステージの第3出力信号に応答して前記充電部に充電された電荷を放電する放電部と、
前記第1出力信号が非アクティブ状態である場合、前記第1クロックまたは前記第2クロックのそれぞれに応答して前記第1出力信号を第1電圧以内にホールドするホールディング部と、
前記スキャン開始信号又は前記第2出力信号を前記駆動部に提供するバッファー部と、
前記駆動部に印加された前記第1クロック信号又は第2クロック信号がアクティブ状態である時、ホールド制御信号を出力するホールディング制御部と、を含み、
前記ホールディング部は、
第1電極に前記第1出力信号が印加され、制御電極が前記ホールディング制御部に連結されて前記ホールド制御信号が印加され、第2電極に第1電圧が印加される第1ホールドトランジスタと、
第1電極に前記スキャン開始信号又は前記第2出力信号が印加され、制御電極に前記第2クロック信号が印加され、第2電極が前記充電部の第1端に連結された第2ホールドトランジスタと、
第1電極が前記充電部の第1端に連結され、制御電極に前記第1クロック信号が印加され、第2電極に前記第1出力信号が印加される第3ホールドトランジスタと、
第1電極に前記第1出力信号が印加され、制御電極に前記第2クロック信号が印加され、第2電極に前記第1電圧が印加される第4ホールドトランジスタと、を含むことを特徴とする表示装置。 - 前記ステージは、前記スキャン開始信号又は前記第2出力信号を前記駆動部に提供するバッファー部を更に含み、
前記放電部は、
前記第3出力信号に応答して前記充電部に充電された電荷を前記第1電圧に放電する第1放電トランジスタと、
最後ステージの第4出力信号に応答して前記充電部に充電された電荷を前記第1電圧に放電する第2放電トランジスタと、を含むことを特徴とする請求項16記載の表示装置。 - 前記第2スキャン駆動回路は、第1電極が前記現在ステージに連結されたスキャンラインの第2端に連結され、第2電極に第2電圧が印加され、制御電極が前記次段ステージに連結されたスキャンラインの第2端に連結された第3放電トランジスタを含むことを特徴とする請求項16記載の表示装置。
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