TWI457896B - 閘極驅動器 - Google Patents

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Han Shui Hsueh
Fa Ming Chen
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Himax Tech Ltd
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Description

閘極驅動器
本發明係有關於一種閘極驅動器，尤指一種可以降低輸入雜訊的閘極驅動器。
請參考第1圖，第1圖為習知液晶顯示面板100的示意圖。如第1圖所示，液晶顯示面板100包含有閘極驅動器110以及源極驅動器120，其中閘極驅動器110連接至多條掃描線G1、G2、G3、...，且用以循序驅動該些掃描線以開啟掃描線上的薄膜電晶體(Thin-film transistor，TFT)，而源極驅動器120則連接至多條資料線D1、D2、...，且用來將顯示資料傳送至像素的像素電極中。由於第1圖所示之液晶顯示面板100的操作應為本領域中具有通常知識者所熟知，故細節在此不予贅述。
當液晶顯示面板100在操作時，源極驅動器120所輸出的資料訊號會透過資料線與掃描線之間的耦合電容Cgd影響到掃描線的電壓準位，特別是當掃描線的電壓準位為低閘極電壓準位時，此影響會瞬間影響到閘極驅動器110中P型基板(P-substrate)的電壓，進而造成內部邏輯訊號產生突波(glitch)。另外，若是之後源極驅動器120採用的高速介面技術，邏輯電壓降至1.8V時，上述耦合電容干擾問題會更加地嚴重。
目前針對上述問題的解決方法是在閘極驅動器110上加入電阻電容濾波器，然而，由於所需過濾雜訊的寬度常常會因不同的面板尺寸、氧化銦錫(Indium-Tin Oxide，ITO)層的電阻值或是晶片貼合狀況而有所差異，故造成設計上的困擾。
因此，本發明的目的之一在於提供一種閘極驅動器，其利用邏輯電路來自動判斷出受雜訊干擾的異常訊號，並將之處理成正常訊號，以解決上述的問題。
依據本發明一實施例，一種閘極驅動器包含有一接收單元以及一設定/重置閂鎖型式電路，該接收單元用來接收一第一訊號以及一第二訊號，其中該第一訊號與該第二訊號為互補訊號；該設定/重置閂鎖型式電路，用來接收該第一訊號與該第二訊號，並降低該第一訊號之雜訊以產生一處理後第一訊號。
請參考第2圖，第2圖為依據本發明一實施例之閘極驅動器200的示意圖，如第2圖所示，閘極驅動器200耦接於一時序控制器(timing controller)202，且包含一接收單元210、一設定/重置閂鎖型式電路(SR latching-type circuit)220以及一處理電路230。閘極驅動器200與時序控制器202係製作於一液晶顯示面板上，且閘極 驅動器200自時序控制器202接收一時脈訊號CPV與其互補訊號CPVB及其他控制訊號(未繪示)以循序產生多個閘極控制訊號VG 至該液晶顯示面板上的掃描線。
在閘極驅動器200的操作上，首先，接收單元210自時序控制器202接收時脈訊號CPV及其互補訊號CPVB。接著，設定/重置閂鎖型式電路220接收時脈訊號CPV及其互補訊號CPVB，並降低時脈訊號CPV的雜訊以產生一處理後時脈訊號CPVI。最後，處理電路230接收處理後時脈訊號CPVI與其他來自時序控制器202的控制訊號(未繪示)以循序產生多個閘極控制訊號VG 至該液晶顯示面板上的掃描線。
詳細來說，請參考第3圖所示之設定/重置閂鎖型式電路220的示意圖，設定/重置閂鎖型式電路220包含有一第一邏輯電路310、一閂鎖電路320以及一第二邏輯電路330，其中第一邏輯電路310包含有兩個反向器312、314以及兩個反及閘(NAND)316、318，閂鎖電路320為一設定/重置反及閘閂鎖器(SR NAND latch)，且包含有兩個交互耦合的反及閘322、324，第二邏輯電路330則包含有一反及閘332以及一反向器334。此外，當閘極驅動器被啟動時，反及閘的輸入訊號VP 會直接被設為“1”。
在設定/重置閂鎖型式電路220的操作上，首先，反向器312接收互補訊號CPVB以產生一反向後互補訊號，接著反及閘316接收 時脈訊號CPV與反向後互補訊號以產生一設定訊號SETB；同時間，反向器314接收時脈訊號CPV以產生一反向後時脈訊號，接著反及閘318接收互補訊號CPVB與反向後時脈訊號以產生一重置訊號RSTB。接著，閂鎖電路320接收設定訊號SETB與重置訊號RSTB，並產生一輸出訊號Q，其中輸出訊號Q可視為經過雜訊處理後的時脈訊號。最後，輸出訊號Q經過反及閘332與反向器334的處理後產生一處理後時脈訊號CPVI。
請參考第4圖，第4圖為時脈訊號CPV、互補訊號CPVB與處理後時脈訊號CPVI的時序圖。如第4圖所示，當時脈訊號CPV與互補訊號CPVB分別為(1，0)時，設定訊號SETB為“0”，處理後時脈訊號CPVI為“1”；且當時脈訊號CPV與互補訊號CPVB分別為(0，1)時，重置訊號RSTB為“0”，處理後時脈訊號CPVI為“0”。亦即，設定/重置閂鎖型式電路220會自動處理掉時脈訊號CPV與互補訊號CPVB分別為(1，1)、或是分別為(0，0)時的錯誤狀態(亦即第4圖所示的突波402、404)。
此外，第3圖所示的設定/重置閂鎖型式電路220僅為範例說明，而並非作為本發明的限制，於本發明之其他實施例中，閂鎖電路320可以被替換為其他形式的閂鎖器，且第一邏輯電路310亦可以採用其他的電路架構以產生設定訊號SETB及重置訊號RSTB。另外，第二邏輯電路330的架構亦僅為一範例說明，其可以被替換為其他形式的邏輯電路，或是直接被移除以使得閂鎖電路320的輸 出Q直接作為設定/重置閂鎖型式電路220的輸出。上述設計上的變化均應隸屬於本發明的範疇。
此外，本發明的設定/重置閂鎖型式電路220並不僅限於用來處理來自時序控制器的時脈訊號CPV與互補訊號CPVB，而是可以用來處理其他的互補訊號以消除掉類似突波的雜訊干擾。
簡要歸納本發明，於本發明的閘極驅動器中，包含有一設定/重置閂鎖型式電路，其可以用來接收第一訊號及與其互補的第二訊號，並降低第一訊號的雜訊以產生一處理後第一訊號。相較於習知技術，本發明之具有設定/重置閂鎖型式電路的閘極驅動器可以廣泛應用於各種面板中，具有簡單的架構，且可以確實降低雜訊干擾，以解決習知技術的問題。
以上所述僅為本發明之較佳實施例，凡依本發明申請專利範圍所做之均等變化與修飾，皆應屬本發明之涵蓋範圍。
100‧‧‧液晶顯示面板
110、200‧‧‧閘極驅動器
120‧‧‧源極驅動器
202‧‧‧時序控制器
210‧‧‧接收單元
220‧‧‧設定/重置閂鎖型式電路
230‧‧‧處理電路
310‧‧‧第一邏輯電路
312、314、334‧‧‧反向器
316、318、322、324、332‧‧‧反及閘
320‧‧‧閂鎖電路
330‧‧‧第二邏輯電路
Cgd‧‧‧耦合電容
TFT‧‧‧薄膜電晶體
G1~G3‧‧‧掃描線
D1~D2‧‧‧資料線
第1圖為習知液晶顯示面板100的示意圖。
第2圖為依據本發明一實施例之閘極驅動器200的示意圖。
第3圖為第2圖所示之設定/重置閂鎖型式電路的示意圖。
第4圖為第3圖所示之時脈訊號CPV、互補訊號CPVB與處理後時脈訊號CPVI的時序圖。
200‧‧‧閘極驅動器
202‧‧‧時序控制器
210‧‧‧接收單元
220‧‧‧設定/重置閂鎖型式電路
230‧‧‧處理電路

Claims (7)

  1. 一種閘極驅動器，包含有：一接收單元，用來接收一第一訊號以及一第二訊號，其中該第一訊號與該第二訊號為互補訊號；以及一設定/重置閂鎖型式電路(SR latching-type circuit)，用來接收該第一訊號與該第二訊號，並降低該第一訊號之雜訊以產生一處理後第一訊號，其中該設定/重置閂鎖型式電路包含有：一第一邏輯電路，用來接收該第一訊號與該第二訊號，並產生一設定訊號以及一重置訊號；以及一閂鎖電路，耦接於該第一邏輯電路，用來依據該設定訊號以及該重置訊號以產生一輸出訊號。
  2. 如申請專利範圍第1項所述之閘極驅動器，其中該輸出訊號係作為該處理後第一訊號。
  3. 如申請專利範圍第1項所述之閘極驅動器，其中該設定/重置閂鎖型式電路另包含有：一第二邏輯電路，耦接於該閂鎖電路，用以接收該輸出訊號以產生該處理後第一訊號。
  4. 如申請專利範圍第1項所述之閘極驅動器，其中該第一邏輯電路包含有：一第一反向器，用來接收該第二訊號以產生一反向後第二訊號； 一第二反向器，用來接收該第一訊號以產生一反向後第一訊號；一第一反及閘，耦接於該第一反向器，以產生該設定訊號；以及一第二反及閘，耦接於該第二反向器，以產生該重置訊號。
  5. 如申請專利範圍第4項所述之閘極驅動器，其中該閂鎖電路為一設定/重置反及閘閂鎖器(SR NAND latch)。
  6. 如申請專利範圍第1項所述之閘極驅動器，其中該第一訊號與第二訊號係來自於一顯示面板上的時序控制器(timing controller)，且該第一訊號為一時脈訊號。
  7. 如申請專利範圍第6項所述之閘極驅動器，其中該顯示面板為一液晶顯示面板。
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