JP4088415B2 - 信号を増幅する装置および方法 - Google Patents
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Description
本発明は一般に増幅器に関し、さらに詳しくは、回路を増幅するための装置および方法に関する。
【0001】
(発明の背景)
ドハティ増幅器(Doherty amplifiers)などの効率の高い線形増幅器は、当業者には周知である。しかし、ドハティ増幅器は、通常、線形性が比較的悪いことも知られる。また、その線形性は効率性に反比例するのが普通である。その結果、ドハティ増幅器はピーク対平均値の比が高い線形増幅器の性能を改善することができたとしても、狭いダイナミック・レンジにおいてしかできない。
【0002】
ドハティ増幅器をネスティングすることによって、より広いダイナミック・レンジにおいて効率良く動作することのできるドハティ増幅器を設計するための少なくとも1つの試みがなされた。これは、「Efficiency of Doherty radio frequency (RF)-power amplifier systems」(F.Raab著 Green Mountain Radio Reserach Company, RN84-23;1984年8月発行;)に説明される。Rabbの実行例において説明されるようにドハティ増幅器をネスティングするには、平行する追加の増幅器段と関連する駆動制御回路構成とが必要である。
【0003】
ドハティ型の増幅器回路は、その効率性が低出力電力レベルにおいて増大されればさらに魅力的になる。特に、多重搬送波電力増幅器に印加されるRF入力信号が30dBも可変するセルラ基地局装置のための多重搬送波電力増幅器の用途において魅力的である。
【0004】
従って、ドハティ増幅器の効率性が広いダイナミック・レンジにおいて増大される信号の増幅システムおよび方法が必要である。
【0005】
(発明の概要)
本発明のある局面により、入力および出力を有する増幅器と、増幅器の出力に結合される入力,出力および制御入力を有する第1ドハティ増幅器とを備える増幅器回路により上記の必要性が満足される。増幅器回路は、第1ドハティ増幅器の出力から第1ドハティ出力信号を検出するために結合される検出器入力と出力とを有する検出器も備える。この出力はコントローラの入力に結合され、コントローラは第1および第2コントローラ出力を有する。増幅器回路は、第1コントローラ出力に結合される入力と、第1ドハティ増幅器の制御入力に結合される出力とを有する切替調整器をさらに備える。対応して、増幅器回路は、信号入力と、増幅器の入力に結合される出力と、第2コントローラ出力に結合される制御入力とを有する可変減衰器を備える。
【0006】
本発明の他局面により、信号を増幅する方法により上記の必要性は満足される。本方法は、可変減衰器の入力において入力信号を受信する段階,入力信号を減衰して被減衰信号を形成する段階および被減衰信号を増幅して被増幅信号を形成する段階を備える。本方法は、ドハティ増幅器内で被増幅信号を増幅する段階および切替調整器により制御入力においてドハティ増幅器に対し提供される電源電圧を受信することに応答してドハティ出力信号を生成する段階も備える。さらに本方法は、検出器内の全信号を検出して被検出出力信号を形成する段階であって、全信号が少なくとも第1ドハティ出力信号を含む段階,被検出出力信号をコントローラ内の所定のコントローラ閾値と比較する段階および被検出出力信号が所定の閾値より低い場合にコントローラ内に第1および第2制御信号を生成する段階を備える。第1制御信号に応答して、切替調整器内に切替調整器出力電圧を生成し、その後で切替調整器出力電圧に基づき第1ドハティ増幅器の電圧を修正する。第2制御信号に応答して、可変減衰器の電圧を修正する。
【0007】
本発明のさらに別の局面により、入力,第1ドハティ制御入力および出力を有する第1ドハティ増幅器を備える増幅器回路により上記の必要性は満足される。このとき、出力は第2ドハティ制御入力および出力を有する第2ドハティ増幅器の入力に結合される。増幅器回路は、第2ドハティ増幅器の出力から第2ドハティ出力信号を検出するために結合される検出器入力と出力とを有する検出器も備える。出力は、コントローラ出力を有するコントローラの入力に結合される。増幅器回路は、コントローラ出力に結合される入力と、第1および第2切替調整器出力とを有する切替調整器をさらに備え、第1切替調整器出力は第1ドハティ制御入力に結合され、第2切替調整器出力は第2ドハティ制御入力に結合される。
【0008】
本発明のさらに別の局面により、上記の必要性は信号を増幅する方法により満足される。本方法は、第1ドハティ増幅器の入力において入力信号を受信する段階,第1ドハティ増幅器の第1ドハティ制御入力において第1電源電圧を受信する段階,第1ドハティ増幅器において入力信号を増幅して第1ドハティ出力信号を形成する段階,第2ドハティ増幅器の入力において第1ドハティ出力信号を受信する段階,第2ドハティ増幅器の第2ドハティ制御入力において第2電源電圧を受信する段階および第2ドハティ増幅器内で第1ドハティ出力信号を増幅して第2ドハティ出力信号を形成する段階を備える。本方法は、全信号を検出して被検出出力信号を形成する段階であって、全信号が少なくとも第2ドハティ出力信号を含む段階と、コントローラ内で被検出出力信号を所定のコントローラ閾値と比較する段階とをさらに備える。また、本方法は、前記の被検出出力信号が所定のコントローラ閾値より低い場合にコントローラ内で制御信号を生成する段階と、制御信号に基づいて切替調整器内で第1電源電圧を生成する段階と、その後で第1電源電圧に基づき第1ドハティ増幅器の電圧を修正する段階とを備える。平行して、制御信号に基づき切替調整器内で第2電源電圧を生成し、その後で前記第2電源電圧に基づき第2ドハティ増幅器の電圧を修正する。
【0009】
本発明の利点は、説明のために図示および解説される本発明の好適な実施例の以下の説明から当業者には容易に理解頂けよう。言うまでもなく、本発明は他の異なる実施例も可能であり、その詳細は種々の観点から変更することができる。従って、図面および解説は説明のためのものであり、制限を加えるためのものではないと見なされる。
【0010】
(好適な実施例の詳細説明)
図面を参照して、同様の番号は同様の構成部品を指すが、図1は典型的なドハティ増幅器を示す。ドハティ増幅器208は、入力信号206を受信し、制御入力234の受信に応答してドハティ出力信号220を生成する。制御入力は一般に、通常ドレイン電圧と呼ばれる電圧を表し、VDdと記される。
【0011】
電界効果トランジスタ(FET:field effect transistor)を利用するドハティ増幅器は、一定のドレイン電圧で動作するのが普通である。ドハティ出力信号220が飽和電力にある場合は、ドハティ増幅器208は最大ドレイン効率において動作する。言い換えると、ドハティ増幅器208は、ドハティ出力信号220の電圧がドレイン電圧VDdに等しいときに最大効率で動作する。飽和は図2に示されるように9dBのバックオフにおいて起こる。RF電力出力のDC入力電力に対する比として定義されるドハティ効率は、飽和から6dBにおいて遷移電圧に到達するまでは、飽和からのバックオフが増すと少しずつ下がる。飽和から6dBのバックオフにおいて、再び最大ドハティ効率に達する。遷移電圧のもとでは、ドハティ効率は、飽和からのバックオフが増大するにつれて急速に下がる。当技術では周知の如く、ドハティ出力信号220の電力が下がるにつれて、ドハティ増幅器208の効率は出力信号電圧振幅に比例して下がる。従って、ドハティ出力信号220が低い場合、ドハティ効率は低くなる。逆にドハティ出力信号220が高い場合、ドハティ効率は高くなる。たとえば、20ワットのドハティ出力信号電力は、20ボルトの一定ドレイン電圧に関して約40%の効率であり、60ワットのドハティ出力信号電力は20ボルトの一定ドレイン電圧に関して約57%の効率である。
【0012】
ドレイン電圧が一定の出力電圧に対して上がると、ドハティ効率は下がる。たとえば、飽和から6dBのバックオフにおいて、900Mhzの用例では、ドハティ効率は20ボルトの一定ドレイン電圧に関して約46%であり、30ボルトの一定ドレイン電圧に関して約40%に下がる。
【0013】
低い一定ドレイン電圧においてドハティ増幅器208を動作させるにあたり2つの実際的な問題がある。1つの問題は、歪みとも呼ばれる、ドハティ出力信号220の相互変調の増大である。この歪みは、ドハティ出力信号220の電力を低い値たとえば飽和より9ないし10dB低く抑えることにより軽減することができる。もう1つの問題は、ドハティ増幅器208の電力利得の低下である。ドハティ増幅器208の電力利得の低下は、可変減衰器をドライバ増幅器により与えられる固定利得と共に加えることにより対処することができる。可変減衰器および固定利得ドライバ増幅器は、ドハティ増幅器208の両端で利得損失を相殺するよう構築される。
【0014】
従って、ドハティ増幅器208を実質的に飽和付近に維持することによって、より広いダイナミック・レンジにおいてドハティ効率を改善することが可能になる。ドハティ増幅器208を飽和付近に維持するためには、制御入力234に現れる電源電圧をドハティ出力信号220の電圧に比例して調整する。本発明の好適な実施例においては、制御入力234に現れる可調整電源電圧が上記の一定電源(またはドレイン)電圧VDdに置き換わる。
【0015】
図3は、本発明の好適な実施例による、信号を増幅してその結果ドハティ増幅器効率を増大する増幅器回路200のブロック図である。増幅器回路200は、入力201および出力240を有して構築される。増幅器回路200は、可変減衰器202,増幅器204,第1ドハティ増幅器208,検出器224,コントローラ228および切替調整器232を備える。入力信号250(たとえば複数のRFトランシーバにより生成される多重搬送波900メガヘルツ(Mhz)のRF信号)が入力201において受信される。
【0016】
回路200の動作中は、増幅器204好ましくはドライバ増幅器は、可変減衰器202により生成される被減衰信号を受信する入力を有し、入力信号206を第1ドハティ増幅器208に提供する。第1ドハティ増幅器208は、入力信号206を受信し、制御入力234における切替調整器232により提供される電源電圧の受信に応答して、第1ドハティ出力信号220を生成する。好適な実施例においては、検出器224好ましくはダイオード検出器が、方向性カプラ(図示せず)を介して第1ドハティ増幅器208の出力に結合される。検出器224は、第1ドハティ出力信号をサンプリングおよび整流して、被検出出力信号226をコントローラ228に提供する。被検出出力信号228は、検出器入力222において検出される信号に比例する直流(DC)電圧である。
【0017】
被検出出力信号226が所定のコントローラ閾値たとえば閾値電圧より低いと、コントローラ228は第1および第2制御信号を生成する。これに応じて、コントローラ228は、被検出出力信号226を切替調整器232への入力に適した第1制御信号230に変換する。この変換は、切替調整器232が第1ドハティ増幅器208への制御入力234として提供される電源電圧を、被検出出力信号の減少に応じて低下させるように行われる。その結果、第1ドハティ増幅器208の両端の電圧利得(第1利得)が下がる。
【0018】
平行して、コントローラ228が被検出出力信号226を可変減衰器202への入力に適した第2制御入力231に変換する。この変換は、可変減衰器が入力信号250の減衰を削減して、結果として第1ドハティ増幅器208の入力に現れる信号を大きくするよう行われる。その結果、可変減衰器202およびドライバ増幅器204の和の両端の電圧利得(第2利得)が上がる。
【0019】
これに由来する第1ドハティ増幅器208の両端の電圧低下は、これに由来する可変減衰器202およびドライバ増幅器204の和の両端の電圧の増大と結合して、より広いダイナミック・レンジにおいてドハティ増幅器208をその飽和点付近に維持する。それに対応して、第1および第2利得の和は、増幅器回路200の両端で実質的に一定になる。
【0020】
増幅器204およびドハティ増幅器208は、好ましくは、モトローラ社から入手可能なMRF 183シリーズ増幅器などの金属酸化物半導体電界効果トランジスタ(MOSFET:metal oxide semiconductor field effect transistor)である。可変減衰器202は、好ましくはM/A-COM社製のAT-108電圧可変吸収減衰器である。検出器224はこれもM/A-COM社製のMA4E932Aゼロ・バイアス検出器ダイオードとすることができる。切替調整器232は、AT&TバージョンのFE150R DC-DC電力モジュールと同様の任意の数の種類の切替調整器とすることができる。コントローラ228は、ソフトウェアまたはハードウェア方法のいずれでも構築することができる。たとえば、コントローラ228をハード・コード化されたルックアップ・テーブルとして実現しても、あるいはレベル・シフティングおよびスケーリング演算増幅器を備えるアナログ回路として実現してもよい。
【0021】
図4に示される代替の増幅器回路300においては、第2ドハティ増幅器310をドハティ増幅器208と並列に加えて、図示されるように第2ドハティ増幅器310がドハティ増幅器208の入力に結合される入力と、ドハティ増幅器208の出力に結合される出力とを有するようにする。第2ドハティ増幅器310は、切替調整器232の出力に結合される制御入力も有する。第1ドハティ出力信号220に第2ドハティ増幅器310が出力する第2ドハティ出力信号320を加算する効果により、全信号322が生成される。追加のドハティ増幅器は、所望の全信号322の大きさによっては並列に加えてもよい。
【0022】
図5に、全体を400とする信号増幅法を表す流れ図を示す。方法400は、ブロック62で始まり、ここで増幅器回路200が入力201において入力信号250を受信する。次にブロック64において、入力信号250が可変減衰器202により減衰され、被減衰信号を形成する。ブロック66において、被減衰信号がドライバ増幅器204により増幅され、第1ドハティ増幅器208に入力信号206を提供する。次にブロック68において、第1ドハティ増幅器208が、制御入力234における電源電圧の受信に応答して、第1ドハティ出力信号220を生成する。
【0023】
次にブロック70において、第1ドハティ出力信号220が検出器224により検出され、検出器224は被検出器出力信号226を生成する。被検出力信号226はブロック72において、コントローラ228により閾値電圧と比較される。被検出出力信号226の電圧が閾値電圧より低い場合は、ブロック74においてコントローラ228が第1制御信号230および第2制御信号231を生成する。被検出出力信号226の電圧が閾値電圧よりも高い場合は、コントローラ228は第1および第2制御信号を生成しない。ブロック78において、第1制御信号230を受信すると、切替調整器232は出力を生成し、これが第1ドハティ増幅器208の制御入力234において電源電圧として現れる。この電源電圧は、第1制御信号230に比例する。電源電圧に応答して、第1ドハティ出力信号220がブロック80において修正される。平行して、第2制御信号231を受信すると、可変減衰器202がブロック82において入力信号250を減衰する。これに応答して、ブロック84において、可変減衰器202と増幅器204の和の両端の電圧が修正される。
【0024】
図6に示される第3の実施例により、増幅器204をドハティ増幅器404と置き換えることによって、さらに増幅器回路を強化することができる。増幅器回路500は、入力403および出力240を有して構築される。増幅器回路は、可変減衰器202,第1ドハティ増幅器404,第2ドハティ増幅器408,検出器224,コントローラ228および切替調整器232を備える。入力信号250(たとえば複数のRFトランシーバにより生成される多重搬送波900メガヘルツ(Mhz)RF信号)が入力403において受信される。
【0025】
増幅器回路500の動作中は、第1ドハティ増幅器404が入力403において入力信号250を受信し、第1ドハティ制御入力233に提供される切替調整器232からの第1電源電圧に基づいて、第1ドハティ出力信号406を生成する。第2ドハティ増幅器408は第1ドハティ出力信号406を受信し、第2ドハティ制御入力234において受信される切替調整器232からの第2電源電圧に基づいて第2ドハティ出力信号220を生成する。
【0026】
好適な実施例においては、検出器224好ましくはダイオード検出器は、方向性カプラ(図示せず)を介して第2ドハティ増幅器408の出力に結合される。検出器224は、第2ドハティ出力信号220をサンプリングおよび整流して、被検出出力信号226をコントローラ228に提供する。被検出出力信号226は、検出器入力222において検出される信号に比例する直流(DC)電圧である。
【0027】
被検出出力信号226が所定のコントローラ閾値たとえば閾値電圧より高いと、コントローラ228は制御信号を生成しない。被検出出力信号226が閾値電圧よりも低いと、コントローラ228は被検出出力信号226を切替調整器232への入力に適した第2制御入力230に変換する。この変換は、切替調整器232が第2ドハティ制御入力234において提供される電源電圧を下げるように行われる。その結果、第2ドハティ増幅器408の電圧利得が、被検出出力信号226の低下に応答して下がる。
【0028】
平行して、切替調整器232が第1ドハティ制御入力233において提供される電源電圧を上げる。その結果、 被検出出力信号226の低下に応答して第1ドハティ増幅器404の電圧利得が上がる。第1ドハティ増幅器404の両端の電圧利得の増大は第2ドハティ増幅器408の両端の電圧損失と結合して、結果的には、増幅器回路500の両端の電圧は実質的に一定になり、それによって第2ドハティ増幅器408の動作はその飽和点付近に維持される。
【0029】
図7に示される第4の実施例においては、第3ドハティ増幅器510が第2ドハティ増幅器408と並列に加えられて、図示されるように第3ドハティ増幅器510が第2ドハティ増幅器408の入力に結合される入力と、第2ドハティ増幅器408の出力に結合される出力とを有するようにする。第3ドハティ増幅器510は、第1ドハティ出力信号406を受信し、第3ドハティ制御入力234において受信される切替調整器232からの第2電源電圧に基づいて、第3ドハティ出力信号520を生成する。第2ドハティ出力信号220と第3ドハティ出力信号520とを加算する効果により、全信号322が生成される。追加のドハティ増幅器は、所望の全信号322の大きさによっては並列に加えてもよい。
【0030】
図8に、全体を700とする信号増幅法を表す流れ図を示す。方法700は、ブロック87で始まり、ここで増幅器回路500が入力403において入力信号250を受信する。次にブロック88において、第1ドハティ増幅器404が第1ドハティ制御入力233の受信に応答して第1ドハティ出力信号406を生成する。第1ドハティ制御入力233は、切替調整器232からの電源電圧を表す。次にブロック89において、第2ドハティ増幅器408が第1ドハティ出力信号406および第2ドハティ制御入力234の受信に応答して、第2ドハティ出力信号220を生成する。
【0031】
ブロック90において、第2ドハティ出力信号220が検出器224により検出され、検出器224は被検出器出力信号226を生成する。被検出力信号226はブロック91において、コントローラ228により閾値電圧と比較される。被検出出力信号226の電圧が閾値電圧より低い場合は、ブロック92においてコントローラ228が制御信号230を生成する。被検出出力信号226の電圧が閾値電圧よりも高い場合は、コントローラ228は制御信号230を生成しない。ブロック93において、制御信号230を受信すると、切替調整器232は出力を生成し、これが第1ドハティ制御入力233において第1電源電圧として現れる。第1ドハティ制御入力233の受信に応答して、第1ドハティ出力信号406がブロック94で修正される。平行して、ブロック95において、制御信号230を受信すると、切替調整器232は出力を生成し、これが第2ドハティ制御入力234において第2電源電圧として現れる。これに応答して、第2ドハティ出力信号420がブロック96において修正される。この後は、第1および第2ドハティ出力信号に対する修正により、増幅器回路500の利得は、ドハティ出力信号に対する歪みを最小限に抑えながら実質的に一定のレベルに維持される。また、ドハティ増幅器の動作は最大効率付近で行われる。
【0032】
本発明の他の形態や、上記に説明される特定の実施例以外の実施例を添付の請求項またはその等価物の精神および範囲から逸脱せずに考案できることは明白である。故に、本発明の範囲は添付の請求項およびその等価物によってのみ決定されるものとする。
【図面の簡単な説明】
【図1】 典型的なドハティ増幅器である。
【図2】 複数のドレイン電圧におけるドハティ増幅器の飽和に関するドハティ増幅器の効率性をグラフに示す。
【図3】 本発明の好適な実施例によるドハティ増幅器の効率性を増大することによる信号増幅回路のブロック図である。
【図4】 図3に示される回路の変形のブロック図である。
【図5】 本発明の好適な実施例による信号増幅方法の流れ図である。
【図6】 本発明の好適な実施例によるドハティ増幅器の効率性を増大することによる信号増幅回路のブロック図である。
【図7】 図6に示される回路の変形のブロック図である。
【図8】 図6の実施例による信号増幅方法の流れ図である。
Claims (13)
- 入力および出力を有する増幅器;
前記増幅器の前記出力に結合される入力と、出力と、制御入力とを有する第1ドハティ増幅器;
前記第1ドハティ増幅器の前記出力の第1ドハティ出力信号を検出するために結合される検出器入力と、出力とを有する検出器;
前記検出器の前記出力に結合される入力と、第1出力と、第2出力とを有するコントローラ;
前記コントローラの前記第1出力に結合される入力と、前記第1ドハティ増幅器の前記制御入力に結合される出力とを有する切替調整器;および
信号入力と、前記増幅器の前記入力に結合される出力と、前記コントローラの前記第2出力に結合される制御入力とを有する可変減衰器;
によって構成される増幅器回路であって、
前記検出器の出力信号がコントローラの所定の閾値よりも小さな場合には、前記コントローラが、前記第1出力および前記第2出力から出力する制御信号により、前記可変減衰器の減衰量を低減するとともに、前記切替調整器が前記第1ドハティ増幅器の電圧利得を下げるよう制御するコントローラであることを特徴とする増幅器回路。 - 前記増幅器回路の第1利得が前記第1ドハティ増幅器の両端の電圧によって構成されることを特徴とする請求項1記載の増幅器回路。
- 前記増幅器回路の第2利得が前記可変減衰器と前記増幅器の和の両端の電圧によって構成されることを特徴とする請求項2記載の増幅器回路。
- 前記第1利得および前記第2利得の和が実質的に一定であることを特徴とする請求項3に記載の増幅器回路。
- 前記第1ドハティ増幅器の前記入力に結合される入力と、前記第1ドハティ増幅器の前記出力に結合される出力と、前記切替調整器の前記出力に結合される制御入力とを有する第2ドハティ増幅器によってさらに構成されることを特徴とする請求項1記載の増幅器回路。
- 前記増幅器群が無線周波数トランジスタ半導体装置によって構成されることを特徴とする請求項1記載の増幅器回路。
- 入力信号を増幅する方法であって: 前記入力信号を可変減衰器の信号入力において受信する段階;
前記入力信号を減衰して被減衰信号を形成する段階;
前記被減衰信号を増幅して被増幅信号を形成する段階;
第1ドハティ増幅器において前記被増幅信号を増幅して第1ドハティ出力信号を形成する段階;
検出器において全信号を検出して被検出出力信号を形成する段階であって、前記全信号が少なくとも前記第1ドハティ出力信号によって構成される段階;
前記被検出出力信号をコントローラ内で所定のコントローラ閾値と比較する段階;
被検出出力信号が前記所定のコントローラ閾値より低い場合に、前記コントローラにおいて第1制御信号および第2制御信号を生成する段階;
前記第1制御信号が生成された場合には、切替調整器において切替調整器出力電圧を生成する段階;
前記切替調整器出力電圧が生成された場合には、前記第1ドハティ増幅器の電圧利得を
低減する段階;および
前記第2制御信号が生成された場合には、前記可変減衰器の減衰量を低減する段階;
によって構成されることを特徴とする方法。 - 前記増幅器回路の第1利得が前記第1ドハティ増幅器の両端の前記電圧修正によって構成されることを特徴とする請求項7記載の方法。
- 前記増幅器回路の第2利得が前記可変減衰器と前記増幅器の前記電圧修正の和によって構成されることを特徴とする請求項8記載の方法。
- 前記第1利得および前記第2利得の和が実質的に一定であることを特徴とする請求項9に記載の方法。
- 前記被増幅信号を第2ドハティ増幅器内で増幅して第2ドハティ出力信号を形成する段階;および
前記第1および第2ドハティ出力信号を合成して前記全信号を形成する段階;
によってさらに構成されることを特徴とする請求項7記載の方法。 - 入力と第1ドハティ制御入力と出力とを有する第1ドハティ増幅器;
前記第1ドハティ増幅器の前記出力に結合される入力と、出力と、第2ドハティ制御入力とを有する第2ドハティ増幅器;
前記第2ドハティ増幅器の前記出力の第2ドハティ出力信号を検出するために結合される検出器入力と、出力とを有する検出器;
前記検出器の前記出力に結合される入力と、出力とを有するコントローラ;
前記コントローラの前記出力に結合される入力と、第1および第2切替調整器出力とを有する切替調整器であって、前記第1切替調整器出力が前記第1ドハティ制御入力に結合され、前記第2切替調整器出力が前記第2ドハティ制御入力に結合される切替調整器;および
前記第2ドハティ増幅器の前記入力に結合される入力と、前記第2ドハティ増幅器の前記出力に結合される出力と、前記第2切替調整器出力に結合される制御入力とを有する第3ドハティ増幅器;
によって構成されることを特徴とする増幅器回路。 - 前記第1ドハティ出力信号を第3ドハティ増幅器内で増幅して第3ドハティ出力信号を形成する段階;および
前記第2ドハティ出力信号および第3ドハティ出力信号を合成して前記全信号を形成する段階;
によってさらに構成されることを特徴とする請求項9記載の方法。
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