JP2018050198A - 画像処理装置、その制御方法、及びプログラム - Google Patents
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Abstract
【解決手段】本画像処理装置は、電力を供給する通常モードと、当該通常モードよりも消費電力の低いRSモードとをアドレスごとに制御可能な複数のメモリモジュールを備え、実行する画像処理のアルゴリズムに基づき、アクセスする各メモリモジュールのエリアを順次予測し、複数のメモリモジュールの全域をRSモードで制御し、その後、順次予測されたエリアを通常モードへ順次制御し、当該エリアへのアクセスが終了すると通常モードへ制御する。
【選択図】 図3
Description
<画像処理装置の構成>
以下では、本発明の第1の実施形態について説明する。まず、図1を参照して、本実施形態に係る画像処理装置100として、プリント機能を有するレーザプリンタを例に説明する。画像処理装置100は、画像処理プロセッサ1とDRAM2とを備える。また、画像処理プロセッサ1は、レーザプリンタのプリント機能を処理するASIC(Application Specific Integrated Circuit)である。また、画像処理プロセッサ1は、その内部にCPU10、DRAM I/F11、DMAC12、画像処理部13、DMAC14、これらを接続する内部バス15を備える。
次に、図2を参照して、本実施形態に係る画像処理部13の詳細な構成について説明する。色空間変換処理部131は色空間変換処理部1310及びSRAM(メモリモジュール)1311を備え、これらはSRAM I/F1312を介してデータを送受信することができる。色空間変換処理部131では、入力された各色8ビットのRGB画像データに対して、公知技術である色変換処理を色空間変換処理部1310で実行し、各色8ビットのCMYK画像データへ変換する。また、色空間変換処理部1310は、SRAM1311に格納された、色空間変換のための係数を定義したルックアップテーブルを、SRAM I/F1312を介して色空間変換処理時に参照する。ここで、色空間変換処理部131による画像処理において、SRAMのアクセスは画素値によりランダムとなり、予測が困難であるため、本提案の省電力制御は行わないものとする。
次に、図3を参照して、本実施形態に係るフィルタ処理部132のラインバッファ制御とn×nウィンドウ制御に関する部分を抜粋した構成例について説明する。
次に、図7を参照して、空のラインバッファにデータを格納してゆく際の上記step_A1〜step_A256付近におけるレジュームSRAM1321_1におけるRSモード(第2モード)と、通常モード(第1モード)の制御タイミングについて説明する。図7において、画像データ転送制御部1320_0は、前段のFIFOからデータを読み出し、stepA_1が開始される3サイクル前に予めSRAMエリア#1(1321_101)を通常モードに戻す。即ち、画像データ転送制御部1320_0は、所定のエリアについて、アクセスが予測された主走査カウンタによる特定のカウントよりも所定数前のカウントにおいて、所定のエリアをRSモードから通常モードへ制御する。具体的には、画像データ転送制御部1320_0は、制御信号1323_1を介してRS信号1321_111をLにするよう制御する。
<ハーフトーン処理用 SRAM部 詳細>
以下では、本発明の第2の実施形態について説明する。図9にハーフトーン処理部133のハーフトーン処理に関する部分を抜粋した構成例を示す。
本発明は、上述の実施形態の1以上の機能を実現するプログラムを、ネットワーク又は記憶媒体を介してシステム又は装置に供給し、そのシステム又は装置のコンピュータにおける1つ以上のプロセッサーがプログラムを読出し実行する処理でも実現可能である。また、1以上の機能を実現する回路(例えば、ASIC)によっても実現可能である。
Claims (13)
- 画像処理装置であって、
電力を供給する第1モードと、該第1モードよりも消費電力の低い第2モードとをアドレスごとに制御可能な複数のメモリモジュールと、
実行する画像処理のアルゴリズムに基づき、アクセスする各メモリモジュールのエリアを順次予測する予測手段と、
前記複数のメモリモジュールの全域を前記第2モードで制御し、その後、前記予測手段によって順次予測されたエリアを前記第1モードへ順次制御し、当該エリアへのアクセスが終了すると前記第2モードへ制御する省電力制御手段と
を備えることを特徴とする画像処理装置。 - 各メモリモジュールは、処理対象の画像データにおける主走査方向のラインごとにデータを保持するラインバッファであり、所定のアドレスごとに複数の前記エリアに分割されることを特徴とする請求項1に記載の画像処理装置。
- 画像データの主走査方向について該画像データを処理するタイミングを調整するための主走査カウンタをさらに備え、
前記省電力制御手段は、
前記予測手段による予測と、前記主走査カウンタによるカウントとに従って、各メモリモジュールのエリアごとに省電力制御を行うことを特徴とする請求項2に記載の画像処理装置。 - 前記省電力制御手段は、
所定のエリアについて、前記予測手段によってアクセスが予測された前記主走査カウンタによる特定のカウントよりも所定数前のカウントにおいて、前記所定のエリアを前記第2モードから前記第1モードへ制御することを特徴とする請求項3に記載の画像処理装置。 - 前記所定数前のカウントは、前記メモリモジュールのエリアが前記第2モードから前記第1モードへ遷移するのに要する期間に基づくことを特徴とする請求項4に記載の画像処理装置。
- 前記画像処理は、フィルタ処理であり、
前記予測手段は、各メモリモジュールついて、主走査方向へのアクセスするエリアの遷移を予測することを特徴とする請求項2乃至5の何れか1項に記載の画像処理装置。 - 各メモリモジュールは、処理対象の画像データにおける主走査方向のラインごとにデータを保持するラインバッファであり、前記複数のメモリモジュールに跨った2次元の前記エリアであって、所定のアドレスごとに複数の前記エリアに分割されることを特徴とする請求項1に記載の画像処理装置。
- 画像データの主走査方向について該画像データを処理するタイミングを調整するための主走査カウンタと
画像データの副走査方向について該画像データを処理するタイミングを調整するための副走査カウンタとをさらに備え、
前記省電力制御手段は、
前記予測手段による予測と、前記主走査カウンタによるカウントと、前記副走査カウンタによるカウントとに従って、前記複数のメモリモジュールに跨ったエリアごとに省電力制御を行うことを特徴とする請求項7に記載の画像処理装置。 - 前記画像処理は、ハーフトーン処理であり、
前記予測手段は、各メモリモジュールついて、主走査方向及び副走査方向へのアクセスするエリアの遷移を予測することを特徴とする請求項7又は8に記載の画像処理装置。 - 前記エリアは、前記ハーフトーン処理に用いられるディザしきい値マトリクスに対応することを特徴とする請求項9に記載の画像処理装置。
- 前記メモリモジュールは、SRAMであることを特徴とする請求項1乃至10の何れか1項に記載の画像処理装置。
- 電力を供給する第1モードと、該第1モードよりも消費電力の低い第2モードとをアドレスごとに制御可能な複数のメモリモジュールを備える画像処理装置の制御方法であって、
予測手段が、実行する画像処理のアルゴリズムに基づき、アクセスする各メモリモジュールのエリアを順次予測する予測工程と、
省電力制御手段が、前記複数のメモリモジュールの全域を前記第2モードで制御し、その後、前記予測工程で順次予測されたエリアを前記第1モードへ順次制御し、当該エリアへのアクセスが終了すると前記第2モードへ制御する省電力制御工程と
を実行することを特徴とする画像処理装置の制御方法。 - 電力を供給する第1モードと、該第1モードよりも消費電力の低い第2モードとをアドレスごとに制御可能な複数のメモリモジュールを備える画像処理装置の制御方法における各工程をコンピュータに実行させるためのプログラムであって、前記制御方法は、
予測手段が、実行する画像処理のアルゴリズムに基づき、アクセスする各メモリモジュールのエリアを順次予測する予測工程と、
省電力制御手段が、前記複数のメモリモジュールの全域を前記第2モードで制御し、その後、前記予測工程で順次予測されたエリアを前記第1モードへ順次制御し、当該エリアへのアクセスが終了すると前記第2モードへ制御する省電力制御工程と
を実行することを特徴とするプログラム。
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