JP2015506048A - 駆動回路、シフトレジスター、ゲート駆動器、アレイ基板及び表示装置 - Google Patents
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Abstract
Description
本発明が解決しようとする技術課題は、ゲートバイアスストレスによる閾値電圧のドリフト欠陥を有効的に避け、且つ出力電圧のノイズを減少できる駆動回路、シフトレジスター、ゲート駆動器、アレイ基板及び表示装置を提供する。
前記課題を解決するために、本発明はプルアップノードの信号及びクロック信号入力端子が入力する信号によって、出力端子に駆動信号を出力するプルアップモジュールと、信号入力端子が入力する信号及びクロック障害信号入力端子が入力する信号によってプルアップノードの信号を制御することより、前記プルアップモジュールを駆動するプルアップ駆動モジュールと、クロック障害信号入力端子が入力する信号及びプルダウンノードの信号によって、前記出力端子にオフ信号を出力する第1プルダウンモジュールと、信号入力端子が入力する信号が低レベルである時に、前記クロック信号入力端子が入力する信号によって、前記プルアップノードと前記出力端子にオフ信号を出力する第2プルダウンモジュールと、前記クロック障害信号入力端子が入力する信号及び前記プルアップノードの信号によって、プルダウンノードの信号を制御することより、前記第1プルダウンモジュールを駆動するプルダウン駆動モジュールと、前記リセット信号入力端子が入力する信号によって、前記プルアップノードと前記出力端子にオフ信号を出力するリセットモジュールと、を備え、前記信号入力端子が入力する信号が高レベルであるときに、前記クロック障害信号入力端子が入力する信号も高レベルであり、前記クロック信号入力端子が入力する信号が前記クロック障害信号入力端子が入力する信号の位相とは逆であることを特徴とする駆動回路を提供する。
本発明は従来のシフトレジスターの段に1つのプルダウンモジュールを増加することより、薄膜トランジスター閾値電圧のドリフトを減少し、出力電圧のノイズを減少することができる。このように、シフトレジスターの各段の駆動回路、シフトレジスター全体、ゲート駆動器、アレイ基板及び液晶表示装置の動作寿命が高められ、更に動作信号を高信頼的に出力することが確保される。また、元のシフトレジスターの段に基づき、クロック信号CLKが来る時に、プルアップノードPUの結合電圧を放電し、そのノイズを下げるとともに、出力ノードを放電し、出力信号のノイズを下げる。シフトレジスターの各段の駆動回路、シフトレジスター全体、ゲート駆動器、アレイ基板及び液晶表示装置の安定性が向上される。
Claims (7)
- プルアップノードの信号及びクロック信号入力端子が入力する信号によって、出力端子に駆動信号を出力するプルアップモジュールと、
信号入力端子が入力する信号及びクロック障害信号入力端子が入力する信号によってプルアップノードの信号を制御することより、前記プルアップモジュールを駆動するプルアップ駆動モジュールと、
クロック障害信号入力端子が入力する信号及びプルダウンノードの信号によって、前記出力端子にオフ信号を出力する第1プルダウンモジュールと、
信号入力端子が入力する信号が低レベルである時に、前記クロック信号入力端子が入力する信号によって、前記プルアップノードと前記出力端子にオフ信号を出力する第2プルダウンモジュールと、
前記クロック障害信号入力端子が入力する信号及び前記プルアップノードの信号によって、プルダウンノードの信号を制御することより、前記第1プルダウンモジュールを駆動するプルダウン駆動モジュールと、
前記リセット信号入力端子が入力する信号によって、前記プルアップノードと前記出力端子にオフ信号を出力するリセットモジュールと、を備え、
前記信号入力端子が入力する信号が高レベルであるときに、前記クロック障害信号入力端子が入力する信号も高レベルであり、前記クロック信号入力端子が入力する信号が前記クロック障害信号入力端子が入力する信号の位相とは逆であることを特徴とする駆動回路。 - 前記第2プルダウンモジュールは、第1薄膜トランジスタ、第2薄膜トランジスター、第3薄膜トランジスター及びコンデンサーとを備え、前記第1薄膜トランジスタのゲートが前記プルアップノードに接続され、前記第1薄膜トランジスタのドレインが前記コンデンサーの第1極板に接続され、前記第1薄膜トランジスタのソースがオフ信号入力端子に接続され、前記コンデンサーの第2極板が前記クロック信号入力端子に接続され、前記第2薄膜トランジスタのゲートが前記第3薄膜トランジスタのゲートに接続され、且つ接続点が前記コンデンサーの前記第1極板に接続され、前記第2薄膜トランジスタのドレインが前記プルアップノードに接続され、前記第2薄膜トランジスタのソースが前記オフ信号入力端子に接続され、前記第3薄膜トランジスタのドレインが前記出力端子に接続され、前記第3薄膜トランジスタのソースがオフ信号入力端子に接続されることを特徴とする請求項1に記載の駆動回路。
- 請求項1または2に記載の多段の駆動回路を備えるシフトレジスターであって、各段の駆動回路の信号入力端子が入力する信号は前段駆動回路出力端子が出力する信号であり、各段の駆動回路のリセット信号入力端子が入力する信号はは次段出力端子が出力する信号であるシフトレジスター。
- 各段の駆動回路は、
第1時間段に、前記信号入力端子は高レベルであり、クロック障害信号入力端子は高レベルであり、且つクロック信号入力端子は低レベルであり、前記出力端子は低レベルを出力し、
第2時間段に、前記信号入力端は低レベルであり、前記クロック障害信号入力端子は低レベルであり、且つクロック信号入力端子は高レベルであり、前記出力端子は高レベルを出力し、
第3時間段に、前記信号入力端子は低レベルであり、前記クロック障害信号入力端子は高レベルであり、クロック信号入力端子は低レベルであり、かつリセット信号入力端子は高レベルであり、前記出力端子は低レベルを出力し、
第4時間段に、信号入力端子は低レベルであり、クロック障害信号入力端子は低レベルであり、且つクロック信号入力端子は低レベルであり、前記出力端子は低レベルを出力し、
第5時間段に、信号入力端子は低レベルであり、クロック障害信号入力端子は高レベルであり、且つクロック信号入力端子は低レベルであり、前記出力端子は低レベルを出力し、
前記第1時間段の後、前記第2、第3、第4、第5時間段が順次に現れ、
前記第5時間段の後、第1時間段が再び現れるまでに第4時間段と第5時間段を繰り返すことを特徴とする請求項3に記載のシフトレジスター。 - 請求項3または4に記載のシフトレジスターを備えるゲート駆動器。
- 基板と、前記基板の表示領域に形成される能動アレイと、前記基板の一側に設けられる請求項5に記載のゲート駆動器と、を備えるアレイ基板。
- 請求項6に記載のアレイ基板を備える表示装置。
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