JP2012164870A - 固体撮像装置とその製造方法、及び電子機器 - Google Patents
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Abstract
【解決手段】2つ以上の半導体チップ部22、26が接合され、少なくとも第1の半導体チップ部22に画素アレイと多層配線層37が形成され、第2の半導体チップ部26にロジック回路と多層配線層59が形成される。両多層配線層37、59が向かい合って電気的に接続されて接合される。第1及び第2の半導体チップ部22、26の接合付近に、一方又は双方の接続される配線と同じ層の導電膜により形成された遮光層68が形成される。裏面照射型に構成される。
【選択図】図3
Description
また、本発明は、かかる固体撮像装置を備えたカメラなどに適用できる電子機器を提供するものである。
1.CMOS固体撮像装置の概略構成例
2.第1実施の形態(固体撮像装置の構成例とその製造方法例)
3.第2実施の形態(固体撮像装置の構成例とその製造方法例)
4.第3実施の形態(電子機器の構成例)
図1に、本発明の半導体装置に適用されるCMOS固体撮像装置の概略構成を示す。このCMOS固体撮像装置は、各実施の形態の固体撮像装置に適用される。本例の固体撮像装置1は、図1に示すように、半導体基板11例えばシリコン基板に複数の光電変換部を含む画素2が規則的に2次元アレイ状に配列された画素アレイ(いわゆる画素領域)3と、周辺回路部とを有して構成される。画素2は、光電変換部となる例えばフォトダイオードと、複数の画素トランジスタ(いわゆるMOSトランジスタ)を有して成る。複数の画素トランジスタは、例えば転送トランジスタ、リセットトランジスタ及び増幅トランジスタの3つのトランジスタで構成することができる。その他、選択トランジスタ追加して4つのトランジスタで構成することもできる。単位画素の等価回路は通常と同様であるので、詳細説明は省略する。画素2は、1つの単位画素として構成することができる。また、画素2は、共有画素構造とすることもできる。この画素共有構造は、複数のフォトダイオードと、複数の転送トランジスタと、共有する1つのフローティングディフージョンと、共有する1つずつの他の画素トランジスタとから構成される。すなわち、共有画素では、複数の単位画素を構成するフォトダイオード及び転送トランジスタが、他の1つずつの画素トランジスタを共有して構成される。
[固体撮像装置の構成例]
図3に、本発明に係る固体撮像装置、すなわち裏面照射型のCMOS固体撮像装置の第1実施の形態を示す。第1実施の形態に係る固体撮像装置31は、図2Bで示すと同様の、画素アレイ23と制御回路24が形成された第1の半導体チップ部22と、ロジック回路25が形成された第2の半導体チップ部26とが貼り合わされた積層半導体チップ32を有して構成される。第1の半導体チップ部22と第2の半導体チップ部26とは、後述する互いの多層配線層が向かい合うようにして、かつ接続配線が直接接合するように、貼りあわされる。
図8〜図16に、第1実施の形態に係る固体撮像装置31の製造方法例を示す。図8〜図10は、画素アレイを有する第1の半導体チップ部側の工程、図11〜図13は、ロジック回路を有する第2の半導体チップ部側の工程、図14〜図16は、接合以降の工程を示す。
すなわち、形成すべき遮光部84に対応する部分の開口84と、形成すべき接続配線58に対応する部分の開口85、ビア孔86を有するようにパターニングする。
第1の半導体チップ部22側の遮光部と、第2の半導体チップ部26側の遮光部は、種々の形状が考えられる。図19に、遮光層の変形例を示す。第1の半導体チップ部22側の遮光部88は、所要の幅W1を有し、所要の間隔t1を置いて配列した複数のストライプ状に形成される(図19A参照)。第2の半導体チップ部26側の遮光部89は、上記幅がW1より大きい所要の幅W2(>W1)を有し、上記間隔t1より小さい所要の間隔t2(<t1)を置いて配列した複数のストライプ状に形成される(図19B参照)。遮光部88のストライプ状部のピッチと遮光部89のストライプ部のピッチは同じとする。これらストライプ状の遮光部88と、ストライプ状の遮光部89を上面から見て一様に閉塞された状態で重ね合わせて遮光層68が形成される(図19C参照)。このような遮光像68を有する固体撮像装置においても、上述で説明したのと同様の効果を奏する。
[固体撮像装置の構成例]
図20に、本発明に係る固体撮像装置、すなわち裏面照射型のCMOS固体撮像装置の第2実施の形態を示す。第2実施の形態に係る固体撮像装置91は、遮光層92を第1の半導体チップ部22側に接続配線36と同層のメタルM5により形成して構成される。この遮光層92は、全面一様に形成される。全面一様の遮光層92の形成において、CMP(化学機械研磨)時のディッシングで凹みが発生しても、密着させる圧力を強くすることで、接合は可能である。
第2実施の形態に係る固体撮像装置91の製造方法は、第1実施の形態の遮光層のパターン形状を変えるだけで、第1実施の形態の製造方法に準じて製造することができる。
[電子機器の構成例]
上述の本発明に係る固体撮像装置は、例えばデジタルカメラやビデオカメラ等のカメラシステムや、撮像機能を有する携帯電話、あるいは撮像機能を備えた他の機器、などの電子機器に適用することができる。
上述の遮光層68、92は、半導体集積回路を有する2つの半導体チップ部を貼り合わせた半導体装置にも適用できる。例えば、図示しないが、第1ロジック回路を有する第1の半導体チップ部と、第2ロジック回路を有する第2の半導体チップ部とを貼り合わせて半導体装置を構成する。第1ロジック回路、第2ロジック回路は、それぞれ複数のMOSトランジスタで形成される。第1及び第2の半導体チップ部は、それぞれ多層配線層を有し、両多層配線層が向かい合うようにして接合される。この構成において、遮光層を第1、第2実施の形態で説明したように、多層配線層の配線と同じ層のメタルで形成し、メタル同士を直接接触させて、機械的、電気的に接合する。
Claims (9)
- 2つ以上の半導体チップ部が接合され、少なくとも第1の半導体チップ部に画素アレイと多層配線層が形成され、第2の半導体チップ部にロジック回路と多層配線層が形成され、前記多層配線層が向かい合って電気的に接続されて接合された積層半導体チップと、
第1及び第2の半導体チップ部の接合付近に、一方又は双方の接続される配線と同じ層の導電膜により形成された遮光層とを有し、
裏面照射型に構成されている
固体撮像装置。 - 前記遮光層が、第1の半導体チップ部側の前記導電膜と、前記第2の半導体チップ部側の前記導電膜とにより上面から見て一様に閉塞された状態で形成されている
請求項1記載の固体撮像装置。 - 第1又は第2の半導体チップ部側の前記導電膜が、複数の開口を有するパターンに形成され、
第2又は第1の半導体チップ部側の前記導電膜が、前記第1又は第2の半導体チップ部側の前記導電膜に一部重なるようにして前記複数の開口を覆うドット状パターンに形成されている
請求項2記載の固体撮像装置。 - 前記第1および第2の半導体チップ部の接合部では、互いの配線が直接接合されている
請求項1乃至3のいずれかに記載の固体撮像装置。 - 第1の半導体ウェハの第1の半導体チップ部となる領域に少なくとも画素アレイと多層配線層を形成する工程と、
第2の半導体ウェハの第2の半導体チップ部となる領域に少なくともロジック回路を形成する工程を有し、
前記第1の半導体ウェハ及び前記第2の半導体ウェハの一方又は双方の多層配線層には、接続される配線と同じ層の導電膜による遮光層を形成し、
さらに、前記第1の半導体ウェルと前記第2の半導体ウェルの互いの多層配線層が向かい合って双方の配線が電気的に接続されるように、少なくとも第1及び第2の半導体ウェハを含む2つ以上の半導体ウェハを接合する工程と、
前記第1の半導体ウェハを薄膜化する工程と、
前記接合した半導体ウェハをチップ化する工程と
を有する固体撮像装置の製造方法。 - 前記遮光層を、第1の半導体ウェハ側の前記導電膜と、前記第2の半導体ウェハ側の前記導電膜とにより上面から見て一様に閉塞された状態に形成する
請求項5記載の固体撮像装置の製造方法。 - 第1又は第2の半導体ウェハ側の前記導電膜を、複数の開口を有するパターンに形成し、
第2又は第1の半導体ウェハ側の前記導電膜を、前記第1又は第2の半導体ウェハ側の前記導電膜に一部重なるようにして前記複数の開口を覆うドット状パターンに形成する
請求項6記載の固体撮像装置の製造方法。 - 前記第1および第2の半導体ウェハの接合部では、互いの配線を直接接合する
請求項5乃至7のいずれかに記載の固体撮像装置の製造方法。 - 固体撮像装置と、
前記固体撮像装置の光電変換部に入射光を導く光学系と、
前記固体撮像装置の出力信号を処理する信号処理回路とを備え、
前記固体撮像装置は、請求項1乃至4のいずれかに記載の固体撮像装置で構成される
電子機器。
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