CN104732939A - 移位寄存器、栅极驱动电路、显示装置及栅极驱动方法 - Google Patents

移位寄存器、栅极驱动电路、显示装置及栅极驱动方法 Download PDF

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Abstract

本发明提供一种移位寄存器、栅极驱动电路、显示装置及栅极驱动方法，其可解决现有的移位寄存器限制了显示装置的边框宽度超窄设计的问题。本发明的移位寄存器，包括用于输出栅极驱动信号的栅极驱动信号生成单元，以及多个信号输出控制模块、信号输出复位模块及信号输出端；每个信号输出控制模块，均连接栅极驱动信号生成单元、对应的控制信号输入端以及对应的信号输出端，且在每个信号输出控制模块和与其对应的信号输出端之间连接一个信号输出复位模块；每个信号输出控制模块，用于在所输入的控制信号的控制下，将栅极驱动信号生成单元所输出的栅极驱动信号通过信号输出端输出；每个信号输出复位模块，用于将输出端的输出信号进行复位。

Description

移位寄存器、栅极驱动电路、显示装置及栅极驱动方法
技术领域
本发明属于显示技术领域，具体涉及一种移位寄存器、栅极驱动电路、显示装置及栅极驱动方法。
背景技术
TFT-LCD(Thin Film Transistor-Liquid Crystal Display，薄膜晶体管液晶显示装置)实现一帧画面显示的基本原理是通过栅极(gate)驱动从上到下依次对每一行像素输入一定宽度的方波进行选通，再通过源极(source)驱动每一行像素所需的信号依次从上往下输出。目前制造这样一种结构的显示器件通常是栅极驱动电路和源极驱动电路通过COF(Chip On Film，覆晶薄膜)或COG(Chip On Glass，芯片直接固定在玻璃上)工艺制作在玻璃面板上的，但是当分辨率较高时，栅极驱动电路和源极驱动电路的输出均较多，驱动电路的长度也将增大，这将不利于模组驱动电路的压焊(Bonding)工艺。
为了克服以上问题，现有显示器件的制造采用GOA(GateDrive On Array)电路的设计，相比现有的COF或COG工艺，其不仅节约了成本，而且可以做到面板两边对称的美观设计，同时也可省去栅极驱动电路的Bonding区域以及***布线空间，从而实现了显示装置窄边框的设计，提高了显示装置的产能和良率。但是现有的GOA电路的设计也存在着一定的问题，如图1所示，现有的GOA电路中的每个移位寄存器的薄膜晶体管(TFT)的个数较多(即M1-M6～M8-M11)，且每个移位寄存器只能用于驱动一行栅线，故占用空间较大，所以进一步减小GOA电路的占用空间，才可以实现真正意义上的窄边框设计。
发明内容
本发明所要解决的技术问题包括，针对现有的以栅极驱动电路存在的上述问题，提供一种可以实现窄边框设计的移位寄存器、栅极驱动电路、显示装置及栅极驱动方法。
解决本发明技术问题所采用的技术方案是提供一种移位寄存器，包括用于输出栅极驱动信号的栅极驱动信号生成单元，该移位寄存器还包括多个信号输出控制模块、信号输出复位模块及信号输出端；其中，
每个所述信号输出控制模块，均连接所述栅极驱动信号生成单元、对应的所述控制信号输入端以及对应的信号输出端，且在每个所述信号输出控制模块和与其对应的所述信号输出端之间连接一个所述信号输出复位模块；
每个所述信号输出控制模块，用于在与其连接的所述控制信号输入端所输入的控制信号的控制下，将所述栅极驱动信号生成单元所输出的栅极驱动信号通过所述信号输出端输出；
每个所述信号输出复位模块，用于将与其连接的所述信号输出端的输出信号进行复位。
优选的是，每个所述信号输出控制模块均包括一个开关晶体管，
所述开关晶体管的第一极连接所述栅极驱动信号生成单元，第二极连接与其对应的所述信号输出端和所述信号输出复位模块，控制极连接控制信号输入端。
优选的是，每个所述信号输出复位模块均包括一个第四晶体管；
所述第四晶体管的第一极连接在与其对应的所述信号输出控制模块和所述信号输出端之间，第二极连接低电压信号，控制极连接所述复位信号输入端。
优选的是，所述移位寄存器还包括：多个输出降噪模块；
每个所述输出降噪模块，连接与其对应的所述信号输出端、所述栅极驱动信号生成单元以及低电压信号，用于在所述栅极驱动信号生成单元的控制下，通过低电压信号降低与其连接的所述信号输出端的输出噪声。
进一步优选的是，每个输出降噪模块均包括一个第十一晶体管，
每个所述第十一晶体管的第一极连接在与其对应的所述信号输出控制模块和所述信号输出端之间，第二极连接低电压信号，控制极连接下拉节点。
优选的是，所述栅极驱动信号生成单元包括：输入模块、上拉模块、输入复位模块、下拉控制模块、下拉模块，以及输入降噪模块；其中，
所述输入模块，连接信号输入端、输入复位模块以及上拉控制节点，用于根据所述信号输入端输入的信号控制所述上拉控制节点的电位，所述上拉控制节点为所述输入模块与所述上拉模块的连接点；
所述上拉模块，连接所述上拉控制节点、第一时钟信号输入端以及各个信号输出控制模块，用于根据上拉控制节点的电位和第一时钟信号输入端所输入的第一时钟信号控制上拉信号输出端的输出；
所述输入复位模块，连接所述上拉控制节点、低电压信号以及复位信号输入端，用于在所述复位信号输入端输入的复位信号的控制下将所述上拉控制节点的电位下拉复位；
所述下拉控制模块，连接下拉节点和第二时钟信号输入端，用于根据所述第二时钟信号输入端所输入的第二时钟信号控制所述下拉节点的电位，所述下拉节点为下拉控制模块与下拉模块的连接点；
所述下拉模块，连接所述下拉节点、所述上拉控制节点以及低电压信号，用于在上拉控制节点的电位的控制下，通过低电压信号将下拉节点的电位进行下拉；
所述输入降噪模块，连接上拉控制节点、下拉节点以及低电压信号，用于在下拉节点的电位的控制下，通过低电压信号降低上拉控制节点的输出噪声。
进一步优选的是，所述输入模块包括第一晶体管；所述输入复位模块包括第二晶体管；所述上拉模块包括第三晶体管和存储电容；所述下拉控制模块包括第五晶体管和第九晶体管；所述下拉模块包括第六晶体管和第八晶体管；所述输入降噪模块包括第十晶体管；其中，
所述第一晶体管的第一极和控制极均连接所述信号输入端，第二极连接所述上拉控制节点；
所述第二晶体管的第一极连接所述上拉控制节点，第二极连接所述低电压信号，控制极连接所述复位信号输入端；
所述第三晶体管的第一极连接所述第一时钟信号输入端，第二极连接所述存储电容的第二端和各个所述信号输出控制模块，控制极连接所述上拉控制节点和所述存储电容的第一端；
所述第五晶体管的第一极连接所述第九晶体管的第一极和控制极，以及所述第二时钟信号输入端，第二极连接所述下拉节点，控制极连接所述第九晶体管的第二极；
所述第六晶体管的第一极连接所述下拉节点，第二极连接所述低电压信号，控制极连接所述第八晶体管的控制极和所述上拉控制节点，所述第八晶体管的第一极连接所述第五晶体管的控制极和所述第九晶体管的第二极，所述第八晶体管的第二极连接所述低电压信号；
所述第十晶体管的第一极连接所述上拉控制节点，第二极连接所述低电压信号，控制极连接所述下拉节点。
进一步优选的是，每个所述信号输出控制模块均包括一个开关晶体管；每个信号输出复位模块均包括一个第四晶体管，每个所述输出降噪模块均包括一个第十一晶体管；其中，
每个所述开关晶体管的第一极均连接存储电容的第二端，第二极分别连接对应的所述信号输出端，控制极分别连接对应的所述控制信号输入端；
每个所述第四晶体管的第一极分别连接在对应的所述信号输出端和所述开关晶体管的第二极之间，第二极均连接低电压信号，控制极均连接所述复位信号输入端。
每个所述第十一晶体管的第一极连接在与其对应的所述开关晶体管的第二极和所述信号输出端之间，第二极连接所述低电压信号，控制极连接所述下拉节点。
优选的是，移位寄存器包括两个所述信号输出控制模块和两个所述信号输出复位模块。
解决本发明技术问题所采用的技术方案是一种栅极驱动电路，其包括多个上述的移位寄存器，
每一级所述移位寄存器的栅极驱动信号生成单元所输出的信号作为该移位寄存器的下一级移位寄存器的信号输入端的输入信号；
每一级所述移位寄存器的每个信号输出端所输出的信号用于驱动一根栅线。
解决本发明技术问题所采用的技术方案是一种显示装置，其包括上述的栅极驱动电路。
解决本发明技术问题所采用的技术方案是一种栅极驱动方法，包括：
栅极驱动电路包括的多个级联的移位寄存器分别通过各自的栅极驱动信号生成单元输出栅极驱动信号；
当显示一幅图像时，每一个所述移位寄存器中的多个信号输出端通过与各自连接的所述信号输出控制模块分时输出所述栅极驱动信号，并通过各自连接的信号输出复位模块对所述信号输出端的输出信号进行复位。
本发明具有如下有益效果：
由于本发明的移位寄存器具有多个信号输出端，以及用于控制这多个信号输出端对信号进行输出的多个信号输出控制模块和多个信号输出复位模块，也就说本实施例中每个移位寄存器可以用于驱动多根栅线，因此将该移位寄存器应用于显示面板中可以实现超窄边框的设计。
附图说明
图1为现有的移位寄存器的电路原理图；
图2为本发明的实施例1的移位寄存器的一种示意图；
图3为本发明的实施例1的移位寄存器的一种优选方式的示意图；
图4为本发明的实施例1的移位寄存器的另一种优选方式的示意图；
图5为本发明的实施例1的移位寄存器的电路原理图；
图6为本发明的实施例1的移位寄存器的工作时序图。
具体实施方式
为使本领域技术人员更好地理解本发明的技术方案，下面结合附图和具体实施方式对本发明作进一步详细描述。
本发明实施例中的所采用的晶体管可以为薄膜晶体管或场效应管或其他特性的相同器件，由于采用的晶体管的源极和漏极是对称的，所以其源极、漏极是没有区别的。在本发明实施例中，为区分晶体管的源极和漏极，将其中一极称为第一极，另一极称为第二极，栅极称为控制极。此外按照晶体管的特性区分可以将晶体管分为N型和P型，以下实施例中是以N型晶体管进行说明的，当采用N型晶体管时，第一极为N型晶体管的源极，第二极为N型晶体管的漏极，栅极输入高电平时，源漏极导通，P型相反。可以想到的是采用P型晶体管实现是本领域技术人员可以在没有付出创造性劳动前提下轻易想到的，因此也是在本发明实施例的保护范围内的。
一种移位寄存器，包括用于输出栅极驱动信号的栅极驱动信号生成单元，以及多个信号输出控制模块和多个信号输出复位模块；其中，每个信号输出控制模块，均连接栅极驱动信号生成单元和与各自对应的控制信号输入端和与其对应的信号输出端，且在每个信号输出控制模块和与其对应的信号输出端之间连接一个信号输出复位模块；每个信号输出控制模块，用于在与其连接控制信号输入端所输入的控制信号的控制下，将栅极驱动信号生成单元所输出的栅极驱动信号通过相应信号输出端输出；每个信号输出复位模块，用于将与其连接的信号输出端的输出进行复位。
由于上述移位寄存器包括栅极驱动信号生成单元、多个信号输出控制模块和多个信号输出复位模块，且具有多个信号输出端，可以理解的是，每个信号输出端是为一根栅线提供栅极驱动信号的，因此该移位寄存器可以为多根栅线提供栅极驱动信号，故将该移位寄存器应用于显示面板中，可以实现窄边框的设计。上述移位寄存器的具体实现方式见下述实施例。
其中，每个所述信号输出控制模块均包括一个开关晶体管，所述开关晶体管的第一极连接所述栅极驱动信号生成单元，第二极连接与其对应的所述信号输出端和所述信号输出复位模块，控制极连接控制信号输入端。
也就是说，每一个信号输出控制模块仅包括一个开关晶体管，通过控制开关晶体管的开启与关断即可控制相应的信号输出端的是否输出栅极驱动信号，该信号输出控制模块结构简单，容易控制，成本较低。
其中，每个所述信号输出复位模块均包括一个第四晶体管；所述第四晶体管的第一极连接在与其对应的所述信号输出控制模块和所述信号输出端之间，第二极连接低电压信号，控制极连接所述复位信号输入端。
也就是说，每一个信号输出复位模块仅包括一个第四晶体管，通过对一个第四晶体管的控制，即可对信号输出端所输出的信号进行复位，该信号输出复位模块结构简单，容易控制，成本较低。
具体结合下述实施例对本发明的移位寄存器进行说明。
实施例1：
结合图3所示，本实施例提供一种移位寄存器，其中本实施例的栅极驱动信号生成单元包括：输入模块、上拉模块、输入复位模块，以及多个信号输出控制模块和多个信号输出复位模块。其中，输入模块，连接信号输入端INPUT、复位模块以及上拉控制节点PU，用于根据信号输入端INPUT输入的信号控制上拉控制节点PU的电位，上拉控制节点PU为输入模块与上拉模块的连接点；上拉模块，连接上拉控制节点PU、第一时钟信号输入端CLK以及各个信号输出控制模块，用于根据上拉控制节点PU的电位和第一时钟信号输入端CLK所输入的第一时钟信号的控制将信号输出端输出的栅极驱动信号进行上拉(也就是上拉为高电平)；每个信号输出控制模块，连接与对应的控制信号输入端Control(N)和信号输出端OUTPUT(N)(其中信号输出均用OUTPUT(N)表示)，且各信号输出控制模块均与上拉模块连接，每个信号输出控制模块用于在与其连接控制信号输入端Control(N)所输入的控制信号控制下，将上拉模块输出的栅极驱动信号通过与其连接的信号输出端OUTPUT(N)输出；输入复位模块，连接上拉控制节点PU、低电压信号VSS以及复位信号输入端RESET，用于根据复位信号输入端RESET输入的复位信号的控制下将上拉控制节点PU的电位下拉复位(也就是下拉为低电平)；每个信号输出复位模块，连接与其对应的信号输出端OUTPUT(N)、低电压信号VSS以及复位信号输入端RESET，用于根据复位信号输入端RESET输入的复位信号的控制下将信号输出端OUTPUT(N)的电位下拉复位(也就是下拉为低电平)。
由于本实施例的移位寄存器具有多个信号输出端，以及用于控制这多个信号输出端对信号进行输出的多个信号输出控制模块和多个信号输出复位模块，也就说本实施例中移位寄存器可以用于驱动多根栅线，因此将该移位寄存器应用于显示面板中可以实现超窄边框的设计。
优选地，如图4所示，本实施例移位寄存器还包括：下拉控制模块和下拉模块；下拉控制模块，连接下拉节点PD和第二时钟信号输入端CLKB，用于根据第二时钟信号输入端CLKB所输入的第二时钟信号控制下拉节点PD的电位，下拉节点PD为下拉控制模块与下拉模块的连接点；下拉模块，连接下拉节点PD、上拉控制节点PU以及低电压信号VSS，用于在上拉控制节点PU的电位的控制下开启，通过低电压信号VSS将下拉节点PD的电位下拉为低电平，以降低下拉节点PD的输出噪声。
进一步优选地，移位寄存器还包括：输入降噪模块和多个输出降噪模块；输入降噪模块，连接上拉控制节点PU、下拉节点PD以及低电压信号VSS，用于在下拉节点PD的电位的控制下开启，通过低电压信号VSS降低上拉控制节点PU的输出噪声；个输出降噪模块，连接与其对应的信号输出端OUTPUT(N)、下拉节点PD以及低电压信号VSS，用于在下拉节点PD的电位的控制下开启，通过低电压信号VSS降低与其连接的信号输出端OUTPUT(N)的输出噪声。
为了时序方便控制、布线简单、容易控制，本实施例中的移位寄存器包括两个信号输出控制模块和两个信号输出复位模块，也就说每一个移位寄存器用于驱动两根栅线。当然本实施例的移位寄存器也不局限于只包括两个信号输出控制模块和两个信号输出复位模块的结构，也可以是包括三个、四个或更多个信号输出控制模块和信号输出复位模块，以驱动多根栅线。
综上，本实施例的移位寄存器可以驱动多根栅线，因此可以采用个数较少的移位寄存单元以驱动显示面板上的栅线，从而可以实现显示装置超窄边框的设计。
作为本实施例的一种优选方式：如图5所示，输入模块包括第一晶体管M1；输入复位模块包括第二晶体管M2；上拉模块包括第三晶体管M3和存储电容；每个信号输出控制模块均包括一个开关晶体管M12/M13；每个信号输出复位模块均包括一个第四晶体管M4；下拉控制模块包括第五晶体管M5和第九晶体管M9；下拉模块包括第六晶体管M6和第八晶体管M8；输入降噪模块包括第十晶体管M10；每个输出降噪模块均包括一个第十一晶体管M11；该移位寄存器用于输出两个驱动信号，也就是包括两个信号输出控制模块。两个信号输出复位模块、两个输出降噪模块为例说明上述各器件的连接关系。
具体的，第一晶体管M1的第一极和控制极均连接信号输入端INPUT，第二极连接上拉控制节点PU；第二晶体管M2的第一极连接上拉控制节点PU，第二极连接低电压信号，控制极连接复位信号输入端RESET；第三晶体管M3的第一极连接第一时钟信号输入端CLK，第二极连接存储电容的第二端和开关晶体管M12和开关晶体管M13的第一极，控制极连接上拉控制节点PU和存储电容的第一端；两个开关晶体管，即开关晶体管M12和开关晶体管M13，这两个开关晶体管的第一极均连接第三晶体管M3的第二极，这两个开关晶体管的第二极分别连接与给自对应的信号输出端OUTPUT-1和信号输出端OUTPUT-2(即：开关晶体管M12的第二极连接信号输出端OUTPUT-1；开关晶体管M13的第二极连接信号输出端OUTPUT-2)，以及与各自对应的信号输出复位模块中的第四晶体管M4的第一极，这两个开关晶体管的控制极连接控制信号输入端Control-1和控制信号输入端Control-2(即：开关晶体管M12的控制极连接控制信号输入端Control-1；开关晶体管M13的控制极连接控制信号输入端Control-2)；两个信号输出复位模块中的第四晶体管M4的第一极连接在均与其对应的输出降噪模块中的第十一晶体管M11的第一极连接，每个第四晶体管M4第二极连接低电压信号，控制极连接复位信号输入端RESET；第五晶体管M5的第一极连接第九晶体管M9的第一极和控制极，以及第二时钟信号输入端CLKB，第五晶体管的第二极连接下拉节点PD，控制极连接第九晶体管M9的第二极；第六晶体管M6的第一极连接下拉节点PD，第二极连接低电压信号，控制极连接第八晶体管M8的控制极和上拉控制节点PU，第八晶体管M8的第一极连接第五晶体管M5的控制极和第九晶体管M9的第二极，第八晶体管M8的第二极连接低电压信号；第十晶体管M10的第一极连接上拉控制节点PU，第二极连接低电压信号，控制极连接下拉节点PD；两个输出降噪模块中的第十一晶体管M11的第一极均连接与其对应的信号输出控制模块中的开关晶体管M12和开关晶体管M13的第二极，第十一晶体管的第二极连接低电压信号，控制极连接下拉节点PD。
相应的，本实施例中还提供一种栅极驱动电路，该栅极驱动电路包括多个上述的移位寄存器，每一级移位寄存器的栅极驱动信号生成单元所输出的信号作为该移位寄存器的下一级移位寄存器的信号输入端INPUT的输入信号；每一级移位寄存器的每个信号输出端OUTPUT(N)所输出的信号用于驱动一行栅线。因此，本实施例中的栅极驱动电路的结构简单，易于实现，且应用于显示装置中可以实现超窄边框的设计。
相应的，本实施例中还提供了一种显示装置，其包括上述的栅极驱动电路。该显示装置可以为：手机、平板电脑、电视机、显示器、笔记本电脑、数码相框、导航仪等任何具有显示功能的产品或部件。
由于本实施例的显示装置包括上述的栅极驱动电路，故可以实现超窄边框设计。
当然，本实施例的显示装置中还可以包括其他常规结构，如显示驱动单元等。
相应的，本实施例还提供了一种栅极驱动方法，其包括：
栅极驱动电路包括的多个级联的移位寄存器分别通过各自的栅极驱动信号生成单元输出栅极驱动信号；
当显示一幅图像时，每一个所述移位寄存器中的多个信号输出端通过与各自连接的所述信号输出控制模块分时输出所述栅极驱动信号，并通过各自连接的信号输出复位模块对所述信号输出端的输出信号进行复位。
具体的，根据如图6所示的时序图，对栅极驱动电路中的移位寄存的工作原理进行说明。
首先，需要说明的是，在通过本实施例的移位寄存器进行一幅画面的显示时，由于该移位寄存器具有两个输出，因此一个移位寄存器可以对两根栅线输入扫描信号，其中，与通过第一个控制信号输入端Control-1控制的信号输出控制模块在显示第一帧画面时进行输出，此时将该帧画面定义为奇数帧；与通过第二个控制信号输入端Control-2控制的信号输出控制模块在显示第二帧画面时进行输出，此时将该帧画面定义为偶数帧。也就是说，该幅画面是由两帧画面组成的，且该移位寄存器的两个输出用于不同帧的显示。具体的如下：
奇数帧显示时，即移位寄存器的第一个信号输出端OUTPUT-1输出信号。
在第一时刻(初始化阶段)，信号输入端INPUT(或帧选通信号STV)输入高电平信号，此时，第一晶体管M1被打开，上拉控制节点PU被充电。
在第二时刻，第一时钟信号输入端CLK输入高电平信号，第一个控制线号输入端输入高电平信号，因此通过该控制信号输入端Control-1控制的开关晶体管M12被打开，由于上拉控制节点PU在第一时刻时被充电，故处于高电平，此时第三晶体管M3被打开，信号输出端OUTPUT-1输出高电平信号，同时由于存储电容的自举作用，第一控制节点的电位被进一步的拉高，第六晶体管M6和第八晶体管M8被打开，下拉节点PD被下拉为低电平，以避免第二信号输入端INPUT所输入的信号干扰信号输出端OUTPUT-1输出的信号。
在第三时刻，第一时钟信号端口所输入的信号从高电平变为低电平，第二时钟信号输入端CLKB和复位信号输入端RESET所输入的信号为高电平信号，此时第九晶体管M9被打开，下拉控制节点PD-CN为该电平，故第五晶体管M5被打开，从而使得下拉节点PD被上拉为高电平；此时，第二晶体管M2和第四晶体管M4被打开，故上拉控制节点PU的电位被拉低为低电平和第一个信号输出端OUTPUT-1所输出的电位也被拉为低电平，也就是对上拉控制节点PU和信号输出端OUTPUT-1进行复位。
在第四时刻，第一时钟信号输入端CLK输入高电平信号，第二时钟信号输入端CLKB输入低电压信号，此时下拉节点PD的电位维持上一阶段的电位保持高电平，故上拉控制节点PU的电位此时仍为低电平，同时，第十晶体管M10和第十一晶体管M11，以对上拉控制节点PU和信号输出端OUTPUT-1输出的信号进行降噪，防止误输出。因此第一个信号输出端OUTPUT-1保持输出低电平，直到下一个奇数帧时刻的到来。
同理，奇数帧显示完成后，开始偶数帧的显示，其显示原理与奇数帧相同，只不过此时是与第二个信号输出端OUTPUT-2对应的信号输出控制模块以及输出复位控制模块进行工作，因此在此不详细描述。
需要说明的是，在本实施例中也可以具有多个信号输出端OUTPUT(N)，多个信号输出端OUTPUT(N)均用于在同一图像的不同帧画面的显示中。工作原理与上述相同，在此不详细描述。
可以理解的是，以上实施方式仅仅是为了说明本发明的原理而采用的示例性实施方式，然而本发明并不局限于此。对于本领域内的普通技术人员而言，在不脱离本发明的精神和实质的情况下，可以做出各种变型和改进，这些变型和改进也视为本发明的保护范围。

Claims (12)

1.一种移位寄存器，包括用于输出栅极驱动信号的栅极驱动信号生成单元，其特征在于，所述移位寄存器还包括多个信号输出控制模块、信号输出复位模块及信号输出端；其中，
每个所述信号输出控制模块，均连接所述栅极驱动信号生成单元、对应的所述控制信号输入端以及对应的信号输出端，且在每个所述信号输出控制模块和与其对应的所述信号输出端之间连接一个所述信号输出复位模块；
每个所述信号输出控制模块，用于在与其连接的所述控制信号输入端所输入的控制信号的控制下，将所述栅极驱动信号生成单元所输出的栅极驱动信号通过所述信号输出端输出；
每个所述信号输出复位模块，用于将与其连接的所述信号输出端的输出信号进行复位。
2.根据权利要求1所述的移位寄存器，其特征在于，每个所述信号输出控制模块均包括一个开关晶体管，
所述开关晶体管的第一极连接所述栅极驱动信号生成单元，第二极连接与其对应的所述信号输出端和所述信号输出复位模块，控制极连接控制信号输入端。
3.根据权利要求1所述的移位寄存器，其特征在于，每个所述信号输出复位模块均包括一个第四晶体管；
所述第四晶体管的第一极连接在与其对应的所述信号输出控制模块和所述信号输出端之间，第二极连接低电压信号，控制极连接所述复位信号输入端。
4.根据权利要求1所述的移位寄存器，其特征在于，所述移位寄存器还包括：多个输出降噪模块；
每个所述输出降噪模块，连接与其对应的所述信号输出端、所述栅极驱动信号生成单元以及低电压信号，用于在所述栅极驱动信号生成单元的控制下，通过低电压信号降低与其连接的所述信号输出端的输出噪声。
5.根据权利要求4所述的移位寄存器，其特征在于，每个输出降噪模块均包括一个第十一晶体管，
每个所述第十一晶体管的第一极连接在与其对应的所述信号输出控制模块和所述信号输出端之间，第二极连接低电压信号，控制极连接下拉节点。
6.根据权利要求1-5中任意一项所述的移位寄存器，其特征在于，所述栅极驱动信号生成单元包括：输入模块、上拉模块、输入复位模块、下拉控制模块、下拉模块，以及输入降噪模块；其中，
所述输入模块，连接信号输入端、输入复位模块以及上拉控制节点，用于根据所述信号输入端输入的信号控制所述上拉控制节点的电位，所述上拉控制节点为所述输入模块与所述上拉模块的连接点；
所述上拉模块，连接所述上拉控制节点、第一时钟信号输入端以及各个信号输出控制模块，用于根据上拉控制节点的电位和第一时钟信号输入端所输入的第一时钟信号控制上拉信号输出端的输出；
所述输入复位模块，连接所述上拉控制节点、低电压信号以及复位信号输入端，用于在所述复位信号输入端输入的复位信号的控制下将所述上拉控制节点的电位下拉复位；
所述下拉控制模块，连接下拉节点和第二时钟信号输入端，用于根据所述第二时钟信号输入端所输入的第二时钟信号控制所述下拉节点的电位，所述下拉节点为所述下拉控制模块与所述下拉模块的连接点；
所述下拉模块，连接所述下拉节点、所述上拉控制节点以及低电压信号，用于所述在上拉控制节点的电位的控制下，通过所述低电压信号将所述下拉节点的电位进行下拉；
所述输入降噪模块，连接所述上拉控制节点、所述下拉节点以及所述低电压信号，用于在所述下拉节点的电位的控制下，通过所述低电压信号降低所述上拉控制节点的输出噪声。
7.根据权利要求6所述的移位寄存器，其特征在于，所述输入模块包括第一晶体管；所述输入复位模块包括第二晶体管；所述上拉模块包括第三晶体管和存储电容；所述下拉控制模块包括第五晶体管和第九晶体管；所述下拉模块包括第六晶体管和第八晶体管；所述输入降噪模块包括第十晶体管；其中，
所述第一晶体管的第一极和控制极均连接所述信号输入端，第二极连接所述上拉控制节点；
所述第二晶体管的第一极连接所述上拉控制节点，第二极连接所述低电压信号，控制极连接所述复位信号输入端；
所述第三晶体管的第一极连接所述第一时钟信号输入端，第二极连接所述存储电容的第二端和各个所述信号输出控制模块，控制极连接所述上拉控制节点和所述存储电容的第一端；
所述第五晶体管的第一极连接所述第九晶体管的第一极和控制极，以及所述第二时钟信号输入端，第二极连接所述下拉节点，控制极连接所述第九晶体管的第二极；
所述第六晶体管的第一极连接所述下拉节点，第二极连接所述低电压信号，控制极连接所述第八晶体管的控制极和所述上拉控制节点，所述第八晶体管的第一极连接所述第五晶体管的控制极和所述第九晶体管的第二极，所述第八晶体管的第二极连接所述低电压信号；
所述第十晶体管的第一极连接所述上拉控制节点，第二极连接所述低电压信号，控制极连接所述下拉节点。
8.根据权利要求7所述的移位寄存器，其特征在于，每个所述信号输出控制模块均包括一个开关晶体管；每个信号输出复位模块均包括一个第四晶体管，每个所述输出降噪模块均包括一个第十一晶体管；其中，
每个所述开关晶体管的第一极均连接存储电容的第二端，第二极分别连接对应的所述信号输出端，控制极分别连接对应的所述控制信号输入端；
每个所述第四晶体管的第一极分别连接在对应的所述信号输出端和所述开关晶体管的第二极之间，第二极均连接低电压信号，控制极均连接所述复位信号输入端。
每个所述第十一晶体管的第一极连接在与其对应的所述开关晶体管的第二极和所述信号输出端之间，第二极连接所述低电压信号，控制极连接所述下拉节点。
9.根据权利要求1所述的移位寄存器，其特征在于，所述移位寄存器包括两个所述信号输出控制模块和两个所述信号输出复位模块。
10.一种栅极驱动电路，其特征在于，所述栅极驱动电路包括多级权利要求1至9中任意一项的所述移位寄存器，
每一级所述移位寄存器的栅极驱动信号生成单元所输出的信号作为该移位寄存器的下一级移位寄存器的信号输入端的输入信号；
每一级所述移位寄存器的每个信号输出端所输出的信号用于驱动一根栅线。
11.一种显示装置，其特征在于，显示装置包括权利要求10的所述的栅极驱动电路。
12.一种栅极驱动方法，其特征在于，包括：
栅极驱动电路包括的多个级联的移位寄存器分别通过各自的栅极驱动信号生成单元输出栅极驱动信号；
当显示一幅图像时，每一个所述移位寄存器中的多个信号输出端通过与各自连接的所述信号输出控制模块分时输出所述栅极驱动信号，并通过各自连接的信号输出复位模块对所述信号输出端的输出信号进行复位。
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