KR910010506A - 반도체 장치 - Google Patents
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Abstract
내용 없음.
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명의 1실시예에 관한 반도체장치의 블럭도.
제2도, 제3도는 제1도 구성의 동작을 설명하는 타이미차트.
Claims (2)
- 선택된 메모리셀로부터 데이터가 입력되는 데이터선과, 이퀄라이즈신호의 인가에 의해, 상기 데이터선을 이퀄라이즈하는 이퀄라이즈수단(Tr0), 상기 데이터선의 데이터에 따른 신호를 외부로 출력하는 출력수단(Tr1, Tr2), 이 출력수단(Tr1, Tr2)과 상기 이퀄라이즈수단(Tr0)사이에 설치되면서, 상기 데이터를 보존하는 래치수단(L1, L2), 상기 래치수단(L1, L2)과 상기 이퀄라이즈수단(Tr0) 사이에 설치되면서, 상기 데이터선의 전위를 그대로 출력하는 로우임피던스상태와, 상기 데이터선의 전위변화가 출력측에 전달되지 않도록 하는 하이임피던스상태를 얻는 출력버퍼수단(B1, B2), 상기 이퀄라이즈수단(Tr0)에 상기 이퀄라이즈신호가 인가되는 경우 그 인가에 선행해서 상기 출력버퍼수단(B1, B2)을 하이임피던스상태로 하고, 상기 이퀄라이즈신호가 OFF되는 경우에는 그 OFF이후에 상기 출력버퍼수단(B1, B2)을 로우임피던스상태로 돌아가도록 제어 신호를 발생시키는 제어수단(BC)을 구비하여 구성된 것을 특징으로 하는 반도체장치.
- 제1항에 있어서, 상기 데이터선은 상기 메모리셀로부터 출력되는 상보적인 한쌍의 데이터가 공급되는 한쌍의 상보적인 데이터선을 구비하여 구성된 것을 특징으로 하는 반도체장치.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
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