KR101283405B1 - 석영 지그 및 반도체 제조장치 - Google Patents
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Abstract
본 발명의 석영 지그는, 반도체 웨이퍼의 주표면상에 에피택셜층을 성장시키는 반도체 제조장치의 내부에 구비되고, 에피택셜 성장 시에, 반도체 웨이퍼를 재치하는 서셉터의 온도를 균일하게 유지하고, 이 서셉터의 상면과 대략 동일 평면 상에 상면이 위치하는 균열 지그를 지지하기 위한 석영 지그로서, 적어도 당해 균열 지그와 접촉하는 부분이 투명 석영으로 구성되어서 이루어지는 것을 특징으로 한다. 이것에 의해, 반도체 제조장치 내에서, 파티클의 발생을 억제하는 것이 가능한, 균열 지그를 지지하기 위한 석영 지그, 및 그것을 구비하는 반도체 제조장치를 제공한다.
반도체 웨이퍼, 에피택셜층, 반도체 제조장치, 서셉터, 균열 지그, 석영 지그, 불투명 석영, 핵부, 투명 석영, 표층부, 반송경로, 가스 공급구
Description
본 발명은, 반도체 웨이퍼의 주표면상에 에피택셜층을 성장시키는 반도체 제조장치의 내부에 구비되고, 에피택셜 성장 시에, 반도체 웨이퍼를 재치하는 서셉터의 온도를 균일하게 유지하고, 이 서셉터의 상면과 대략 동일평면 상에 상면이 위치하는 균열(均熱) 지그를 지지하기 위한 석영 지그, 및 그것을 구비하는 반도체장치에 관한 것이다.
실리콘 에피택셜 웨이퍼나 반도체 디바이스를 제조하는 반도체 제조장치로서는, 예를 들면, 석영 챔버 내에 넣어진 실리콘 단결정 웨이퍼를 챔버 외부의 램프나 히터로부터 방사된 복사열에 의해 가열함과 동시에, 챔버 내에 트리클로로실란 등의 실리콘소스 가스나 도판트 가스를 포함한 수소 가스를 주성분으로 하는 원료 가스를 흘려보냄으로써 웨이퍼 표면에 원하는 에피택셜층을 성장시키는 CVD장치가 종래부터 사용되고 있다.
반도체 제조장치(CVD장치(11))를 사용하여 실리콘 단결정 웨이퍼의 주표면에 박막을 성장시키는 수순을 도 1을 참조하여 설명한다. 우선, 탄화규소 등으로 이루어지는 서셉터(1)가 재치된 서셉터 지지 지그(10)를 하강시킨다. 이 때, CVD장 치(11)는 웨이퍼의 투입 온도, 즉 650℃로 설정되어 있다. 실리콘 단결정 웨이퍼(2)는, 도시하지 않은 반송장치에 의해 지면에 수직한 방향에서 CVD장치(11) 내로 반입되고, 서셉터(1)의 상면에 형성된 스폿페이싱부 내에 재치된다. 도시하지 않은 반입출구가 밀폐된 후, 서셉터(1)의 상면이 이 서셉터(1)의 주위를 둘러싸는 균열(均熱) 지그(3)의 상면과 대략 동일평면 상에 위치할 때까지 서셉터 지지 지그(10)는 상승한다.
서셉터(1)가 당해 위치까지 상승하면, 석영 챔버(6)의 외부에 배치되어 있는 가열장치(9)에 의해, 석영 챔버(6)의 내부는 수백℃∼1200℃ 정도, 예를 들면 1100℃∼1180℃까지 가열된다. 가열장치(9)로부터 방출되는 복사광에는 파장이 약 2∼3㎛의 적외광이 포함되어 있는데, 이 파장의 광은 석영 챔버(6)의 상하면을 구성하는 투명 석영제의 챔버 천판(6a), 챔버 바닥판(6b)에는 흡수되지 않고 투과하므로, 이 챔버(6)를 가열하지 않고 실리콘 단결정 웨이퍼(2)나 서셉터(1)에 도달하고, 그것들에 흡수됨으로써 웨이퍼나 서셉터는 가열된다. 또한, 가열장치(9)로서는, 예를 들면, 할로겐램프나 히터, 적외선 램프 등이 사용된다. 또, CVD장치(11) 내는, 이 때 수소 가스 분위기이며, 이 수소 가스에 의해 실리콘 단결정 웨이퍼의 주표면에 존재하는 자연산화막이 에칭되어 제거된다.
이 CVD장치(11)에서는, 서셉터(1)를 둘러싸는 균열 지그(3)가 배치되어 있다. 균열 지그(3)의 재질은, 탄화규소, 또는 탄소, 또는 탄소기재에 탄화규소를 코팅한 재료중 어느 하나로 이루어지고, 서셉터(1)와 대략 동일한 재질이다. 그 때문에, 가열장치(9)로부터의 복사 광에 의해 서셉터(1)와 동일한 정도의 온도까지 가열된다. 이러한 균열 지그(3)가 없는 경우, 가열된 서셉터(1)의 외주부로부터 방열이 일어나, 서셉터(1)의 외주부에 온도저하가 발생하여 서셉터(1) 내부의 온도차가 커지는데, 서셉터(1)와 대략 동일한 온도까지 가열되는 균열 지그(3)가 서셉터(1)를 둘러쌈으로써, 서셉터(1)의 외주부로부터의 방열이 억제되어, 서셉터(1) 내부의 온도차가 작아져, 웨이퍼(2) 전체를 균일한 온도로 유지하는 것이 용이하게 된다.
이 균열 지그(3)는 석영 지그(4)에 의해 지지된다. 이 때 균열 지그(3)의 열이 석영 지그(4)에 전도되어 방산하는 것을 막기 위해서, 재질로서는 불투명 석영이 사용된다. 석영 지그(4)의 재질이 불투명 석영이면, 열전도도가 낮아, 방열 시에, 균열 지그(3)로부터 방출되는 적외선을 반사하기 때문에, 균열 지그(3)로부터의 방열을 적합하게 막을 수 있다.
상기한 바와 같은 서셉터(1), 균열 지그(3)를 사용하여 서셉터(1) 상의 실리콘 단결정 웨이퍼(2)를 가열하고, CVD장치 내의 온도가 성장온도(예를 들면 1060℃∼1150℃ 정도)가 되면, 성장 가스 공급구(7)로부터 전술한 바와 같은 원료가스를 석영 챔버(6) 내에 공급한다. 그리고, 원료가스 중의 실리콘소스 가스나 도판트 가스는 열에 의해 분해되어, 가스 중의 실리콘 원자나, 보론이나 인 등의 불순물 원자가 실리콘 단결정 웨이퍼(2)의 주표면의 실리콘과 결합하여 실리콘 에피택셜층이 성장한다.
실리콘 에피택셜층의 성장이 종료되면, 가열장치(9)에 의한 가열을 정지하고, CVD장치 내를, 취출 온도(예를 들면 투입 온도와 동일한 650℃ 정도)까지 강온 한다. 그리고, 서셉터(1)는 실리콘 에피택셜 웨이퍼(2)와 함께 서셉터 지지 지그(10)에 의해 하강된다. 그 후, 실리콘 에피택셜 웨이퍼(2)는 도시하지 않은 반송장치에 의해 서셉터(2) 상에서 CVD장치(11) 밖으로 반출된다. 이상과 같은 각 공정을 반복함으로써, 복수의 실리콘 에피택셜 웨이퍼를 제조할 수 있다.
그런데, 상기와 같은 에피택셜 성장 시에는, CVD장치(11)의 내부에 설치되어 있는 지그 등의 표면에 실리콘 부생성물이 성장한다. 성장한 실리콘 부생성물은, 가열·냉각 등에 의한 지그의 팽창·수축에 의해 지그 표면으로부터 박리되어 파티클이 된다. 이 파티클이 웨이퍼의 주표면에 부착되면, 에피택셜층의 결정 결함을 유기(誘起)한다. 이 결정 결함은 반도체 소자의 양품 수율저하 및 전기 특성에 영향을 미치는 것이 판명되어 있기 때문에, 가능한 한 결정 결함을 적게 하는 것이 요구되고 있다.
또, 석영 챔버(6)의 내벽에 실리콘 부생성물이 성장한 경우에는, 석영 챔버(6)의 열전도도를 변화시켜버려, 원하는 처리조건이 얻어지지 않게 될 가능성이 나오기 때문에, 실리콘 부생성물은 정기적으로 제거할 필요가 있다. 이 때문에, 상기와 같은 실리콘 에피택셜 웨이퍼의 제조공정을 1회 이상(예를 들면 5회) 행하면, 석영 챔버(6)의 내부에, 가스 공급구(7)로부터 정기적으로 염산가스 등의 에칭가스를 도입하여, 실리콘 부생성물을 제거하는 방법이 행해지고 있다. 이때, 에칭가스는 실리콘 부생성물 뿐만 아니라, 석영 챔버(6) 내의 각 부재, 예를 들면 균열 지그(3)나 석영 지그(4), 챔버 천판(6a), 챔버 측벽(6c) 등도 에칭해버리기 때문에, 장기간의 사용에 의해 이들 각 부재는 열화되어 간다. 특히, 석영 지그(4)나 챔버 측벽(6c) 등의 불투명 석영제의 부재는, 내부에 갖는 미세한 기포 때문에, 밀도가 작아, 에칭에 의한 열화가 진행되기 쉽다. 그리고, 열화에 의해 기포가 노출되면, 기포 간의 석영이 에칭에 의해 대량으로 탈리하여 파티클 오염의 원인이 되어버린다. 또한, 소정의 기간 또는 소정 매수의 실리콘 에피택셜 웨이퍼를 제조한 후에 석영 챔버(6), 및 그 내부의 지그를 해체하고, 산성용액(예를 들면 불산과 질산의 혼합수용액 등)으로 세정을 행하여, 실리콘 부생성물의 제거를 행하는 일도 있지만, 이 경우도 같은 문제가 발생한다.
일본 특개평7-86178호 공보에 의하면, CVD장치 내의 지그의 하나인 원료공급 노즐에 부착되는 실리콘 부생성물의 성장을 방지하기 위해서, 원료가스 공급 노즐의 노즐 기부를 불투명 석영으로, 노즐 선단부를 투명 석영으로 구성하는 것을 제안하고 있다. 그러나, 이 구성에서는, 불투명 석영으로 이루어지는 노즐 기부가 에칭가스에 폭로되기 때문에, 실리콘 부생성물의 에칭은 할 수 있어도 노즐 기부의 열화를 방지하는 것은 할 수는 없다는 문제가 있다.
일본 특개평8-102447호 공보에 의하면, CVD장치 등에서 사용되는 석영 지그로서, 웨이퍼와의 접촉부에 샌드 블라스트 처리를 시행한 투명 석영을 사용함으로써, 부생성물의 박리에 의한 파티클의 발생을 방지한다고 하는 방법이 제안되어 있다. 그러나, 샌드 블라스트 처리에서는 석영분말을 석영 지그에 세게 불어대기 때문에, 석영분말이 석영 지그에 부착될 가능성이 있다. 이렇게 부착된 석영분말은 CVD장치 내부에서의 가열·냉각에 의한 석영 지그의 팽창·수축 때문에, 석영 지그로부터 박리되어, 새로운 파티클 오염의 원인이 될 우려가 있다.
일본 특개평10-256161호 공보에 의하면, CVD장치의 석영제 지그의 표면을 열처리함으로써 이 표면의 개질을 행하여, 표면열화를 방지하는 방법이 제안되어 있다. 그러나, 이러한 표면개질법에서는, 지그의 극표층이 투명화되는 것에 지나지 않기 때문에, 수소 가스나 에칭가스에 의해 표면이 침식된 경우, 개질되지 않은 불투명 석영부분이 노출되게 되어, 열화가 촉진된다고 하는 문제가 있다. 또, 표면에 성장한 부생성물이 박리할 때에 지그의 극표층의 석영을 함께 박리시켜버려, 열화를 빠르게 한다고 하는 문제도 있다.
일본 특개2001-102319호 공보에서는, 뱃치식 열처리장치에서의 보온체에, 표면에 기포가 없는 평활한 석영판을 사용함으로써, 보온체 표면에의 불순물의 부착을 방지하고 있다. 그러나, 이 석영판은 2장의 얇은 석영판의 일방의 면에 금속막을 형성하고, 이 2장의 석영판의 금속막이 형성된 면끼리를 접촉시켜, 버너 등으로 용착함으로써 제조할 필요가 있어, 대단히 번잡한 공정을 거치지 않으면 안되며, 금속막을 형성하는 증착기와 같은 장치를 준비할 필요가 있다.
본 발명은, 상기의 문제점을 감안하여 이루어진 것으로, 반도체 제조장치 내에서, 파티클의 발생을 억제하는 것이 가능한, 균열 지그를 지지하기 위한 석영 지그, 및 그것을 구비하는 반도체 제조장치를 제공하는 것을 목적으로 한다.
본 발명자들이 예의 조사를 거듭한 결과, 반도체 제조장치 내에서 발생하는 파티클은, 석영 지그의 표면에 성장한 실리콘 부생성물이 박리한 것과, 석영 지그의 열화에 의해 석영자체가 탈리한 것을 발견했다. 즉, 반도체 제조장치에 의한 에피택셜 성장과정에서, 장치 내의 지그 표면에 실리콘 부생성물이 성장하고, 이러 한 실리콘 부생성물이 가열·강온에 의한 지그의 팽창·수축에 의해 박리하여 파티클로 되는 경우와, 이러한 실리콘 부생성물과 함께, 내부에 미소하고 또한 고밀도의 기포를 갖는 불투명 석영제의 지그로부터 미세한 석영이 탈리하여 파티클이 되는 경우가 있다. 또, 실리콘 부생성물을 제거하기 위해서 에칭가스를 반도체 제조장치 내에 도입하는 조작을 반복하면, 내부에 미소하고 또한 고밀도의 기포를 갖는 불투명 석영제의 지그는 급속한 열화를 일으키기 쉬워, 석영의 탈리가 더욱 증가되게 된다.
그래서, 반도체 제조장치 내의 석영 지그 중, 균열 지그와 접하기 때문에 고온으로 되기 쉽고, 실리콘 부생성물이 가장 성장하기 쉬운 석영 지그에 착목하여, 다음 발명을 하기에 이르렀다.
즉, 본 발명의 석영 지그는, 반도체 웨이퍼의 주표면 상에 에피택셜층을 성장시키는 반도체 제조장치의 내부에 구비되고, 에피택셜 성장 시에, 반도체 웨이퍼를 재치하는 서셉터의 온도를 균일하게 유지하고, 이 서셉터의 상면과 대략 동일평면 상에 상면이 위치하는 균열 지그를 지지하기 위한 석영 지그로서, 적어도 당해 균열 지그와 접촉하는 부분이 투명 석영으로 구성되어서 이루어지는 것을 특징으로 한다.
이러한 석영 지그에서는, 실리콘 부생성물이 가장 성장하기 쉬운 부분인 균열 지그와의 접촉부분이 투명 석영으로 되어 있다. 투명 석영은 불투명 석영과 비교하여 치밀하고, 내부에 기포가 거의 존재하지 않으므로, 실리콘 부생성물과 함께 지그 표면의 석영이 박리될 가능성이나, 실리콘 부생성물을 제거하기 위한 에칭가스에 폭로되어 기포 간의 미소한 석영이 파티클이 되어 발진할 가능성을 대폭 억제할 수 있다.
다음에 본 발명의 석영 지그는 불투명 석영으로 구성되는 핵부와, 투명 석영으로 구성되고, 또한 당해 핵부를 그 표면이 노출되지 않도록 피복하는 표층부를 갖는 것이 바람직하다. 이러한 구성으로 함으로써, 투명 석영(표층부)에 의해 석영 지그의 모든 표면에 걸쳐 상기의 효과가 얻어지는 것과 더불어, 균열 지그로부터 적외선 등에 의한 방열이 있어도, 투명 석영(표층부)의 하층에 있는 불투명 석영(핵부)이 적외선 등을 반사하므로, 균열 지그의 온도를 원하는 온도로 유지하기 쉬워진다.
다음에 본 발명의 석영 지그는 상기 반도체 제조장치의 내부에 반출입되는 반도체 웨이퍼의 반송경로 상에 해당되는 부분이 잘려진 형상으로 할 수 있다. 이렇게 구성함으로써 웨이퍼의 반입·반출 시에 있어서, 웨이퍼가 통과하는 반송경로의 상부에 석영 지그가 존재하지 않기 때문에, 가령 석영 지그 표면에 성장한 실리콘 부생성물이 박리해도, 파티클로 되어서 웨이퍼의 주표면에 부착되는 것을 억제할 수 있다.
또, 상기 반도체 제조장치의 내부에 성장 가스를 도입하기 위한 가스 공급구의 근방에 해당되는 부분이 잘려진 형상으로 할 수도 있다. 이와 같이, 에피택셜 성장 시에 실리콘 부생성물이 성장하기 쉬운 부분인 가스 공급구의 근방에 석영 지그가 존재하지 않도록 하면, 실리콘 부생성물이 석영 지그의 표면에 성장하는 것을 효과적으로 억제할 수 있다.
이상의 석영 지그를 구비하는 반도체 제조장치에 의하면, 상기한 바와 같이, 균열 지그를 지지하는 석영 지그의 표면에 투명 석영을 사용하고 있기 때문에, 실리콘 부생성물이 박리할 때, 지그 표면의 석영이 함께 탈리하는 것을 억제할 수 있다. 또, 에칭가스에 석영 지그가 폭로되어서 에칭되어도 미소한 석영이 탈리하여, 파티클로 되어서 웨이퍼를 오염시키는 것을 억제할 수 있다. 또한, 석영 지그를 상기한 바와 같은 잘라낸 형상으로 함으로써 가령 실리콘 부생성물이 석영 지그로부터 박리되어도, 웨이퍼 표면에 부착되어 웨이퍼를 오염시키는 것을 억제할 수 있다.
도 1은 본 발명의 반도체 성장 장치의 개략 단면도이다.
도 2는 본 발명의 석영 지그의 구조를 도시하는 개략 단면도이다.
도 3은 본 발명의 석영 지그의 다른 1예의 구조를 도시하는 개략 단면도이다.
도 4는 본 발명의 석영 지그의 다른 1예의 개략 정면도이다.
도 5는 본 발명의 석영 지그의 다른 1예의 개략 정면도이다.
도 6은 종래의 석영 지그의 구조를 도시하는 개략 단면도이다.
도 7은 서셉터, 웨이퍼, 균열 지그, 석영 지그의 배치를 도시하는 개략 정면도이다.
도 8은 실시예 1∼4와 비교예의 파티클수를 비교한 그래프이다.
(발명을 실시하기 위한 최량의 형태)
이하, 본 발명의 실시형태를 도면을 참조하여 설명한다.
도 1에 도시하는 바와 같이 반도체 제조장치(11)의 내부에는, 서셉터(1), 균열(均熱) 지그(3), 석영 지그(4), 석영 챔버(6), 가스 공급구(7), 가스 배출구(8), 서셉터 지지 지그(10) 등의 부품이나 지그가 편입되어 있다. 이러한 반도체 제조장치(11)의 내부에 실리콘 단결정 웨이퍼(2)를 반입하고, 이 웨이퍼(2)의 주표면에 실리콘 에피택셜층을 성장시키는 경우, 반도체 제조장치(11)의 내부를 원하는 온도로 승온하고, 가스 공급구(7)로부터 성장 가스를 도입한다. 이것에 의해, 실리콘 단결정 웨이퍼(2)의 주표면상에 실리콘 에피택셜층이 성장되지만, 그때, 서셉터(1), 균열 지그(3), 석영 지그(4), 석영 챔버(6), 가스 공급구(7), 가스 배출구(8), 서셉터 지지 지그(10)의 표면에도 얇은 다결정 실리콘층이 성장하여, 실리콘 부생성물이 된다.
이 때, 서셉터(1)와 균열 지그(3)는 그 표면이 탄화규소이기 때문에, 실리콘 부생성물과 열팽창계수가 비슷하여, 실리콘 부생성물이 서셉터(1)나 균열 지그(3)의 표면으로부터 박리될 가능성은 석영제의 지그와 비교하여 상당히 낮다. 그 때문에, 정기적으로 가스 공급구(7)로부터 도입되는 염산가스에 의한 에칭으로 이 표면으로부터 실리콘 부생성물을 제거함으로써, 실리콘 부생성물의 박리를 충분히 억제할 수 있다.
또, 균열 지그(3)의 상면과 서셉터(1)의 상면은 도 6에 도시하는 바와 같이, 대략 동일 평면 상에 존재하고, 그 사이의 간극도 작기 때문에, 성장 가스는 균열 지그(3)나 서셉터(1)의 극히 근방을 제외하고, 균열 지그(3)나 서셉터(1)로부터 하방으로는 거의 흐르지 않는다. 따라서, 서셉터 지지 지그(10)의 표면에도 극히 얇은 실리콘 부생성물이 성장할 뿐이므로, 염산가스에 의해 정기적으로 실리콘 부생성물을 제거함으로써, 이 부생성물의 박리를 충분히 억제할 수 있다.
석영 챔버(6), 가스 공급구(7), 가스 배출구(8)는 석영제로, 열전도도가 낮다. 그리고, 웨이퍼와 동일한 정도의 고온에까지 가열되는 서셉터(1)나 균열 지그(3)로부터 떨어져 있으므로, 이들 지그는 온도가 그다지 높아지지 않아, 대단히 얇은 실리콘 부생성물이 성장할 뿐이므로, 염산가스에 의해 정기적으로 실리콘 부생성물을 제거함으로써, 이 부생성물의 박리를 충분히 억제할 수 있다. 따라서, 석영 챔버 측벽(6c)이나 가스 공급구(7), 가스 배출구(8)가 불투명 석영이어도 성장하는 실리콘 부생성물이 얇기 때문에, 이 부생성물과 함께 박리되는 미소 석영이 적다. 또한, 염산가스의 에칭 시에는, 에칭을 효율적으로 진행시키기 위해서, 역시 원하는 온도로 반도체 제조장치(11) 내부를 승온하지만, 전술한 바와 같이 이들 지그는 온도가 그다지 높아지지 않기 때문에, 염산가스에 의한 석영의 에칭도 극히 조금밖에 진행하지 않아, 미소 석영이 탈리하여 파티클이 될 가능성은 낮게 된다.
한편, 석영 지그(4)는 고온으로 가열되는 균열 지그(3)를 지지하고 있기 때문에, 균열 지그(3)와 동일한 정도의 온도까지 가열된다. 또, 전술한 바와 같이, 성장 가스가 서셉터(1)나 균열 지그(3)의 이면측에 대량으로 돌아 들어가는 일은 적지만, 이들 서셉터(1)나 균열 지그(3)의 이면의 극히 근방에는 성장 가스가 돌아 들어가고 있다. 그 때문에 석영 지그(4)의 측면이나 하면에는 실리콘 부생성물의 성장이 촉진된다. 특히, 균열 지그(3)와 석영 지그(4) 사이의 간극은 가스의 흐름이 극히 느리기 때문에, 성장 가스가 체류하기 쉬워 실리콘 부생성물의 성장이 더욱 촉진된다.
석영 지그(4)에 성장하는 실리콘 부생성물도 염산가스 등에 의해 제거되지만, 상기한 이유에 의해 다른 부품이나 지그에 비해 실리콘 부생성물의 성장이 빠르고, 또한, 균열 지그(3)의 이면측에 위치해 있기 때문에, 에칭가스가 흐르기 어렵다. 특히, 균열 지그(3)와 석영 지그(4) 사이의 간극은 흐르기 어렵다. 그 때문에, 실리콘 부생성물이 석영 지그(4)의 표면에 잔류하기 쉬워, 에피택셜 성장 과정에서의 온도상승·강온에 의한 석영 지그(4)의 팽창·수축에 의해 실리콘 부생성물이 박리되어, 석영 챔버(6) 내에서의 유력한 파티클 발생원이 될 우려가 있다. 또, 실리콘 부생성물이 박리될 때는, 석영 지그(4)의 표면의 석영이 이 부생성물과 결합하여 함께 박리되는 경우가 있어, 그것에 의해 석영 지그(4)의 열화가 진행될 가능성이 있다.
상기 문제를 억제하기 위해서, 염산가스 등의 에칭가스를 대량으로 흘려, 석영 지그(4)의 표면에 성장한 실리콘 부생성물을 충분히 제거할 수는 있다. 그러나, 대량의 에칭가스는, 석영 지그(4) 이외의 석영 지그, 예를들면, 석영 챔버(6)나 가스 공급구(7), 가스 배출구(8)의 열화를 촉진해버리기 때문에, 반도체 제조장치(11)의 부품이나 지그의 교환 빈도가 높아지고, 결과적으로 장치의 가동효율을 나쁘게 할 가능성이 있다.
또한, 석영 지그(4)의 표면이 불투명 석영일 경우, 에칭가스를 충분하게 흘려서 실리콘 부생성물을 제거할 때, 석영 지그(4)의 표면의 에칭도 진행되어 이 지그(4)가 열화되고, 불투명 석영의 기포 사이에 존재하는 미소 석영이 노출되어서 탈리하여, 파티클이 될 가능성이 있다.
그래서, 본 발명에서는, 도 2에 도시하는 바와 같이, 균열 지그(3)와 접하는 석영 지그(4)의 상면의 재질을 투명 석영으로 한다. 석영 지그(4)의 상면은 균열 지그(3)와 접하기 때문에, 가장 고온으로 되기 쉽다. 또, 서셉터(1)와 균열 지그(3) 사이의 간극에 가깝기 때문에, 성장 가스의 농도가 보다 높고, 게다가 석영 지그(4)의 상면과 균열 지그(4)의 하면의 간극은 성장 가스가 대단히 체류하기 쉽다. 그 때문에, 석영 지그(4)의 상면에는 실리콘 부생성물이 가장 성장하기 쉽다. 그래서, 석영 지그(4)의 상면을 투명 석영으로 하면, 투명 석영에는 기포가 존재하지 않아, 석영 분자가 치밀하게 배열되어 있으므로, 실리콘 부생성물의 박리가 발생해도 석영 지그(4)의 상면의 일부가 함께 탈리해버리는 것을 적합하게 막을 수 있다. 또, 염산 등에 의한 에칭이 행해져도 투명 석영에는 기포가 거의 존재하지 않기 때문에, 불투명 석영의 기포 간에 존재하는 미소 석영의 탈리를 적합하게 막을 수 있다.
또, 도 3에 도시하는 바와 같이, 석영 지그(4)는 상면뿐만 아니라 측면 및 하면(즉, 모든 표면)도 투명 석영으로 하는 것이 보다 바람직하다. 즉, 석영 지그(4)를 불투명 석영으로 구성하는 핵부와, 투명 석영으로 구성하는 표층부를 갖도록 구성할 수 있다. 석영 지그(4)의 표면 중, 가장 실리콘 부생성물이 성장하기 쉬운 것은, 전술한 바와 같이 석영 지그(4)의 상면이지만, 이 지그(4)의 측면도 하면도 다른 지그나 부품과 비교하여 고온이 되기 쉬우므로, 실리콘 부생성물의 성장도 촉진된다. 따라서, 이들 표면도 투명 석영으로 하면, 실리콘 부생성물의 박리가 발생해도 석영 지그(4)의 일부가 함께 박리해버리는 것을 적합하게 막을 수 있다. 또, 염산 등에 의한 에칭이 행해져도 투명 석영에는 기포가 거의 존재하지 않기 때문에, 불투명 석영의 기포 간에 존재하는 것과 같은 미소 석영의 탈리를 적합하게 막을 수 있다. 또한, 불투명 석영과 투명 석영의 적층은 양자를 포개어 버너로 용착하는 등의 공지의 기술을 사용하면 된다.
또한, 석영 지그(4)는, 종래와 같은 링 형상(도 7 참조)으로 할 수도 있지만, 도 4에 도시하는 바와 같이, 석영 지그(4)의 일부를 잘라낸 형상으로 하여, 웨이퍼의 반송경로 상에 석영 지그(4)가 존재하지 않도록 하는 것이 바람직하다. 석영 지그(4)를 이러한 형상으로 함으로써, 가령 석영 지그(4)로부터 실리콘 부생성물의 박리가 발생해도, 반송중의 웨이퍼의 주표면에 실리콘 부생성물이 파티클로서 낙하, 부착되는 것을 억제할 수 있다.
이 때, 반송경로 상 뿐만 아니라, 실리콘 부생성물이 성장하기 쉬운 부분도 잘라낸 석영 지그(4)를 사용해도 된다. 예를 들면, 가스 공급구(7)의 근방은 성장 가스의 농도가 높아, 이 성장 가스가 균열 지그(3)의 이면으로 돌아 들어가 석영 지그(4)의 표면에 실리콘 부생성물이 성장하기 쉽다. 따라서, 가스 공급구(7)의 주위에 위치하는 석영 지그(4)의 일부를 잘라내도 된다. 또는, 도 5와 같은 석영 지그(4)로 해도 된다. 또한, 상술한 석영 지그(4)는 석영 챔버 측벽(6c)에 고정되 어 있다.
상기와 같은 석영 지그(4)를 사용한 CVD장치(11)에서 서셉터(1) 상에 재치된 실리콘 단결정 웨이퍼(2)의 주표면에 실리콘 에피택셜 성장을 행하면, 실리콘 에피택셜층의 표면상에 파티클의 부착이 적은 실리콘 에피택셜 웨이퍼를 제조할 수 있다. 이 때의 실리콘 에피택셜 성장의 조건은, 전술한 바와 같은 공지의 제조조건에 의하면 된다.
이상, 본 발명을 낱장식 CVD장치에 적용한 경우에 대해 설명했지만, 본 발명은 낱장식의 CVD장치에 한하지 않고, 뱃치식의 CVD장치 등에 대해서도 적용 가능하다. 또, CVD장치 내의 가스에 의한 에칭으로서 염산가스를 예로 들었지만, 그밖의 환원성 가스에서도 동일한 효과를 얻을 수 있는 것은 말할 필요도 없다.
실시예
(실시예 1)
도전형 p형, 직경 200mm, 결정방위 <100>의 실리콘 단결정 웨이퍼를 준비하고, 도 1에 도시하는 바와 같은 낱장형 CVD장치에 이 웨이퍼를 투입했다. 이 CVD장치의 석영 지그로서, 균열 지그와 접하는 불투명 석영의 표면에 두께 1mm의 투명 석영을 용착한 링 형상의 지그(도 2 참조)를 사용했다. CVD장치에 투입된 실리콘 단결정 웨이퍼는 1050℃로 승온되고, 원료 가스인 수소 희석된 트리클로로실란을 석영 챔버 내에 도입하고, 6㎛ 의 실리콘 에피택셜층을 웨이퍼의 주표면에 성장시켰다. 이 처리를 10회 반복한 후, CVD장치 내의 드라이에칭으로 하여, 염산가스에 의한 클리닝을 행했다. 이상의, 실리콘 웨이퍼 10장의 처리와 드라이에칭 1회를 연속하여 행했다.
(실시예 2)
실시예 1에서 사용한 것과 동일한 실리콘 단결정 웨이퍼를 준비하고, 동일 조건에서 이 웨이퍼의 주표면에 대해 실리콘 에피택셜층을 6㎛ 성장시켰다. 이 때, CVD장치의 석영 지그로서, 불투명 석영의 모든 표면에 두께 1mm의 투명 석영을 용착 한 링 형상의 지그(도 3 참조)를 사용했다.
(실시예 3)
실시예 1에서 사용한 것과 동일한 실리콘 단결정 웨이퍼를 준비하고, 동일 조건에서 이 웨이퍼의 주표면에 대해 실리콘 에피택셜층을 6㎛ 성장시켰다. 이 때, CVD장치의 석영 지그로서, 균열 지그와 접하는 불투명 석영의 표면에 두께 1mm의 투명 석영을 용착하고, 웨이퍼의 반송경로 상의 석영 지그 부분을 잘라낸 지그(도 4 참조)를 사용했다.
(실시예 4)
실시예 1에서 사용한 것과 동일한 실리콘 단결정 웨이퍼를 준비하고, 동일한 조건에서 이 웨이퍼의 주표면에 대해 실리콘 에피택셜층을 6㎛ 성장시켰다. 이 때, CVD장치의 석영 지그로서, 균열 지그와 접하는 불투명 석영의 표면에 두께 1mm의 투명 석영을 용착하고, 도 5에 도시하는 바와 같은 형상의 지그를 사용했다.
(비교예)
실시예 1에서 사용한 것과 동일한 실리콘 단결정 웨이퍼를 준비하고, 동일한 조건에서 이 웨이퍼의 주표면에 대해 실리콘 에피택셜층을 6㎛ 성장시켰다. 이 때, CVD 장치의 석영 지그로서, 불투명 석영이 전체면에서 노출된 종래의 지그(도 6 참조)를 사용했다.
이상의 실시예에 기초하여, 각 실시예 및 비교예에서, 합계 3000장의 처리를 행했다. 이 후, 동일한 실리콘 웨이퍼를 사용하여, 동일한 연속처리를 100장 행했을 때의, 이 100장의 웨이퍼에 대해, 파티클 카운터(케이엘에이 텐코르사제 SP-1)로 실리콘 에피택셜 웨이퍼의 주표면상의 파티클을 카운트하고, 파티클의 카운트수에 대해, 0.12㎛ 이상의 사이즈에서의 100장의 평균값을 산출했다. 결과적으로, 종래의 석영 지그를 사용한 비교예에서의 파티클 카운트수의 평균값을 1로 하여 비교한 그래프를 도 8에 도시한다. 본 발명의 석영 지그를 사용하면, 파티클수는 약 1/5로 감소한 것을 알 수 있다.
Claims (5)
- 반도체 웨이퍼의 주표면상에 에피택셜층을 성장시키는 반도체 제조장치의 내부에 구비되고, 에피택셜 성장 시에, 반도체 웨이퍼를 재치하는 서셉터의 온도를 균일하게 유지하고, 이 서셉터의 상면과 동일 평면 상에 상면이 위치하는 균열 지그를 지지하기 위한 석영 지그로서,적어도 당해 균열 지그와 접촉하는 부분이 투명 석영으로 구성되어서 이루어지고,상기 반도체 제조장치의 내부에 반출입되는 반도체 웨이퍼의 반송경로 상에 해당되는 부분이 잘려진 형상인 것을 특징으로 하는 석영 지그.
- 제 1 항에 있어서, 불투명 석영으로 구성되는 핵부와, 투명 석영으로 구성되고, 또한 당해 핵부를 그 표면이 노출되지 않도록 피복하는 표층부를 갖는 것을 특징으로 하는 석영 지그.
- 제 1 항에 있어서, 상기 반도체 제조장치의 내부에 성장 가스를 도입하기 위한 가스 공급구의 근방에 해당되는 부분이 잘려진 형상인 것을 특징으로 하는 석영 지그.
- 제 1 항에 기재된 석영 지그를 구비하여 이루어지는 것을 특징으로 하는 반도체 제조장치.
- 삭제
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