JPH1138946A - 液晶表示装置 - Google Patents
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- Liquid Crystal (AREA)
Abstract
(57)【要約】
【課題】 本発明は、画素マトリクスのデータライン等
を時分割駆動する液晶表示装置に関する。 【解決手段】 この液晶表示装置は、少なくとも２個以
上のマルチプレクサMUX１〜600を利用し、少なくとも２
個以上のデータドライバ集積回路24a,24bの出力信号
を、画素マトリクスに含まれた多数のデータライン側DL
1〜2400に伝達する。そしてこの液晶表示装置は、少な
くとも２個以上のデータドライバ集積回路に供給される
ビデオデータを再配列するデータ再配列部26を備える。
このような構成により、液晶表示装置に必要とされるデ
ータドライバ集積回路の数を減らし、併せて画素マトリ
クスとデータドライバ集積回路等の間の配線構造が簡素
化される。
を時分割駆動する液晶表示装置に関する。 【解決手段】 この液晶表示装置は、少なくとも２個以
上のマルチプレクサMUX１〜600を利用し、少なくとも２
個以上のデータドライバ集積回路24a,24bの出力信号
を、画素マトリクスに含まれた多数のデータライン側DL
1〜2400に伝達する。そしてこの液晶表示装置は、少な
くとも２個以上のデータドライバ集積回路に供給される
ビデオデータを再配列するデータ再配列部26を備える。
このような構成により、液晶表示装置に必要とされるデ
ータドライバ集積回路の数を減らし、併せて画素マトリ
クスとデータドライバ集積回路等の間の配線構造が簡素
化される。
Description
【０００１】
【発明の属する技術分野】本発明は、薄膜トランジスタ
(Thin Film Transistor;以下“ＴＦＴ”という）等をス
イッチマトリクス(Switch Matrix)に利用する液晶表示
装置に関するもので、特にデジタルビデオデータにより
駆動されることに適合した液晶表示装置に関する。
(Thin Film Transistor;以下“ＴＦＴ”という）等をス
イッチマトリクス(Switch Matrix)に利用する液晶表示
装置に関するもので、特にデジタルビデオデータにより
駆動されることに適合した液晶表示装置に関する。
【０００２】
【従来の技術】最近、映像媒体は視聴者に高解像度の画
像を提供するための方案として、既存のアナログ映像信
号の代わりに、情報の圧縮が容易なデジタル映像信号で
転送する方式へ転換されつつある趨勢である。それによ
り、映像表示装置の一種類の液晶表示パネルも、既存の
アナログ映像信号の代わりにデジタル映像信号により駆
動されることができるように開発されている。
像を提供するための方案として、既存のアナログ映像信
号の代わりに、情報の圧縮が容易なデジタル映像信号で
転送する方式へ転換されつつある趨勢である。それによ
り、映像表示装置の一種類の液晶表示パネルも、既存の
アナログ映像信号の代わりにデジタル映像信号により駆
動されることができるように開発されている。
【０００３】このような開発努力により出現されるよう
になったデジタル方式の液晶表示装置は図１の図示のと
おり、液晶表示パネル（１０）のゲートライン等（Ｇ
Ｌ）を駆動するためのゲートドライバ(Gate Driver、１
２）と、液晶表示パネル（１０）のデータライン等（Ｄ
Ｌ）を一定な個数づつ分割駆動するための多数のデータ
ドライバ集積回路等(Data Driver Integrated Circui
t；以下“Ｄ−ＩＣという）（１４）を備える。液晶表
示パネル（１０）には、ゲートライン等（ＧＬ）とデー
タライン等（ＤＬ）の交差部等にＴＦＴ等（図示されて
いない）が設置され、共にこのＴＦＴ等のそれぞれには
液晶セル等が接続されている。ゲートドライバ（１２）
は、ゲート制御信号によりフレーム期間毎に水平走査期
間づつゲートライン等（ＧＬ）を順次的に駆動する。す
なわち、ゲートドライバ（１２）は、液晶表示パネル
（１０）に含まれたＴＦＴ等を１ライン分づつ順次的に
駆動する。一方、Ｄ−ＩＣ等（１４）は、データ制御信
号により水平走査期間毎にビデオデータをアナログ信号
の形態に変換し、その変換されたアナログビデオ信号を
データライン等（ＤＬ）に供給する。これを詳細に説明
すると、Ｄ−ＩＣ等（１４）のそれぞれは、自分の出力
ライン数に該当するビデオデータを入力して、その入力
されたビデオデータ等をアナログビデオ信号等に変換す
る。そして、Ｄ−ＩＣ等（１４）のそれぞれは、アナロ
グビデオ信号等を、自分の出力ライン等に接続されたデ
ータライン等（ＤＬ）に供給するようになる。そうする
と、１ライン分のＴＦＴ等にそれぞれ接続された１ライ
ン分の液晶セル等は、それぞれのビデオ信号の電圧レベ
ルによって光透過率を調節するようになる。
になったデジタル方式の液晶表示装置は図１の図示のと
おり、液晶表示パネル（１０）のゲートライン等（Ｇ
Ｌ）を駆動するためのゲートドライバ(Gate Driver、１
２）と、液晶表示パネル（１０）のデータライン等（Ｄ
Ｌ）を一定な個数づつ分割駆動するための多数のデータ
ドライバ集積回路等(Data Driver Integrated Circui
t；以下“Ｄ−ＩＣという）（１４）を備える。液晶表
示パネル（１０）には、ゲートライン等（ＧＬ）とデー
タライン等（ＤＬ）の交差部等にＴＦＴ等（図示されて
いない）が設置され、共にこのＴＦＴ等のそれぞれには
液晶セル等が接続されている。ゲートドライバ（１２）
は、ゲート制御信号によりフレーム期間毎に水平走査期
間づつゲートライン等（ＧＬ）を順次的に駆動する。す
なわち、ゲートドライバ（１２）は、液晶表示パネル
（１０）に含まれたＴＦＴ等を１ライン分づつ順次的に
駆動する。一方、Ｄ−ＩＣ等（１４）は、データ制御信
号により水平走査期間毎にビデオデータをアナログ信号
の形態に変換し、その変換されたアナログビデオ信号を
データライン等（ＤＬ）に供給する。これを詳細に説明
すると、Ｄ−ＩＣ等（１４）のそれぞれは、自分の出力
ライン数に該当するビデオデータを入力して、その入力
されたビデオデータ等をアナログビデオ信号等に変換す
る。そして、Ｄ−ＩＣ等（１４）のそれぞれは、アナロ
グビデオ信号等を、自分の出力ライン等に接続されたデ
ータライン等（ＤＬ）に供給するようになる。そうする
と、１ライン分のＴＦＴ等にそれぞれ接続された１ライ
ン分の液晶セル等は、それぞれのビデオ信号の電圧レベ
ルによって光透過率を調節するようになる。
【０００４】このような構成のデジタル液晶表示装置
は、Ｄ−ＩＣ等（１４）が自分の出力端子に該当する数
のデータライン等のみを駆動することができるので、多
数のＤ−ＩＣ等（１４）が必要とされ、共に回路構成及
び嵩が大きくならざるをえなかった状況であった。
は、Ｄ−ＩＣ等（１４）が自分の出力端子に該当する数
のデータライン等のみを駆動することができるので、多
数のＤ−ＩＣ等（１４）が必要とされ、共に回路構成及
び嵩が大きくならざるをえなかった状況であった。
【０００５】このようなデジタル液晶表示装置の短所を
解消するために、１ラインのデータライン等を時分割駆
動する時分割方式の液晶表示装置が提案された。この時
分割方式の液晶表示装置は、タナカ(Tanaka)らにより、
１９９３年度ＩＥＥＥの刊行物を通し、“Ａｎ ＬＣＤ
Ａｄｄｒｅｓｓｅｄ ｂｙ ａ−Ｓｉ：Ｈ ＴＦＴｓ
ｗｉｔｈ Ｐｅｒｉｐｈｅｒａｌ ｐｏｌｙ−Ｓｉ
ＴＦＴ Ｃｉｒｃｕｉｔｓ”という題目で発表されてか
ら、更にカト(Kato)らにより、“Ｅｕｒｏ Ｄｉｓｐｌ
ａｙ ’９６”という論文集において、“Ａｒ＋ Ｌａ
ｓｅｒＡｎｎｅａｌｅｄ Ｐｏｌｙ−Ｓｉ ＴＦＴｓ
ｆｏｒ ＬａｒｇｅＡｒｅａ ＬＣＤｓ”という題目で
発表された。この論文等によると、時分割方式の液晶表
示装置は、ポリクリスタルシリコン(Polycrystalline S
i)とアモルファスシリコン(Amorphous si)の二重層を有
するようにＴＦＴ等を形成し、ＴＦＴ等のオン／オフ速
度を向上させた。併せて、時分割方式の液晶表示装置で
は、Ｄ−ＩＣ等のそれぞれの出力端子等とデータライン
等との間にマルチプレクサを介在させ、データライン等
が時分割的に駆動される。それにより、時分割方式の液
晶表示装置は、Ｄ−ＩＣの所要量を少なくとも１／２以
下に減少させることができた。
解消するために、１ラインのデータライン等を時分割駆
動する時分割方式の液晶表示装置が提案された。この時
分割方式の液晶表示装置は、タナカ(Tanaka)らにより、
１９９３年度ＩＥＥＥの刊行物を通し、“Ａｎ ＬＣＤ
Ａｄｄｒｅｓｓｅｄ ｂｙ ａ−Ｓｉ：Ｈ ＴＦＴｓ
ｗｉｔｈ Ｐｅｒｉｐｈｅｒａｌ ｐｏｌｙ−Ｓｉ
ＴＦＴ Ｃｉｒｃｕｉｔｓ”という題目で発表されてか
ら、更にカト(Kato)らにより、“Ｅｕｒｏ Ｄｉｓｐｌ
ａｙ ’９６”という論文集において、“Ａｒ＋ Ｌａ
ｓｅｒＡｎｎｅａｌｅｄ Ｐｏｌｙ−Ｓｉ ＴＦＴｓ
ｆｏｒ ＬａｒｇｅＡｒｅａ ＬＣＤｓ”という題目で
発表された。この論文等によると、時分割方式の液晶表
示装置は、ポリクリスタルシリコン(Polycrystalline S
i)とアモルファスシリコン(Amorphous si)の二重層を有
するようにＴＦＴ等を形成し、ＴＦＴ等のオン／オフ速
度を向上させた。併せて、時分割方式の液晶表示装置で
は、Ｄ−ＩＣ等のそれぞれの出力端子等とデータライン
等との間にマルチプレクサを介在させ、データライン等
が時分割的に駆動される。それにより、時分割方式の液
晶表示装置は、Ｄ−ＩＣの所要量を少なくとも１／２以
下に減少させることができた。
【０００６】このような時分割方式の液晶表示装置で
は、マルチプレクサが遠く離れているデータライン等を
切換するので、１つのマルチプレクサにより駆動される
データライン等間の距離が大きくなる。それにより、液
晶表示パネル上の配線構造が複雑となることはいうまで
もなく、ビデオ信号が歪曲されるおそれがある。併せ
て、Ｄ−ＩＣ等は１ライン分のビデオデータを順次的に
サンプリングしなければならないので、１ライン分のビ
デオデータ数に該当する周波数のサンプリングクロック
がＤ−ＩＣ等に供給されなければならない。
は、マルチプレクサが遠く離れているデータライン等を
切換するので、１つのマルチプレクサにより駆動される
データライン等間の距離が大きくなる。それにより、液
晶表示パネル上の配線構造が複雑となることはいうまで
もなく、ビデオ信号が歪曲されるおそれがある。併せ
て、Ｄ−ＩＣ等は１ライン分のビデオデータを順次的に
サンプリングしなければならないので、１ライン分のビ
デオデータ数に該当する周波数のサンプリングクロック
がＤ−ＩＣ等に供給されなければならない。
【０００７】
【発明が解決しようとする課題】従って、本発明の目的
は回路構成と配線構造とを簡素化することができる液晶
表示装置を提供することにある。
は回路構成と配線構造とを簡素化することができる液晶
表示装置を提供することにある。
【０００８】本発明の他の目的は、ビデオデータのサン
プリング周期を遅くすることができる液晶表示装置を提
供することにある。
プリング周期を遅くすることができる液晶表示装置を提
供することにある。
【０００９】
【課題を解決するための手段】この発明に係る液晶表示
装置は、複数のデータラインと複数のゲートラインとの
交差部にそれぞれ配列された複数の画素セルを含む液晶
パネルと、複数のビデオ信号を供給するための第１デー
タドライバ回路と、複数のビデオ信号を供給するための
第２データドライバ回路と、前記第１及び第２データド
ライバ回路のいずれかから供給される前記複数のビデオ
信号のいずれかをそれぞれ受信するとともに、受信した
ビデオ信号を前記複数のデータラインに選択的に出力す
る複数のマルチプレクサ回路とを備える。
装置は、複数のデータラインと複数のゲートラインとの
交差部にそれぞれ配列された複数の画素セルを含む液晶
パネルと、複数のビデオ信号を供給するための第１デー
タドライバ回路と、複数のビデオ信号を供給するための
第２データドライバ回路と、前記第１及び第２データド
ライバ回路のいずれかから供給される前記複数のビデオ
信号のいずれかをそれぞれ受信するとともに、受信した
ビデオ信号を前記複数のデータラインに選択的に出力す
る複数のマルチプレクサ回路とを備える。
【００１０】この発明に係る液晶表示装置は、水平軸で
反復される赤、緑、青の画素セルが、複数のデータライ
ンと複数のゲートラインとの交差部のそれぞれに配列さ
れた液晶パネルと、複数のビデオ信号を供給するための
第１データドライバ回路と、複数のビデオ信号を供給す
るための第２データドライバ回路と、前記第１及び第２
データドライバ回路のいずれかから供給される前記複数
のビデオ信号のいずれかをそれぞれ受信するとともに、
受信したビデオ信号を前記複数のデータラインに選択的
に出力する複数のマルチプレクサ回路とを備える。
反復される赤、緑、青の画素セルが、複数のデータライ
ンと複数のゲートラインとの交差部のそれぞれに配列さ
れた液晶パネルと、複数のビデオ信号を供給するための
第１データドライバ回路と、複数のビデオ信号を供給す
るための第２データドライバ回路と、前記第１及び第２
データドライバ回路のいずれかから供給される前記複数
のビデオ信号のいずれかをそれぞれ受信するとともに、
受信したビデオ信号を前記複数のデータラインに選択的
に出力する複数のマルチプレクサ回路とを備える。
【００１１】この発明に係る液晶表示装置は、画素セル
がｎ個のデータラインとｍ個のゲートライン（ただし、
ｎ及びｍは整数）の複数の交差部のそれぞれに配列され
た液晶パネルと、データ信号を前記ｎ個のデータライン
の中のｐ個（ただし、ｐはｎより小さい整数）にそれぞ
れ出力するための複数のマルチプレキシング手段と、前
記複数のマルチプレキシング手段を時分割的に駆動する
ためのｑ個（ただし、ｑは整数）のデータドライバ回路
を備える。
がｎ個のデータラインとｍ個のゲートライン（ただし、
ｎ及びｍは整数）の複数の交差部のそれぞれに配列され
た液晶パネルと、データ信号を前記ｎ個のデータライン
の中のｐ個（ただし、ｐはｎより小さい整数）にそれぞ
れ出力するための複数のマルチプレキシング手段と、前
記複数のマルチプレキシング手段を時分割的に駆動する
ためのｑ個（ただし、ｑは整数）のデータドライバ回路
を備える。
【００１２】本発明による液晶表示装置は、１ライン分
のビデオデータを再整列し、液晶パネル上の１ライン分
のＴＦＴの中の隣接したＴＦＴが順次的に駆動されるよ
うにすると共に、同時に駆動されるＴＦＴを分散させる
ことができる。それにより、本発明の液晶表示装置で
は、Ｄ−ＩＣと画素マトリクスとの間の配線構造が簡素
化される。また、本発明では、Ｄ−ＩＣが同時にビデオ
データをサンプリングするようにすることにより、Ｄ−
ＩＣは周波数が低いサンプリングクロックの周波数を使
用することができる。
のビデオデータを再整列し、液晶パネル上の１ライン分
のＴＦＴの中の隣接したＴＦＴが順次的に駆動されるよ
うにすると共に、同時に駆動されるＴＦＴを分散させる
ことができる。それにより、本発明の液晶表示装置で
は、Ｄ−ＩＣと画素マトリクスとの間の配線構造が簡素
化される。また、本発明では、Ｄ−ＩＣが同時にビデオ
データをサンプリングするようにすることにより、Ｄ−
ＩＣは周波数が低いサンプリングクロックの周波数を使
用することができる。
【００１３】
【発明の実施の形態】前記の目的以外に、本発明の他の
目的及び利点等は添付図面を参照してから、好ましい実
施の形態に関する詳細な説明を通して明らかになる。
目的及び利点等は添付図面を参照してから、好ましい実
施の形態に関する詳細な説明を通して明らかになる。
【００１４】以下、本発明の好ましい実施の形態を、添
付の図２乃至図７を参照して詳細に説明する。
付の図２乃至図７を参照して詳細に説明する。
【００１５】図２を参照すると、画素マトリクス（２
０）のゲートライン等（ＧＭ１乃至ＧＭ６００）を駆動
するためのゲートドライバ（２２）と、画素マトリクス
（２０）のデータライン等（ＤＬ１乃至ＤＬ２４００）
を駆動するためのＤ−ＩＣ等（２４ａ、２４ｂ)を備え
る、本発明の実施の形態による液晶表示装置が図示され
ている。この画素マトリクス（２０）は、ゲートライン
等（ＧＭ１乃至ＧＭ６００）とデータライン等（ＤＬ１
乃至ＤＬ２４００）との交差地点等にそれぞれ配置され
た６００×２４００個の画像素子等を含んで、６００×
８００個の画素を有する画像を表示するようになる。画
像素子等はそれぞれ１つのＴＦＴと１つの液晶セルとか
ら構成され、この画像素子に含まれたＴＦＴのゲート電
極とデータ電極とは、ゲートライン（ＧＭ）とデータラ
イン（ＤＬ）にそれぞれ接続される。２４００個のデー
タライン等（ＤＬ１乃至ＤＬ２４００）は赤色（Ｒ）用
の画像素子等、緑色（Ｇ）用の画像素子等、そして青色
（Ｂ）用の画像素子等を駆動するために８００個づつ割
り当てられる。これ等の赤色（Ｒ）用、緑色（Ｇ）用及
び青色（Ｂ）用のデータライン等は、交替に配列され
る。ゲートドライバ（２２）は、ゲート制御信号等によ
りフレーム期間毎に水平走査期間づつ順次的にゲートラ
イン等（ＧＬ）を駆動する。このゲートドライバ（２
２）により、画素マトリクス（２０）に含まれたＴＦＴ
等は、２４００個づつ順次的にターンオン(Turn-on)さ
れ、２４００個のデータライン（ＤＬ１乃至ＤＬ２４０
０）を２４００個の液晶セル等にそれぞれ接続させる。
一方、Ｄ−ＩＣ等（２４ａ、２４ｂ)のそれぞれは、水
平走査期間毎に多数のビデオデータをサンプリングする
と共に、そのサンプリングされた多数のビデオデータを
アナログビデオ信号等に変換する。そして、Ｄ−ＩＣ等
（２４ａ、２４ｂ)のそれぞれは、ビデオ信号等をデー
タライン等（ＤＬ）に供給する。そうすると、ターンオ
ンされたＴＦＴ等に接続された液晶セル等は、それぞれ
データライン（ＤＬ）からのビデオ信号の電圧レベルに
よって光透過率を調節するようになる。
０）のゲートライン等（ＧＭ１乃至ＧＭ６００）を駆動
するためのゲートドライバ（２２）と、画素マトリクス
（２０）のデータライン等（ＤＬ１乃至ＤＬ２４００）
を駆動するためのＤ−ＩＣ等（２４ａ、２４ｂ)を備え
る、本発明の実施の形態による液晶表示装置が図示され
ている。この画素マトリクス（２０）は、ゲートライン
等（ＧＭ１乃至ＧＭ６００）とデータライン等（ＤＬ１
乃至ＤＬ２４００）との交差地点等にそれぞれ配置され
た６００×２４００個の画像素子等を含んで、６００×
８００個の画素を有する画像を表示するようになる。画
像素子等はそれぞれ１つのＴＦＴと１つの液晶セルとか
ら構成され、この画像素子に含まれたＴＦＴのゲート電
極とデータ電極とは、ゲートライン（ＧＭ）とデータラ
イン（ＤＬ）にそれぞれ接続される。２４００個のデー
タライン等（ＤＬ１乃至ＤＬ２４００）は赤色（Ｒ）用
の画像素子等、緑色（Ｇ）用の画像素子等、そして青色
（Ｂ）用の画像素子等を駆動するために８００個づつ割
り当てられる。これ等の赤色（Ｒ）用、緑色（Ｇ）用及
び青色（Ｂ）用のデータライン等は、交替に配列され
る。ゲートドライバ（２２）は、ゲート制御信号等によ
りフレーム期間毎に水平走査期間づつ順次的にゲートラ
イン等（ＧＬ）を駆動する。このゲートドライバ（２
２）により、画素マトリクス（２０）に含まれたＴＦＴ
等は、２４００個づつ順次的にターンオン(Turn-on)さ
れ、２４００個のデータライン（ＤＬ１乃至ＤＬ２４０
０）を２４００個の液晶セル等にそれぞれ接続させる。
一方、Ｄ−ＩＣ等（２４ａ、２４ｂ)のそれぞれは、水
平走査期間毎に多数のビデオデータをサンプリングする
と共に、そのサンプリングされた多数のビデオデータを
アナログビデオ信号等に変換する。そして、Ｄ−ＩＣ等
（２４ａ、２４ｂ)のそれぞれは、ビデオ信号等をデー
タライン等（ＤＬ）に供給する。そうすると、ターンオ
ンされたＴＦＴ等に接続された液晶セル等は、それぞれ
データライン（ＤＬ）からのビデオ信号の電圧レベルに
よって光透過率を調節するようになる。
【００１６】液晶表示装置は、Ｄ−ＩＣ等（２４ａ、２
４ｂ)の出力端子等（ＬＤ１乃至ＬＤ６００）にそれぞ
れ接続されたマルチプレクサ等（ＭＵＸ１乃至ＭＵＸ６
００）を追加で備える。これ等のマルチプレクサ（ＭＵ
Ｘ１乃至ＭＵＸ６００）は、それぞれ互いに隣接した４
個のデータライン等（ＤＬｉ乃至ＤＬｉ＋３）に接続さ
れる。そしてこれ等のマルチプレクサ等（ＭＵＸ１乃至
ＭＵＸ６００）は、それぞれ第１乃至第４選択信号（Ｓ
ＥＬ１乃至ＳＥＬ４）により、Ｄ−ＩＣ（２４）の出力
端子（ＬＤ）からのビデオ信号を４個のデータライン等
（ＤＬｉ乃至ＤＬｉ＋３）に順次的に供給する。そのた
めに、このマルチプレクサ等（ＭＵＸ１乃至ＭＵＸ６０
０）のそれぞれは、Ｄ−ＩＣ（２４）の出力端子（Ｌ
Ｄ）と４個のデータライン等（ＤＬｉ乃至ＤＬｉ＋３）
の間にそれぞれ接続された４個のＭＯＳトランジスタ
（ＭＮ１乃至ＭＮ４）を備える。マルチプレクサ（ＭＵ
Ｘ）に含まれた４個のＭＯＳトランジスタ等（ＭＮ１乃
至ＭＮ４）は、第１乃至第４選択信号（ＳＥＬ１乃至Ｓ
ＥＬ４）を１個づつ自分らのゲート電極側にそれぞれ入
力する。第１乃至第４選択信号（ＳＥＬ１乃至ＳＥＬ
４）は、水平同期信号と同一な周波数を有する。そし
て、第１乃至第４選択信号（ＳＥＬ１乃至ＳＥＬ４）
は、互いに順次的で反復的に進行されるイネーブル区
間、すなわちハイ論理区間を有する。それにより、マル
チプレクサ（ＭＵＸ）に含まれた４個のＭＯＳトランジ
スタ等（ＭＮ１乃至ＭＮ４）は、水平走査期間毎に順次
的にターンオンされ、４個のデータライン（ＤＬｉ乃至
ＤＬｉ＋３）が順次的にＤ−ＩＣ（２４）の出力端子
（ＬＤ）に接続されるようにする。この４個のＭＯＳト
ランジスタ等（ＭＮ１乃至ＭＮ４）は、スイッチ機能を
有する回路素子等に代置されることもできる。そして、
マルチプレクサ等（ＭＵＸ１乃至ＭＵＸ６００）は、画
素マトリクス（２０）及びゲートドライバ（２２）と共
に同一なガラス基板（２８）上に形成される。ここにお
いて、マルチプレクサ等（ＭＵＸ１乃至ＭＵＸ６００）
は、画素マトリクス（２０）の上側（すなわち、ガラス
基板（２８）の上端）に、そしてゲートドライバ（２
２）は画素マトリクス（２０）の端（すなわち、ガラス
基板（２８）の端）にそれぞれ位置する。
４ｂ)の出力端子等（ＬＤ１乃至ＬＤ６００）にそれぞ
れ接続されたマルチプレクサ等（ＭＵＸ１乃至ＭＵＸ６
００）を追加で備える。これ等のマルチプレクサ（ＭＵ
Ｘ１乃至ＭＵＸ６００）は、それぞれ互いに隣接した４
個のデータライン等（ＤＬｉ乃至ＤＬｉ＋３）に接続さ
れる。そしてこれ等のマルチプレクサ等（ＭＵＸ１乃至
ＭＵＸ６００）は、それぞれ第１乃至第４選択信号（Ｓ
ＥＬ１乃至ＳＥＬ４）により、Ｄ−ＩＣ（２４）の出力
端子（ＬＤ）からのビデオ信号を４個のデータライン等
（ＤＬｉ乃至ＤＬｉ＋３）に順次的に供給する。そのた
めに、このマルチプレクサ等（ＭＵＸ１乃至ＭＵＸ６０
０）のそれぞれは、Ｄ−ＩＣ（２４）の出力端子（Ｌ
Ｄ）と４個のデータライン等（ＤＬｉ乃至ＤＬｉ＋３）
の間にそれぞれ接続された４個のＭＯＳトランジスタ
（ＭＮ１乃至ＭＮ４）を備える。マルチプレクサ（ＭＵ
Ｘ）に含まれた４個のＭＯＳトランジスタ等（ＭＮ１乃
至ＭＮ４）は、第１乃至第４選択信号（ＳＥＬ１乃至Ｓ
ＥＬ４）を１個づつ自分らのゲート電極側にそれぞれ入
力する。第１乃至第４選択信号（ＳＥＬ１乃至ＳＥＬ
４）は、水平同期信号と同一な周波数を有する。そし
て、第１乃至第４選択信号（ＳＥＬ１乃至ＳＥＬ４）
は、互いに順次的で反復的に進行されるイネーブル区
間、すなわちハイ論理区間を有する。それにより、マル
チプレクサ（ＭＵＸ）に含まれた４個のＭＯＳトランジ
スタ等（ＭＮ１乃至ＭＮ４）は、水平走査期間毎に順次
的にターンオンされ、４個のデータライン（ＤＬｉ乃至
ＤＬｉ＋３）が順次的にＤ−ＩＣ（２４）の出力端子
（ＬＤ）に接続されるようにする。この４個のＭＯＳト
ランジスタ等（ＭＮ１乃至ＭＮ４）は、スイッチ機能を
有する回路素子等に代置されることもできる。そして、
マルチプレクサ等（ＭＵＸ１乃至ＭＵＸ６００）は、画
素マトリクス（２０）及びゲートドライバ（２２）と共
に同一なガラス基板（２８）上に形成される。ここにお
いて、マルチプレクサ等（ＭＵＸ１乃至ＭＵＸ６００）
は、画素マトリクス（２０）の上側（すなわち、ガラス
基板（２８）の上端）に、そしてゲートドライバ（２
２）は画素マトリクス（２０）の端（すなわち、ガラス
基板（２８）の端）にそれぞれ位置する。
【００１７】また、液晶表示装置にはＤ−ＩＣ等（２４
ａ、２４ｂ)に供給されるビデオデータを再整列させ、
その再整列されたビデオデータをＤ−ＩＣ等（２４ａ、
２４ｂ)に供給するデータ再整列部（２６）が設置され
ている。このデータ再整列部（２６）は、それぞれ赤色
用バス（ＭＲＢ）、緑色用バス（ＭＧＢ）及び青色用バ
ス（ＭＢＢ）を経由して入力される赤色データ（Ｒ）ス
トリーム、緑色データ（Ｇ）ストリーム及び青色データ
（Ｂ）ストリームを、Ｄ−ＩＣ等（２４）の数に該当す
るグループ（例えば、２個のデータグループ）に分離
し、それぞれのデータグループをマルチプレクサ（ＭＵ
Ｘ）の出力ライン数（例えば、４個）に該当するセクシ
ョン等（例えば、４個のセクション）に再整列する。そ
して、データ再整列部（２６）は、再整列されたビデオ
データを、他のバス等を経由しＤ−ＩＣ等（２４ａ、２
４ｂ)に供給する。実際に、第１Ｄ−ＩＣ（２４ａ)には
ビデオデータが第１乃至第３補助バス（ＳＢ１、ＳＢ
２、ＳＢ３）を経由し、３個のシンボルづつ供給され、
そして第２Ｄ−ＩＣ(２４ｂ)には、ビデオデータが第４
乃至第６補助バス（ＳＢ４、ＳＢ５、ＳＢ６）を経由
し、３個のシンボルづつ供給される。また、データ再整
列部（２６）は、Ｄ−ＩＣ等（２４ａ、２４ｂ)が同時
にビデオデータを入力するか、または交替にビデオデー
タを入力するように設計されることができる。最後に、
データ再整列部（２６）とＤ−ＩＣ等（２４ａ、２４
ｂ)は、データ制御バス（ＤＣＢ）から入力されるサン
プリングクロックを含むデータ制御信号等により駆動さ
れる。
ａ、２４ｂ)に供給されるビデオデータを再整列させ、
その再整列されたビデオデータをＤ−ＩＣ等（２４ａ、
２４ｂ)に供給するデータ再整列部（２６）が設置され
ている。このデータ再整列部（２６）は、それぞれ赤色
用バス（ＭＲＢ）、緑色用バス（ＭＧＢ）及び青色用バ
ス（ＭＢＢ）を経由して入力される赤色データ（Ｒ）ス
トリーム、緑色データ（Ｇ）ストリーム及び青色データ
（Ｂ）ストリームを、Ｄ−ＩＣ等（２４）の数に該当す
るグループ（例えば、２個のデータグループ）に分離
し、それぞれのデータグループをマルチプレクサ（ＭＵ
Ｘ）の出力ライン数（例えば、４個）に該当するセクシ
ョン等（例えば、４個のセクション）に再整列する。そ
して、データ再整列部（２６）は、再整列されたビデオ
データを、他のバス等を経由しＤ−ＩＣ等（２４ａ、２
４ｂ)に供給する。実際に、第１Ｄ−ＩＣ（２４ａ)には
ビデオデータが第１乃至第３補助バス（ＳＢ１、ＳＢ
２、ＳＢ３）を経由し、３個のシンボルづつ供給され、
そして第２Ｄ−ＩＣ(２４ｂ)には、ビデオデータが第４
乃至第６補助バス（ＳＢ４、ＳＢ５、ＳＢ６）を経由
し、３個のシンボルづつ供給される。また、データ再整
列部（２６）は、Ｄ−ＩＣ等（２４ａ、２４ｂ)が同時
にビデオデータを入力するか、または交替にビデオデー
タを入力するように設計されることができる。最後に、
データ再整列部（２６）とＤ−ＩＣ等（２４ａ、２４
ｂ)は、データ制御バス（ＤＣＢ）から入力されるサン
プリングクロックを含むデータ制御信号等により駆動さ
れる。
【００１８】図３は、データ再整列部（２６）からビデ
オデータが第１乃至第３補助バス（ＳＢ１乃至ＳＢ３）
と第４乃至第６補助バス（ＳＢ４乃至ＳＢ６）に交替に
出力される場合、データ再整列部（２６）、Ｄ−ＩＣ等
（２４）及びマルチプレクサ等（ＭＵＸ１乃至ＭＵＸ６
００）の動作波形を図示する。
オデータが第１乃至第３補助バス（ＳＢ１乃至ＳＢ３）
と第４乃至第６補助バス（ＳＢ４乃至ＳＢ６）に交替に
出力される場合、データ再整列部（２６）、Ｄ−ＩＣ等
（２４）及びマルチプレクサ等（ＭＵＸ１乃至ＭＵＸ６
００）の動作波形を図示する。
【００１９】図３において、第１乃至第３補助バス等
（ＳＢ１乃至ＳＢ３）と第４乃至第６補助バス等（ＳＢ
４乃至ＳＢ６）には、選択信号等（ＳＥＬ１乃至ＳＥＬ
４）がイネーブルされる期間、すなわちハイ論理を維持
する期間毎に、交替に再整列されたビデオデータストリ
ームが供給される。これを詳細に説明すると、第１選択
信号（ＳＥＬ１）がイネーブルされた時点から第１補助
バス（ＳＢ１）に“Ｒ１、Ｒ５、Ｒ９…Ｒ３９７”の再
整列されたビデオデータが、第２補助バス（ＳＢ２）に
は“Ｇ２、Ｇ６、Ｇ１０…Ｇ３９８”の再整列されたビ
デオデータが、そして第３補助バス（ＳＢ３）には“Ｂ
３、Ｂ７、Ｂ１１…Ｂ３９９”の再整列されたビデオデ
ータがそれぞれ供給される。第１乃至第３補助バス（Ｓ
Ｂ１乃至ＳＢ３）に再整列されたビデオデータが供給さ
れたから、残りの第１選択信号（ＳＥＬ１）のイネーブ
ル期間の間、第４補助バス（ＳＢ４）に“Ｒ４０１、Ｒ
４０５、Ｒ４０９…Ｒ７９７”の再整列されたビデオデ
ータが、第５補助バス（ＳＢ５）には“Ｇ４０２、Ｇ４
０６、Ｇ４１０…Ｇ７９８”の再整列されたビデオデー
タ、そして第６補助バス（ＳＢ６）には“Ｂ４０３、Ｂ
４０７、Ｂ４１１…Ｂ７９９”の再整列されたビデオデ
ータが供給されるようになる。
（ＳＢ１乃至ＳＢ３）と第４乃至第６補助バス等（ＳＢ
４乃至ＳＢ６）には、選択信号等（ＳＥＬ１乃至ＳＥＬ
４）がイネーブルされる期間、すなわちハイ論理を維持
する期間毎に、交替に再整列されたビデオデータストリ
ームが供給される。これを詳細に説明すると、第１選択
信号（ＳＥＬ１）がイネーブルされた時点から第１補助
バス（ＳＢ１）に“Ｒ１、Ｒ５、Ｒ９…Ｒ３９７”の再
整列されたビデオデータが、第２補助バス（ＳＢ２）に
は“Ｇ２、Ｇ６、Ｇ１０…Ｇ３９８”の再整列されたビ
デオデータが、そして第３補助バス（ＳＢ３）には“Ｂ
３、Ｂ７、Ｂ１１…Ｂ３９９”の再整列されたビデオデ
ータがそれぞれ供給される。第１乃至第３補助バス（Ｓ
Ｂ１乃至ＳＢ３）に再整列されたビデオデータが供給さ
れたから、残りの第１選択信号（ＳＥＬ１）のイネーブ
ル期間の間、第４補助バス（ＳＢ４）に“Ｒ４０１、Ｒ
４０５、Ｒ４０９…Ｒ７９７”の再整列されたビデオデ
ータが、第５補助バス（ＳＢ５）には“Ｇ４０２、Ｇ４
０６、Ｇ４１０…Ｇ７９８”の再整列されたビデオデー
タ、そして第６補助バス（ＳＢ６）には“Ｂ４０３、Ｂ
４０７、Ｂ４１１…Ｂ７９９”の再整列されたビデオデ
ータが供給されるようになる。
【００２０】このような形態に、第２乃至第４選択信号
（ＳＥＬ２乃至ＳＥＬ４）が順次的にイネーブルされる
ことにより、第１乃至第６補助バス（ＳＢ１乃至ＳＢ
６）に再整列されたビデオデータが一定な間隔を置いて
反復的に供給される。この時、第１補助バス（ＳＢ１）
には“Ｇ１、Ｇ５、Ｇ９…Ｇ３９７”、“Ｂ１、Ｂ５、
Ｂ９…Ｂ３９７”及び“Ｒ２、Ｒ６、Ｒ１０…Ｒ３９
８”の再整列されたビデオデータが、一定な間隔を置い
て順次的に供給される。併せて、第２補助バス（ＳＢ
２）には“Ｂ２、Ｂ６、Ｂ１０…Ｂ３９８”、“Ｒ３、
Ｒ７、Ｒ１１…Ｒ３９９”及び“Ｇ３、Ｇ７、Ｇ１１…
Ｇ３９９”の再整列されたビデオデータが、そして第３
補助バス（ＳＢ３）には“Ｒ４、Ｒ８、Ｒ１２…Ｒ４０
０”、“Ｇ４、Ｇ８、Ｇ１２…Ｇ４００”及び“Ｂ４、
Ｂ８、Ｂ１２…Ｂ４００”の再整列されたビデオデータ
がそれぞれ供給される。また、第１乃至第３補助バス等
（ＳＢ１乃至ＳＢ３）と時間的に交替になるように再整
列されたビデオデータを入力する第４乃至第６補助バス
等（ＳＢ４乃至ＳＢ６）には、“Ｇ４０１、Ｇ４０５、
Ｇ４０９…Ｇ７９７”、“Ｂ４０１、Ｂ４０５、Ｂ４０
９…Ｂ７９７”及び“Ｒ４０２、Ｒ４０６、Ｒ４１０…
Ｒ７９８”の再整列されたビデオデータ、“Ｂ４０２、
Ｂ４０６、Ｂ４１０…Ｂ７９８”、“Ｒ４０３、Ｒ４０
７、Ｒ４１１…Ｒ７９９”及び“Ｇ４０３、Ｇ４０７、
Ｇ４１１…Ｇ７９９”の再整列されたビデオデータ、そ
して“Ｒ４０４、Ｒ４０８、Ｒ４１２…Ｒ８００”、
“Ｇ４０４、Ｇ４０８、Ｇ４１２…Ｇ８００”及び“Ｂ
４０４、Ｂ４０８、Ｂ４１２…Ｂ８００”の再整列され
たビデオデータがそれぞれ供給される。
（ＳＥＬ２乃至ＳＥＬ４）が順次的にイネーブルされる
ことにより、第１乃至第６補助バス（ＳＢ１乃至ＳＢ
６）に再整列されたビデオデータが一定な間隔を置いて
反復的に供給される。この時、第１補助バス（ＳＢ１）
には“Ｇ１、Ｇ５、Ｇ９…Ｇ３９７”、“Ｂ１、Ｂ５、
Ｂ９…Ｂ３９７”及び“Ｒ２、Ｒ６、Ｒ１０…Ｒ３９
８”の再整列されたビデオデータが、一定な間隔を置い
て順次的に供給される。併せて、第２補助バス（ＳＢ
２）には“Ｂ２、Ｂ６、Ｂ１０…Ｂ３９８”、“Ｒ３、
Ｒ７、Ｒ１１…Ｒ３９９”及び“Ｇ３、Ｇ７、Ｇ１１…
Ｇ３９９”の再整列されたビデオデータが、そして第３
補助バス（ＳＢ３）には“Ｒ４、Ｒ８、Ｒ１２…Ｒ４０
０”、“Ｇ４、Ｇ８、Ｇ１２…Ｇ４００”及び“Ｂ４、
Ｂ８、Ｂ１２…Ｂ４００”の再整列されたビデオデータ
がそれぞれ供給される。また、第１乃至第３補助バス等
（ＳＢ１乃至ＳＢ３）と時間的に交替になるように再整
列されたビデオデータを入力する第４乃至第６補助バス
等（ＳＢ４乃至ＳＢ６）には、“Ｇ４０１、Ｇ４０５、
Ｇ４０９…Ｇ７９７”、“Ｂ４０１、Ｂ４０５、Ｂ４０
９…Ｂ７９７”及び“Ｒ４０２、Ｒ４０６、Ｒ４１０…
Ｒ７９８”の再整列されたビデオデータ、“Ｂ４０２、
Ｂ４０６、Ｂ４１０…Ｂ７９８”、“Ｒ４０３、Ｒ４０
７、Ｒ４１１…Ｒ７９９”及び“Ｇ４０３、Ｇ４０７、
Ｇ４１１…Ｇ７９９”の再整列されたビデオデータ、そ
して“Ｒ４０４、Ｒ４０８、Ｒ４１２…Ｒ８００”、
“Ｇ４０４、Ｇ４０８、Ｇ４１２…Ｇ８００”及び“Ｂ
４０４、Ｂ４０８、Ｂ４１２…Ｂ８００”の再整列され
たビデオデータがそれぞれ供給される。
【００２１】次に、Ｄ−ＩＣ等（２４ａ、２４ｂ)等の
６００個の出力ライン（ＬＤ１乃至ＬＤ６００）のそれ
ぞれには、選択信号等（ＳＥＬ１乃至ＳＥＬ４）が順次
的にイネーブル、すなわちハイ論理を有することによ
り、４個のビデオ信号が順次的に出力される。例えば、
Ｄ−ＩＣ（２４ａ)の第１出力端子（ＬＤ１）に“Ｒ
１、Ｇ１、Ｂ１及びＲ２”のビデオ信号が順次的に出力
され、そしてＤ−ＩＣ（２４ａ)の第２出力端子（ＬＤ
２）に“Ｇ２、Ｂ２、Ｒ３及びＧ３”のビデオ信号が順
次的に出力される。このような形態に、Ｄ−ＩＣ（２４
ａ)の第３乃至第６出力端子等（ＬＤ３乃至ＬＤ６）の
それぞれにも“Ｂ３、Ｒ４、Ｇ４及びＢ４”のビデオ信
号等と、“Ｒ５、Ｇ５、Ｂ５及びＲ６”のビデオ信号等
と、“Ｇ６、Ｂ６、Ｒ７及びＧ７”のビデオ信号等と、
そして“Ｂ７、Ｒ８、Ｇ８及びＢ８”のビデオ信号等と
が供給される。
６００個の出力ライン（ＬＤ１乃至ＬＤ６００）のそれ
ぞれには、選択信号等（ＳＥＬ１乃至ＳＥＬ４）が順次
的にイネーブル、すなわちハイ論理を有することによ
り、４個のビデオ信号が順次的に出力される。例えば、
Ｄ−ＩＣ（２４ａ)の第１出力端子（ＬＤ１）に“Ｒ
１、Ｇ１、Ｂ１及びＲ２”のビデオ信号が順次的に出力
され、そしてＤ−ＩＣ（２４ａ)の第２出力端子（ＬＤ
２）に“Ｇ２、Ｂ２、Ｒ３及びＧ３”のビデオ信号が順
次的に出力される。このような形態に、Ｄ−ＩＣ（２４
ａ)の第３乃至第６出力端子等（ＬＤ３乃至ＬＤ６）の
それぞれにも“Ｂ３、Ｒ４、Ｇ４及びＢ４”のビデオ信
号等と、“Ｒ５、Ｇ５、Ｂ５及びＲ６”のビデオ信号等
と、“Ｇ６、Ｂ６、Ｒ７及びＧ７”のビデオ信号等と、
そして“Ｂ７、Ｒ８、Ｇ８及びＢ８”のビデオ信号等と
が供給される。
【００２２】このＤ−ＩＣ等（２４ａ、２４ｂ)の６０
０個の出力端子等（ＬＤ１乃至ＬＤ６００）に４回にか
けて出力される２４００個のビデオ信号等は、第１乃至
第４選択信号（ＳＥＬ１乃至ＳＥＬ４）によって切換動
作を遂行する６００個のマルチプレクサ（ＭＵＸ１乃至
ＭＵＸ６００）によって、２４００個のデータライン等
（ＤＬ１乃至ＤＬ２４００）にそれぞれ印加されるよう
になる。その結果、画素マトリクス（２０）を駆動する
ために使用されるＤ−ＩＣ等の数が大幅（例えば８個か
ら２個に）に減少されるようになる。
０個の出力端子等（ＬＤ１乃至ＬＤ６００）に４回にか
けて出力される２４００個のビデオ信号等は、第１乃至
第４選択信号（ＳＥＬ１乃至ＳＥＬ４）によって切換動
作を遂行する６００個のマルチプレクサ（ＭＵＸ１乃至
ＭＵＸ６００）によって、２４００個のデータライン等
（ＤＬ１乃至ＤＬ２４００）にそれぞれ印加されるよう
になる。その結果、画素マトリクス（２０）を駆動する
ために使用されるＤ−ＩＣ等の数が大幅（例えば８個か
ら２個に）に減少されるようになる。
【００２３】図４は、データ再整列部（２６）から再整
列されたビデオデータが、第１乃至第３補助バス（ＳＢ
１乃至ＳＢ３）と第４乃至第６補助バス（ＳＢ４乃至Ｓ
Ｂ６）に同時に出力される場合、データ再整列部（２
６）、Ｄ−ＩＣ等（２４）及びマルチプレクサ等（ＭＵ
Ｘ１乃至ＭＵＸ６００）の動作波形を図示する。
列されたビデオデータが、第１乃至第３補助バス（ＳＢ
１乃至ＳＢ３）と第４乃至第６補助バス（ＳＢ４乃至Ｓ
Ｂ６）に同時に出力される場合、データ再整列部（２
６）、Ｄ−ＩＣ等（２４）及びマルチプレクサ等（ＭＵ
Ｘ１乃至ＭＵＸ６００）の動作波形を図示する。
【００２４】図４において、第１乃至第３補助バス等
（ＳＢ１乃至ＳＢ３）と第４乃至第６補助バス等（ＳＢ
４乃至ＳＢ６）のそれぞれに供給される再整列されたビ
デオデータは、選択信号等（ＳＥＬ１乃至ＳＥＬ４）が
順次的にイネーブルされることにより、４回にかけて変
更される。これを詳細に説明すると、第１選択信号（Ｓ
ＥＬ１）がイネーブルされた時点から第４選択信号（Ｓ
ＥＬ４）がイネーブルされる時点までの期間の間、第１
補助バス（ＳＢ１）に“Ｒ１、Ｒ５、Ｒ９…Ｒ３９７”
の再整列されたビデオデータから、“Ｇ１、Ｇ５、Ｇ９
…Ｇ３９７”、“Ｂ１、Ｂ５、Ｂ９…Ｂ３９７”及び
“Ｒ２、Ｒ６、Ｒ１０…Ｒ３９８”の再整列されたビデ
オデータが順次的に供給される。そして第２乃至第６補
助バス（ＳＢ２乃至ＳＢ６）のそれぞれにも、“Ｇ２、
Ｇ６、Ｇ１０…Ｇ３９８”、“Ｂ２、Ｂ６、Ｂ１０…Ｂ
３９８”、“Ｒ３、Ｒ７、Ｒ１１…Ｒ３９９”及び“Ｇ
３、Ｇ７、Ｇ１１…Ｇ３９９”の再整列されたビデオデ
ータと、“Ｂ３、Ｂ７、Ｂ１１…Ｂ３９９”、“Ｒ４、
Ｒ８、Ｒ１２…Ｒ４００”、“Ｇ４、Ｇ８、Ｇ１２…Ｇ
４００”及び“Ｂ４、Ｂ８、Ｂ１２…Ｂ４００”の再整
列されたビデオデータと、“Ｒ４０１、Ｒ４０５、Ｒ４
０９…Ｒ７９７”、“Ｇ４０１、Ｇ４０５、Ｇ４０９…
Ｇ７９７”、“Ｂ４０１、Ｂ４０５、Ｂ４０９…Ｂ７９
７”及び“Ｒ４０２、Ｒ４０６、Ｒ４１０…Ｒ７９８”
の再整列されたビデオデータと、“Ｇ４０２、Ｇ４０
６、Ｇ４１０…Ｇ７９８”、“Ｂ４０２、Ｂ４０６、Ｂ
４１０…Ｂ７９８”、“Ｒ４０３、Ｒ４０７、Ｒ４１１
…Ｒ７９９”及び“Ｇ４０３、Ｇ４０７、Ｇ４１１…Ｇ
７９９”の再整列されたビデオデータと、そして“Ｂ４
０３、Ｂ４０７、Ｂ４１１…Ｂ７９９”、“Ｒ４０４、
Ｒ４０８、Ｒ４１２…Ｒ８００”、“Ｇ４０４、Ｇ４０
８、Ｇ４１２…Ｇ８００”及び“Ｂ４０４、Ｂ４０８、
Ｂ４１２…Ｂ８００”の再整列されたビデオデータがそ
れぞれ供給される。
（ＳＢ１乃至ＳＢ３）と第４乃至第６補助バス等（ＳＢ
４乃至ＳＢ６）のそれぞれに供給される再整列されたビ
デオデータは、選択信号等（ＳＥＬ１乃至ＳＥＬ４）が
順次的にイネーブルされることにより、４回にかけて変
更される。これを詳細に説明すると、第１選択信号（Ｓ
ＥＬ１）がイネーブルされた時点から第４選択信号（Ｓ
ＥＬ４）がイネーブルされる時点までの期間の間、第１
補助バス（ＳＢ１）に“Ｒ１、Ｒ５、Ｒ９…Ｒ３９７”
の再整列されたビデオデータから、“Ｇ１、Ｇ５、Ｇ９
…Ｇ３９７”、“Ｂ１、Ｂ５、Ｂ９…Ｂ３９７”及び
“Ｒ２、Ｒ６、Ｒ１０…Ｒ３９８”の再整列されたビデ
オデータが順次的に供給される。そして第２乃至第６補
助バス（ＳＢ２乃至ＳＢ６）のそれぞれにも、“Ｇ２、
Ｇ６、Ｇ１０…Ｇ３９８”、“Ｂ２、Ｂ６、Ｂ１０…Ｂ
３９８”、“Ｒ３、Ｒ７、Ｒ１１…Ｒ３９９”及び“Ｇ
３、Ｇ７、Ｇ１１…Ｇ３９９”の再整列されたビデオデ
ータと、“Ｂ３、Ｂ７、Ｂ１１…Ｂ３９９”、“Ｒ４、
Ｒ８、Ｒ１２…Ｒ４００”、“Ｇ４、Ｇ８、Ｇ１２…Ｇ
４００”及び“Ｂ４、Ｂ８、Ｂ１２…Ｂ４００”の再整
列されたビデオデータと、“Ｒ４０１、Ｒ４０５、Ｒ４
０９…Ｒ７９７”、“Ｇ４０１、Ｇ４０５、Ｇ４０９…
Ｇ７９７”、“Ｂ４０１、Ｂ４０５、Ｂ４０９…Ｂ７９
７”及び“Ｒ４０２、Ｒ４０６、Ｒ４１０…Ｒ７９８”
の再整列されたビデオデータと、“Ｇ４０２、Ｇ４０
６、Ｇ４１０…Ｇ７９８”、“Ｂ４０２、Ｂ４０６、Ｂ
４１０…Ｂ７９８”、“Ｒ４０３、Ｒ４０７、Ｒ４１１
…Ｒ７９９”及び“Ｇ４０３、Ｇ４０７、Ｇ４１１…Ｇ
７９９”の再整列されたビデオデータと、そして“Ｂ４
０３、Ｂ４０７、Ｂ４１１…Ｂ７９９”、“Ｒ４０４、
Ｒ４０８、Ｒ４１２…Ｒ８００”、“Ｇ４０４、Ｇ４０
８、Ｇ４１２…Ｇ８００”及び“Ｂ４０４、Ｂ４０８、
Ｂ４１２…Ｂ８００”の再整列されたビデオデータがそ
れぞれ供給される。
【００２５】次に、Ｄ−ＩＣ等（２４ａ、２４ｂ)の６
００個の出力ライン（ＬＤ１乃至ＬＤ６００）のそれぞ
れには、選択信号等（ＳＥＬ１乃至ＳＥＬ４）が順次的
にイネーブル、すなわちハイ論理を有することにより、
４個のビデオ信号が順次的に出力される。例えば、Ｄ−
ＩＣ（２４ａ）の第１出力端子（ＬＤ１）に“Ｒ１、Ｇ
１、Ｂ１及びＲ２”のビデオ信号が順次的に出力され、
そしてＤ−ＩＣ（２４ａ)の第２出力端子（ＬＤ２）に
“Ｇ２、Ｂ２、Ｒ３及びＧ３”のビデオ信号が順次的に
出力される。このような形態に、Ｄ−ＩＣ（２４ａ)の
第３乃至第６出力端子等（ＬＤ３乃至ＬＤ６）のそれぞ
れにも、“Ｂ３、Ｒ４、Ｇ４及びＢ４”のビデオ信号等
と、“Ｒ５、Ｇ５、Ｂ５及びＲ６”のビデオ信号等と、
“Ｇ６、Ｂ６、Ｒ７及びＧ７”のビデオ信号等と、そし
て“Ｂ７、Ｒ８、Ｇ８及びＢ８”のビデオ信号等とが供
給される。
００個の出力ライン（ＬＤ１乃至ＬＤ６００）のそれぞ
れには、選択信号等（ＳＥＬ１乃至ＳＥＬ４）が順次的
にイネーブル、すなわちハイ論理を有することにより、
４個のビデオ信号が順次的に出力される。例えば、Ｄ−
ＩＣ（２４ａ）の第１出力端子（ＬＤ１）に“Ｒ１、Ｇ
１、Ｂ１及びＲ２”のビデオ信号が順次的に出力され、
そしてＤ−ＩＣ（２４ａ)の第２出力端子（ＬＤ２）に
“Ｇ２、Ｂ２、Ｒ３及びＧ３”のビデオ信号が順次的に
出力される。このような形態に、Ｄ−ＩＣ（２４ａ)の
第３乃至第６出力端子等（ＬＤ３乃至ＬＤ６）のそれぞ
れにも、“Ｂ３、Ｒ４、Ｇ４及びＢ４”のビデオ信号等
と、“Ｒ５、Ｇ５、Ｂ５及びＲ６”のビデオ信号等と、
“Ｇ６、Ｂ６、Ｒ７及びＧ７”のビデオ信号等と、そし
て“Ｂ７、Ｒ８、Ｇ８及びＢ８”のビデオ信号等とが供
給される。
【００２６】このＤ−ＩＣ等（２４ａ、２４ｂ)の６０
０個の出力端子等（ＬＤ１乃至ＬＤ６００）に４回にか
けて出力される２４００個のビデオ信号等は、第１乃至
第４選択信号（ＳＥＬ１乃至ＳＥＬ４）によって切換動
作を遂行する６００個のマルチプレクサ（ＭＵＸ１乃至
ＭＵＸ６００）によって、２４００個のデータライン等
（ＤＬ１乃至ＤＬ２４００）にそれぞれ印加されるよう
になる。その結果、画素マトリクス（２０）を駆動する
ために使用されるＤ−ＩＣ等の数が大幅（例えば８個か
ら２個に）に減少されるようになる。併せて、ビデオデ
ータがＤ−ＩＣ等（２４ａ、２４ｂ)に同時に供給され
ることにより、ビデオデータをサンプリングするために
Ｄ−ＩＣ等（２４ａ、２４ｂ)に供給されるサンプリン
グクロックの周波数が低くなる。
０個の出力端子等（ＬＤ１乃至ＬＤ６００）に４回にか
けて出力される２４００個のビデオ信号等は、第１乃至
第４選択信号（ＳＥＬ１乃至ＳＥＬ４）によって切換動
作を遂行する６００個のマルチプレクサ（ＭＵＸ１乃至
ＭＵＸ６００）によって、２４００個のデータライン等
（ＤＬ１乃至ＤＬ２４００）にそれぞれ印加されるよう
になる。その結果、画素マトリクス（２０）を駆動する
ために使用されるＤ−ＩＣ等の数が大幅（例えば８個か
ら２個に）に減少されるようになる。併せて、ビデオデ
ータがＤ−ＩＣ等（２４ａ、２４ｂ)に同時に供給され
ることにより、ビデオデータをサンプリングするために
Ｄ−ＩＣ等（２４ａ、２４ｂ)に供給されるサンプリン
グクロックの周波数が低くなる。
【００２７】図５は、図２に図示されたデータ再整列部
（２６）の一実施の形態を詳細に図示する。
（２６）の一実施の形態を詳細に図示する。
【００２８】図５において、データ再整列部（２６）
は、赤色用、緑色用及び青色用バス等（ＭＲＢ、ＭＧ
Ｂ、ＭＢＢ）のそれぞれに接続された第１乃至第３デー
タマルチプレクサ（３０、３２、３４）と、この第１乃
至第３データマルチプレクサ等（３０、３２、３４）の
それぞれに４個づつ並列接続された第１乃至第１２シリ
アル入力シリアル出力（First Input First Output；以
下“ＦＩＦＯ”という）（ＦＲ１乃至ＦＲ１２）を備え
る。第１乃至第３データマルチプレクサ等（３０、３
２、３４）は、第１分割イネーブル信号（ＥＮａ）がハ
イ論理を維持する間、すなわち水平走査期間の半分に該
当する期間の間に駆動される。そして第１データマルチ
プレクサ（３０）は、赤色用バス（ＭＲＢ）からの赤色
データストリーム（Ｒ１乃至Ｒ８００）の中の半分に該
当する４００個の赤色データ（Ｒ１乃至Ｒ４００）を順
次的で反復的に変化する２ビットの選択信号（Ａ、Ｂ）
の論理値によって、第１乃至第４ＦＩＦＯ（ＦＲ１乃至
ＦＲ４）に順次的で反復的に貯蔵する。その結果、第１
乃至第４ＦＩＦＯ（ＦＲ１乃至ＦＲ４）には“Ｒ１、Ｒ
５、Ｒ９…Ｒ３９７”、“Ｒ２、Ｒ６、Ｒ１０…Ｒ３９
８”、“Ｒ３、Ｒ７、Ｒ１１…Ｒ３９９”及び“Ｒ４、
Ｒ８、Ｒ１２…Ｒ４００”の赤色データがそれぞれ貯蔵
される。第１データマルチプレクサ（３０）と同様に、
第２データマルチプレクサ（３２）は、緑色用バス（Ｍ
ＧＢ）からの緑色データストリーム（Ｇ１乃至Ｇ８０
０）の中の半分に該当する４００個の緑色データ（Ｇ１
乃至Ｇ４００）を、前記２ビットの選択信号（Ａ、Ｂ）
の論理値によって、第５乃至第８ＦＩＦＯ（ＦＲ５乃至
ＦＲ８）に順次的で反復的に貯蔵する。従って、第５乃
至第８ＦＩＦＯ（ＦＲ５乃至ＦＲ８）には“Ｇ１、Ｇ
５、Ｇ９…Ｇ３９７”、“Ｇ２、Ｇ６、Ｇ１０…Ｇ３９
８”、“Ｇ３、Ｇ７、Ｇ１１…Ｇ３９９”及び“Ｇ４、
Ｇ８、Ｇ１２…Ｇ４００”の緑色データがそれぞれ貯蔵
される。また、第３データマルチプレクサ（３４）も、
第１及び第２データマルチプレクサ（３０、３２）と同
様に、青色用バス（ＭＢＢ）からの青色データストリー
ム（Ｂ１乃至Ｂ８００）の中の半分に該当する４００個
の青色データ（Ｂ１乃至Ｂ４００）を、前記２ビットの
選択信号（Ａ、Ｂ）の論理値によって、第９乃至第１２
ＦＩＦＯ（ＦＲ９乃至ＦＲ１２）に順次的で反復的に貯
蔵する。それによって、第９乃至第１２ＦＩＦＯ（ＦＲ
９乃至ＦＲ１２）には“Ｂ１、Ｂ５、Ｂ９…Ｂ３９
７”、“Ｂ２、Ｂ６、Ｂ１０…Ｂ３９８”、“Ｂ３、Ｂ
７、Ｂ１１…Ｂ３９９”及び“Ｂ４、Ｂ８、Ｂ１２…Ｂ
４００”の青色データがそれぞれ貯蔵される。
は、赤色用、緑色用及び青色用バス等（ＭＲＢ、ＭＧ
Ｂ、ＭＢＢ）のそれぞれに接続された第１乃至第３デー
タマルチプレクサ（３０、３２、３４）と、この第１乃
至第３データマルチプレクサ等（３０、３２、３４）の
それぞれに４個づつ並列接続された第１乃至第１２シリ
アル入力シリアル出力（First Input First Output；以
下“ＦＩＦＯ”という）（ＦＲ１乃至ＦＲ１２）を備え
る。第１乃至第３データマルチプレクサ等（３０、３
２、３４）は、第１分割イネーブル信号（ＥＮａ）がハ
イ論理を維持する間、すなわち水平走査期間の半分に該
当する期間の間に駆動される。そして第１データマルチ
プレクサ（３０）は、赤色用バス（ＭＲＢ）からの赤色
データストリーム（Ｒ１乃至Ｒ８００）の中の半分に該
当する４００個の赤色データ（Ｒ１乃至Ｒ４００）を順
次的で反復的に変化する２ビットの選択信号（Ａ、Ｂ）
の論理値によって、第１乃至第４ＦＩＦＯ（ＦＲ１乃至
ＦＲ４）に順次的で反復的に貯蔵する。その結果、第１
乃至第４ＦＩＦＯ（ＦＲ１乃至ＦＲ４）には“Ｒ１、Ｒ
５、Ｒ９…Ｒ３９７”、“Ｒ２、Ｒ６、Ｒ１０…Ｒ３９
８”、“Ｒ３、Ｒ７、Ｒ１１…Ｒ３９９”及び“Ｒ４、
Ｒ８、Ｒ１２…Ｒ４００”の赤色データがそれぞれ貯蔵
される。第１データマルチプレクサ（３０）と同様に、
第２データマルチプレクサ（３２）は、緑色用バス（Ｍ
ＧＢ）からの緑色データストリーム（Ｇ１乃至Ｇ８０
０）の中の半分に該当する４００個の緑色データ（Ｇ１
乃至Ｇ４００）を、前記２ビットの選択信号（Ａ、Ｂ）
の論理値によって、第５乃至第８ＦＩＦＯ（ＦＲ５乃至
ＦＲ８）に順次的で反復的に貯蔵する。従って、第５乃
至第８ＦＩＦＯ（ＦＲ５乃至ＦＲ８）には“Ｇ１、Ｇ
５、Ｇ９…Ｇ３９７”、“Ｇ２、Ｇ６、Ｇ１０…Ｇ３９
８”、“Ｇ３、Ｇ７、Ｇ１１…Ｇ３９９”及び“Ｇ４、
Ｇ８、Ｇ１２…Ｇ４００”の緑色データがそれぞれ貯蔵
される。また、第３データマルチプレクサ（３４）も、
第１及び第２データマルチプレクサ（３０、３２）と同
様に、青色用バス（ＭＢＢ）からの青色データストリー
ム（Ｂ１乃至Ｂ８００）の中の半分に該当する４００個
の青色データ（Ｂ１乃至Ｂ４００）を、前記２ビットの
選択信号（Ａ、Ｂ）の論理値によって、第９乃至第１２
ＦＩＦＯ（ＦＲ９乃至ＦＲ１２）に順次的で反復的に貯
蔵する。それによって、第９乃至第１２ＦＩＦＯ（ＦＲ
９乃至ＦＲ１２）には“Ｂ１、Ｂ５、Ｂ９…Ｂ３９
７”、“Ｂ２、Ｂ６、Ｂ１０…Ｂ３９８”、“Ｂ３、Ｂ
７、Ｂ１１…Ｂ３９９”及び“Ｂ４、Ｂ８、Ｂ１２…Ｂ
４００”の青色データがそれぞれ貯蔵される。
【００２９】そしてデータ再整列部（２６）は、赤色
用、緑色用及び青色用バス等（ＭＲＢ、ＭＧＢ、ＭＢ
Ｂ）にそれぞれ接続されると共に、第１乃至第３データ
マルチプレクサ（３０、３２、３４）とそれぞれ並列接
続された、第４乃至第６データマルチプレクサ（３６、
３８、４０）を追加で備える。この第４乃至第６データ
マルチプレクサ等（３６、３８、４０）のそれぞれに４
個づつのＦＩＦＯ等、すなわち第１３乃至第２４ＦＩＦ
Ｏ（ＦＲ１３乃至ＦＲ２４）が接続されている。第４乃
至第６データマルチプレクサ（３６、３８、４０）は、
第２分割イネーブル信号（ＥＮｂ）がハイ論理を維持す
る間、すなわち第１乃至第３データマルチプレクサ（３
０、３２、３４）が駆動されない水平走査期間の後半部
に該当する期間の間に駆動される。そして、第４データ
マルチプレクサ（３６）は、赤色用バス（ＭＲＢ）から
の赤色データストリーム（Ｒ１乃至Ｒ８００）の中の半
分に該当する４００個の赤色データ（Ｒ４０１乃至Ｒ４
００）を、前記２ビットの選択信号（Ａ、Ｂ）の論理値
によって、第１３乃至第１６ＦＩＦＯ（ＦＲ１３乃至Ｆ
Ｒ１６）に順次的で反復的に貯蔵する。その結果、第１
３乃至第１６ＦＩＦＯ（ＦＲ１３乃至ＦＲ１６）には、
“Ｒ４０１、Ｒ４０５、Ｒ４０９…Ｒ７９７”、“Ｒ４
０２、Ｒ４０６、Ｒ４１０…Ｒ７９８”、“Ｒ４０３、
Ｒ４０７、Ｒ４１１…Ｒ７９９”及び“Ｒ４０４、Ｒ４
０８、Ｒ４１２…Ｒ８００”の赤色データがそれぞれ貯
蔵される。そして第５データマルチプレクサ（３８）
は、緑色用バス（ＭＧＢ）からの緑色データストリーム
（Ｇ１乃至Ｇ８００）の中の半分に該当する４００個の
緑色データ（Ｇ４０１乃至Ｇ８００）を、前記２ビット
の選択信号（Ａ、Ｂ）の論理値によって、第１７乃至第
２０ＦＩＦＯ（ＦＲ１７乃至ＦＲ２０）に順次的で反復
的に貯蔵する。従って、第１７乃至第２０ＦＩＦＯ（Ｆ
Ｒ１７乃至ＦＲ２０）には、“Ｇ４０１、Ｇ４０５、Ｇ
４０９…Ｇ７９７”、“Ｇ４０２、Ｇ４０６、Ｇ４１０
…Ｇ７９８”、“Ｇ４０３、Ｇ４０７、Ｇ４１１…Ｇ７
９９”及び“Ｇ４０４、Ｇ４０８、Ｇ４１２…Ｇ８０
０”の緑色データがそれぞれ貯蔵される。また、第６デ
ータマルチプレクサ（４０）も、青色用バス（ＭＢＢ）
からの青色データストリーム（Ｂ１乃至Ｂ８００）の中
の半分に該当する４００個の青色データ（Ｂ４０１乃至
Ｂ８００）を、前記２ビットの選択信号（Ａ、Ｂ）の論
理値によって、第２１乃至第２４ＦＩＦＯ（ＦＲ２１乃
至ＦＲ２４）に順次的で反復的に貯蔵する。それによっ
て、第２１乃至第２４ＦＩＦＯ（ＦＲ２１乃至ＦＲ２
４）には、“Ｂ４０１、Ｂ４０５、Ｂ４０９…Ｂ７９
７”、“Ｂ４０２、Ｂ４０６、Ｂ４１０…Ｂ７９８”、
“Ｂ４０３、Ｂ４０７、Ｂ４１１…Ｂ７９９”及び“Ｂ
４０４、Ｂ４０８、Ｂ４１２…Ｂ８００”の青色データ
がそれぞれ貯蔵される。
用、緑色用及び青色用バス等（ＭＲＢ、ＭＧＢ、ＭＢ
Ｂ）にそれぞれ接続されると共に、第１乃至第３データ
マルチプレクサ（３０、３２、３４）とそれぞれ並列接
続された、第４乃至第６データマルチプレクサ（３６、
３８、４０）を追加で備える。この第４乃至第６データ
マルチプレクサ等（３６、３８、４０）のそれぞれに４
個づつのＦＩＦＯ等、すなわち第１３乃至第２４ＦＩＦ
Ｏ（ＦＲ１３乃至ＦＲ２４）が接続されている。第４乃
至第６データマルチプレクサ（３６、３８、４０）は、
第２分割イネーブル信号（ＥＮｂ）がハイ論理を維持す
る間、すなわち第１乃至第３データマルチプレクサ（３
０、３２、３４）が駆動されない水平走査期間の後半部
に該当する期間の間に駆動される。そして、第４データ
マルチプレクサ（３６）は、赤色用バス（ＭＲＢ）から
の赤色データストリーム（Ｒ１乃至Ｒ８００）の中の半
分に該当する４００個の赤色データ（Ｒ４０１乃至Ｒ４
００）を、前記２ビットの選択信号（Ａ、Ｂ）の論理値
によって、第１３乃至第１６ＦＩＦＯ（ＦＲ１３乃至Ｆ
Ｒ１６）に順次的で反復的に貯蔵する。その結果、第１
３乃至第１６ＦＩＦＯ（ＦＲ１３乃至ＦＲ１６）には、
“Ｒ４０１、Ｒ４０５、Ｒ４０９…Ｒ７９７”、“Ｒ４
０２、Ｒ４０６、Ｒ４１０…Ｒ７９８”、“Ｒ４０３、
Ｒ４０７、Ｒ４１１…Ｒ７９９”及び“Ｒ４０４、Ｒ４
０８、Ｒ４１２…Ｒ８００”の赤色データがそれぞれ貯
蔵される。そして第５データマルチプレクサ（３８）
は、緑色用バス（ＭＧＢ）からの緑色データストリーム
（Ｇ１乃至Ｇ８００）の中の半分に該当する４００個の
緑色データ（Ｇ４０１乃至Ｇ８００）を、前記２ビット
の選択信号（Ａ、Ｂ）の論理値によって、第１７乃至第
２０ＦＩＦＯ（ＦＲ１７乃至ＦＲ２０）に順次的で反復
的に貯蔵する。従って、第１７乃至第２０ＦＩＦＯ（Ｆ
Ｒ１７乃至ＦＲ２０）には、“Ｇ４０１、Ｇ４０５、Ｇ
４０９…Ｇ７９７”、“Ｇ４０２、Ｇ４０６、Ｇ４１０
…Ｇ７９８”、“Ｇ４０３、Ｇ４０７、Ｇ４１１…Ｇ７
９９”及び“Ｇ４０４、Ｇ４０８、Ｇ４１２…Ｇ８０
０”の緑色データがそれぞれ貯蔵される。また、第６デ
ータマルチプレクサ（４０）も、青色用バス（ＭＢＢ）
からの青色データストリーム（Ｂ１乃至Ｂ８００）の中
の半分に該当する４００個の青色データ（Ｂ４０１乃至
Ｂ８００）を、前記２ビットの選択信号（Ａ、Ｂ）の論
理値によって、第２１乃至第２４ＦＩＦＯ（ＦＲ２１乃
至ＦＲ２４）に順次的で反復的に貯蔵する。それによっ
て、第２１乃至第２４ＦＩＦＯ（ＦＲ２１乃至ＦＲ２
４）には、“Ｂ４０１、Ｂ４０５、Ｂ４０９…Ｂ７９
７”、“Ｂ４０２、Ｂ４０６、Ｂ４１０…Ｂ７９８”、
“Ｂ４０３、Ｂ４０７、Ｂ４１１…Ｂ７９９”及び“Ｂ
４０４、Ｂ４０８、Ｂ４１２…Ｂ８００”の青色データ
がそれぞれ貯蔵される。
【００３０】また、データ再整列部（２６）は第１乃至
第１２ＦＩＦＯ（ＦＲ１乃至ＦＲ１２）からのビデオデ
ータを入力する第１ディマルチプレクサ（４２）と、第
１３乃至第２４ＦＩＦＯ（ＦＲ１３乃至ＦＲ２４）から
のビデオデータを入力する第２ディマルチプレクサ（４
４）とを備える。これ等の第１及び第２ディマルチプレ
クサ（４２、４４）は、図３における第１乃至第４選択
信号（ＳＥＬ１乃至ＳＥＬ４）のそれぞれがイネーブル
される期間毎に、１回づつ交替に駆動される。例えば、
前記の第１選択信号（ＳＥＬ１）のイネーブル期間の前
半部では第１ディマルチプレクサ（４２）が、そして前
記の第１選択信号（ＳＥＬ１）のイネーブル期間の後半
部では第２ディマルチプレクサ（４４）が駆動される。
従って、第１及び第２ディマルチプレクサ（４２、４
４）は、第１乃至第４選択信号（ＳＥＬ１乃至ＳＥＬ
４）が順次的にイネーブルされることにより交替に４回
づつ駆動され、１水平ラインのビデオデータを第１乃至
第６補助バス（ＳＢ１乃至ＳＢ６）を経由して出力する
ようになる。そして第１及び第２ディマルチプレクサ
（４２、４４）は、駆動される時毎に、それぞれ１２個
のＦＩＦＯ（ＦＲ１乃至ＦＲ１２、またはＦＲ１３乃至
ＦＲ２４）の中の３個のＦＩＦＯ等に貯蔵されたビデオ
データを選択し、３個の補助バス（ＳＢ１乃至ＳＢ３、
またはＳＢ４乃至ＳＢ６）にそれぞれ出力する。
第１２ＦＩＦＯ（ＦＲ１乃至ＦＲ１２）からのビデオデ
ータを入力する第１ディマルチプレクサ（４２）と、第
１３乃至第２４ＦＩＦＯ（ＦＲ１３乃至ＦＲ２４）から
のビデオデータを入力する第２ディマルチプレクサ（４
４）とを備える。これ等の第１及び第２ディマルチプレ
クサ（４２、４４）は、図３における第１乃至第４選択
信号（ＳＥＬ１乃至ＳＥＬ４）のそれぞれがイネーブル
される期間毎に、１回づつ交替に駆動される。例えば、
前記の第１選択信号（ＳＥＬ１）のイネーブル期間の前
半部では第１ディマルチプレクサ（４２）が、そして前
記の第１選択信号（ＳＥＬ１）のイネーブル期間の後半
部では第２ディマルチプレクサ（４４）が駆動される。
従って、第１及び第２ディマルチプレクサ（４２、４
４）は、第１乃至第４選択信号（ＳＥＬ１乃至ＳＥＬ
４）が順次的にイネーブルされることにより交替に４回
づつ駆動され、１水平ラインのビデオデータを第１乃至
第６補助バス（ＳＢ１乃至ＳＢ６）を経由して出力する
ようになる。そして第１及び第２ディマルチプレクサ
（４２、４４）は、駆動される時毎に、それぞれ１２個
のＦＩＦＯ（ＦＲ１乃至ＦＲ１２、またはＦＲ１３乃至
ＦＲ２４）の中の３個のＦＩＦＯ等に貯蔵されたビデオ
データを選択し、３個の補助バス（ＳＢ１乃至ＳＢ３、
またはＳＢ４乃至ＳＢ６）にそれぞれ出力する。
【００３１】これを詳細に説明すると、第１ディマルチ
プレクサ（４２）は、最初に駆動される時に第１ＦＩＦ
Ｏ（ＦＲ１）からの“Ｒ１、Ｒ５、Ｒ９…Ｒ３９７”の
赤色データと、第６ＦＩＦＯ（ＦＲ６）からの“Ｇ２、
Ｇ６、Ｇ１０…Ｇ３９８”の緑色データと、第１１ＦＩ
ＦＯ（ＦＲ１１）からの“Ｂ３、Ｂ７、Ｂ１１…Ｂ３９
９”の青色データを第１乃至第３補助バス（ＳＢ１乃至
ＳＢ３）にそれぞれ供給し、２番目に駆動される時は、
第５ＦＩＦＯ（ＦＲ５）からの“Ｇ１、Ｇ５、Ｇ９…Ｇ
３９７”の緑色データと、第１０ＦＩＦＯ（ＦＲ１０）
からの“Ｂ２、Ｂ６、Ｂ１０…Ｂ３９８”の青色データ
と、第４ＦＩＦＯ（ＦＲ４）からの“Ｒ４、Ｒ８、Ｒ１
２…Ｒ４００”の赤色データとを、第１乃至第３補助バ
ス（ＳＢ１乃至ＳＢ３）にそれぞれ供給する。そして、
第１ディマルチプレクサ（４２）は３番目に駆動される
時、第９ＦＩＦＯ（ＦＲ９）からの“Ｂ１、Ｂ５、Ｂ９
…Ｂ３９７”の青色データと、第２ＦＩＦＯ（ＦＲ２）
からの“Ｒ３、Ｒ７、Ｒ１１…Ｒ３９９”の赤色データ
と、第８ＦＩＦＯ（ＦＲ８）からの“Ｇ４、Ｇ８、Ｇ１
２…Ｇ４００”の緑色データとを、第１乃至第３補助バ
ス（ＳＢ１乃至ＳＢ３）にそれぞれ供給し、４番目に駆
動される時は、第２ＦＩＦＯ（ＦＲ２）からの“Ｒ２、
Ｒ６、Ｒ１０…Ｒ３９８”の赤色データと、第７ＦＩＦ
Ｏ（ＦＲ７）からの“Ｇ３、Ｇ７、Ｇ１１…Ｇ３９９”
の緑色データと、第１２ＦＩＦＯ（ＦＲ１２）からの
“Ｂ４、Ｂ８、Ｂ１２…Ｂ４００”の青色データとを、
第１乃至第３補助バス（ＳＢ１乃至ＳＢ３）にそれぞれ
供給する。一方、第２ディマルチプレクサ（４４）は、
最初に駆動される時に第１３ＦＩＦＯ（ＦＲ１３）から
の“Ｒ４０１、Ｒ４０５、Ｒ４０９…Ｒ７９７”の赤色
データと、第１８ＦＩＦＯ（ＦＲ１８）からの“Ｇ４０
２、Ｇ４０６、Ｇ４１０…Ｇ７９８”の緑色データと、
第２３ＦＩＦＯ（ＦＲ２３）からの“Ｂ４０３、Ｂ４０
７、Ｂ４１１…Ｂ７９９”の青色データとを、第４乃至
第６補助バス（ＳＢ４乃至ＳＢ６）にそれぞれ供給し、
２番目に駆動される時は、第１７ＦＩＦＯ（ＦＲ１７）
からの“Ｇ４０１、Ｇ４０５、Ｇ４０９…Ｇ７９７”の
緑色データと、第２２ＦＩＦＯ（ＦＲ２２）からの“Ｂ
４０２、Ｂ４０６、Ｂ４１０…Ｂ７９８”の青色データ
と、第１６ＦＩＦＯ（ＦＲ１６）からの“Ｒ４０４、Ｒ
４０８、Ｒ４１２…Ｒ８００”の赤色データとを、第４
乃至第６補助バス（ＳＢ４乃至ＳＢ６）にそれぞれ供給
する。また、第２ディマルチプレクサ（４４）は３番目
に駆動される時、第２１ＦＩＦＯ（ＦＲ２１）からの
“Ｂ４０１、Ｂ４０５、Ｂ４０９…Ｂ７９７”の青色デ
ータと、第１４ＦＩＦＯ（ＦＲ１４）からの“Ｒ４０
３、Ｒ４０７、Ｒ４１１…Ｒ７９９”の赤色データと、
第２０ＦＩＦＯ（ＦＲ２０）からの“Ｇ４０４、Ｇ４０
８、Ｇ４１２…Ｇ８００”の緑色データとを、第４乃至
第６補助バス（ＳＢ４乃至ＳＢ６）にそれぞれ供給し、
４番目に駆動される時は、第１４ＦＩＦＯ（ＦＲ１４）
からの“Ｒ４０２、Ｒ４０６、Ｒ４１０…Ｒ７９８”の
赤色データと、第１９ＦＩＦＯ（ＦＲ１９）からの“Ｇ
４０３、Ｇ４０７、Ｇ４１１…Ｇ７９７”の緑色データ
と、第２４ＦＩＦＯ（ＦＲ２４）からの“Ｂ４０４、Ｂ
４０８、Ｂ４１２…Ｂ８００”の青色データとを、第４
乃至第６補助バス（ＳＢ４乃至ＳＢ６）にそれぞれ供給
する。
プレクサ（４２）は、最初に駆動される時に第１ＦＩＦ
Ｏ（ＦＲ１）からの“Ｒ１、Ｒ５、Ｒ９…Ｒ３９７”の
赤色データと、第６ＦＩＦＯ（ＦＲ６）からの“Ｇ２、
Ｇ６、Ｇ１０…Ｇ３９８”の緑色データと、第１１ＦＩ
ＦＯ（ＦＲ１１）からの“Ｂ３、Ｂ７、Ｂ１１…Ｂ３９
９”の青色データを第１乃至第３補助バス（ＳＢ１乃至
ＳＢ３）にそれぞれ供給し、２番目に駆動される時は、
第５ＦＩＦＯ（ＦＲ５）からの“Ｇ１、Ｇ５、Ｇ９…Ｇ
３９７”の緑色データと、第１０ＦＩＦＯ（ＦＲ１０）
からの“Ｂ２、Ｂ６、Ｂ１０…Ｂ３９８”の青色データ
と、第４ＦＩＦＯ（ＦＲ４）からの“Ｒ４、Ｒ８、Ｒ１
２…Ｒ４００”の赤色データとを、第１乃至第３補助バ
ス（ＳＢ１乃至ＳＢ３）にそれぞれ供給する。そして、
第１ディマルチプレクサ（４２）は３番目に駆動される
時、第９ＦＩＦＯ（ＦＲ９）からの“Ｂ１、Ｂ５、Ｂ９
…Ｂ３９７”の青色データと、第２ＦＩＦＯ（ＦＲ２）
からの“Ｒ３、Ｒ７、Ｒ１１…Ｒ３９９”の赤色データ
と、第８ＦＩＦＯ（ＦＲ８）からの“Ｇ４、Ｇ８、Ｇ１
２…Ｇ４００”の緑色データとを、第１乃至第３補助バ
ス（ＳＢ１乃至ＳＢ３）にそれぞれ供給し、４番目に駆
動される時は、第２ＦＩＦＯ（ＦＲ２）からの“Ｒ２、
Ｒ６、Ｒ１０…Ｒ３９８”の赤色データと、第７ＦＩＦ
Ｏ（ＦＲ７）からの“Ｇ３、Ｇ７、Ｇ１１…Ｇ３９９”
の緑色データと、第１２ＦＩＦＯ（ＦＲ１２）からの
“Ｂ４、Ｂ８、Ｂ１２…Ｂ４００”の青色データとを、
第１乃至第３補助バス（ＳＢ１乃至ＳＢ３）にそれぞれ
供給する。一方、第２ディマルチプレクサ（４４）は、
最初に駆動される時に第１３ＦＩＦＯ（ＦＲ１３）から
の“Ｒ４０１、Ｒ４０５、Ｒ４０９…Ｒ７９７”の赤色
データと、第１８ＦＩＦＯ（ＦＲ１８）からの“Ｇ４０
２、Ｇ４０６、Ｇ４１０…Ｇ７９８”の緑色データと、
第２３ＦＩＦＯ（ＦＲ２３）からの“Ｂ４０３、Ｂ４０
７、Ｂ４１１…Ｂ７９９”の青色データとを、第４乃至
第６補助バス（ＳＢ４乃至ＳＢ６）にそれぞれ供給し、
２番目に駆動される時は、第１７ＦＩＦＯ（ＦＲ１７）
からの“Ｇ４０１、Ｇ４０５、Ｇ４０９…Ｇ７９７”の
緑色データと、第２２ＦＩＦＯ（ＦＲ２２）からの“Ｂ
４０２、Ｂ４０６、Ｂ４１０…Ｂ７９８”の青色データ
と、第１６ＦＩＦＯ（ＦＲ１６）からの“Ｒ４０４、Ｒ
４０８、Ｒ４１２…Ｒ８００”の赤色データとを、第４
乃至第６補助バス（ＳＢ４乃至ＳＢ６）にそれぞれ供給
する。また、第２ディマルチプレクサ（４４）は３番目
に駆動される時、第２１ＦＩＦＯ（ＦＲ２１）からの
“Ｂ４０１、Ｂ４０５、Ｂ４０９…Ｂ７９７”の青色デ
ータと、第１４ＦＩＦＯ（ＦＲ１４）からの“Ｒ４０
３、Ｒ４０７、Ｒ４１１…Ｒ７９９”の赤色データと、
第２０ＦＩＦＯ（ＦＲ２０）からの“Ｇ４０４、Ｇ４０
８、Ｇ４１２…Ｇ８００”の緑色データとを、第４乃至
第６補助バス（ＳＢ４乃至ＳＢ６）にそれぞれ供給し、
４番目に駆動される時は、第１４ＦＩＦＯ（ＦＲ１４）
からの“Ｒ４０２、Ｒ４０６、Ｒ４１０…Ｒ７９８”の
赤色データと、第１９ＦＩＦＯ（ＦＲ１９）からの“Ｇ
４０３、Ｇ４０７、Ｇ４１１…Ｇ７９７”の緑色データ
と、第２４ＦＩＦＯ（ＦＲ２４）からの“Ｂ４０４、Ｂ
４０８、Ｂ４１２…Ｂ８００”の青色データとを、第４
乃至第６補助バス（ＳＢ４乃至ＳＢ６）にそれぞれ供給
する。
【００３２】ここにおいて、第１乃至第３データマルチ
プレクサ（３０、３２、３４）は、第１乃至第１２ＦＩ
ＦＯ（ＦＲ１乃至ＦＲ１２）と、第１ディマルチプレク
サ（４２）と共に、１ライン分のビデオデータストリー
ムの一部を再整列する第１グループ再整列手段を構成
し、第４乃至第６データマルチプレクサ（３６、３８、
４０）は、第１３乃至第２４ＦＩＦＯ（ＦＲ１３乃至Ｆ
Ｒ２４）と第２ディマルチプレクサ（４４）と共に、１
ライン分のビデオデータストリームの一部を再整列する
第２グループ再整列手段を構成する。このグループ再整
列手段の数は、図２に図示されたＤ−ＩＣ（２４）の個
数ほど必要とされる。そして、データマルチプレクサ等
（３０乃至４０）のそれぞれに接続されるＦＩＦＯの数
は、図２に図示されたマルチプレクサ等（ＭＵＸ）の出
力ラインの数ほど必要とされる。また、ＦＩＦＯ等（Ｆ
Ｒ１乃至ＦＲ２４）の総貯蔵容量は、少なくとも１ライ
ン分以上のビデオデータを貯蔵することができれば問題
ないが、好ましくは２ライン分のビデオデータを貯蔵す
ることができるように設定されなければならない。ま
た、ＦＩＦＯ等（ＦＲ１乃至ＦＲ２４）の総貯蔵容量が
２ライン分のビデオデータを貯蔵するように設定された
場合に、第１及び第２ディマルチプレクサ（４２、４
４）が同時に駆動されることができる。それによって、
データサンプリングを制御するために、図２に図示され
たＤ−ＩＣ等（２４）に供給されるサンプリングクロッ
クの周波数を低めることができるようになる。
プレクサ（３０、３２、３４）は、第１乃至第１２ＦＩ
ＦＯ（ＦＲ１乃至ＦＲ１２）と、第１ディマルチプレク
サ（４２）と共に、１ライン分のビデオデータストリー
ムの一部を再整列する第１グループ再整列手段を構成
し、第４乃至第６データマルチプレクサ（３６、３８、
４０）は、第１３乃至第２４ＦＩＦＯ（ＦＲ１３乃至Ｆ
Ｒ２４）と第２ディマルチプレクサ（４４）と共に、１
ライン分のビデオデータストリームの一部を再整列する
第２グループ再整列手段を構成する。このグループ再整
列手段の数は、図２に図示されたＤ−ＩＣ（２４）の個
数ほど必要とされる。そして、データマルチプレクサ等
（３０乃至４０）のそれぞれに接続されるＦＩＦＯの数
は、図２に図示されたマルチプレクサ等（ＭＵＸ）の出
力ラインの数ほど必要とされる。また、ＦＩＦＯ等（Ｆ
Ｒ１乃至ＦＲ２４）の総貯蔵容量は、少なくとも１ライ
ン分以上のビデオデータを貯蔵することができれば問題
ないが、好ましくは２ライン分のビデオデータを貯蔵す
ることができるように設定されなければならない。ま
た、ＦＩＦＯ等（ＦＲ１乃至ＦＲ２４）の総貯蔵容量が
２ライン分のビデオデータを貯蔵するように設定された
場合に、第１及び第２ディマルチプレクサ（４２、４
４）が同時に駆動されることができる。それによって、
データサンプリングを制御するために、図２に図示され
たＤ−ＩＣ等（２４）に供給されるサンプリングクロッ
クの周波数を低めることができるようになる。
【００３３】図６は、図２に図示されたデータ再整列部
（２６）の他の実施の形態を詳細に図示する。
（２６）の他の実施の形態を詳細に図示する。
【００３４】図６において、データ再整列部（２６）
は、赤色用、緑色用及び青色用バス等（ＭＲＢ、ＭＧ
Ｂ、ＭＢＢ）からのビデオデータを第１乃至第１２メモ
リ（ＭＲ１乃至ＭＲ１２）にマルチプレキシングするた
めの、第１乃至第９制御用スイッチ等（ＳＷ１乃至ＳＷ
９）を備える。第１乃至第１２メモリ（ＭＲ１乃至ＭＲ
１２）のそれぞれは、１ライン分の色データの中の半分
に該当する色データを貯蔵することができる貯蔵容量を
有する。
は、赤色用、緑色用及び青色用バス等（ＭＲＢ、ＭＧ
Ｂ、ＭＢＢ）からのビデオデータを第１乃至第１２メモ
リ（ＭＲ１乃至ＭＲ１２）にマルチプレキシングするた
めの、第１乃至第９制御用スイッチ等（ＳＷ１乃至ＳＷ
９）を備える。第１乃至第１２メモリ（ＭＲ１乃至ＭＲ
１２）のそれぞれは、１ライン分の色データの中の半分
に該当する色データを貯蔵することができる貯蔵容量を
有する。
【００３５】第１制御用スイッチ（ＳＷ１）は、第１切
換制御信号（ＥＮａ）の論理状態によって、赤色用バス
（ＭＲＢ）からの赤色データストリームを、第４制御用
スイッチ（ＳＷ４）及び第７制御用スイッチ（ＳＷ７）
の中のいずれか一側に供給する。第１切換制御信号（Ｅ
Ｎａ）は、水平走査期間の前半部に該当する期間にはハ
イ論理を、そして残りの後半部に該当する期間にはロー
論理を維持する。この第１切換制御信号（ＥＮａ）によ
り第１制御用スイッチ９ＳＷ１）は、１ライン分の赤色
データ（Ｒ１乃至Ｒ８００）の中の前半４００個の赤色
データ（Ｒ１乃至Ｒ４００）は、第４制御用スイッチ
（ＳＷ４）側に、そして残りの後半４００個の赤色デー
タ（Ｒ４０１乃至Ｒ８００）は、第７制御用スイッチ
（ＳＷ７）側にそれぞれ転送するようになる。それと同
様に、第２制御用スイッチ（ＳＷ２）は、前記第１切換
制御信号（ＥＮａ）により緑色用バス（ＭＧＢ）からの
１ライン分の緑色データ（Ｇ１乃至Ｇ８００）の中の前
半４００個の緑色データ（Ｇ１乃至Ｇ４００）を第５制
御用スイッチ（ＳＷ５）側に、そして残りの後半４００
個の緑色データ（Ｇ４０１乃至Ｇ８００）を第８制御用
スイッチ（ＳＷ８）側にそれぞれ転送する。第１及び第
２制御用スイッチ（ＳＷ１、ＳＷ２）と同様に、第３制
御用スイッチ（ＳＷ３）も、前記の第１切換制御信号
（ＥＮａ）により、青色用バス（ＭＢＢ）からの１ライ
ン分の青色データ（Ｂ１乃至Ｂ８００）の中の前半４０
０個の青色データ（Ｂ１乃至Ｂ４００）を第６制御用ス
イッチ（ＳＷ６）に、そして残りの後半４００個の青色
データ（Ｂ４０１乃至Ｂ８００）を第９制御用スイッチ
（ＳＷ９）にそれぞれ供給する。
換制御信号（ＥＮａ）の論理状態によって、赤色用バス
（ＭＲＢ）からの赤色データストリームを、第４制御用
スイッチ（ＳＷ４）及び第７制御用スイッチ（ＳＷ７）
の中のいずれか一側に供給する。第１切換制御信号（Ｅ
Ｎａ）は、水平走査期間の前半部に該当する期間にはハ
イ論理を、そして残りの後半部に該当する期間にはロー
論理を維持する。この第１切換制御信号（ＥＮａ）によ
り第１制御用スイッチ９ＳＷ１）は、１ライン分の赤色
データ（Ｒ１乃至Ｒ８００）の中の前半４００個の赤色
データ（Ｒ１乃至Ｒ４００）は、第４制御用スイッチ
（ＳＷ４）側に、そして残りの後半４００個の赤色デー
タ（Ｒ４０１乃至Ｒ８００）は、第７制御用スイッチ
（ＳＷ７）側にそれぞれ転送するようになる。それと同
様に、第２制御用スイッチ（ＳＷ２）は、前記第１切換
制御信号（ＥＮａ）により緑色用バス（ＭＧＢ）からの
１ライン分の緑色データ（Ｇ１乃至Ｇ８００）の中の前
半４００個の緑色データ（Ｇ１乃至Ｇ４００）を第５制
御用スイッチ（ＳＷ５）側に、そして残りの後半４００
個の緑色データ（Ｇ４０１乃至Ｇ８００）を第８制御用
スイッチ（ＳＷ８）側にそれぞれ転送する。第１及び第
２制御用スイッチ（ＳＷ１、ＳＷ２）と同様に、第３制
御用スイッチ（ＳＷ３）も、前記の第１切換制御信号
（ＥＮａ）により、青色用バス（ＭＢＢ）からの１ライ
ン分の青色データ（Ｂ１乃至Ｂ８００）の中の前半４０
０個の青色データ（Ｂ１乃至Ｂ４００）を第６制御用ス
イッチ（ＳＷ６）に、そして残りの後半４００個の青色
データ（Ｂ４０１乃至Ｂ８００）を第９制御用スイッチ
（ＳＷ９）にそれぞれ供給する。
【００３６】第４乃至第９制御用スイッチ（ＳＷ４乃至
ＳＷ９）は、水平同期パルス（ＨＰ）の論理状態によっ
て、それぞれの色データを奇数番目または偶数番目のメ
モリの中のいずれか一側のメモリ側に伝達する。この水
平同期パルス（ＨＰ）は、水平同期信号の周期毎にハイ
論理からロー論理に、そしてロー論理からハイ論理に変
化される。その結果、第４乃至第９制御用スイッチ（Ｓ
Ｗ４乃至ＳＷ９）は、それぞれ奇数番目の水平同期期間
には色データを奇数番目のメモリ側に伝達し、偶数番目
の水平同期期間には色データを偶数番目のメモリ側に伝
達する。これを詳細に説明すると、奇数番目の水平同期
期間において、第４制御用スイッチ（ＳＷ４）は“Ｒ１
乃至Ｒ４００”の赤色データを第１メモリ（ＭＲ１）
に、第５制御用スイッチ（ＳＷ５）は“Ｇ１乃至Ｇ４０
０”の緑色データを第３メモリ（ＭＲ３）に、第６制御
用スイッチ（ＳＷ６）は“Ｂ１乃至Ｂ４００”の青色デ
ータを第５メモリ（ＭＲ５）に、第７制御用スイッチ
（ＳＷ７）は“Ｒ４０１乃至Ｒ８００”の赤色データを
第７メモリ（ＭＲ７）に、第８制御用スイッチ（ＳＷ
８）は“Ｇ４０１乃至Ｇ８００”の緑色データを第９メ
モリ（ＭＲ９）に、第９制御用スイッチ（ＳＷ９）は
“Ｂ４０１乃至Ｂ８００”の青色データを第１１メモリ
（ＭＲ１１）にそれぞれ供給する。これとは異なって、
偶数番目の水平同期期間において、第４制御用スイッチ
（ＳＷ４）は“Ｒ１乃至Ｒ４００”の赤色データを第２
メモリ（ＭＲ２）に、第５制御用スイッチ（ＳＷ５）は
“Ｇ１乃至Ｇ４００”の緑色データを第４メモリ（ＭＲ
４）に、第６制御用スイッチ（ＳＷ６）は“Ｂ１乃至Ｂ
４００”の青色データを第６メモリ（ＭＲ６）に、第７
制御用スイッチ（ＳＷ７）は“Ｒ４０１乃至Ｒ８００”
の赤色データを第８メモリ（ＭＲ８）に、第８制御用ス
イッチ（ＳＷ８）は“Ｇ４０１乃至Ｇ８００”の緑色デ
ータを第１０メモリ（ＭＲ１０）に、第９制御用スイッ
チ（ＳＷ９）は“Ｂ４０１乃至Ｂ８００”の青色データ
を第１２メモリ（ＭＲ１２）にそれぞれ供給する。
ＳＷ９）は、水平同期パルス（ＨＰ）の論理状態によっ
て、それぞれの色データを奇数番目または偶数番目のメ
モリの中のいずれか一側のメモリ側に伝達する。この水
平同期パルス（ＨＰ）は、水平同期信号の周期毎にハイ
論理からロー論理に、そしてロー論理からハイ論理に変
化される。その結果、第４乃至第９制御用スイッチ（Ｓ
Ｗ４乃至ＳＷ９）は、それぞれ奇数番目の水平同期期間
には色データを奇数番目のメモリ側に伝達し、偶数番目
の水平同期期間には色データを偶数番目のメモリ側に伝
達する。これを詳細に説明すると、奇数番目の水平同期
期間において、第４制御用スイッチ（ＳＷ４）は“Ｒ１
乃至Ｒ４００”の赤色データを第１メモリ（ＭＲ１）
に、第５制御用スイッチ（ＳＷ５）は“Ｇ１乃至Ｇ４０
０”の緑色データを第３メモリ（ＭＲ３）に、第６制御
用スイッチ（ＳＷ６）は“Ｂ１乃至Ｂ４００”の青色デ
ータを第５メモリ（ＭＲ５）に、第７制御用スイッチ
（ＳＷ７）は“Ｒ４０１乃至Ｒ８００”の赤色データを
第７メモリ（ＭＲ７）に、第８制御用スイッチ（ＳＷ
８）は“Ｇ４０１乃至Ｇ８００”の緑色データを第９メ
モリ（ＭＲ９）に、第９制御用スイッチ（ＳＷ９）は
“Ｂ４０１乃至Ｂ８００”の青色データを第１１メモリ
（ＭＲ１１）にそれぞれ供給する。これとは異なって、
偶数番目の水平同期期間において、第４制御用スイッチ
（ＳＷ４）は“Ｒ１乃至Ｒ４００”の赤色データを第２
メモリ（ＭＲ２）に、第５制御用スイッチ（ＳＷ５）は
“Ｇ１乃至Ｇ４００”の緑色データを第４メモリ（ＭＲ
４）に、第６制御用スイッチ（ＳＷ６）は“Ｂ１乃至Ｂ
４００”の青色データを第６メモリ（ＭＲ６）に、第７
制御用スイッチ（ＳＷ７）は“Ｒ４０１乃至Ｒ８００”
の赤色データを第８メモリ（ＭＲ８）に、第８制御用ス
イッチ（ＳＷ８）は“Ｇ４０１乃至Ｇ８００”の緑色デ
ータを第１０メモリ（ＭＲ１０）に、第９制御用スイッ
チ（ＳＷ９）は“Ｂ４０１乃至Ｂ８００”の青色データ
を第１２メモリ（ＭＲ１２）にそれぞれ供給する。
【００３７】一方、第１乃至第１２メモリ（ＭＲ１乃至
ＭＲ１２）は、それぞれ貯蔵された色データを、入力順
序とは異なって判読して出力する。そして第１、第３及
び第５メモリ（ＭＲ１、ＭＲ３、ＭＲ５）は、第７、第
９及び第１１メモリ（ＭＲ７、ＭＲ９、ＭＲ１１）と同
時に、そして第２、第４及び第６メモリ（ＭＲ２、ＭＲ
４、ＭＲ６）は第８、第１０及び第１２メモリ（ＭＲ
８、ＭＲ１０、ＭＲ１２）と同時に判読動作を遂行す
る。第１及び第２メモリ（ＭＲ１、ＭＲ２）は、データ
の判読時に４００個の赤色データ（Ｒ１乃至Ｒ４００）
を“Ｒ１、Ｒ５、Ｒ９…Ｒ３９７”、“Ｒ４、Ｒ８、Ｒ
１２…Ｒ４００”、“Ｒ３、Ｒ７、Ｒ１１…Ｒ３９９”
及び“Ｒ２、Ｒ６、Ｒ１０…Ｒ３９８”の順に出力す
る。第１及び第２メモリ（ＭＲ１、ＭＲ２）と同様に、
第７及び第８メモリ（ＭＲ７、ＭＲ８）は、４００個の
赤色データ（Ｒ４０１乃至Ｒ８００）を“Ｒ４０１、Ｒ
４０５、Ｒ４０９…Ｒ７９７”、“Ｒ４０４、Ｒ４０
８、Ｒ４１２…Ｒ８００”、“Ｒ４０３、Ｒ４０７、Ｒ
４１１…Ｒ７９９”及び“Ｒ４０２、Ｒ４０６、Ｒ４１
０…Ｒ７９８”の順に出力する。第３及び第４メモリ
（ＭＲ３、ＭＲ４）はデータの判読時に、４００個の緑
色データ（Ｇ１乃至Ｇ４００）を“Ｇ２、Ｇ６、Ｇ１０
…Ｇ３９８”、“Ｇ１、Ｇ５、Ｇ９…Ｇ３９７”、“Ｇ
４、Ｇ８、Ｇ１２…Ｇ４００”及び“Ｇ３、Ｇ７、Ｇ１
１…Ｇ３９９”の順に出力する。それと同様に、第９及
び第１０メモリ（ＭＲ９、ＭＲ１０）も、４００個の緑
色データ（Ｇ４０１乃至Ｇ８００）を“Ｇ４０２、Ｇ４
０６、Ｇ４１０…Ｇ７９８”、“Ｇ４０１、Ｇ４０５、
Ｇ４０９…Ｇ７９７”、“Ｇ４０４、Ｇ４０８、Ｇ４１
２…Ｇ８００”及び“Ｇ４０３、Ｇ４０７、Ｇ４１１…
Ｇ７９９”の順に出力する。第５及び第６メモリ（ＭＲ
５、ＭＲ６）はデータ判読時に、４００個の青色データ
（Ｂ１乃至Ｂ４００）を“Ｂ３、Ｂ７、Ｂ１１…Ｂ３９
９”、“Ｂ２、Ｂ６、Ｂ１０…Ｂ３９８”、“Ｂ１、Ｂ
５、Ｂ９…Ｂ３９７”及び“Ｂ４、Ｂ８、Ｂ１２…Ｂ４
００”の順に出力する。第５及び第６メモリ（ＭＲ５、
ＭＲ６）と同様に、第１１及び第１２メモリも、４００
個の青色データ（Ｂ４０１乃至Ｂ８００）を“Ｂ４０
３、Ｂ４０７、Ｂ４１１…Ｂ７９９”、“Ｂ４０２、Ｂ
４０６、Ｂ４１０…Ｂ７９８”、“Ｂ４０１ Ｂ４０
５、Ｂ４０９…Ｂ７９７”及び“Ｂ４０４、Ｂ４０８、
Ｂ４１２…Ｇ８００”の順に出力する。
ＭＲ１２）は、それぞれ貯蔵された色データを、入力順
序とは異なって判読して出力する。そして第１、第３及
び第５メモリ（ＭＲ１、ＭＲ３、ＭＲ５）は、第７、第
９及び第１１メモリ（ＭＲ７、ＭＲ９、ＭＲ１１）と同
時に、そして第２、第４及び第６メモリ（ＭＲ２、ＭＲ
４、ＭＲ６）は第８、第１０及び第１２メモリ（ＭＲ
８、ＭＲ１０、ＭＲ１２）と同時に判読動作を遂行す
る。第１及び第２メモリ（ＭＲ１、ＭＲ２）は、データ
の判読時に４００個の赤色データ（Ｒ１乃至Ｒ４００）
を“Ｒ１、Ｒ５、Ｒ９…Ｒ３９７”、“Ｒ４、Ｒ８、Ｒ
１２…Ｒ４００”、“Ｒ３、Ｒ７、Ｒ１１…Ｒ３９９”
及び“Ｒ２、Ｒ６、Ｒ１０…Ｒ３９８”の順に出力す
る。第１及び第２メモリ（ＭＲ１、ＭＲ２）と同様に、
第７及び第８メモリ（ＭＲ７、ＭＲ８）は、４００個の
赤色データ（Ｒ４０１乃至Ｒ８００）を“Ｒ４０１、Ｒ
４０５、Ｒ４０９…Ｒ７９７”、“Ｒ４０４、Ｒ４０
８、Ｒ４１２…Ｒ８００”、“Ｒ４０３、Ｒ４０７、Ｒ
４１１…Ｒ７９９”及び“Ｒ４０２、Ｒ４０６、Ｒ４１
０…Ｒ７９８”の順に出力する。第３及び第４メモリ
（ＭＲ３、ＭＲ４）はデータの判読時に、４００個の緑
色データ（Ｇ１乃至Ｇ４００）を“Ｇ２、Ｇ６、Ｇ１０
…Ｇ３９８”、“Ｇ１、Ｇ５、Ｇ９…Ｇ３９７”、“Ｇ
４、Ｇ８、Ｇ１２…Ｇ４００”及び“Ｇ３、Ｇ７、Ｇ１
１…Ｇ３９９”の順に出力する。それと同様に、第９及
び第１０メモリ（ＭＲ９、ＭＲ１０）も、４００個の緑
色データ（Ｇ４０１乃至Ｇ８００）を“Ｇ４０２、Ｇ４
０６、Ｇ４１０…Ｇ７９８”、“Ｇ４０１、Ｇ４０５、
Ｇ４０９…Ｇ７９７”、“Ｇ４０４、Ｇ４０８、Ｇ４１
２…Ｇ８００”及び“Ｇ４０３、Ｇ４０７、Ｇ４１１…
Ｇ７９９”の順に出力する。第５及び第６メモリ（ＭＲ
５、ＭＲ６）はデータ判読時に、４００個の青色データ
（Ｂ１乃至Ｂ４００）を“Ｂ３、Ｂ７、Ｂ１１…Ｂ３９
９”、“Ｂ２、Ｂ６、Ｂ１０…Ｂ３９８”、“Ｂ１、Ｂ
５、Ｂ９…Ｂ３９７”及び“Ｂ４、Ｂ８、Ｂ１２…Ｂ４
００”の順に出力する。第５及び第６メモリ（ＭＲ５、
ＭＲ６）と同様に、第１１及び第１２メモリも、４００
個の青色データ（Ｂ４０１乃至Ｂ８００）を“Ｂ４０
３、Ｂ４０７、Ｂ４１１…Ｂ７９９”、“Ｂ４０２、Ｂ
４０６、Ｂ４１０…Ｂ７９８”、“Ｂ４０１ Ｂ４０
５、Ｂ４０９…Ｂ７９７”及び“Ｂ４０４、Ｂ４０８、
Ｂ４１２…Ｇ８００”の順に出力する。
【００３８】そして、データ再整列部（２６）は、奇数
番目のメモリ（ＭＲ１、ＭＲ３、ＭＲ５、ＭＲ７、ＭＲ
９、ＭＲ１１）等からの色データと、偶数番目のメモリ
（ＭＲ２、ＭＲ４、ＭＲ６、ＭＲ８、ＭＲ１０、ＭＲ１
２）からの色データとを選択的に出力する、第１０乃至
第１５制御用スイッチ（ＳＷ１０乃至ＳＷ１５）を追加
で備える。これ等の第１０乃至第１５制御用スイッチ
（ＳＷ１０乃至ＳＷ１５）はインバーター（ＩＮＶ１）
を経由しつつ反転された水平同期パルス（ＨＰ）の論理
状態によって、奇数番目または偶数番目のメモリからの
色データを選択するようになる。すなわち、第１０乃至
第１５制御用スイッチ（ＳＷ１０乃至ＳＷ１５）は、奇
数番目の水平同期期間には偶数番目のメモリからの色デ
ータを選択する反面、偶数番目の水平同期期間には奇数
番目のメモリからの色データを選択するようになる。
番目のメモリ（ＭＲ１、ＭＲ３、ＭＲ５、ＭＲ７、ＭＲ
９、ＭＲ１１）等からの色データと、偶数番目のメモリ
（ＭＲ２、ＭＲ４、ＭＲ６、ＭＲ８、ＭＲ１０、ＭＲ１
２）からの色データとを選択的に出力する、第１０乃至
第１５制御用スイッチ（ＳＷ１０乃至ＳＷ１５）を追加
で備える。これ等の第１０乃至第１５制御用スイッチ
（ＳＷ１０乃至ＳＷ１５）はインバーター（ＩＮＶ１）
を経由しつつ反転された水平同期パルス（ＨＰ）の論理
状態によって、奇数番目または偶数番目のメモリからの
色データを選択するようになる。すなわち、第１０乃至
第１５制御用スイッチ（ＳＷ１０乃至ＳＷ１５）は、奇
数番目の水平同期期間には偶数番目のメモリからの色デ
ータを選択する反面、偶数番目の水平同期期間には奇数
番目のメモリからの色データを選択するようになる。
【００３９】また、データ再整列部（２６）は、第２乃
至第４切換制御信号（ＥＮｂ、ＥＮｃ、ＥＮｄ）により
それぞれ駆動される第１６乃至第１８制御用スイッチ
（ＳＷ１６乃至ＳＷ１８）を備える。併せて、データ再
整列部（２６）は、第２乃至第４切換制御信号（ＥＮ
ｂ、ＥＮｃ、ＥＮｄ）に駆動される第１９乃至第２１制
御用スイッチ（ＳＷ１９乃至ＳＷ２１）も備える。第２
乃至第４切換制御信号（ＥＮｂ、ＥＮｃ、ＥＮｄ）は、
それぞれ２ビット論理信号から構成され、併せてその論
理値は図２に図示された第１乃至第４選択信号等（ＳＥ
Ｌ１乃至ＳＥＬ４）が順次的にイネーブルされることに
より、１水平同期期間の間等間隔で４回にかけて変化さ
れる。それによって、第１６乃至第２１制御用スイッチ
等（ＳＷ１６乃至ＳＷ２１）は、１水平同期期間の間４
回にかけて切換されるようになる。これを詳細に説明す
ると、第１６制御用スイッチ（ＳＷ１６）は、第２切換
制御信号（ＥＮｂ）の論理値に従って、第１０制御用ス
イッチ（ＳＷ１０）、第１１制御用スイッチ（ＳＷ１
１）、第１２制御用スイッチ（ＳＷ１２）及び第１０制
御用スイッチ（ＳＷ１０）を順次的に選択し、“Ｒ１、
Ｒ５、Ｒ９…Ｒ３９７”、“Ｇ１、Ｇ５、Ｇ９…Ｇ３９
７”、“Ｂ１、Ｂ５、Ｂ９…Ｂ３９７”及び“Ｒ２、Ｒ
６、Ｒ１０…Ｒ３９８”の再整列されたビデオデータ
が、第１補助バス（ＳＢ１）に出力されるようにする。
そして第１７制御用スイッチ（ＳＷ１７）は、第３切換
制御信号（ＥＮｃ）の論理値に従って、第１１制御用ス
イッチ（ＳＷ１１）、第１２制御用スイッチ（ＳＷ１
２）、第１０制御用スイッチ（ＳＷ１０）及び第１１制
御用スイッチ（ＳＷ１１）とを順次的に選択し、“Ｇ
２、Ｇ６、Ｇ１０…Ｇ３９８”、“Ｂ２、Ｂ６、Ｂ１０
…Ｂ３９８”、“Ｒ３、Ｒ７、Ｒ１１…Ｒ３９９”及び
“Ｇ３、Ｇ７、Ｇ１１…Ｇ３９９”の再整列されたビデ
オデータが第２補助バス（ＳＢ２）に出力されるように
する。また、第１８制御用スイッチ（ＳＷ１８）は、第
４切換制御信号（ＥＮｄ）の論理値に従って、第１２制
御用スイッチ（ＳＷ１２）、第１０制御用スイッチ（Ｓ
Ｗ１０）、第１１制御用スイッチ（ＳＷ１１）及び第１
２制御用スイッチ（ＳＷ１２）とを順次的に選択し、
“Ｂ３、Ｂ７、Ｂ１１…Ｂ３９９”、“Ｒ４、Ｒ８、Ｒ
１２…Ｒ４００”、“Ｇ４、Ｇ８、Ｇ１２…Ｇ４００”
及び“Ｂ４、Ｂ８、Ｂ１２…Ｂ４００”の再整列された
ビデオデータが第３補助バス（ＳＢ３）に出力されるよ
うにする。次に、第１６乃至第１８制御用スイッチ（Ｓ
Ｗ１６乃至ＳＷ１８）と同一に動作する第１９乃至第２
１制御用スイッチ（ＳＷ１９乃至ＳＷ２１）により第４
乃至第６補助バス（ＳＢ４乃至ＳＢ６）に出力される、
再整列されたビデオデータは下記のとおりである。第４
補助バス（ＳＢ４）には“Ｒ４０１、Ｒ４０５、Ｒ４０
９…Ｒ７９７”、“Ｇ４０１、Ｇ４０５、Ｇ４０９…Ｇ
７９７”、“Ｂ４０１、Ｂ４０５、Ｂ４０９…Ｂ７９
７”及び“Ｒ４０２、Ｒ４０６、Ｒ４１０…Ｒ７９８”
の再整列されたビデオデータが、第５補助バス（ＳＢ
５）には“Ｇ４０２、Ｇ４０６、Ｇ４１０…Ｇ７９
８”、“Ｂ４０２、Ｂ４０６、Ｂ４１０…Ｂ７９８”、
“Ｒ４０３、Ｒ４０７、Ｒ４１１…Ｒ７９９”及び“Ｇ
４０３、Ｇ４０７、Ｇ４１１…Ｇ７９９”の再整列され
たビデオデータが、そして第６補助バス（ＳＢ６）には
“Ｂ４０３、Ｂ４０７、Ｂ４１１…Ｂ７９９”、“Ｒ４
０４、Ｒ４０８、Ｒ４１２…Ｒ８００”、“Ｇ４０４、
Ｇ４０８、Ｇ４１２…Ｇ８００”及び“Ｂ４０４、Ｂ４
０８、Ｂ４１２…Ｂ８００”の再整列されたビデオデー
タがそれぞれ供給される。
至第４切換制御信号（ＥＮｂ、ＥＮｃ、ＥＮｄ）により
それぞれ駆動される第１６乃至第１８制御用スイッチ
（ＳＷ１６乃至ＳＷ１８）を備える。併せて、データ再
整列部（２６）は、第２乃至第４切換制御信号（ＥＮ
ｂ、ＥＮｃ、ＥＮｄ）に駆動される第１９乃至第２１制
御用スイッチ（ＳＷ１９乃至ＳＷ２１）も備える。第２
乃至第４切換制御信号（ＥＮｂ、ＥＮｃ、ＥＮｄ）は、
それぞれ２ビット論理信号から構成され、併せてその論
理値は図２に図示された第１乃至第４選択信号等（ＳＥ
Ｌ１乃至ＳＥＬ４）が順次的にイネーブルされることに
より、１水平同期期間の間等間隔で４回にかけて変化さ
れる。それによって、第１６乃至第２１制御用スイッチ
等（ＳＷ１６乃至ＳＷ２１）は、１水平同期期間の間４
回にかけて切換されるようになる。これを詳細に説明す
ると、第１６制御用スイッチ（ＳＷ１６）は、第２切換
制御信号（ＥＮｂ）の論理値に従って、第１０制御用ス
イッチ（ＳＷ１０）、第１１制御用スイッチ（ＳＷ１
１）、第１２制御用スイッチ（ＳＷ１２）及び第１０制
御用スイッチ（ＳＷ１０）を順次的に選択し、“Ｒ１、
Ｒ５、Ｒ９…Ｒ３９７”、“Ｇ１、Ｇ５、Ｇ９…Ｇ３９
７”、“Ｂ１、Ｂ５、Ｂ９…Ｂ３９７”及び“Ｒ２、Ｒ
６、Ｒ１０…Ｒ３９８”の再整列されたビデオデータ
が、第１補助バス（ＳＢ１）に出力されるようにする。
そして第１７制御用スイッチ（ＳＷ１７）は、第３切換
制御信号（ＥＮｃ）の論理値に従って、第１１制御用ス
イッチ（ＳＷ１１）、第１２制御用スイッチ（ＳＷ１
２）、第１０制御用スイッチ（ＳＷ１０）及び第１１制
御用スイッチ（ＳＷ１１）とを順次的に選択し、“Ｇ
２、Ｇ６、Ｇ１０…Ｇ３９８”、“Ｂ２、Ｂ６、Ｂ１０
…Ｂ３９８”、“Ｒ３、Ｒ７、Ｒ１１…Ｒ３９９”及び
“Ｇ３、Ｇ７、Ｇ１１…Ｇ３９９”の再整列されたビデ
オデータが第２補助バス（ＳＢ２）に出力されるように
する。また、第１８制御用スイッチ（ＳＷ１８）は、第
４切換制御信号（ＥＮｄ）の論理値に従って、第１２制
御用スイッチ（ＳＷ１２）、第１０制御用スイッチ（Ｓ
Ｗ１０）、第１１制御用スイッチ（ＳＷ１１）及び第１
２制御用スイッチ（ＳＷ１２）とを順次的に選択し、
“Ｂ３、Ｂ７、Ｂ１１…Ｂ３９９”、“Ｒ４、Ｒ８、Ｒ
１２…Ｒ４００”、“Ｇ４、Ｇ８、Ｇ１２…Ｇ４００”
及び“Ｂ４、Ｂ８、Ｂ１２…Ｂ４００”の再整列された
ビデオデータが第３補助バス（ＳＢ３）に出力されるよ
うにする。次に、第１６乃至第１８制御用スイッチ（Ｓ
Ｗ１６乃至ＳＷ１８）と同一に動作する第１９乃至第２
１制御用スイッチ（ＳＷ１９乃至ＳＷ２１）により第４
乃至第６補助バス（ＳＢ４乃至ＳＢ６）に出力される、
再整列されたビデオデータは下記のとおりである。第４
補助バス（ＳＢ４）には“Ｒ４０１、Ｒ４０５、Ｒ４０
９…Ｒ７９７”、“Ｇ４０１、Ｇ４０５、Ｇ４０９…Ｇ
７９７”、“Ｂ４０１、Ｂ４０５、Ｂ４０９…Ｂ７９
７”及び“Ｒ４０２、Ｒ４０６、Ｒ４１０…Ｒ７９８”
の再整列されたビデオデータが、第５補助バス（ＳＢ
５）には“Ｇ４０２、Ｇ４０６、Ｇ４１０…Ｇ７９
８”、“Ｂ４０２、Ｂ４０６、Ｂ４１０…Ｂ７９８”、
“Ｒ４０３、Ｒ４０７、Ｒ４１１…Ｒ７９９”及び“Ｇ
４０３、Ｇ４０７、Ｇ４１１…Ｇ７９９”の再整列され
たビデオデータが、そして第６補助バス（ＳＢ６）には
“Ｂ４０３、Ｂ４０７、Ｂ４１１…Ｂ７９９”、“Ｒ４
０４、Ｒ４０８、Ｒ４１２…Ｒ８００”、“Ｇ４０４、
Ｇ４０８、Ｇ４１２…Ｇ８００”及び“Ｂ４０４、Ｂ４
０８、Ｂ４１２…Ｂ８００”の再整列されたビデオデー
タがそれぞれ供給される。
【００４０】
【発明の効果】上述の如く、本発明による液晶表示装置
は、１ライン分のビデオデータを再整列し、液晶パネル
上の１ライン分のＴＦＴの中の隣接したＴＦＴが順次的
に駆動されるようにすると共に、同時に駆動されるＴＦ
Ｔを分散させることができる。それにより、本発明の液
晶表示装置では、Ｄ−ＩＣと画素マトリクス間の配線構
造が簡素化される。また、本発明ではＤ−ＩＣが同時に
ビデオデータをサンプリングすることにより、Ｄ−ＩＣ
は周波数が低いサンプリングクロックの周波数を使用す
ることができる。
は、１ライン分のビデオデータを再整列し、液晶パネル
上の１ライン分のＴＦＴの中の隣接したＴＦＴが順次的
に駆動されるようにすると共に、同時に駆動されるＴＦ
Ｔを分散させることができる。それにより、本発明の液
晶表示装置では、Ｄ−ＩＣと画素マトリクス間の配線構
造が簡素化される。また、本発明ではＤ−ＩＣが同時に
ビデオデータをサンプリングすることにより、Ｄ−ＩＣ
は周波数が低いサンプリングクロックの周波数を使用す
ることができる。
【００４１】以上において説明した内容を通して、当業
者であれば本発明の技術的な思想から逸脱しない範囲内
で、多様な変更及び修正が可能であることが分かる。従
って、本発明の技術的範囲は、実施の形態に記載された
内容に限定されるものでなく、特許請求の範囲により定
めなければならない。
者であれば本発明の技術的な思想から逸脱しない範囲内
で、多様な変更及び修正が可能であることが分かる。従
って、本発明の技術的範囲は、実施の形態に記載された
内容に限定されるものでなく、特許請求の範囲により定
めなければならない。
【図１】従来の液晶表示装置を概略的に図示する図面、
【図２】本発明の実施の形態による液晶表示装置のブロ
ック図、
ック図、
【図３及び図４】図２に図示された回路の各部分に対す
る動作波形図、
る動作波形図、
【図５】図２に図示されたデータ再整列部の一実施の形
態を詳細に図示する図面、
態を詳細に図示する図面、
【図６】図２に図示されたデータ再整列部の他の実施の
形態を詳細に図示する図面である。
形態を詳細に図示する図面である。
１０：液晶パネル １２、２２：ゲートドライバ １４、２４：Ｄ−ＩＣ ２６：データ再整列部 ＭＵＸ１乃至ＭＵＸ６００：マルチプレクサ
Claims (30)
- 【請求項１】 複数のデータラインと複数のゲートライ
ンとの交差部にそれぞれ配列された複数の画素セルを含
む液晶パネルと、複数のビデオ信号を供給するための第
１データドライバ回路と、複数のビデオ信号を供給する
ための第２データドライバ回路と、前記第１及び第２デ
ータドライバ回路のいずれかから供給される前記複数の
ビデオ信号のいずれかをそれぞれ受信するとともに、受
信したビデオ信号を前記複数のデータラインに選択的に
出力する複数のマルチプレクサ回路とを備える液晶表示
装置。 - 【請求項２】 入力ビデオデータを再配列し、その再配
列された入力ビデオデータのそれぞれを、前記第１及び
第２ビデオデータドライバ回路に個別的に接続された第
１及び第２データ経路を経由し、前記第１及び第２デー
タドライバ回路に供給するための再配列手段を備えるこ
とを特徴とする請求項１記載の液晶表示装置。 - 【請求項３】 前記第１経路上の再配列された入力ビデ
オデータは、前記第２経路上の再配列された入力ビデオ
データと互いに排他的な関係であることを特徴とする請
求項２記載の液晶表示装置。 - 【請求項４】 前記第１及び第２データ経路は、前記再
配列手段からの入力データが同時に供給されることを特
徴とする請求項２記載の液晶表示装置。 - 【請求項５】 前記再配列手段は、前記入力ビデオデー
タを一時的に貯蔵するための少なくとも２個のメモリ
と、前記入力ビデオデータを、前記少なくとも２個のメ
モリに分配するためのデータ分配手段とを備えることを
特徴とする請求項２記載の液晶表示装置。 - 【請求項６】 前記少なくとも２個のメモリのいずれか
一方に貯蔵された前記入力ビデオデータは、前記少なく
とも２個のメモリの他方に貯蔵された前記入力ビデオデ
ータと相互に排他的な関係であることを特徴とする請求
項５記載の液晶表示装置。 - 【請求項７】 前記少なくとも２個のメモリの記憶容量
は、前記入力ビデオデータの１ラインに必要とされる記
憶量に該当することを特徴とする請求項６記載の液晶表
示装置。 - 【請求項８】 前記少なくとも２個のメモリは、前記少
なくとも２個のメモリから前記入力ビデオデータを同時
に読み取る手段を備えることを特徴とする請求項５記載
の液晶表示装置。 - 【請求項９】 前記少なくとも２個のメモリの記憶容量
は、前記入力ビデオデータの２ラインに必要とされる記
憶量に該当することを特徴とする請求項８記載の液晶表
示装置。 - 【請求項１０】 前記再配列手段は、前記第１及び第２
データドライバ回路のそれぞれに接続された少なくとも
２個の先入先出装置と、前記入力ビデオデータを、前記
少なくとも２個の先入先出装置に分配するためのデータ
分配手段とを備えることを特徴とする請求項２記載の液
晶表示装置。 - 【請求項１１】 前記複数のマルチプレクサ回路は、前
記液晶パネル上に備えられることを特徴とする請求項１
記載の液晶表示装置。 - 【請求項１２】 前記複数のマルチプレクサ回路と、前
記第１及び第２データドライバ回路は、前記液晶パネル
上に備えられることを特徴とする請求項１記載の液晶表
示装置。 - 【請求項１３】 前記第１及び第２データドライバ回路
は、液晶パネルと分離された集積回路上に備えられるこ
とを特徴とする請求項１記載の液晶表示装置。 - 【請求項１４】 前記第１及び第２データドライバ回路
は、液晶パネルを有する集積回路上に備えられることを
特徴とする請求項１記載の液晶表示装置。 - 【請求項１５】 水平軸で反復される赤、緑、青の画素
セルが、複数のデータラインと複数のゲートラインとの
交差部のそれぞれに配列された液晶パネルと、複数のビ
デオ信号を供給するための第１データドライバ回路と、
複数のビデオ信号を供給するための第２データドライバ
回路と、前記第１及び第２データドライバ回路のいずれ
かから供給される前記複数のビデオ信号のいずれかをそ
れぞれ受信するとともに、受信したビデオ信号を前記複
数のデータラインに選択的に出力する複数のマルチプレ
クサ回路とを備える液晶表示装置。 - 【請求項１６】 入力赤、緑、青のビデオデータを再配
列し、その再配列された入力ビデオデータのそれぞれ
を、前記第１及び第２ビデオデータドライバ回路に個別
的に接続された第１及び第２データ経路を経由し、前記
第１及び第２データドライバ回路に供給するための再配
列手段を備えることを特徴とする請求項１５記載の液晶
表示装置。 - 【請求項１７】 前記第１経路上の再配列された入力ビ
デオデータは、前記第２経路上の再配列された入力ビデ
オデータと互いに排他的な関係であることを特徴とする
請求項１６記載の液晶表示装置。 - 【請求項１８】 前記第１及び第２データ経路は、前記
再配列手段からの入力データが同時に供給されることを
特徴とする請求項１６記載の液晶表示装置。 - 【請求項１９】 前記再配列手段は、前記赤、緑、青の
入力ビデオデータを一時的に貯蔵するための少なくとも
２個のメモリと、前記ビデオデータを、前記少なくとも
２個のメモリに分配するためのデータ分配手段とを備え
ることを特徴とする請求項１６記載の液晶表示装置。 - 【請求項２０】 前記少なくとも２個のメモリのいずれ
か一方に貯蔵されたデータは、前記少なくとも２個のメ
モリの他方に貯蔵されたデータと相互に排他的な関係で
あることを特徴とする請求項１９記載の液晶表示装置。 - 【請求項２１】 前記少なくとも２個のメモリの記憶容
量は、前記ビデオデータの１ラインに必要とされる記憶
量に該当することを特徴とする請求項２０記載の液晶表
示装置。 - 【請求項２２】 前記少なくとも２個のメモリは、前記
少なくとも２個のメモリから前記ビデオデータを同時に
読み取る手段を備えることを特徴とする請求項１９記載
の液晶表示装置。 - 【請求項２３】 前記少なくとも２個のメモリの記憶容
量は、前記ビデオデータの２ラインに必要とされる記憶
量に該当することを特徴とする請求項２２記載の液晶表
示装置。 - 【請求項２４】 前記再配列手段は、前記第１及び第２
データドライバ回路のそれぞれに接続された少なくとも
２個の先入先出装置と、前記入力ビデオデータを、前記
少なくとも２個の先入先出装置に分配するためのデータ
分配手段とを備えることを特徴とする請求項１５記載の
液晶表示装置。 - 【請求項２５】 前記複数のマルチプレクサ回路は、前
記液晶パネル上に備えられることを特徴とする請求項１
５記載の液晶表示装置。 - 【請求項２６】 前記複数のマルチプレクサ回路と、前
記第１及び第２データドライバ回路は、前記液晶パネル
上に備えられることを特徴とする請求項１５記載の液晶
表示装置。 - 【請求項２７】 前記第１及び第２データドライバ回路
は、液晶パネルと分離された集積回路上に備えられるこ
とを特徴とする請求項１５記載の液晶表示装置。 - 【請求項２８】 前記第１及び第２データドライバ回路
は、液晶パネルを有する集積回路上に備えられることを
特徴とする請求項１５記載の液晶表示装置。 - 【請求項２９】 画素セルがｎ個のデータラインとｍ個
のゲートライン（ただし、ｎ及びｍは整数）の複数の交
差部のそれぞれに配列された液晶パネルと、データ信号
を前記ｎ個のデータラインの中のｐ個（ただし、ｐはｎ
より小さい整数）にそれぞれ出力するための複数のマル
チプレキシング手段と、前記複数のマルチプレキシング
手段を時分割的に駆動するためのｑ個（ただし、ｑは整
数）のデータドライバ回路を備えることを特徴とする液
晶表示装置。 - 【請求項３０】 前記データドライバ集積回路に供給さ
れるビデオデータを再配列するための再配列手段を備え
ることを特徴とする請求項２９記載の液晶表示装置。
Applications Claiming Priority (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| KR1997-32096 | 1997-07-10 | ||
| KR1019970032096A KR100430091B1 (ko) | 1997-07-10 | 1997-07-10 | 액정표시장치 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH1138946A true JPH1138946A (ja) | 1999-02-12 |
| JP2963437B2 JP2963437B2 (ja) | 1999-10-18 |
Family
ID=19514085
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP10140706A Expired - Lifetime JP2963437B2 (ja) | 1997-07-10 | 1998-05-22 | 液晶表示装置 |
Country Status (6)
| Country | Link |
|---|---|
| US (1) | US6333729B1 (ja) |
| JP (1) | JP2963437B2 (ja) |
| KR (1) | KR100430091B1 (ja) |
| DE (1) | DE19825276B4 (ja) |
| FR (1) | FR2765997B1 (ja) |
| GB (1) | GB2327137B (ja) |
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