JPH05210359A - 表示装置の駆動回路 - Google Patents
表示装置の駆動回路Info
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- JPH05210359A JPH05210359A JP1669192A JP1669192A JPH05210359A JP H05210359 A JPH05210359 A JP H05210359A JP 1669192 A JP1669192 A JP 1669192A JP 1669192 A JP1669192 A JP 1669192A JP H05210359 A JPH05210359 A JP H05210359A
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- Japan
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- signal data
- video signal
- display device
- sampling
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Abstract
(57)【要約】 (修正有)
【目的】 表示装置の駆動回路において、サンプリング
速度を上げることなく、高速でサンプリング処理を行う
ことができるようにする。 【構成】 入力された映像信号データの各水平周期分を
複数に分割すると共に、その分割数と同じ数に該映像信
号データのサンプリングを開始するための信号SPを分
配し、液晶パネル7の画面を分割表示する。例えば映像
信号データを分割する数を2にした場合を仮定する。そ
うすると、画像信号データは、前半の映像信号データS
1と後半の映像信号データS2とに分割される。この分
割された映像信号データの前半部S1と後半部S2は、
それぞれ前半用のソースドライバー8aと後半用のソー
スドライバー8bで同時に、かつ並行に処理される。な
お、映像信号データを分割する数を3以上にすると、よ
り速い速度でサンプリング処理が可能となる。
速度を上げることなく、高速でサンプリング処理を行う
ことができるようにする。 【構成】 入力された映像信号データの各水平周期分を
複数に分割すると共に、その分割数と同じ数に該映像信
号データのサンプリングを開始するための信号SPを分
配し、液晶パネル7の画面を分割表示する。例えば映像
信号データを分割する数を2にした場合を仮定する。そ
うすると、画像信号データは、前半の映像信号データS
1と後半の映像信号データS2とに分割される。この分
割された映像信号データの前半部S1と後半部S2は、
それぞれ前半用のソースドライバー8aと後半用のソー
スドライバー8bで同時に、かつ並行に処理される。な
お、映像信号データを分割する数を3以上にすると、よ
り速い速度でサンプリング処理が可能となる。
Description
【0001】
【産業上の利用分野】本発明は、映像信号データがディ
ジタル信号で与えられると共に該映像信号データをサン
プリングして表示装置の画面に表示する表示装置の駆動
回路に関し、特にサンプリング処理に高速性を要する、
例えば大型高精細の液晶表示装置等に利用される表示装
置の駆動回路に関する。
ジタル信号で与えられると共に該映像信号データをサン
プリングして表示装置の画面に表示する表示装置の駆動
回路に関し、特にサンプリング処理に高速性を要する、
例えば大型高精細の液晶表示装置等に利用される表示装
置の駆動回路に関する。
【0002】
【従来の技術】上記駆動回路として、従来、図4に示す
回路部分を多数備えたものが知られている。図示されて
いる回路部分は、スイッチング素子として薄膜トランジ
スタ(TFT)を使用した液晶表示装置を駆動する駆動
回路の1出力(n番目)に対応している。なお、この図
示例では説明を簡単にするために映像信号データは2ビ
ットとしている。この駆動回路(ディジタルソースドラ
イバー)は、次のように動作する。
回路部分を多数備えたものが知られている。図示されて
いる回路部分は、スイッチング素子として薄膜トランジ
スタ(TFT)を使用した液晶表示装置を駆動する駆動
回路の1出力(n番目)に対応している。なお、この図
示例では説明を簡単にするために映像信号データは2ビ
ットとしている。この駆動回路(ディジタルソースドラ
イバー)は、次のように動作する。
【0003】入力された映像信号データ(D0、D1)
は、第n番目の絵素に対応するサンプリングパルスTs
mpの立ち上がりで、第1段目のDフリップフロップ
(以下サンプリングFFという)10に取り込まれ保持
される。1水平期間のサンプリングが終了した時点で、
出力パルスOEが第2段目のDフリップフロップ(以下
ホールドFFという)11に与えられ、サンプリングF
F10に保持されていた映像信号データ(D0、D1)
はホールドFF11に取り込まれると共にデコーダ12
に出力される。
は、第n番目の絵素に対応するサンプリングパルスTs
mpの立ち上がりで、第1段目のDフリップフロップ
(以下サンプリングFFという)10に取り込まれ保持
される。1水平期間のサンプリングが終了した時点で、
出力パルスOEが第2段目のDフリップフロップ(以下
ホールドFFという)11に与えられ、サンプリングF
F10に保持されていた映像信号データ(D0、D1)
はホールドFF11に取り込まれると共にデコーダ12
に出力される。
【0004】デコーダ12は、この2ビットの映像信号
データ(D0、D1)をデコードし、その値(0〜3)
に応じて4つのアナログスイッチ13a、13b、13
c、13dのいずれか1つを導通とする。各アナログス
イッチ13a、13b、13c、13dには、それぞれ
外部電圧V0、V1、V2、V3が与えられており、導
通したアナログスイッチを介して4種の外部電圧V0〜
V3のいずれかをソースラインOnに出力する。1台の
TFT液晶表示装置に設けられる駆動回路は、これと同
様な回路部分を表示装置の水平のドット数と同数だけ有
している。
データ(D0、D1)をデコードし、その値(0〜3)
に応じて4つのアナログスイッチ13a、13b、13
c、13dのいずれか1つを導通とする。各アナログス
イッチ13a、13b、13c、13dには、それぞれ
外部電圧V0、V1、V2、V3が与えられており、導
通したアナログスイッチを介して4種の外部電圧V0〜
V3のいずれかをソースラインOnに出力する。1台の
TFT液晶表示装置に設けられる駆動回路は、これと同
様な回路部分を表示装置の水平のドット数と同数だけ有
している。
【0005】
【発明が解決しようとする課題】以上説明したディジタ
ルソースドライバーは、最大で25MHzの速度でサン
プリング処理が可能であり、従来のアナログソースドラ
イバーと比較すると、より高速なサンプリングが可能で
ある。しかし、液晶表示装置の大型化や高精細化が推進
されている近年にあっては、その大型化や高精細化に伴
って絵素が増加するために、更に高速のサンプリング速
度が要求されるが、従来のディジタルソースドライバー
ではその要求に対応することが非常に困難なこととなり
つつある。具体的には、ワークステーション等に対応し
た液晶表示装置に用いられるディジタルソースドライバ
ーとしては、従来に比較して2倍程度、例えば50MH
z程度の高速サンプリングが要求されるが、ディジタル
ソースドライバーを構成するLSI自体をこのように高
速化させることが非常に困難であるからである。
ルソースドライバーは、最大で25MHzの速度でサン
プリング処理が可能であり、従来のアナログソースドラ
イバーと比較すると、より高速なサンプリングが可能で
ある。しかし、液晶表示装置の大型化や高精細化が推進
されている近年にあっては、その大型化や高精細化に伴
って絵素が増加するために、更に高速のサンプリング速
度が要求されるが、従来のディジタルソースドライバー
ではその要求に対応することが非常に困難なこととなり
つつある。具体的には、ワークステーション等に対応し
た液晶表示装置に用いられるディジタルソースドライバ
ーとしては、従来に比較して2倍程度、例えば50MH
z程度の高速サンプリングが要求されるが、ディジタル
ソースドライバーを構成するLSI自体をこのように高
速化させることが非常に困難であるからである。
【0006】本発明は、かかる課題を解決すべくなされ
たものであり、サンプリング速度を上げることなく、高
速でサンプリング処理を行うことができる表示装置の駆
動回路を提供することを目的とする。
たものであり、サンプリング速度を上げることなく、高
速でサンプリング処理を行うことができる表示装置の駆
動回路を提供することを目的とする。
【0007】
【課題を解決するための手段】本発明の表示装置の駆動
回路は、映像信号データがディジタル信号で与えられる
と共に該映像信号データをサンプリングして表示装置の
画面に表示する表示装置の駆動回路であって、入力され
た映像信号データの各水平周期分を複数に分割すると共
に、その分割数と同じ数に該映像信号データのサンプリ
ングを開始するための信号を分配し、表示装置の画面を
分割表示するようになっており、そのことにより上記目
的を達成することができる。
回路は、映像信号データがディジタル信号で与えられる
と共に該映像信号データをサンプリングして表示装置の
画面に表示する表示装置の駆動回路であって、入力され
た映像信号データの各水平周期分を複数に分割すると共
に、その分割数と同じ数に該映像信号データのサンプリ
ングを開始するための信号を分配し、表示装置の画面を
分割表示するようになっており、そのことにより上記目
的を達成することができる。
【0008】
【作用】本発明にあっては、入力された映像信号データ
の各水平周期分を複数に分割すると共に、その分割数と
同じ数に該映像信号データのサンプリングを開始するた
めの信号を分配し、表示装置の画面を分割表示する構成
となっている。ここで、例えば映像信号データを分割す
る数を2にした場合を仮定する。そうすると、映像信号
データは、前半の映像信号データと後半の映像信号デー
タとに分割される。この分割された映像信号データを各
々ディジタルソースドライバーの前半部と後半部とに分
けて入力させ、かつ、その前半部と後半部との先頭に、
サンプリングを開始する信号を与えるようにすると、入
力された映像信号データの前半部と後半部は、それぞれ
ディジタルソースドライバーの前半部と後半部で同時
に、かつ並行に処理される。
の各水平周期分を複数に分割すると共に、その分割数と
同じ数に該映像信号データのサンプリングを開始するた
めの信号を分配し、表示装置の画面を分割表示する構成
となっている。ここで、例えば映像信号データを分割す
る数を2にした場合を仮定する。そうすると、映像信号
データは、前半の映像信号データと後半の映像信号デー
タとに分割される。この分割された映像信号データを各
々ディジタルソースドライバーの前半部と後半部とに分
けて入力させ、かつ、その前半部と後半部との先頭に、
サンプリングを開始する信号を与えるようにすると、入
力された映像信号データの前半部と後半部は、それぞれ
ディジタルソースドライバーの前半部と後半部で同時
に、かつ並行に処理される。
【0009】したがって、元の画像信号データは半分の
クロックで処理してもよいことになる。このため、従来
並のサンプリング速度をもつディジタルソースドライバ
ーを使用しても、サンプリング処理を実質的に2倍にす
ることが可能である。なお、映像信号データを分割する
数を3以上にすると、より速い速度でサンプリング処理
が実質的に可能となる。
クロックで処理してもよいことになる。このため、従来
並のサンプリング速度をもつディジタルソースドライバ
ーを使用しても、サンプリング処理を実質的に2倍にす
ることが可能である。なお、映像信号データを分割する
数を3以上にすると、より速い速度でサンプリング処理
が実質的に可能となる。
【0010】
【実施例】以下、本発明の実施例を図面に基づき具体的
に説明する。
に説明する。
【0011】図1は本発明にかかる表示装置の駆動回路
の出力側を示し、図2はその駆動回路の入力側に備わっ
たインターフェース部を示す。インターフェース部に
は、図2に示すように水平同期信号と映像信号データと
サンプリングクロック信号(ck1)とが入力される。
そのうちの映像信号データは、切換スイッチ1を介して
1水平期間に1組のラインメモリ2aと2bに、又は他
の1組のラインメモリ2cと2dに保持される。切換ス
イッチ1には、水平同期信号が入力される。各ラインメ
モリ2a、2b、2c、2dには、それぞれ前記サンプ
リングクロック信号(ck1)が、例えば50MHzで
入力される。このサンプリングクロック信号(ck1)
は分周器3にも与えられる。この分周器3は、本実施例
では1/2分周器を使用している。
の出力側を示し、図2はその駆動回路の入力側に備わっ
たインターフェース部を示す。インターフェース部に
は、図2に示すように水平同期信号と映像信号データと
サンプリングクロック信号(ck1)とが入力される。
そのうちの映像信号データは、切換スイッチ1を介して
1水平期間に1組のラインメモリ2aと2bに、又は他
の1組のラインメモリ2cと2dに保持される。切換ス
イッチ1には、水平同期信号が入力される。各ラインメ
モリ2a、2b、2c、2dには、それぞれ前記サンプ
リングクロック信号(ck1)が、例えば50MHzで
入力される。このサンプリングクロック信号(ck1)
は分周器3にも与えられる。この分周器3は、本実施例
では1/2分周器を使用している。
【0012】上記分周器3は、25MHzのサンプリン
グクロック信号(ck2)を、前記各ラインメモリ2
a、2b、2c、2dと液晶表示装置ユニット6とに出
力する。このサンプリングクロック信号(ck2)に基
づいて、各ラインメモリ2a、2b、2c、2dに保持
された映像信号データは読み出される。ラインメモリ2
aと2cから読み出された映像信号データは、切換スイ
ッチ4aを介して出力バッファ5aに出力され、ライン
メモリ2bと2dから読み出された映像信号データは、
切換スイッチ4bを介して出力バッファ5bに出力され
る。
グクロック信号(ck2)を、前記各ラインメモリ2
a、2b、2c、2dと液晶表示装置ユニット6とに出
力する。このサンプリングクロック信号(ck2)に基
づいて、各ラインメモリ2a、2b、2c、2dに保持
された映像信号データは読み出される。ラインメモリ2
aと2cから読み出された映像信号データは、切換スイ
ッチ4aを介して出力バッファ5aに出力され、ライン
メモリ2bと2dから読み出された映像信号データは、
切換スイッチ4bを介して出力バッファ5bに出力され
る。
【0013】出力バッファ5aは出力信号である映像信
号データS1を液晶表示装置ユニット6に出力し、出力
バッファ5bは出力信号である映像信号データS2を液
晶表示装置ユニット6に出力する。液晶表示装置ユニッ
ト6及び切換スイッチ4a、4bには、前記水平同期信
号が与えられる。
号データS1を液晶表示装置ユニット6に出力し、出力
バッファ5bは出力信号である映像信号データS2を液
晶表示装置ユニット6に出力する。液晶表示装置ユニッ
ト6及び切換スイッチ4a、4bには、前記水平同期信
号が与えられる。
【0014】液晶表示装置ユニット6は、図1に示すよ
うに、上記映像信号データS1、S2およびサンプリン
グクロック信号(ck2)が入力され、後述する映像信
号データS1U、S2Uを出力するコントローラ9と、
コントローラ9からの映像信号データS1Uを入力する
上の前半用のソースドライバー(下の前半用のソースド
ライバーも同様。図には上側のソースドライバー8aが
現れている。)と、コントローラ9からの映像信号デー
タS2Uを入力する上の後半用のソースドライバー(下
の後半用のソースドライバーも同様。図には上側のソー
スドライバー8bが現れている。)と、これらソースド
ライバー8a、8b等により駆動される液晶パネル7と
を備える。
うに、上記映像信号データS1、S2およびサンプリン
グクロック信号(ck2)が入力され、後述する映像信
号データS1U、S2Uを出力するコントローラ9と、
コントローラ9からの映像信号データS1Uを入力する
上の前半用のソースドライバー(下の前半用のソースド
ライバーも同様。図には上側のソースドライバー8aが
現れている。)と、コントローラ9からの映像信号デー
タS2Uを入力する上の後半用のソースドライバー(下
の後半用のソースドライバーも同様。図には上側のソー
スドライバー8bが現れている。)と、これらソースド
ライバー8a、8b等により駆動される液晶パネル7と
を備える。
【0015】前半用のソースドライバー8a等及び後半
用のソースドライバー8b等の各々の先頭のドライバー
には、コントローラ9からサンプリング開始信号SPが
分配されて入力される。また、これら各ソースドライバ
ー8a、8b等には、サンプリングクロック(ck2)
が入力される。このサンプリングクロック(ck2)は
25MHzであるので、各ソースドライバー8a、8b
等は従来の、つまり図4に示した回路を備えたディジタ
ルソースドライバーで構成してある。
用のソースドライバー8b等の各々の先頭のドライバー
には、コントローラ9からサンプリング開始信号SPが
分配されて入力される。また、これら各ソースドライバ
ー8a、8b等には、サンプリングクロック(ck2)
が入力される。このサンプリングクロック(ck2)は
25MHzであるので、各ソースドライバー8a、8b
等は従来の、つまり図4に示した回路を備えたディジタ
ルソースドライバーで構成してある。
【0016】次に、このように構成された表示装置の駆
動回路の動作内容を、図3に基づいて説明する。なお、
ディジタル信号である映像信号データのサンプリング速
度は50MHz、水平表示範囲は1280画素とし、ま
た液晶パネル7の水平画素は1280画素、総てのソー
スドライバー8a、8b等のデータサンプリング速度は
25MHzとした。
動回路の動作内容を、図3に基づいて説明する。なお、
ディジタル信号である映像信号データのサンプリング速
度は50MHz、水平表示範囲は1280画素とし、ま
た液晶パネル7の水平画素は1280画素、総てのソー
スドライバー8a、8b等のデータサンプリング速度は
25MHzとした。
【0017】インターフェース部に入力される映像信号
データは、図3(c)に示す水平同期信号が与えられて
いる1水平期間において1280画素分の信号を有する
(図3(a)参照)。この映像信号データのうち1〜6
40画素分をラインメモリ2aに、続いて641〜12
80画素分をラインメモリ2bに、図3(b)に示す5
0MHzのサンプリングクロック信号(ck1)で保持
する。次の水平期間では、ラインメモリ2cに映像信号
データの1〜640画素分を、ラインメモリ2dに映像
信号データの641〜1280画素分を保持すると同時
に、前の水平期間に保持していたデータをラインメモリ
2a又は2bから並列に、かつ、同時に25MHzのサ
ンプリングクロック信号(ck2)で読み出す。
データは、図3(c)に示す水平同期信号が与えられて
いる1水平期間において1280画素分の信号を有する
(図3(a)参照)。この映像信号データのうち1〜6
40画素分をラインメモリ2aに、続いて641〜12
80画素分をラインメモリ2bに、図3(b)に示す5
0MHzのサンプリングクロック信号(ck1)で保持
する。次の水平期間では、ラインメモリ2cに映像信号
データの1〜640画素分を、ラインメモリ2dに映像
信号データの641〜1280画素分を保持すると同時
に、前の水平期間に保持していたデータをラインメモリ
2a又は2bから並列に、かつ、同時に25MHzのサ
ンプリングクロック信号(ck2)で読み出す。
【0018】ラインメモリ2aから読み出されたデータ
は切換スイッチ4aを介して出力バッファ5aに与えら
れ、出力バッファ5aは1〜640画素分の映像信号デ
ータS1を液晶表示装置ユニット6に出力する。一方、
ラインメモリ2bから読み出されたデータは切換スイッ
チ4bを介して出力バッファ5bに与えられ、出力バッ
ファ5bは641〜1280画素分の映像信号データS
2を液晶表示装置ユニット6に出力する。従って、上記
インターフェース部から出力される映像信号データは、
1〜640画素分の映像信号データS1と、641〜1
280画素分の映像信号データS2との2つに分割され
て、液晶表示装置ユニット6に与えられる。
は切換スイッチ4aを介して出力バッファ5aに与えら
れ、出力バッファ5aは1〜640画素分の映像信号デ
ータS1を液晶表示装置ユニット6に出力する。一方、
ラインメモリ2bから読み出されたデータは切換スイッ
チ4bを介して出力バッファ5bに与えられ、出力バッ
ファ5bは641〜1280画素分の映像信号データS
2を液晶表示装置ユニット6に出力する。従って、上記
インターフェース部から出力される映像信号データは、
1〜640画素分の映像信号データS1と、641〜1
280画素分の映像信号データS2との2つに分割され
て、液晶表示装置ユニット6に与えられる。
【0019】次に、2つの映像信号データS1とS2
は、液晶表示装置ユニット6のコントローラ9に入力さ
れる。コントローラ9は、映像信号データS1及びS2
それぞれを上ソース用の映像信号データと下ソース用の
映像信号データとに分けて出力し、またドライバーのサ
ンプリング開始を決めるサンプリング開始信号SPを作
り、出力している。ここで、映像信号のうち1画素おき
の1〜640画素のデータと1画素おきの641〜12
80画素のデータとの各々を、上ソース用の映像信号デ
ータS1U、S2Uとする。下ソース用の映像信号デー
タも同様に処理される。
は、液晶表示装置ユニット6のコントローラ9に入力さ
れる。コントローラ9は、映像信号データS1及びS2
それぞれを上ソース用の映像信号データと下ソース用の
映像信号データとに分けて出力し、またドライバーのサ
ンプリング開始を決めるサンプリング開始信号SPを作
り、出力している。ここで、映像信号のうち1画素おき
の1〜640画素のデータと1画素おきの641〜12
80画素のデータとの各々を、上ソース用の映像信号デ
ータS1U、S2Uとする。下ソース用の映像信号デー
タも同様に処理される。
【0020】上記映像信号データS1Uは、それに対応
する前半用のソースドライバー8aに入力され、映像信
号データS2Uもそれに対応する後半用のソースドライ
バー8bに入力される。更に、図3(g)に示すサンプ
リング開始信号SPは、前半用のソースドライバー8a
及び後半用のソースドライバー8bの各々の先頭のドラ
イバーに分配して入力される。このため、図3(d)に
示される前半分(1〜640画素分)の映像信号データ
S1と、図3(e)に示される後半分(641〜128
0画素分)の映像信号データS2とは、元のサンプリン
グクロック信号(ck1)(図3(b)参照)の半分の
サンプリングクロック信号(ck2)(図3(f)参
照)で同時に液晶表示装置ユニット6に入力され、液晶
パネル7の左半分の画面と右半分の画面とが同時に表示
されることになる。
する前半用のソースドライバー8aに入力され、映像信
号データS2Uもそれに対応する後半用のソースドライ
バー8bに入力される。更に、図3(g)に示すサンプ
リング開始信号SPは、前半用のソースドライバー8a
及び後半用のソースドライバー8bの各々の先頭のドラ
イバーに分配して入力される。このため、図3(d)に
示される前半分(1〜640画素分)の映像信号データ
S1と、図3(e)に示される後半分(641〜128
0画素分)の映像信号データS2とは、元のサンプリン
グクロック信号(ck1)(図3(b)参照)の半分の
サンプリングクロック信号(ck2)(図3(f)参
照)で同時に液晶表示装置ユニット6に入力され、液晶
パネル7の左半分の画面と右半分の画面とが同時に表示
されることになる。
【0021】従って、本発明にかかる表示装置の駆動回
路は、画像信号データの各水平周期をインターフェース
部で前半と後半とに分割し、前半の画像信号データを液
晶表示装置ユニット6内の前半用のソースドライバー8
aに、後半の画像信号データを液晶表示装置ユニット6
内の後半用のソースドライバー8bに並行して同時的に
入力し、液晶パネル7の画面を分割表示する。このと
き、ソースドライバー8a、8bに与えられるサンプリ
ングクロック信号(ck2)は、分周器3により元のサ
ンプリングクロック信号(ck1)に対して1/2に分
周されていて、従来程度の速度に落ちている。このた
め、サンプリングクロック信号(ck2)としては25
MHzの半減したものの使用が可能となる。
路は、画像信号データの各水平周期をインターフェース
部で前半と後半とに分割し、前半の画像信号データを液
晶表示装置ユニット6内の前半用のソースドライバー8
aに、後半の画像信号データを液晶表示装置ユニット6
内の後半用のソースドライバー8bに並行して同時的に
入力し、液晶パネル7の画面を分割表示する。このと
き、ソースドライバー8a、8bに与えられるサンプリ
ングクロック信号(ck2)は、分周器3により元のサ
ンプリングクロック信号(ck1)に対して1/2に分
周されていて、従来程度の速度に落ちている。このた
め、サンプリングクロック信号(ck2)としては25
MHzの半減したものの使用が可能となる。
【0022】なお、上記実施例では、表示装置の駆動回
路がインターフェース部を備え、そのインターフェース
部の出力バッファ5a、5bから1水平期間のデータ信
号を分割する構成としているが、その信号と同等の信号
をコンピュータ等を用いて得るようにしてもよい。コン
ピュータを用いる場合には、本発明の表示装置の駆動回
路は、図2に示すインターフェース部は省くことができ
る。
路がインターフェース部を備え、そのインターフェース
部の出力バッファ5a、5bから1水平期間のデータ信
号を分割する構成としているが、その信号と同等の信号
をコンピュータ等を用いて得るようにしてもよい。コン
ピュータを用いる場合には、本発明の表示装置の駆動回
路は、図2に示すインターフェース部は省くことができ
る。
【0023】また、上記実施例では映像信号データの各
水平周期分を2つに分割する場合を説明したが、本発明
はこれに限らず、映像信号の分割数とそれに合ったクロ
ックの分周により、ドライバーのサンプリング速度の仕
様を満足できる映像データを作り、種々の高速な映像信
号を表示することも可能であり、映像信号データの各水
平周期分を3つ以上に分割しても実施できる。
水平周期分を2つに分割する場合を説明したが、本発明
はこれに限らず、映像信号の分割数とそれに合ったクロ
ックの分周により、ドライバーのサンプリング速度の仕
様を満足できる映像データを作り、種々の高速な映像信
号を表示することも可能であり、映像信号データの各水
平周期分を3つ以上に分割しても実施できる。
【0024】
【発明の効果】以上のように本発明によれば、映像信号
データの各水平周期分を複数に分割して表示装置の画面
を分割表示できるので、従来の低いサンプリング速度で
しか動作しないディジタルソースドライバーを使用して
も、現行では表示できない高速なディジタル映像信号で
の表示が可能となる。
データの各水平周期分を複数に分割して表示装置の画面
を分割表示できるので、従来の低いサンプリング速度で
しか動作しないディジタルソースドライバーを使用して
も、現行では表示できない高速なディジタル映像信号で
の表示が可能となる。
【図1】本発明にかかる表示装置の駆動回路を適用した
液晶表示装置ユニット部分を示すブロック図。
液晶表示装置ユニット部分を示すブロック図。
【図2】図1の駆動回路のインターフェース部を示すブ
ロック図。
ロック図。
【図3】図1の駆動回路におけるタイミング波形図。
【図4】従来のディジタルソースドライバーを示すブロ
ック図。
ック図。
1、4、13 切換スイッチ 2 ラインメモリ 3 分周器 5 出力バッファ 6 液晶表示装置ユニット 7 液晶パネル 8a 前半用のソースドライバー 8b 後半用のソースドライバー 9 コントローラ
Claims (1)
- 【請求項1】映像信号データがディジタル信号で与えら
れると共に該映像信号データをサンプリングして表示装
置の画面に表示する表示装置の駆動回路であって、 入力された映像信号データの各水平周期分を複数に分割
すると共に、その分割数と同じ数に該映像信号データの
サンプリングを開始するための信号を分配し、表示装置
の画面を分割表示する表示装置の駆動回路。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP1669192A JPH05210359A (ja) | 1992-01-31 | 1992-01-31 | 表示装置の駆動回路 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP1669192A JPH05210359A (ja) | 1992-01-31 | 1992-01-31 | 表示装置の駆動回路 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH05210359A true JPH05210359A (ja) | 1993-08-20 |
Family
ID=11923332
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP1669192A Pending JPH05210359A (ja) | 1992-01-31 | 1992-01-31 | 表示装置の駆動回路 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH05210359A (ja) |
Cited By (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US6333729B1 (en) | 1997-07-10 | 2001-12-25 | Lg Electronics Inc. | Liquid crystal display |
KR100470758B1 (ko) * | 2001-04-16 | 2005-03-08 | 엔이씨 엘씨디 테크놀로지스, 엘티디. | 입력 화소 데이터 재배열 회로를 구비한 액정 표시 유닛 |
JP2007164152A (ja) * | 2005-12-16 | 2007-06-28 | Chi Mei Electronics Corp | フラットパネルディスプレイとその駆動装置および駆動方法 |
-
1992
- 1992-01-31 JP JP1669192A patent/JPH05210359A/ja active Pending
Cited By (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US6333729B1 (en) | 1997-07-10 | 2001-12-25 | Lg Electronics Inc. | Liquid crystal display |
KR100470758B1 (ko) * | 2001-04-16 | 2005-03-08 | 엔이씨 엘씨디 테크놀로지스, 엘티디. | 입력 화소 데이터 재배열 회로를 구비한 액정 표시 유닛 |
US7030852B2 (en) | 2001-04-16 | 2006-04-18 | Nec Lcd Technologies, Ltd. | Liquid crystal display unit having incoming pixel data rearrangement circuit |
JP2007164152A (ja) * | 2005-12-16 | 2007-06-28 | Chi Mei Electronics Corp | フラットパネルディスプレイとその駆動装置および駆動方法 |
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Legal Events
Date | Code | Title | Description |
---|---|---|---|
A02 | Decision of refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A02 Effective date: 19990621 |