JP3262908B2 - Lcdディスプレイおよびそのデータ駆動線数低減方法 - Google Patents
Lcdディスプレイおよびそのデータ駆動線数低減方法Info
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Description
レイおよび関連するドライブ回路に関し、特に多重化構
成を使用して入力ビデオデータ線数を低減しかつビデオ
データ信号が加わる前にプリチャージされるデータ線お
よびピクセルキャパシタを使用してセレクトされたデー
タ線およびピクセルキャパシタが到来するビデオデータ
信号により適切なレベルへディスチャージされディスプ
レイ動作が一層良くされるLCDビデオディスプレイ列
ドライブ回路に関する。
的に行列マトリクス構成とされ電気光学材薄層の両側に
支持された複数個のディスプレイエレメントを利用して
いる。スイッチングデバイスがディスプレイエレメント
に付随していてデータ信号の印加を制御する。このディ
スプレイエレメントはスイッチングデバイスとしてのト
ランジスタにより駆動されるピクセルキャパシタを含ん
でいる。ピクセル電極の一つがマトリクスディスプレイ
の一方側にあり各ピクセルに対する共通電極がマトリク
スディスプレイの反対側に形成されている。トランジス
タは通常ガラス等の透明基板上に堆積される薄膜トラン
ジスタ(TFT)である。スイッチング素子トランジス
タはスイッチングトランジスタとして、ディスプレイマ
トリクスと同じ側でガラス上に堆積されたピクセル電極
に接続されているソース電極を有する。所与の列内の全
スイッチングトランジスタのドレーン電極がデータ信号
が印加される同じ列導体に接続されている。所与の行内
の全スイッチングトランジスタのゲート電極が共通行導
体に接続されており、それには行選定信号が加えられて
セレクトされた行内の全トランジスタがON状態に切り
替えられる。行選定信号により行導体を走査することに
より、所与の行内の全スイッチングトランジスタがON
とされて全行が順次セレクトされる。同時に、各行の選
定に同期して列導体にビデオデータ信号が加えられる。
行セレクト信号により所与の行内のスイッチングトラン
ジスタがセレクトされると、スイッチングトランジスタ
に送られるビデオデータ信号によりピクセルキャパシタ
は列導体上のデータ信号に対応する値にチャージされ
る。ディスプレイの両側に電極を有する各ピクセルはキ
ャパシタとして作用する。セレクトされた行に対する信
号が除去されると、ピクセルキャパシタ内の電荷は次の
繰返しまで蓄積されそこでその行が行セレクト信号によ
り再びセレクトされて新しい電圧が蓄積される。このよ
うにして、ピクセルキャパシタに蓄積された電荷により
マトリクスディスプレイ上に画像が形成される。
ョン信号に対して使用されているが、ここではTV画像
即ちディスプレイ以外のディスプレイをカバーするもの
とする。このようなディスプレイは動く図柄等を表示す
るLCDディスプレイを有するハンドヘルドゲームとす
ることができる。
依存する。市販の非走査の白黒アクティブマトリクス液
晶ディスプレイでは1024列768行のディスプレイ
が普通である。このようなディスプレイは1792本の
行および列ドライバリード線を必要とする。
いほど多くの所要列および行ドライブ線をディスプレイ
に接続することが困難になる。したがって、マトリクス
外部回路とマトリクス自体上に堆積された回路間に必要
な接続数を低減するための多くのデバイスが開発されて
いる。米国特許第4,922,240号にはLCD素子
のピクセルドライバの製造に使用するのと同じ技術を使
用してディスプレイ基板上に走査機構電子装置を集積す
ることが提案されている。さらに、個別ピクセルをセレ
クトするためにアクティブディスプレイで使用されるの
と同じマトリクス構成に基いた交換器もしくはスイッチ
構成を使用してマトリクスとの接続数を低減することも
提案されている。TVディスプレイとして使用する操作
については記載されていない。
くとも2個のディスプレイ素子を各行内の信号線に接続
するスイッチング構成を使用して各行を順次走査しディ
スプレイ信号が同じ信号線を介してその信号線に接続さ
れた少くとも2個のディスプレイ素子の各々にタイムシ
リアルに加えられるようにする列信号線数が低減された
ディスプレイデバイスが開示されている。したがって、
信号線の総数を行方向のディスプレイ素子数以下に低減
することができる。
像素子を少くとも2個の画像素子の群(グループとも言
う)構成とし各群の画像素子を同じスイッチング信号お
よびデータ導体によりアドレスすることによりアドレス
導体数を低減することが提案されている。各群のピクセ
ル素子に関連するスイッチングトランジスタはスイッチ
ング信号のそれぞれ異なる電圧レベルで作動することが
できる。したがって、選択された振幅範囲にわたり所定
の方法で電圧レベルが変化するドライブ手段から得られ
るスイッチング信号を使用することにより、各群の画像
素子に関連するスイッチングトランジスタを選択的にコ
ントロールすることができる。このようにして、1本の
導体にいくつかの異なる電圧を印加して同数のピクセル
を作動させることができる。
ィブマトリクス液晶ディスプレイのほとんど全てが非走
査型である。このような非走査型ディスプレイは各列お
よび行線ごとに1本の外部リード線を必要とする。前記
したように、黒白768×1024コンピュータディス
プレイ用ダイレクトラインインターフェイスドライバは
1792本のリード線を必要とする。前記したように、
ディスプレイドライバ内でこれだけ多くのリード線を処
理することは大変な問題である。これはディスプレイの
分解能および複雑度が増すほど悪化していく問題であ
る。問題を解決するための2つの主目標は所要入力リー
ド線数を低減しシフトレジスタ、ラツチおよびドライバ
からなるドライバ回路をディスプレイ基板上に集積する
ことである。個々の基板上へ集積回路を実装する必要が
なくなるため、これによりコストが低減され信頼度が向
上する。
することができる新しいデータドライバ回路および新し
いドライブ方式に関するものである。これにより、非走
査型アクティブマトリクス液晶ディスプレイをアレイに
接続するのに必要な周辺集積回路およびハイブリッドア
センブリのコストが不要となる。したがって本発明で
は、384×240ピクセルカラーハンドヘルドTVを
例として使用して、ディスプレイ自体の上にデマルチプ
レクシング回路およびプリチャージ回路を薄膜トランジ
スタ(TFT)により製作し、これによりビデオデータ
を転送し、ディスプレイをビデオソースに直接仲介して
結びつける。ディスプレイ上にないビデオ源からのビデ
オ信号は指示されたライン時間間隔の1/6を使用して
入力データリード線を介してディスプレイへ行くような
多重化構成とされている。前記したように、これは単な
る例であり、入力リード線数の異なる他のディスプレイ
に対しては異なる比率を使用することができる。コント
ロール信号により第1ブロックのデマルチプレクシング
回路は第1群(群はグループとも言う)のディスプレイ
内部データ線にビデオ信号を転送することができる。第
1群の垂直列すなわち列への最初のデータ転送完了後、
指示ライン時間間隔の第2の1/6期間中に第2群の内
部データ線へ第2群のビデオ信号が転送される。これは
第2のデマルチプレクシング回路のコントロール信号を
イネーブルすることにより行われる。使用例におけるデ
マルチプレクシング回路1〜6もしくは列数の異なる他
のディスプレイの1〜Nに対してこの操作が順次継続さ
れる。
間t中にセレクトされたZ行内のX群Y個のスイッチン
グ素子へのビデオ信号を切り換えることにより全行のビ
デオ情報が内部データ線へ転送される。この新しいデマ
ルチプレクシングドライブ方式の利点は外部リード線接
続数が例における384から64本の入力データ線と必
要なコントロールおよびクロック信号を含む79まで低
減され、コネクタピッチの小さいTFT LCDアセン
ブリと実装上の問題点が著しく解決されることである。
その結果、製造コストが低減される。
ャージ回路が各データ線に使用される。これらの回路は
関連するピクセルキャパシタをハイもしくはローの予選
定電圧レベルへ同時にプリチャージして割り付けられた
データ信号入力時間間隔t中にデータ線とピクセルキャ
パシタを所要レベルへ放電するだけでよいようにするの
に使用される。各データ線には2個のトランジスタしか
使用されず、入力信号デマルチプレクシング用と内部デ
ータ線のプリチャージ用である。したがって、高い収率
でマトリックスを製造するのが容易になる。
ディスプレイ自体上に堆積されたデマルチプレクシング
回路およびプリチャージ回路を有するLCDを製造する
ことが本発明の主な特徴となる。
クセルキャパシタを所定の電圧レベルへプリチャージ
し、データ信号入力時間間隔中にデータ線およびピクセ
ルキャパシタが所要レベルに放電するようにして、ピク
セルキャパシタおよびデータ線をチャージングするより
も少い時間で済むようにする、プリチャージトランジス
タを各データ線に対して有する、自己走査TFTLCD
デバイス用の新しいデータドライバ回路を提供すること
が本発明のもう一つの特徴である。各データ線に対して
1個のデマルチプレクシング用トランジスタと1個のプ
リチャージトランジスタだけを使用して製造中の収率を
高めることも本発明の特徴である。
してディスプレイ14に接続されてその上の素子を駆動
する“オフグラス(off−glass)”コントロー
ル回路12を含む新しいディスプレイシステム10の基
本ブロック図である。図1に示すアクティブマトリクス
液晶ディスプレイ(AMLCD)は代表的に200,0
00個以上のディスプレイ素子により構成される。明ら
かに、テレビジョン画像のディスプレイに関しては、デ
ィスプレイ素子数が多いほど画像の分解能が高くなる。
例えば、ハンドヘルドTVについては、アレイは384
列および240行を含むことができる。このような場
合、92,000個を越えるディスプレイ素子やピクセ
ルが必要とされる。もちろん、大型セットについてはこ
の数は増大する。ピクセルの駆動に使用されるトランジ
スタは通常ガラス等の基板上に堆積される薄膜トランジ
スタ(TFT)である。ディスプレイ素子はガラス上に
堆積された電極および対向基板上の共通素子を含み、対
向する基板は電気光学材により分離されている。ガラス
とすることができる基板14(基板14はディスプレイ
本体を形成するためディスプレイ14としても言及され
る)上で、列データドライバ回路16はビデオデータ信
号により列線24を駆動する。行セレクトドライバ25
は公知の任意タイプのものとすることができ、セレクト
された各行内のピクセルが順次活性化されて行1〜24
0が順次駆動される。
ロール回路12において、サンプルキャパシタ50はシ
フトレジスタ49を介して入力回路64からデータを受
信する。シフトレジスタ49内のデータと協調して赤、
緑および青ビデオ信号が回路58からサンプルキャパシ
タ50へ接続される。クロック信号および水平垂直同期
化信号がコントロール論理60から供給される。高電圧
発生器62が必要な高電圧電力を供給する。サンプルキ
ャパシタ50の出力は64個の出力アンプ52に接続さ
れている。したがって、1行を形成するピクセルに38
4個のディスプレイ素子が含まれる場合、64本のデー
タ入力線13が、一時に64ビットづつ、基板14上の
384個のディスプレイ素子に多重接続される。後記す
るように、64のビデオ出力は線13により列データド
ライバ16を介して列導体24に接続される。線18に
より、コントロール回路12から6対のビデオセレクト
信号線がガラス14上の列データドライバ16に加えら
れ64個の出力信号が切り換えられてガラス14上のZ
(240)行の中のセレクトされた行内の異なるX
(6)群のY(64)列24へ順次接続される。後記す
るように、行セレクトドライバ信号、クロックおよびパ
ワー線がコントロール回路12から線21を介して行セ
レクトドライバ回路25に接続される。行セレクトドラ
イバ回路25は公知の任意の回路とすることができる。
プリチャージ信号は線48を介して基板14に接続され
る。
されると、図1の行1のディスプレイ素子19,36,
42が活性化される。次に、順次、列データドライバ回
路16内のプリチャージ回路により第1群内の各データ
線および各ピクセルキャパシタ22を所定電圧へチャー
ジする信号が与えられる。次に、列線24にデータ信号
が加えられると、列線24に加わるデータ信号のレベル
に依存する量だけキャパシタが放電される。プリチャー
ジ回路を使用してデータ信号によりキャパシタ22を放
電できるようにする理由は、図4に示す場合よりも遙か
に早く放電するためである。図4に示すように、キャパ
シタが0から番号23で示す値まで充電するのに要する
時間量はxである。しかしながら、キャパシタが最大値
から同じレベルへ放電するのに要する時間量はxよりも
遙かに小さいyである。さらに、全量充電するのに時間
tを要し完全放電するのに要する時間zは短い。放電時
間は充電時間よりも遙かに迅速であるためデータ信号入
力時間間隔中にデータ線キャパシタは適切な電圧レベル
へ放電することができる。これにより、データ入力時間
間隔に要する時間を短縮できる。
レクトされた行内の全群の全ピクセルキャパシタが同時
にフルバリュー(full value)へ充電されX群内で順次
放電される。このようにして、Z行のX群のY個のスイ
ッチングトランジスタ19,36,42が基板14上に
堆積される。ディスプレイが例えば384×240ピク
セルディスプレイである場合には、240行の64個の
スイッチング素子の6群が基板上に堆積されたものとな
る。このような例についてここで検討を行う。
も、基板外部の列コントロール回路12により線13を
介して基板14へビデオ信号が与えられる。また、図1
の線21を介したコントロール回路12からのコントロ
ール信号により作動するTFTトランジスタを含む公知
の行ドライバ回路25により公知のように順次行がセレ
クトされる。行は図2に1〜Z行として示され、最初と
最後の行だけを示す。残りの行は同じである。また、図
2にはX群のY個のスイッチング素子もある。スイッチ
ング素子はトランジスタおよび関連するピクセルキャパ
シタにより構成される。番号72で示す第1群には、簡
単にするために4個のスイッチング素子86,88,9
0,92しか示されていない。実際にはX群が6群であ
って使用する列数が384列であれば、このようなスイ
ッチング素子は64個となる。ガラス基板14上に堆積
された薄膜トランジスタとすることができるトランジス
タ78,80,82,84のゲートは行導体1を介して
行ドライバ回路25に接続されている。ピクセルキャパ
シタすなわちディスプレイ素子94,96,98,10
0はトランジスタ78,80,82,84の各ソース電
極に接続される。電極28はピクセルキャパシタの第2
プレートでありディスプレイ14の対向基板上に配置さ
れた共通電極セグメントである。
リチャージトランジスタに接続された線118を介して
出力信号を発生し、各プリチャージトランジスタが基板
14上の384本の各列線に接続されている。プリチャ
ージトランジスタのサンプルを番号66で示すグループ
1内に示す。プリチャージトランジスタ120のドレー
ンは電圧源V+に接続され、ソース電極は内部データ線
列D1に接続されている。奇数番列線の全てにこのよう
なトランジスタが接続されている。例えば図2におい
て、トランジスタ120および124のドレーン電極は
V+電圧源128に接続されている。偶数番列線のトラ
ンジスタ122および126のドレーン電極はV−電圧
源127に接続されている。番号13で示す列ドライバ
回路12からの64本の出力線D1-64はX群の各々に並
列接続されたビデオ信号を含んでいる。列数が384と
される本例では、入力線13から多重化ビデオ入力信号
を受信する64列(Y=64)の6群(X=6)があ
る。デマルチプレクサドライバ回路102はブロック1
のグループ1内のデマルチプレクシング用トランジスタ
108,110……112,114のゲートに接続され
るフェーズ1およびフェーズ2パルスを発生する。デマ
ルチプレクサドライバ回路102からの線対130およ
び132上の同様な信号により番号68および70で示
すグループ5および6(X−1およびX)が駆動され
る。このようにして、デマルチプレクサドライバ回路1
02により最初に64本のビデオデータ入力線13がス
イッチング素子86,88……90,92の第1群72
内の64列に接続され、次に64線が連続するグループ
2〜Xの各々に順次接続される。したがって、64本の
データ入力線13は図示するグループ74,76を含む
次の5群のスイッチング素子に順次接続される。各行1
〜Zも順次セレクトされ、本例ではZは240行に等し
い。64本の入力データ線が6群1〜Xの全てと順次接
続されるたびに次ぎの1行がセレクトされる。
たデータドライバ回路のブロック図を示している。それ
は、単なる例として、384×240ピクセルカラーハ
ンドヘルドTVを提供するディスプレイを有している。
水平ピクセルカウントは384である。デマルチプレク
シングおよびプリチャージ回路66〜130および13
2、6群、はディスプレイ自体上の薄膜トランジスタに
より製作されて、これにより入力線13からビデオデー
タを転送し、ディスプレイを線13を介したビデオ源か
らのビデオ信号に直接仲介し結びつける。図2に示すよ
うに、ビデオ源(オフグラス集積回路)からのビデオ信
号は指示されたライン時間間隔を使用して入力データリ
ード線13(D1-64)を介して一時にディスプレイ14
の64本のデータ線へ到来するようにされている。線1
04,106上等のデマルチプレクサドライバ回路10
2からの2つのコントロール信号によりブロック66内
の第1ブロックのデマルチプレクシング用トランジスタ
108,110……112、114がイネーブルされて
ディスプレイの第1の64本の内部データ線D1〜D64
に接続されたスイッチング素子へ線13を介してビデオ
信号が転送される。第1の64個の列スイッチング素子
へのデータ転送完了後、指示されたライン時間間隔の次
の1/6期間中に内部データ線D65〜D128へ次の64
のビデオ信号が転送される。これは第2のデマルチプレ
クシング回路(図示せず)の第2の対のコントロール信
号をイネーブルして行われる。グループ3〜6内のデマ
ルチプレクシング回路に対して同じ操作が順次継続され
る。このようにして、42μSの割付けられたデータ入
力時間内にビデオ情報の1行線全部が内部データ線へ転
送される。ピクセルを安定化させるための7μSが付加
される。したがって、総データ入力時間は49μSとな
る。
の利点は、外部接続数が384から79へ低減されるこ
とと、コネクタピッチの小さいことに起因するTFTL
CDのアセンブリおよび実装の問題が著しく解決される
ことである。その結果、製造コストが低減される。10
8,110……112,114等のトランジスタを使用
するデマルチプレクシング方式に加えて、トランジスタ
120,122……124,126等のプリチャージト
ランジスタを使用して関連するデータ線およびスイッチ
ング素子を所定の電圧レベルV+もしくはV−へ同時に
プリチャージして、データ信号、入力時間間隔中のみデ
ータ線を所定のビデオ信号レベルへ放電すればよいよう
にされる。このような1個のプリチャージトランジスタ
には各列線が関連している。本発明では、各データ線に
2個のトランジスタしか使用せず、それはデマルチプレ
クシング用トランジスタおよびプリチャージトランジス
タである。したがって、高い収率で回路を製造すること
ができる。
照すれば、図3の(a)線から、NTSC TVシステ
ムと接続して動作する384×240ピクセルディスプ
レイの走査線時間間隔はおよそ63μSとなることが判
る。予定として立てられたラインタイムは、前のライン
ディセレクション(非選択)に対しては8μS、走査デ
ータ線プリチャージに対しては6μS、外部ビデオ源か
らディスプレイのX群のデータ線へのビデオデータの多
重転送に対しては42μSであり、ピクセルの安定化に
対しては7μSである。これを(c)線に示す。このよ
うにして、図3の(d)線を見れば、最初の8μSのデ
ィセレクト時間中に、前に走査された線ln-1は図3の
(e)線に示すように20V等のセレクトレベルから−
5Vのディセレクト(非選択)レベルへ放電される。これ
によりn−1線内の全ピクセルキャパシタが切り離され
てそのビデオデータ電荷を保持するようにされる。8μ
Sのディセレクト時間に続いて、(f)線に示す行nの
プリチャージ信号が6μSだけ25V等の所定電圧へ上
昇する。トランジスタ120,122……124,12
6がオンとされ6μS内に奇数番内部データ線D1,D3
……D383がV+レベルへプリチャージされ偶数番内部
データ線D2,D4……D384がV−レベルへプリチャー
ジされる。例えば、V+電圧レベルはおよそ5Vであ
る。しかしながら、V+レベルは5Vよりも幾分低くし
てデバイスの動作速度を高めるのが有利である。図5に
示すように、6μSのプリチャージ期間中に、内部デー
タ線およびピクセルキャパシタを5Vの最大電圧よりも
低いV+値に充電することができる。次に、データ線に
よりピクセルキャパシタがデータ入力電圧レベルへ充電
される7μS期間中に、ΔV2に関してV+から最大デ
ータ電圧となる時間と、ΔV1に関して最小データ電圧
へ放電される時間は同じ時間を要する。いずれの場合に
も、ΔV2に関する充電時間およびΔV1に関する放電時
間を短縮すなわち最適化することができる。データ線お
よびピクセルキャパシタ充電時間はΔV2を得るのに要
する時間量へ短縮されており、所要のデータ線所定電圧
が5Vよりも低ければ、所要レベルまでの放電時間はΔ
V2の放電に等しい時間量だけ短縮される。このように
して、V+電圧レベルを最適化して内部データ線と関連
するピクセルキャパシタを例えば5Vの最大入力ビデオ
データ信号レベルへ充電する時と内部データ線と関連す
るピクセルキャパシタを例えば0Vの最小入力ビデオデ
ータ信号レベルへ放電する時の時間差が最小となるよう
にすることができる。このようにして、プリチャージ期
間中にピクセルキャパシタは5Vのフルバリューへ充電
されないため所要プリチャージ時間は短くなる。同じ分
析は偶数番プリチャージトランジスタ122……126
のV−電圧レベル127にも適用される。94,96…
…98,100等のセレクトされた行内の全内部データ
線およびピクセルキャパシタがV+もしくはV−レベル
へプリチャージされた後で、到来するビデオデータ信号
(赤、緑、青)およびその相補信号がデータ入力線D1
〜D64へ送られる。この場合、D1,D3……D63は正
極性ビデオ信号でありD2,D4……D64はその相補極性
ビデオ信号である。これらのビデオ信号電圧を図3の
(j)および(k)線に示す。線104および106を
介したデマルチプレクサドライバ回路102からのコン
トロール信号は、図3の(g)線に示すように、それぞ
れ7μSだけ25Vおよび30Vへ引き上げられる。こ
の場合X=6である他のX群の各入力線は図3の
(g)、(h)、(i)線に示すように7μSだけ線1
3を介してビデオデータが接続される。データ線を奇偶
の2群へ分割するのは本システムにおいてデータ電圧極
性反転方式が使用されるためである。データ電圧極性は
TVフレームの2フィールド間で変えられる。63μS
時間間隔の最終7μSは最終グループ、グループX、内
のピクセルを安定化するのに使用される。
8,110……112,114は、本例において7μS
である割付けられた時間間隔内に、内部データ線D1〜
D64が、到来するビデオデータカラー信号の15mV以内
に放電できるようなサイズとされる。66〜68および
70の各デマルチプレクシング回路、あるいは6群全部
に対して連続動作が繰り返される。
ルスイッチングトランジスタは既に完全にONとされて
いる。したがって、走査された行(n−1)がディセレ
クト(非選択)された後で、次に行nのピクセルがプリ
チャージされる。残りの49μSデータ入力転送時間が
各8μSの本質的に等しい時間に割付けられる場合に
は、行nのD1〜D64列の第1ブロックのピクセルトラ
ンジスタがピクセル放電及び安定化時間のための全49
μSを有し、D65〜D128列に接続された行nの第2ブ
ロックのピクセルトランジスタがおよそ41μSの放電
及び安定化時間を有している。第3ブロックはおよそ3
3μSとなり、以下同様である。行nの最終ブロックピ
クセルトランジスタには実質的に僅か9μSのピクセル
放電及び安定化時間しか残されていない。図3(d)に
示すように6群のピクセルトランジスタの各々へ7μS
の放電時間を割り付け最後の群(#6)に対して最終7
μSをピクセル安定化用とすると、全ピクセルトランジ
スタに充分な放電及び安定化時間が与えられる。放電時
間が短いとピクセルの第6ブロックに対するエラー電圧
ΔVを発生する。ΔVを低減して256グレイレベルの
分解能とするために、最後の群(#6)に対してさらに
7μSをピクセル安定化時間に割付けることが望まし
い。この場合、第6群のピクセルキャパシタがそのビデ
オ信号レベルへ放電し、安定化するために14μSを利
用できる。(e)線に示すようにn−1線がディセレク
トされていると、n線がセレクトされておりその線に印
加される電圧は(l)に示すように20Vの最大値であ
る。
数および信号入力リード線数に影響を及ぼす。それは製
品の応用に応じて最適化もしくは妥協することができ
る。例えば、高分解能および/もしくは高画像品質に対
しては、小さいデマルチプレクシング比を使用して64
ではなくグループ当りより多くのビデオ信号リード線を
基板14へ接続することができる。また、要求グレード
の低い、もしくは低速ビデオ製品に対しては入力リード
線数を大幅に低減することができる。
ルトランジスタが使用され、また正確な信号電圧を得る
ためにデータ線やピクセルを充電するよりも放電する方
が遙かに容易かつ迅速に行われるため、ビデオ信号の入
力中にデータ線やピクセルが放電されるという事実によ
り、データ線およびピクセルは必要最高電圧レベルにプ
リチャージされる。
び106)を結合してグループ1内のデマルチプレクシ
ング用トランジスタ108,110……112,114
の全ゲートに供給する一つのコントロール線信号とする
ことができる。信号Φ1,eおよびΦ1,oの結合はゲート電
圧ストレスが問題ではなくデマルチプレクシング用トラ
ンジスタ108,110……112,114のデバイス
特性が内部データ線およびピクセルキャパシタを均一に
放電させるのに充分なほど良好である場合に行うことが
できる。同様に、図2の68および70を含む、他の5
群への130および132等の他のデマルチプレクシン
グ線対を結合して各対に対する1本のコントロール線と
することができる。このような場合には、マルチプレク
サゲートコントロール線数を半減することができる。
低減され列および行ドライバ回路がディスプレイ基板上
に直接集積されるアクティブマトリックス液晶ディスプ
レイが開示される。独立基板上に集積回路を実装する必
要性が無くなるため、これによりコストが低減され信頼
度が向上する。
ラーハンドヘルドTVが使用される。水平ピクセル数は
384である。デマルチプレクシングおよびプリチャー
ジ回路をディスプレイ自体の上に薄膜トランジスタによ
り製作してビデオデータを転送し、ディスプレイをビデ
オ源に直接仲介し結びつける。ディスプレイ外部のビデ
オ源からのビデオ信号は指示されたライン時間間隔の1
/6を使用してディスプレイの64本のデータ線へ一時
に到来するようにされる。6群の各々に2個ずつの12
個のコントロール信号により、異なる6ブロック内のデ
マルチプレクシング用トランジスタは到来するビデオ信
号をディスプレイの6群の64本の内部データ線へ順次
転送することができる。第1の64本の内部データ線へ
のビデオデータ転送完了後に、次の64個のビデオ信号
が内部データ線D65〜D128へ転送される。これはデマ
ルチプレクシング回路の第2セットのコントロール信号
をイネーブルして行われる。各ビデオデータ信号の転送
は指示されたライン時間間隔の1/6期間中に行われ
る。この操作は6つのデマルチプレクシング回路全部に
ついて順次継続される。42μSの割付けられたデータ
入力時間内に1行のビデオ情報全体が内部データ線へ転
送される。
発明の範囲を開示した特定形式に限定するものではな
く、特許請求の範囲に明記された発明の精神および範囲
に入る変更、修正、等価発明は全て本発明に含まれるも
のとする。
新システムおよびデータドライバ回路の基本ブロック
図。
路の詳細図。
示すキャパシタ充電波形図。
もしくはV−よりも低い電圧を印加して時間を節減する
ことを示す波形図。
クトされておりその線に印加される電圧は(e)に示す
ように20Vの最大値である。
び信号入力リード数に影響を及ぼす。それは製品の応用
に応じて最適化もしくは妥協することができる。例え
ば、高分解能および/もしくは高ピクチュア品質に対し
ては、小さいデマルチプレクス比を使用して64ではな
くグループ当りよく多くのビデオ信号リードを基板14
へ接続することができる。また、要求グレードの低いも
しくは低速ビデオ製品に対しては入力リード数を大幅に
低減することができる。
トランジスタが使用されまた正確な信号電圧を得るため
に放電するよりも充電する方が遥かに容易かつ迅速に行
われるためのビデオ信号の入力中にデータ線やピクセル
が放電されるという事実により、データ線およびピクセ
ルは必要最高電圧レベルプリチャージされる。
4および106)を結合してグループ1内の多重化トラ
ンジスタ108,110……112,114の全ゲート
に供給する一つのコントロール線信号とすることができ
る。信号Φ1,eおよびΦ1,oの結合はゲート電圧ス
トレスが問題ではなくデマルチプレクストランジスタ1
08,110……112,114のデバイス特性が内部
データ線およびピクセルキャパシタを均一に放電させる
のに充分なほど良好である場合に行うことができる。同
様に、図2の68および70を含む、他の5群への13
0および132等の他のデマルチプレクス線対を結合し
て各対に対する1本のコントロール線とすることができ
る。このような場合には、マルチプレクサゲートコント
ロール線数を半減することができる。
減されコラムおよびロードライバ回路がディスプレイ基
板上に直接集積されるアクティブマトリックス液晶ディ
スプレイが開示される。独立基板上に集積回路を実装す
る必要性が無くなるため、これによりコストが低減され
信頼度が向上する。
ラーハンドヘルドTVが使用される。水平ピクセル数は
384である。デマルチプレクサおよびプリチャージ回
路をディスプレイ自体の上に薄膜トランジスタにより製
作してビデオデータを転送しディスプレイがビデオ源に
直接インターフェイスされる。ディスプレイ外部のビデ
オ源からのビデオ信号は指示されたライン時間間隔の1
/6を使用してディスプレイ64のデータ線へ一時に到
来するようにされる。6群の各々に2個ずつの12個の
コントロール信号により、異なる6ブロック内のデマル
チプレクストランジスタは到来するビデオ信号をディス
プレイの6群の64本内部データ線へ逐次転送すること
ができる。第1の64本内部データ線へのビデオデータ
転送完了後に、次の64個のビデオ信号が内部データ線
D65〜D128へ転送される。これはデマルチプレク
ス回路の第2セットのコントロール信号をイネーブルし
て行われる。各ビデオデータ信号の転送は指示されたラ
イン時間間隔の1/6期間中に行われる。この操作は6
つのデマルチプレクス回路全部について逐次継続され
る。42μSの割付けられたデータ入力時間内に1ロー
のビデオ情報全体が内部データ線へ転送される。
発明の範囲を開示した特定形式に限定するものではな
く、特許請求の範囲に明記された発明の精神および範囲
に入る変更、修正、等価発明は全て本発明に含まれるも
のとする。
新システムおよびデータドライバ回路の基本ブロック
図。
路の詳細図。
示すキャパシタ充電波形図。
もしくはV−よりも低い電圧を印加して時間を節減する
ことを示す波形図。
Claims (12)
- 【請求項1】 電気光学材料の薄層で分離され、少なく
とも一方がガラスである、第1および第2の対向基板を
有するディスプレイを駆動する回路において、該回路
は、 第1の基板上に各群Y個でX群Z行の行列状に堆積され
各々がディスプレイ素子を形成するピクセルキャパシタ
およびスイッチングトランジスタを含む複数のスイッチ
ング素子と、 第2の基板上のピクセルキャパシタ用共通電極と、 各々が入力データ電圧レベルを有するY本の信号データ
入力線と、行1〜Zを順次選択し、選択された行のスイッチング素
子を活性化する行ドライブ回路と 、 第1の基板上に堆積され、Y本の信号データ入力線を選
択された行に属するX群の各群のY個のスイッチング素
子に順次接続するX群のデマルチプレクシング回路と、第1の基板上に堆積され、対応するスイッチング素子に
直接接続されているX群のプリチャージ素子と、を有
し、 このプリチャージ素子は、選択された行内のピクセルキ
ャパシタを2種類の所定のDC電圧レベルにプリチャー
ジし、各行が選択される時に、Y本のデータ入力線上の
入力データにより、選択されたピクセルキャパシタが入
力データ電圧レベルに放電されて画像を形成することを
特徴とする、 ディスプレイ駆動回路 。 - 【請求項2】 請求項1のディスプレイ駆動回路は更
に、 各プリチャージ素子を形成するソース、ドレーンおよび
ゲート電極を有し、ソース電極はその関連するデータ線
の中の一本に接続されている薄膜トランジスタと、前記各薄膜トランジスタ のドレーン電極に接続されてい
る電圧源と、前記各薄膜トランジスタ のゲート電極に接続され、Y本
の入力データ線上のデータが前記スイッチング素子に接
続される前に、前記各薄膜トランジスタを導通させ、選
択された行の関連するピクセルキャパシタをプリチャー
ジして所定の2種類のDC電圧レベルとし、データ線に
より各ピクセルキャパシタが画像を形成する入力データ
電圧レベルに放電することを可能にするプリチャージ信
号線とを含むプリチャージ回路を有するディスプレイ駆
動回路。 - 【請求項3】 請求項2のディスプレイ駆動回路は更
に、 奇数番入力データ線D1,D3,……Dn-1に接続された
前記薄膜トランジスタのドレーン電極に接続された第1
の所定電圧と、 偶数番の入力データ線D2,D4,……Dnに接続された
前記薄膜トランジスタのドレーン電極に接続された第1
の所定電圧と異なる第2の所定電圧とを含むプリチャー
ジ回路を有するディスプレイ駆動回路。 - 【請求項4】 ディスプレイ装置へのデータドライブ線
数を低減するシステムにおいて、前記ディスプレイ装置
は、電気光学材料の薄層により分離された対向する第1
および第2の対向基板を有し、少なくとも第1の基板は
ガラスであり、複数本の内部データ線が各群Y個でX群
Z行として第1の基板上に堆積された複数個のピクセル
キャパシタに接続されていて、チャージされると画像を
発生するようにされており、各列は内部データ線とピク
セルキャパシタを有し、かつ該システムは第1と第2の
回路を有し、第1の回路は、行nに関し、Y本の信号データ入力線
を、第1の固定時間t内において各群のY本の列に順次
切り換えてゆき、一方、一つの群のY本の列において
は、第2の固定時間t/X内において該群のピクセルキ
ャパシタを入力データ電圧レベルに向けて充放電させ、
X群の最後の群の第2の固定時間の後に、該最後の群の
ピクセルキャパシタの電圧レベルが入力データ電圧レベ
ルに落ち付くのに十分な時間として第3の付加的な固定
時間t/Xが付加されており、 行(n−1)のすべてのピクセルキャパシタは、第4の
固定時間切り離されている間に画像を形成し、 第2の回路は、第5の固定時間内で、行nのピクセルキ
ャパシタをプリチャージして所定のDC電圧レベルに
し、次いで該所定のDC電圧レベルを指定された時間内
に入力データ電圧レベルに変える、 ことを特徴とするシステム。 - 【請求項5】 電気光学材料の薄層により分離され少な
くとも第1の基板がガラスである対向する第1および第
2の基板を有し且つ各群Y個でX群Z行として第1の基
板上に堆積されてチャージされた時にディスプレイ上に
画像を発生する複数個のピクセルキャパシタを有するデ
ィスプレイのデータドライブ線数低減方法において、該
方法は、 (a)Y本の信号データ入力線を、第1の固定時間t内
に、Z行の選択された1つの行nのY列X群の全てのピ
クセルキャパシタに順次切り換え、第2の固定時間の
間、Z行の選択された1つの行のY列X群の各々の群に
順次切り換え、各データ線とその関連する選択されたピ
クセルキャパシタが入力データ電圧レベルとなるように
し、前記第2の固定時間と同じ長さの第3の付加的な固
定時間で、X群の最後の群の選択されたピクセルキャパ
シタが入力データ電圧レベルに落ち着くための十分の時
間が得られるようにし、 (b)第4の固定時間の間、行(n−1)の全ピクセル
キャパシタを切り離し、 (c)第5の固定時間の間、行n内の全ピクセルキャパ
シタをプリチャージして所定のDC電圧レベルにし、 (d)Z行の各々に対してステップ(a)から(c)を
連続して繰り返し、画像を形成するステップを含む。 - 【請求項6】 電気光学材料の薄層により分離され、少
なくとも一方がガラスである対向する第1および第2の
基板を有するディスプレイを駆動する回路において、該
回路は、 第1の基板上に各群Y個でX群Z行として行列状に堆積
され各々がディスプレイ素子を形成する、ピクセルキャ
パシタとスイッチングトランジスタを含む、複数のスイ
ッチング素子と、 第2の基板上のピクセルキャパシタ用共通電極と、 各々が入力データ電圧レベルを有するY本の信号データ
入力線と、所与の行を順次選択し、 選択された各行内のスイッチン
グトランジスタを活性化する行ドライブ回路と、 第1の基板上に堆積され、対応するスイッチング素子に
接続されて選択された行内の各データ線およびピクセル
キャパシタを2種類の所定のDC電圧レベルにプリチャ
ージする各群Y個でX群のプリチャージ素子とを含み、 前記ピクセルキャパシタがプリチャージされた後、順次
Y本の信号データ入力線をX群のそれぞれのY個の対応
するスイッチング素子に結合するデマルチプレクシング
回路を第1基板上に堆積し、Y本の信号データ入力線の
信号データが選択されたピクセルキャパシタを充放電し
て入力データ電圧レベルとし、各行が選択されて、画像
を形成するようにした前記回路。 - 【請求項7】 電気光学材料の薄層で分離され、少なく
とも一方がガラスである、第1および第2の対向基板を
有するディスプレイであって、該ディスプレイは、 第1基板上に堆積されたY本の信号データ入力線と、 第1基板上に堆積された各群Y個でX群Z行のスイッチ
ング素子と、 第2基板上のすべてのスイッチング素子用の共通電極
と、 各スイッチング素子を形成しているスイッチングトラン
ジスタとピクセルキャパシタと、 Z行のスイッチングトランジスタに結合され、各行のス
イッチングトランジスタを活性化する行ドライブ線と、前記ピクセルキャパシタは、前記スイッチングトランジ
スタの対応する1つに結合している第1基板上に堆積さ
れた第1電極と、第2基板上に堆積された共通電極とを
有し、 第1基板に堆積され、X群のY個のスイッチング素子と
Y本の信号データ入力線に結合され、画像を形成するた
めに、Y本の信号データ入力線上の信号データを各群Y
個でX群のスイッチング素子に一定の順序で順次結合す
る各群Y個でX群のデマルチプレクシング用トランジス
タと、 各々がデマルチプレクシング用トランジスタと対応する
スイッチングトランジスタ間において、X群の各々のY
本のデータ線の個々の1つに結合され、データが加えら
れる前に、行内のデータ線とピクセルキャパシタを2種
類の所定のDC電圧レベルにプリチャージする、第1基
板に堆積された各群Y個でX群のプリチャージ素子とを
含むディスプレイ。 - 【請求項8】 請求項7のディスプレイは更に、各デマルチプレクシング用トランジスタを形成する薄膜
トランジスタと、 第1基板に堆積されたX群のデマルチプレクシング回路
の各々に対して設けられており、各群の偶数番目のデマ
ルチプレクシング用トランジスタに接続されていて、各
行が順次活性化された時、各群において、偶数番目の信
号データ入力線を前記活性化された行の偶数番目のスイ
ッチングトランジスタに接続するための第1の制御線
と、 第1基板に堆積されたX群のデマルチプレクシング回路
の各々に対して設けられており、各群の奇数番目のデマ
ルチプレクシング用トランジスタに接続されていて、各
行が順次活性化された時、各群において、奇数番目の信
号データ入力線を前記活性化された行の奇数番目のスイ
ッチングトランジスタに接続するための第2の制御線と
を含む。 - 【請求項9】 請求項8のディスプレイにおいて、前記プリチャージ素子は薄膜トランジスタで形成され、
前記スイッチングトランジスタは薄膜トランジスタで形
成されている。 - 【請求項10】 請求項9のディスプレイにおいて、X
は6群であり、Yは64であり、Zは240である。 - 【請求項11】 請求項7のディスプレイにおいて、画
像はテレビの画像である。 - 【請求項12】 請求項7のディスプレイは更に、各デマルチプレクシング用トランジスタを形成する薄膜
トランジスタと、 第1基板に堆積されたX群のデマルチプレクシング回路
の各々に対して設けられおり、各群のデマルチプレクシ
ング用トランジスタに接続されていて、各行が順次活性
化された時、各群において、信号データ入力線を前記活
性化された行のスイッチングトランジスタに接続するた
めの制御線とを含む。
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