JPH0244722U - - Google Patents
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- Publication number
- JPH0244722U JPH0244722U JP12290688U JP12290688U JPH0244722U JP H0244722 U JPH0244722 U JP H0244722U JP 12290688 U JP12290688 U JP 12290688U JP 12290688 U JP12290688 U JP 12290688U JP H0244722 U JPH0244722 U JP H0244722U
- Authority
- JP
- Japan
- Prior art keywords
- bus line
- tft
- insulating substrate
- gate bus
- drain bus
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Granted
Links
- 239000011159 matrix material Substances 0.000 claims description 4
- 239000000758 substrate Substances 0.000 claims description 3
- 239000012528 membrane Substances 0.000 claims 1
- 239000010409 thin film Substances 0.000 claims 1
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- 239000011229 interlayer Substances 0.000 description 1
Landscapes
- Testing Or Measuring Of Semiconductors Or The Like (AREA)
- Liquid Crystal Display Device Control (AREA)
- Control Of Indicators Other Than Cathode Ray Tubes (AREA)
- Thin Film Transistor (AREA)
- Liquid Crystal (AREA)
Description
第１図は本考案のＴＦＴマトリクスアレイのド
レイン端子の断面図、第２図は本考案のＴＦＴマ
トリクスアレイのドレイン端子の平面図、第３図
はＴＦＴパネルの模式図である。 １…端子電極、２…ドレインバスライン、３…
層間絶縁膜、４…ガラス基板、５…コンタクトホ
ール。
レイン端子の断面図、第２図は本考案のＴＦＴマ
トリクスアレイのドレイン端子の平面図、第３図
はＴＦＴパネルの模式図である。 １…端子電極、２…ドレインバスライン、３…
層間絶縁膜、４…ガラス基板、５…コンタクトホ
ール。
Claims (1)
- 絶縁基板上に複数のＴＦＴ（薄膜トランジスタ
）をマトリクス配置し、該ＴＦＴの配線電極であ
るゲートバスライン又はドレインバスラインと絶
縁基板周辺位置に設けたゲートバスライン用端子
又はドレインバスライン端子とを絶縁膜のコンタ
クトホールを介して接続した端子構造を有するＴ
ＦＴマトリクスアレイに於いて、上記コンタクト
ホールを数字パターンで形成したことを特徴とし
たＴＦＴマトリクスアレイ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1988122906U JPH071676Y2 (ja) | 1988-09-20 | 1988-09-20 | Ｔｆｔマトリクスアレイ |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1988122906U JPH071676Y2 (ja) | 1988-09-20 | 1988-09-20 | Ｔｆｔマトリクスアレイ |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH0244722U true JPH0244722U (ja) | 1990-03-28 |
| JPH071676Y2 JPH071676Y2 (ja) | 1995-01-18 |
Family
ID=31371277
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1988122906U Expired - Lifetime JPH071676Y2 (ja) | 1988-09-20 | 1988-09-20 | Ｔｆｔマトリクスアレイ |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH071676Y2 (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2002108241A (ja) * | 2000-10-03 | 2002-04-10 | Fujitsu Ltd | アクティブマトリクス型表示装置及びその製造方法 |
| JP2004126597A (ja) * | 2003-10-06 | 2004-04-22 | Seiko Epson Corp | 液晶パネル用基板およびそれを用いた液晶パネル並びに投写型表示装置 |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS62120732U (ja) * | 1986-01-21 | 1987-07-31 |
-
1988
- 1988-09-20 JP JP1988122906U patent/JPH071676Y2/ja not_active Expired - Lifetime
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS62120732U (ja) * | 1986-01-21 | 1987-07-31 |
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2002108241A (ja) * | 2000-10-03 | 2002-04-10 | Fujitsu Ltd | アクティブマトリクス型表示装置及びその製造方法 |
| JP4566377B2 (ja) * | 2000-10-03 | 2010-10-20 | シャープ株式会社 | アクティブマトリクス型表示装置及びその製造方法 |
| JP2004126597A (ja) * | 2003-10-06 | 2004-04-22 | Seiko Epson Corp | 液晶パネル用基板およびそれを用いた液晶パネル並びに投写型表示装置 |
Also Published As
| Publication number | Publication date |
|---|---|
| JPH071676Y2 (ja) | 1995-01-18 |
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