JP4132961B2 - 固体撮像素子の製造方法 - Google Patents

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Description

【0001】
【発明の属する技術分野】
本発明は、固体撮像素子およびその製造方法に関し、特にゲート酸化膜中に窒化シリコン膜を含む構造の固体撮像素子およびその製造方法に関する。
【0002】
【従来の技術】
従来の固体撮像素子は、図7に断面構造の一例を示すように、半導体基板10表面に形成されたpウェル11内に、フォトダイオード部と、電荷転送部とを形成してなるもので、フォトダイオード部で生成された電荷を、電荷転送部の電荷転送電極に電圧を印加することにより、n型不純物領域14からなる転送チャネルに導き、順次読み出すように構成されている。そして電荷転送部では、フォトダイオード部で生成された電荷を、n型不純物領域14からなる転送チャネルに導き、この上層に酸化シリコン膜15、窒化シリコン膜16、酸化シリコン膜17との3層構造のゲート酸化膜を介して、電荷転送電極兼読み出し電極(以下読み出し電極)としてのゲート電極18が形成される構造となっている。
【0003】
このように、固体撮像素子の読み出し電極下のゲート酸化膜は、高耐圧ゲートである窒化シリコン膜を酸化シリコン膜で挟む、いわゆるONO構造をとっている。この構造は、薄くかつ昨今の微細化が進んだ固体撮像素子においては薄くかつ高耐圧のゲート酸化膜が必須であり、ONO構造は、ゲート薄膜化のために必須の構造となっている。
【0004】
この構造の固体撮像素子において、画素部に光が入射すると、n型不純物領域13にて光電変換されて信号電荷aが発生し、電荷転送電極兼読み出し電極であるゲート電極18に読み出しパルスが印加されると転送チャネル14に移動する。一方基板表面近傍で発生した信号電荷bは読み出しパルスによる電界にて加速され、一部がホットエレクトロンとなり、窒化シリコン膜中にトラップされ、読み出しゲート電圧の経時変化を引き起こしている。
【0005】
素子の微細化が進むにつれ、低抵抗化のためにn型不純物領域13の不純物濃度は上昇される傾向にあり、読み出し電極端部での電界集中はより大きくなる。また、ゲート長が短くなるため、電子の衝突回数が減ってホットエレクトロンの発生頻度は上昇する傾向にあり、読み出しゲートにかかる電圧の経時変化は深刻な問題となりつつある。
【0006】
【発明が解決しようとする課題】
このように、従来の固体撮像素子においては、高耐圧で薄型化の可能なゲート構造と、ホットエレクトロンによる経時変化が発生しないゲート構造とはトレードオフの関係にあり、2つを同時に満たすことはできないという問題があった。本発明は前記実情に鑑みてなされたもので、ホットエレクトロンによる経時変化が発生することなく、安定で、信頼性の高い薄型の高耐圧固体撮像素子を提供することを目的とする。
また、製造が容易で信頼性の高い固体撮像素子の製造方法を提供することを目的とする。
【0007】
【課題を解決するための手段】
本発明の固体撮像素子は、半導体基板上に形成された光電変換部と、前記光電変換部に近接した、電荷転送素子(CCD)の転送路のゲート酸化膜が、酸化シリコン膜(SiO)と、窒化シリコン膜(SiN)との積層構造膜で構成され、少なくとも前記ゲート酸化膜の光電変換部側端部が窒化シリコン膜を含有しないことを特徴とする。
【0008】
かかる構成によれば、光電変換部に近接した、電荷転送素子(CCD)の転送路のゲート酸化膜が、光電変換部側端部で窒化シリコン膜を含有しない構造をとっており、読み出しパルス印加時に際してもっとも電界が集中する電極端部に窒化シリコン膜が存在しないため、基板表面近傍で発生した信号電荷がホットエレクトロンとなっても、窒化シリコン膜を含む構造に比べてトラップを少なくすることができる。従って、読み出しゲートにかかる電圧の経時変化を引き起こすことなく良好な読み出し特性を維持することが可能となる。
【0009】
望ましくは、前記積層構造膜は、酸化シリコン膜(SiO)中に、窒化シリコン膜(SiN)を介在させたONO構造膜である。ONO構造膜を用いることにより、薄くてかつ高耐圧のゲート酸化膜を構成することができ、転送路のゲート酸化膜が、光電変換部側端部で窒化シリコン膜を含有しない単層構造をとっているため、ホットエレクトロンが窒化シリコン膜にトラップされることが少なくなる。
【0010】
また、前記窒化シリコン膜を含有しない領域のゲート酸化膜は幅0.2μmを越えないようにするのが望ましく、ホットエレクトロンの蓄積されやすい領域において窒化シリコン膜が存在しないようにすることにより、ホットエレクトロンのトラップは防止可能である。一方、幅0.2μmを越えると、耐圧が不十分となることがある。
【0011】
望ましくは、前記光電変換部はフォトダイオードで構成され、前記転送路は、フォトダイオードに近接した読み出しゲート電極と、前記読み出しゲートに近接しかつ独立した転送電極とを有し、読み出しゲート電極下の窒化シリコン膜端部が、読み出しゲート電極の端部よりも内方に位置するようにしている。
このように読み出しゲートと電荷転送電極とが独立している場合にも読み出しゲート電極下の窒化シリコン膜端部が読み出しゲート電極の端部よりも退出しているため、ホットエレクトロンのトラップを防止するとともに、耐圧も十分に維持することが可能となる。
【0012】
また望ましくは、前記読み出しゲート電極下のゲート酸化膜は単層構造となるようにしてもよい。これにより読み出しゲート電極下では完全に窒化シリコン膜が除去されているため、ホットエレクトロンのトラップは皆無となる。
【0013】
また本発明の方法では、半導体基板表面の絶縁膜上に、少なくとも窒化シリコン膜と酸化シリコン膜とを含む積層構造のゲート酸化膜を形成するゲート酸化膜形成工程と、前記ゲート酸化膜上に電荷転送電極を形成する工程と、前記電荷転送電極をマスクとして、前記ゲート酸化膜をエッチングする工程とを含み、固体撮像素子を形成する方法において、前記エッチングする工程の後、酸化シリコン膜に対する窒化シリコン膜のエッチング選択比の高いエッチング条件でエッチングを行い、窒化シリコン膜の端部を選択的に除去する工程を含むことを特徴とする。
【0014】
かかる構成によれば、電荷転送電極のパターニング後、この電荷転送電極をマスクとしてゲート酸化膜をパターニングすることにより、高度なリソグラフィ技術を必要とすることなく、端部から窒化シリコン膜が除去されたゲート酸化膜を容易に形成することが出来る。従って、高耐圧でかつホットエレクトロンによる経時変化のない固体撮像素子を提供することが可能となる。
【0015】
望ましくは、前記選択的に除去する工程は、ケミカルドライエッチング(CDE)とすることにより、容易に制御性よく窒化シリコン膜を除去することが可能となる。
【0016】
また望ましくは、前記選択的に除去する工程は、燐酸を用いた等方性エッチングとすることにより、容易に制御性よく窒化シリコン膜を除去することが可能となる。
【0017】
また望ましくは、窒化シリコンを除去した後、酸化工程を経ることにより、窒化シリコンの除去された領域は酸化シリコン膜で覆われることになり、極めて容易に信頼性の高い固体撮像素子を形成することが可能となる。
【0018】
【発明の実施の形態】
以下本発明の実施の形態について図面を参照しつ説明する。
【0019】
(第1の実施の形態)
この固体撮像素子は、図1に、概略断面図を示すように、シリコン基板10表面のONO構造の絶縁膜15、16、17(以下、ゲート酸化膜と記述する。)を介して多結晶シリコン膜からなる電荷転送電極としてのゲート電極18が形成されており、このゲート電極18下のゲート酸化膜がフォトダイオード部側の端部で窒化シリコン膜16を含有しない単層構造のゲート酸化膜をなすことを特徴とする。
【0020】
他部については、図7に示した従来例の固体撮像素子と同様に形成されている。
【0021】
次に、この固体撮像素子の製造工程について、図2(a)乃至(e)を用いて説明する。この例ではフォトダイオード領域形成のためのn型不純物領域12、p型不純物拡散領域13、転送チャネルとしてのn型不純物領域14を形成すべく、イオン注入を行った後、ゲート酸化膜およびゲート電極を形成する。このとき後続工程における加熱により拡散長が伸びるのを想定し、拡散時間を設定する必要がある。以下の工程では簡略化のために半導体基板内に形成されるフォトダイオード領域および転送チャネルを省略する。
【0022】
まず、図2(a)に示すように、n型のシリコン基板10表面に形成されたpウェル11内に、膜厚15nmの酸化シリコン膜15と、膜厚50nmの窒化シリコン膜16と、膜厚10nmの酸化シリコン膜17を形成し、3層構造のゲート酸化膜を形成する。
続いて、このゲート酸化膜上に、ゲート電極18形成のための膜厚0.4μmの高濃度ドープの多結晶シリコン膜を形成する。
【0023】
そして、図2(b)に示すように、フォトリソグラフィで形成したレジストパターンをマスクとして、反応性イオンエッチングにより、この多結晶シリコン膜をパターニングすることにより、読み出しゲートとしてのゲート電極18を形成する。さらに、このゲート電極18をマスクとしてゲート酸化膜を順次エッチングする。
【0024】
この後、図2(c)に示すように、熱酸化を行い、読み出しゲートの表面に熱酸化膜19を形成する。このとき、ゲート酸化膜上にも熱酸化膜は形成されるが、窒化シリコン膜16上であるため、ほとんど形成されない。従って酸系の処理で容易に除去可能である。
【0025】
そして図2(d)に示すように、窒化シリコン膜16上の酸化膜を酸系の処理で除去し、熱燐酸を用いたウエットエッチングにより読み出しゲート端部から0.2μm程度の幅で窒化シリコン膜を選択的にエッチング除去する。
【0026】
この後、熱酸化を行い、図2(e)に示すように、窒化シリコン膜の除去された領域を酸化シリコン膜で埋める。
【0027】
なお、最後の酸化シリコン膜の形成工程は熱酸化に限定されることなく、プラズマCVD法、減圧CVD法などを用いるようにしてもよい。また、そのまま後続工程に移行するようにしてもよい。
【0028】
このようにして形成された固体撮像素子によれば、フォトダイオード領域に近接した、読み出しゲート下のゲート酸化膜が、端部で窒化シリコン膜を含有しない単層構造をとっており、読み出しパルス印加時に際してもっとも電界が集中する電極端部に窒化シリコン膜が存在しないため、基板表面近傍で発生した信号電荷がホットエレクトロンとなってもほとんどトラップされない。従って、読み出しゲート電圧の経時変化を引き起こすことなく良好な読み出し特性を維持することが可能となる。
【0029】
また、形成に際しても、新たなフォトリソ工程を必要とすることなく、エッジを等方性エッチングでエッチングするのみで形成することができ、極めて容易に作業性よく特性の良好な固体撮像素子を形成することが可能となる。
【0030】
(第2の実施の形態)
次に、本発明の第2の実施の形態について図3を用いて説明する。第1の実施の形態では、シリコン基板10上に酸化シリコン膜15、窒化シリコン膜16、酸化シリコン膜17を形成し、この上層に読み出しゲートとなる多結晶シリコン膜を形成しこれをパターニングし、この多結晶シリコン膜をマスクとしてサイドエッチングにより窒化シリコンを退出させるようにしたが、本実施の形態では窒化シリコンをあらかじめパターニングし、この上層に窒化シリコン膜16のエッジを囲むように読み出しゲートを突出させたものである。
【0031】
すなわち、酸化シリコン膜15、窒化シリコン膜16、酸化シリコン膜17を形成し、酸化シリコン膜17、窒化シリコン膜16をパターニングしてから、窒化シリコン膜16のエッジよりも突出するように読み出しゲート18を形成するようにしたことを特徴とするものである。 他部についても前記第1の実施の形態と同様に形成される。
【0032】
かかる構造によっても同様に、ホットエレクトロンのトラップによる読み出し電圧の上昇を防ぐことが可能となる。ただ難点は、この場合フォトリソグラフィ工程が一回増える点である。
【0033】
(第3実施の形態)
次に、本発明の第3の実施の形態について図4を用いて説明する。第2実施の形態では、シリコン基板10上に酸化シリコン膜15、窒化シリコン膜16、酸化シリコン膜17を形成し、酸化シリコン膜17、窒化シリコン膜16をパターニングしてから、窒化シリコン膜16のエッジよりも突出するように読み出しゲートとしてのゲート電極18を形成するようにしたが、本実施の形態では、ゲート酸化膜とゲート電極とを前記第1の実施の形態と同様に順次パターニングしたのち、ゲート電極の側壁に側壁残し法により多結晶シリコンからなるサイドウォール20を形成し、このサイドウォールにより実質的に読み出しゲートの端部を外方に突出させたことを特徴とするものである。
他部についても前記第1の実施の形態と同様に形成される。
【0034】
かかる構造によっても同様に、ホットエレクトロンのトラップによる読み出し電圧の上昇を防ぐことが可能となる。
【0035】
次にこの製造工程を簡単に説明する。図5(a)乃至(d)はその製造工程図であるが、図5(b)に示すパターニング工程までは前記第1の実施の形態と同様に形成され、図2(b)に示すように、ゲート電極18およびゲート酸化膜15、16、17を形成する。このとき、実際は読み出しゲートであるゲート電極18のパターンを前記第1の実施の形態の場合よりも0.2μm程度小さく形成させておくようにする。
【0036】
そして図5(c)に示すように、減圧CVD法により600〜650℃でSiH4を熱分解することにより、膜厚0.4μmの高濃度ドープの多結晶シリコン膜4bを形成する。
【0037】
そして、異方性をもつように条件設定のなされた反応性イオンエッチングにより図5(d)に示すように、側壁残しを行い多結晶シリコンからなるサイドウォール20を形成する。
【0038】
そして表面酸化を行い図4に示した固体撮像素子が形成される。
この方法によってもサイドウォール20の存在により実質的に読み出しゲートが突出しているのと同様の構成をとることができ、窒化シリコンへのホットエレクトロンのトラップをなくし、信頼性の高い固体撮像素子を形成することが可能となる。
【0039】
またフォトリソグラフィ工程が増えることもなく、低温工程である減圧CVD法と異方性エッチング工程のみで形成されるため、拡散長の伸びもなく設計どおりの固体撮像素子を提供することが可能となる。
【0040】
(第4の実施の形態)
次に、本発明の第4の実施の形態について図6を用いて説明する。本実施の形態では、前記第3の実施の形態で多結晶シリコンのサイドウオールで形成した、読み出しゲートの端部となる領域を、本来の読み出しゲートの周りを覆うタングステン膜からなる遮光性の電極21で形成したものである。
【0041】
望ましくはタングステンシリサイドを介してタングステン膜を形成するようにすれば、密着性も向上する。
製造工程では、サイドウォール形成のための異方性エッチングに代えて、遮光性の電極のエッジを規定するためのフォトリソグラフィ工程が必要であるが、他については前記第3の実施の形態と同様に形成される。
【0042】
固体撮像素子では、受光領域を除いて遮光膜で被覆することは誤動作を防ぐために極めて有効であり、この構造では遮光性という面からも、ホットエレクトロンのトラップ防止という面からも有効な効果を奏効するものである。
【0043】
なお、前記実施の形態では、読み出しゲートについて説明したが、読み出しゲートと転送ゲートが一体化されている場合には、その一体化されたゲート電極の端縁の窒化シリコンを退行するようにすればよい。
【0044】
また、前記実施の形態では、端縁のみを単層構造にしたが、光電変換部にもっとも近接した読み出しゲートなどのゲート電極のゲート酸化膜全体が窒化シリコンを含まない構造とするようにしてもよい。
【0045】
さらにまた、かかる遮光膜の形状で、多結晶シリコン膜あるいは金属膜を用いるようにしてもよい。この場合、遮光性は持たなくても、電極21としての役割は奏功し得る。また、金属膜としてはタングステンのほか、タンタル、チタン、モリブデン、コバルト等を用いるようにしてもよい。
【0046】
【発明の効果】
以上説明してきたように、本発明の固体撮像素子によれば、光電変換部に近接した、電荷転送素子(CCD)の転送路のゲート酸化膜が、光電変換部側端部で窒化シリコン膜を含有しない単層構造をとっており、読み出しパルス印加時に際してもっとも電界が集中する電極端部に窒化シリコン膜が存在しないため、読み出しゲートにかかる電圧の経時変化を引き起こすことなく良好な読み出し特性を維持することが可能となる。
【0047】
また本発明の方法によれば、極めて容易に、ゲート電圧の経時変化を引き起こすことのない良好な読み出し特性を持つ固体撮像素子の製造方法を提供することが可能となる。
【図面の簡単な説明】
【図1】本発明の第1の実施の形態の固体撮像素子を示す図
【図2】本発明の第1の実施の形態の固体撮像素子の製造工程を示す図
【図3】本発明の第2の実施の形態の固体撮像素子を示す図
【図4】本発明の第3の実施の形態の固体撮像素子を示す図
【図5】本発明の第3の実施の形態の固体撮像素子の製造工程を示す図
【図6】本発明の第4の実施の形態の固体撮像素子を示す図
【図7】従来例の形態の固体撮像素子を示す図
【符号の説明】
10・・・シリコン基板
15・・・酸化シリコン膜(ゲート酸化膜)
16・・・窒化シリコン膜
17・・・酸化シリコン膜
18・・・ゲート電極

Claims (4)

  1. 半導体基板表面の絶縁膜上に、少なくとも窒化シリコン膜と酸化シリコン膜とを含む積層構造のゲート酸化膜を形成するゲート酸化膜形成工程と、前記ゲート酸化膜上に電荷転送電極を形成する工程と、前記電荷転送電極をマスクとして、前記ゲート酸化膜をエッチングする工程とを含み、固体撮像素子を形成する方法において、前記エッチングする工程の後、酸化シリコン膜に対する窒化シリコン膜のエッチング選択比の高いエッチング条件でエッチングを行い、窒化シリコン膜の端部を選択的に除去する工程を含むことを特徴とする固体撮像素子の製造方法。
  2. 請求項記載の固体撮像素子の製造方法であって、前記選択的に除去する工程は、ケミカルドライエッチング(CDE)工程であることを特徴とする固体撮像素子の製造方法。
  3. 請求項記載の固体撮像素子の製造方法であって、前記選択的に除去する工程は、燐酸を用いた等方性エッチング工程であることを特徴とする固体撮像素子の製造方法。
  4. 請求項1から3のいずか1つに記載の固体撮像素子の製造方法であって、前記選択的に除去する工程の後、前記窒化シリコン膜が選択的に除去された領域を前記酸化シリコンで埋めることを特徴とする固体撮像素子の製造方法。
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Publication number Priority date Publication date Assignee Title
JP4132961B2 (ja) * 2002-05-16 2008-08-13 富士フイルム株式会社 固体撮像素子の製造方法
JP4739703B2 (ja) * 2004-07-14 2011-08-03 富士フイルム株式会社 固体撮像素子の製造方法
KR100817201B1 (ko) * 2004-07-14 2008-03-27 후지필름 가부시키가이샤 고체 촬상 소자 및 그 제조 방법
JP4739706B2 (ja) 2004-07-23 2011-08-03 富士フイルム株式会社 固体撮像素子及びその製造方法
KR100719797B1 (ko) 2004-09-03 2007-05-21 엠텍비젼 주식회사 광감도 개선을 위한 이미지 센서 및 그 제조 방법
JP2006261229A (ja) * 2005-03-15 2006-09-28 Fuji Photo Film Co Ltd 固体撮像素子およびその製造方法
JP2008135636A (ja) * 2006-11-29 2008-06-12 Fujifilm Corp 固体撮像素子およびその製造方法
US7692134B2 (en) * 2008-03-24 2010-04-06 Omnivision Technologies, Inc. Variable transfer gate oxide thickness for image sensor
JP4784655B2 (ja) * 2009-01-26 2011-10-05 ソニー株式会社 固体撮像装置及び電子機器
JP2010182790A (ja) * 2009-02-04 2010-08-19 Fujifilm Corp 固体撮像素子、撮像装置、固体撮像素子の製造方法
KR101062325B1 (ko) * 2009-09-15 2011-09-05 삼성전기주식회사 염료 감응 태양전지 및 이를 포함하는 모바일 기기
JP5651982B2 (ja) * 2010-03-31 2015-01-14 ソニー株式会社 固体撮像装置、固体撮像装置の製造方法、及び電子機器
US8557624B2 (en) * 2011-01-13 2013-10-15 International Business Machines Corporation Pixel sensor cells with a split-dielectric transfer gate

Family Cites Families (15)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH04286361A (ja) * 1991-03-15 1992-10-12 Sony Corp 固体撮像装置
JP2996567B2 (ja) 1992-10-30 2000-01-11 松下電子工業株式会社 固体撮像素子の製造方法
KR0123048Y1 (ko) * 1994-07-08 1998-10-01 구본준 씨씨디 영상소자
US6094221A (en) * 1997-01-02 2000-07-25 Andersion; Eric C. System and method for using a scripting language to set digital camera device features
JPH1145989A (ja) 1997-04-08 1999-02-16 Matsushita Electron Corp 固体撮像装置およびその製造方法
US6133595A (en) 1997-04-08 2000-10-17 Matsushita Electronics Corporation Solid state imaging device with improved ground adhesion layer
US6747757B1 (en) * 1998-05-20 2004-06-08 Fuji Photo Film Co., Ltd. Image processing method and apparatus
JP2000000286A (ja) 1998-06-16 2000-01-07 Dainippon Printing Co Ltd X線装置で視認可能なプレススルーパック包装体
JP2000286407A (ja) 1999-03-31 2000-10-13 Matsushita Electronics Industry Corp 固体撮像装置およびその製造方法
US6482706B1 (en) * 2001-12-10 2002-11-19 Macronix International Co., Ltd. Method to scale down device dimension using spacer to confine buried drain implant
JP4132961B2 (ja) * 2002-05-16 2008-08-13 富士フイルム株式会社 固体撮像素子の製造方法
US7233352B2 (en) * 2002-06-20 2007-06-19 Hewlett-Packard Development Company, L.P. Method and apparatus for color non-uniformity correction in a digital camera
EP1447977A1 (en) * 2003-02-12 2004-08-18 Dialog Semiconductor GmbH Vignetting compensation
EP1564681A1 (en) * 2004-02-13 2005-08-17 Dialog Semiconductor GmbH Vignetting compensation algorithm
US20070211154A1 (en) * 2006-03-13 2007-09-13 Hesham Mahmoud Lens vignetting correction algorithm in digital cameras

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