JP3793945B2 - 電圧プローブ、これを用いた半導体装置の検査方法、およびモニタ機能付き半導体装置 - Google Patents
電圧プローブ、これを用いた半導体装置の検査方法、およびモニタ機能付き半導体装置 Download PDFInfo
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Description
【発明の属する技術分野】
本発明は、電圧プローブ、これを用いた半導体装置の検査方法、およびモニタ機能付き半導体装置にかかり、特にシステムLSI内部信号を外部からリアルタイムにモニターする技術に関する。
【0002】
【従来の技術】
従来、マイコンや、DSP等の幅の広いバス信号をモニターする為には、強引にLSI端子を形成して全てを出力するか、選択的に出力するなどの方法や、LSI内部にトレースメモリーを内蔵してメモリーに蓄積した後、シリアル通信で読み出すなどの工夫をしていた。
すなわち、この様な方法では、図17に示すようにトレースの為に特別に接続用の端子101を配設し、ワイヤボンディングによってボンディングワイヤ102を介して信号取り出し端子102に接続するかあるいは検査時のみ針でプロービングできるパッドを設けるかいずれかの方法をとる必要があった。このためトレースすることのできる信号本数を多くすることが困難であり、通常は8本程度で出力しているため、十分な信号モニタを行うことができないという問題があった。
また半導体チップの高集積化および高速化に伴い、ゲート入力容量C2に比べ、ボンディングワイヤを含めて配線間の結合容量C1が大きく、十分な感度を得ることができないという問題があった。
【0003】
【発明が解決しようとする課題】
以上のように、従来の方法では、トレースの為に特別に接続用の端子を配設する必要があり、LSIの専有面積が大きくなり、量産用のLSIにまで搭載することは経済的に好ましくない。
一方、量産用と、開発用のLSIを共に開発出来る場合には、問題がないが、コストも時間もかかるので全てのLSIには適用出来ないという問題があった。
また、半導体基板を用いた集積回路チップからなる電圧プローブも提案されている(特開平8−254545)。このプローブでは、入力と出力とこれらの間に接続可能なアナログ増幅器と、グランドプレーンを含むプローブグランドを有する回路基板で構成されている。しかしながらこの電圧プローブでは、入力はIC入力の一つに接続する必要があり、依然としてモニタしようとするLSI自体には特別の接続用端子が必要であった。
【0004】
このような状況を解決する為に、開発用のLSIをそのまま量産ラインに持ち込めるようにするのが望ましい。そこで開発用のLSIと、量産用のLSIを一つにまとめて考え、開発用のLSIと、量産用のLSIとを同一のもの(共通のLSI)を用いるようにしている。そして開発時には、この共通のLSIにトレース専用のLSIと組み合わせて用いることにより、LSI自体にはモニタ用として特別の接続端子を必要とせず、量産用のLSI規模を大きくせず、かつ、開発時には快適なリアルタイムトレースが可能となるようにすることを企図している。
【0005】
すなわち本発明ではLSI自体に、モニタ用として特別の接続端子を配設することなく、量産用のLSI規模を大きくせず、かつ、開発時には快適なリアルタイムトレースを行うことのできる電圧プローブを提供することを目的とする。
【0006】
また、本発明では、LSI自体に、モニタ用として特別の接続端子を配設することなく、量産用のLSI規模を大きくせず、かつ、開発時には快適なリアルタイムトレースを行うことのできる半導体装置の検査方法を提供することを目的とする。
【0007】
さらに、本発明では、特別の接続端子を配設することなく、量産用のLSI規模を大きくせず、かつ、開発時には快適なリアルタイムトレースを行うことのできるモニタ機能付き半導体装置を提供することを目的とする。
また高速信号をモニタし得る電圧プローブを提供することを目的とする。
【0008】
【課題を解決するための手段】
そこで本発明のモニタ機能付半導体装置では、モニターしようとする信号線を、チップ外表面からの最近接導体層となるように、引き出した引き出し領域を形成してなる第1の半導体チップと、使用時に用いる実際の電圧が印加された前記第 1 の半導体チップ上のモニターしようとする信号線に、相対向するように配置可能に構成されたセンサ部とを備え、前記信号線の電圧変化を、静電誘導による誘起電圧として検出することによりリアルタイムトレースするように構成されたことを特徴とする。
【0009】
かかる構成によれば、非接触で、使用時に用いる実際の電圧が印加され、実際に駆動している状態にある信号線をリアルタイムでモニタすることができるため、半導体チップ自体はモニタのために基本的には設計を変更することなく形成することができ、低コストで信頼性の高い信号モニタを行うことが可能となる。
また、ワイヤボンディングも不要であり、チップ自体には特別の付加回路を追加することなく形成できるため、寄生容量の発生もなく、高速で信頼性の高いモニタが可能となる。
【0010】
望ましくは、前記センサ部は、前記半導体チップの前記信号線に接続され、表面近傍に引き出された配線パターンに、容量結合するように配設されていることを特徴とする。
【0011】
かかる構成によれば、センサ部は、非接触の容量結合により信号の取り出しを行うようにしているため、半導体チップの設計に何等制限を与えることなく高精度で信頼性の高いモニタが可能となる。
【0012】
望ましくは、前記センサ部は、前記半導体チップの前記信号線に接続され、表面近傍に引き出されて配列された複数の配線パターンのそれぞれに相対向して配設され、非接触で容量結合するように配設された複数のセンサ部を具備したことを特徴とする。
【0013】
かかる構成によれば、上記効果に加え、高密度の信号配線が存在する場合にも容易に信頼性の高いモニタ出力を得ることが可能となる。
【0014】
望ましくは、前記複数のセンサ部はクロストーク防止手段を具備したことを特徴とする。
【0015】
かかる構成によれば、上記効果に加え、クロストーク防止手段を具備しているため、高密度の信号配線が存在する領域においても、信頼性の高いモニタ出力を得ることが可能となる。
【0016】
望ましくは、センサ部が半導体基板表面に形成され、半導体チップ上のモニタ使用とする信号線の配線パターンとの間に介在する誘電体層を介して前記配線パターンと容量結合するように形成されたセンサ電極を含むことを特徴とする。
【0017】
かかる構成によれば、センサ部が半導体基板表面に形成され、前記配線パターンとの間の誘電体層を介して前記配線パターンと容量結合するように形成されたセンサ電極を含むように構成されているため、モニタしようとする半導体チップあるいは、電圧プローブを構成するチップのセンサ電極のいずれかの表面に形成された誘電体層を介してセンサ電極と配線パターンが容量結合していればよく、形成が極めて容易で、かつ信頼性の高い出力を得ることが可能となる。
【0018】
望ましくは、前記誘電体層は、前記センサ電極表面に形成されたプローブ誘電体膜であることを特徴とする。
【0019】
かかる構成によれば、センサ電極表面に形成されたプローブ誘電体膜を介して容量結合されるため、このプローブ誘電体膜はセンサ電極の保護膜としても有効に作用し、プローブの耐久性の向上をはかることが可能となる。
【0020】
望ましくは、前記誘電体層は、測定しようとする前記配線パターン表面に形成された誘電体膜であることを特徴とする。
【0021】
かかる構成によれば、半導体チップの配線パターンを露呈することなく誘電体膜で被覆しておけばよいため、半導体チップの信頼性の向上をはかることが可能となる。
【0022】
望ましくは、前記誘電体層は、前記センサ電極表面に形成されたプローブ誘電体膜と、測定しようとする前記配線パターン表面に形成された誘電体膜との複合膜であることを特徴とする。
【0023】
かかる構成によれば、センサ電極表面に形成されたプローブ誘電体膜と、測定しようとする前記配線パターン表面に形成された誘電体膜との複合膜を介して容量結合されるため、この複合誘電体膜はセンサ電極およびチップ上の配線パターンの保護膜としても有効に作用し、半導体チップおよびプローブの耐久性の向上をはかることが可能となる。
【0024】
望ましくは、前記センサ部は、半導体基板表面に形成され、前記配線パターンとの間に介在する誘電体層を介して前記配線パターンと容量結合するように形成された複数のセンサ電極と、前記センサ電極間に形成され、隣接する前記センサ電極間のクロストークを防止し得るように配設された絶縁領域からなるクロストーク防止手段とを含むことを特徴とする
【0025】
かかる構成によれば、クロストーク防止手段を具備しているため、高密度の信号配線が存在する領域においても、信頼性の高いモニタ出力を得ることが可能となる。
【0026】
望ましくは、前記センサ電極のそれぞれが、モニターしようとする信号線を、チップ表面に近い配線パターンに引き出している信号配線部の前記信号線に、相対向して容量結合するように配列されていることを特徴とする。
この構成によれば、極めて容易にリアルタイムで実際の信号線の出力をモニタすることができる
また、望ましくは、前記センサ電極は、モニターしようとする信号を、チップ表面に近い配線パターンに引き出している信号配線部よりも十分に狭い、ピッチで配設されていることを特徴とする。
【0027】
かかる構成によれば、センサ電極が、モニターしようとする信号を、チップ表面に近い配線パターンに引き出している信号配線部よりも十分に狭い、ピッチで配設されているため、半導体チップの配線パターンとの位置ずれが生じたりした場合にも、漏れを生じることなくいずれかのセンサ電極で信号を取り出すことができる。
【0028】
かかる構成によれば、モニタチップを、前記センサ電極に対応してその直下に細長形状で配置された電圧センスアンプを具備した多層構造基板で構成しているため、小型でかつ信頼性も高いものとなっている。また、この電圧センスアンプは細長形状をなすように構成されているため、センサと配線との静電容量に対して、電圧センスアンプの入力ゲート容量を小さくすることができるため、入力感度を上げることができる。また電圧センスアンプ側の配線を短くすることができるため、周辺からの誘導ノイズによる影響を軽減することができるという効果を奏効する。
【0029】
さらに、前記センサ電極のそれぞれから誘起する電圧が最大となるセンサ電極を選択する信号処理回路を具備し、前記信号処理回路で選択された前記センサ電極からの信号を当該信号線の出力として取り出すように構成したことを特徴とする。
【0030】
かかる構成によれば、前記センサ電極のそれぞれから誘起する電圧が最大となるセンサ電極を選択する信号処理回路を具備し、前記信号処理回路で選択された前記センサ電極からの信号を当該信号線の出力として取り出すようにしているため、半導体チップの配線パターンとの位置ずれが生じたりした場合にも、信号処理により、漏れを生じることなくいずれかのセンサ電極で信号を取り出すことができる。
【0031】
また、配線パターンと一対一対応していなくてもよいため、汎用型のモニタチップを構成することができる。
【0032】
望ましくは、半導体チップ上のモニターしようとする信号線に、相対向するように配置可能に構成され、モニタチップとしての半導体基板表面の所定の領域に形成されたセンサ電極と、前記センサ電極の出力に基き前記信号線の電圧変化を、静電誘導による誘起電圧として検出し、所望のモニタ信号を出力する信号処理回路とを備えたセンサ部を具備したことを特徴とする。
【0033】
かかる構成によれば、半導体基板上に形成されたプローブであるため、製造が容易で小型化をはかることが可能である。
【0034】
望ましくは、前記モニタチップは、前記半導体チップとほぼ同一サイズの半導体基板で構成され、前記半導体チップ上のモニターしようとする信号線に、前記センサ電極が相対向して静電結合するように、チップオンチップ接続可能に構成されたことを特徴とする。
【0035】
かかる構成によれば、チップオンチップ接続可能であるため、配線長を最小限に抑えることができ、高速処理が可能となる。また全体として小型化をはかることができ、取り扱いが容易である。
【0036】
望ましくは、前記モニタチップは、前記センサ電極に対応してその直下に細長形状で配置された電圧センスアンプを具備した多層構造基板であることを特徴とする。
【0037】
かかる構成によれば、モニタチップを、前記センサ電極に対応してその直下に細長形状で配置された電圧センスアンプを具備した多層構造基板で構成しているため、小型でかつ信頼性も高いものとなっている。また、この電圧センスアンプは細長形状をなすように構成されているため、センサと配線との宣伝容量に対して、電圧センスアンプの入力ゲート容量を小さくすることができるため、入力感度を上げることができる。また電圧センスアンプ側の配線を短くすることができる溜め、周辺からの誘導ノイズによる影響を軽減することができるという効果を奏効する。
【0038】
また本発明の半導体装置では、前記半導体基板は、モニターしようとする信号線を、チップ外表面からの最近接導体層となるように、引き出した引き出し領域を形成してなる第1の半導体チップと、前記引き出し領域に相対向して静電結合せしめられた形成されたセンサ電極と、前記センサ電極の出力に基き前記信号線の電圧変化を、静電誘導による誘起電圧として検出し、所望のモニタ信号を出力する信号処理回路とを備えたセンサ部を有するモニタチップとしての第2の半導体チップとが結合せしめられたことを特徴とする。
【0039】
かかる構成によれば、測定を必要とする半導体チップにモニタチップが結合されているため、量産用のLSI規模を大きくすることなく形成することができる。また、開発時には快適なリアルタイムトレースを行うことができるモニタ機能付き半導体装置を実現することができる。
【0040】
望ましくは、前記モニタ信号は、前記第2の半導体チップからさらに前記第1のチップに戻され、前記第1のチップから出力されるように構成されていることを特徴とする。
【0041】
かかる構成によれば、従来の半導体装置の組み立て手法で実現することができる。
【0042】
望ましくは、前記モニタ信号は、前記第2の半導体チップのセンサ電極形成面側から出力されるように構成されていることを特徴とする。
【0043】
かかる構成によれば、LSIにモニタ用の出力端子を形成する必要がなく、LSIの面積を増大することなく実現することができる。
【0044】
望ましくは、前記モニタチップは、折り返し可能な程度に薄く形成されていることを特徴とする
【0045】
かかる構成によれば、モニタチップをまげてワイヤボンディングによって接続することができるため接続の自由度が高く測定の作業性が容易である。
【0046】
望ましくは、前記モニタ信号は、前記第2の半導体チップのセンサ電極形成面の対向面側から出力されるように構成されていることを特徴とする。
【0047】
かかる構成によれば、LSIにモニタ用の出力端子を形成する必要がなく、LSIの面積を増大することなく実現することができる。加えて、センサ電極形成面の対向面側から電極取り出しを行うため、配線の引き出しが容易となる。
【0048】
また望ましくは、前記モニタチップは、完全に折り返されていることを特徴とする。
【0049】
かかる構成によれば、モニタチップを50μm程度まで薄く加工することにより、LSI基板が大きい場合にも装着が容易である。またモニタチップをLSIチップに加圧接合する際、表面の多少のうねりは吸収できるため、良好な接合が可能である。ここで曲率は基板の弾性率と厚さとから容易に算出することができる。
【0050】
本発明では、モニターしようとする信号線を、当該チップ外表面からの最近接導体層となるように、引き出した引き出し領域を形成するとともに、前記引き出し領域の信号線に相対向して静電結合せしめられるように誘電体層を介して形成されたセンサ電極とを具備してなる第1の半導体チップと、前記センサ電極に接触する取り出し電極と、前記取り出し電極を介して、前記引き出し領域に相対向して静電結合せしめられた前記センサ電極の出力を、取り出し、前記信号線の電圧変化を、静電誘導による誘起電圧として検出し、所望のモニタ信号を出力する信号処理回路とを備えたセンサ部を有するモニタチップとしての第2の半導体チップとが結合せしめられたことを特徴とする。
【0051】
かかる構成によれば、従来の半導体の組み立て手法で実現することができる。
【0052】
本発明の方法では、使用時に用いる実際の電圧の印加された半導体チップ上のモニターしようとする信号線に、相対向するようにセンサ電極を配置し、前記信号線の電圧変化を、静電誘導による誘起電圧として検出することによりリアルタイムトレースするようにしたことを特徴とする。
【0053】
かかる構成によれば半導体チップの設計に何ら制限を加えることなく、高精度で信頼性の高いモニタを行うことが可能となる。
【0054】
望ましくは、使用時に用いる実際の電圧の印加された半導体チップ上のモニターしようとする信号線に、相対向するように前記信号線よりも狭ピッチで複数のセンサ電極を配置し、前記信号線の電圧変化を、静電誘導による誘起電圧として検出することによりリアルタイムトレースする第1の検出工程と、前記誘起電圧を信号処理し、最大出力となるセンサ電極を選択する選択工程と、前記選択工程で選択されたセンサ電極のみを駆動し、信号線の電圧変化を、静電誘導による誘起電圧として検出する第2の検出工程とを含み、前記第1の検出工程は、前記第2の検出工程に比べて低周波を用いた検出工程であることを特徴とする。
【0055】
かかる構成によれば、センサ電極を選択するための工程では、低周波処理を行い、実際のモニタ工程では実際に用いる高周波処理を行うようにすれば、容易に信頼性の高いモニタ出力を得ることが可能となる。
【0056】
【発明の実施の形態】
本発明の電圧プローブを用いたモニタ装置は、図13に等価回路を示すように、モニタすべきLSIチップ100においてバスを構成する信号線104と、電圧プローブチップ200のセンサ電極204とが、誘電体膜を介して容量結合されており、信号線104のそれぞれを通過する信号変化をモニターするように構成したものである。ここで信号線104とセンサ電極204との結合容量C1はゲート入力容量C2に比べて十分に大きいものとする。
以下、本発明の実施の形態について説明する。
【0057】
(第1の実施の形態)
図1は、本発明の基本的な構成図を示す。
この電圧プローブは、図1および図2に示すように、システムLSIを構成するLSIチップ100上のモニターしようとする信号線104に、相対向するようにセンサ部204が形成され、この信号線の電圧変化を、静電誘導による誘起電圧として検出するように構成された電圧プローブチップ200を配置してなるものである。
【0058】
ここでこの電圧プローブチップは、シリコン基板201表面に形成された増幅回路などの信号処理回路部202と、モニタしようとするLSIチップ100上の信号線に、相対向するように配列されたセンサ部204と、このセンサ部204の表面を被覆する膜厚t=0.5μmのシリケートガラス層(誘電体層)205とで構成されている。このセンサ部204は0.6μm角の正方形のセンサ部がピッチL=6μmで配列されている。さらにこのセンサ部204の表面を覆うシリケートガラスは、比誘電率4、膜厚0.5μmのシリケートガラス層205で構成されており、表面は平滑となるように研磨が施されている。
【0059】
この電圧プローブチップは、シリコンウェハを出発材料とする通常の半導体プロセスで形成される。ここではクロストークの防止という観点から、ピッチLはシリケートガラス層205の膜厚tよりも十分に大きくなるように設計するのが望ましい。ここでセンサ電極204近傍に形成される誘電体膜205は厳密にはセンサ電極間に配置される層間絶縁膜205aと、センサ電極上に形成される誘電体膜205bとで構成されている。製造上は例えばシリケートガラスの塗布など、いずれも同一の膜で形成するのが望ましいが、別の膜で形成してもよい。その場合は、センサ電極間に配置される層間絶縁膜205aとしては、センサ電極上に形成される誘電体膜205bよりも誘電率の高いものを用いるのが望ましい。これによりクロストークの低減を図ることが可能となる。
例えばアンテナとなるセンサ電極の絶縁物は誘電体とし、隣接電極との間は空気にするなどにより、クロストークは大幅に低減される。
【0060】
一方、モニタされるLSIチップは、所望の素子領域の形成されたシリコン基板101表面に配線層102を介して信号線が所定の間隔で配列されて露出するように、スルーホール(図示せず)を介して取り出され、いわゆる再配列配線構造を構成し、モニタ領域105を構成している。従って、素子領域上に層間絶縁膜103を介してセンサ電極104が配列されたモニタ領域が積層されている構造をとっており、基本的には素子面積の増大を招くことはない。またこの表面は、CMP(化学的機械研磨)法などによって平坦化されている。
【0061】
このようにして形成されたLSIチップ100および、電圧プローブチップ200を清浄化したのち、LSIチップ100のモニタ領域105に電圧プローブチップ200のセンサ電極204がのるように位置あわせし、真空吸引しながら加圧し、直接接合により固定する。
【0062】
この状態で、LSIチップの外部取り出し端子に使用時に用いる実際の電圧を印加して、駆動する。そしてこの時の誘導電圧を電圧プローブのセンサ電極204で検出し、信号処理回路202を介して、モニタする。
例えば、信号線104に、電圧変化ΔVがあったとすると、信号処理回路202において信号処理がなされ出力電圧ΔV‘が現われる。
【0063】
ここでこの電圧プローブチップ200は、センサ電極204と、このセンサ電極の直下に、入力インピーダンスが極めて高くなるように設計された電圧アンプ回路を含む信号処理回路202を集積回路として形成している。
そしてこのLSIチップ100の信号線(バス信号配線)104と、電圧プローブチップ200のセンサ電極204は、物理的に同じ形状でミラーリングしたパターンであり、LSIチップ100と電圧プローブチップ200の素子面同士をフェースツーフェースで対面させて、位置合わせした後、位置ずれが生じないように直接接合で固定している。
【0064】
この信号線104と、センサ電極204は、静電結合され、電圧プローブチップ200に搭載された電圧アンプで増幅されて、そこから測定器までの電送に耐え得るように信号処理回路で信号処理される。
【0065】
これにより、システムLSIチップ100にトレースするための回路を搭載することなく、電圧プローブチップに分割して全体を動作させることが出来るので、開発時のみ、二つのチップを接合して用い、量産時にはシステムLSIチップ100だけで生産することが出来るので、極めて経済的である。
【0066】
また、非接触で、信号線をモニタすることができるため、基本的には半導体チップ自体はモニタのために設計を変更することなく形成することができ、低コストで信頼性の高い信号モニタを行うことが可能となる。
【0067】
また、ワイヤボンディングも不要であり、チップ自体には特別の付加回路を追加することなく形成できるため、寄生容量の発生もなく、高速で信頼性の高いモニタが可能となる。
【0068】
さらにまた、センサ部は、非接触の容量結合により信号の取り出しを行うようにしているため、半導体チップの設計に何等制限を与えることなく高精度で信頼性の高い信号モニタを行うことが可能となる。
【0069】
また高密度の信号配線が存在する場合にも容易に信頼性の高いモニタ出力を得ることが可能となる。
なお、前記第1の実施の形態では、LSIチップ表面に同じサイズの電圧プローブチップが搭載される例について説明したが、図3にその変形例を示すようにモニタ領域の一部のみが接合するような形態をとる電圧プローブチップ220を用い、この電圧プローブチップを信号処理回路チップ221に接続し、この信号処理回路チップ221内で信号処理を行うようにしてもよいことは言うまでもない。
【0070】
(第2の実施の形態)
次に本発明の第2の実施の形態について説明する。
前記第1の実施の形態では、電圧プローブチップのセンサ電極表面に形成された比誘電率4、膜厚0.5μmのシリケートガラス層205bを介して、誘導電圧を生起せしめるようにしたが、この例ではLSIチップ100側表面もシリケートガラス層105で被覆したことを特徴とするものである。この例では、図4に示すように、LSIチップおよび電圧プローブチップのシリケートガラス層105、205Sとこの間の接着層300とを介して誘導電圧が生起せしめられる。
【0071】
なおこの電圧プローブチップのセンサ電極は、比誘電率4、膜厚0.2μmのシリケートガラス層205Sを具備しており、一方LSIチップ100の信号線104の表面も比誘電率4、膜厚0.2μmのシリケートガラス層105で被覆されており、これらの間は膜厚0.1μmとなるように制御された接着樹脂300で固着されている。
【0072】
ここではLSIチップ表面もシリケートガラス層で被覆されているため、信号線が露呈している第1の実施の形態の場合に比べ信頼性が向上するが、この接着樹脂300の膜厚を高精度に制御する必要がある。
【0073】
(第3の実施の形態)
次に本発明の第3の実施の形態について説明する。
この実施の形態では、図5に示すように、センサ電極204に誘起する電圧のクロストークノイズ対策として、センサ電極204の間に断面が串状となるように、周辺の電位を接地レベルにおさえるための接地電極207を、挿入したことを特徴とするものである。
【0074】
この構造では接地電極207は、対向信号線の間まで伸びており、誘電体層であるシリケートガラス層205の先端と同一面となるように形成されている。
このため、高精度に位置合わせをして、接合する必要があり、位置ずれが生じるとショートする危険が高い。このため必要に応じて接地電極207は表面に露呈しないようにし、表面が薄いシリケートガラス層で覆われる程度の深さに形成するようにした方が加工が容易である。
他の部分については前記第1の実施の形態と同様に形成する。
【0075】
かかる構成によれば、前記第1の実施の形態の効果に加えて、クロストークの低減を図ることが可能となる。
なお、システムLSIチップ側には、接地電極を設けていないが、物理的に許諾されるレイアウトが可能な場合には、LSIチップ側のモニタ領域にも信号線間を接地層で区切ることによりクロストークノイズの更なる低減をはかることが可能となる。
【0076】
(第4の実施の形態)
次に本発明の第4の実施の形態について説明する。この例では、図6に示すようにセンサ電極がLSIチップのモニタ領域の信号線に狭ピッチで容量接合するように形成された複数のセンサ電極214を具備したことを特徴とする。
すなわち、センサ電極214を信号線のパターン数よりも多く設け、複数のセンサ電極群の中から、もっとも静電結合が強力なセンサ電極だけを選択的に使い分けるセレクタ回路を搭載することにより、機械的なアライメントをラフにすることが出来るようにしたものである。
すなわち、わずかな位置ずれが生じても、信号処理回路において、出力信号の大きなもののみを取り出すように調整すればよく、機械的なアライメントとしては、信号線の傾きだけに着目し信号線とセンサ電極とが平行となるように配置すればよいことになる。
また、この電圧プローブチップは、測定すべきLSIチップのモニタ領域の信号線のピッチと必ずしも同一でなくてもよいため、汎用型電圧プローブとしても有効である。
【0077】
(第5の実施の形態)
次に本発明の第5の実施の形態について説明する。
この実施の形態では、図7に示すように、3本の小センサ電極224Sからなるセンサ電極ユニット224が各信号線に対応して配列されており、各信号線を通過する信号による誘起電圧を3本の小センサ電極224Sで検出し、ノイズ除去のための信号処理を行うようにしたものである。
すなわち、この例では、誘起する電圧のクロストークを抑える為、3本の小センサ電極224Sを用いることにより中央のみならず、両隣の信号レベルもトレースした上で、演算処理により、ノイズを軽減する。
【0078】
例えば図7に示すように第1乃至第4の信号配線が存在したとし、第2の信号配線上のモニタ信号線104A乃至104Cのうち、第2のモニタ信号線103A上のセンサ電極ユニット224による検出信号を得る場合、3本の各小センサ電極224Sの出力は隣接するモニタ信号線104Bおよび104Cの信号をも読み取ることになる。そこでこの例では隣接する信号線の出力に起因するセンサ信号を3個の小センサ電極を用いてセンスするようにしたものである。
まず、相互の電極距離を求め、相応する減衰量を決めた後、両隣のセンサ電極からの信号の逆相を加算している。演算のアルゴリズムは、隣り合う電極の信号に距離を考慮したゲインを乗じて、元の信号に減算しノイズの相殺をはかるようにしている。
【0079】
(第6の実施の形態)
次に本発明の第6の実施の形態について説明する。
この実施の形態では電圧プローブチップについて説明する。図8(a)および(b)は、センサ電極を備えた電圧プローブチップ200の詳細構造であり、センサ電極線の直下に、ゲート長Lの長いゲートが構築され、P‐chと、N‐chのMOSトランジスタを前段とする電圧増幅器が形成されている。また、セルフバイアスの為のネガティブフィードバック用高抵抗227も同様に構築されている。
【0080】
ここでセンサ電極204の長さは、ゲート容量に比べ、図2に示したようなモニタすべきLSIチップ100のバス信号線104とセンサ電極線の静電結合容量が10倍以上大きくなるように設計されている。
【0081】
センサ電極の長さは、静電結合時の距離すなわち信号線とセンサ電極との間の誘電体層の厚さを小さくすることによって低減可能であるが、これは製造の限界にも関係する重要な課題である。
【0082】
ここで信号処理回路202はシリコン基板201表面に形成されたソース・ドレイン領域220、221と、このソース・ドレイン領域220、221間にゲート絶縁膜225を介して形成されたゲート電極226とからなる増幅用のトランジスタがアレイ状に配列されてなり、このゲート電極226がそれぞれ対応するセンサ電極と層間絶縁膜としてのシリケートガラス膜205に形成されたコンタクトを介して形成されている。尚ここで図8(b)ではセンサ電極表面を覆う誘電体膜としてのシリケートガラス膜は省略した。
【0083】
なお、本発明の実施の形態の変形例として、システムLSIチップと電圧プローブチップとの間は電気的なコンタクトをとり、システムLSIチップ内部に、静電結合部分を設けるようにしたものも有効である。
【0084】
かかる構成によれば、システムLSIチップと電圧プローブチップとの間のコンタクトをとることができれば、システムLSIチップ内部に、誘電体膜を形成しこの誘電体膜を介して静電結合を行なうようにすればよいため、誘電体膜の膜厚は均一となるようにコントロールすることができ、高精度の信号モニタを行なうことが可能となる。
【0085】
(第7の実施の形態)
次に、本発明の第7の実施の形態について説明する。
図9は、信号取り出し部の構造例について示すもので、この例では、シリコン基板201に集積回路を形成してなるチップ200のセンサ電極204と増幅回路を含む信号処理回路202からの信号を電極パッド15上に形成されたバンプ10を介してシステムLSIチップ100のパッド12に接続し、さらにシステムLSIチップ100の端部に形成されたボンディングパッド13を介してボンディングワイヤ14に取り出すようにしたものである。ここでは検出された信号は、システムLSIチップ100からボンディングパッド13,ワイヤー14を介して、測定器(図示せず)に出力される。
【0086】
(第8の実施の形態)
次に、本発明の第8の実施の形態について説明する。
図10は、本発明の第8の実施の形態であり、センサ電極を搭載している電圧プローブチップ200の素子面から、パッド15を経由して、TABケーブル(Tape automated bonding Cable)16にバンプ接続し、測定器に出力される。
【0087】
(第9の実施の形態)
次に、本発明の第9の実施の形態について説明する。
図11は、第9の実施例であり、センサ電極を搭載している電圧プローブチップ200の素子面とは反対側の面に、スルーホール17などを介して信号を取り出し、ボンディングパッド15を経由して、TABケーブル16にバンプ接続することにより測定器に接続している。
【0088】
(第10の実施の形態)
次に、本発明の第10の実施の形態について説明する。この例では、図12に示すように、システムLSIチップ100と電圧プローブチップ200との間は電気的なコンタクトをとり、電圧プローブチップ200内部に、静電結合部分を設けるようにしたものである。
【0089】
すなわち、前記第1の実施の形態で説明した基本構成に、補助電極208を挟んだ構造であり、補助電極208は、電圧プローブチップ200のセンサ電極204上に誘電体膜209を介して、センサ電極204とは静電結合し、かつ電気的に絶縁されている。信号線104は、この補助電極208に電気的に接続されている。この接触する配線パターン部分は、ニッケル・金メッキが施されており、接触安定化を図っている。
【0090】
なお、この実施例では、補助電極208をセンサ電極を搭載しているチップ200に実装しているが、前述したようなシステムLSI側に補助電極を実装した方が、システムLSIのバスに対する負荷容量が少ないために、高速デバイスの場合には、好ましい。反面、システムLSIの製造プロセスが複雑になるためで、コスト的にはデメリットになる。従って、製造の容易さとコストを考慮するとこの実施の形態の例がより好ましい。
【0091】
(第11の実施の形態)
次に、本発明の第11の実施の形態について説明する。この例では、図13に示すように、センサ電極を備えた電圧プローブチップ200の詳細構造を示すものである。この例では、図8で説明した第6の実施の形態において説明したような、直下に、P‐chと、N‐chのMOSトランジスタを前段とする電圧増幅器を具えたセンサ電極226が、マトリックス状になるように配列したことを特徴とするものである。
また、セルフバイアスの為のネガティブフィードバック用高抵抗227も同様に構築されている。
かかる構成によれば、機能ブロックをアレイ上に配置する場合の観測に適している。
【0092】
(第12の実施の形態)
次に、本発明の第12の実施の形態について説明する。この例では、図14に示すように、センサ電極を備えた電圧プローブチップ200の詳細構造を示すものである。この例では、図8で説明した第6の実施の形態において説明したような、直下に、P‐chと、N‐chのMOSトランジスタを前段とする電圧増幅器を具えたセンサ電極226が、扇状になるように配列したことを特徴とするものである。
【0093】
また、セルフバイアスの為のネガティブフィードバック用高抵抗227も同様に構築されている。
かかる構成によれば、等長配線を施して機能ブロックを配置する必要がある程度に高速の回路に適している。
【0094】
(第13の実施の形態)
次に、本発明の第13の実施の形態について説明する。
図15は、第13の実施例であり、センサ電極を搭載している電圧プローブチップ200を50μm程度まで薄く加工し、基板をまげて接続できるようにしたものである。他の部分については前記第12の実施の形態の電圧プローブチップと同様に形成されている。
電圧プローブチップ200を引き出し電極の厚さ以上に曲げることができるようにすれば、接続が容易で、使用場所を選ばず、自由度が高いという効果を奏効する。
【0095】
またセンサ電極を搭載している電圧プローブチップを加圧接合する際、測定すべき基板側の表面の多少のうねりは吸収できるため、良好な接合を行うことが可能となる。この例でも基板を薄くしたのみで前記第8および第9の実施の形態の電圧プローブチップと同様である。
【0096】
(第14の実施の形態)
次に、本発明の第14の実施の形態について説明する。
図16は、第14の実施例であり、センサ電極を搭載している電圧プローブチップ200を、50μm程度まで薄く加工し、基板を折り返すことができる程度に接続できるようにしたものである。他の部分については前記第9の実施の形態の電圧プローブチップと同様に形成されている。
電圧プローブチップ200を折り返すことができる程度に曲げることができるようにすれば、ワイヤボンディングにより接続することが可能となりさらに、自由度が向上するという効果を奏効する。
【0097】
【発明の効果】
開発用のLSIと、量産用のLSIを一つにまとめたもので、開発時には、トレース専用のLSIと組み合わせて用いることにより、量産用のLSI規模を大きくせず、かつ、開発時には快適なリアルタイムトレースが出来る電圧プローブを提供することができるものである。
【0098】
また、本発明の方法によれば、容易にかつ作業性よく信号をモニタすることのできる半導体装置の検査方法を提供することができるものである。
【図面の簡単な説明】
【図1】 本発明の第1の実施の形態を示す基本的な構成図である。
【図2】 本発明の第1の実施の形態を示す断面構成図である。
【図3】 本発明の第1の実施の形態の変形例を示す基本的な構成図である。
【図4】 本発明の第2の実施の形態を示す基本的な構成図である。
【図5】 本発明の第3の実施の形態を示す断面構成図である。
【図6】 本発明の第4の実施の形態を示す断面構成図である。
【図7】 本発明の第5の実施の形態を示す断面構成図である。
【図8】 本発明の第6の実施の形態を示す拡大断面図および上面説明図である。
【図9】 本発明の第7の実施の形態を示す断面構成図である。
【図10】 本発明の第8の実施の形態を示す断面構成図である。
【図11】 本発明の第9の実施の形態を示す断面構成図である。
【図12】 本発明の第10の実施の形態を示す断面構成図である。
【図13】 本発明の第11の実施の形態を示す断面構成図である。
【図14】 本発明の第12の実施の形態を示す断面構成図である。
【図15】 本発明の第13の実施の形態を示す断面構成図である。
【図16】 本発明の第14の実施の形態を示す断面構成図である。
【図17】 従来例の信号モニタ方法を示す等価回路図である。
【符号の説明】
100 システムLSIチップ
200 電圧プローブチップ
104 信号線
204 センサ電極(センサ部)
10 バンプ
12,13,15 パッド
14、16 ボンディングワイヤ
Claims (23)
- モニターしようとする信号線を、チップ外表面からの最近接導体層となるように、引き出した引き出し領域を形成してなる第1の半導体チップと、
使用時に用いる実際の電圧が印加された前記第 1 の半導体チップ上のモニターしようとする信号線に、相対向して配置可能に構成されたセンサ部を備えた電圧プローブを具備したモニタチップとしての第2の半導体チップとを備え、
前記信号線の電圧変化を、静電誘導による誘起電圧として検出することによりリアルタイムトレースするように構成されたモニタ機能付き半導体装置。 - 前記センサ部は、前記半導体チップの前記信号線に接続され、表面近傍に引き出された配線パターンに、容量結合するように配設されていることを特徴とする請求項1に記載のモニタ機能付き半導体装置。
- 前記センサ部は、前記半導体チップの前記信号線に接続され、表面近傍に引き出されて配列された複数の配線パターンのそれぞれに相対向して配設され、容量結合するように配設された複数のセンサ電極を具備したことを特徴とする請求項1に記載のモニタ機能付き半導体装置。
- さらに、前記複数のセンサ部はクロストーク防止手段を具備したことを特徴とする請求項3に記載のモニタ機能付き半導体装置。
- 前記センサ部は、半導体基板表面に形成され、前記第1の半導体チップ上のモニターしようとする信号線の配線パターンとの間に介在する誘電体層を介して前記配線パターンと容量結合するように形成されたセンサ電極を含むことを特徴とする請求項1乃至4のいずれかに記載のモニタ機能付き半導体装置。
- 前記誘電体層は、前記センサ電極表面に形成されたプローブ誘電体膜であることを特徴とする請求項5に記載のモニタ機能付き半導体装置。
- 前記誘電体層は、測定しようとする前記配線パターン表面に形成された誘電体膜であることを特徴とする請求項5に記載のモニタ機能付き半導体装置。
- 前記誘電体層は、前記センサ電極表面に形成されたプローブ誘電体膜と、測定しようとする前記配線パターン表面に形成された誘電体膜との複合膜であることを特徴とする請求項5に記載のモニタ機能付き半導体装置。
- 前記センサ部は、半導体基板表面に形成され、前記配線パターンとの間に介在する誘電体層を介して前記配線パターンと容量結合するように形成された複数のセンサ電極と、前記センサ電極間に形成され、隣接する前記センサ電極間のクロストークを防止し得るように配設された絶縁領域からなるクロストーク防止手段とを含むことを特徴とする請求項3に記載のモニタ機能付き半導体装置。
- 前記センサ電極のそれぞれが、モニターしようとする信号線を、チップ表面に近い配線パターンに引き出している信号配線部の前記信号線に、相対向して静電結合するように配列されていることを特徴とする請求項2に記載のモニタ機能付き半導体装置。
- 前記センサ電極は、モニターしようとする信号を、チップ表面に近い配線パターンに引き出している信号配線部よりも十分に狭い、ピッチで配設されていることを特徴とする請求項2に記載のモニタ機能付き半導体装置。
- さらに、前記センサ電極のそれぞれから誘起する電圧が最大となるセンサ電極を選択する信号処理回路を具備し、
前記信号処理回路で選択された前記センサ電極からの信号を当該信号線の出力として取り出すように構成したことを特徴とする請求項11に記載のモニタ機能付き半導体装置。 - 前記センサ部は、前記第 1 の半導体チップ上のモニターしようとする信号線に、相対向するように配置可能に構成され、モニタチップとしての半導体基板表面の所定の領域に形成されたセンサ電極と、前記センサ電極の出力に基く前記信号線の電圧変化を、静電誘導による誘起電圧として検出し、所望のモニタ信号を出力する信号処理回路を備えたことを特徴とする請求項1乃至12のいずれかに記載のモニタ機能付き半導体装置。
- 前記モニタチップは、前記第1の半導体チップ上のモニターしようとする信号線に、前記センサ電極が相対向して静電結合するように、チップオンチップ接続可能に構成されたことを特徴とする請求項13に記載のモニタ機能付き半導体装置。
- 前記モニタチップは、前記センサ電極に対応してその直下に細長形状で配置された電圧センスアンプを具備した多層構造基板であることを特徴とする請求項14に記載のモニタ機能付き半導体装置。
- 前記モニタ信号は、前記第2の半導体チップからさらに前記第1のチップに戻され、前記第1のチップから出力されるように構成されていることを特徴とする請求項1に記載のモニタ機能付き半導体装置。
- 前記モニタ信号は、前記第2の半導体チップのセンサ電極形成面側から出力されるように構成されていることを特徴とする請求項1に記載のモニタ機能付き半導体装置。
- 前記モニタチップは、折り返し可能な程度に薄く形成されていることを特徴とする請求項13乃至17のいずれかに記載のモニタ機能付き半導体装置。
- 前記モニタ信号は、前記第2の半導体チップのセンサ電極形成面の対向面側から出力されるように構成されていることを特徴とする請求項18に記載のモニタ機能付き半導体装置。
- 前記モニタチップは、完全に折り返されていることを特徴とする請求項19に記載のモニタ機能付き半導体装置。
- モニターしようとする信号線を、当該チップ外表面からの最近接導体層となるように、引き出した引き出し領域を形成するとともに、前記引き出し領域の信号線に相対向して静電結合せしめられるように誘電体層を介して形成されたセンサ電極とを具備してなる第1の半導体チップと、
前記センサ電極に接触する取り出し電極と、前記取り出し電極を介して、前記引き出し領域に相対向して静電結合せしめられた前記センサ電極の出力を、取り出し、前記信号線の電圧変化を、静電誘導による誘起電圧として検出し、所望のモニタ信号を出力する信号処理回路とを備えたセンサ部を有するモニタチップとしての第2の半導体チップとが結合せしめられたことを特徴とするモニタ機能付き半導体装置。 - 使用時に用いる実際の電圧が印加された半導体チップ上のモニターしようとする信号線に、相対向するようにセンサ電極を配置し、前記信号線の電圧変化を、静電誘導による誘起電圧として検出することによりリアルタイムトレースするようにしたことを特徴とする半導体チップのモニタ方法。
- 使用時に用いる実際の電圧が印加された半導体チップ上のモニターしようとする信号線に、相対向するように前記信号線よりも狭ピッチで複数のセンサ電極を配置し、前記信号線の電圧変化を、静電誘導による誘起電圧として検出することによりリアルタイムトレースする第1の検出工程と、
前記誘起電圧を信号処理し、最大出力となるセンサ電極を選択する選択工程と、
前記選択工程で選択されたセンサ電極のみを通電して駆動し、信号線の電圧変化を、静電誘導による誘起電圧として検出する第2の検出工程とを含み、
前記第1の検出工程は、前記第2の検出工程に比べて低周波を用いた検出工程であることを特徴とする請求項22に記載の半導体チップのモニタ方法。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2002157637A JP3793945B2 (ja) | 2002-05-30 | 2002-05-30 | 電圧プローブ、これを用いた半導体装置の検査方法、およびモニタ機能付き半導体装置 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2002157637A JP3793945B2 (ja) | 2002-05-30 | 2002-05-30 | 電圧プローブ、これを用いた半導体装置の検査方法、およびモニタ機能付き半導体装置 |
Related Child Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2005225624A Division JP4417304B2 (ja) | 2005-08-03 | 2005-08-03 | 電圧プローブ |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2003344448A JP2003344448A (ja) | 2003-12-03 |
JP3793945B2 true JP3793945B2 (ja) | 2006-07-05 |
Family
ID=29773408
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2002157637A Expired - Fee Related JP3793945B2 (ja) | 2002-05-30 | 2002-05-30 | 電圧プローブ、これを用いた半導体装置の検査方法、およびモニタ機能付き半導体装置 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP3793945B2 (ja) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US8536890B2 (en) | 2008-02-05 | 2013-09-17 | Nec Corporation | Semiconductor inspecting device and semiconductor inspecting method |
Families Citing this family (10)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
CN101258416A (zh) | 2005-09-07 | 2008-09-03 | 日本电气株式会社 | 半导体器件测试装置以及供电单元 |
JP4492544B2 (ja) * | 2006-01-17 | 2010-06-30 | ブラザー工業株式会社 | 回路基板の製造方法 |
JP4995495B2 (ja) * | 2006-06-16 | 2012-08-08 | セイコーインスツル株式会社 | 半導体装置 |
KR100796172B1 (ko) | 2006-07-20 | 2008-01-21 | 마이크로 인스펙션 주식회사 | 비접촉 싱글사이드 프로브 구조 |
WO2009151118A1 (ja) * | 2008-06-12 | 2009-12-17 | 日本電気株式会社 | 半導体検査装置および半導体検査方法 |
JP2010160142A (ja) | 2008-12-09 | 2010-07-22 | Renesas Electronics Corp | 信号送受信方法、半導体装置の製造方法、半導体装置、およびテスタ装置 |
JP6611251B2 (ja) * | 2016-03-22 | 2019-11-27 | ヤマハファインテック株式会社 | 検査治具、検査装置及び検査方法 |
JP6615680B2 (ja) | 2016-04-08 | 2019-12-04 | 株式会社日本マイクロニクス | プローブカード |
US10600697B2 (en) * | 2016-12-16 | 2020-03-24 | Tesoro Scientific, Inc. | Light emitting diode (LED) test apparatus and method of manufacture |
CN111929571B (zh) * | 2020-10-19 | 2022-11-04 | 深圳市Tcl高新技术开发有限公司 | Led芯片测试治具、测试方法及测试*** |
-
2002
- 2002-05-30 JP JP2002157637A patent/JP3793945B2/ja not_active Expired - Fee Related
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US8536890B2 (en) | 2008-02-05 | 2013-09-17 | Nec Corporation | Semiconductor inspecting device and semiconductor inspecting method |
Also Published As
Publication number | Publication date |
---|---|
JP2003344448A (ja) | 2003-12-03 |
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Legal Events
Date | Code | Title | Description |
---|---|---|---|
A131 | Notification of reasons for refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A131 Effective date: 20040623 |
|
A521 | Request for written amendment filed |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20040823 |
|
A02 | Decision of refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A02 Effective date: 20050608 |
|
A521 | Request for written amendment filed |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20050803 |
|
A911 | Transfer to examiner for re-examination before appeal (zenchi) |
Free format text: JAPANESE INTERMEDIATE CODE: A911 Effective date: 20050824 |
|
TRDD | Decision of grant or rejection written | ||
RD04 | Notification of resignation of power of attorney |
Free format text: JAPANESE INTERMEDIATE CODE: A7424 Effective date: 20060324 |
|
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A61 | First payment of annual fees (during grant procedure) |
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R150 | Certificate of patent or registration of utility model |
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FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20100421 Year of fee payment: 4 |
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