JP3025598B2 - 表示駆動装置及び表示駆動方法 - Google Patents
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- G09G3/288—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters using controlled light sources using luminous gas-discharge panels, e.g. plasma panels using AC panels
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Description
【０００１】〔目 次〕 産業上の利用分野 従来の技術（図13，14） 発明が解決しようとする課題（図15，16） 課題を解決するための手段（図１，２） 作用 実施例 （１）第１の実施例の説明（図３〜７） （２）第２の実施例の説明（図８〜10） （３）第３の実施例の説明（図11，12） 発明の効果
【０００２】
【産業上の利用分野】本発明は、表示駆動装置及び表示
駆動方法に関するものであり、更に詳しく言えば、メモ
リ機能を有するＡＣ（交流）型のプラズマディスプレイ
パネル（Ｐlasma Ｄisplay Ｐanel：ＰＤＰ）の駆動装
置及びその書込み／消去動作の改善に関するものであ
る。
駆動方法に関するものであり、更に詳しく言えば、メモ
リ機能を有するＡＣ（交流）型のプラズマディスプレイ
パネル（Ｐlasma Ｄisplay Ｐanel：ＰＤＰ）の駆動装
置及びその書込み／消去動作の改善に関するものであ
る。
【０００３】近年，電子機器のコンパクト化の要請から
奥行きの大きいＣＲＴ（冷陰極管）装置の置き代わり、
奥行きの少ない液晶ディスプレイやＰＤＰ等の平面型表
示装置が使用される傾向にある。例えば、メモリ機能を
有する表示セルを集合した構成のＡＣ型ＰＤＰが開発さ
れ、その解像度や表示品質の向上が図られる。これによ
れば、ＡＣ型ＰＤＰのアドレス放電に有効に作用する壁
電荷を残すために、全面書込み動作に継続して、太幅消
去パルス又は細幅消去パルスを放電維持電極に印加し、
その後、アドレス放電を行う書込みアドレス方法が採ら
れる。しかし、表示セル毎の放電開始電圧にバラツキが
あると、消去動作を正確に行うことができず、表示品質
の低下を招く。
奥行きの大きいＣＲＴ（冷陰極管）装置の置き代わり、
奥行きの少ない液晶ディスプレイやＰＤＰ等の平面型表
示装置が使用される傾向にある。例えば、メモリ機能を
有する表示セルを集合した構成のＡＣ型ＰＤＰが開発さ
れ、その解像度や表示品質の向上が図られる。これによ
れば、ＡＣ型ＰＤＰのアドレス放電に有効に作用する壁
電荷を残すために、全面書込み動作に継続して、太幅消
去パルス又は細幅消去パルスを放電維持電極に印加し、
その後、アドレス放電を行う書込みアドレス方法が採ら
れる。しかし、表示セル毎の放電開始電圧にバラツキが
あると、消去動作を正確に行うことができず、表示品質
の低下を招く。
【０００４】そこで、表示セル毎に放電開始電圧のバラ
ツキを生じた場合であっても、その放電波形を制御し、
アドレス放電に有効な壁電荷を残留させ、消去動作を確
実に行うこと、及び、低いアドレス電圧によりアドレス
放電をすることができる装置及び方法が望まれている。
ツキを生じた場合であっても、その放電波形を制御し、
アドレス放電に有効な壁電荷を残留させ、消去動作を確
実に行うこと、及び、低いアドレス電圧によりアドレス
放電をすることができる装置及び方法が望まれている。
【０００５】
【従来の技術】図13〜16は、従来例に係る説明図であ
る。図13は従来例に係るＡＣ型ＰＤＰの表示駆動装置の
構成図であり、図14は、その表示駆動方法を説明する波
形図である。また、図15は、その問題点を説明する太幅
消去動作の説明図であり、図16は、その問題点を説明す
る細幅消去動作の説明図を示している。
る。図13は従来例に係るＡＣ型ＰＤＰの表示駆動装置の
構成図であり、図14は、その表示駆動方法を説明する波
形図である。また、図15は、その問題点を説明する太幅
消去動作の説明図であり、図16は、その問題点を説明す
る細幅消去動作の説明図を示している。
【０００６】例えば、３電極面放電型のＰＤＰ２５を駆
動する表示駆動装置は、図13（Ａ）において、Ｘドライ
バ１，Ｙスキャンドライバ２，Ｙドライバ３，アドレス
ドライバ４及び制御回路５から成る。なお、ＰＤＰ２５
はカラー表示の場合、Ｎ×Ｍ×３（Ｒ，Ｇ，Ｂ）個のメ
モリ機能を有する表示セルＣｓから成る。１ビットの表
示セルＣｓは、図13（Ｂ）において、同一平面に設けら
れた放電維持電極（以下単にＸ電極，Ｙ電極という）
６，７と、それらと対向する位置に設けられたアドレス
電極８と、Ｘ電極６，Ｙ電極７を保護する保護膜９と、
アドレス電極８を被覆しカラー表示をする蛍光体１０と
が具備されて成る。
動する表示駆動装置は、図13（Ａ）において、Ｘドライ
バ１，Ｙスキャンドライバ２，Ｙドライバ３，アドレス
ドライバ４及び制御回路５から成る。なお、ＰＤＰ２５
はカラー表示の場合、Ｎ×Ｍ×３（Ｒ，Ｇ，Ｂ）個のメ
モリ機能を有する表示セルＣｓから成る。１ビットの表
示セルＣｓは、図13（Ｂ）において、同一平面に設けら
れた放電維持電極（以下単にＸ電極，Ｙ電極という）
６，７と、それらと対向する位置に設けられたアドレス
電極８と、Ｘ電極６，Ｙ電極７を保護する保護膜９と、
アドレス電極８を被覆しカラー表示をする蛍光体１０と
が具備されて成る。
【０００７】当該装置の機能は、まず、Ｘドライバ１か
らＸ電極６に所定電圧Ｖｘが供給され、Ｙドライバ３に
所定電圧Ｖｙが供給される。これにより、Ｙスキャンド
ライバ２によりＹ電極７が走査され、所定電圧ＶｙがＹ
電極７に供給される。一方、制御回路５からアドレスド
ライバ４にアドレスデータが供給されると、表示セルＣ
ｓが選択され、発光表示が行われる。
らＸ電極６に所定電圧Ｖｘが供給され、Ｙドライバ３に
所定電圧Ｖｙが供給される。これにより、Ｙスキャンド
ライバ２によりＹ電極７が走査され、所定電圧ＶｙがＹ
電極７に供給される。一方、制御回路５からアドレスド
ライバ４にアドレスデータが供給されると、表示セルＣ
ｓが選択され、発光表示が行われる。
【０００８】すなわち、ＰＤＰ２５は２本のＸ，Ｙ電極
６，７に交互に、所定の電圧波形（以下維持パルスとい
う）を印加することで、放電を持続し、発光表示を行う
ものである。ここで、放電はパルス印加直後、１〔μ
ｓ〕から数〔μｓ〕で終了する。また、この放電によっ
て発生した正電荷（イオン）は、負電圧が印加されてい
る，例えば、Ｘ電極６上の保護膜（絶縁層）９の表面に
蓄積され、同様に、負電荷（電子）は、正電圧が印加さ
れているＹ電極７上の蛍光体１０（絶縁層）の表面に蓄
積される。
６，７に交互に、所定の電圧波形（以下維持パルスとい
う）を印加することで、放電を持続し、発光表示を行う
ものである。ここで、放電はパルス印加直後、１〔μ
ｓ〕から数〔μｓ〕で終了する。また、この放電によっ
て発生した正電荷（イオン）は、負電圧が印加されてい
る，例えば、Ｘ電極６上の保護膜（絶縁層）９の表面に
蓄積され、同様に、負電荷（電子）は、正電圧が印加さ
れているＹ電極７上の蛍光体１０（絶縁層）の表面に蓄
積される。
【０００９】従って、始めに高い電圧値の書込み電圧
（以下書込みパルスともいう）をＸ，Ｙ電極６，７間に
供給することにより、該電極間６，７が放電し、壁電荷
が生成される。その後、前回よりも低く、極性の異なる
維持電圧（維持放電パルス）をＸ，Ｙ電極６，７間に印
加すると、前に蓄積された壁電荷が維持電圧に重複され
る。
（以下書込みパルスともいう）をＸ，Ｙ電極６，７間に
供給することにより、該電極間６，７が放電し、壁電荷
が生成される。その後、前回よりも低く、極性の異なる
維持電圧（維持放電パルス）をＸ，Ｙ電極６，７間に印
加すると、前に蓄積された壁電荷が維持電圧に重複され
る。
【００１０】これにより、表示セルＣｓの放電空間に対
する相対電圧が大きなものとなり、放電閾値を越えて表
示セルＣｓが放電を開始する。つまり、最初に書込み放
電が行われ、壁電荷が生成された表示セルＣｓでは、そ
の後、逆極性の維持パルスを交互に印加することによ
り、放電を維持するという特徴がある。一般に、このよ
うな状態をメモリ効果又はメモリ機能と呼ばれ、ＡＣ型
のＰＤＰ２５ではこのメモリ効果を利用して表示を行う
ものである。
する相対電圧が大きなものとなり、放電閾値を越えて表
示セルＣｓが放電を開始する。つまり、最初に書込み放
電が行われ、壁電荷が生成された表示セルＣｓでは、そ
の後、逆極性の維持パルスを交互に印加することによ
り、放電を維持するという特徴がある。一般に、このよ
うな状態をメモリ効果又はメモリ機能と呼ばれ、ＡＣ型
のＰＤＰ２５ではこのメモリ効果を利用して表示を行う
ものである。
【００１１】
【発明が解決しようとする課題】ところで、従来例の表
示駆動方法によれば、アドレス放電に有効に作用する壁
電荷を残すために、ＰＤＰ２５の全面書込み動作に継続
して、図14に示すような、太幅消去パルス（実線）又は
細幅消去パルス（点線）をＸ，Ｙ電極６，７間に印加
し、その後、アドレス放電を行う書込みアドレス方法が
採られる。
示駆動方法によれば、アドレス放電に有効に作用する壁
電荷を残すために、ＰＤＰ２５の全面書込み動作に継続
して、図14に示すような、太幅消去パルス（実線）又は
細幅消去パルス（点線）をＸ，Ｙ電極６，７間に印加
し、その後、アドレス放電を行う書込みアドレス方法が
採られる。
【００１２】これは、表示セルＣｓ毎に、残留壁電荷量
が一定であれば、アドレス電圧もほぼ一定になり、全表
示セルＣｓの動作電圧マージンが一致し、結果的に、安
定な動作が確保可能となるからである。しかし、表示セ
ルＣｓ毎の放電開始電圧にバラツキがあると、次のよう
な問題を生ずる。図15（Ａ）は太幅消去動作の説明図で
あり、太幅消去放電を行う直前のＸ，Ｙ電極６，７上の
広範囲な壁電荷の分布を示している。
が一定であれば、アドレス電圧もほぼ一定になり、全表
示セルＣｓの動作電圧マージンが一致し、結果的に、安
定な動作が確保可能となるからである。しかし、表示セ
ルＣｓ毎の放電開始電圧にバラツキがあると、次のよう
な問題を生ずる。図15（Ａ）は太幅消去動作の説明図で
あり、太幅消去放電を行う直前のＸ，Ｙ電極６，７上の
広範囲な壁電荷の分布を示している。
【００１３】図15（Ａ）において、太幅消去動作は、維
持パルスより低い電圧をＸ，Ｙ電極６，７間に、長い時
間印加して壁電荷の中和（一部残留）を行うものであ
る。しかし、太幅消去動作では、パルス印加直後に放電
に移行するが、印加電圧が低いため、図15（Ｂ）に示す
ように、通常の維持放電と異なり小規模な放電となる。
このため、放電が起こる領域は、Ｘ，Ｙ電極６，７間の
隙間（以下放電ギャップという）付近の極限られた部分
となり、中和する壁電荷はその放電ギャップ付近の壁電
荷のみとなる。
持パルスより低い電圧をＸ，Ｙ電極６，７間に、長い時
間印加して壁電荷の中和（一部残留）を行うものであ
る。しかし、太幅消去動作では、パルス印加直後に放電
に移行するが、印加電圧が低いため、図15（Ｂ）に示す
ように、通常の維持放電と異なり小規模な放電となる。
このため、放電が起こる領域は、Ｘ，Ｙ電極６，７間の
隙間（以下放電ギャップという）付近の極限られた部分
となり、中和する壁電荷はその放電ギャップ付近の壁電
荷のみとなる。
【００１４】また、図15（Ｃ）において、反対に維持パ
ルスよりは低いが、図15（Ｂ）の場合よりも高い電圧が
印加されると、維持放電状態に近づくため、消去動作を
行うことができなくなる。つまり、太幅消去動作では最
小規模の放電により有効な壁電荷を残留させることが重
要である。従って、放電が余り小規模すぎて、壁電圧と
維持パルスの電圧とが放電開始電圧を越えるほどの壁電
荷を残留させてはならい。ここに、壁電圧とは壁電荷の
電圧をいう。
ルスよりは低いが、図15（Ｂ）の場合よりも高い電圧が
印加されると、維持放電状態に近づくため、消去動作を
行うことができなくなる。つまり、太幅消去動作では最
小規模の放電により有効な壁電荷を残留させることが重
要である。従って、放電が余り小規模すぎて、壁電圧と
維持パルスの電圧とが放電開始電圧を越えるほどの壁電
荷を残留させてはならい。ここに、壁電圧とは壁電荷の
電圧をいう。
【００１５】しかし、表示セルＣｓ毎に放電開始電圧の
バラツキがあるため、ある表示セルＣｓを基準にして小
規模放電をさせようとすると、その表示セルＣｓよりも
放電開始電圧が高いセルでは、放電そのものが起こら
ず、消去動作が行えない状態が生ずる。また、全ての表
示セルＣｓで放電を開始させようとすると、放電開始電
圧が低いセルでは、十分に大きな放電となり通常の維持
放電に移行していまうという問題がある。
バラツキがあるため、ある表示セルＣｓを基準にして小
規模放電をさせようとすると、その表示セルＣｓよりも
放電開始電圧が高いセルでは、放電そのものが起こら
ず、消去動作が行えない状態が生ずる。また、全ての表
示セルＣｓで放電を開始させようとすると、放電開始電
圧が低いセルでは、十分に大きな放電となり通常の維持
放電に移行していまうという問題がある。
【００１６】また、図16（Ａ）は細幅消去動作の説明図
であり、放電初期段階のＸ，Ｙ電極６，７上の壁電荷の
分布を示している。細幅消去動作では、Ｘ，Ｙ電極６，
７間の放電が完結する前に、維持パルスを除去するが、
そのタイミングによって、完全に壁電荷を中和できる状
態と、壁電荷を中和しきれない状態とが発生する。ま
た、壁電荷が中和しきれない状態では、さらに、細幅消
去パルスの極性と同極性の壁電荷が残留する場合と、該
パルスの極性と異極性の壁電荷が残留する場合とがあ
る。
であり、放電初期段階のＸ，Ｙ電極６，７上の壁電荷の
分布を示している。細幅消去動作では、Ｘ，Ｙ電極６，
７間の放電が完結する前に、維持パルスを除去するが、
そのタイミングによって、完全に壁電荷を中和できる状
態と、壁電荷を中和しきれない状態とが発生する。ま
た、壁電荷が中和しきれない状態では、さらに、細幅消
去パルスの極性と同極性の壁電荷が残留する場合と、該
パルスの極性と異極性の壁電荷が残留する場合とがあ
る。
【００１７】例えば、前者の場合には、図16（Ａ）に示
すように、パルス印加直後に存在しいた全ての壁電荷
が、放電に関与する直前に、細幅消去パルスが除去され
るため、全ての壁電荷を中和する空間電荷を生成するこ
とが困難となる。これにより、放電ギャップより離れた
位置に壁電荷がそのままの状態で残留するものである。
一方，後者の場合には、図16（Ｂ）の放電後期段階の
Ｘ，Ｙ電極６，７上の壁電荷の分布に示すように、パル
ス印加時間が経過し放電がかなり進行して、放電ギャッ
プより離れた位置に存在する壁電荷も放電に関与するよ
うになる。しかし、その時点では既に、放電ギャップで
は印加電圧により空間電荷の吸収が進行し、壁電荷とな
って吸着してしまう。よって、結果的に、図16（Ｂ）に
示すように維持放電動作に近づくことになる。
すように、パルス印加直後に存在しいた全ての壁電荷
が、放電に関与する直前に、細幅消去パルスが除去され
るため、全ての壁電荷を中和する空間電荷を生成するこ
とが困難となる。これにより、放電ギャップより離れた
位置に壁電荷がそのままの状態で残留するものである。
一方，後者の場合には、図16（Ｂ）の放電後期段階の
Ｘ，Ｙ電極６，７上の壁電荷の分布に示すように、パル
ス印加時間が経過し放電がかなり進行して、放電ギャッ
プより離れた位置に存在する壁電荷も放電に関与するよ
うになる。しかし、その時点では既に、放電ギャップで
は印加電圧により空間電荷の吸収が進行し、壁電荷とな
って吸着してしまう。よって、結果的に、図16（Ｂ）に
示すように維持放電動作に近づくことになる。
【００１８】従って、壁電圧と維持パルスの電圧との和
が放電開始電圧を越えなければ、消去動作として問題は
生じない。しかしながら、実際には、表示セルＣｓ毎の
放電遅れ時間のバラツキもあるため、ＰＤＰ２５全体に
渡り、確実な消去動作を行うのはかなり困難である。ま
た、書込みアドレス法の場合には残留壁電荷量がアドレ
ス放電の動作マージンにも影響するため、問題はさらに
深刻である。
が放電開始電圧を越えなければ、消去動作として問題は
生じない。しかしながら、実際には、表示セルＣｓ毎の
放電遅れ時間のバラツキもあるため、ＰＤＰ２５全体に
渡り、確実な消去動作を行うのはかなり困難である。ま
た、書込みアドレス法の場合には残留壁電荷量がアドレ
ス放電の動作マージンにも影響するため、問題はさらに
深刻である。
【００１９】次に、太幅消去，細幅消去動作に係る残留
壁電荷量の相違が及ぼす影響について説明をする。書込
みアドレス法は、アドレス放電の直前に、有効な壁電荷
が形成されるため、低印加電圧で安定なアドレス動作が
可能となる。つまり、アドレス電極８と、Ｙ電極７間の
放電開始電圧をＶｆａ，アドレス電極８とＹ電極７間の
印加電圧Ｖａ，アドレス電極側に蓄積された壁電荷とＹ
電極側に蓄積された壁電荷による壁電圧をＶｗａとする
と、Ｖｆａ≦Ｖａ＋Ｖｗａとなるような条件が必要とさ
れる。これが満たされない場合には、アドレス放電その
ものが起こらず、その表示セルＣｓは消去状態のままに
なる。
壁電荷量の相違が及ぼす影響について説明をする。書込
みアドレス法は、アドレス放電の直前に、有効な壁電荷
が形成されるため、低印加電圧で安定なアドレス動作が
可能となる。つまり、アドレス電極８と、Ｙ電極７間の
放電開始電圧をＶｆａ，アドレス電極８とＹ電極７間の
印加電圧Ｖａ，アドレス電極側に蓄積された壁電荷とＹ
電極側に蓄積された壁電荷による壁電圧をＶｗａとする
と、Ｖｆａ≦Ｖａ＋Ｖｗａとなるような条件が必要とさ
れる。これが満たされない場合には、アドレス放電その
ものが起こらず、その表示セルＣｓは消去状態のままに
なる。
【００２０】また、隣接する非選択セルに対して、放電
を開始させる最小の電圧をＶｆoaとすると、Ｖａ＋Ｖｗ
ａ＜Ｖｆoaでなくてはならない。これが満たされない場
合には、選択セルにおいては通常の放電が起こるが、隣
接する隣接する非選択セルにおいても、放電を起こして
しまう。さらに、選択セルにおいて、目的のアドレス放
電が達成されても、生成される壁電荷が多すぎるため、
パルス除去後に、壁電荷のみの電圧で放電を起こしてし
まい、いわゆる自己消去放電と呼ばれる消去動作になる
可能性がある。この電圧をＶｆseとすると、Ｖａ＋Ｖｗ
ａ＜Ｖｆseでなくてはならない。
を開始させる最小の電圧をＶｆoaとすると、Ｖａ＋Ｖｗ
ａ＜Ｖｆoaでなくてはならない。これが満たされない場
合には、選択セルにおいては通常の放電が起こるが、隣
接する隣接する非選択セルにおいても、放電を起こして
しまう。さらに、選択セルにおいて、目的のアドレス放
電が達成されても、生成される壁電荷が多すぎるため、
パルス除去後に、壁電荷のみの電圧で放電を起こしてし
まい、いわゆる自己消去放電と呼ばれる消去動作になる
可能性がある。この電圧をＶｆseとすると、Ｖａ＋Ｖｗ
ａ＜Ｖｆseでなくてはならない。
【００２１】結局、Ｖｆａ≦Ｖａ＋Ｖｗａ＜Ｖｆoa及び
Ｖｆａ≦Ｖａ＋Ｖｗａ＜Ｖｆseの関係が必要となる。こ
こで、Ｙスキャンドライバ３及びアドレスドライバ４か
ら出力される印加電圧は全て一定であるため、Ｖｗａを
上式が満たされるようにしなければならい。このような
観点から書込みアドレス法において、消去パルスは、本
来の消去を行うこと以外に決まった量の壁電荷を残留さ
せるという重要な目的がある。
Ｖｆａ≦Ｖａ＋Ｖｗａ＜Ｖｆseの関係が必要となる。こ
こで、Ｙスキャンドライバ３及びアドレスドライバ４か
ら出力される印加電圧は全て一定であるため、Ｖｗａを
上式が満たされるようにしなければならい。このような
観点から書込みアドレス法において、消去パルスは、本
来の消去を行うこと以外に決まった量の壁電荷を残留さ
せるという重要な目的がある。
【００２２】さらに、低電圧アドレスを実現するために
は、Ｖｆoa−Ｖａ及びＶｆse−Ｖａを越えずに、それに
近い壁電荷を残留させることが有効となるさらに、通
常、全面書込みパルスを除去する場合に、急峻にＸ電極
６とＹ電極７との電位差を０Ｖにするか、逆極性の維持
パルスを維持電極に印加する。もしも、全面書込み放電
で大量の壁電荷を形成し過ぎた場合に、２本の維持電極
の電位差を０Ｖにすると、壁電荷のみの電圧で放電を起
こしてしまい、維持放電に移行するだけの壁電荷を失い
自己消去動作に陥る場合がある。
は、Ｖｆoa−Ｖａ及びＶｆse−Ｖａを越えずに、それに
近い壁電荷を残留させることが有効となるさらに、通
常、全面書込みパルスを除去する場合に、急峻にＸ電極
６とＹ電極７との電位差を０Ｖにするか、逆極性の維持
パルスを維持電極に印加する。もしも、全面書込み放電
で大量の壁電荷を形成し過ぎた場合に、２本の維持電極
の電位差を０Ｖにすると、壁電荷のみの電圧で放電を起
こしてしまい、維持放電に移行するだけの壁電荷を失い
自己消去動作に陥る場合がある。
【００２３】その場合には、それ以降の操作が不可能と
なる。また、パルス印加直後に、逆極性の維持パルスを
印加すると、そのパルスの印加過程（電圧の立ち上がり
時期）で放電を開始してしまい正常な維持放電を行えな
いという問題も生ずる。本発明は、かかる従来例の問題
点に鑑み創作されたものであり、表示セル毎に放電開始
電圧のバラツキを生じた場合であっても、その放電波形
を制御し、アドレス放電に有効な壁電荷を残留させ、消
去動作を確実に行うこと、及び、低いアドレス電圧によ
り放電維持をすることが可能となる表示駆動装置及び表
示駆動方法の提供を目的とする。
なる。また、パルス印加直後に、逆極性の維持パルスを
印加すると、そのパルスの印加過程（電圧の立ち上がり
時期）で放電を開始してしまい正常な維持放電を行えな
いという問題も生ずる。本発明は、かかる従来例の問題
点に鑑み創作されたものであり、表示セル毎に放電開始
電圧のバラツキを生じた場合であっても、その放電波形
を制御し、アドレス放電に有効な壁電荷を残留させ、消
去動作を確実に行うこと、及び、低いアドレス電圧によ
り放電維持をすることが可能となる表示駆動装置及び表
示駆動方法の提供を目的とする。
【００２４】
【課題を解決するための手段】 請求項１に記載の表示
駆動装置は、互いに独立した複数の放電維持電極を備え
た平面型表示装置と、該放電維持電極に印加される放電
波形を制御するための放電制御手段とを有する表示駆動
装置であって、該放電制御手段は、所定の電位を与える
ためのスイッチング素子と、該スイッチング素子に接続
され、該放電維持電極に供給される電流を制限するため
のバイアス素子と、該バイアス素子に並列に接続された
定電圧弁別素子とを含むことを特徴とする。請求項２に
記載の表示駆動装置は、請求項１に記載の表示駆動装置
において、前記バイアス素子は抵抗であり、前記定電圧
弁別素子はツェナーダイオードであることを特徴とす
る。
駆動装置は、互いに独立した複数の放電維持電極を備え
た平面型表示装置と、該放電維持電極に印加される放電
波形を制御するための放電制御手段とを有する表示駆動
装置であって、該放電制御手段は、所定の電位を与える
ためのスイッチング素子と、該スイッチング素子に接続
され、該放電維持電極に供給される電流を制限するため
のバイアス素子と、該バイアス素子に並列に接続された
定電圧弁別素子とを含むことを特徴とする。請求項２に
記載の表示駆動装置は、請求項１に記載の表示駆動装置
において、前記バイアス素子は抵抗であり、前記定電圧
弁別素子はツェナーダイオードであることを特徴とす
る。
【００２５】請求項３に記載の表示駆動方法は、複数の
表示セルを構成する複数ラインの維持電極を備えた平面
型表示装置の表示駆動方法であって、該複数の表示セル
に対し、アドレスデータに応じて選択的に壁電荷を生成
するためのアドレス放電を実施するアドレス期間と、該
アドレス期間において選択的に壁電荷を生成した表示セ
ルに対し、放電発光を行うための維持放電を実施する維
持放電期間とを含み、前記アドレス期間は、時間に対し
て印加電圧が変化するパルスを前記放電維持電極に印加
することにより、前記アドレス放電に有効な壁電荷を生
成するステップを、前記アドレス放電に先立って有する
ことを特徴とする。請求項４に記載の表示駆動方法は、
請求項３に記載の表示駆動方法において、前記アドレス
放電に有効な壁電荷を生成するステップは、前記表示セ
ルの全てにおいて壁電荷を生成する全面書込みのステッ
プと、生成した該壁電荷の量を調節するために、時間に
対して印加電圧が変化する消去パルスを印加する全面消
去のステップとを備えることを特徴とする。
表示セルを構成する複数ラインの維持電極を備えた平面
型表示装置の表示駆動方法であって、該複数の表示セル
に対し、アドレスデータに応じて選択的に壁電荷を生成
するためのアドレス放電を実施するアドレス期間と、該
アドレス期間において選択的に壁電荷を生成した表示セ
ルに対し、放電発光を行うための維持放電を実施する維
持放電期間とを含み、前記アドレス期間は、時間に対し
て印加電圧が変化するパルスを前記放電維持電極に印加
することにより、前記アドレス放電に有効な壁電荷を生
成するステップを、前記アドレス放電に先立って有する
ことを特徴とする。請求項４に記載の表示駆動方法は、
請求項３に記載の表示駆動方法において、前記アドレス
放電に有効な壁電荷を生成するステップは、前記表示セ
ルの全てにおいて壁電荷を生成する全面書込みのステッ
プと、生成した該壁電荷の量を調節するために、時間に
対して印加電圧が変化する消去パルスを印加する全面消
去のステップとを備えることを特徴とする。
【００２６】請求項５に記載の表示駆動方法は、請求項
４に記載の表示駆動方法において、前記全面消去のステ
ップにおいては、前記複数の表示セルのうちの最小維持
放電電圧の直前まで消去パルスを急速に印加し、その
後、消去パルスを緩やかに印加することを特徴とする。
請求項６に記載の表示駆動方法は、請求項３乃至５に記
載の表示駆動方法において、前記放電維持電極はライン
毎に第１及び第２の放電維持電極を具備しており、前記
時間に対して印加電圧が変化するパルスは該第１の放電
維持電極に印加されるものであり、前記有効な壁電荷を
生成するステップ修了時において、該第１の放電維持電
極の電位は、前記アドレス放電における該第１の放電維
持電極の選択電位と同電位であることを特徴とする。
４に記載の表示駆動方法において、前記全面消去のステ
ップにおいては、前記複数の表示セルのうちの最小維持
放電電圧の直前まで消去パルスを急速に印加し、その
後、消去パルスを緩やかに印加することを特徴とする。
請求項６に記載の表示駆動方法は、請求項３乃至５に記
載の表示駆動方法において、前記放電維持電極はライン
毎に第１及び第２の放電維持電極を具備しており、前記
時間に対して印加電圧が変化するパルスは該第１の放電
維持電極に印加されるものであり、前記有効な壁電荷を
生成するステップ修了時において、該第１の放電維持電
極の電位は、前記アドレス放電における該第１の放電維
持電極の選択電位と同電位であることを特徴とする。
【００２７】請求項７に記載の表示駆動方法は、請求項
３乃至５に記載の表示駆動方法において、前記放電維持
電極はライン毎に第１及び第２の放電維持電極を具備し
ており、前記時間に対して印加電圧が変化するパルスは
該第１の放電維持電極に印加されるものであり、前記有
効な壁電荷を生成するステップ終了時において、該第２
の放電維持電極の電位は、前記アドレス放電における該
第２の放電維持電極の電位と同電位であることを特徴と
する。請求項８に記載の表示駆動方法は、複数の表示セ
ルを構成する複数ラインの放電維持電極を備えた平面型
表示装置の表示駆動方法であって、該複数の表示セルに
対し、アドレスデータに応じて選択的に壁電荷を生成す
るためのアドレス放電を実施するアドレス期間と、該ア
ドレス期間において選択的に壁電荷を生成した表示セル
に対し、放電発光を行うための維持放電を実施する維持
放電期間とを含み、該アドレス期間は、該放電維持電極
に放電開始電圧を越える書込みパルスを与える全面書込
みのステップと、該全面書込みのステップ終了時の電位
状態から、時間に対して印加電圧が変化する消去パルス
を該放電維持電極に対して印加する全面消去のステップ
とを、前記アドレス放電に先立って有することにより、
前記アドレス放電に有効な壁電荷を残留させることを特
徴とする。
３乃至５に記載の表示駆動方法において、前記放電維持
電極はライン毎に第１及び第２の放電維持電極を具備し
ており、前記時間に対して印加電圧が変化するパルスは
該第１の放電維持電極に印加されるものであり、前記有
効な壁電荷を生成するステップ終了時において、該第２
の放電維持電極の電位は、前記アドレス放電における該
第２の放電維持電極の電位と同電位であることを特徴と
する。請求項８に記載の表示駆動方法は、複数の表示セ
ルを構成する複数ラインの放電維持電極を備えた平面型
表示装置の表示駆動方法であって、該複数の表示セルに
対し、アドレスデータに応じて選択的に壁電荷を生成す
るためのアドレス放電を実施するアドレス期間と、該ア
ドレス期間において選択的に壁電荷を生成した表示セル
に対し、放電発光を行うための維持放電を実施する維持
放電期間とを含み、該アドレス期間は、該放電維持電極
に放電開始電圧を越える書込みパルスを与える全面書込
みのステップと、該全面書込みのステップ終了時の電位
状態から、時間に対して印加電圧が変化する消去パルス
を該放電維持電極に対して印加する全面消去のステップ
とを、前記アドレス放電に先立って有することにより、
前記アドレス放電に有効な壁電荷を残留させることを特
徴とする。
【００２７】
【００２８】請求項９に記載の表示駆動方法は、前記放
電維持電極はライン毎に第１及び第２の放電維持電極を
具備しており、前記全面消去のステップにおいて、該第
１及び第２の放電維持電極間の電位差が０〔Ｖ〕となる
電位を経由することを特徴とする。請求項１０に記載の
表示駆動方法は、前記放電維持電極はライン毎に第１及
び第２の放電維持電極を具備しており、前記時間に対し
て印加電圧が変化する消去パルスは該第１の放電維持電
極に印加されるものであり、前記全面消去のステップ終
了時において、該第１の放電維持電極の電位は、前記ア
ドレス放電における該第１の放電維持電極の選択電位と
同電位であることを特徴とする。
電維持電極はライン毎に第１及び第２の放電維持電極を
具備しており、前記全面消去のステップにおいて、該第
１及び第２の放電維持電極間の電位差が０〔Ｖ〕となる
電位を経由することを特徴とする。請求項１０に記載の
表示駆動方法は、前記放電維持電極はライン毎に第１及
び第２の放電維持電極を具備しており、前記時間に対し
て印加電圧が変化する消去パルスは該第１の放電維持電
極に印加されるものであり、前記全面消去のステップ終
了時において、該第１の放電維持電極の電位は、前記ア
ドレス放電における該第１の放電維持電極の選択電位と
同電位であることを特徴とする。
【００２９】請求項１１に記載の表示駆動方法は、前記
放電維持電極はライン毎に第１及び第２の放電維持電極
を具備しており、前記時間に対して印加電圧が変化する
消去パルスは該第１の放電維持電極に印加されるもので
あり、前記全面消去のステップ終了時において、該第２
の放電維持電極の電位は、前記アドレス放電における該
第２の放電維持電極の電位と同電位であることを特徴と
する。
放電維持電極はライン毎に第１及び第２の放電維持電極
を具備しており、前記時間に対して印加電圧が変化する
消去パルスは該第１の放電維持電極に印加されるもので
あり、前記全面消去のステップ終了時において、該第２
の放電維持電極の電位は、前記アドレス放電における該
第２の放電維持電極の電位と同電位であることを特徴と
する。
【００３０】
【００３１】
【作用】本発明の表示駆動装置によれば、図１（Ａ）に
示すように、第１，第２の駆動手段１１，１２及び制御
手段１３が具備され、第１の駆動手段１１に放電制御手
段１４が設けられる。このため、図１（Ｂ）に示すよう
なバイアス素子Ｒ及びスイッチング素子１４Ａから成る
放電制御手段１４により、アドレス電極Ａｊの選択前で
あって、表示手段１５の全面書込み時や、その終了後の
消去パルスの放電波形制御をすることができる。
示すように、第１，第２の駆動手段１１，１２及び制御
手段１３が具備され、第１の駆動手段１１に放電制御手
段１４が設けられる。このため、図１（Ｂ）に示すよう
なバイアス素子Ｒ及びスイッチング素子１４Ａから成る
放電制御手段１４により、アドレス電極Ａｊの選択前で
あって、表示手段１５の全面書込み時や、その終了後の
消去パルスの放電波形制御をすることができる。
【００３２】すなわち、アドレス放電の前動作であっ
て、まず、制御手段１３を介して第１の駆動手段１１か
ら放電維持電極Ｘ，Ｙｉに全面書込み電圧が印加され
る。この際には、スイッチング素子14ＡがＯFF動作さ
れ、また、全面書込み及びそれに続く維持放電動作が終
了すると、スイッチング素子14ＡがＯＮ動作に移行され
る。これにより、表示セルＣｓ，バイアス素子Ｒ及びス
イッチング素子14Ａから成る回路において、それらの回
路時定数により、放電維持電極Ｘ，Ｙｉ上の電荷が放電
をする。ここで、放電制御手段１４により表示手段１５
の放電波形が制御され、放電維持電極Ｘ，Ｙｉ上にアド
レス放電に有効な壁電荷を残留させることが可能とな
る。
て、まず、制御手段１３を介して第１の駆動手段１１か
ら放電維持電極Ｘ，Ｙｉに全面書込み電圧が印加され
る。この際には、スイッチング素子14ＡがＯFF動作さ
れ、また、全面書込み及びそれに続く維持放電動作が終
了すると、スイッチング素子14ＡがＯＮ動作に移行され
る。これにより、表示セルＣｓ，バイアス素子Ｒ及びス
イッチング素子14Ａから成る回路において、それらの回
路時定数により、放電維持電極Ｘ，Ｙｉ上の電荷が放電
をする。ここで、放電制御手段１４により表示手段１５
の放電波形が制御され、放電維持電極Ｘ，Ｙｉ上にアド
レス放電に有効な壁電荷を残留させることが可能とな
る。
【００３３】このことで、表示セルＣｓ毎に放電開始電
圧のバラツキを生じた場合であっても、簡単な回路で効
率良く、しかも、確実に消去動作を行うことが可能とな
る。また、第２の駆動手段１２からアドレス電極Ａｊ
に、従来例に比べて低いアドレスパルスを印加すること
により、通常のアドレス放電を行うことが可能となる。
さらに、本発明の表示駆動装置によれば、放電制御手段
１４に定電圧弁別素子ＺＤが設けられ、図１（Ｃ）に示
すように、定電圧弁別素子ＺＤがバイアス素子Ｒに並列
に接続される。
圧のバラツキを生じた場合であっても、簡単な回路で効
率良く、しかも、確実に消去動作を行うことが可能とな
る。また、第２の駆動手段１２からアドレス電極Ａｊ
に、従来例に比べて低いアドレスパルスを印加すること
により、通常のアドレス放電を行うことが可能となる。
さらに、本発明の表示駆動装置によれば、放電制御手段
１４に定電圧弁別素子ＺＤが設けられ、図１（Ｃ）に示
すように、定電圧弁別素子ＺＤがバイアス素子Ｒに並列
に接続される。
【００３４】例えば、放電維持電極Ｘ，Ｙｉ間の維持放
電電圧に関して定電圧弁別素子ＺＤの特性電圧を最小維
持放電電圧未満に設定して置くものとすれば、定電圧弁
別素子ＺＤを含む放電制御手段１４により、アドレス電
極Ａｊの選択前であって、表示手段１５の全面書込み時
や、その終了後の消去パルスの放電波形を極め細かく制
御することができる。
電電圧に関して定電圧弁別素子ＺＤの特性電圧を最小維
持放電電圧未満に設定して置くものとすれば、定電圧弁
別素子ＺＤを含む放電制御手段１４により、アドレス電
極Ａｊの選択前であって、表示手段１５の全面書込み時
や、その終了後の消去パルスの放電波形を極め細かく制
御することができる。
【００３５】すなわち、アドレス放電の前動作であっ
て、まず、本発明の第１の表示駆動装置と同様に、第１
の駆動手段１１から放電維持電極Ｘ，Ｙｉに全面書込み
電圧が印加される。この際には、スイッチング素子14Ａ
がＯFF動作され、また、全面書込み及びそれに続く維持
放電動作が終了すると、スイッチング素子14ＡがＯＮ動
作に移行される。
て、まず、本発明の第１の表示駆動装置と同様に、第１
の駆動手段１１から放電維持電極Ｘ，Ｙｉに全面書込み
電圧が印加される。この際には、スイッチング素子14Ａ
がＯFF動作され、また、全面書込み及びそれに続く維持
放電動作が終了すると、スイッチング素子14ＡがＯＮ動
作に移行される。
【００３６】このため、全面消去動作時に、スイッチン
グ素子14ＡがＯＮ動作をすることで、バイアス素子Ｒと
定電圧弁別素子ＺＤとに電流が流れる。この際に、放電
維持電極Ｙｉの電圧が該バイアス素子ＺＤの特性電圧以
上の状態では、電流を制限する成分がないため、急激に
電流が流れる。また、その間の電圧が特性電圧を下回る
と、該バイアス素子ＺＤには電流が流れなくなる。その
後は、表示セルＣｓ，バイアス素子Ｒに基づく回路時定
数により、放電維持電極Ｘ，Ｙｉ上の電荷が放電をす
る。
グ素子14ＡがＯＮ動作をすることで、バイアス素子Ｒと
定電圧弁別素子ＺＤとに電流が流れる。この際に、放電
維持電極Ｙｉの電圧が該バイアス素子ＺＤの特性電圧以
上の状態では、電流を制限する成分がないため、急激に
電流が流れる。また、その間の電圧が特性電圧を下回る
と、該バイアス素子ＺＤには電流が流れなくなる。その
後は、表示セルＣｓ，バイアス素子Ｒに基づく回路時定
数により、放電維持電極Ｘ，Ｙｉ上の電荷が放電をす
る。
【００３７】 これにより、消去初期段階で急峻に波形
変化をし、その後は、大きな傾き変化をする消去パルス
を得ることが可能となり、表示セルＣｓ毎に放電開始電
圧のバラツキを生じた場合であっても、放電維持電極
Ｘ，Ｙｉ上にアドレス放電に有効な壁電荷を残留させる
ことが可能となる。また、本発明の表示駆動方法によれ
ば、図２（Ａ）において、表示手段１５のアドレス電極
Ａｊの選択前であって、表示手段１５の全面書込み動作
終了後に、放電維持電極Ｘ，Ｙｉ間の放電波形制御が行
われる。
変化をし、その後は、大きな傾き変化をする消去パルス
を得ることが可能となり、表示セルＣｓ毎に放電開始電
圧のバラツキを生じた場合であっても、放電維持電極
Ｘ，Ｙｉ上にアドレス放電に有効な壁電荷を残留させる
ことが可能となる。また、本発明の表示駆動方法によれ
ば、図２（Ａ）において、表示手段１５のアドレス電極
Ａｊの選択前であって、表示手段１５の全面書込み動作
終了後に、放電維持電極Ｘ，Ｙｉ間の放電波形制御が行
われる。
【００３８】例えば、表示手段１５の全面書込み動作に
おいて、アドレス電極Ａｊを選択する放電パルスと同極
性のパルスであって、数マイクロ秒から数百マイクロ秒
の間に、最大維持放電電圧を越えない値まで増大される
電圧（以下消去パルスという）が放電維持電極Ｘ，Ｙｉ
間に印加される。また、その放電維持電極Ｘ，Ｙｉ間の
放電波形制御をする際に、アドレス電極Ａｊの非選択時
の電位と、放電維持電極Ｘ，Ｙｉの中で表示ライン毎に
共通する電極の電位とが、消去パルス印加時において、
そのまま固定され、放電維持電極Ｘ，Ｙｉの中で表示ラ
イン毎に独立する電極に大きな傾きを持った消去パルス
が印加される。
おいて、アドレス電極Ａｊを選択する放電パルスと同極
性のパルスであって、数マイクロ秒から数百マイクロ秒
の間に、最大維持放電電圧を越えない値まで増大される
電圧（以下消去パルスという）が放電維持電極Ｘ，Ｙｉ
間に印加される。また、その放電維持電極Ｘ，Ｙｉ間の
放電波形制御をする際に、アドレス電極Ａｊの非選択時
の電位と、放電維持電極Ｘ，Ｙｉの中で表示ライン毎に
共通する電極の電位とが、消去パルス印加時において、
そのまま固定され、放電維持電極Ｘ，Ｙｉの中で表示ラ
イン毎に独立する電極に大きな傾きを持った消去パルス
が印加される。
【００３９】さらに、その全面消去動作時には、図２
（Ｂ）に示すように、消去パルスの電圧変化分が時間変
化分に対して一定となり、表示手段１５内の表示セルＣ
ｓの最小維持放電電圧の最も小さい値を越えた電圧値か
ら、消去パルスの電圧変化分が時間変化分に対して一定
となるような放電制御が行われる。このため、放電維持
電極Ｘ，Ｙｉ間にに印加する電圧と、表示セルＣｓ内に
蓄積されていた壁電荷とによる電圧値の和がこの空間の
持つ放電開始電圧値をわずかに越える値であるならば、
放電に関与する壁電荷は放電空間において、最も電界強
度の強い放電維持電極Ｘ，Ｙｉの最短地点の壁電荷のみ
となる。
（Ｂ）に示すように、消去パルスの電圧変化分が時間変
化分に対して一定となり、表示手段１５内の表示セルＣ
ｓの最小維持放電電圧の最も小さい値を越えた電圧値か
ら、消去パルスの電圧変化分が時間変化分に対して一定
となるような放電制御が行われる。このため、放電維持
電極Ｘ，Ｙｉ間にに印加する電圧と、表示セルＣｓ内に
蓄積されていた壁電荷とによる電圧値の和がこの空間の
持つ放電開始電圧値をわずかに越える値であるならば、
放電に関与する壁電荷は放電空間において、最も電界強
度の強い放電維持電極Ｘ，Ｙｉの最短地点の壁電荷のみ
となる。
【００４０】この場合に、放電が終了しても中和される
壁電荷の量はわずかであり、消去放電終了後に、もし
も、維持放電電圧が印加された場合でも、維持放電を起
こさない範囲により、多量の壁電荷を残留させることが
できる。なお、残留する壁電荷の極性は、その消去放電
が行われる直前の壁電荷の極性と同等となることから、
例えば、放電維持電極Ｙｉ側には電子が残留し、放電維
持電極Ｘ側にイオンが残留することになる。
壁電荷の量はわずかであり、消去放電終了後に、もし
も、維持放電電圧が印加された場合でも、維持放電を起
こさない範囲により、多量の壁電荷を残留させることが
できる。なお、残留する壁電荷の極性は、その消去放電
が行われる直前の壁電荷の極性と同等となることから、
例えば、放電維持電極Ｙｉ側には電子が残留し、放電維
持電極Ｘ側にイオンが残留することになる。
【００４１】これにより、全画面に渡る消去動作を従来
例に比べて確実に行うことができ、消去ミスのない良好
な画像表示をすることが可能となる。さらに、アドレス
放電（選択書込み放電）を行う前までに、該アドレス放
電に有効に作用する壁電荷を蓄積することが可能とな
り、低い印加電圧（アドレス電圧）により維持放電を行
うことが可能となる。これに伴い小電力化及び回路の集
積化に貢献するところが大きい。
例に比べて確実に行うことができ、消去ミスのない良好
な画像表示をすることが可能となる。さらに、アドレス
放電（選択書込み放電）を行う前までに、該アドレス放
電に有効に作用する壁電荷を蓄積することが可能とな
り、低い印加電圧（アドレス電圧）により維持放電を行
うことが可能となる。これに伴い小電力化及び回路の集
積化に貢献するところが大きい。
【００４２】さらに、本発明の表示駆動方法によれば、
放電維持電極Ｘ，Ｙ間の放電波形制御をする際に、表示
手段１５内の表示セルＣｓの最小維持放電電圧の最も小
さい値の直前まで、数ナノ秒から数マイクロ秒間に消去
パルスが急速に印加され、その後、単位電圧当たり数ナ
ノ秒から数マイクロ秒の割合で消去パルスが緩やかに印
加される。
放電維持電極Ｘ，Ｙ間の放電波形制御をする際に、表示
手段１５内の表示セルＣｓの最小維持放電電圧の最も小
さい値の直前まで、数ナノ秒から数マイクロ秒間に消去
パルスが急速に印加され、その後、単位電圧当たり数ナ
ノ秒から数マイクロ秒の割合で消去パルスが緩やかに印
加される。
【００４３】このため、表示セルＣｓ毎に放電開始電圧
のバラツキを生じた場合であっても、消去初期段階で急
峻に波形が立ち下がり、その後は、大きな傾き変化をす
る消去パルスにより、放電維持電極Ｘ，Ｙｉ上にアドレ
ス放電に有効な壁電荷を残留させることができる。すな
わち、本発明の第１の表示駆動方法に比べて、放電に関
与する壁電荷はより少ないものとなり、結果的に、空間
電荷が中和され、アドレス放電に有効に作用する壁電荷
を多く残留させることが可能となる。
のバラツキを生じた場合であっても、消去初期段階で急
峻に波形が立ち下がり、その後は、大きな傾き変化をす
る消去パルスにより、放電維持電極Ｘ，Ｙｉ上にアドレ
ス放電に有効な壁電荷を残留させることができる。すな
わち、本発明の第１の表示駆動方法に比べて、放電に関
与する壁電荷はより少ないものとなり、結果的に、空間
電荷が中和され、アドレス放電に有効に作用する壁電荷
を多く残留させることが可能となる。
【００４４】これにより、表示セルＣｓ毎の放電開始電
圧に多少のバラツキがあっても、限られた時間で壁電荷
を多く残留させることができ、低電圧アドレス放電を行
うことが可能となる。これにより、書込みミスを回避
し、良好な画像表示を行うことができる。また、本発明
の表示駆動方法によれば、表示手段１５の全面書込み動
作の際に、放電維持電極Ｘ，Ｙｉの一方に放電開始電圧
を越える書込みパルスが与えられ、次いで、全面書込み
動作終了時の電位状態から放電維持電極Ｘ，Ｙｉ間の電
位差を０〔Ｖ〕にし、引続き、全面書込み動作時の書込
みパルスの極性であって、最大維持放電電圧を越えない
値まで、消去パルスを印加する放電維持電極Ｘ，Ｙｉ間
の放電波形制御が行われる。
圧に多少のバラツキがあっても、限られた時間で壁電荷
を多く残留させることができ、低電圧アドレス放電を行
うことが可能となる。これにより、書込みミスを回避
し、良好な画像表示を行うことができる。また、本発明
の表示駆動方法によれば、表示手段１５の全面書込み動
作の際に、放電維持電極Ｘ，Ｙｉの一方に放電開始電圧
を越える書込みパルスが与えられ、次いで、全面書込み
動作終了時の電位状態から放電維持電極Ｘ，Ｙｉ間の電
位差を０〔Ｖ〕にし、引続き、全面書込み動作時の書込
みパルスの極性であって、最大維持放電電圧を越えない
値まで、消去パルスを印加する放電維持電極Ｘ，Ｙｉ間
の放電波形制御が行われる。
【００４５】このため、放電維持電極Ｘ，Ｙｉ間に全面
書込みパルスを印加し、全面書込み放電を実行した後
に、維持放電を経ずに、放電維持電極Ｘ，Ｙｉ上に、ほ
ぼ一定の壁電荷量を残留させる消去放電を行うことが可
能となる。これにより、全面書込み動作により、放電維
持電極Ｘ，Ｙｉ上に、大量の壁電荷を生成し過ぎた場合
にも、アドレス放電の前までには、残留壁電荷量を一定
にすることが可能となる。このことで、書込みミスを回
避し、良好な画像表示を行うことが可能となる。
書込みパルスを印加し、全面書込み放電を実行した後
に、維持放電を経ずに、放電維持電極Ｘ，Ｙｉ上に、ほ
ぼ一定の壁電荷量を残留させる消去放電を行うことが可
能となる。これにより、全面書込み動作により、放電維
持電極Ｘ，Ｙｉ上に、大量の壁電荷を生成し過ぎた場合
にも、アドレス放電の前までには、残留壁電荷量を一定
にすることが可能となる。このことで、書込みミスを回
避し、良好な画像表示を行うことが可能となる。
【００４６】
【実施例】次に、図を参照しながら本発明の実施例につ
いて説明をする。図３〜12は、本発明の実施例に係る表
示駆動装置及び表示駆動方法を説明する図である。 （１）第１の実施例の説明 図３は、本発明の各実施例に係るＡＣ型ＰＤＰ駆動装置
の全体構成図であり、図４は、ＡＣ型ＰＤＰの構成図で
ある。図５は、本発明の第１の実施例に係る表示駆動回
路の構成図をそれぞれ示している。
いて説明をする。図３〜12は、本発明の実施例に係る表
示駆動装置及び表示駆動方法を説明する図である。 （１）第１の実施例の説明 図３は、本発明の各実施例に係るＡＣ型ＰＤＰ駆動装置
の全体構成図であり、図４は、ＡＣ型ＰＤＰの構成図で
ある。図５は、本発明の第１の実施例に係る表示駆動回
路の構成図をそれぞれ示している。
【００４７】例えば、３電極面放電型のＰＤＰ２５を駆
動する表示駆動装置は、図３において、Ｘ共通ドライバ
21Ａ，Ｙスキャンドライバ21Ｂ，Ｙ共通ドライバ21Ｃ，
アドレスドライバ２２，制御回路２３及び波形制御部２
４から成る。すなわち、Ｘ共通ドライバ21Ａ，Ｙ共通ド
ライバ21Ｂ及びＹスキャンドライバ21Ｃは第１の駆動手
段１１の一例を構成するものであり、Ｘ共通ドライバ21
Ａはメモリ機能を有するＰＤＰ２５の放電維持電極Ｘ
（以下単にＸ電極という）を駆動する回路である。例え
ば、Ｘ共通ドライバ21Ａは駆動制御信号（以下Ｘ−Ｕ
Ｄ，Ｘ−ＤＤ信号という）に基づいて書込みパルスＶ
ｗ，維持パルスＶｓ等を発生する。なお、Ｘ電極は図４
（Ａ）に示すようにＰＤＰ２５のＮライン（Ｎ＝１〜ｉ
…Ｎ）を共通接続した電極である。
動する表示駆動装置は、図３において、Ｘ共通ドライバ
21Ａ，Ｙスキャンドライバ21Ｂ，Ｙ共通ドライバ21Ｃ，
アドレスドライバ２２，制御回路２３及び波形制御部２
４から成る。すなわち、Ｘ共通ドライバ21Ａ，Ｙ共通ド
ライバ21Ｂ及びＹスキャンドライバ21Ｃは第１の駆動手
段１１の一例を構成するものであり、Ｘ共通ドライバ21
Ａはメモリ機能を有するＰＤＰ２５の放電維持電極Ｘ
（以下単にＸ電極という）を駆動する回路である。例え
ば、Ｘ共通ドライバ21Ａは駆動制御信号（以下Ｘ−Ｕ
Ｄ，Ｘ−ＤＤ信号という）に基づいて書込みパルスＶ
ｗ，維持パルスＶｓ等を発生する。なお、Ｘ電極は図４
（Ａ）に示すようにＰＤＰ２５のＮライン（Ｎ＝１〜ｉ
…Ｎ）を共通接続した電極である。
【００４８】Ｙスキャンドライバ21ＢはＮライン（ｉ＝
１〜Ｎ）の放電維持電極Ｙｉ（以下単にＹｉ電極とい
う）を走査駆動する回路である。Ｙスキャンドライバ21
Ｂはアドレス放電時に、走査データ（以下Ｙ−ＤＡＴＡ
信号という），走査クロック信号（以下Ｙ−ＣＬＫ信号
という），ストローブ信号（以下Ｙ−ＳＴＢ１，Ｙ−Ｓ
ＴＢ２信号という）に基づいてスキャンパルスを発生す
る。なお、Ｙ共通ドライバ21Ｃは駆動制御信号（以下Ｙ
−ＵＤ，Ｙ−ＤＤ信号という）に基づいてＹスキャンド
ライバ21Ｂの入出力を制御する回路である。
１〜Ｎ）の放電維持電極Ｙｉ（以下単にＹｉ電極とい
う）を走査駆動する回路である。Ｙスキャンドライバ21
Ｂはアドレス放電時に、走査データ（以下Ｙ−ＤＡＴＡ
信号という），走査クロック信号（以下Ｙ−ＣＬＫ信号
という），ストローブ信号（以下Ｙ−ＳＴＢ１，Ｙ−Ｓ
ＴＢ２信号という）に基づいてスキャンパルスを発生す
る。なお、Ｙ共通ドライバ21Ｃは駆動制御信号（以下Ｙ
−ＵＤ，Ｙ−ＤＤ信号という）に基づいてＹスキャンド
ライバ21Ｂの入出力を制御する回路である。
【００４９】アドレスドライバ２２の第２の駆動手段１
２一例であり、ＰＤＰ２５のアドレス電極Ａｊ〔ｊ＝１
〜Ｍ（Ｒ，Ｇ，Ｂ）〕を駆動する回路である。例えば、
アドレスドライバ２２はアドレスデータ（以下単にＡ−
ＤＡＴＡ信号という），アドレスクロック信号（以下単
にＡ−ＣＬＫ信号という）に基づいてアドレスパルスを
発生し、アドレス放電時に、それらをアドレス電極Ａｊ
に印加する。
２一例であり、ＰＤＰ２５のアドレス電極Ａｊ〔ｊ＝１
〜Ｍ（Ｒ，Ｇ，Ｂ）〕を駆動する回路である。例えば、
アドレスドライバ２２はアドレスデータ（以下単にＡ−
ＤＡＴＡ信号という），アドレスクロック信号（以下単
にＡ−ＣＬＫ信号という）に基づいてアドレスパルスを
発生し、アドレス放電時に、それらをアドレス電極Ａｊ
に印加する。
【００５０】制御回路２３の制御手段１３一例であり、
Ｘ共通ドライバ21Ａ，Ｙ共通ドライバ21Ａ及びＹスキャ
ンドライバ21Ｂの入出力を制御する回路である。例え
ば、制御回路２３は表示データ制御部23Ａ及びパネル駆
動制御部23Ｂから成る。表示データ制御部23Ａは、フレ
ームメモリ231 を備え、画像クロック信号（以下単にＣ
ＬＫ信号という）に基づいて画像表示データ（以下単に
ＤＡＴＡ信号という）の書込み／読出し制御をする。
Ｘ共通ドライバ21Ａ，Ｙ共通ドライバ21Ａ及びＹスキャ
ンドライバ21Ｂの入出力を制御する回路である。例え
ば、制御回路２３は表示データ制御部23Ａ及びパネル駆
動制御部23Ｂから成る。表示データ制御部23Ａは、フレ
ームメモリ231 を備え、画像クロック信号（以下単にＣ
ＬＫ信号という）に基づいて画像表示データ（以下単に
ＤＡＴＡ信号という）の書込み／読出し制御をする。
【００５１】パネル駆動制御部23Ｂはスキャンドライバ
制御部232 及び共通ドライバ制御部233 から成る。スキ
ャンドライバ制御部232 は垂直同期信号（以下単にＶＳ
ＹＮＣ信号という）及び水平同期信号（以下単にＨＳＹ
ＮＣ信号という）に基づいてＹ−ＤＡＴＡ信号，Ｙ−Ｃ
ＬＫ信号，Ｙ−ＳＴＢ１，Ｙ−ＳＴＢ２信号及びゲート
制御信号ＧＳを発生し、それらをＹスキャンドライバ21
Ｂや波形制御部２４に供給する。共通ドライバ制御部23
3 はＶＳＹＮＣ信号及びＨＳＹＮＣ信号に基づいて、Ｙ
−ＵＤ，Ｙ−ＤＤ信号を発生し、それらをＹ共通ドライ
バ21Ｃに供給する。
制御部232 及び共通ドライバ制御部233 から成る。スキ
ャンドライバ制御部232 は垂直同期信号（以下単にＶＳ
ＹＮＣ信号という）及び水平同期信号（以下単にＨＳＹ
ＮＣ信号という）に基づいてＹ−ＤＡＴＡ信号，Ｙ−Ｃ
ＬＫ信号，Ｙ−ＳＴＢ１，Ｙ−ＳＴＢ２信号及びゲート
制御信号ＧＳを発生し、それらをＹスキャンドライバ21
Ｂや波形制御部２４に供給する。共通ドライバ制御部23
3 はＶＳＹＮＣ信号及びＨＳＹＮＣ信号に基づいて、Ｙ
−ＵＤ，Ｙ−ＤＤ信号を発生し、それらをＹ共通ドライ
バ21Ｃに供給する。
【００５２】波形制御部２４の放電制御手段１４一実施
例であり、Ｙ共通ドライバ21Ａ及びＹスキャンドライバ
21Ｂの間に設けられ、ゲート制御信号ＧＳに基づいてＰ
ＤＰ２５の放電波形を制御する。なお、波形制御部２４
の内部回路については図５において詳述し、その機能，
すなわち、ＰＤＰ２５の表示制御については、図６，７
において詳述する。
例であり、Ｙ共通ドライバ21Ａ及びＹスキャンドライバ
21Ｂの間に設けられ、ゲート制御信号ＧＳに基づいてＰ
ＤＰ２５の放電波形を制御する。なお、波形制御部２４
の内部回路については図５において詳述し、その機能，
すなわち、ＰＤＰ２５の表示制御については、図６，７
において詳述する。
【００５３】また、ＰＤＰ２５は図４（Ａ）の平面図に
おいて、カラー表示の場合、Ｎライン×Ｍ列×３（Ｒ，
Ｇ，Ｂ）個のメモリ機能を有する表示セルＣｓから成
る。すなわち、Ｍ個のアドレス電極Ａ１〜ＡＭはＰＤＰ
２５のＸ方向に配置され、それが１本毎にアドレスドラ
イバ２２に接続される。ＮラインのＹ１電極〜ＹＮ電極
はＰＤＰ２５のＹ方向に配置され、Ｙスキャンドライバ
21Ｂに個別に接続される。なお、Ｘ電極はＮラインのＹ
１電極〜ＹＮ電極に併設され、それが共通に接続されて
Ｘ共通ドライバ21Ａに接続される。
おいて、カラー表示の場合、Ｎライン×Ｍ列×３（Ｒ，
Ｇ，Ｂ）個のメモリ機能を有する表示セルＣｓから成
る。すなわち、Ｍ個のアドレス電極Ａ１〜ＡＭはＰＤＰ
２５のＸ方向に配置され、それが１本毎にアドレスドラ
イバ２２に接続される。ＮラインのＹ１電極〜ＹＮ電極
はＰＤＰ２５のＹ方向に配置され、Ｙスキャンドライバ
21Ｂに個別に接続される。なお、Ｘ電極はＮラインのＹ
１電極〜ＹＮ電極に併設され、それが共通に接続されて
Ｘ共通ドライバ21Ａに接続される。
【００５４】さらに、１ビットの表示セルＣｓは図４
（Ｂ）の断面図において、相互に対向する背面ガラス基
板２６と前面ガラス基板２７との間が壁（障壁）３０に
より仕切られ、両ガラス基板２６，２７と壁３０とで区
割りされる領域に、Ｘ電極，Ｙ電極及びアドレス電極Ａ
ｊが設けられて成る。背面ガラス基板２６上には同一平
面に平行してＸ電極及びＹ電極が設けられ、両電極上に
誘電体層２８が設けられ、該誘電体層２８上に保護膜と
して、ＭｇＯ（酸化マグネシウム）膜が形成されてい
る。また、アドレス電極Ａｊはそれらと対向する位置で
あって、Ｘ，Ｙ電極と直交する位置に設けられ、前面ガ
ラス基板２７に設けられる。なお、該電極Ａｊ面に、
赤，緑，青の発光特性を持つ蛍光体３１が設けられる。
（Ｂ）の断面図において、相互に対向する背面ガラス基
板２６と前面ガラス基板２７との間が壁（障壁）３０に
より仕切られ、両ガラス基板２６，２７と壁３０とで区
割りされる領域に、Ｘ電極，Ｙ電極及びアドレス電極Ａ
ｊが設けられて成る。背面ガラス基板２６上には同一平
面に平行してＸ電極及びＹ電極が設けられ、両電極上に
誘電体層２８が設けられ、該誘電体層２８上に保護膜と
して、ＭｇＯ（酸化マグネシウム）膜が形成されてい
る。また、アドレス電極Ａｊはそれらと対向する位置で
あって、Ｘ，Ｙ電極と直交する位置に設けられ、前面ガ
ラス基板２７に設けられる。なお、該電極Ａｊ面に、
赤，緑，青の発光特性を持つ蛍光体３１が設けられる。
【００５５】また、１ビットの表示セルＣｓの放電波形
を制御する波形制御部２４は、図５において、ｎ型の電
界トランジスタ（以下単にトランジスタＦＥＴという）
及び抵抗Ｒから成る。すなわち、トランジスタＦＥＴは
スイッチング素子14Ａの一例であり、そのゲートがスキ
ャンドライバ制御部232 に接続され、そのソースが接地
線ＧNDに接続される。抵抗Ｒはバイアス素子Ｒの一例で
あり、その一端がＹ１電極に接続され、その他端がトラ
ンジスタＦＥＴのドレインに接続される。
を制御する波形制御部２４は、図５において、ｎ型の電
界トランジスタ（以下単にトランジスタＦＥＴという）
及び抵抗Ｒから成る。すなわち、トランジスタＦＥＴは
スイッチング素子14Ａの一例であり、そのゲートがスキ
ャンドライバ制御部232 に接続され、そのソースが接地
線ＧNDに接続される。抵抗Ｒはバイアス素子Ｒの一例で
あり、その一端がＹ１電極に接続され、その他端がトラ
ンジスタＦＥＴのドレインに接続される。
【００５６】当該波形制御部２４の機能は、図５（Ｂ）
において、全面書込み動作終了時に、スキャンドライバ
制御部232 から出力されたゲート制御信号ＧＳ＝「Ｈ」
レベルにより、トランジスタＦＥＴがＯＮ動作に移行す
る。これにより、全面書込みパルス印加後に、そのパル
ス電圧を一定の変化率（電圧変化分に対する時間変化
分）により推移させる消去パルスが得られる。
において、全面書込み動作終了時に、スキャンドライバ
制御部232 から出力されたゲート制御信号ＧＳ＝「Ｈ」
レベルにより、トランジスタＦＥＴがＯＮ動作に移行す
る。これにより、全面書込みパルス印加後に、そのパル
ス電圧を一定の変化率（電圧変化分に対する時間変化
分）により推移させる消去パルスが得られる。
【００５７】ここで、消去パルスの傾きは、表示パネル
Ｃｓの電極間に存在する静電容量Ｃと抵抗Ｒにより決定
される時定数によって変化をする。つまり、消去パルス
終了時の電位差をＶｓとし、時間ｔにおけるＸ電極，Ｙ
１電極間の電位差をＶｔとすると、Ｖｔ＝Ｖｓ（１−ｅ
-t/CR ）で表される。この結果，図５（Ｂ）に示すよう
な波形制御をすることができ、放電電圧領域では十分に
小さい電位の傾きを得ることができる。
Ｃｓの電極間に存在する静電容量Ｃと抵抗Ｒにより決定
される時定数によって変化をする。つまり、消去パルス
終了時の電位差をＶｓとし、時間ｔにおけるＸ電極，Ｙ
１電極間の電位差をＶｔとすると、Ｖｔ＝Ｖｓ（１−ｅ
-t/CR ）で表される。この結果，図５（Ｂ）に示すよう
な波形制御をすることができ、放電電圧領域では十分に
小さい電位の傾きを得ることができる。
【００５８】このようにして、本発明の第１の実施例に
係る表示駆動装置によれば、図３〜５に示すように、Ｘ
共通ドライバ21Ａ，Ｙスキャンドライバ21Ｂ，Ｙ共通ド
ライバ21Ｃ，アドレスドライバ２２，制御回路２３及び
波形制御部２４が具備され、該波形制御部２４がＹスキ
ャンドライバ21ＢとＹ共通ドライバ21Ｃとの間に設けら
れる。
係る表示駆動装置によれば、図３〜５に示すように、Ｘ
共通ドライバ21Ａ，Ｙスキャンドライバ21Ｂ，Ｙ共通ド
ライバ21Ｃ，アドレスドライバ２２，制御回路２３及び
波形制御部２４が具備され、該波形制御部２４がＹスキ
ャンドライバ21ＢとＹ共通ドライバ21Ｃとの間に設けら
れる。
【００５９】このため、図５（Ａ）に示すような抵抗Ｒ
及びトランジスタＦＥＴから成る波形制御部２４によ
り、アドレス電極Ａｊの選択前であって、ＰＤＰ２５の
全面書込み時や、その終了後の消去パルスの放電波形制
御をすることができる。すなわち、アドレス放電の前動
作であって、まず、制御回路２３を介してＸ共通ドライ
バ21ＡやＹスキャンドライバ21ＢからＸ，Ｙｉ電極に全
面書込みパルスＶｗが印加される。この際には、トラン
ジスタＦＥＴがＯFF動作され、また、全面書込み及びそ
れに続く維持放電動作が終了すると、トランジスタＦＥ
ＴがＯＮ動作に移行される。
及びトランジスタＦＥＴから成る波形制御部２４によ
り、アドレス電極Ａｊの選択前であって、ＰＤＰ２５の
全面書込み時や、その終了後の消去パルスの放電波形制
御をすることができる。すなわち、アドレス放電の前動
作であって、まず、制御回路２３を介してＸ共通ドライ
バ21ＡやＹスキャンドライバ21ＢからＸ，Ｙｉ電極に全
面書込みパルスＶｗが印加される。この際には、トラン
ジスタＦＥＴがＯFF動作され、また、全面書込み及びそ
れに続く維持放電動作が終了すると、トランジスタＦＥ
ＴがＯＮ動作に移行される。
【００６０】これにより、表示セルＣｓの容量Ｃ，抵抗
Ｒ及びトランジスタＦＥＴから成る放電回路において、
それらの回路時定数τ＝ＲＣにより、Ｘ，Ｙｉ電極上の
電荷が放電をする。ここで、波形制御部２４によりＰＤ
Ｐ２５の放電波形が制御され、Ｘ，Ｙｉ電極上にアドレ
ス放電に有効な壁電荷を残留させることが可能となる。
Ｒ及びトランジスタＦＥＴから成る放電回路において、
それらの回路時定数τ＝ＲＣにより、Ｘ，Ｙｉ電極上の
電荷が放電をする。ここで、波形制御部２４によりＰＤ
Ｐ２５の放電波形が制御され、Ｘ，Ｙｉ電極上にアドレ
ス放電に有効な壁電荷を残留させることが可能となる。
【００６１】このことで、表示セルＣｓ毎に放電開始電
圧のバラツキを生じた場合であっても、簡単な回路で効
率良く、しかも、確実に消去動作を行うことが可能とな
る。また、アドレスドライバ２２からアドレス電極Ａｊ
に、従来例に比べて低いアドレスパルスを印加すること
により、通常のアドレス放電を行うことが可能となる。
圧のバラツキを生じた場合であっても、簡単な回路で効
率良く、しかも、確実に消去動作を行うことが可能とな
る。また、アドレスドライバ２２からアドレス電極Ａｊ
に、従来例に比べて低いアドレスパルスを印加すること
により、通常のアドレス放電を行うことが可能となる。
【００６２】次に、本発明の第１の実施例に係る表示駆
動方法について、当該装置の動作を補足しながら説明を
する。図６は、本発明の第１の実施例に係る表示駆動方
法を説明する波形図であり、図７は第１，第２の実施例
に係る書込み動作時の補足説明図をそれぞれ示してい
る。
動方法について、当該装置の動作を補足しながら説明を
する。図６は、本発明の第１の実施例に係る表示駆動方
法を説明する波形図であり、図７は第１，第２の実施例
に係る書込み動作時の補足説明図をそれぞれ示してい
る。
【００６３】例えば、ＰＤＰ２５をアドレス／維持放電
分離型方式により表示駆動をする場合であって、その１
ビットの表示セルＣｓに係る１駆動サイクル（１サブフ
ィールドに相当する）について説明をすると、図６にお
いて、まず、Ｘ電極に電圧Ｖｗから成る書込みパルスを
印加し、全セルに渡り書込みを実行する。ここで、ＰＤ
Ｐ２５の全面書込み動作において、図７（Ａ）に示すよ
うに、アドレス電極Ａｊに正電荷（イオン）が蓄積され
る。次に、Ｙ１電極に電圧Ｖｓから成るパルスを印加
し、図７（Ｂ）に示すように、全表示セルＣｓが維持放
電を行う。
分離型方式により表示駆動をする場合であって、その１
ビットの表示セルＣｓに係る１駆動サイクル（１サブフ
ィールドに相当する）について説明をすると、図６にお
いて、まず、Ｘ電極に電圧Ｖｗから成る書込みパルスを
印加し、全セルに渡り書込みを実行する。ここで、ＰＤ
Ｐ２５の全面書込み動作において、図７（Ａ）に示すよ
うに、アドレス電極Ａｊに正電荷（イオン）が蓄積され
る。次に、Ｙ１電極に電圧Ｖｓから成るパルスを印加
し、図７（Ｂ）に示すように、全表示セルＣｓが維持放
電を行う。
【００６４】次いで、Ｙ１電極に負極性の消去パルスを
印加する。ここに、「負極性のパルスを印加する」と
は、当該パルスが始まる直前の電圧を基準にマイナス方
向に印加することをいう。つまり、維持放電電圧ＶＳか
ら０Ｖに向かって印加される消去パルスである。具体的
には、アドレス電極Ａｊの非選択時の電位と、Ｘ，Ｙｉ
電極の中で表示ライン毎に共通する電極，つまり、Ｘ電
極の電位とが、そのまま固定され、Ｘ，Ｙｉ電極の中で
表示ライン毎に独立する電極，つまり、Ｙｉ電極に大き
な傾きを持った消去パルスが印加される。
印加する。ここに、「負極性のパルスを印加する」と
は、当該パルスが始まる直前の電圧を基準にマイナス方
向に印加することをいう。つまり、維持放電電圧ＶＳか
ら０Ｖに向かって印加される消去パルスである。具体的
には、アドレス電極Ａｊの非選択時の電位と、Ｘ，Ｙｉ
電極の中で表示ライン毎に共通する電極，つまり、Ｘ電
極の電位とが、そのまま固定され、Ｘ，Ｙｉ電極の中で
表示ライン毎に独立する電極，つまり、Ｙｉ電極に大き
な傾きを持った消去パルスが印加される。
【００６５】この消去パルスは、Ｙｉ電極を選択するス
キャンパルスと同極性のパルスであって、数マイクロ秒
から数百マイクロ秒の間に、最大維持放電電圧を越えな
い値まで増大される消去パルスがＸ，Ｙｉ電極間に印加
される。さらに、この消去パルスは従来例の太幅消去動
作のメカニズムに類似するものであり、消去状態は印加
電圧による空間電荷の吸収をもって行われる壁電荷の中
和によって実現される。これにより、図７（Ｃ）に示す
ように全表示セルＣｓが消去動作となる。
キャンパルスと同極性のパルスであって、数マイクロ秒
から数百マイクロ秒の間に、最大維持放電電圧を越えな
い値まで増大される消去パルスがＸ，Ｙｉ電極間に印加
される。さらに、この消去パルスは従来例の太幅消去動
作のメカニズムに類似するものであり、消去状態は印加
電圧による空間電荷の吸収をもって行われる壁電荷の中
和によって実現される。これにより、図７（Ｃ）に示す
ように全表示セルＣｓが消去動作となる。
【００６６】この際に、Ｘ電極，Ｙ１電極の壁電荷を維
持放電電圧ＶＳを印加しても放電が起きない値まで減少
させる。この際に、消去パルスの電圧変化分が時間変化
分に対して一定とするように、又は、ＰＤＰ２５内の表
示セルＣｓの最小維持放電電圧の最も小さい値を越えた
電圧値から、消去パルスの電圧変化分が時間変化分に対
して一定となるような放電制御が行われる。
持放電電圧ＶＳを印加しても放電が起きない値まで減少
させる。この際に、消去パルスの電圧変化分が時間変化
分に対して一定とするように、又は、ＰＤＰ２５内の表
示セルＣｓの最小維持放電電圧の最も小さい値を越えた
電圧値から、消去パルスの電圧変化分が時間変化分に対
して一定となるような放電制御が行われる。
【００６７】ここで、Ｘ電極，Ｙ１電極間の電位差と、
表示セルＣｓ内に蓄積されていた壁電荷とによる電圧値
との和がこの空間の持つ放電開始電圧値をわずかに越え
る値であるならば、放電に関与する壁電荷は放電空間に
おいて、最も電界強度の強いＸ電極，Ｙ１電極の最短地
点の壁電荷のみとなる。その場合に、放電が終了しても
中和される壁電荷の量はわずかであり、消去放電終了後
にも、維持放電電圧ＶＳが印加されても維持放電を起こ
さない範囲において、多量の壁電荷が残留する。よっ
て、残留する壁電荷の極性は、図７（Ｃ）に示すよう
に、その消去放電が行われる直前の壁電荷の極性と同じ
であるから、Ｙ１電極側に電子（負電荷）が残留し、Ｘ
電極側にイオン（正電荷）が残留する。なお、全表示セ
ルＣｓは、この電位の傾きのいずれかのポイントで消去
放電が行われる。その後、線順次で、書込み放電（アド
レス放電）が実施される。
表示セルＣｓ内に蓄積されていた壁電荷とによる電圧値
との和がこの空間の持つ放電開始電圧値をわずかに越え
る値であるならば、放電に関与する壁電荷は放電空間に
おいて、最も電界強度の強いＸ電極，Ｙ１電極の最短地
点の壁電荷のみとなる。その場合に、放電が終了しても
中和される壁電荷の量はわずかであり、消去放電終了後
にも、維持放電電圧ＶＳが印加されても維持放電を起こ
さない範囲において、多量の壁電荷が残留する。よっ
て、残留する壁電荷の極性は、図７（Ｃ）に示すよう
に、その消去放電が行われる直前の壁電荷の極性と同じ
であるから、Ｙ１電極側に電子（負電荷）が残留し、Ｘ
電極側にイオン（正電荷）が残留する。なお、全表示セ
ルＣｓは、この電位の傾きのいずれかのポイントで消去
放電が行われる。その後、線順次で、書込み放電（アド
レス放電）が実施される。
【００６８】さらに、図７（Ｄ）において、表示セルＣ
ｓの選択書込み（アドレス放電）を実行する。この書込
み放電に関与する電圧は、アドレス電極ＡｊとＹ１電極
間の電位，つまり、アドレス電極Ａｊに印加された正の
電圧Ｖａと、アドレス電極側の蛍光体表面に蓄積された
正の壁電荷であるイオンと、Ｙ１電極側の誘電体表面に
蓄積された負の壁電荷である電子である。なお、このＹ
１電極側の電子は、前述の消去パルスによって形成され
ている。一方、アドレス電極側のイオンは全面書込み放
電によって形成，蓄積されものである。
ｓの選択書込み（アドレス放電）を実行する。この書込
み放電に関与する電圧は、アドレス電極ＡｊとＹ１電極
間の電位，つまり、アドレス電極Ａｊに印加された正の
電圧Ｖａと、アドレス電極側の蛍光体表面に蓄積された
正の壁電荷であるイオンと、Ｙ１電極側の誘電体表面に
蓄積された負の壁電荷である電子である。なお、このＹ
１電極側の電子は、前述の消去パルスによって形成され
ている。一方、アドレス電極側のイオンは全面書込み放
電によって形成，蓄積されものである。
【００６９】また、アドレス放電が全表示ラインで行わ
れた後には、全画面に渡り、Ｘ電極とＹ１電極に交互
に、維持放電電圧パルスが印加され、維持放電が繰り返
される。これにより、最初のサブフィールドに係る維持
放電期間が終了すると、次のサブフィールドで、同様
に、全面書込み放電をし、さらに、全面消去放電が実行
され、それを経てアドレス放電を再び実行することによ
り、ＰＤＰ２５の表示駆動をすることができる。
れた後には、全画面に渡り、Ｘ電極とＹ１電極に交互
に、維持放電電圧パルスが印加され、維持放電が繰り返
される。これにより、最初のサブフィールドに係る維持
放電期間が終了すると、次のサブフィールドで、同様
に、全面書込み放電をし、さらに、全面消去放電が実行
され、それを経てアドレス放電を再び実行することによ
り、ＰＤＰ２５の表示駆動をすることができる。
【００７０】このようにして、本発明の第１の実施例に
係る表示駆動方法によれば、図６において、ＰＤＰ２５
のアドレス電極Ａｊの選択前であって、その全面書込み
及びその直後の維持放電動作終了後に、Ｘ，Ｙｉ電極間
の放電波形制御が行われる。このため、Ｘ，Ｙｉ電極間
にに印加する電圧と、表示セルＣｓ内に蓄積されていた
壁電荷とによる電圧値の和がこの空間の持つ放電開始電
圧値をわずかに越える値であるならば、放電に関与する
壁電荷は放電空間において、最も電界強度の強いＸ，Ｙ
ｉ電極の最短地点の壁電荷のみとなる。
係る表示駆動方法によれば、図６において、ＰＤＰ２５
のアドレス電極Ａｊの選択前であって、その全面書込み
及びその直後の維持放電動作終了後に、Ｘ，Ｙｉ電極間
の放電波形制御が行われる。このため、Ｘ，Ｙｉ電極間
にに印加する電圧と、表示セルＣｓ内に蓄積されていた
壁電荷とによる電圧値の和がこの空間の持つ放電開始電
圧値をわずかに越える値であるならば、放電に関与する
壁電荷は放電空間において、最も電界強度の強いＸ，Ｙ
ｉ電極の最短地点の壁電荷のみとなる。
【００７１】この場合に、放電が終了しても中和される
壁電荷の量はわずかであり、消去放電終了後に、仮に、
維持放電電圧が印加された場合であっても、維持放電を
起こさない範囲に多量の壁電荷を残留させることができ
る。なお、残留する壁電荷の極性は、その消去放電が行
われる直前の壁電荷の極性と同等となることから、極Ｙ
１電側に、電子を残留させ、Ｘ電極側にはイオンを残留
させることが可能となる。
壁電荷の量はわずかであり、消去放電終了後に、仮に、
維持放電電圧が印加された場合であっても、維持放電を
起こさない範囲に多量の壁電荷を残留させることができ
る。なお、残留する壁電荷の極性は、その消去放電が行
われる直前の壁電荷の極性と同等となることから、極Ｙ
１電側に、電子を残留させ、Ｘ電極側にはイオンを残留
させることが可能となる。
【００７２】これにより、全画面に渡る消去動作を従来
例に比べて確実に行うことができ、消去ミスのない良好
な画像表示をすることが可能となる。また、アドレス放
電（選択書込み放電）を行う前までに、該アドレス放電
に有効に作用する壁電荷を蓄積することが可能となるこ
とから、低い印加電圧（アドレス電圧）によりアドレス
放電を行うことが可能となる。これに伴い当該装置の小
電力化及び回路の集積化に貢献するところが大きい。
例に比べて確実に行うことができ、消去ミスのない良好
な画像表示をすることが可能となる。また、アドレス放
電（選択書込み放電）を行う前までに、該アドレス放電
に有効に作用する壁電荷を蓄積することが可能となるこ
とから、低い印加電圧（アドレス電圧）によりアドレス
放電を行うことが可能となる。これに伴い当該装置の小
電力化及び回路の集積化に貢献するところが大きい。
【００７３】（２）第２の実施例の説明 図８（Ａ），（Ｂ）は、本発明の第２の実施例に係る表
示駆動回路の構成図及び動作波形図である。第２の実施
例では第１の実施例と異なり、波形制御部３４にツェナ
ーダイオードＺＤが設けられる。すなわち、ツェナーダ
イオードＺＤは定電圧弁別素子の一例であり、該ダイオ
ードＺＤが抵抗Ｒに並列に接続されることを特徴とす
る。このダイオードＺＤのツェナー電圧Ｖｚは最小維持
放電電圧Ｖsm1 −Ｖｓ以上に設定をする。これにより、
トランジスタＦＥＴがゲート制御信号に基づいてＯＮ動
作をすると、抵抗ＲとツェナーダイオードＺＤに電流が
流れる。また、Ｙｉ電極の電位がツェナー電圧Ｖｚ以上
である場合には、電流を制限する成分がないため、急激
に電流が流れる。なお、ダイオードＺＤの両端に係る電
圧がツェナー電圧Ｖｚ以下になると、ダイオードＺＤに
は電流が流れなくなる。
示駆動回路の構成図及び動作波形図である。第２の実施
例では第１の実施例と異なり、波形制御部３４にツェナ
ーダイオードＺＤが設けられる。すなわち、ツェナーダ
イオードＺＤは定電圧弁別素子の一例であり、該ダイオ
ードＺＤが抵抗Ｒに並列に接続されることを特徴とす
る。このダイオードＺＤのツェナー電圧Ｖｚは最小維持
放電電圧Ｖsm1 −Ｖｓ以上に設定をする。これにより、
トランジスタＦＥＴがゲート制御信号に基づいてＯＮ動
作をすると、抵抗ＲとツェナーダイオードＺＤに電流が
流れる。また、Ｙｉ電極の電位がツェナー電圧Ｖｚ以上
である場合には、電流を制限する成分がないため、急激
に電流が流れる。なお、ダイオードＺＤの両端に係る電
圧がツェナー電圧Ｖｚ以下になると、ダイオードＺＤに
は電流が流れなくなる。
【００７４】このようにして、本発明の第２の実施例に
係る表示駆動装置によれば、波形制御部３４にツェナー
ダイオードＺＤが設けられ、図８（Ａ）に示すように、
ダイオードＺＤが抵抗Ｒに並列に接続される。このた
め、波形制御部３４により、アドレス電極Ａｊの選択前
であって、ＰＤＰ２５の全面書込み時や、その終了後の
消去パルスの放電波形を極め細かく制御することができ
る。例えば、アドレス放電の前動作であって、まず、本
発明の第１の実施例と同様に、Ｘ共通ドライバ21Ａ，Ｙ
スキャンドライバ21ＢからＸ，Ｙｉ電極に全面書込みパ
ルスＶｗが印加される。この際には、トランジスタＦＥ
ＴがＯFF動作され、また、全面書込み及びそれに続く維
持放電動作が終了すると、トランジスタＦＥＴがＯＮ動
作に移行される。
係る表示駆動装置によれば、波形制御部３４にツェナー
ダイオードＺＤが設けられ、図８（Ａ）に示すように、
ダイオードＺＤが抵抗Ｒに並列に接続される。このた
め、波形制御部３４により、アドレス電極Ａｊの選択前
であって、ＰＤＰ２５の全面書込み時や、その終了後の
消去パルスの放電波形を極め細かく制御することができ
る。例えば、アドレス放電の前動作であって、まず、本
発明の第１の実施例と同様に、Ｘ共通ドライバ21Ａ，Ｙ
スキャンドライバ21ＢからＸ，Ｙｉ電極に全面書込みパ
ルスＶｗが印加される。この際には、トランジスタＦＥ
ＴがＯFF動作され、また、全面書込み及びそれに続く維
持放電動作が終了すると、トランジスタＦＥＴがＯＮ動
作に移行される。
【００７５】このことで、図８（Ｂ）に示すように、全
面消去動作時に、ゲート制御信号Ｇに基づいてトランジ
スタＦＥＴがＯＮ動作をすることで、抵抗Ｒとツェナー
ダイオードＺＤとに電流が流れる。この際に、Ｙｉ電極
の電圧が該抵抗ＺＤのツェナー電圧以上の状態では、電
流を制限する成分がないため、急激に電流が流れる。ま
た、その間の電圧がツェナー電圧を下回ると、該抵抗Ｚ
Ｄには電流が流れなくなる。その後は、表示セルＣｓ，
抵抗Ｒに基づく回路時定数により、Ｘ，Ｙｉ電極上の電
荷が放電をする。
面消去動作時に、ゲート制御信号Ｇに基づいてトランジ
スタＦＥＴがＯＮ動作をすることで、抵抗Ｒとツェナー
ダイオードＺＤとに電流が流れる。この際に、Ｙｉ電極
の電圧が該抵抗ＺＤのツェナー電圧以上の状態では、電
流を制限する成分がないため、急激に電流が流れる。ま
た、その間の電圧がツェナー電圧を下回ると、該抵抗Ｚ
Ｄには電流が流れなくなる。その後は、表示セルＣｓ，
抵抗Ｒに基づく回路時定数により、Ｘ，Ｙｉ電極上の電
荷が放電をする。
【００７６】これにより、消去初期段階で急峻に波形変
化をし、その後は、大きな傾き変化をする消去パルスを
得ることが可能となり、表示セルＣｓ毎に放電開始電圧
のバラツキを生じた場合であっても、Ｘ，Ｙｉ電極上に
アドレス放電に有効な壁電荷を残留させることが可能と
なる。次に、本発明の第２の実施例に係る表示駆動方法
について、当該装置の動作を補足しながら説明をする。
化をし、その後は、大きな傾き変化をする消去パルスを
得ることが可能となり、表示セルＣｓ毎に放電開始電圧
のバラツキを生じた場合であっても、Ｘ，Ｙｉ電極上に
アドレス放電に有効な壁電荷を残留させることが可能と
なる。次に、本発明の第２の実施例に係る表示駆動方法
について、当該装置の動作を補足しながら説明をする。
【００７７】図９は、本発明の第２の実施例に係るＰＤ
Ｐの表示駆動方法を説明する波形図であり、図10
（Ａ），（Ｂ）は、その補足説明図をそれぞれ示してい
る。 なお、基本的な動作は第１の実施例と同様であ
り、その相違点は、波形制御部３４により消去パルスを
緩やかに制御するものである。すなわち、図９におい
て、第１の実施例と同様に、Ｘ電極に電圧Ｖｗから成る
書込みパルスを印加し、全セルに渡り書込みを実行す
る。これにより、図７（Ａ）に示すように、アドレス電
極Ａｊに正電荷（イオン）が蓄積される。その後、電極
Ｖｓから成る維持放電パルスが印加され、維持放電が行
われる。次に、消去パルスが印加され消去を行う。
Ｐの表示駆動方法を説明する波形図であり、図10
（Ａ），（Ｂ）は、その補足説明図をそれぞれ示してい
る。 なお、基本的な動作は第１の実施例と同様であ
り、その相違点は、波形制御部３４により消去パルスを
緩やかに制御するものである。すなわち、図９におい
て、第１の実施例と同様に、Ｘ電極に電圧Ｖｗから成る
書込みパルスを印加し、全セルに渡り書込みを実行す
る。これにより、図７（Ａ）に示すように、アドレス電
極Ａｊに正電荷（イオン）が蓄積される。その後、電極
Ｖｓから成る維持放電パルスが印加され、維持放電が行
われる。次に、消去パルスが印加され消去を行う。
【００７８】この際に、Ｙ電極を選択するスキャンパル
スと同極性のパルスであって、数マイクロ秒から数百マ
イクロ秒の間に、最大維持放電電圧を越えない値まで増
大される消去パルスがＸ，Ｙｉ電極間に印加される。ま
た、図10（Ａ）に示す消去動作時の拡大波形図におい
て、表示パネルＣｓ内の最も電圧の低い表示セルＣｓの
維持放電電圧である最小維持放電電圧Ｖsm１になる直前
まで、波形制御部３４により急峻に電圧を印加する。な
お、消去放電のメカニズムは、第１の実施例と同様であ
るが、同じ消去期間を設定した場合に、消去パルスの傾
きをより緩やかにすることが可能となる。これにより、
第１の実施例に比べて多くの壁電荷を残留させることが
可能となり、より一層低電圧アドレス放電を行うことが
可能となる。
スと同極性のパルスであって、数マイクロ秒から数百マ
イクロ秒の間に、最大維持放電電圧を越えない値まで増
大される消去パルスがＸ，Ｙｉ電極間に印加される。ま
た、図10（Ａ）に示す消去動作時の拡大波形図におい
て、表示パネルＣｓ内の最も電圧の低い表示セルＣｓの
維持放電電圧である最小維持放電電圧Ｖsm１になる直前
まで、波形制御部３４により急峻に電圧を印加する。な
お、消去放電のメカニズムは、第１の実施例と同様であ
るが、同じ消去期間を設定した場合に、消去パルスの傾
きをより緩やかにすることが可能となる。これにより、
第１の実施例に比べて多くの壁電荷を残留させることが
可能となり、より一層低電圧アドレス放電を行うことが
可能となる。
【００７９】ここで、パルスの傾きが壁電荷の形成に及
ぼす影響について図10（Ａ）に基づいて説明をすると、
気体中における放電現象では、電子，イオンの空間電荷
がギャップ中を比較的に低速度で移動をすることから、
電圧印加から放電開始に至るまでには、ある程度の遅れ
があることが知られている。この時間は放電遅れ時間と
呼ばれている。代表的なＰＤＰ２５では、通常百〔ｎ
ｓ〕〜数〔μｓ〕になるが、印加電圧や封入ガス等の条
件によって異なる。放電遅れ時間をＴｄとすると、印加
電圧の立ち上がり時間ＴｒがＴｒ＜Ｔｄの場合には、パ
ルス立ち上がり過程で、放電開始電圧を越えるが、放電
遅れ時間Ｔｄがあるため、実際には、放電はピーク電圧
で向かえることとなる。
ぼす影響について図10（Ａ）に基づいて説明をすると、
気体中における放電現象では、電子，イオンの空間電荷
がギャップ中を比較的に低速度で移動をすることから、
電圧印加から放電開始に至るまでには、ある程度の遅れ
があることが知られている。この時間は放電遅れ時間と
呼ばれている。代表的なＰＤＰ２５では、通常百〔ｎ
ｓ〕〜数〔μｓ〕になるが、印加電圧や封入ガス等の条
件によって異なる。放電遅れ時間をＴｄとすると、印加
電圧の立ち上がり時間ＴｒがＴｒ＜Ｔｄの場合には、パ
ルス立ち上がり過程で、放電開始電圧を越えるが、放電
遅れ時間Ｔｄがあるため、実際には、放電はピーク電圧
で向かえることとなる。
【００８０】一方、Ｔｒ＞Ｔｄの場合には、放電はピー
ク電圧より低いレベルで発生する。この場合には、ピー
ク電圧で放電を向かえた場合よりも壁電荷の形成量が少
なくなってくる。従って、Ｔｒ＞＞Ｔｄとなれば、放電
に関与する壁電荷はより少ないものとなり、放電によっ
て形成される空間電荷及び壁電荷はより少ないものとな
り、その結果、残留壁電荷は多くなる。
ク電圧より低いレベルで発生する。この場合には、ピー
ク電圧で放電を向かえた場合よりも壁電荷の形成量が少
なくなってくる。従って、Ｔｒ＞＞Ｔｄとなれば、放電
に関与する壁電荷はより少ないものとなり、放電によっ
て形成される空間電荷及び壁電荷はより少ないものとな
り、その結果、残留壁電荷は多くなる。
【００８１】例えば、図10（Ａ）において、ＰＤＰ２５
が放電電圧を向かえ、その放電が行われる時間をＴｄと
すると、Ｔｄ後の電圧は、第１の実施例に比べて第２
の実施例の方が小さい。ということは、の場合がよ
り残留壁電荷が多くなるといえる。なお、図10（Ｂ）
は、消去パルスの傾きｄｖ／ｄｔに対する電荷量Ｑとの
関係を示している。図10（Ｂ）において、縦軸は、電荷
量Ｑの絶対値であり、横軸は消去パルスの傾きｄｖ／ｄ
ｔを示している。傾きｄｖ／ｄｔは、時間変化分に対す
る電圧変化分の割合である。
が放電電圧を向かえ、その放電が行われる時間をＴｄと
すると、Ｔｄ後の電圧は、第１の実施例に比べて第２
の実施例の方が小さい。ということは、の場合がよ
り残留壁電荷が多くなるといえる。なお、図10（Ｂ）
は、消去パルスの傾きｄｖ／ｄｔに対する電荷量Ｑとの
関係を示している。図10（Ｂ）において、縦軸は、電荷
量Ｑの絶対値であり、横軸は消去パルスの傾きｄｖ／ｄ
ｔを示している。傾きｄｖ／ｄｔは、時間変化分に対す
る電圧変化分の割合である。
【００８２】また、図10（Ｂ）において、消去パルスと
して動作する領域Ｂは、放電が完全に終了した時点で、
残留又は生成された壁電荷による電圧Ｖwrと、維持パル
スの電圧の和が放電開始電圧に満たない領域である。な
お、領域Ａは放電の規模が小さく、発生する空間電荷が
少ないため、空間電荷による壁電荷の中和量も少なくな
り、最終的に残る壁電荷の量が多くなる領域である。こ
の場合の壁電荷量は、パルスが印加される前の状態と同
極性である。
して動作する領域Ｂは、放電が完全に終了した時点で、
残留又は生成された壁電荷による電圧Ｖwrと、維持パル
スの電圧の和が放電開始電圧に満たない領域である。な
お、領域Ａは放電の規模が小さく、発生する空間電荷が
少ないため、空間電荷による壁電荷の中和量も少なくな
り、最終的に残る壁電荷の量が多くなる領域である。こ
の場合の壁電荷量は、パルスが印加される前の状態と同
極性である。
【００８３】また、領域Ｃは維持パルスの動作とほぼ同
等である。ここで、大量に発生した空間電荷は、放電に
未関与であった壁電荷を中和し、さらに、印加電圧に引
かれ、壁電荷として蓄積する。よって、極性はパルスが
印加される前の状態と異なった極性となる。これによ
り、領域Ｂにおいて、領域Ａ側に近づくほど、Ｙｉ電極
側にマイナスの壁電荷が多くなり、アドレス放電を低い
印加電圧Ｖａにて行うことが可能となる。逆に、領域Ｃ
側に近づくほど、逆極性つまり、プラスの壁電荷がＹｉ
電極側に蓄積されるため、アドレス放電につき、高い印
加電圧が必要となる。
等である。ここで、大量に発生した空間電荷は、放電に
未関与であった壁電荷を中和し、さらに、印加電圧に引
かれ、壁電荷として蓄積する。よって、極性はパルスが
印加される前の状態と異なった極性となる。これによ
り、領域Ｂにおいて、領域Ａ側に近づくほど、Ｙｉ電極
側にマイナスの壁電荷が多くなり、アドレス放電を低い
印加電圧Ｖａにて行うことが可能となる。逆に、領域Ｃ
側に近づくほど、逆極性つまり、プラスの壁電荷がＹｉ
電極側に蓄積されるため、アドレス放電につき、高い印
加電圧が必要となる。
【００８４】このようにして、本発明の第２の実施例に
係る表示駆動方法によれば、Ｘ，Ｙｉ電極間の放電波形
制御をする際に、波形制御部３４により、ＰＤＰ２５内
の表示セルＣｓの最小維持放電電圧の最も小さい値の直
前まで、数ナノ秒から数マイクロ秒間に消去パルスが急
速に印加され、その後、単位電圧当たり数ナノ秒から数
マイクロ秒の割合で消去パルスが緩やかに印加される。
係る表示駆動方法によれば、Ｘ，Ｙｉ電極間の放電波形
制御をする際に、波形制御部３４により、ＰＤＰ２５内
の表示セルＣｓの最小維持放電電圧の最も小さい値の直
前まで、数ナノ秒から数マイクロ秒間に消去パルスが急
速に印加され、その後、単位電圧当たり数ナノ秒から数
マイクロ秒の割合で消去パルスが緩やかに印加される。
【００８５】このため、表示セルＣｓ毎に放電開始電圧
のバラツキを生じた場合であっても、消去初期段階で急
峻に波形が立ち下がり、その後は、大きな傾き変化をす
る消去パルスにより、Ｘ，Ｙｉ電極上にアドレス放電に
有効な壁電荷を残留させることができる。すなわち、図
10（Ｂ）に示したように、第１の実施例に比べて、第
２の実施例では放電に関与する壁電荷はより少ないも
のとなり、その結果、空間電荷が中和された後に、アド
レス放電に有効に作用する壁電荷を多く残留させること
が可能となる。
のバラツキを生じた場合であっても、消去初期段階で急
峻に波形が立ち下がり、その後は、大きな傾き変化をす
る消去パルスにより、Ｘ，Ｙｉ電極上にアドレス放電に
有効な壁電荷を残留させることができる。すなわち、図
10（Ｂ）に示したように、第１の実施例に比べて、第
２の実施例では放電に関与する壁電荷はより少ないも
のとなり、その結果、空間電荷が中和された後に、アド
レス放電に有効に作用する壁電荷を多く残留させること
が可能となる。
【００８６】これにより、表示セルＣｓ毎の放電開始電
圧に多少バラツキがあっても、限られた時間で壁電荷を
多く残留させることができ、従来例のように自己消去動
作に陥ることなく、低電圧アドレス放電を行うことが可
能となる。このことで、書込みミスを回避し、良好な画
像表示を行うことが可能となる。 （３）第３の実施例の説明 図11は、本発明の第３の実施例に係る表示駆動方法の説
明図であり、図12（Ａ）〜（Ｃ）は、その書込み動作時
の補足説明図をそれぞれ示している。
圧に多少バラツキがあっても、限られた時間で壁電荷を
多く残留させることができ、従来例のように自己消去動
作に陥ることなく、低電圧アドレス放電を行うことが可
能となる。このことで、書込みミスを回避し、良好な画
像表示を行うことが可能となる。 （３）第３の実施例の説明 図11は、本発明の第３の実施例に係る表示駆動方法の説
明図であり、図12（Ａ）〜（Ｃ）は、その書込み動作時
の補足説明図をそれぞれ示している。
【００８７】第３の実施例では第２の実施例と異なり、
Ｙ１電極〜ＹＮ電極に全面書込みパルス（電圧Ｖｗ）を
印加し、全面書込み放電を実行し、その後、維持放電を
経ずに、消去放電を行うものである。すなわち、通常の
全面書込みパルスを除去する際には、急峻にＸ電極とＹ
１電極の電位差を０Ｖにするか、即、逆極性の維持放電
パルスを印加する。もし、全面書込み放電で、大量の壁
電荷を形成しすぎた場合には、Ｘ電極とＹ１電極の電位
差を０Ｖにすると、壁電荷のみの電圧で放電を起こして
しまい、維持放電に移行するだけの壁電荷を失う自己消
去動作になる場合がある。
Ｙ１電極〜ＹＮ電極に全面書込みパルス（電圧Ｖｗ）を
印加し、全面書込み放電を実行し、その後、維持放電を
経ずに、消去放電を行うものである。すなわち、通常の
全面書込みパルスを除去する際には、急峻にＸ電極とＹ
１電極の電位差を０Ｖにするか、即、逆極性の維持放電
パルスを印加する。もし、全面書込み放電で、大量の壁
電荷を形成しすぎた場合には、Ｘ電極とＹ１電極の電位
差を０Ｖにすると、壁電荷のみの電圧で放電を起こして
しまい、維持放電に移行するだけの壁電荷を失う自己消
去動作になる場合がある。
【００８８】この場合には、それ以降の制御は不可能と
なる。また、全面書込みパルス印加直後に、逆極性の維
持放電パルスを印加すると、そのパルスの印加過程（電
圧の立ち上がり時期）で放電を開始してしまい、正常な
維持放電を行えない可能性がある。そこで、第３の実施
例では、図11において、Ｙ１電極より印加される電圧Ｖ
ｗ≧Ｖｆよりなる全面書込みパルスによって、全面の放
電セルに対して書込み放電を行った後、その電位状態の
まま、まず、Ｘ電極とＹ１電極間の電位差が０Ｖになる
ように、時間をかけて電圧を印加する。なお、Ｖｆは
Ｘ，Ｙ１電極間の放電開始電圧である。
なる。また、全面書込みパルス印加直後に、逆極性の維
持放電パルスを印加すると、そのパルスの印加過程（電
圧の立ち上がり時期）で放電を開始してしまい、正常な
維持放電を行えない可能性がある。そこで、第３の実施
例では、図11において、Ｙ１電極より印加される電圧Ｖ
ｗ≧Ｖｆよりなる全面書込みパルスによって、全面の放
電セルに対して書込み放電を行った後、その電位状態の
まま、まず、Ｘ電極とＹ１電極間の電位差が０Ｖになる
ように、時間をかけて電圧を印加する。なお、Ｖｆは
Ｘ，Ｙ１電極間の放電開始電圧である。
【００８９】次に、電位差が電圧Ｖｗとは逆極性で、電
位差がＶｓになるパルスを印加する。ここで、図12
（Ａ）において、始めの電位差Ｖｗから０Ｖまでの過程
において、全面書込み放電により大量の壁電荷が生成さ
れた場合に、余分な電荷分で放電を行い電荷を中和す
る。つまり、全面書込み放電によって生成された壁電荷
をＶｗｗとすると、Ｖｗｗ≧Ｖｆであるならば、電圧Ｖ
ｗが印加されている状態でＸ電極とＹ１電極間に印加さ
れる電圧Ｖｃは、Ｖｃ＝Ｖｗ−Ｖｗｗで表される。
位差がＶｓになるパルスを印加する。ここで、図12
（Ａ）において、始めの電位差Ｖｗから０Ｖまでの過程
において、全面書込み放電により大量の壁電荷が生成さ
れた場合に、余分な電荷分で放電を行い電荷を中和す
る。つまり、全面書込み放電によって生成された壁電荷
をＶｗｗとすると、Ｖｗｗ≧Ｖｆであるならば、電圧Ｖ
ｗが印加されている状態でＸ電極とＹ１電極間に印加さ
れる電圧Ｖｃは、Ｖｃ＝Ｖｗ−Ｖｗｗで表される。
【００９０】また、放電が終了している状態では、Ｖｃ
＜＜Ｖｆであり、電位差が０Ｖに近づくに従って、Ｖｃ
＝Ｖｗｗに近づく。ここで、Ｖｗｗ≧Ｖｆであるから、
壁電荷のみの電圧Ｖｗｗで放電を行ってしまう。Ｖｗｗ
はＶｆよりも大きな値であっても、格段に大きいものと
はならないことから、放電に関与する壁電荷（Ｖｗｗの
中で）が少なくなり、余分なものが中和されて消失され
る。その結果、大きなＶｗを印加して、壁電荷を大量に
生成し過ぎても、この過程で取り除かれるため消去放電
に入る直前の壁電荷量は、ほぼ一定に保たれる。
＜＜Ｖｆであり、電位差が０Ｖに近づくに従って、Ｖｃ
＝Ｖｗｗに近づく。ここで、Ｖｗｗ≧Ｖｆであるから、
壁電荷のみの電圧Ｖｗｗで放電を行ってしまう。Ｖｗｗ
はＶｆよりも大きな値であっても、格段に大きいものと
はならないことから、放電に関与する壁電荷（Ｖｗｗの
中で）が少なくなり、余分なものが中和されて消失され
る。その結果、大きなＶｗを印加して、壁電荷を大量に
生成し過ぎても、この過程で取り除かれるため消去放電
に入る直前の壁電荷量は、ほぼ一定に保たれる。
【００９１】次の段階では、Ｘ電極とＹ１電極間の電位
差が０ＶからＶｓになることから、図12（Ｂ）に示すよ
うに、第１，第２の実施例と同様な消去放電を行うこと
ができる。なお、図12（Ｃ）において、第１の実施例と
同様に表示セルＣｓの選択書込み（アドレス放電）を実
行し、アドレス放電が全表示ラインで行われた後には、
全画面に渡り、Ｘ電極とＹ１電極に交互に、維持放電電
圧パルスが印加され、維持放電が繰り返される。これに
より、第１の実施例と同様にＰＤＰ２５の表示駆動をす
ることができる。
差が０ＶからＶｓになることから、図12（Ｂ）に示すよ
うに、第１，第２の実施例と同様な消去放電を行うこと
ができる。なお、図12（Ｃ）において、第１の実施例と
同様に表示セルＣｓの選択書込み（アドレス放電）を実
行し、アドレス放電が全表示ラインで行われた後には、
全画面に渡り、Ｘ電極とＹ１電極に交互に、維持放電電
圧パルスが印加され、維持放電が繰り返される。これに
より、第１の実施例と同様にＰＤＰ２５の表示駆動をす
ることができる。
【００９２】このようにして、本発明の第３の実施例に
係る表示駆動方法によれば、ＰＤＰ２５の全面書込み動
作の際に、Ｘ，Ｙｉ電極の一方に放電開始電圧Ｖｆを越
える書込みパルスＶｗが与えられ、次いで、全面書込み
動作終了時の電位状態からＸ，Ｙｉ電極間の電位差を０
〔Ｖ〕にし、引続き、全面書込み動作時の書込みパルス
Ｖｗの極性であって、最大維持放電電圧を越えない値ま
で、消去パルスを印加するＸ，Ｙｉ電極間の放電波形制
御が行われる。
係る表示駆動方法によれば、ＰＤＰ２５の全面書込み動
作の際に、Ｘ，Ｙｉ電極の一方に放電開始電圧Ｖｆを越
える書込みパルスＶｗが与えられ、次いで、全面書込み
動作終了時の電位状態からＸ，Ｙｉ電極間の電位差を０
〔Ｖ〕にし、引続き、全面書込み動作時の書込みパルス
Ｖｗの極性であって、最大維持放電電圧を越えない値ま
で、消去パルスを印加するＸ，Ｙｉ電極間の放電波形制
御が行われる。
【００９３】このため、本発明の第１，第２の実施例と
は異なり、Ｘ，Ｙｉ電極間に全面書込みパルスを印加
し、全面書込み放電を実行した後に、維持放電を経ず
に、Ｘ，Ｙｉ電極上に、ほぼ一定の壁電荷量を残留させ
る消去放電を行うことが可能となる。これにより、全面
書込み動作により、Ｘ，Ｙｉ電極上に、大量の壁電荷を
生成し過ぎた場合にも、アドレス放電の前までには、残
留壁電荷量を一定にすることが可能になる。このこと
で、書込みミスを回避し、良好な画像表示を行うことが
可能となる。
は異なり、Ｘ，Ｙｉ電極間に全面書込みパルスを印加
し、全面書込み放電を実行した後に、維持放電を経ず
に、Ｘ，Ｙｉ電極上に、ほぼ一定の壁電荷量を残留させ
る消去放電を行うことが可能となる。これにより、全面
書込み動作により、Ｘ，Ｙｉ電極上に、大量の壁電荷を
生成し過ぎた場合にも、アドレス放電の前までには、残
留壁電荷量を一定にすることが可能になる。このこと
で、書込みミスを回避し、良好な画像表示を行うことが
可能となる。
【００９４】
【発明の効果】以上説明したように、本発明の第１の表
示駆動装置によれば、第１，第２の駆動手段及び制御手
段が具備され、第１の駆動手段に放電制御手段が設けら
れる。このため、バイアス素子及びスイッチング素子か
ら成る放電制御手段により、アドレス電極の選択前であ
って、表示セル容量，バイアス素子の回路時定数によ
り、表示手段の全面書込み時や、その終了後の消去パル
スの放電波形制御をすることができる。この結果、アド
レス放電（選択書込み放電）に有効な壁電荷を残留させ
ることが可能となる。
示駆動装置によれば、第１，第２の駆動手段及び制御手
段が具備され、第１の駆動手段に放電制御手段が設けら
れる。このため、バイアス素子及びスイッチング素子か
ら成る放電制御手段により、アドレス電極の選択前であ
って、表示セル容量，バイアス素子の回路時定数によ
り、表示手段の全面書込み時や、その終了後の消去パル
スの放電波形制御をすることができる。この結果、アド
レス放電（選択書込み放電）に有効な壁電荷を残留させ
ることが可能となる。
【００９５】また、本発明の第２の表示駆動装置によれ
ば、放電制御手段に定電圧弁別素子が設けられ、該定電
圧弁別素子がバイアス素子に並列に接続される。このた
め、定電圧弁別素子を含む放電制御手段により、消去初
期段階で急峻に波形変化をし、その後は、大きな傾き変
化をする消去パルスを得ることが可能となり、消去パル
スの放電波形を極め細かく制御すること可能となる。こ
のことで、第１の表示駆動装置と同様に表示セル毎に放
電開始電圧のバラツキを生じた場合であっても、簡単な
回路で効率良く、しかも、確実に消去動作を行うことが
可能となる。
ば、放電制御手段に定電圧弁別素子が設けられ、該定電
圧弁別素子がバイアス素子に並列に接続される。このた
め、定電圧弁別素子を含む放電制御手段により、消去初
期段階で急峻に波形変化をし、その後は、大きな傾き変
化をする消去パルスを得ることが可能となり、消去パル
スの放電波形を極め細かく制御すること可能となる。こ
のことで、第１の表示駆動装置と同様に表示セル毎に放
電開始電圧のバラツキを生じた場合であっても、簡単な
回路で効率良く、しかも、確実に消去動作を行うことが
可能となる。
【００９６】また、本発明の第１の表示駆動方法によれ
ば、アドレス電極の選択前であって、表示手段の全面書
込み動作終了後に、放電維持電極間の放電波形制御が行
われる。このため、全画面に渡る消去動作を従来例に比
べて確実に行うことができ、良好な画像表示をすること
が可能となる。また、アドレス放電を行う前までに、該
アドレス放電に有効に作用する壁電荷を蓄積することが
可能となり、低い印加電圧（アドレス電圧）により維持
放電を行うことが可能となる。
ば、アドレス電極の選択前であって、表示手段の全面書
込み動作終了後に、放電維持電極間の放電波形制御が行
われる。このため、全画面に渡る消去動作を従来例に比
べて確実に行うことができ、良好な画像表示をすること
が可能となる。また、アドレス放電を行う前までに、該
アドレス放電に有効に作用する壁電荷を蓄積することが
可能となり、低い印加電圧（アドレス電圧）により維持
放電を行うことが可能となる。
【００９７】さらに、本発明の第２の表示駆動方法によ
れば、表示セルの最小維持放電電圧の最も小さい値の直
前まで、数ナノ秒から数マイクロ秒間に消去パルスが急
速に印加され、その後、単位電圧当たり数ナノ秒から数
マイクロ秒の割合で消去パルスが緩やかに印加される。
このため、表示セル毎に放電開始電圧のバラツキを生じ
た場合であっても、消去初期段階で急峻に波形が立ち下
がり、その後は、大きな傾き変化をする消去パルスによ
り、放電維持電極上にアドレス放電に有効な壁電荷を多
く残留させることができる。
れば、表示セルの最小維持放電電圧の最も小さい値の直
前まで、数ナノ秒から数マイクロ秒間に消去パルスが急
速に印加され、その後、単位電圧当たり数ナノ秒から数
マイクロ秒の割合で消去パルスが緩やかに印加される。
このため、表示セル毎に放電開始電圧のバラツキを生じ
た場合であっても、消去初期段階で急峻に波形が立ち下
がり、その後は、大きな傾き変化をする消去パルスによ
り、放電維持電極上にアドレス放電に有効な壁電荷を多
く残留させることができる。
【００９８】また、本発明の第３の表示駆動方法によれ
ば、放電維持電極の一方に放電開始電圧を越える書込み
パルスが与えられ、その後、全面書込み動作終了時の電
位状態から放電維持電極間の電位差を０〔Ｖ〕にし、引
続き、その書込みパルスの極性であって、最大維持放電
電圧を越えない値まで、消去パルスを印加する放電波形
制御が行われる。
ば、放電維持電極の一方に放電開始電圧を越える書込み
パルスが与えられ、その後、全面書込み動作終了時の電
位状態から放電維持電極間の電位差を０〔Ｖ〕にし、引
続き、その書込みパルスの極性であって、最大維持放電
電圧を越えない値まで、消去パルスを印加する放電波形
制御が行われる。
【００９９】このため、維持放電を経ずに、放電維持電
極上に、ほぼ一定の壁電荷量を残留させる消去放電を行
うことが可能となる。また、全面書込み動作により、放
電維持電極上に、大量の壁電荷を生成し過ぎた場合に
も、アドレス放電の前までには、残留壁電荷量を一定に
することが可能になる。これにより、低消費電力型で高
集積化が可能な表示駆動装置の提供及びプラズマディズ
プレイ装置の高品質，高画質化に寄与するところが大き
い。
極上に、ほぼ一定の壁電荷量を残留させる消去放電を行
うことが可能となる。また、全面書込み動作により、放
電維持電極上に、大量の壁電荷を生成し過ぎた場合に
も、アドレス放電の前までには、残留壁電荷量を一定に
することが可能になる。これにより、低消費電力型で高
集積化が可能な表示駆動装置の提供及びプラズマディズ
プレイ装置の高品質，高画質化に寄与するところが大き
い。
【図１】本発明に係る表示駆動装置の原理図である。
【図２】本発明に係る表示駆動方法の原理図である。
【図３】本発明の各実施例に係るＡＣ型ＰＤＰ駆動装置
の全体構成図である。
の全体構成図である。
【図４】本発明の各実施例に係るＡＣ型ＰＤＰの構成図
である。
である。
【図５】本発明の第１の実施例に係る表示駆動回路の構
成図である。
成図である。
【図６】本発明の第１の実施例に係る表示駆動方法を説
明する波形図である。
明する波形図である。
【図７】本発明の第１，第２の実施例に係る書込み動作
時の補足説明図である。
時の補足説明図である。
【図８】本発明の第２の実施例に係る表示駆動回路の構
成図及び動作波形図である。
成図及び動作波形図である。
【図９】本発明の第２の実施例に係る表示駆動方法を説
明する波形図である。
明する波形図である。
【図10】本発明の第２の実施例に係る表示駆動方法の補
足説明図である。
足説明図である。
【図11】本発明の第３の実施例に係る表示駆動方法の説
明する波形図である。
明する波形図である。
【図12】本発明の第３の実施例に係る書込み動作時の補
足説明図である。
足説明図である。
【図13】従来例に係るＡＣ型ＰＤＰ駆動装置の構成図で
ある。
ある。
【図14】従来例に係る表示駆動方法を説明する波形図で
ある。
ある。
【図15】従来例に係る問題点を説明する太幅消去動作の
説明図である。
説明図である。
【図16】従来例に係る問題点を説明する細幅消去動作の
説明図である。
説明図である。
１１…第１の駆動手段、 １２…第２の駆動手段、 １３…制御手段、 １４…放電制御手段、 14Ａ…スイッチング素子、 Ｒ…バイアス素子、 ＺＤ…定電圧弁別素子、 Ｃｓ…表示セル、 Ａｊ…アドレス電極、 Ｘ，Ｙｉ…放電維持電極。
Claims (11)
- 【請求項１】 互いに独立した複数の放電維持電極を備
えた平面型表示装置と、該放電維持電極に印加される放
電波形を制御するための放電制御手段とを有する表示駆
動装置であって、 該放電制御手段は、所定の電位を与えるためのスイッチ
ング素子と、該スイッチング素子に接続され、該放電維
持電極に供給される電流を制限するためのバイアス素子
と、該バイアス素子に並列に接続された定電圧弁別素子
とを含むことを特徴とする表示駆動装置。 - 【請求項２】 前記バイアス素子は抵抗であり、前記定
電圧弁別素子はツェナーダイオードであることを特徴と
する請求項１記載の表示駆動装置。 - 【請求項３】 複数の表示セルを構成する複数ラインの
維持電極を備えた平面型表示装置の表示駆動方法であっ
て、 該複数の表示セルに対し、アドレスデータに応じて選択
的に壁電荷を生成するためのアドレス放電を実施するア
ドレス期間と、 該アドレス期間において選択的に壁電荷を生成した表示
セルに対し、放電発光を行うための維持放電を実施する
維持放電期間とを含み、 前記アドレス期間は、時間に対して印加電圧が変化する
パルスを前記放電維持電極に印加することにより、前記
アドレス放電に有効な壁電荷を生成するステップを、前
記アドレス放電に先立って有することを特徴とする表示
駆動方法。 - 【請求項４】 前記アドレス放電に有効な壁電荷を生成
するステップは、前記表示セルの全てにおいて壁電荷を
生成する全面書込みのステップと、生成した該壁電荷の
量を調節するために、時間に対して印加電圧が変化する
消去パルスを印加する全面消去のステップとを備えるこ
とを特徴とする請求項３記載の表示駆動方法。 - 【請求項５】 前記全面消去のステップにおいては、前
記複数の表示セルのうちの最小維持放電電圧の直前まで
消去パルスを急速に印加し、その後、消去パルスを緩や
かに印加することを特徴とする請求項４記載の表示駆動
方法。 - 【請求項６】 前記放電維持電極はライン毎に第１及び
第２の放電維持電極を具備しており、前記時間に対して
印加電圧が変化するパルスは該第１の放電維持電極に印
加されるものであり、前記有効な壁電荷を生成するステ
ップ終了時において、該第１の放電維持電極の電位は、
前記アドレス放電における該第１の放電維持電極の選択
電位と同電位であることを特徴とする請求項３乃至５記
載の表示駆動方法。 - 【請求項７】 前記放電維持電極はライン毎に第１及び
第２の放電維持電極を具備しており、前記時間に対して
印加電圧が変化するパルスは該第１の放電維持電極に印
加されるものであり、前記有効な壁電荷を生成するステ
ップ終了時において、該第２の放電維持電極の電位は、
前記アドレス放電における該第２の放電維持電極の電位
と同電位であることを特徴とする請求項３乃至５記載の
表示駆動方法。 - 【請求項８】 複数の表示セルを構成する複数ラインの
放電維持電極を備えた平面型表示装置の表示駆動方法で
あって、 該複数の表示セルに対し、アドレスデータに応じて選択
的に壁電荷を生成するためのアドレス放電を実施するア
ドレス期間と、 該アドレス期間において選択的に壁電荷を生成した表示
セルに対し、放電発光を行うための維持放電を実施する
維持放電期間とを含み、 該アドレス期間は、該放電維持電極に放電開始電圧を越
える書込みパルスを与える全面書込みのステップと、該
全面書込みのステップ終了時の電位状態から、時間に対
して印加電圧が変化する消去パルスを該放電維持電極に
対して印加する全面消去のステップとを、前記アドレス
放電に先立って有することにより、前記アドレス放電に
有効な壁電荷を残留させることを特徴とする表示駆動方
法。 - 【請求項９】 前記放電維持電極はライン毎に第１及び
第２の放電維持電極を具備しており、前記全面消去のス
テップにおいて、該第１及び第２の放電維持電極間の電
位差が０〔Ｖ〕となる電位を経由することを特徴とする
請求項８記載の表示駆動方法。 - 【請求項１０】 前記放電維持電極はライン毎に第１及
び第２の放電維持電極を具備しており、前記時間に対し
て印加電圧が変化する消去パルスは該第１の放電維持電
極に印加されるものであり、前記全面消去のステップ終
了時において、該第１の放電維持電極の電位は、前記ア
ドレス放電における該第１の放電維持電極の選択電位と
同電位であることを特徴とする請求項８記載の表示駆動
方法。 - 【請求項１１】 前記放電維持電極はライン毎に第１及
び第２の放電維持電極を具備しており、前記時間に対し
て印加電圧が変化する消去パルスは該第１の放電維持電
極に印加されるものであり、前記全面消去のステップ終
了時において、該第２の放電維持電極の電位は、前記ア
ドレス放電における該第２の放電維持電極の電位と同電
位であることを特徴とする請求項８記載の表示駆動方
法。
Priority Applications (3)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5104087A JP3025598B2 (ja) | 1993-04-30 | 1993-04-30 | 表示駆動装置及び表示駆動方法 |
| FR9400941A FR2704674B1 (fr) | 1993-04-30 | 1994-01-28 | Contrôleur d'un panneau d'affichage plasma et procédé de commande d'un tel panneau. |
| US08/618,270 US5663741A (en) | 1993-04-30 | 1996-03-18 | Controller of plasma display panel and method of controlling the same |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5104087A JP3025598B2 (ja) | 1993-04-30 | 1993-04-30 | 表示駆動装置及び表示駆動方法 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH06314078A JPH06314078A (ja) | 1994-11-08 |
| JP3025598B2 true JP3025598B2 (ja) | 2000-03-27 |
Family
ID=14371348
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP5104087A Expired - Lifetime JP3025598B2 (ja) | 1993-04-30 | 1993-04-30 | 表示駆動装置及び表示駆動方法 |
Country Status (3)
| Country | Link |
|---|---|
| US (1) | US5663741A (ja) |
| JP (1) | JP3025598B2 (ja) |
| FR (1) | FR2704674B1 (ja) |
Families Citing this family (329)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6861803B1 (en) * | 1992-01-28 | 2005-03-01 | Fujitsu Limited | Full color surface discharge type plasma display device |
| US5656893A (en) * | 1994-04-28 | 1997-08-12 | Matsushita Electric Industrial Co., Ltd. | Gas discharge display apparatus |
| US5969478A (en) * | 1994-04-28 | 1999-10-19 | Matsushita Electronics Corporation | Gas discharge display apparatus and method for driving the same |
| RU2089966C1 (ru) * | 1995-11-22 | 1997-09-10 | Научно-производственная компания "Орион-Плазма" - Совместная акционерная компания закрытого типа | Газоразрядная индикаторная панель переменного тока с реверсивным поверхностным разрядом |
| US5745086A (en) * | 1995-11-29 | 1998-04-28 | Plasmaco Inc. | Plasma panel exhibiting enhanced contrast |
| FR2744275B1 (fr) * | 1996-01-30 | 1998-03-06 | Thomson Csf | Procede de commande d'un panneau de visualisation et dispositif de visualisation utilisant ce procede |
| SG64446A1 (en) * | 1996-10-08 | 1999-04-27 | Hitachi Ltd | Plasma display driving apparatus of plasma display panel and driving method thereof |
| KR100230437B1 (ko) | 1997-04-22 | 1999-11-15 | 손욱 | 면 방전형 교류 플라즈마 표시 패널의 구동 방법 |
| JP3406508B2 (ja) | 1998-03-27 | 2003-05-12 | シャープ株式会社 | 表示装置および表示方法 |
| JP4210805B2 (ja) | 1998-06-05 | 2009-01-21 | 株式会社日立プラズマパテントライセンシング | ガス放電デバイスの駆動方法 |
| JP3424587B2 (ja) | 1998-06-18 | 2003-07-07 | 富士通株式会社 | プラズマディスプレイパネルの駆動方法 |
| JP3556097B2 (ja) * | 1998-06-30 | 2004-08-18 | 富士通株式会社 | プラズマディスプレイパネル駆動方法 |
| KR100388901B1 (ko) * | 1998-07-29 | 2003-08-19 | 삼성에스디아이 주식회사 | 플라즈마 표시 패널의 리셋팅 방법 |
| CN100367330C (zh) | 1998-09-04 | 2008-02-06 | 松下电器产业株式会社 | 等离子体显示板驱动方法及离子体显示板装置 |
| JP3175711B2 (ja) * | 1998-10-16 | 2001-06-11 | 日本電気株式会社 | 交流放電メモリ動作型プラズマディスプレイパネルの駆動方法 |
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