JP2012120158A - 画像出力装置、画像出力方法、画像処理装置、画像処理方法、プログラム、データ構造、および撮像装置 - Google Patents
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Abstract
【解決手段】本技術は、ペイロードに含まれる画素データが1フレームの先頭ラインの画素データであるのか否かを表す第1のフレーム情報と、ペイロードに含まれる画素データが1フレームの終端ラインの画素データであるのか否かを表す第2のフレーム情報と、ペイロードに含まれる画素データが有効画素のデータであるのか否かを表す第1のライン情報と、ペイロードに含まれる画素データからなるラインのライン番号を表す第2のライン情報とからなるヘッダ情報と、ヘッダ情報の誤り検出に用いられる誤り検出符号とが含まれるヘッダを生成し、撮像によって得られた画像を構成する1ライン分の画素データをペイロードに含み、ヘッダが付加されたパケットを生成し、パケットを出力するものである。本技術は、イメージセンサとDSPを有する撮像装置に適用することができる。
【選択図】図4
Description
1.第1の実施の形態(画素データを伝送する例)
2.第2の実施の形態(画素データに限らず、所定のデータを伝送する例)
[伝送システムの構成例]
図1は、本技術の一実施形態に係る伝送システムの第1の構成例を示す図である。
図4は、イメージセンサ11−DSP12間で1フレームの画像データを伝送するのに用いられるフォーマットの例を示す図である。
図5は、送信部22と受信部31の構成例を示す図である。
はじめに、送信部22のリンクレイヤの構成について説明する。
次に、送信部22の物理レイヤの構成について説明する。
次に、受信部31の物理レイヤの構成について説明する。
次に、受信部31のリンクレイヤの構成について説明する。
次に、以上のような構成を有する送信部22と受信部31の一連の処理について説明する。
各レーンにおいて同じ制御コードを同じタイミングで伝送することは、通常のデータ伝送時だけでなく、例えばレーン数を切り替える場合にも行われる。レーン数を切り替える場合においても、アクティブなレーン(データ伝送に用いられるレーン)の状態は全て同じ状態になる。
図30は、イメージセンサ11−DSP12間のデータ伝送に用いられるフレームフォーマットの他の例を示す図である。上述した説明と重複する説明については適宜省略する。
図33は、撮像部21の構成例を示す図である。撮像部21は、制御部201、画素アレイ部211、選択部212、ADC(Analog Digital Converter)213、および定電流回路部214から構成される。
ここで、撮像部21による画素データの読み出しについて説明する。画素データの読み出しは行方向に並ぶ画素単位(ライン単位)で行われる。画素222を含むラインをN行目のライン、画素221を含むラインをN+1行目のラインとして説明する。
同じ位置の画素のデータとして複数のデータを取得し、画素データの種類の識別情報を画素データとともにDSP12側に伝送することによって各種の機能を実現することが可能になる。
図36は、撮像部21の他の構成例を示す図である。図36の撮像部21からは、各ラインのDATA1の画素データとして低ゲインの画素データが出力され、DATA2の画素データとして高ゲインの画素データが出力される。すなわち、DAC242とDAC252にはそれぞれ異なるゲインが設定されており、各画素から出力された画素信号のA/D変換が異なるゲインを用いて行われる。
DAC242とDAC252のA/D変換の分解能をそれぞれ異なるものとし、各画素から出力された画素信号をビット数の異なるデータに変換するようにしてもよい。撮像部21からは、各ラインのDATA1の画素データとして12bitなどのビット数の少ない画素データが出力され、DATA2の画素データとして14bitなどのビット数の多い画素データが出力されることになる。
図38は、撮像部21の他の構成例を示す図である。図38の撮像部21は、いわゆる縦分光型のイメージセンサである。画素アレイ部211を構成する各画素は、画素の厚み方向(光が入射する方向)にRGBのそれぞれのセンサが積層して配置されることによって構成される。
図41は、画素アレイ部211を構成する画素の例を示す図である。図41に示す各画素はハニカム構造の画素であり、各画素は、感度とダイナミックレンジが異なるR画素とS画素から構成される。
図43は、イメージセンサ11の構成例を示す図である。
図46は、Line Numberの使用例を示す図である。図46に示すように、N行目の画素データをペイロードに格納するパケットのLine Numberにはそのことを表す値が設定され、N+1行目の画素データをペイロードに格納するパケットのLine Numberにはそのことを表す値が設定される。N+2行目の画素データをペイロードに格納するパケットのLine Numberにはそのことを表す値が設定され、N+3行目の画素データをペイロードに格納するパケットのLine Numberにはそのことを表す値が設定される。
上述した複数のレーンを使ったチップ間のデータ伝送は、画像データだけでなく各種のデータの伝送にも用いることができる。
図47は、汎用I/Fを用いた伝送システムの第1の構成例を示す図である。
図50A乃至Dは、データ伝送に用いられるパケットのデータ構造の例を示す図である。
図51は、送信側LSI311と受信側LSI312の構成例を示す図である。
送信側LSI311のアダプテーションレイヤの構成について説明する。送信部322は、ペイロードデータ生成部351をアダプテーションレイヤの構成として有する。
送信部322は、Byte Packing部362、ペイロードECC挿入部363、パケット生成部364、およびレーン分配部365をリンクレイヤの構成として有する。
送信部322は、PHY-TX状態制御部381、クロック生成部382、信号処理部383−0乃至383−Nを物理レイヤの構成として有する。送信部322の物理レイヤの構成は、図5を参照して説明したCIS-IFにおける送信部22の物理レイヤの構成と同じ構成である。重複する説明については適宜省略する。
次に、受信側LSI312の受信部331の物理レイヤの構成について説明する。受信部331は、PHY-RX状態制御部401、信号処理部402−0乃至402−Nを物理レイヤの構成として有する。受信部331の物理レイヤの構成は、図5を参照して説明したCIS-IFにおける受信部31の物理レイヤの構成と同じ構成である。重複する説明については適宜省略する。
受信部331は、レーン統合部422、パケット分離部423、ペイロードエラー訂正部424、およびByte Unpacking部425をリンクレイヤの構成として有する。
受信部331は、ペイロードデータ取得部431をアダプテーションレイヤの構成として有する。ペイロードデータ取得部431は、Byte Unpacking部425から供給されたデータを取得し、送信側LSI311においてデータ入力部342からペイロードデータ生成部351に入力されたデータのビット幅と同じビット幅の単位で情報処理部332に出力する。
次に、以上のような構成を有する送信側LSI311と受信側LSI312の一連の処理について説明する。
CIS IFによるデータ伝送と汎用 IFによるデータ伝送の両方のデータ伝送に対応した送信部を送信側のLSIに設け、受信部を受信側のLSIに設けるようにしてもよい。
上述した一連の処理は、ハードウェアにより実行することもできるし、ソフトウェアにより実行することもできる。一連の処理をソフトウェアにより実行する場合には、そのソフトウェアを構成するプログラムが、専用のハードウェアに組み込まれているコンピュータ、または汎用のパーソナルコンピュータなどに、プログラム記録媒体からインストールされる。
本技術は、以下のような構成をとることもできる。
撮像部と、
ペイロードに含まれる画素データが1フレームの先頭ラインの画素データであるのか否かを表す第1のフレーム情報と、ペイロードに含まれる画素データが1フレームの終端ラインの画素データであるのか否かを表す第2のフレーム情報と、ペイロードに含まれる画素データが有効画素のデータであるのか否かを表す第1のライン情報と、ペイロードに含まれる画素データからなるラインのライン番号を表す第2のライン情報とからなるヘッダ情報と、前記ヘッダ情報の誤り検出に用いられる誤り検出符号とが含まれるヘッダを生成するヘッダ生成部と、
前記撮像部による撮像によって得られた画像を構成する1ライン分の画素データをペイロードに含み、前記ヘッダが付加されたパケットを生成するパケット生成部と、
前記パケット生成部により生成された前記パケットを画像処理装置に出力する出力部と
を備える画像出力装置。
前記第1のフレーム情報、前記第2のフレーム情報、および前記第1のライン情報は、それぞれ1ビットの情報であり、
前記第2のライン情報は、13ビットの情報である
前記(1)に記載の画像出力装置。
前記ヘッダ生成部は、前記ヘッダ情報と前記誤り検出符号との組を複数含む前記ヘッダを生成する
前記(1)または(2)に記載の画像出力装置。
前記パケット生成部により生成された前記パケットの先頭に、パケットの開始位置を表す開始コードを付加し、前記パケットの末尾に、パケットの終了位置を表す終了コードを付加する付加部をさらに備える
前記(1)乃至(3)のいずれかに記載の画像出力装置。
前記付加部は、前記画像出力装置と前記画像処理装置の間の伝送路のデータの伝送レートが、前記撮像部が出力する前記画素データの伝送レートより大きい場合、パディングコードを前記パケットのペイロードに付加する
前記(4)に記載の画像出力装置。
前記付加部は、複数の前記伝送路を介して伝送されてきた前記パケットのデータの同期を確保するために前記画像処理装置において用いられるスキューコードを前記終了コードに続けて付加し、
前記出力部は、前記開始コード、前記終了コード、前記スキューコードが少なくとも付加された前記パケットのデータを、複数の前記伝送路を用いて同時に前記画像処理装置に出力する
前記(4)または前記(5)に記載の画像出力装置。
前記付加部は、所定の数のビットの並びから構成される既知の情報である複数のシンボルのうち、
3種類の前記シンボルを4つ組み合わせることによって前記開始コードと前記終了コードを生成して前記パケットに付加し、
4種類の前記シンボルを4つ組み合わせることによって前記パディングコードを生成して前記パケットのペイロードに付加し、
所定の前記シンボルを2つ組み合わせることによって前記スキューコードを生成して前記パケットに付加する
前記(6)に記載の画像出力装置。
前記付加部は、前記開始コード、前記終了コード、および前記スキューコードを、同じ種類の前記シンボルを少なくとも1つ含むように生成する
前記(7)に記載の画像出力装置。
前記パケット生成部により生成された前記パケットのデータを複数の前記伝送路に割り当てる分配部をさらに備え、
前記付加部と前記出力部は、複数の前記伝送路に対応して、前記伝送路の数と同じ数だけ設けられる
前記(6)に記載の画像出力装置。
前記撮像部は、同じ位置の画素のデータとして複数の画素データを出力し、
前記ヘッダ生成部は、ペイロードに含まれる画素データの識別情報をさらに含む前記ヘッダを生成する
前記(1)乃至(9)のいずれかに記載の画像出力装置。
前記撮像部は、異なるゲインを用いてA/D変換を行うことによって得られた複数の画素データ、異なる分解能でA/D変換を行うことによって得られた複数の画素データ、異なるシャッタスピードで露光を行うことによって得られた複数の画素データ、縦分光型の配置を有する画素によって得られた複数の画素データ、または、同じ位置の画素が感度の異なる複数の画素からなる場合にそれぞれの画素から得られた複数の画素データを出力する
前記(10)に記載の画像出力装置。
前記ヘッダ生成部は、ペイロードに含まれる画素データが得られた前記撮像部の領域の識別情報をさらに含む前記ヘッダを生成する
前記(1)乃至(11)のいずれかに記載の画像出力装置。
撮像し、
ペイロードに含まれる画素データが1フレームの先頭ラインの画素データであるのか否かを表す第1のフレーム情報と、ペイロードに含まれる画素データが1フレームの終端ラインの画素データであるのか否かを表す第2のフレーム情報と、ペイロードに含まれる画素データが有効画素のデータであるのか否かを表す第1のライン情報と、ペイロードに含まれる画素データからなるラインのライン番号を表す第2のライン情報とからなるヘッダ情報と、前記ヘッダ情報の誤り検出に用いられる誤り検出符号とが含まれるヘッダを生成し、
撮像によって得られた画像を構成する1ライン分の画素データをペイロードに含み、前記ヘッダが付加されたパケットを生成し、
生成した前記パケットを画像処理装置に出力する
ステップを含む画像出力方法。
撮像し、
ペイロードに含まれる画素データが1フレームの先頭ラインの画素データであるのか否かを表す第1のフレーム情報と、ペイロードに含まれる画素データが1フレームの終端ラインの画素データであるのか否かを表す第2のフレーム情報と、ペイロードに含まれる画素データが有効画素のデータであるのか否かを表す第1のライン情報と、ペイロードに含まれる画素データからなるラインのライン番号を表す第2のライン情報とからなるヘッダ情報と、前記ヘッダ情報の誤り検出に用いられる誤り検出符号とが含まれるヘッダを生成し、
撮像によって得られた画像を構成する1ライン分の画素データをペイロードに含み、前記ヘッダが付加されたパケットを生成し、
生成した前記パケットを画像処理装置に出力する
ステップを含む処理をコンピュータに実行させるプログラム。
撮像して得られた画像を構成する1ライン分の画素データを含むデータの伝送に用いられる伝送データのデータ構造であって、
パケットの先頭に付加された、前記パケットの開始位置を表す開始コードと、
ペイロードに含まれる画素データが1フレームの先頭ラインの画素データであるのか否かを表す第1のフレーム情報と、ペイロードに含まれる画素データが1フレームの終端ラインの画素データであるのか否かを表す第2のフレーム情報と、ペイロードに含まれる画素データが有効画素のデータであるのか否かを表す第1のライン情報と、ペイロードに含まれる画素データからなるラインのライン番号を表す第2のライン情報とからなるヘッダ情報と、前記ヘッダ情報の誤り検出に用いられる誤り検出符号とが含まれるヘッダが、撮像して得られた画像を構成する1ライン分の画素データを含むペイロードに付加された前記パケットと、
前記パケットの末尾に付加された、パケットの終了位置を表す終了コードと、
前記終了コードに続けて付加された、前記パケットのデータの同期を確保するために前記パケットのデータを受信した画像処理装置において用いられるスキューコードと
からなる伝送データのデータ構造。
同じ機器内に設けられる画像出力装置において生成され、前記画像出力装置から出力された、ペイロードに含まれる画素データが1フレームの先頭ラインの画素データであるのか否かを表す第1のフレーム情報と、ペイロードに含まれる画素データが1フレームの終端ラインの画素データであるのか否かを表す第2のフレーム情報と、ペイロードに含まれる画素データが有効画素のデータであるのか否かを表す第1のライン情報と、ペイロードに含まれる画素データからなるラインのライン番号を表す第2のライン情報とからなるヘッダ情報と、前記ヘッダ情報の誤り検出に用いられる誤り検出符号とが含まれるヘッダが、前記画像出力装置の撮像部による撮影によって得られた画像を構成する1ライン分の画素データを含むペイロードに付加されたパケットを受信する受信部と、
前記受信部により受信された前記パケットのペイロードに含まれる前記画素データからなるラインから構成される前記画像を処理する画像処理部と
を備える画像処理装置。
前記ヘッダには、前記ヘッダ情報と前記誤り検出符号との組が複数含まれており、
それぞれの組を対象として、前記ヘッダ情報の誤りをその前記ヘッダ情報と同じ組を構成する前記誤り検出符号に基づいて検出する誤り検出部と、
前記誤り検出部により誤りが検出されなかった前記ヘッダ情報に基づいて、ペイロードに含まれる前記画素データからなる1フレームの前記画像を生成する生成部と
をさらに備え、
前記画像処理部は、前記生成部により生成された前記画像を処理する
前記(16)に記載の画像処理装置。
前記パケットの先頭には、パケットの開始位置を表す開始コードが付加され、前記パケットの末尾には、パケットの終了位置を表す終了コードが付加されており、
前記受信部は、前記開始コードを受信してから前記終了コードを受信するまでのデータを前記パケットのデータとして受信する
前記(16)または前記(17)に記載の画像処理装置。
前記開始コードと前記終了コードを除去するとともに、前記画像出力装置と前記画像処理装置の間の伝送路の伝送レートが、前記画像出力装置の前記撮像部が出力する前記画像の画素データの伝送レートより大きい場合に前記画像出力装置において前記パケットのペイロードに付加されたパディングコードを除去する除去部をさらに備える
前記(18)に記載の画像処理装置。
前記画像出力装置においては、前記終了コードに続けてスキューコードが付加され、前記開始コード、前記終了コード、前記スキューコードが少なくとも付加された前記パケットのデータが、複数の前記伝送路を用いて同時に出力され、
前記受信部により受信されたデータの受信タイミングのずれを、前記スキューコードに基づいて補正する補正部をさらに備え、
前記受信部と前記補正部と前記除去部は、複数の前記伝送路に対応して、前記伝送路の数と同じ数だけ設けられる
前記(18)または前記(19)に記載の画像処理装置。
前記画像出力装置においては、所定の数のビットの並びから構成される既知の情報である複数のシンボルのうち、
3種類の前記シンボルを4つ組み合わせることによって前記開始コードと前記終了コードが生成されて前記パケットに付加され、
4種類の前記シンボルを4つ組み合わせることによって前記パディングコードが生成されて前記パケットのペイロードに付加され、
所定の前記シンボルを2つ組み合わせることによって前記スキューコードが生成されて前記パケットに付加される
前記(20)に記載の画像処理装置。
前記画像出力装置においては、前記開始コード、前記終了コード、および前記スキューコードが、同じ種類の前記シンボルを少なくとも1つ含むようにして生成される
前記(20)または前記(21)に記載の画像処理装置。
前記受信部は、ペイロードに含まれる画素データの識別情報を含む前記ヘッダが付加された前記パケットを受信し、
前記画像処理部は、同じ前記識別情報を含む前記ヘッダが付加されたペイロードに含まれる前記画素データを合成することによって前記画像を生成する
前記(16)乃至前記(22)のいずれかに記載の画像処理装置。
前記受信部は、ペイロードに含まれる画素データが得られた前記撮像部の領域の識別情報を含む前記ヘッダを受信し、
前記画像処理部は、同じ前記識別情報を含む前記ヘッダが付加されたペイロードに含まれる前記画素データを合成することによって前記画像を生成する
前記(16)乃至前記(23)のいずれかに記載の画像処理装置。
同じ機器内に設けられる画像出力装置において生成され、前記画像出力装置から出力された、ペイロードに含まれる画素データが1フレームの先頭ラインの画素データであるのか否かを表す第1のフレーム情報と、ペイロードに含まれる画素データが1フレームの終端ラインの画素データであるのか否かを表す第2のフレーム情報と、ペイロードに含まれる画素データが有効画素のデータであるのか否かを表す第1のライン情報と、ペイロードに含まれる画素データからなるラインのライン番号を表す第2のライン情報とからなるヘッダ情報と、前記ヘッダ情報の誤り検出に用いられる誤り検出符号とが含まれるヘッダが、前記画像出力装置の撮像部による撮影によって得られた画像を構成する1ライン分の画素データを含むペイロードに付加されたパケットを受信し、
受信した前記パケットのペイロードに含まれる前記画素データからなるラインから構成される前記画像を処理する
ステップを含む画像処理方法。
同じ機器内に設けられる画像出力装置において生成され、前記画像出力装置から出力された、ペイロードに含まれる画素データが1フレームの先頭ラインの画素データであるのか否かを表す第1のフレーム情報と、ペイロードに含まれる画素データが1フレームの終端ラインの画素データであるのか否かを表す第2のフレーム情報と、ペイロードに含まれる画素データが有効画素のデータであるのか否かを表す第1のライン情報と、ペイロードに含まれる画素データからなるラインのライン番号を表す第2のライン情報とからなるヘッダ情報と、前記ヘッダ情報の誤り検出に用いられる誤り検出符号とが含まれるヘッダが、前記画像出力装置の撮像部による撮影によって得られた画像を構成する1ライン分の画素データを含むペイロードに付加されたパケットを受信し、
受信した前記パケットのペイロードに含まれる前記画素データからなるラインから構成される前記画像を処理する
ステップを含む処理をコンピュータに実行させるプログラム。
画像出力装置と画像処理装置とを含む撮像装置であって、
前記画像出力装置は、
撮像部と、
ペイロードに含まれる画素データが1フレームの先頭ラインの画素データであるのか否かを表す第1のフレーム情報と、ペイロードに含まれる画素データが1フレームの終端ラインの画素データであるのか否かを表す第2のフレーム情報と、ペイロードに含まれる画素データが有効画素のデータであるのか否かを表す第1のライン情報と、ペイロードに含まれる画素データからなるラインのライン番号を表す第2のライン情報とからなるヘッダ情報と、前記ヘッダ情報の誤り検出に用いられる誤り検出符号とが含まれるヘッダを生成するヘッダ生成部と、
前記撮像部による撮像によって得られた画像を構成する1ライン分の画素データをペイロードに含み、前記ヘッダが付加されたパケットを生成するパケット生成部と、
前記パケット生成部により生成された前記パケットを前記画像処理装置に出力する出力部と
を備え、
前記画像処理装置は、
前記パケットを受信する受信部と、
前記受信部により受信された前記パケットのペイロードに含まれる前記画素データからなるラインから構成される前記画像を処理する画像処理部と
を備える
撮像装置。
Claims (27)
- 撮像部と、
ペイロードに含まれる画素データが1フレームの先頭ラインの画素データであるのか否かを表す第1のフレーム情報と、ペイロードに含まれる画素データが1フレームの終端ラインの画素データであるのか否かを表す第2のフレーム情報と、ペイロードに含まれる画素データが有効画素のデータであるのか否かを表す第1のライン情報と、ペイロードに含まれる画素データからなるラインのライン番号を表す第2のライン情報とからなるヘッダ情報と、前記ヘッダ情報の誤り検出に用いられる誤り検出符号とが含まれるヘッダを生成するヘッダ生成部と、
前記撮像部による撮像によって得られた画像を構成する1ライン分の画素データをペイロードに含み、前記ヘッダが付加されたパケットを生成するパケット生成部と、
前記パケット生成部により生成された前記パケットを画像処理装置に出力する出力部と
を備える画像出力装置。 - 前記第1のフレーム情報、前記第2のフレーム情報、および前記第1のライン情報は、それぞれ1ビットの情報であり、
前記第2のライン情報は、13ビットの情報である
請求項1に記載の画像出力装置。 - 前記ヘッダ生成部は、前記ヘッダ情報と前記誤り検出符号との組を複数含む前記ヘッダを生成する
請求項1に記載の画像出力装置。 - 前記パケット生成部により生成された前記パケットの先頭に、パケットの開始位置を表す開始コードを付加し、前記パケットの末尾に、パケットの終了位置を表す終了コードを付加する付加部をさらに備える
請求項1に記載の画像出力装置。 - 前記付加部は、前記画像出力装置と前記画像処理装置の間の伝送路のデータの伝送レートが、前記撮像部が出力する前記画素データの伝送レートより大きい場合、パディングコードを前記パケットのペイロードに付加する
請求項4に記載の画像出力装置。 - 前記付加部は、複数の前記伝送路を介して伝送されてきた前記パケットのデータの同期を確保するために前記画像処理装置において用いられるスキューコードを前記終了コードに続けて付加し、
前記出力部は、前記開始コード、前記終了コード、前記スキューコードが少なくとも付加された前記パケットのデータを、複数の前記伝送路を用いて同時に前記画像処理装置に出力する
請求項5に記載の画像出力装置。 - 前記付加部は、所定の数のビットの並びから構成される既知の情報である複数のシンボルのうち、
3種類の前記シンボルを4つ組み合わせることによって前記開始コードと前記終了コードを生成して前記パケットに付加し、
4種類の前記シンボルを4つ組み合わせることによって前記パディングコードを生成して前記パケットのペイロードに付加し、
所定の前記シンボルを2つ組み合わせることによって前記スキューコードを生成して前記パケットに付加する
請求項6に記載の画像出力装置。 - 前記付加部は、前記開始コード、前記終了コード、および前記スキューコードを、同じ種類の前記シンボルを少なくとも1つ含むように生成する
請求項7に記載の画像出力装置。 - 前記パケット生成部により生成された前記パケットのデータを複数の前記伝送路に割り当てる分配部をさらに備え、
前記付加部と前記出力部は、複数の前記伝送路に対応して、前記伝送路の数と同じ数だけ設けられる
請求項6に記載の画像出力装置。 - 前記撮像部は、同じ位置の画素のデータとして複数の画素データを出力し、
前記ヘッダ生成部は、ペイロードに含まれる画素データの識別情報をさらに含む前記ヘッダを生成する
請求項1に記載の画像出力装置。 - 前記撮像部は、異なるゲインを用いてA/D変換を行うことによって得られた複数の画素データ、異なる分解能でA/D変換を行うことによって得られた複数の画素データ、異なるシャッタスピードで露光を行うことによって得られた複数の画素データ、縦分光型の配置を有する画素によって得られた複数の画素データ、または、同じ位置の画素が感度の異なる複数の画素からなる場合にそれぞれの画素から得られた複数の画素データを出力する
請求項10に記載の画像出力装置。 - 前記ヘッダ生成部は、ペイロードに含まれる画素データが得られた前記撮像部の領域の識別情報をさらに含む前記ヘッダを生成する
請求項1に記載の画像出力装置。 - 撮像し、
ペイロードに含まれる画素データが1フレームの先頭ラインの画素データであるのか否かを表す第1のフレーム情報と、ペイロードに含まれる画素データが1フレームの終端ラインの画素データであるのか否かを表す第2のフレーム情報と、ペイロードに含まれる画素データが有効画素のデータであるのか否かを表す第1のライン情報と、ペイロードに含まれる画素データからなるラインのライン番号を表す第2のライン情報とからなるヘッダ情報と、前記ヘッダ情報の誤り検出に用いられる誤り検出符号とが含まれるヘッダを生成し、
撮像によって得られた画像を構成する1ライン分の画素データをペイロードに含み、前記ヘッダが付加されたパケットを生成し、
生成した前記パケットを画像処理装置に出力する
ステップを含む画像出力方法。 - 撮像し、
ペイロードに含まれる画素データが1フレームの先頭ラインの画素データであるのか否かを表す第1のフレーム情報と、ペイロードに含まれる画素データが1フレームの終端ラインの画素データであるのか否かを表す第2のフレーム情報と、ペイロードに含まれる画素データが有効画素のデータであるのか否かを表す第1のライン情報と、ペイロードに含まれる画素データからなるラインのライン番号を表す第2のライン情報とからなるヘッダ情報と、前記ヘッダ情報の誤り検出に用いられる誤り検出符号とが含まれるヘッダを生成し、
撮像によって得られた画像を構成する1ライン分の画素データをペイロードに含み、前記ヘッダが付加されたパケットを生成し、
生成した前記パケットを画像処理装置に出力する
ステップを含む処理をコンピュータに実行させるプログラム。 - 撮像して得られた画像を構成する1ライン分の画素データを含むデータの伝送に用いられる伝送データのデータ構造であって、
パケットの先頭に付加された、前記パケットの開始位置を表す開始コードと、
ペイロードに含まれる画素データが1フレームの先頭ラインの画素データであるのか否かを表す第1のフレーム情報と、ペイロードに含まれる画素データが1フレームの終端ラインの画素データであるのか否かを表す第2のフレーム情報と、ペイロードに含まれる画素データが有効画素のデータであるのか否かを表す第1のライン情報と、ペイロードに含まれる画素データからなるラインのライン番号を表す第2のライン情報とからなるヘッダ情報と、前記ヘッダ情報の誤り検出に用いられる誤り検出符号とが含まれるヘッダが、撮像して得られた画像を構成する1ライン分の画素データを含むペイロードに付加された前記パケットと、
前記パケットの末尾に付加された、パケットの終了位置を表す終了コードと、
前記終了コードに続けて付加された、前記パケットのデータの同期を確保するために前記パケットのデータを受信した画像処理装置において用いられるスキューコードと
からなる伝送データのデータ構造。 - 同じ機器内に設けられる画像出力装置において生成され、前記画像出力装置から出力された、ペイロードに含まれる画素データが1フレームの先頭ラインの画素データであるのか否かを表す第1のフレーム情報と、ペイロードに含まれる画素データが1フレームの終端ラインの画素データであるのか否かを表す第2のフレーム情報と、ペイロードに含まれる画素データが有効画素のデータであるのか否かを表す第1のライン情報と、ペイロードに含まれる画素データからなるラインのライン番号を表す第2のライン情報とからなるヘッダ情報と、前記ヘッダ情報の誤り検出に用いられる誤り検出符号とが含まれるヘッダが、前記画像出力装置の撮像部による撮影によって得られた画像を構成する1ライン分の画素データを含むペイロードに付加されたパケットを受信する受信部と、
前記受信部により受信された前記パケットのペイロードに含まれる前記画素データからなるラインから構成される前記画像を処理する画像処理部と
を備える画像処理装置。 - 前記ヘッダには、前記ヘッダ情報と前記誤り検出符号との組が複数含まれており、
それぞれの組を対象として、前記ヘッダ情報の誤りをその前記ヘッダ情報と同じ組を構成する前記誤り検出符号に基づいて検出する誤り検出部と、
前記誤り検出部により誤りが検出されなかった前記ヘッダ情報に基づいて、ペイロードに含まれる前記画素データからなる1フレームの前記画像を生成する生成部と
をさらに備え、
前記画像処理部は、前記生成部により生成された前記画像を処理する
請求項16に記載の画像処理装置。 - 前記パケットの先頭には、パケットの開始位置を表す開始コードが付加され、前記パケットの末尾には、パケットの終了位置を表す終了コードが付加されており、
前記受信部は、前記開始コードを受信してから前記終了コードを受信するまでのデータを前記パケットのデータとして受信する
請求項16に記載の画像処理装置。 - 前記開始コードと前記終了コードを除去するとともに、前記画像出力装置と前記画像処理装置の間の伝送路の伝送レートが、前記画像出力装置の前記撮像部が出力する前記画像の画素データの伝送レートより大きい場合に前記画像出力装置において前記パケットのペイロードに付加されたパディングコードを除去する除去部をさらに備える
請求項18に記載の画像処理装置。 - 前記画像出力装置においては、前記終了コードに続けてスキューコードが付加され、前記開始コード、前記終了コード、前記スキューコードが少なくとも付加された前記パケットのデータが、複数の前記伝送路を用いて同時に出力され、
前記受信部により受信されたデータの受信タイミングのずれを、前記スキューコードに基づいて補正する補正部をさらに備え、
前記受信部と前記補正部と前記除去部は、複数の前記伝送路に対応して、前記伝送路の数と同じ数だけ設けられる
請求項18に記載の画像処理装置。 - 前記画像出力装置においては、所定の数のビットの並びから構成される既知の情報である複数のシンボルのうち、
3種類の前記シンボルを4つ組み合わせることによって前記開始コードと前記終了コードが生成されて前記パケットに付加され、
4種類の前記シンボルを4つ組み合わせることによって前記パディングコードが生成されて前記パケットのペイロードに付加され、
所定の前記シンボルを2つ組み合わせることによって前記スキューコードが生成されて前記パケットに付加される
請求項20に記載の画像処理装置。 - 前記画像出力装置においては、前記開始コード、前記終了コード、および前記スキューコードが、同じ種類の前記シンボルを少なくとも1つ含むようにして生成される
請求項21に記載の画像処理装置。 - 前記受信部は、ペイロードに含まれる画素データの識別情報を含む前記ヘッダが付加された前記パケットを受信し、
前記画像処理部は、同じ前記識別情報を含む前記ヘッダが付加されたペイロードに含まれる前記画素データを合成することによって前記画像を生成する
請求項16に記載の画像処理装置。 - 前記受信部は、ペイロードに含まれる画素データが得られた前記撮像部の領域の識別情報を含む前記ヘッダを受信し、
前記画像処理部は、同じ前記識別情報を含む前記ヘッダが付加されたペイロードに含まれる前記画素データを合成することによって前記画像を生成する
請求項16に記載の画像処理装置。 - 同じ機器内に設けられる画像出力装置において生成され、前記画像出力装置から出力された、ペイロードに含まれる画素データが1フレームの先頭ラインの画素データであるのか否かを表す第1のフレーム情報と、ペイロードに含まれる画素データが1フレームの終端ラインの画素データであるのか否かを表す第2のフレーム情報と、ペイロードに含まれる画素データが有効画素のデータであるのか否かを表す第1のライン情報と、ペイロードに含まれる画素データからなるラインのライン番号を表す第2のライン情報とからなるヘッダ情報と、前記ヘッダ情報の誤り検出に用いられる誤り検出符号とが含まれるヘッダが、前記画像出力装置の撮像部による撮影によって得られた画像を構成する1ライン分の画素データを含むペイロードに付加されたパケットを受信し、
受信した前記パケットのペイロードに含まれる前記画素データからなるラインから構成される前記画像を処理する
ステップを含む画像処理方法。 - 同じ機器内に設けられる画像出力装置において生成され、前記画像出力装置から出力された、ペイロードに含まれる画素データが1フレームの先頭ラインの画素データであるのか否かを表す第1のフレーム情報と、ペイロードに含まれる画素データが1フレームの終端ラインの画素データであるのか否かを表す第2のフレーム情報と、ペイロードに含まれる画素データが有効画素のデータであるのか否かを表す第1のライン情報と、ペイロードに含まれる画素データからなるラインのライン番号を表す第2のライン情報とからなるヘッダ情報と、前記ヘッダ情報の誤り検出に用いられる誤り検出符号とが含まれるヘッダが、前記画像出力装置の撮像部による撮影によって得られた画像を構成する1ライン分の画素データを含むペイロードに付加されたパケットを受信し、
受信した前記パケットのペイロードに含まれる前記画素データからなるラインから構成される前記画像を処理する
ステップを含む処理をコンピュータに実行させるプログラム。 - 画像出力装置と画像処理装置とを含む撮像装置であって、
前記画像出力装置は、
撮像部と、
ペイロードに含まれる画素データが1フレームの先頭ラインの画素データであるのか否かを表す第1のフレーム情報と、ペイロードに含まれる画素データが1フレームの終端ラインの画素データであるのか否かを表す第2のフレーム情報と、ペイロードに含まれる画素データが有効画素のデータであるのか否かを表す第1のライン情報と、ペイロードに含まれる画素データからなるラインのライン番号を表す第2のライン情報とからなるヘッダ情報と、前記ヘッダ情報の誤り検出に用いられる誤り検出符号とが含まれるヘッダを生成するヘッダ生成部と、
前記撮像部による撮像によって得られた画像を構成する1ライン分の画素データをペイロードに含み、前記ヘッダが付加されたパケットを生成するパケット生成部と、
前記パケット生成部により生成された前記パケットを前記画像処理装置に出力する出力部と
を備え、
前記画像処理装置は、
前記パケットを受信する受信部と、
前記受信部により受信された前記パケットのペイロードに含まれる前記画素データからなるラインから構成される前記画像を処理する画像処理部と
を備える
撮像装置。
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