JP2011180891A - 半導体集積回路 - Google Patents
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Abstract
【解決手段】レギュレータ10は、第1の電源ピン1に第1の外部電源の電圧V1の供給を受けて、第1の動作電源の電圧V3を生成し、第1の電源配線4を経由して第1の内部回路20に供給する。第1の動作電源の電圧V3と等しい電圧の第2の動作電源の電圧V2は、第2の電源ピン3から供給を受けて、第2の電源配線5を経由して第2の内部回路30に供給される。第1の電源配線4と第2の電源配線5との間をスイッチ回路40で接続する。通常動作時は、制御回路50によってスイッチ回路40をオフに制御する。レギュレータ10が生成する第1の動作電源の電圧V3をモニタする時は、制御回路50によってスイッチ回路40をオンする。
【選択図】図1
Description
請求項2にかかる発明は、請求項1に記載の半導体集積回路において、前記制御回路が、前記第1の動作電源の電圧をモニタする試験状態を示す信号が入力されたときに、前記スイッチ回路をオン状態に制御することを特徴とする。
請求項3にかかる発明は、請求項1又は2に記載の半導体集積回路において、前記第1の動作電源の異常を検知したときに検知信号を生成して前記制御回路に入力する検知回路をさらに備え、前記制御回路が、前記検知信号が入力されたときに、前記スイッチ回路をオン状態に制御することを特徴とする。
請求項4にかかる発明は、請求項1ないし3のいずれかに記載の半導体集積回路において、前記第2の電源ピンに安定化容量が接続されていることを特徴とする。
V3=Vref ×(1+(R1/R2))
となり、第1の電源配線4に出力される。また、第2の電源ピン3に外部入力する第2の動作電源の電圧V2は、V2=V3であり、第2の電源配線5に供給される。
10:レギュレータ、11:演算増幅器
20:第1の内部回路
30:第2の内部回路
40:スイッチ回路
50:制御回路、51:制御端子
60:検知回路、61:基準電圧端子
Claims (4)
- 第1および第2の内部回路を有する半導体集積回路であって、
第1の外部電源の供給を受ける第1の電源ピンと、
前記第1の外部電源から第1の動作電源を生成するレギュレータと、
前記第1の動作電源を前記第1の内部回路に供給する第1の電源配線と、
前記第1の動作電源の電圧と同一電圧を有する第2の動作電源の供給を受ける第2の電源ピンと、
前記第2の動作電源を前記第2の内部回路に供給する第2の電源配線と、
オン状態において前記第1の電源配線と前記第2の電源配線とを相互に接続するスイッチ回路と、
前記第1の内部回路が前記第1の動作電源の供給を受けて動作する通常動作時に、前記スイッチ回路をオフ状態に制御する制御回路と、
を備えることを特徴とする半導体集積回路。 - 前記制御回路が、前記第1の動作電源の電圧をモニタする試験状態を示す信号が入力されたときに、前記スイッチ回路をオン状態に制御することを特徴とする請求項1に記載の半導体集積回路。
- 前記第1の動作電源の異常を検知したときに検知信号を生成して前記制御回路に入力する検知回路をさらに備え、
前記制御回路が、前記検知信号が入力されたときに、前記スイッチ回路をオン状態に制御することを特徴とする請求項1又は2に記載の半導体集積回路。 - 前記第2の電源ピンに安定化容量が接続されていることを特徴とする請求項1ないし3のいずれかに記載の半導体集積回路。
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