JP2008533513A - アクティブマトリクス配列装置 - Google Patents
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Abstract
Description
Claims (31)
- 個々にアドレス可能なマトリクス素子の配列と、該マトリクス素子へアドレス信号を供給するドライバ回路とを有し、
該ドライバ回路は、デジタル画素マトリクス素子信号をアナログ駆動レベルへ変換するデジタル−アナログ変換器回路構成を有し、
該デジタル−アナログ変換器回路構成は、前記デジタルマトリクス素子信号のビットの第1の組に基づいて一対の電圧を選択する電圧選択器と、前記一対の電圧から及び前記デジタルマトリクス素子信号のビットの第2の組から得られるアナログ電圧レベルを供給する変換器配置とを有し、
該変換器配置は、並列であって、交互に当該変換器配置の出力部へアナログ電圧レベルを供給するよう構成される第1及び第2のデジタル−アナログ変換器回路を有する、アクティブマトリクス配列装置。 - 夫々のデジタル−アナログ変換器回路は、
増幅器と、
該増幅器の入力部へ接続されるスイッチコンデンサ入力配置とを有し、
前記増幅器の出力部は、前記変換器配置の出力を供給する、請求項1記載の装置。 - 前記一対の電圧の夫々1つは、夫々の入力スイッチ配置を介して前記コンデンサ配置の各コンデンサの入力側へ結合され、
前記コンデンサ配置の各コンデンサの出力側は、前記増幅器の入力部へ結合される、請求項2記載の装置。 - 前記コンデンサ配置の各コンデンサの入力側は、夫々のフィードバックスイッチを介して前記増幅器の出力部へ結合される、請求項3記載の装置。
- 夫々のフィードバックスイッチは、同じタイミングで制御され、
前記フィードバックスイッチは、前記入力スイッチが開いている場合にのみ閉じられる、請求項4記載の装置。 - 個々にアドレス可能なマトリクス素子の配列と、該マトリクス素子へアドレス信号を供給するドライバ回路とを有し、
該ドライバ回路は、デジタル画素マトリクス素子信号をアナログ駆動レベルへ変換するデジタル−アナログ変換器回路構成を有し、
該デジタル−アナログ変換器回路構成は、前記デジタルマトリクス素子信号のビットの第1の組に基づいて一対の電圧を選択する電圧選択器と、前記一対の電圧から及び前記デジタルマトリクス素子信号のビットの第2の組から得られるアナログ電圧レベルを供給する変換器配置とを有し、
該変換器配置は、増幅器と、該増幅器の入力部へ接続されるスイッチコンデンサ入力配置とを有し、
前記増幅器の出力部は、前記変換器配置の出力を供給し、
前記コンデンサ配置の各コンデンサの入力側は、夫々のフィードバックスイッチを介して前記増幅器の出力側へ結合される、アクティブマトリクス配列装置。 - 前記変換器配置は、並列であって、交互に当該変換器配置の出力部へアナログ電圧レベルを供給するよう構成される第1及び第2のデジタル−アナログ変換器回路を有する、請求項6記載の装置。
- 前記一対の電圧の夫々1つは、夫々の入力スイッチ配置を介して前記コンデンサ配置の各コンデンサの入力側へ結合され、
前記コンデンサ配置の各コンデンサの出力側は、前記増幅器の入力部へ結合される、請求項6又は7記載の装置。 - 夫々のフィードバックスイッチは、同じタイミングで制御され、
前記フィードバックスイッチは、前記入力スイッチが開いている場合にのみ閉じられる、請求項8記載の装置。 - 夫々のデジタル−アナログ変換器回路は、充電モード及び出力モードの2つのモードで動作可能であり、
前記第1及び第2のデジタル−アナログ変換器回路の一方が前記充電モードで動作する場合に、他方は前記出力モードで動作する、請求項1乃至5又は7のうちいずれか一項記載の装置。 - 夫々のデジタル−アナログ変換器回路のモードは、少なくとも1つの夫々のクロック信号によって制御される、請求項10記載の装置。
- 前記第1及び第2のデジタル−アナログ変換器回路の対応するクロック信号は、重複しないハイレベルを有する、請求項11記載の装置。
- 前記変換器配置は、nが前記第2の組のビットの数である場合に、nビットのデジタル−アナログ変換用である、請求項1乃至12のうちいずれか一項記載の装置。
- 前記第1の組は、最上位のビットを有し、
前記第2の組は、前記デジタルマトリクス素子信号の最下位のビットを有する、請求項1乃至13のうちいずれか一項記載の装置。 - 前記デジタルマトリクス素子信号は6ビットであり、
前記第1及び第2の組は、夫々3ビットを有する、請求項14記載の装置。 - 前記デジタル−アナログ変換器回路構成は、複数の電圧選択器及び複数の変換器配置を有する、請求項1乃至15のうちいずれか一項記載の装置。
- 1つの電圧選択器及び1つの変換器配置は、複数のマトリクス素子へアナログ電圧レベルを供給するためであり、
当該装置は、更に、夫々の電圧選択器及び変換器配置に関して、前記複数のマトリクス素子の間のスイッチングのためのマルチプレクサ回路を有する、請求項16記載の装置。 - 前記一対の電圧は、抵抗器列の複数の出力電圧から選択される、請求項1乃至17のうちいずれか一項記載の装置。
- アクティブマトリクスディスプレイを有する、請求項1乃至18のうちいずれか一項記載の装置。
- LCDディスプレイを有する、請求項19記載の装置。
- 電界発光ディスプレイ有する、請求項19記載の装置。
- 前記ドライバ回路は、前記マトリクス素子の配列と同じ基板上に集積される、請求項1乃至21のうちいずれか一項記載の装置。
- 前記ドライバ回路は、低温ポリシリコン加工により実施される、請求項22記載の装置。
- デジタル信号をアナログ駆動レベルへ変換するデジタル−アナログ変換器回路構成であって、
前記デジタル信号のビットの第1の組に基づいて一対の電圧を選択する電圧選択器と、
前記一対の電圧から及び前記デジタルマトリクス素子信号のビットの第2の組から得られるアナログ電圧レベルを供給する変換器配置とを有し、
該変換器配置は、並列であって、交互に当該変換器配置の出力部へアナログ電圧レベルを供給するよう構成される第1及び第2のデジタル−アナログ変換器回路を有する、デジタル−アナログ変換器回路構成。 - 夫々のデジタル−アナログ変換器回路は、スイッチコンデンサ回路を有する、請求項24記載の回路構成。
- デジタル信号をアナログ駆動レベルへ変換するデジタル−アナログ変換器回路構成であって、
前記デジタル信号のビットの第1の組に基づいて一対の電圧を選択する電圧選択器と、
前記一対の電圧から及び前記デジタルマトリクス素子信号のビットの第2の組から得られるアナログ電圧レベルを供給する変換器配置とを有し、
該変換器配置は、増幅器と、該増幅器の入力部へ接続されるスイッチコンデンサ入力配置とを有し、
前記増幅器の出力部は、前記変換器配置の出力を供給し、
前記コンデンサ配置の各コンデンサの入力側は、夫々のフィードバックスイッチを介して前記増幅器の出力側へ結合される、デジタル−アナログ変換器回路構成。 - 個々にアドレス可能なマトリクス素子の配列を有するアクティブマトリクス配列装置の前記マトリクス素子へアドレス信号を供給する方法であって、
デジタルマトリクス素子信号のビットの第1の組に基づいて一対の電圧を選択するステップと、
前記一対の電圧から及び前記デジタルマトリクス素子信号のビットの第2の組から得られるアナログ電圧レベルを供給するステップとを有し、
前記アナログ電圧レベルは、並列な第1及び第2のデジタル−アナログ変換器回路によって交互に供給される、方法。 - 夫々のデジタル−アナログ変換器回路は、充電モード及び出力モードの2つのモードで動作し、
前記第1及び第2のデジタル−アナログ変換器回路の一方が前記充電モードで動作する場合に、他方は前記出力モードで動作する、請求項27記載の方法。 - 夫々の1又は複数のクロック信号によって各デジタル−アナログ変換器回路のモードを制御するステップを有する、請求項28記載の方法。
- 前記第1及び第2のデジタル−アナログ変換器回路の対応するクロック信号は、重複しないハイレベルを有する、請求項29記載の方法。
- 抵抗器列の複数の出力電圧から前記一対の電圧を選択するステップを有する、請求項27乃至30のうちいずれか一項記載の方法。
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