KR970051189A - 메모리의 데이타 읽기회로 - Google Patents

메모리의 데이타 읽기회로 Download PDF

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Abstract

본 발명은 메모리의 어드레싱(Addressing)된 데이터를 읽어낼 때의 읽기회로에 관한 것으로, 특히 메모리의 고집적화 추세와 그에 따른 저항성분 및 콘덴서 성분의 증가로 인한 메모리의 읽기동작 모드에서의 지연효과를 줄여 그로인한 어드레싱된 해당데이타의 출력시의 스피드 개선에 관한 메모리의 데이터 읽기회로에 관한 것이다.
센스엠프로부터 출력된 데이터를 입력받아 제어단자의 제어를 받아 반전출력하는 인버터부와, 상기 인버터부의 출력을 입력받고 제어단자의 제어를 받아 데이터버스 라인(DOUTB)을 전원전압(VCC)의 1/2로 미리 프리차지(Precharge)시키는 프리차지부와, 상기 프리차지부로 부터 발생된 데이터를 입력받아 증폭시키는 제1증폭부와, 입력단자가 상기 제1증폭부의 입력단자와 공통접속되어 상기 인버터부에서 발생된 신호를 입력받아 증폭시키는 제2증폭부와, 상기 제1증폭부와 제2증폭부에서 발생한 신호를 입력받아 증폭, 출력하는 출력버퍼부로 구성한다.

Description

메모리의 데이터 읽기회로
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제2도는 본 발명에 따른 데이터 읽기회로의 일 실시예를 나타낸 회로도.

Claims (7)

  1. 센스엠프로부터 출력된 데이터를 입력받아 반전출력하는 인버터부와, 상기 인버터부의 출력단자인 데이터버스라인(DOUTB)를 Vcc/2로 프리차지시키는 프리차지부와, 상기 인버터부에서 출력된 신호를 입력받아 증폭하는 제1증폭부와, 상기 제1증폭부의 입력단자와 공통 접속되어 상기 인버터부에서 출력된 신호를 입력받아 증폭하는 제2증폭부와, 상기 제1 및 제2증폭부에서 증폭된 신호를 입력받아 반전증폭후 출력하는 출력버퍼부를 포함하는 것을 특징으로 하는 메모리의 데이터읽기 회로.
  2. 제1항에 있어서, 상기 제1증폭부는 상기 인버터부에서 출력된 1비트 데이터를 인가받아 증폭출력하는 제1차동 증폭부와, 상기 제1차동 증폭부에서 출력된 신호를 보다 더 빠르게 H레벨로 변환시키는 제1하이레벨 차지부를 포함하는 것을 특징으로 하는 메모리의 데이터읽기 회로.
  3. 제2항에 있어서, 상기 제1차동 증폭부는 다수개의 피모스트랜지스터와 엔모스 트랜지스터의 조합으로 구성된 커런트 미러형 미분증폭기를 포함하는 것을 특징으로 하는 메모리의 데이터 읽기 회로.
  4. 제2항에 있어서, 상기 제1하이레벨 차지부는 소오스전극이 전원전압에 접속되고 게이트전극이 제어단자 P3와 후술하는 전송게이트의 L측제어단자에 공통접속되고 드레인전극이 상기 제1차동증폭부의 피모스게이트의 드레인전극과 출력버퍼부의 인버터의 입력단자(DSB)에 공통접속되는 피모스트랜지스터와, 일측이 노드 X에 접속되고 타측이 상기 프리차지부의 출력단자(DOUTB)에 접속되며 L측제어단자는 상기 제1차동증폭부의 엔모스트랜지스터의 게이트전극에 접속되며 H측 제어단자는 제2증폭부의 인버터의 출력단자에 접속되는 전송게이트와, 일측이 노드 X에 접속되고 타측이 공통전위에 접속되는 콘덴서를 포함함을 특징으로 하는 메모리의 데이터 읽기 회로.
  5. 제1항에 있어서, 상기 제2증폭부는 상기 인버터부에서 발생된 신호를 인가받아 기준 전압단자에 인가된 기준전압(VREF)과의 차를 증폭하여 출력하는 제2차동 증폭부와, 상기 제2차동 증폭부에서 발생된 신호를 보다 빠르게 감지하여 출력버퍼부로 전달하는 제2항이레벨 차지부를 포함함을 특징으로 하는 매모리의 데이터 읽기회로.
  6. 제5항에 있어서, 상기 제2차동증폭부는 다수개의 피모스트랜지스터와 엔모스트랜지스터의 조합으로 구성된 커런 트 미러형 미분증폭기를 포함하는 것을 특징으로 하는 메모리의 데이터 읽기 회로.
  7. 제5항에 있어서, 상기 제2하이레벨 차지부는 소오스전극이 전원전압에 접속되고 게이트전극이 제어단자 P3와 상기 엔모스트랜지스터의 게이트전극 및 상기 인버터의 입력단자에 공통접속되고 드레인전극이 상기 피모스트랜지스터의 드레인전극(DS단자) 및 상기 출력버퍼부의 인버터의 입력단자에 공통접속되는 피모스트랜지스터를 포함함을 특징으로 하는 메모리의 데이터 읽기회로.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
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