JPS61175724A - 集約表示方式 - Google Patents

集約表示方式

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JPS61175724A
JPS61175724A JP1588885A JP1588885A JPS61175724A JP S61175724 A JPS61175724 A JP S61175724A JP 1588885 A JP1588885 A JP 1588885A JP 1588885 A JP1588885 A JP 1588885A JP S61175724 A JPS61175724 A JP S61175724A
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JP
Japan
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display
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circuit
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Pending
Application number
JP1588885A
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English (en)
Inventor
Kazunori Kita
北 和則
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NEC Corp
Original Assignee
NEC Corp
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Publication date
Application filed by NEC Corp filed Critical NEC Corp
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 本発明は情報処理装置に関し、特に表示信号を〔従来の
技術〕 従来、情報処理装置の表示方式は第2因に示すように、
表示情報3oが表示情報格納部31にセットされると、
論理和回路32を介し、表示信号33として、操作表示
パネル35の表示回路34に入力してステータス表示を
行う方式であった。
また、゛表示テストスイッチ回路36を操作することに
より、テスト信号37が出力さn1表示回路34のテス
トを行なっていた。
〔発明が解決しようとする問題点〕
しかしながら、このような従来の表示方式は、情報処理
装置のステータγ表示数が多い場合、操作表示パネルの
面積を広くする必要があり、情報処理装置の制御部は小
さくできたとしても、筐体が大型となるという欠点があ
った。
〔問題点を解決するための手段〕
本発明の集約表示方式は複数の表示情報の表示を制御す
る表示制御部と、予め表示情報の表示ステータス情報を
格納した表示ステータス格納部と、を〃操作者が表示内
容を確認できる一定の間隔で自動的に順次ループさせて
読み出す表示ループ制御回路と、表示ステータス格納部
から読み出された表示ステータス内容を表示する操作表
示パネルを有している。
〔実施例〕
次に、本発明の実施例について、図面を参照して説明す
る。
第1図は本発明の一実施例を示すブロック図である。表
示情報1は論理和回路2を介して表示情報格納回路3に
セットされ、その出力が論理積回路6において、アドレ
スデコーダ10の出力であるアドレス信号9と論理積が
とられ、論理和回路7に入力され、表示指示信号13と
なって液晶ドライバ20に入力さnる。つまり、予め格
納された表示ステータス格納部14の表示ステータス内
容に対するアドレスと表示情報1によってセットされた
表示情報格納回路3の出力が一致したときのみ表示指示
信号13が出力されるため、表示情報格納回路3におい
てセットさnている表示情報のみが、液晶表示部16に
表示さnることになる。
一方、表示ループ制御回路12は操作者が表示内容を確
認できる一定の間隔で順次、アドレス情報11をアドレ
スデコーダ10および表示ステータス格納部14に送出
しているため、表示ステーられる。そして、表示指示信
号13が出力されている場合のみ液晶表示部16にステ
ータス表示を行う。つまり、操作者が表示内容を確認で
きる一定の間隔で自動的に順次ループし、表示ステータ
ス格納部14の表示ステータス内容が表示される。
また、操作表示パネル17上の表示制御スイッチ回路1
5を操作し、表示制御信号19を出力することにより、
表示ループ制御回路12の出力であるアドレス情報11
を固定にし、表示したい表示ステータス内容を固定して
表示できる。
さらに、操作表示パネル17上の表示テストスイッチ回
路5を操作し、テスト信号18を論理和回路2に送出し
、表示信号4を発生させ、表示情報格納回路3の全てを
セットすることにより、表示ステータス格納部14の表
示ステータス内容を表示させ、表示テストを行う。
〔発明の効果〕
本発明の集約表示方式は、表示情報に対応した表示ステ
ータス格納部を具備し、表示ステータス格納部の表示ス
テータス内容を順次ループさせて表示するように構成す
ることにより、表示のための専有面積を小さくすること
ができ、情報処理装置を小屋化できるという効果がある
【図面の簡単な説明】
第1図は本発明の一実施例を示すブロック図、第2図は
従来の一例を示すブロック図である。 1・・・・・・表示情報、2・・・・・・論理和回路、
3・・・・・・表示情報格納回路、4・・・・・・表示
信号、5・・・・・・表示テストスイッチ回路、6・・
・・・・論理積回路、7・・・・・・論理和回路、8・
・・・・・表示制御部、9・・・・・・アドレス信号、
10・・・・・・アドレスデコーダ、11・・・・・・
アドレス情報、12・・・・・・表示ループ制御回路、
13・・・・・・表示指示信号、14・・・・・・表示
ステータス格納部、15・・・・・・表示制御スイッチ
回路、16・・・・・・液晶表示部、17・・・・・・
操作表示パネル、工8・・・・・・テスト信号、19・
・・・・・表示制御信号、20・・・・・・液晶ドライ
バ、30・・・・・・表示情報、31・・・・・・表示
情報格納部、32・・・・・・論理和回路、33・・・
・・・表示信号、34・・・・・・表示回路、35・・
・・・・操作表示パネル、36・・・・・・表示テスト
スイッチ回路、37・・・・・・テスト信号。 寿1図 豹                        
             −+/         
                         
       m色

Claims (1)

    【特許請求の範囲】
  1. 情報処理装置のステータス表示方式において、複数の表
    示情報の表示を制御する表示制御部と、予め表示情報の
    表示ステータス内容を格納した表示ステータス格納部と
    、前記表示ステータス格納部の表示ステータス内容を操
    作者が表示内容を確認できる一定の間隔で自動的に順次
    ループさせて読み出す表示ループ制御回路と、前記表示
    ステータス格納部から読み出された表示ステータス内容
    を表示する操作表示パネルとを含むことを特徴とする集
    約表示方式。
JP1588885A 1985-01-30 1985-01-30 集約表示方式 Pending JPS61175724A (ja)

Priority Applications (1)

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JP1588885A JPS61175724A (ja) 1985-01-30 1985-01-30 集約表示方式

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JPS61175724A true JPS61175724A (ja) 1986-08-07

Family

ID=11901326

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JP1588885A Pending JPS61175724A (ja) 1985-01-30 1985-01-30 集約表示方式

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JP (1) JPS61175724A (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US9057177B2 (en) 2011-10-08 2015-06-16 Caterpillar Inc. Implement tooth assembly with tip and adapter

Cited By (1)

* Cited by examiner, † Cited by third party
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US9057177B2 (en) 2011-10-08 2015-06-16 Caterpillar Inc. Implement tooth assembly with tip and adapter

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