JPS60225450A - 半導体装置の製造法 - Google Patents
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は改良された半導体装置の製造法に係シ、特に、
レジンモールドに不可避的な水分の浸入障害を防止して
、経済性と信頼性とを共に改善した半導体装置の製造法
に関するものである0集積回路(IOと略称する)、ト
ランジスターなどの半導体は益々小型高密化(高集積化
)されると共に、初期の金属やセラミック封止に代って
、安値なレジンモールド封止が強く志向されている0す
なわち、多くの場合リードフレームを用いて素゛子を塔
載して結線してから、レジンモールドされる0例えば第
1図は、IC用リードフレームの拡大平面図例でらる0
第2図1は完成され九半導体装置の内部を示す断面略図
である9図中の参照数字lは、タブでSiなどの半導体
素子2がエポキシなどの接着剤がPb Sn SAu
−3iなどの金属ろう剤層8を介して接合搭載される。
レジンモールドに不可避的な水分の浸入障害を防止して
、経済性と信頼性とを共に改善した半導体装置の製造法
に関するものである0集積回路(IOと略称する)、ト
ランジスターなどの半導体は益々小型高密化(高集積化
)されると共に、初期の金属やセラミック封止に代って
、安値なレジンモールド封止が強く志向されている0す
なわち、多くの場合リードフレームを用いて素゛子を塔
載して結線してから、レジンモールドされる0例えば第
1図は、IC用リードフレームの拡大平面図例でらる0
第2図1は完成され九半導体装置の内部を示す断面略図
である9図中の参照数字lは、タブでSiなどの半導体
素子2がエポキシなどの接着剤がPb Sn SAu
−3iなどの金属ろう剤層8を介して接合搭載される。
素子2の表層にはSio、 、 Si、N、などの薄膜
でパッシベーションされ、かつ適宜に電極4が設けられ
ている0当該電極4とインナーリード5の先端とは、A
uなどの細線6でワイヤボンドされる。ワイヤボンドさ
れた後、エポキシ、シリコーンなどのレジン7によりモ
ールド封止される。タイバー8はモール゛ド後に切断さ
れ、アウターリード9は第2図の如く曲げられて、半田
付けされる@ 従来、以上の操作は大気中で実施されてきた〇このため
、前記タブlやインナーリード5には、Au −? #
などの貴金属メッキが施され、Au−8i共晶ろうやA
u線を用いて、各々ダイ、ワイヤーボンディングが為さ
れて、半導体装置の製造に多大の貴金属が消費される結
果となった0他方、貴金属自体は耐食的であるが、ひ金
属との接合部においてこれを電食的に腐食するのみでな
く、より重大なことはエポキシ、シリコーンなどの封止
レジンとの接着力に乏しいために、使用期間中の熱膨張
差などのストレスにより、微細な間隙を発生して、外界
水分の浸入路となり、前記の腐食はもとより、81チツ
プ上の回路の障害劣化をもたらしている〇 本発明は以上の現況に鑑みて為されたものでらジ、経済
性と信頼性とを両立できる改良された半導体装置の製造
法を提供しようとするものでらる0すなわち、本発明の
半導体装置の製造法は、図面にもみられるように、レジ
ンモールドされり半導体装置の製造法において、非酸化
雰囲気中でOu又はQu合金製のリードフレームを用い
て半導体素子2を搭載した後、非酸化雰囲気で金属細線
6を用いて前記素子2と前記リードフレームとをワイヤ
ーボンドし、しかる後酸化雰囲気中で加熱して400〜
5,0OOAの酸化被膜を形成し、次いでレジンモール
ドすることを特徴とする〇又、本発明では、前記リード
フレームとして全くメッキされない非メツキリードフレ
ームを、前記ワイヤーボンド用細線6としてQu−又は
aU合金線を用いることができる〇 本発明においては、非酸化性雰囲気中でOu又はQu合
金製リードフレームに搭載してから、同じく非酸化性雰
囲気中で金属細線6を用いてワイー’1’−ホントして
、81などの半導体素子2とリードフレームとの回路を
形成し、しかる後に1酸化雰囲気中で加熱して、400
〜5,000人の銅酸化物被膜を形成し、次いでレジン
モールドする@前記Ou系リードフレームとは、Gu−
8ns 0u−FesOu−Ni−8i N C1u−
Ni−8n、系などの要求される強度と導電性即ち熱放
散性を有して、かつ従来Ni −Feやコバール(Fe
−Ni−00) 1どヨリ安値なQu系合金でおるの
みでなく、鉄鋼や合金鉄などの芯材の表層にQuなどを
被覆したものも含まれる。これらをArやN、など′の
不活性、更に望ましくはH,−N、 Hg−00−N、
などの還元性雰囲気において、100〜400℃に加熱
して、S1チツグをダイボンドする@このとき、特にエ
ポキシやポリイミド系の接着剤やAfペーストを用いる
接着ダイボンドは250〜800℃の高温でもって固着
できるので、前記の400℃前後のAu−8iろうより
簡便でかつ経済的である0次に同様の雰囲気中でAu、
011. AI!等の細線6を用いてリードフレーム
のインナーリード部5と半導体チップ上の電極4との間
をワイヤーボンド結4線する。リードフレームは150
〜850℃位の高温に加熱され、超音波熱圧着法などの
方法によシ高速ボンディングされる。
でパッシベーションされ、かつ適宜に電極4が設けられ
ている0当該電極4とインナーリード5の先端とは、A
uなどの細線6でワイヤボンドされる。ワイヤボンドさ
れた後、エポキシ、シリコーンなどのレジン7によりモ
ールド封止される。タイバー8はモール゛ド後に切断さ
れ、アウターリード9は第2図の如く曲げられて、半田
付けされる@ 従来、以上の操作は大気中で実施されてきた〇このため
、前記タブlやインナーリード5には、Au −? #
などの貴金属メッキが施され、Au−8i共晶ろうやA
u線を用いて、各々ダイ、ワイヤーボンディングが為さ
れて、半導体装置の製造に多大の貴金属が消費される結
果となった0他方、貴金属自体は耐食的であるが、ひ金
属との接合部においてこれを電食的に腐食するのみでな
く、より重大なことはエポキシ、シリコーンなどの封止
レジンとの接着力に乏しいために、使用期間中の熱膨張
差などのストレスにより、微細な間隙を発生して、外界
水分の浸入路となり、前記の腐食はもとより、81チツ
プ上の回路の障害劣化をもたらしている〇 本発明は以上の現況に鑑みて為されたものでらジ、経済
性と信頼性とを両立できる改良された半導体装置の製造
法を提供しようとするものでらる0すなわち、本発明の
半導体装置の製造法は、図面にもみられるように、レジ
ンモールドされり半導体装置の製造法において、非酸化
雰囲気中でOu又はQu合金製のリードフレームを用い
て半導体素子2を搭載した後、非酸化雰囲気で金属細線
6を用いて前記素子2と前記リードフレームとをワイヤ
ーボンドし、しかる後酸化雰囲気中で加熱して400〜
5,0OOAの酸化被膜を形成し、次いでレジンモール
ドすることを特徴とする〇又、本発明では、前記リード
フレームとして全くメッキされない非メツキリードフレ
ームを、前記ワイヤーボンド用細線6としてQu−又は
aU合金線を用いることができる〇 本発明においては、非酸化性雰囲気中でOu又はQu合
金製リードフレームに搭載してから、同じく非酸化性雰
囲気中で金属細線6を用いてワイー’1’−ホントして
、81などの半導体素子2とリードフレームとの回路を
形成し、しかる後に1酸化雰囲気中で加熱して、400
〜5,000人の銅酸化物被膜を形成し、次いでレジン
モールドする@前記Ou系リードフレームとは、Gu−
8ns 0u−FesOu−Ni−8i N C1u−
Ni−8n、系などの要求される強度と導電性即ち熱放
散性を有して、かつ従来Ni −Feやコバール(Fe
−Ni−00) 1どヨリ安値なQu系合金でおるの
みでなく、鉄鋼や合金鉄などの芯材の表層にQuなどを
被覆したものも含まれる。これらをArやN、など′の
不活性、更に望ましくはH,−N、 Hg−00−N、
などの還元性雰囲気において、100〜400℃に加熱
して、S1チツグをダイボンドする@このとき、特にエ
ポキシやポリイミド系の接着剤やAfペーストを用いる
接着ダイボンドは250〜800℃の高温でもって固着
できるので、前記の400℃前後のAu−8iろうより
簡便でかつ経済的である0次に同様の雰囲気中でAu、
011. AI!等の細線6を用いてリードフレーム
のインナーリード部5と半導体チップ上の電極4との間
をワイヤーボンド結4線する。リードフレームは150
〜850℃位の高温に加熱され、超音波熱圧着法などの
方法によシ高速ボンディングされる。
リードフレームの加熱はボンディングの生産性と信頼性
とに不可欠の必要条件である0ワイヤーボンドには表面
の酸化膜が極めて有害で$5.100人前後の極薄膜に
おいても、有意のボンディング強度低下となるので、前
記の不活性雰囲気が必要となる。ダイボンドでは、一般
に酸化は障害とならない6大気雰囲気でダイボンドした
際に発生する銅酸化膜は次のワイヤーボンド条件で還元
性雰囲気を採用することにより外見上aUに還元できる
が、しかし、前記のOu合金成分の酸化物は還元されず
に残留するので、前記の如きボンディング強度の低下を
まねく0従って、両ボンドにおいて酸化条件は厳に避け
ねばならない。
とに不可欠の必要条件である0ワイヤーボンドには表面
の酸化膜が極めて有害で$5.100人前後の極薄膜に
おいても、有意のボンディング強度低下となるので、前
記の不活性雰囲気が必要となる。ダイボンドでは、一般
に酸化は障害とならない6大気雰囲気でダイボンドした
際に発生する銅酸化膜は次のワイヤーボンド条件で還元
性雰囲気を採用することにより外見上aUに還元できる
が、しかし、前記のOu合金成分の酸化物は還元されず
に残留するので、前記の如きボンディング強度の低下を
まねく0従って、両ボンドにおいて酸化条件は厳に避け
ねばならない。
次に、大気中に於いて加熱され400〜5.000人の
酸化膜が形成される0これらは前記ボンディング温度で
数分間内に発生することができるので1ワイヤーポンド
との連続ラインにおいて無人的に実施することができる
0酸化膜はレジンとOuとの化学的結合を促進して強固
な接着を可能にするO但し、過剰の酸化膜は熱的なスト
レスによるクラックの発生となるので、上記接着界面の
完全性が損なわれるので、前記の厚さ範囲が実用的であ
る0以上の本発明により、貴金属メッキなどの高価の工
程を省略し、かつ、信頼性の高い半導体装置を製造する
ことができる。本発明において、Ou又はcu金合金例
えば0u−8n、 Qu−At、 0u−Znなどの細
線を用いてポンディングするとき、特に、本発明の実用
効果を最大化することができる。即たチップへの水分浸
入パスを完全に遮断できるばかりでなく、リードフレー
ムと同一金属でおるため、パープルフレーク内電食など
の異種金属接合に不可避的な欠陥を完全に回避できるO
このモノメタル化は、チップ上の回路電極がAj等で形
成されているとき、Qr、 MO,Ni等のバリヤー?
介してcu 2蒸着して形成することによりよシ完全に
実現できることは言うまでもない0 次に実施例を用いて更に具体的に説明するO実施例 1 第1図に略図される14ビンのリードフレーム@ 0u
−5Ni−23n合金条(0,25t X 26rnm
) カらプレス成型した。本品タブ部1にA、−エボ
キシペーストヲ滴下してからS1チツプをお@ 260
℃のlr雰囲気炉中でキュアーした0本品を次に超音波
熱圧着法によりワイヤーボンドした。Siチップ上の電
極は予めCu蒸着で形成されていた0細線6としてはA
u線とOu−0,15Sn線(共にo、os。
酸化膜が形成される0これらは前記ボンディング温度で
数分間内に発生することができるので1ワイヤーポンド
との連続ラインにおいて無人的に実施することができる
0酸化膜はレジンとOuとの化学的結合を促進して強固
な接着を可能にするO但し、過剰の酸化膜は熱的なスト
レスによるクラックの発生となるので、上記接着界面の
完全性が損なわれるので、前記の厚さ範囲が実用的であ
る0以上の本発明により、貴金属メッキなどの高価の工
程を省略し、かつ、信頼性の高い半導体装置を製造する
ことができる。本発明において、Ou又はcu金合金例
えば0u−8n、 Qu−At、 0u−Znなどの細
線を用いてポンディングするとき、特に、本発明の実用
効果を最大化することができる。即たチップへの水分浸
入パスを完全に遮断できるばかりでなく、リードフレー
ムと同一金属でおるため、パープルフレーク内電食など
の異種金属接合に不可避的な欠陥を完全に回避できるO
このモノメタル化は、チップ上の回路電極がAj等で形
成されているとき、Qr、 MO,Ni等のバリヤー?
介してcu 2蒸着して形成することによりよシ完全に
実現できることは言うまでもない0 次に実施例を用いて更に具体的に説明するO実施例 1 第1図に略図される14ビンのリードフレーム@ 0u
−5Ni−23n合金条(0,25t X 26rnm
) カらプレス成型した。本品タブ部1にA、−エボ
キシペーストヲ滴下してからS1チツプをお@ 260
℃のlr雰囲気炉中でキュアーした0本品を次に超音波
熱圧着法によりワイヤーボンドした。Siチップ上の電
極は予めCu蒸着で形成されていた0細線6としてはA
u線とOu−0,15Sn線(共にo、os。
φmm ) f用い、下記の条件とした0ボンディング
部は101 H,−N、雰囲気として外気と遮断した〇
ポンディング条件を下記に記す。
部は101 H,−N、雰囲気として外気と遮断した〇
ポンディング条件を下記に記す。
lu線 0u−0,15Sn線
プレ一ト温度 250℃ 810℃
第1ボンド(荷重x時間) 50rrX0.05S80
60frX0.05S80第2 1 (# )80f
rX0.1880 90frX0.l580超音波 5
0 Kuz50KH2 続いて280℃の大気炉中に10秒、80秒、2分S5
分、80分通過させた0以上につきプルテスターでポン
ディングループの強度全測定すると共に、カソード還元
法によりリードフレーム部の酸化膜厚さを測定した。次
にワイヤーボンド、′大気酸化を終え71j7レームを
エポキシモールドして半導体装置とした。本品を180
℃の飽和型プレッシャークツカーVC2,000hr保
持してから断線率をめた0以上の結果を表−1にまとめ
て示す3表−1 1Au 、0 25 9.2 40 2 # 10秒 280 9.6 808 N 80秒
510 9.2’ 44 l 2分 1200 9.
7 8 6 # 5分 2600 9.1 4 6 # 80分 9500 9.0 25? 0u−0
,15Sn O2511,2158〃 10秒 240
10.6 109 # 80秒 490 12.2
810#2分 1150 19.8 0 11 # 5分 2700 11.9 012 # 8
0分 9040 12.0 12以上の結果は説明する
までもなく、本発明法において初めて厳しい耐湿試験条
件に耐え得ること、特にリードフレームと同じCu系の
Qu −0,15Sn細線の使用ケースの方が優れるこ
とが明示されている。なお、比較のため、ダイボンドを
大気中で実行してから、前記の0u−0,15Sn細線
ポンディングを行ったとき、プルテストにより平均5.
2 rr (範囲0−9.1lr)の強度しか得られな
かつ几・本文中に説明した通り、合金成分の酸化物が残
留したためと推考される〇 以上に詳しく説明した通り、本発明は経済性に優れ、か
つ信頼性の高い半導体の製造全可能にするものであり1
その工業的意義は高い。
60frX0.05S80第2 1 (# )80f
rX0.1880 90frX0.l580超音波 5
0 Kuz50KH2 続いて280℃の大気炉中に10秒、80秒、2分S5
分、80分通過させた0以上につきプルテスターでポン
ディングループの強度全測定すると共に、カソード還元
法によりリードフレーム部の酸化膜厚さを測定した。次
にワイヤーボンド、′大気酸化を終え71j7レームを
エポキシモールドして半導体装置とした。本品を180
℃の飽和型プレッシャークツカーVC2,000hr保
持してから断線率をめた0以上の結果を表−1にまとめ
て示す3表−1 1Au 、0 25 9.2 40 2 # 10秒 280 9.6 808 N 80秒
510 9.2’ 44 l 2分 1200 9.
7 8 6 # 5分 2600 9.1 4 6 # 80分 9500 9.0 25? 0u−0
,15Sn O2511,2158〃 10秒 240
10.6 109 # 80秒 490 12.2
810#2分 1150 19.8 0 11 # 5分 2700 11.9 012 # 8
0分 9040 12.0 12以上の結果は説明する
までもなく、本発明法において初めて厳しい耐湿試験条
件に耐え得ること、特にリードフレームと同じCu系の
Qu −0,15Sn細線の使用ケースの方が優れるこ
とが明示されている。なお、比較のため、ダイボンドを
大気中で実行してから、前記の0u−0,15Sn細線
ポンディングを行ったとき、プルテストにより平均5.
2 rr (範囲0−9.1lr)の強度しか得られな
かつ几・本文中に説明した通り、合金成分の酸化物が残
留したためと推考される〇 以上に詳しく説明した通り、本発明は経済性に優れ、か
つ信頼性の高い半導体の製造全可能にするものであり1
その工業的意義は高い。
第1図は本発明の一実施例に係るリードフレームの拡大
平面図、 第2図は本発明の一実施例に係る完成され友レジンモー
ルド半導体装置の内部を示す断面略図である。 1・・・タブ 2・・・Siなどの半導体装置8・・・
エポキシ樹脂などの接着剤やPb−8n、 Au−8i
などの金属ろう剤層 4・・・電極 5・・・インナーリード6・・・細線 7・・・エポキシ、シリコーンなどのレジン8・・・タ
イバー 9・・・アウターリードO特許出願人 古河電
気工業株式会社 第1図
平面図、 第2図は本発明の一実施例に係る完成され友レジンモー
ルド半導体装置の内部を示す断面略図である。 1・・・タブ 2・・・Siなどの半導体装置8・・・
エポキシ樹脂などの接着剤やPb−8n、 Au−8i
などの金属ろう剤層 4・・・電極 5・・・インナーリード6・・・細線 7・・・エポキシ、シリコーンなどのレジン8・・・タ
イバー 9・・・アウターリードO特許出願人 古河電
気工業株式会社 第1図
Claims (1)
- 【特許請求の範囲】 L レジンモールドされた半導体装置の製造法において
、非酸化雰囲気中でOu又はOu合金製のリードフレー
ムを用いて半導体素子を塔載した後、非酸化雰囲気で金
属細線を用いて前記素子と前記リードフレームとをワイ
ヤーボンドし、しかる後酸化雰囲気中で加熱して400
〜5,0OOAの酸化被膜を形成し、次いでレジンモー
ルドすることを特徴とする半導体装置の製造法。 ム 前記リードフレームとして全くメッキされない非メ
ツキリードフレームを、前記ワイヤーボンド用細線とし
てaU又はQu合金i1i!’t−用いることを特徴と
する特許請求の範囲第1項記載の半導体装置の製造法0
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP59081058A JPS60225450A (ja) | 1984-04-24 | 1984-04-24 | 半導体装置の製造法 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP59081058A JPS60225450A (ja) | 1984-04-24 | 1984-04-24 | 半導体装置の製造法 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS60225450A true JPS60225450A (ja) | 1985-11-09 |
JPH0558259B2 JPH0558259B2 (ja) | 1993-08-26 |
Family
ID=13735801
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP59081058A Granted JPS60225450A (ja) | 1984-04-24 | 1984-04-24 | 半導体装置の製造法 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS60225450A (ja) |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH01503184A (ja) * | 1987-05-13 | 1989-10-26 | エルエスアイ ロジック コーポレーション | 集積回路装置パッケージ |
JPH0294449A (ja) * | 1988-09-29 | 1990-04-05 | Nec Corp | 半導体装置の製造装置 |
Citations (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS5433659A (en) * | 1977-08-22 | 1979-03-12 | Hitachi Ltd | Bonding wire |
JPS54162471A (en) * | 1978-06-13 | 1979-12-24 | Nec Corp | Semiconductor device |
JPS5693338A (en) * | 1979-06-09 | 1981-07-28 | Itt | Planar semiconductor device and method and apparatus for manufacturing same |
JPS5958833A (ja) * | 1982-09-28 | 1984-04-04 | Shinkawa Ltd | 半導体装置 |
-
1984
- 1984-04-24 JP JP59081058A patent/JPS60225450A/ja active Granted
Patent Citations (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS5433659A (en) * | 1977-08-22 | 1979-03-12 | Hitachi Ltd | Bonding wire |
JPS54162471A (en) * | 1978-06-13 | 1979-12-24 | Nec Corp | Semiconductor device |
JPS5693338A (en) * | 1979-06-09 | 1981-07-28 | Itt | Planar semiconductor device and method and apparatus for manufacturing same |
JPS5958833A (ja) * | 1982-09-28 | 1984-04-04 | Shinkawa Ltd | 半導体装置 |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH01503184A (ja) * | 1987-05-13 | 1989-10-26 | エルエスアイ ロジック コーポレーション | 集積回路装置パッケージ |
JPH0294449A (ja) * | 1988-09-29 | 1990-04-05 | Nec Corp | 半導体装置の製造装置 |
Also Published As
Publication number | Publication date |
---|---|
JPH0558259B2 (ja) | 1993-08-26 |
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