JPH11162875A - 半導体装置の製造方法 - Google Patents
半導体装置の製造方法Info
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- JPH11162875A JPH11162875A JP9325040A JP32504097A JPH11162875A JP H11162875 A JPH11162875 A JP H11162875A JP 9325040 A JP9325040 A JP 9325040A JP 32504097 A JP32504097 A JP 32504097A JP H11162875 A JPH11162875 A JP H11162875A
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Abstract
(57)【要約】
【課題】 ハロゲン化合物ガスを用いて化学的気相成長
法によりチタンを堆積する半導体装置の製造方法におい
て、チタンの堆積速度を安定化し、前記チタンをバリア
メタルとするコンタクト孔の電気的特性を改善する。 【解決手段】 半導体装置にチタンを堆積した後、半導
体装置を反応室から搬出し、反応室内に残留するハロゲ
ンを含むガス12をシランガス15により除去する。
法によりチタンを堆積する半導体装置の製造方法におい
て、チタンの堆積速度を安定化し、前記チタンをバリア
メタルとするコンタクト孔の電気的特性を改善する。 【解決手段】 半導体装置にチタンを堆積した後、半導
体装置を反応室から搬出し、反応室内に残留するハロゲ
ンを含むガス12をシランガス15により除去する。
Description
【0001】
【発明の属する技術分野】この発明は、半導体装置の製
造方法に係り、特に化学的気相成長によりチタンを堆積
してバリアメタルを形成する工程を含む半導体装置の製
造方法に関する。
造方法に係り、特に化学的気相成長によりチタンを堆積
してバリアメタルを形成する工程を含む半導体装置の製
造方法に関する。
【0002】
【従来の技術】化学的気相成長を用いてコンタクトホー
ル(接続孔)にバリアメタルを形成する半導体装置の製
造方法について、特に窒化チタンとチタンの化学的気相
成長を例にあげて説明する。
ル(接続孔)にバリアメタルを形成する半導体装置の製
造方法について、特に窒化チタンとチタンの化学的気相
成長を例にあげて説明する。
【0003】まず、図1(A)に示すように、シリコン
基板1上に厚さ200nmの素子分離酸化膜2を形成し
てシリコン基板1に所定の不純物を導入し拡散層3を形
成する。続いて、厚さ1500nmの絶縁膜4を堆積し
拡散層3上に接続孔5を開口する。
基板1上に厚さ200nmの素子分離酸化膜2を形成し
てシリコン基板1に所定の不純物を導入し拡散層3を形
成する。続いて、厚さ1500nmの絶縁膜4を堆積し
拡散層3上に接続孔5を開口する。
【0004】次に図1(B)に示すように、四塩化チタ
ン、水素、アルゴンを原料ガスとした化学的気相成長法
を用いて絶縁膜4上に厚さ10nmのチタン膜6を堆積
し、これにより拡散層3上に厚さ20nmのチタンシリ
サイド膜7を形成する。
ン、水素、アルゴンを原料ガスとした化学的気相成長法
を用いて絶縁膜4上に厚さ10nmのチタン膜6を堆積
し、これにより拡散層3上に厚さ20nmのチタンシリ
サイド膜7を形成する。
【0005】次に図1(C)に示すように、絶縁膜4上
のチタン膜6をアンモニアにより窒化し窒化チタン膜8
を形成し、図1(D)に示すように四塩化チタン、アン
モニア、窒素を原料ガスとした化学的気相成長法を用い
て窒化チタン膜8とチタンシリサイド膜7上に厚さ50
0nmの窒化チタン膜9を形成する。
のチタン膜6をアンモニアにより窒化し窒化チタン膜8
を形成し、図1(D)に示すように四塩化チタン、アン
モニア、窒素を原料ガスとした化学的気相成長法を用い
て窒化チタン膜8とチタンシリサイド膜7上に厚さ50
0nmの窒化チタン膜9を形成する。
【0006】
【発明が解決しようとする課題】上述した従来の半導体
装置の製造方法は、以下に示す欠点がある。すなわち、
ハロゲン化チタンガスと高周波放電を用いた化学的気相
成長法によるチタン堆積においては、反応室内に残留す
るハロゲンを含むガスが半導体基板以外の場所に堆積し
たTiを腐食し基板上に過剰な塩化チタンを供給するた
め、塩化チタン分圧が半導体基板(ウエハ)の処理枚数
により変動し所望の分圧が得られない。従って、半導体
基板上のチタン堆積速度が変動し安定したコンタクト電
極の電気特性を得ることができないという欠点があった
のである。
装置の製造方法は、以下に示す欠点がある。すなわち、
ハロゲン化チタンガスと高周波放電を用いた化学的気相
成長法によるチタン堆積においては、反応室内に残留す
るハロゲンを含むガスが半導体基板以外の場所に堆積し
たTiを腐食し基板上に過剰な塩化チタンを供給するた
め、塩化チタン分圧が半導体基板(ウエハ)の処理枚数
により変動し所望の分圧が得られない。従って、半導体
基板上のチタン堆積速度が変動し安定したコンタクト電
極の電気特性を得ることができないという欠点があった
のである。
【0007】この発明は以上説明した事情に鑑みてなさ
れたものであり、半導体基板上のチタン堆積速度が安定
しており、良好な電気的特性のコンタクト電極が得られ
る半導体装置の製造方法を提供することを目的としてい
る。
れたものであり、半導体基板上のチタン堆積速度が安定
しており、良好な電気的特性のコンタクト電極が得られ
る半導体装置の製造方法を提供することを目的としてい
る。
【0008】
【課題を解決するための手段】この発明に係る半導体装
置の製造方法は、半導体基板上に化学的気相成長法を用
いてチタンを堆積し反応室内にハロゲンを含む残留ガス
をシランガスにより除去する工程を有することを特徴と
する。
置の製造方法は、半導体基板上に化学的気相成長法を用
いてチタンを堆積し反応室内にハロゲンを含む残留ガス
をシランガスにより除去する工程を有することを特徴と
する。
【0009】
【発明の実施の形態】以下、図面を参照し、本発明の実
施の形態について説明する。 A.第1の実施形態 本実施形態に係る製造方法では、まず、図1(A)に示
すように、シリコン基板1上に厚さ200nmの素子分
離酸化膜2を形成してシリコン基板1に所定の不純物を
導入し拡散層3を形成する。続いて厚さ2000nmの
絶縁膜4を堆積し拡散層3上に接続孔5を開口する。
施の形態について説明する。 A.第1の実施形態 本実施形態に係る製造方法では、まず、図1(A)に示
すように、シリコン基板1上に厚さ200nmの素子分
離酸化膜2を形成してシリコン基板1に所定の不純物を
導入し拡散層3を形成する。続いて厚さ2000nmの
絶縁膜4を堆積し拡散層3上に接続孔5を開口する。
【0010】次に図1(B)に示すように、高周波放電
を用いた化学的気相成長法により、例えば四塩化チタン
2sccm、水素1000sccm、アルゴン500s
ccmの混合ガスを原料ガスとして、基板温度600
℃、圧力5T、高周波放電出力500kWの条件の下で
絶縁膜4上に厚さ10nmのチタン膜6を堆積し、これ
により拡散層3上に厚さ20nmのチタンシリサイド膜
7を形成する。そして、半導体基板を反応室から搬出す
る。
を用いた化学的気相成長法により、例えば四塩化チタン
2sccm、水素1000sccm、アルゴン500s
ccmの混合ガスを原料ガスとして、基板温度600
℃、圧力5T、高周波放電出力500kWの条件の下で
絶縁膜4上に厚さ10nmのチタン膜6を堆積し、これ
により拡散層3上に厚さ20nmのチタンシリサイド膜
7を形成する。そして、半導体基板を反応室から搬出す
る。
【0011】このときの反応室の概略を図2(A)に示
す。チタン膜11を堆積した後、半導体基板は搬出され
ている状能であり、反応室内にTiClx等の残留ハロ
ゲンガス12が浮遊している。そこで、図2(B)に示
すように、残留ハロゲンガス12を除去するために、1
T、100sccm、30秒の条件のもとで、SiH
4、Si2H2、B2H6、AsH4等の水素化物であるシラ
ンガス15を流す。この処理により残留ハロゲンガス1
2の分圧が低下するだけでなく、反応室に堆積したチタ
ン膜11がシリサイド化されチタンシリサイド膜13が
形成されるため、反応室に堆積したチタン膜11の四塩
化チタンによる腐食も抑制することが可能となる。従っ
て、引き続き処理される基板のチタン成膜において過剰
な塩化チタンの供給を抑制できる。また、このシランガ
ス照射工程においてアルゴン500sccmを加えて5
00kW程度の高周波放電を用いても良い。
す。チタン膜11を堆積した後、半導体基板は搬出され
ている状能であり、反応室内にTiClx等の残留ハロ
ゲンガス12が浮遊している。そこで、図2(B)に示
すように、残留ハロゲンガス12を除去するために、1
T、100sccm、30秒の条件のもとで、SiH
4、Si2H2、B2H6、AsH4等の水素化物であるシラ
ンガス15を流す。この処理により残留ハロゲンガス1
2の分圧が低下するだけでなく、反応室に堆積したチタ
ン膜11がシリサイド化されチタンシリサイド膜13が
形成されるため、反応室に堆積したチタン膜11の四塩
化チタンによる腐食も抑制することが可能となる。従っ
て、引き続き処理される基板のチタン成膜において過剰
な塩化チタンの供給を抑制できる。また、このシランガ
ス照射工程においてアルゴン500sccmを加えて5
00kW程度の高周波放電を用いても良い。
【0012】次に図1(C)に示すように、アンモニア
100sccm、基板温度600℃、圧力20T、高周
波放電出力500kWの条件の下で絶縁膜4上のチタン
膜6上に窒化処理を施し窒化チタン膜8を形成する。
100sccm、基板温度600℃、圧力20T、高周
波放電出力500kWの条件の下で絶縁膜4上のチタン
膜6上に窒化処理を施し窒化チタン膜8を形成する。
【0013】次に図1(D)に示すように、化学的気相
成長法を用いて四塩化チタン40sccm、アンモニア
100sccm、窒素3000sccmの混合ガスを原
料ガスとして基板温度600℃、圧力20Tの条件の下
で化学的気相成長法を用いて窒化チタン膜8上に厚さ5
0nmの窒化チタン膜9を形成する。
成長法を用いて四塩化チタン40sccm、アンモニア
100sccm、窒素3000sccmの混合ガスを原
料ガスとして基板温度600℃、圧力20Tの条件の下
で化学的気相成長法を用いて窒化チタン膜8上に厚さ5
0nmの窒化チタン膜9を形成する。
【0014】本実施形態において示した半導体装置の製
造方法によれば、チタン堆積用反応室では常に残留ハロ
ゲンガスが除去されており堆積チタン膜の四塩化チタン
による腐食も発生しないため、安定した四塩化チタン分
圧を得ることができる。従って、安定したチタン堆積速
度が得られるためコンタクト電極の電気特性の安定化が
可能となる。
造方法によれば、チタン堆積用反応室では常に残留ハロ
ゲンガスが除去されており堆積チタン膜の四塩化チタン
による腐食も発生しないため、安定した四塩化チタン分
圧を得ることができる。従って、安定したチタン堆積速
度が得られるためコンタクト電極の電気特性の安定化が
可能となる。
【0015】B.第2の実施形態 次に本発明の第2の実施形態について図面を参照して説
明する。本実施形態では、まず、図3(A)に示すよう
に、シリコン基板1上に厚さ200nmの素子分離酸化
膜2を形成してシリコン基板1に所定の不純物を導入し
拡雌層3を形成する。続いて、厚さ2000nmの絶縁
膜4を堆積し拡散層3上に接続孔5を開口する。
明する。本実施形態では、まず、図3(A)に示すよう
に、シリコン基板1上に厚さ200nmの素子分離酸化
膜2を形成してシリコン基板1に所定の不純物を導入し
拡雌層3を形成する。続いて、厚さ2000nmの絶縁
膜4を堆積し拡散層3上に接続孔5を開口する。
【0016】次に図3(B)に示すように、高周波放電
を用いた化学的気相成長法により、例えば四塩化チタン
2sccm、水素1000sccm、アルゴン500s
ccmの混合ガスを原料ガスとして、基板温度600
℃、圧力5T、高周波放電出力500kWの条件の下で
絶縁膜4上に厚さ10nmのチタン膜6を堆積し、これ
により拡散層3上に厚さ20nmのチタンシリサイド膜
7を形成する。
を用いた化学的気相成長法により、例えば四塩化チタン
2sccm、水素1000sccm、アルゴン500s
ccmの混合ガスを原料ガスとして、基板温度600
℃、圧力5T、高周波放電出力500kWの条件の下で
絶縁膜4上に厚さ10nmのチタン膜6を堆積し、これ
により拡散層3上に厚さ20nmのチタンシリサイド膜
7を形成する。
【0017】このときの反応室の概略を図4(A)に示
す。チタン膜11を堆積した後、半導体基板は搬出され
ていない状態であり、反応室内にTiClx等の残留ハ
ロゲンガス12が浮遊している。そこで、図4(B)に
示すように、残留ハロゲンガス12を除去するために、
1T、100sccm、30秒の条件のもとで、SiH
4、Si2H2、B2H6、AsH4等の水素化物であるシラ
ンガス15を流す。この処理により残留ハロゲンガス1
2の分圧が低下するだけでなく、反応室に堆積したチタ
ン膜11がシリサイド化されチタンシリサイド膜13が
形成されるため、反応室に堆積したチタン膜11の四塩
化チタンによる腐食も抑制することが可能となる。従っ
て、引き続き処理される基板のチタン成膜において過剰
な塩化チタンの供給を抑制できる。また、このシランガ
ス照射工程においてアルゴン500sccmを加えて5
00kW程度の高周波放電を用いても良い。
す。チタン膜11を堆積した後、半導体基板は搬出され
ていない状態であり、反応室内にTiClx等の残留ハ
ロゲンガス12が浮遊している。そこで、図4(B)に
示すように、残留ハロゲンガス12を除去するために、
1T、100sccm、30秒の条件のもとで、SiH
4、Si2H2、B2H6、AsH4等の水素化物であるシラ
ンガス15を流す。この処理により残留ハロゲンガス1
2の分圧が低下するだけでなく、反応室に堆積したチタ
ン膜11がシリサイド化されチタンシリサイド膜13が
形成されるため、反応室に堆積したチタン膜11の四塩
化チタンによる腐食も抑制することが可能となる。従っ
て、引き続き処理される基板のチタン成膜において過剰
な塩化チタンの供給を抑制できる。また、このシランガ
ス照射工程においてアルゴン500sccmを加えて5
00kW程度の高周波放電を用いても良い。
【0018】以上の処理によって、図3(C)に示すよ
うに、半導体基板上のチタン膜6はチタンシリサイド膜
10に相転移する。従って、第1の実施形態で行ったチ
タン膜のアンモニア窒化処理による窒化チタン膜形成工
程は不要となる
うに、半導体基板上のチタン膜6はチタンシリサイド膜
10に相転移する。従って、第1の実施形態で行ったチ
タン膜のアンモニア窒化処理による窒化チタン膜形成工
程は不要となる
【0019】次に図3(D)に示すように、化学的気相
成長法を用いて四塩化チタン40sccm、アンモニア
100sccm、窒素3000sccmの混合ガスを原
料ガスとして基板温度600℃、圧力20Tの条件の下
で化学的気相成長法を用いてチタンシリサイド膜10上
に厚さ50nmの窒化チタン膜9を形成する。
成長法を用いて四塩化チタン40sccm、アンモニア
100sccm、窒素3000sccmの混合ガスを原
料ガスとして基板温度600℃、圧力20Tの条件の下
で化学的気相成長法を用いてチタンシリサイド膜10上
に厚さ50nmの窒化チタン膜9を形成する。
【0020】本実施形態において示した半導体装置の製
造方法によれば、チタン堆積用反応室では常に残留ハロ
ケンガスが除去されており、堆積チタン膜の四塩化チタ
ンによる腐食も発生しないため、安定した四塩化チタン
分圧を得ることができる。従って、安定したチタン堆積
速度が得られるためコンタクト電極の電気特性の安定化
が可能となる。
造方法によれば、チタン堆積用反応室では常に残留ハロ
ケンガスが除去されており、堆積チタン膜の四塩化チタ
ンによる腐食も発生しないため、安定した四塩化チタン
分圧を得ることができる。従って、安定したチタン堆積
速度が得られるためコンタクト電極の電気特性の安定化
が可能となる。
【0021】
【発明の効果】以上説明したように、この発明によれ
ば、半導体基板上のチタン堆積速度が安定しているた
め、良好な電気的特性のコンタクト電極が得られるとい
う効果がある。
ば、半導体基板上のチタン堆積速度が安定しているた
め、良好な電気的特性のコンタクト電極が得られるとい
う効果がある。
【図1】 この発明の第1の実施形態である半導体装置
の製造方法および従来の半導体装置の製造方法を説明す
る工程縦断面図である。
の製造方法および従来の半導体装置の製造方法を説明す
る工程縦断面図である。
【図2】 同実施形態において使用する反応室の断面図
である。
である。
【図3】 この発明の第2の実施形態である半導体装置
の製造方法を説明する工程縦断面図である。
の製造方法を説明する工程縦断面図である。
【図4】 同実施形態において使用する反応室の断面図
である。
である。
1 シリコン基板 2 素子分離酸化膜 3 拡散層 4 絶縁膜 5 接続孔 6 チタニウム膜 7 チタンシリサイド膜 8 窒化チタン膜 9 窒化チタン膜 10 チタンシリサイド膜 11 チタン膜 12 残留ハロゲンガス 13 チタンシリサイド膜 14 半導体基板 l5 シランガス
Claims (3)
- 【請求項1】 ハロゲン化合物ガスを用いて化学的気相
成長法によりチタンを堆積する半導体装置の製造方法に
おいて、チタン堆積前あるいはチタン堆積後に反応室内
に残留するハロゲンを含むガスをSiH4、Si2H2、
B2H6、AsH4等の水素化物により除去するハロゲン
ガス除去工程を有することを特徴とする半導体装置の製
造方法。 - 【請求項2】 前記反応室から前記半導体装置を搬出し
た後に前記ハロゲンガス除去工程を実施することを特徴
とする請求項1に記載の半導体装置の製造方法。 - 【請求項3】 前記反応室から前記半導体装置を搬出す
る前に前記ハロゲンガス除去工程を実施することを特徴
とする請求項1に記載の半導体装置の製造方法。
Priority Applications (4)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP32504097A JP3189771B2 (ja) | 1997-11-26 | 1997-11-26 | 半導体装置の製造方法 |
US09/198,005 US6174805B1 (en) | 1997-11-26 | 1998-11-23 | Titanium film forming method |
CN98124972A CN1218282A (zh) | 1997-11-26 | 1998-11-25 | 钛膜形成方法 |
KR1019980050946A KR19990045603A (ko) | 1997-11-26 | 1998-11-26 | 티탄막 형성방법 |
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Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP32504097A JP3189771B2 (ja) | 1997-11-26 | 1997-11-26 | 半導体装置の製造方法 |
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Publication Number | Publication Date |
---|---|
JPH11162875A true JPH11162875A (ja) | 1999-06-18 |
JP3189771B2 JP3189771B2 (ja) | 2001-07-16 |
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---|---|---|---|
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---|---|
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CN (1) | CN1218282A (ja) |
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Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2008258656A (ja) * | 2008-07-16 | 2008-10-23 | Renesas Technology Corp | 半導体装置の製造方法 |
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JP3191290B2 (ja) * | 1999-01-07 | 2001-07-23 | 日本電気株式会社 | 半導体装置の製造方法及び半導体装置の製造方法に用いられるプラズマcvd装置 |
US6524952B1 (en) * | 1999-06-25 | 2003-02-25 | Applied Materials, Inc. | Method of forming a titanium silicide layer on a substrate |
KR100681155B1 (ko) * | 2000-06-15 | 2007-02-09 | 주성엔지니어링(주) | 질화티타늄막 형성방법 |
JP5211503B2 (ja) * | 2007-02-16 | 2013-06-12 | 富士通セミコンダクター株式会社 | 半導体装置の製造方法 |
CN106943627B (zh) * | 2017-02-15 | 2020-10-27 | 北京华钽生物科技开发有限公司 | 高生物相容性纤维 |
US10714334B2 (en) | 2017-11-28 | 2020-07-14 | Taiwan Semiconductor Manufacturing Co., Ltd. | Conductive feature formation and structure |
US20230193473A1 (en) * | 2021-12-22 | 2023-06-22 | Intel Corporation | Titanium contact formation |
Family Cites Families (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH02148715A (ja) * | 1988-11-29 | 1990-06-07 | Canon Inc | 半導体デバイスの連続形成装置 |
US5834371A (en) * | 1997-01-31 | 1998-11-10 | Tokyo Electron Limited | Method and apparatus for preparing and metallizing high aspect ratio silicon semiconductor device contacts to reduce the resistivity thereof |
US5926737A (en) * | 1997-08-19 | 1999-07-20 | Tokyo Electron Limited | Use of TiCl4 etchback process during integrated CVD-Ti/TiN wafer processing |
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1997
- 1997-11-26 JP JP32504097A patent/JP3189771B2/ja not_active Expired - Fee Related
-
1998
- 1998-11-23 US US09/198,005 patent/US6174805B1/en not_active Expired - Fee Related
- 1998-11-25 CN CN98124972A patent/CN1218282A/zh active Pending
- 1998-11-26 KR KR1019980050946A patent/KR19990045603A/ko active IP Right Grant
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Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2008258656A (ja) * | 2008-07-16 | 2008-10-23 | Renesas Technology Corp | 半導体装置の製造方法 |
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---|---|
JP3189771B2 (ja) | 2001-07-16 |
CN1218282A (zh) | 1999-06-02 |
KR19990045603A (ko) | 1999-06-25 |
US6174805B1 (en) | 2001-01-16 |
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