JPH05211271A - 半導体装置 - Google Patents

半導体装置

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JPH05211271A
JPH05211271A JP1487792A JP1487792A JPH05211271A JP H05211271 A JPH05211271 A JP H05211271A JP 1487792 A JP1487792 A JP 1487792A JP 1487792 A JP1487792 A JP 1487792A JP H05211271 A JPH05211271 A JP H05211271A
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JP
Japan
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semiconductor device
island
package
chip
lead frame
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Pending
Application number
JP1487792A
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English (en)
Inventor
Kenji Iwata
健二 岩田
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NEC Corp
Original Assignee
NEC Corp
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Publication date
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    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/48Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • H01L2224/4805Shape
    • H01L2224/4809Loop shape
    • H01L2224/48091Arched
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
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    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/48Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
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    • H01L2224/48151Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
    • H01L2224/48221Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
    • H01L2224/48245Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being metallic
    • H01L2224/48247Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being metallic connecting the wire to a bond pad of the item

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  • Die Bonding (AREA)
  • Lead Frames For Integrated Circuits (AREA)

Abstract

(57)【要約】 【目的】樹脂封止型半導体装置を急熱する際に発生する
樹脂内部クラックの防止を目的とする。 【構成】半導体チップ1をダイマウントするためのリー
ドフレームのアイランド部2の面積を小さくすることに
より、半導体装置に占める封止用樹脂の容積比率を大き
くし、内部膨張に対する機械的強度を高める。

Description

【発明の詳細な説明】
【0001】
【産業上の利用分野】本発明は、樹脂封止型半導体装置
に関し、特にリードフレームに関する。
【0002】
【従来の技術】従来の樹脂封止型半導体装置のリードフ
レームのアイランド部2は、図2(a),(b)に示す
ように、ダイマウントされる半導体チップ1より大きな
サイズを有している。
【0003】
【発明が解決しようとする課題】この従来のリードフレ
ームでは、アイランド部の大きさが半導体チップより大
きいために半導体装置のパッケージ容積に占める封止用
樹脂の容積比が相対的に小さくなり、且つアイランド端
からパッケージ端までの距離が小さくなる。このため半
導体装置をボードアセンブリする際の熱ストレスによ
り、半導体装置のパッケージ内部にクラックが入り易い
という問題点があった。
【0004】
【課題を解決するための手段】本発明の半導体装置は、
リードフレームのアイランド部の面積が半導体チップの
面積より小さくなっており、半導体装置パッケージ容積
に占める封止用樹脂の容積比が大きくなっており、且つ
アイランド部端からパッケージ端までの距離が大きくな
っている。
【0005】
【実施例】次に本発明について図面を参照して説明す
る。図1(a)は、本発明の第1の実施例の半導体装置
の内部上面図であり、図1(b)は断面図である。半導
体チップ1は、リードフレームのアイランド部2にダイ
マウントされ、封止用樹脂3によりパッケージが構成さ
れている。本実施例では、リードフレームのアイランド
部2の面積が半導体チップ1の面積より小さくなってい
る。この構成により半導体装置に占める封止用樹脂の比
率が多くなるので樹脂クラックが生じにくくなる。
【0006】図3は本発明の第2の実施例の内部上面図
である。半導体チップ1はリードフレームのアイランド
部2’にダイマウントされている。本実施例のアイラン
ド部2’には複数のコ字形のくい込みが設けてある。こ
のようにアイランド部にくい込みを入れることにより上
記第1の実施例と同様の効果を得ている。なお、このく
い込みの形状、くい込みの個所及び箇数を変えても同様
の効果が得られることは言うまでもない。
【0007】
【発明の効果】以上説明したように本発明は、リードフ
レームアイランド部の面積を小さくすることにより、半
導体パッケージの容積に占める封止用樹脂の割合を大き
くし、半導体装置の急激な加熱時に予想される樹脂クラ
ックに際する機械的強度を上げるという効果を有する。
【図面の簡単な説明】
【図1】(a),(b)はそれぞれ本発明の第1の実施
例の上面図と断面図である。
【図2】(a),(b)は、それぞれ従来技術を用いた
半導体装置の上面図と断面図である。
【図3】本発明の第2の実施例の上面図である。
【符号の説明】
1 半導体チップ 2,2′ リードフレームアイランド部 3 封止用樹脂

Claims (1)

    【特許請求の範囲】
  1. 【請求項1】 樹脂封止型の半導体装置において、半導
    体チップのダイマウント用のアイランドの面積が半導体
    チップの面積より小さいことを特徴とする半導体装置。
JP1487792A 1992-01-30 1992-01-30 半導体装置 Pending JPH05211271A (ja)

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Date Code Title Description
A02 Decision of refusal

Free format text: JAPANESE INTERMEDIATE CODE: A02

Effective date: 19980113