JP5559823B2 - デジタル/アナログコンバータ - Google Patents
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Description
第3及び第4ビットが「00」のときは、下位デコーダ21は、スイッチS22及びS33をオンにする。
第3及び第4ビットが「01」のときは、下位デコーダ21は、スイッチS21、S22及びS33をオンにする。
第3及び第4ビットが「10」のときは、下位デコーダ21は、スイッチS21、S22及びS32をオンにする。
第3及び第4ビットが「11」のときは、下位デコーダ21は、スイッチS21、S22及びS31をオンにする。
第3及び第4ビットが「00」のときは、下位デコーダ21は、スイッチS22及びS31をオンにする。
第3及び第4ビットが「01」のときは、下位デコーダ21は、スイッチS21、S22及びS31をオンにする。
第3及び第4ビットが「10」のときは、下位デコーダ21は、スイッチS21、S22及びS32をオンにする。
第3及び第4ビットが「11」のときは、下位デコーダ21は、スイッチS21、S22及びS33をオンにする。
入力されたデジタル信号が「0110」の場合、下位デコーダ21は、スイッチS21、S22及びS32をオンにするので、出力端T31の電圧は6V/16となる。
入力されたデジタル信号が「0111」の場合、下位デコーダ21は、スイッチS21、S22及びS33をオンにするので、出力端T31の電圧は7V/16となる。
S11、S12、S13、S14 第1スイッチ
S21、S22 第2スイッチ
S31、S32、S33 第3スイッチ
S51、S52、S53、S54、S55、S61、S62、S63,S64 スイッチ
T11、T12、T13、T14、T15、T21、T22、T23、T31 端子
V11 電源
A11 オペアンプ
1 デコーダ
11 上位デコーダ
21 下位デコーダ
Claims (2)
- 直列に接続され、電圧が印加されるN個(N:2以上の整数)の抵抗と、
オン抵抗を有し、前記N個の抵抗夫々の両端に夫々が接続されたN+1個の第1スイッチと、
入力された複数ビットのデジタル信号に従って、特定の抵抗の両端に接続された2つの第1スイッチを選択的にオンにするよう制御するデコーダと、
オンにされた前記2つの第1スイッチを通じてアナログ電圧が出力される出力端とを備えたデジタル/アナログコンバータにおいて、
前記第1スイッチ夫々と等しい値のオン抵抗を有し、前記N+1個の第1スイッチ夫々を介して、前記N個の抵抗夫々の両端と1個又は直列に接続されたM個(M:2以上の整数)の両端とが接続された第2スイッチと、
1個又はM個の第2スイッチ夫々の両端に各一端が接続され、前記出力端に他端が接続された2個又はM+1個の第3スイッチとを備え、
前記デコーダは、入力されたデジタル信号に従って、第2及び第3スイッチのうち複数個のスイッチを選択的にオンにするよう制御するようにしてある
ことを特徴とするデジタル/アナログコンバータ。 - 前記第2スイッチ夫々のオン抵抗の値は前記抵抗の値より大きい
ことを特徴とする請求項1に記載のデジタル/アナログコンバータ。
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JP2012008259A JP5559823B2 (ja) | 2012-01-18 | 2012-01-18 | デジタル/アナログコンバータ |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
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JP2012008259A JP5559823B2 (ja) | 2012-01-18 | 2012-01-18 | デジタル/アナログコンバータ |
Publications (2)
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JP2013150119A JP2013150119A (ja) | 2013-08-01 |
JP5559823B2 true JP5559823B2 (ja) | 2014-07-23 |
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Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
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JP2012008259A Active JP5559823B2 (ja) | 2012-01-18 | 2012-01-18 | デジタル/アナログコンバータ |
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2012
- 2012-01-18 JP JP2012008259A patent/JP5559823B2/ja active Active
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