JP5104712B2 - 送信装置 - Google Patents
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Description
図2(A)はパルス無線通信システムの構成例を示す図であり、図2(B)はバンドパスフィルタ103の通過帯域を示す図である。パルス無線通信システムは、ベースバンド信号生成器201、パルス発生器202、バンドパスフィルタ103、送信アンプ104、スイッチ205、アンテナ206、受信アンプ207、バンドパスフィルタ208、検波器209及びベースバンド信号再生器210を有する。ベースバンド信号生成器201、インパルス発生器202、バンドパスフィルタ103及び送信アンプ104は、送信装置を構成する。これに対し、ベースバンド信号再生器210、検波器209、バンドパスフィルタ208及び受信アンプ207は、受信装置を構成する。
図1は本発明の第1の実施形態による送信装置の構成例を示す図であり、図4はその送信回路の動作例を示すタイミングチャートである。この送信装置以外の部分は、図2(A)のパルス無線通信システムと同じである。送信装置は、1個の半導体チップ110上に、ノンリターンゼロ/リターンゼロ変換部101、パルス生成部102、バンドパスフィルタ103、送信アンプ104、ローレベル(ゼロ)検出部105、遅延器106及び積分器107が設けられる。なお、バンドパスフィルタ103及び送信アンプ104は、半導体チップ110の外に設けてもよい。ノンリターンゼロ/リターンゼロ変換部101、パルス生成部102、バンドパスフィルタ103及び送信アンプ104のうちの2以上が1個の半導体チップ110上に設けられることが好ましい。
図9は本発明の第2の実施形態による送信装置の構成例を示す図であり、図10はその送信回路の動作例を示すタイミングチャートである。この送信装置以外の部分は、図2(A)のインパルス無線通信システムと同じである。本実施形態(図9)は、第1の実施形態(図1)に対して、トラックアンドホールド回路901を追加したものである。以下、本実施形態が第1の実施形態と異なる点を説明する。
図12(A)は制御回路の構成例を示す回路図、図12(B)は制御回路の動作例を示すタイミングチャートである。この制御回路は、第1の実施形態(図1)及び第2の実施形態(図9)のゼロ検出部105、遅延器106及び積分器107に対応し、データA及びクロック信号Bを入力し、制御信号Iを出力する。第1の実施形態及び第2の実施形態のゼロ検出部105、遅延器106及び積分器107を図12(A)の制御回路に置き換えることができる。
図14は、本発明の第4の実施形態による送信装置の構成例を示す図である。この送信装置以外の部分は、図2(A)のインパルス無線通信システムと同じである。本実施形態(図14)は、第1の実施形態(図1)に対して、ゼロ検出部105、遅延器106及び積分器107を削除し、遅延器1401、データ比較器1402、RAM1403及びデジタル/アナログ変換器1404を追加したものである。以下、本実施形態が第1の実施形態と異なる点を説明する。
図15は、本発明の第5の実施形態によるパルスレーダシステム内の送信装置の構成例を示す図である。この送信装置以外の部分は、図2(A)のインパルス無線通信システムと同様である。本実施形態(図15)は、第1の実施形態(図1)に対して、ゼロ検出部105、遅延器106及び積分器107を削除し、コード生成部1501、遅延器1502及びデジタル/アナログ変換器1404を追加したものである。以下、本実施形態が第1の実施形態と異なる点を説明する。
データの信号と前記データの信号を遅延させた信号を用いてパルスを生成し、そのパルスのそれぞれが、前記データの系列に応じたパルス幅になるようにパルスを生成するパルス生成部と、
前記パルスをフィルタリングするバンドパスフィルタと、
前記フィルタリングされたパルスを増幅して送信信号として出力する送信アンプと
を有することを特徴とする送信装置。
(付記2)
さらに、前記データがローレベルのときには容量を積分して充電し、前記データがハイレベルのときには前記容量を放電させ、前記容量の電圧に基づく制御信号を出力する積分器を有し、
前記パルス生成部は、前記制御信号に応じたパルス幅のパルスを生成することを特徴とする付記1記載の送信装置。
(付記3)
さらに、前記ノンリターン信号のデータのローレベルを検出してローレベル検出信号を出力するローレベル検出部と、
前記ローレベル検出信号を遅延させる遅延器を有し、
前記積分器は、前記遅延させられたローレベル検出信号を基に積分することを特徴とする付記2記載の送信装置。
(付記4)
前記積分器は、前記データが複数回連続してローレベルになると前記容量が飽和し、前記データが1回ハイレベルになると前記容量が放電し尽くすことを特徴とする付記2又は3記載の送信装置。
(付記5)
前記パルス生成部は、前記データが複数回連続してハイレベルになるときのパルス幅に比べて、前記データがローレベルからハイレベルに変化するときのパルス幅が広くなるようにパルス幅を制御することを特徴とする付記1〜4のいずれか1項に記載の送信装置。
(付記6)
さらに、前記データをラッチする第1のフリップフロップ回路と、
前記データをラッチする第2のフリップフロップ回路と、
前記第2のフリップフロップ回路が出力するデータをラッチする第3のフリップフロップ回路と、
前記第1及び第3のフリップフロップ回路の出力信号の排他的論理和信号を出力する排他的論理和回路とを有し、
前記パルス生成部は、前記排他的論理和信号に応じたパルス幅のパルスを生成することを特徴とする付記1記載の送信装置。
(付記7)
さらに、前記データの系列と制御信号との対応関係を記憶するテーブルと、
前記パルス生成部は、前記制御信号に応じたパルス幅のパルスを生成することを特徴とする付記1記載の送信装置。
(付記8)
さらに、自己識別用コードを生成し、前記自己識別用コードを前記データとして出力するコード生成部を有することを特徴とする付記1記載の送信装置。
(付記9)
さらに、データをノンリターンゼロ信号からリターンゼロ信号に変換し、前記リターンゼロ信号をデータ信号として前記パルス生成部に出力するノンリターンゼロ/リターンゼロ変換部を有することを特徴とする付記1記載の送信装置。
(付記10)
データの信号に応じてパルスを生成するパルス生成部と、
前記パルスをフィルタリングするバンドパスフィルタと、
前記データの系列に応じた増幅率で、前記フィルタリングされたパルスを増幅して送信信号として出力する送信アンプと
を有することを特徴とする送信装置。
(付記11)
さらに、前記データがローレベルのときには容量を積分して充電し、前記データが第2の論理レベルのときには前記容量を放電させ、前記容量の電圧に基づく制御信号を出力する積分器を有し、
前記送信アンプは、前記制御信号に応じた増幅率で増幅することを特徴とする付記10記載の送信装置。
(付記12)
さらに、前記積分器により出力される制御信号をトラックアンドホールドし、前記送信アンプに出力するトラックアンドホールド回路を有することを特徴とする付記11記載の送信装置。
(付記13)
さらに、前記ノンリターン信号のデータのローレベルを検出してローレベル検出信号を出力するローレベル検出部と、
前記ローレベル検出信号を遅延させる遅延器を有し、
前記積分器は、前記遅延させられたローレベル検出信号を基に積分することを特徴とする付記12記載の送信装置。
(付記14)
前記積分器は、前記データが複数回連続してローレベルになると前記容量が飽和し、前記データが1回ハイレベルになると前記容量が放電し尽くすことを特徴とする付記11〜13のいずれか1項に記載の送信装置。
(付記15)
前記送信アンプは、前記データが複数回連続してハイレベルになるときの増幅率に比べて、前記データがローレベルからハイレベルに変化するときの増幅率が大きくなるように増幅率を制御することを特徴とする付記10〜14のいずれか1項に記載の送信装置。
(付記16)
さらに、前記データをラッチする第1のフリップフロップ回路と、
前記データをラッチする第2のフリップフロップ回路と、
前記第2のフリップフロップ回路が出力するデータをラッチする第3のフリップフロップ回路と、
前記第1及び第3のフリップフロップ回路の出力信号の排他的論理和信号を出力する排他的論理和回路とを有し、
前記送信アンプは、前記排他的論理和信号に応じた増幅率で増幅することを特徴とする付記10記載の送信装置。
(付記17)
さらに、前記排他的論理和回路により出力される排他的論理和信号をトラックアンドホールドし、前記送信アンプに出力するトラックアンドホールド回路を有することを特徴とする付記16記載の送信装置。
(付記18)
さらに、前記データの系列と制御信号との対応関係を記憶するテーブルと、
前記送信アンプは、前記制御信号に応じた増幅率で増幅することを特徴とする付記10記載の送信装置。
(付記19)
さらに、自己識別用コードを生成し、前記自己識別用コードを前記データとして出力するコード生成部を有することを特徴とする付記10記載の送信装置。
(付記20)
さらに、データをノンリターンゼロ信号からリターンゼロ信号に変換し、前記リターンゼロ信号をデータ信号として前記パルス生成部に出力するノンリターンゼロ/リターンゼロ変換部を有することを特徴とする付記10記載の送信装置。
102 パルス生成部
103 バンドパスフィルタ
104 送信アンプ
105 ローレベル(ゼロ)検出部
106 遅延器
107 積分器
Claims (4)
- データの信号と前記データの信号を遅延させた信号を用いてパルスを生成し、そのパルスのそれぞれが、前記データの系列に応じたパルス幅になるようにパルスを生成するパルス生成部と、
前記パルスをフィルタリングするバンドパスフィルタと、
前記フィルタリングされたパルスを増幅して送信信号として出力する送信アンプと、
前記データがローレベルのときには容量を積分して充電し、前記データがハイレベルのときには前記容量を放電させ、前記容量の電圧に基づく制御信号を出力する積分器とを有し、
前記パルス生成部は、前記制御信号に応じたパルス幅のパルスを生成することを特徴とする送信装置。 - データの信号と前記データの信号を遅延させた信号を用いてパルスを生成し、そのパルスのそれぞれが、前記データの系列に応じたパルス幅になるようにパルスを生成するパルス生成部と、
前記パルスをフィルタリングするバンドパスフィルタと、
前記フィルタリングされたパルスを増幅して送信信号として出力する送信アンプとを有し、
前記パルス生成部は、前記データが複数回連続してハイレベルになるときのパルス幅に比べて、前記データがローレベルからハイレベルに変化するときのパルス幅が広くなるようにパルス幅を制御することを特徴とする送信装置。 - データの信号と前記データの信号を遅延させた信号を用いてパルスを生成し、そのパルスのそれぞれが、前記データの系列に応じたパルス幅になるようにパルスを生成するパルス生成部と、
前記パルスをフィルタリングするバンドパスフィルタと、
前記フィルタリングされたパルスを増幅して送信信号として出力する送信アンプと、
前記データをラッチする第1のフリップフロップ回路と、
前記データをラッチする第2のフリップフロップ回路と、
前記第2のフリップフロップ回路が出力するデータをラッチする第3のフリップフロップ回路と、
前記第1及び第3のフリップフロップ回路の出力信号の排他的論理和信号を出力する排他的論理和回路とを有し、
前記パルス生成部は、前記排他的論理和信号に応じたパルス幅のパルスを生成することを特徴とする送信装置。 - データの信号と前記データの信号を遅延させた信号を用いてパルスを生成し、そのパルスのそれぞれが、前記データの系列に応じたパルス幅になるようにパルスを生成するパルス生成部と、
前記パルスをフィルタリングするバンドパスフィルタと、
前記フィルタリングされたパルスを増幅して送信信号として出力する送信アンプと、
前記データの系列と制御信号との対応関係を記憶するテーブルとを有し、
前記パルス生成部は、前記制御信号に応じたパルス幅のパルスを生成することを特徴とする送信装置。
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