JP4845368B2 - 半導体装置及びその製造方法 - Google Patents
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Claims (16)
- 半導体チップと、
前記半導体チップの表面上に形成されたパッド電極と、
前記パッド電極上に形成された高融点金属層と、
前記パッド電極及び前記高融点金属層上を覆うようにして前記半導体チップの表面上に形成されたパッシベーション層と、
前記半導体チップの裏面から当該パッド電極に到達するビアホールと、
前記ビアホール内に形成され、かつ当該ビアホールの底部のパッド電極と電気的に接続された貫通電極と、を備えることを特徴とする半導体装置。 - 半導体チップと、
前記半導体チップの表面上に形成されたパッド電極と、
前記パッド電極上に形成された高融点金属層と、
前記パッド電極及び前記高融点金属層上を覆うようにして前記半導体チップの表面上に形成されたパッシベーション層と、
前記パッシベーション層が形成された前記半導体チップ上に接着された支持体と、
前記半導体チップの裏面から当該パッド電極に到達するビアホールと、
前記ビアホール内に形成され、かつ当該ビアホールの底部のパッド電極と電気的に接続された貫通電極と、を備えることを特徴とする半導体装置。 - 前記ビアホールの底部の開口径が前記パッド電極の平面的な幅より広くなるように形成されることを特徴とする請求項1または請求項2に記載の半導体装置。
- 前記高融点金属層は、チタン、チタン合金、タンタル、タンタル合金のうちいずれか1つを含むことを特徴とする請求項1乃至請求項3のいずれかに記載の半導体装置。
- 前記パッシベーション層は、シリコン酸化膜もしくはシリコン窒化膜から成ることを特徴とする請求項1乃至請求項4のいずれかに記載の半導体装置。
- 前記貫通電極と電気的に接続されて前記半導体チップの裏面上に延びる配線層と、
前記配線層を含む半導体チップ上に、当該配線層の一部上を露出するように形成された保護層と、を備えることを特徴とする請求項1乃至請求項5のいずれかに記載の半導体装置。 - 前記配線層の一部上に導電端子を備えることを特徴とする請求項6に記載の半導体装置。
- 前記高融点金属の硬さは、前記パッシベーション膜の硬さより大きく、かつ前記パッド電極の硬さより小さいという関係を満たしていることを特徴とする請求項1乃至請求項7のいずれかに記載の半導体装置。
- 半導体基板の表面上に形成されたパッド電極上に、高融点金属層を形成する工程と、
前記パッド電極及び前記高融点金属層上を含む半導体基板の表面上に、パッシベーション層を形成する工程と、
前記半導体基板の裏面から当該パッド電極に到達するビアホールを形成する工程と、
前記ビアホール内に、当該底部で前記パッド電極と電気的に接続された貫通電極を形成する工程と、
前記半導体基板を複数の半導体チップに切断分離する工程と、を有することを特徴とする半導体装置の製造方法。 - 半導体基板の表面上に形成されたパッド電極上に、高融点金属層を形成する工程と、
前記パッド電極及び前記高融点金属層上を含む半導体基板の表面上に、パッシベーション層を形成する工程と、
前記パッシベーション層が形成された前記半導体基板上に支持体を接着する工程と、
前記半導体基板の裏面から当該パッド電極に到達するビアホールを形成する工程と、
前記ビアホール内に、当該底部で前記パッド電極と電気的に接続された貫通電極を形成する工程と、
前記半導体基板を複数の半導体チップに切断分離する工程と、を有することを特徴とする半導体装置の製造方法。 - 前記ビアホールの底部の開口径が前記パッド電極の平面的な幅より広くなるように形成されることを特徴とする請求項9または請求項10に記載の半導体装置の製造方法。
- 前記高融点金属層は、チタン、チタン合金、タンタル、タンタル合金のうちいずれか1つを含むことを特徴とする請求項9乃至請求項11のいずれかに記載の半導体装置の製造方法。
- 前記パッシベーション層は、シリコン酸化膜もしくはシリコン窒化膜から成ることを特徴とする請求項9乃至請求項12に記載の半導体装置の製造方法。
- 前記貫通電極と電気的に接続されて前記半導体基板の裏面上に延びる配線層を形成する工程と、
前記配線層を含む半導体基板上に、当該配線層の一部上を露出するようにして保護層を形成する工程と、を有することを特徴とする請求項9乃至請求項13のいずれかに記載の半導体装置の製造方法。 - 前記配線層の一部上に導電端子を形成する工程を有することを特徴とする請求項14に記載の半導体装置の製造方法。
- 前記高融点金属の硬さは、前記パッシベーション膜の硬さより大きく、かつ前記パッド電極の硬さより小さいという関係を満たしていることを特徴とする請求項9乃至請求項15のいずれかに記載の半導体装置の製造方法。
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