JP4474821B2 - シフトレジスタ、データ線駆動回路および走査線駆動回路 - Google Patents
シフトレジスタ、データ線駆動回路および走査線駆動回路 Download PDFInfo
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Description
【発明の属する技術分野】
本発明は、複数の走査線及び複数のデータ線と、それらの交差に対応してマトリックス状に配置された画素電極及びスイッチング素子とを有する電気光学パネルを駆動するために用いられるシフトレジスタ、これを用いたデータ線駆動回路および走査線駆動回路に関する。
【0002】
【従来の技術】
従来の電気光学装置、例えば、液晶装置の駆動回路は、画像表示領域に配線されたデータ線や走査線などに、データ線信号や走査信号などを所定タイミングで供給するためのデータ線駆動回路や、走査線駆動回路などから構成されている。
【0003】
データ線駆動回路の基本構成は、入力される画像信号がアナログ信号かデジタル信号かによって相違する。ただし、いずれの場合であっても、データ線駆動回路は、水平走査期間の最初に供給される転送信号をクロック信号に応じて順次シフトするシフトレジスタを備えている。
【0004】
このシフトレジスタとして、特開平10−199284号公報には図13に示す回路が開示されている。このシフトレジスタは、基本ユニットが多段接続され、各基本ユニットはクロック信号HCKとこれを反転した反転クロック信号HCKXによって駆動される。ここで、第n段目の基本ユニットUnは、インバータINV1,INV2,INV3、ノア回路NOR、および制御電圧がローレベルでオン状態となりハイレベルでオフ状態となるスイッチSWa,SWbから構成されている。インバータINV1,INV2は、制御電圧がハイレベルのときに各入力信号を反転して出力し、制御電圧がローレベルのときに出力端子をハイインピーダンス状態にする。
【0005】
このような回路において、インバータINV1,INV2は常に動作する必要はなく、信号Dnがアクティブとなっている期間または信号Dn+1がアクティブとなっている期間のみ動作すれば足りる。このため、ノア回路NORは、信号Dnと信号Dn+1の反転論理和を算出し、算出結果に基づいてスイッチSWa,SWbを制御している。この結果、クロック信号HCKおよび反転クロック信号HCKXは、所定期間においてのみインバータINV1,INV2に供給される。
【0006】
したがって、シフトレジスタを構成する各基本ユニットにクロック信号HCKおよび反転クロック信号HCKXを供給する期間を制限することができる。この結果、シフトレジスタの消費電力を低減させることが可能となる。
【0007】
【発明が解決しようとする課題】
図14は従来のシフトレジスタのタイミングチャートである。このシフトレジスタにおいて、信号Dnがローレベルからハイレベルに立ち上がると、信号DnはインバータINV1とインバータINV3とを経由して伝送され、信号Dn+1として出力される。すなわち、信号Dn+1の立ち上がりエッジE1は、インバータINV1による遅延と、インバータINV3を構成するトランジスタの応答特性の影響をうける。このため、同図に示すように立ち上がりエッジE1は、本来の立ち上がり時刻t1よりも遅れ、しかも立上時間が長くなる。
【0008】
一方、信号Dn+1の立ち下がりエッジE2は、インバータINV1による遅延と、インバータINV2を構成するトランジスタの応答特性の影響をうける。このため、同図に示すように立ち上がりエッジE1は、本来の立ち上がり時刻t1よりも遅れ、しかも立下時間が長くなる。信号Dn+2についても同様に立ち上がりエッジと立下がりがエッジが遅延するとともに、それらの傾斜が緩やかになる。
【0009】
基本ユニットUn+1のノア回路NORの出力信号は、信号Dn+1と信号Dn+2に基づいて生成されるから、その信号波形は、同図に示すようにクロック信号HCKおよび反転クロック信号HCKXのエッジから遅れてしまう。このため、インバータINV1およびINV2に供給されるクロック信号CKAおよび反転クロック信号CKBは、ノア回路NORによってゲートされ、図示するように一部が欠落してまう。
【0010】
すなわち、従来のシフトレジスタでは、データ転送方向が、単方向あるいは単一方向にしか対応しておらず、また、動作マージンが低下し、誤動作し易いといった問題があった。
【0011】
本発明は、上述した事情に鑑みてなされたものであり、その目的は、シフトレジスタの動作マージンを増やし、これを安定して動作させる点にある。
【0012】
【課題を解決するための手段】
上記目的を達成するために、本発明に係るシフトレジスタは、複数の走査線と、複数のデータ線と、前記走査線と前記データ線との交差に対応してマトリックス状に配置された画素電極およびスイッチング素子とを有する電気光学パネルを駆動する駆動回路に用いられ、開始パルスを順次シフトすることによって、前記データ線または前記走査線を選択するための選択信号を順次生成するものであって、クロック信号とこれを反転した反転クロック信号に同期して前記開始パルスを順次シフトして出力信号を出力するとともに転送方向を指示する転送方向信号に基づいて前記開始パルスの転送方向を制御可能な複数のシフト単位回路を縦続接続したシフト手段と、前記各シフト単位回路に各々対応して設けられ、前記クロック信号および前記反転クロック信号に基づいて第1制御信号および第2制御信号を生成する複数の制御単位回路を有するクロック信号制御手段とを備え、前記転送方向信号は、転送方向制御信号と前記転送方向制御信号を反転した反転転送方向制御信号とを含み、前記シフト単位回路は、前段のシフト単位回路と一方の端子が接続され、中間接続点と他方の端子が接続される第1論理回路と、前記中間接続点と一方の端子が接続され、後段のシフト単位回路と他方の端子が接続される第2論理回路とを備え、前記転送方向信号が前段から後段に向けて前記開始パルスを転送することを指示する場合、前記第1論理回路は前記第1制御信号によって制御されるサンプリング回路として機能するとともに前記第2論理回路は保持回路として機能し、前記転送方向信号が後段から前段に向けて前記開始パルスを転送することを指示する場合、前記第1論理回路は保持回路として機能するとともに前記第2論理回路は前記第2制御信号によって制御されるサンプリング回路として機能し、前記制御単位回路は、当該制御単位回路と対応するシフト単位回路に対して、前段のシフト単位回路の前記中間接続点における信号電圧と後段のシフト単位回路の前記中間接続点における信号電圧とのうち、いずれか一方がアクティブになる選択期間に、前記クロック信号および前記反転クロック信号を前記第1制御信号または前記第2制御信号として出力し、
前記制御単位回路は、当該制御単位回路と対応するシフト単位回路に対して、前段のシフト単位回路の前記中間接続点における信号電圧と後段のシフト単位回路の前記中間接続点における信号電圧とがともに非アクティブになる選択期間に、前記転送方向制御信号および前記反転転送方向制御信号を前記第1制御信号または前記第2制御信号として出力する、ことを特徴とする。
【0013】
この発明によれば、制御単位回路は、前段および後段のシフト単位回路における中間接続点の信号電圧に基づいて、クロック信号および反転クロック信号をシフト単位回路に供給するか否かを制御することになる。中間接続点の信号電圧の変化は、第1または第2論理回路がクロックドインバータとして機能し、その出力信号がアクティブから非アクティブに遷移するとき、あるいは非アクティブからアクティブに遷移するときに生じ、その遷移タイミングはクロック信号と反転クロック信号に直接同期している。したがって、制御単位回路は、少ない遅延時間でクロック信号および反転クロック信号をシフト単位回路に供給することが可能となる。くわえて、クロック信号および反転クロック信号の供給に際して他のインバータの応答特性の影響を受けない。この結果、動作マージンを拡大させることができ、シフトレジスタの信頼性を高めることができる。さらに、クロック制御単位回路は、前段および後段のシフト単位回路における中間接続点の信号電圧に基づいて、クロック信号および反転クロック信号をシフト単位回路に供給するか否かを制御するから、クロック信号の周波数が高くともシフト手段をクロック信号および反転クロック信号を確実に供給できる。
【0014】
より具体的には、転送方向制御信号とこれを反転した反転転送方向制御信号とを含み、前記シフト単位回路は、中間接続点を介して相互に接続され、制御入力端子に供給される信号がアクティブのときインバータとして動作する一方、当該信号が非アクティブのとき出力端子をハイインピーダンス状態とする第1乃至第4インバータを備え、前記第1インバータは、入力端子が前段のシフト単位回路と接続され、出力端子が中間接続点と接続され、前記制御単位回路から前記第1制御信号が制御入力端子に供給され、前記第2インバータは、入力端子が後段のシフト単位回路と接続され、出力端子が前記中間接続点と接続され、前記制御単位回路から前記第2制御信号が制御入力端子に供給され、前記第3インバータは、入力端子が前記中間接続点と接続され、出力端子が前記第1インバータの入力端子と接続され、前記反転転送方向制御信号が制御入力端子に供給され、前記第4インバータは、入力端子が前記中間接続点と接続され、出力端子が前記第2インバータの入力端子に接続され、前記転送方向制御信号が制御入力端子に供給され、前記第1論理回路は、前記第1インバータおよび前記第3インバータを備え、前記第2論理回路は、前記第2インバータおよび前記第4インバータを備えることが好ましい。
【0015】
また、前記クロック信号制御手段を構成する複数の単位制御回路のうち、奇数段の単位制御回路は、前記選択期間に、前記クロック信号を前記第1制御信号として出力するとともに前記反転クロック信号を前記第2制御信号として出力し、偶数段の単位制御回路は、前記選択期間に、前記反転クロック信号を前記第1制御信号として出力するとともに前記クロック信号を前記第2制御信号として出力することが好ましい。これにより、開始パルスが順次転送されることになる。
【0016】
また、前記シフト手段に含まれる前記シフト単位回路の数および前記クロック信号制御手段に含まれる前記単位制御回路の数は偶数個であることが好ましい。これにより、シフト手段おびクロック信号制御手段を、初段側から見ても終段側から見ても対称に構成することができ、双方向に開始パルスを転送することが可能となる。
【0017】
また、前記制御単位回路は、当該制御単位回路と対応するシフト単位回路に対して、前段のシフト単位回路の前記中間接続点における信号電圧と後段のシフト単位回路の前記中間接続点における信号電圧とに基づいて、各信号電圧のうちいずれか一方がアクティブになる期間にアクティブとなる出力信号を出力する論理回路と、前記論理回路の出力信号に基づいて、前記クロック信号または前記反転クロック信号を、前記第1インバータに供給する第1トランスファーゲートおよび前記第2インバータに供給する第2トランスファーゲートと、前記論理回路の出力信号に基づいて、当該出力信号が非アクティブの期間に前記第1インバータの制御入力端子に前記反転転送方向制御信号を供給する第3トランスファーゲートと、前記論理回路の出力信号に基づいて、当該出力信号が非アクティブの期間に前記第2インバータの制御入力端子に転送方向制御信号を供給する第4トランスファーゲートとを備えることが好ましい。
【0018】
さらに、前記開始パルスがハイレベルでアクティブとなるならば、前記論理回路はナンド回路で構成することが好ましく、一方、前記開始パルスがローレベルでアクティブとなるならば、前記論理回路はノア回路で構成することが好ましい。
【0019】
次に、本発明に係るデータ線駆動回路は、上述したシフトレジスタを備え、当該シフトレジスタから出力される前記選択信号に基づいて、入力画像信号をサンプリングし、サンプリング結果に基づいて各データ線を駆動するものである。これにより、データ線の選択動作にマージンを持たせることができ、高い信頼性の下にデータ線を駆動することが可能となる。
【0020】
次に、本発明に係る走査線駆動回路は、上述したシフトレジスタを備え、当該シフトレジスタから出力される前記選択信号に基づいて、前記各走査線を駆動するものである。これにより、データ線の選択動作にマージンを持たせることができ、高い信頼性の下にデータ線を駆動することが可能となる。
【0021】
次に、本発明に係る電気光学パネルにあっては、複数の走査線と、複数のデータ線と、前記走査線と前記データ線との交差に対応してマトリックス状に配置された画素電極及びスイッチング素子とを有する画素領域と、上述したデータ線駆動回路と前記走査線を駆動するための走査線駆動回路とを備えることを特徴とする。また、本発明に係る電気光学パネルにあっては、複数の走査線と、複数のデータ線と、前記走査線と前記データ線との交差に対応してマトリックス状に配置された画素電極及びスイッチング素子とを有する画素領域と、前記データ線を駆動するためのデータ線駆動回路と、上述した走査線駆動回路とを備えたことを特徴とする。これらの電気光学パネルによれば、高い信頼性の下に画像を表示させることができる。また、これらの構成によれば、電気光学パネル上に駆動回路が作り込まれるものとなる。この場合、画素領域に構成されるスイッチング素子は薄膜トランジスタであり、駆動回路も薄膜トランジスタで構成することが望ましい。
【0022】
次に、本発明の電子機器は、上述した電気光学パネルを備えることを特徴とするものであり、例えば、ビデオカメラに用いられるビューファインダ、携帯電話機、ノート型コンピュータ、ビデオプロジェクタ等が該当する。
【0023】
【発明の実施の形態】
以下、本発明の実施形態について図面を参照して説明する。
【0024】
<1:液晶装置の全体構成>
【0025】
まず、本発明に係る電気光学装置として、電気光学材料として液晶を用いた液晶装置を一例にとって説明する。液晶装置は、主要部として液晶パネルAAを備える。液晶パネルAAは、スイッチング素子として薄膜トランジスタ(Thin Film Transistor:以下、「TFT」と称する)を形成した素子基板と対向基板とを互いに電極形成面を対向させて、かつ、一定の間隙を保って貼付し、この間隙に液晶が挟持されている。
【0026】
図1は実施形態に係る液晶装置の全体構成を示すブロック図である。この液晶装置は、液晶パネルAA、タイミング発生回路300および画像処理回路400を備える。液晶パネルAAは、その素子基板上に画像表示領域A、走査線駆動回路100、データ線駆動回路200、サンプリング回路240および画像信号供給線L1〜L3を備える。
【0027】
この液晶装置に供給される入力画像データDは、例えば、3ビットパラレルの形式である。タイミング発生回路300は、入力画像データDに同期してYクロック信号YCK、反転Yクロック信号YCKB、Xクロック信号XCK、反転Xクロック信号XCKB、Y転送開始パルスDY、X転送開始パルスDX、転送方向制御信号DIRおよび反転転送方向制御信号DIRBを生成して、走査線駆動回路100およびデータ線駆動回路200に供給する。また、タイミング発生回路300は、画像処理回路400を制御する各種のタイミング信号を生成し、これを出力する。
【0028】
ここで、Yクロック信号YCKは、走査線2を選択する期間を特定し、反転Yクロック信号YCKBはYクロック信号YCKの論理レベルを反転したものである。Xクロック信号XCKは、データ線3を選択する期間を特定し、反転Xクロック信号XCKBはXクロック信号XCKの論理レベルを反転したものである。また、Y転送開始パルスDYは走査線2の選択開始を指示するパルスであり、一方、X転送開始パルスDXはデータ線3の選択開始を指示するパルスである。さらに、転送方向制御信号DIRは、走査線2およびデータ線3の選択順序を指示する信号である。その論理レベルがハイレベルのとき、転送方向制御信号DIRは、各走査線2を上から下に順次選択するとともに各データ線3を左から右に選択することを指示する。一方、その論理レベルがローレベルのとき、転送方向制御信号DIRは、各走査線2を下から上に順次選択するとともに各データ線3を右から左に選択することを指示する。
【0029】
この例では、走査線駆動回路100およびデータ線駆動回路200に対して、共通の転送方向制御信号DIRおよび反転転送方向制御信号DIRBを供給しているが、タイミング発生回路300において、走査線の選択用の信号とデータ線の選択用の信号とを個別に生成して、これらを走査線駆動回路100およびデータ線駆動回路200に供給してもよいことは勿論である。
【0030】
画像処理回路400は、入力画像データDに、液晶パネルの光透過特性を考慮したガンマ補正等を施した後、RGB各色の画像データをD/A変換して、画像信号40R、40G、40Bを生成して液晶パネルAAに供給する。
【0031】
<1−2:画像表示領域>
【0032】
次に、画像表示領域Aには、図1に示されるように、m(mは2以上の自然数)本の走査線2が、X方向に沿って平行に配列して形成される一方、n(nは2以上の自然数)本のデータ線3が、Y方向に沿って平行に配列して形成されている。そして、走査線2とデータ線3との交差付近においては、TFT50のゲートが走査線2に接続される一方、TFT50のソースがデータ線3に接続されるとともに、TFT50のドレインが画素電極6に接続される。そして、各画素は、画素電極6と、対向基板に形成される対向電極(後述する)と、これら両電極間に挟持された液晶とによって構成される。この結果、走査線2とデータ線3との各交差に対応して、画素はマトリクス状に配列されることとなる。
【0033】
また、TFT50のゲートが接続される各走査線2には、走査信号Y1、Y2、…、Ymが、パルス的に線順次で印加されるようになっている。このため、ある走査線2に走査信号が供給されると、当該走査線に接続されるTFT50がオンするので、データ線3から所定のタイミングで供給される画像信号X1、X2、…、Xnは、対応する画素に順番に書き込まれた後、所定の期間保持されることとなる。
【0034】
各画素に印加される電圧レベルに応じて液晶分子の配向や秩序が変化するので、光変調による階調表示が可能となる。例えば、液晶を通過する光量は、ノーマリーホワイトモードであれば、印加電圧が高くなるにつれて制限される一方、ノーマリーブラックモードであれば、印加電圧が高くなるにつれて緩和されるので、液晶装置全体では、画像信号に応じたコントラストを持つ光が各画素毎に出射される。このため、所定の表示が可能となる。
【0035】
また、保持された画像信号がリークするのを防ぐために、蓄積容量51が、画素電極6と対向電極との間に形成される液晶容量と並列に付加される。例えば、画素電極6の電圧は、ソース電圧が印加された時間よりも3桁も長い時間だけ蓄積容量51により保持されるので、保持特性が改善される結果、高コントラスト比が実現されることとなる。
【0036】
<1−3:データ線駆動回路およびサンプリング回路>
【0037】
次に、データ線駆動回路200は、Xクロック信号XCKに同期して順次アクティブとなるサンプリング信号SR1〜SRnを生成する。また、データ線駆動回路200は、転送方向制御信号DIRおよび反転転送方向制御信号DIRBによってサンプリング信号SR1〜SRnをアクティブにする順番を制御することが可能である。具体的には、転送方向制御信号DIRがハイレベル且つ反転転送方向制御信号DIRBがローレベルである場合、サンプリング信号はSR1→SR2→…SRnの順にアクティブとなり、転送方向制御信号DIRがローレベル且つ反転転送方向制御信号DIRBがハイレベルである場合、サンプリング信号はSRn→SRn−1→…SR1の順にアクティブとなる。
【0038】
サンプリング回路240は、n個のスイッチSW1〜SWnを備える。各スイッチSW1〜SWnは、TFTによって構成されている。そして、ゲートに供給される各サンプリング信号SR1〜SRnが順次アクティブになると、各スイッチSW1〜SWnが順次オン状態となる。すると、画像信号供給線L1〜L3を介して供給される画像信号40R、40G、40Bがサンプリングされ、各データ線3に順次供給される。したがって、SR1→SR2→…SRnの順にサンプリング信号がアクティブとなれば、データ線3は左から右に順次選択される一方、SRn→SRn−1→…SR1の順にサンプリング信号がアクティブとなれば、データ線3は右から左に順次選択されることになる。なお、サンプリング回路240をデータ線駆動回路200に含めてもよいことは勿論である。
【0039】
次に、図2はデータ線駆動回路200の詳細な構成を示す回路図である。図に示すようにデータ線駆動回路200は、シフトレジスタ部210とクロック信号制御部220とを含んでいる。
【0040】
まず、シフトレジスタ部210は、縦続接続されたシフトレジスタ単位回路Ua1〜Uan+2と、論理演算単位回路Ub1〜Ubnと、インバータZ1およびZ2を含む。
【0041】
各論理演算単位回路Ub1〜Ubnは、シフトレジスタ単位回路Ua2〜Uan+1に対応して各々設けられており、サンプリング信号SR1〜SRnを出力する。各論理演算単位回路Ub1〜Ubnは、ナンド回路511とインバータ512とを備える。そして、j(jは1からnまでの自然数)番目の論理演算単位回路Ubjにおいてナンド回路511にはシフトレジスタ単位回路Uaj+1の入力信号と出力信号とが供給される。
【0042】
各シフトレジスタ単位回路Ua1〜Uan+2は、クロックドインバータ501〜504を備える。また、シフトレジスタ部210は、シフトレジスタ単位回路Ua1の前段にインバータZ1とシフトレジスタ単位回路Uan+2の後段にインバータZ2とを備える。
【0043】
クロックドインバータ501〜504は、制御端子電圧がハイレベルのときに各入力信号を反転して出力し、制御端子電圧がローレベルのときに出力端子をハイインピーダンス状態にする。クロックドインバータ501および502の各制御端子には、所定期間だけアクティブとなるクロック信号XCKと反転Xクロック信号XCKBとが供給されるようになっている。また、クロックドインバータ503の制御端子には反転転送方向制御信号DIRBが供給される一方、クロックドインバータ504の制御端子には転送方向制御信号DIRが供給される。
【0044】
転送方向制御信号DIRがハイレベルで反転転送方向制御信号DIRBがローレベルの場合を想定すると、クロックドインバータ503はハイインピーダンス状態となる一方、クロックドインバータ504はインバータとして機能する。したがって、転送方向制御信号DIRがハイレベルの場合には、シフトレジスタ単位回路Ua1〜Uan+2は、図3(A)に示す回路と等価である。
【0045】
逆に、転送方向制御信号DIRがローレベルで反転転送方向制御信号DIRBがハイレベルの場合を想定すると、クロックドインバータ504はハイインピーダンス状態となる一方、クロックドインバータ503はインバータとして機能する。したがって、転送方向制御信号DIRがローレベルの場合には、シフトレジスタ単位回路Ua1〜Uan+2は、図3(B)に示す回路と等価である。
【0046】
ここで、転送方向制御信号DIRの論理レベルがハイレベルの場合を想定する(図3(A)を参照)。各シフトレジスタ単位回路Ua1〜Uan+2のクロックドインバータ501には第1制御信号Q1、Q2、…、Qn+2が供給される一方、クロックドインバータ502には第1制御信号Q1’、Q2’、…、Qn+2’が供給される。第2制御信号の論理レベルは、第1制御信号の論理レベルを反転したものとなっている。
【0047】
シフトレジスタ単位回路Ua1において、第1制御信号Q1がハイレベルのときクロックドインバータ501はX転送開始パルスDXを反転して出力する。このとき、第2制御信号Q1’はローレベルとなるので、クロックドインバータ502の出力端子はハイインピーダンス状態となる。この場合には、X転送開始パルスDXがクロックドインバータ501とインバータ503とを介して出力される。一方、第2制御信号Q1’がハイレベルのときクロックドインバータ502はX転送開始パルスDXを反転して出力する。このとき、第1制御信号Q1はローレベルとなっているので、クロックドインバータ501の出力端子はハイインピーダンス状態となっている。この場合には、クロックドインバータ502とインバータ504とによってラッチ回路が構成されることになる。
【0048】
すなわち、シフトレジスタ単位回路Ua1〜Uan+2は、クロックドインバータ501および503から構成される第1論理回路と、クロックドインバータ502および504から構成される第2論理回路とを備えていると考えることができる。そして、転送方向制御信号DIRがハイレベルの場合(転送方向が左から右)、第1制御信号によって制御されるクロクッドインバータ501として機能するとともに第2論理回路はラッチ回路として機能する。また、転送方向制御信号DIRがハイレベルの場合(転送方向が右から左)、第1論理回路はラッチ回路として機能するとともに第2論理回路は第2制御信号によって制御されるクロクッドインバータとして機能する。
【0049】
また、シフトレジスタ部210はn+2個のシフトレジスタ単位回路によって構成されるが、総数n+2は偶数である。これは、図3(A)に示すようにX転送開始パルスDXを第1番目のシフトレジスタ単位回路Ua1に供給して、右から左に転送する場合と、図3(B)に示すようにX転送開始パルスDXを第1番目のシフトレジスタ単位回路Ua1に供給して、右から左に転送する場合に対応するためである。なお、この例においてデータ線3は偶数本からなるが、仮に奇数本である場合には、シフトレジスタ単位回路Ua1の前段、またはシフトレジスタ単位回路Uan+2の後段にシフトレジスタ単位回路を1個追加し、追加したシフトレジスタ単位回路に合わせて制御単位回路を追加すればよい。
【0050】
説明を図2に戻す。クロック信号制御部220は、各シフトレジスタ単位回路Ua1,Ua2,…,Uan+2に各々対応して設けられた制御単位回路Uc1〜Ucn+2を縦続接続して構成され。制御単位回路Uc1〜Ucn+2はナンド回路521、インバータ522、およびトランスファーゲート523〜526を備える。
【0051】
ここで、第2番目の制御単位回路Uc2に着目すると、ナンド回路521の一方の入力端子には、信号P1が供給され、他方の入力端子には信号P3が供給される。信号P1およびP3は、クロックドインバータ501および502の接続点A1およびA3の信号電圧として与えられる。
【0052】
このように信号P1と信号P3とに基づいて、トランスファーゲート523〜526を制御するクロック制御信号N2を生成するようにしたのは、インバータ503または504による波形特性の劣化を防止するためである。
【0053】
説明を簡略化するため、転送方向制御信号DIRがハイレベルであるものとする。図13に示す従来のシフトレジスタにあっては、隣接する各基本ユニット間の出力信号、すなわちインバータINV3(本実施形態のインバータ504に相当)の出力信号に基づいて、クロック制御信号を生成していた。このため、クロック制御信号の立ち上がりエッジと立ち下がりエッジは、インバータINV3の応答特性の影響を受けて、その傾斜が緩やかになってしまっていた。
【0054】
これに対して、接続点A1,A2,…の電圧は、クロックドインバータ501または502の出力電圧によって定まる。後述する図4に示すように信号P3は信号P2を転送したものであるから、クロック制御信号N2は、信号P1の立ち下がりエッジと信号P3の立ち上がりエッジとに同期して論理レベルが遷移する。信号P1と信号P3の論理レベルは、Xクロック信号XCKと反転Xクロック信号XCKBに基づいて定まるので、Xクロック信号XCKや反転Xクロック信号XCKBに対するクロック制御信号N2の遅延時間を短縮することができるとともに、インバータ504による波形劣化を防止することが可能となる。
【0055】
さらに、信号P1は前段のシフトレジスタ単位回路Ua1から出力され、信号P2は後段のシフトレジスタ単位回路Ua3から出力される。したがって、クロック制御信号N2のパルス幅を広くすることができ、余裕のある動作マージンを確保することができる。
【0056】
次に、制御単位回路Uc2においてトランスファーゲート524および525は、反転Xクロック信号XCKBをクロックドインバータ501に供給するためのものである。これらによって、ナンド回路521の出力信号がハイレベルの状態において、クロックドインバータ501の制御入力端子に反転Xクロック信号XCKが供給される一方、当該出力信号がローレベルの状態において、トランスファーゲート525はハイインピーダンス状態となり、反転Xクロック信号XCKBの供給が停止される。
【0057】
また、トランスファーゲート523および526は、Xクロック信号XCKをクロックドインバータ502に供給するためのものである。これらによって、ナンド回路521の出力信号がハイレベルの状態において、クロックドインバータ502の制御入力端子にXクロック信号XCKが供給される一方、当該出力信号がローレベルの状態において、トランスファーゲート526はハイインピーダンス状態となるので、Xクロック信号XCKの供給が停止される。
【0058】
すなわち、ある制御単位回路Ucjは、対応するシフトレジスタ単位回路Uajの前段のシフトレジスタ単位回路Uaj−1における接続点Aj−1の信号電圧と、の後段のシフトレジスタ単位回路Uaj+1における接続点Aj+1の信号電圧とのうちいずれか一方がアクティブになる期間(この例では、ローレベル)にのみ、Xクロック信号XCKおよび反転Xクロック信号XCKBをシフトレジスタ単位回路Uajに供給する。
【0059】
<1−5:Xシフトレジスタの動作>
【0060】
次に、データ線駆動回路200の動作について図4を参照しつつ説明する。図4は、データ線駆動回路200の動作を示すタイミングチャートである。
【0061】
まず、第1番目のシフトレジスタ単位回路Ua1および制御単位回路Uc1の動作について説明する。また、転送方向制御信号DIRはハイレベルであるものとする。時刻T1において、X転送開始パルスDXがローレベル(非アクティブ)からハイレベル(アクティブ)に立ち上がると、信号P0がローレベルに遷移し、クロック制御信号N1はハイレベルになる。トランスファーゲート525および526は、クロック制御信号N1がハイレベルのときオン状態となるのから、時刻T1からXクロック信号XCKと反転Xクロック信号XCKBが、第1番目のクロックドインバータ501および502に各々供給されることになる。
【0062】
時刻T2に至ると、Xクロック信号XCKがハイレベルになり、クロックドインバータ501がアクティブとなる。このため、信号P1は、時刻T2においてハイレベルからローレベルに立ち下がる。
【0063】
次に、時刻T3に至ると、Xクロック信号XCKがローレベルとなる一方、反転Xクロック信号XCKBがハイレベルとなるから、クロックドインバータ501が非アクティブとなる一方、クロックドインバータ502がアクティブとなる。クロックドインバータ502とインバータ504はラッチ回路を構成しているので、信号P1はローレベルのまま維持される。
【0064】
この後、時刻T4においてX転送開始パルスDXがハイレベルからローレベルに立ち下がると、信号P0がローレベルからハイレベルに遷移するが、このとき信号P1はローレベルのままなので、クロック制御信号N1はハイレベルを維持する。
【0065】
そして、時刻T5に至ると、信号P2がローレベルからハイレベルに遷移する。時刻T5における信号P0はハイレベルであるから、この時点でクロック制御信号N1がハイレベルからローレベルに遷移する。すると、トランスファーゲート525および526は、オフ状態となる一方、トランスファーゲート523および525がオン状態になる。
【0066】
この例では、転送方向制御信号DIRはハイレベルであるから、時刻T5以降、クロックドインバータ501はハイインピーダンス状態になる一方、クロックドインバータ502はインバータとして機能する。したがって、信号P0の論理レベルは、インバータ502および504からなるラッチ回路によって、ローレベルが維持されることになる。
【0067】
トランスファーゲート523および524を用いて、転送方向制御信号DIRをクロックドインバータ502に供給する一方、反転転送方向制御信号DIRBをクロックドインバータ501に供給したのは、以下の理由による。
【0068】
トランスファーゲート523および524を設けなくとも、理論的にはシフトレジスタは動作する。この場合には、ナンド回路521の出力信号が非アクティブになると、クロックドインバータ501および502の制御端子はハイインピーダンスとなる。したがって、それらの制御端子に、ノイズが飛び込み易くなり、誤動作する可能性がある。そこで、実際の回路では、トランスファーゲート523および524を設け、クロックドインバータ501および502の各制御端子に所定の電圧を供給したのである。
【0069】
次に、第2番目のシフトレジスタ単位回路Ua2にあっては、信号P1と信号P3とに基づいてクロック制御信号N2が生成され、他のシフトレジスタ単位回路Ua3〜Ucn+3についても同様にクロック制御信号N3、N4、…Nn+2が生成される。
【0070】
本実施形態にあっては、クロック制御信号N1、N2、…をクロックドインバータ501と502の接続点A1、A2、…の信号電圧P1、P2、…から生成したので、Xクロック信号XCKおよび反転Xクロック信号XCKBのエッジが発生してからクロック制御信号のエッジが発生するまでの遅延時間を短縮することができ、かつ、その波形の立ち上がりおよび立ち下りを急峻にすることができる。
【0071】
さらに、クロック制御信号N1、N2、…を前段のシフトレジスタ単位回路の信号と後段のシフトレジスタ単位回路の信号に基づいて生成したので、確実にXクロック信号CKXと反転Xクロック信号CKXBとを各シフトレジスタ単位回路Ua1〜Uan+2に供給することが可能である。
【0072】
これらにより、データ線駆動回路200の動作マージンが拡大するから、温度変化や経年変化があってもX転送開始パルスDXを確実に転送することができる。
【0073】
次に、液晶装置の消費電力について検討する。液晶装置の電源を投入した時点において、接続点A1、A2、…の論理レベルがハイレベルになるかローレベルになるかは確率の問題である。しかし、1水平走査期間を経過すると、接続点A1、A2、…の論理レベルは定常状態になる。定常状態におけるXクロック信号XCKの入力端子からクロック信号制御部220の内部を見た入力容量Cを検討する。ここで、クロックドインバータ501または502の制御端子から、トランスファーゲート525または526までの容量値をCaで表すものとすると、Xクロック信号XCKの入力端子からクロック信号制御部220の内部を見た負荷容量Cは、最大4Caとなる。例えば、液晶パネルAAが1280本のデータ線を有するSXGA形式であったとすると、クロック信号制御部220を用いない場合には、負荷容量Cは1280Caになる。したがって、クロック信号制御部220を用いることによって、負荷容量を1/320に低減することができる。よって、Xクロック信号XCKおよび反転Xクロック信号XCKBを供給する駆動回路(図示せず)の消費電力を大幅に削減することができる。
【0074】
<1−6:データ線駆動回路の他の構成例>
【0075】
上述したデータ線駆動回路200は、X転送開始パルスDXがハイレベルでアクティブとなる正論理に対応するのものであった。この変形例のデータ線駆動回路200’は、X転送開始パルスDX’がローレベルでアクティブとなる負論理に対応するものである。
【0076】
図5は、データ線駆動回路200’の詳細な構成を示す回路図であり、図6は、そのタイミングチャートである。データ線駆動回路200’は、論理演算単位回路Ub1〜Ubnにおいてナンド回路511をノア回路513に置き換えた点および制御単位回路Uc1〜Ucn+2においてナンド回路511をノア回路513に置き換えた点を除いて、上述したデータ線駆動回路200と同一である。
【0077】
図6に示すようにX転送開始パルスDX’はローレベルでアクティブとなるため、信号P0および接続点A1,A2,…の信号電圧P1,P2,…はハイレベルでアクティブとなる。くわえて、クロック制御信号N1,N2,…はローレベルでアクティブとなる。
【0078】
したがって、この例においても、正論理の場合と同様に、ある制御単位回路Ucjは、前段の接続点Aj−1の信号電圧Pj−1と後段の接続点Aj+1の信号電圧Pj+1とのうちいずれか一方がアクティブになる期間(この例では、ハイレベル)にのみ、Xクロック信号XCKおよび反転Xクロック信号XCKBをシフトレジスタ単位回路Uajに供給している。
【0079】
<1−7:走査線駆動回路>
【0080】
次に、走査線駆動回路100について説明する。図6は、走査線駆動回路100の構成を示すブロック図である。この図に示すように走査線駆動回路100は、クロック制御回路101、Yシフトレジスタ102、レベルシフタ103およびバッファ104を備えている。
【0081】
クロック制御回路101は、Xクロック信号XCKおよび反転Xクロック信号XCKBの代わりにYクロック信号YCKおよび反転Yクロック信号YCKBが供給される点およびm本の走査線に対応するm個の制御単位回路を備える点を除いて、上述したデータ線駆動回路200のクロック信号制御部220と同様である。また、Yシフトレジスタ102は、X転送開始パルスDXの替わりにY転送開始パルスDYが供給される点およびm+2個のシフトレジスタ単位回路および論理演算単位回路を備える点を除いて、上述したデータ線駆動回路200のシフトレジスタ部210と同様である。
【0082】
したがって、走査線駆動回路100は、上述したデータ線駆動回路200と同様に動作マージンが大きいので、温度変化や経年変化があってもY転送開始パルスDYを確実に転送することができる。
【0083】
レベルシフタ103は、Yシフトレジスタ102の各出力信号のレベルをシフトして走査線2を駆動するのに適したレベルに変換している。また、バッファ104は、レベルシフタ103の各出力信号をローインピーダンスに変換し、走査線駆動信号Y1、Y2、…Ymとして各走査線2に出力する。
【0084】
なお、この走査線駆動回路100において、クロック制御回路101およびYシフトレジスタ102として図5に示す負論理で構成されたものを適用してもよいことは勿論である。
【0085】
<1−8:液晶パネルの構成例>
【0086】
次に、上述した電気的構成に係る液晶パネルの全体構成について図8および図9を参照して説明する。ここで、図8は、液晶パネルAAの構成を示す斜視図であり、図9は、図8におけるZ−Z’線断面図である。
【0087】
これらの図に示されるように、液晶パネルAAは、画素電極6等が形成されたガラスや半導体等の素子基板151と、共通電極158等が形成されたガラス等の透明な対向基板152とを、スペーサ153が混入されたシール材154によって一定の間隙を保って、互いに電極形成面が対向するように貼り合わせるとともに、この間隙に電気光学材料としての液晶155を封入した構造となっている。なお、シール材154は、対向基板152の基板周辺に沿って形成されるが、液晶155を封入するために一部が開口している。このため、液晶155の封入後に、その開口部分が封止材156によって封止されている。
【0088】
ここで、素子基板151の対向面であって、シール材154の外側一辺においては、上述したデータ線駆動回路200が形成されて、Y方向に延在するデータ線3を駆動する構成となっている。さらに、この一辺には複数の接続電極157が形成されて、タイミング発生回路300からの各種信号や画像信号40R、40G、40Bを入力する構成となっている。また、この一辺に隣接する一辺には、走査線駆動回路100が形成されて、X方向に延在する走査線2をそれぞれ両側から駆動する構成となっている。
【0089】
一方、対向基板152の共通電極158は、素子基板151との貼合部分における4隅のうち、少なくとも1箇所において設けられた導通材によって、素子基板151との電気的導通が図られている。ほかに、対向基板152には、液晶パネルAAの用途に応じて、例えば、第1に、ストライプ状や、モザイク状、トライアングル状等に配列したカラーフィルタが設けられ、第2に、例えば、クロムやニッケルなどの金属材料や、カーボンやチタンなどをフォトレジストに分散した樹脂ブラックなどのブラックマトリクスが設けられ、第3に、液晶パネルAAに光を照射するバックライトが設けられる。特に色光変調の用途の場合には、カラーフィルタは形成されずにブラックマトリクスが対向基板152に設けられる。
【0090】
くわえて、素子基板151および対向基板152の対向面には、それぞれ所定の方向にラビング処理された配向膜などが設けられる一方、その各背面側には配向方向に応じた偏光板(図示省略)がそれぞれ設けられる。ただし、液晶155として、高分子中に微小粒として分散させた高分子分散型液晶を用いれば、前述の配向膜、偏光板等が不要となる結果、光利用効率が高まるので、高輝度化や低消費電力化などの点において有利である。
【0091】
なお、データ線駆動回路200、走査線駆動回路100等の周辺回路の一部または全部を、素子基板151に形成する替わりに、例えば、TAB(Tape Automated Bonding)技術を用いてフィルムに実装された駆動用ICチップを、素子基板151の所定位置に設けられる異方性導電フィルムを介して電気的および機械的に接続する構成としても良いし、駆動用ICチップ自体を、COG(Chip On Grass)技術を用いて、素子基板151の所定位置に異方性導電フィルムを介して電気的および機械的に接続する構成としても良い。
【0092】
<3.応用例>
【0093】
<3−1:素子基板の構成など>
【0094】
上述した各実施形態においては、液晶パネルの素子基板151をガラス等の透明な絶縁性基板により構成して、当該基板上にシリコン薄膜を形成するとともに、当該薄膜上にソース、ドレイン、チャネルが形成されたTFTによって、画素のスイッチング素子(TFT50)やデータ線駆動回路200、および走査線駆動回路100の素子を構成するものとして説明したが、本発明はこれに限られるものではない。
【0095】
例えば、素子基板151を半導体基板により構成して、当該半導体基板の表面にソース、ドレイン、チャネルが形成された絶縁ゲート型電界効果トランジスタによって、画素のスイッチング素子や各種の回路の素子を構成しても良い。このように素子基板151を半導体基板により構成する場合には、透過型の表示パネルとして用いることができないため、画素電極6をアルミニウムなどで形成して、反射型として用いられることとなる。また、単に、素子基板151を透明基板として、画素電極6を反射型にしても良い。
【0096】
さらに、上述した実施の形態にあっては、画素のスイッチング素子を、TFTで代表される3端子素子として説明したが、ダイオード等の2端子素子で構成しても良い。ただし、画素のスイッチング素子として2端子素子を用いる場合には、走査線2を一方の基板に形成し、データ線3を他方の基板に形成するとともに、2端子素子を、走査線2またはデータ線3のいずれか一方と、画素電極との間に形成する必要がある。この場合、画素は、走査線2とデータ線3との間に直列接続された二端子素子と、液晶とから構成されることとなる。
【0097】
また、本発明は、アクティブマトリクス型液晶表示装置として説明したが、これに限られず、STN(Super Twisted Nematic)液晶などを用いたパッシィブ型にも適用可能である。さらに、電気光学材料としては、液晶のほかに、エレクトロルミネッセンス素子などを用いて、その電気光学効果により表示を行う表示装置にも適用可能である。すなわち、本発明は、上述した液晶装置と類似の構成を有するすべての電気光学装置に適用可能である。
【0098】
<3−2:電子機器>
【0099】
次に、上述した液晶装置を各種の電子機器に適用される場合について説明する。
【0100】
<3−2−1:プロジェクタ>
【0101】
まず、この液晶装置をライトバルブとして用いたプロジェクタについて説明する。図10は、プロジェクタの構成例を示す平面図である。
【0102】
この図に示されるように、プロジェクタ1100内部には、ハロゲンランプ等の白色光源からなるランプユニット1102が設けられている。このランプユニット1102から射出された投射光は、ライトガイド1104内に配置された4枚のミラー1106および2枚のダイクロイックミラー1108によってRGBの3原色に分離され、各原色に対応するライトバルブとしての液晶パネル1110R、1110Bおよび1110Gに入射される。
【0103】
液晶パネル1110R、1110Bおよび1110Gの構成は、上述した液晶パネルAAと同等であり、画像信号処理回路(図示省略)から供給されるR、G、Bの原色信号でそれぞれ駆動されるものである。そして、これらの液晶パネルによって変調された光は、ダイクロイックプリズム1112に3方向から入射される。このダイクロイックプリズム1112においては、RおよびBの光が90度に屈折する一方、Gの光が直進する。したがって、各色の画像が合成される結果、投射レンズ1114を介して、スクリーン等にカラー画像が投写されることとなる。
【0104】
ここで、各液晶パネル1110R、1110Bおよび1110Gによる表示像について着目すると、液晶パネル1110Gによる表示像は、液晶パネル1110R、1110Bによる表示像に対して左右反転することが必要となる。
【0105】
なお、液晶パネル1110R、1110Bおよび1110Gには、ダイクロイックミラー1108によって、R、G、Bの各原色に対応する光が入射するので、カラーフィルタを設ける必要はない。
【0106】
<3−2−2:モバイル型コンピュータ>
【0107】
次に、この液晶パネルを、モバイル型のパーソナルコンピュータに適用した例について説明する。図11は、このパーソナルコンピュータの構成を示す斜視図である。図において、コンピュータ1200は、キーボード1202を備えた本体部1204と、液晶表示ユニット1206とから構成されている。この液晶表示ユニット1206は、先に述べた液晶パネル1005の背面にバックライトを付加することにより構成されている。
【0108】
<3−2−3:携帯電話>
【0109】
さらに、この液晶パネルを、携帯電話に適用した例について説明する。図12は、この携帯電話の構成を示す斜視図である。図において、携帯電話1300は、複数の操作ボタン1302とともに、反射型の液晶パネル1005を備えるものである。この反射型の液晶パネル1005にあっては、必要に応じてその前面にフロントライトが設けられる。
【0110】
なお、図10〜図12を参照して説明した電子機器の他にも、液晶テレビや、ビューファインダ型、モニタ直視型のビデオテープレコーダ、カーナビゲーション装置、ページャ、電子手帳、電卓、ワードプロセッサ、ワークステーション、テレビ電話、POS端末、タッチパネルを備えた装置等などが挙げられる。そして、これらの各種電子機器に適用可能なのは言うまでもない。
【0111】
【発明の効果】
以上説明したように本発明よれば、シフトレジスタの転送方向を双方向に切り替えることができ、また、動作マージンを拡大して安定して動作させることができる。くわえて、クロック信号を駆動する回路の消費電力を低減させることができる。
【図面の簡単な説明】
【図1】 本発明に係る液晶装置AAの全体構成を示すブロック図である。
【図2】 同装置のデータ線駆動回路200の詳細な構成を示す回路図である。
【図3】 (A)は転送方向制御信号DIRがハイレベルの場合におけるシフトレジスタ単位回路Ua1〜Uan+2の等価回路図であり、(B)は転送方向制御信号DIRがローレベルの場合におけるシフトレジスタ単位回路Ua1〜Uan+2の等価回路図である。
【図4】 データ線駆動回路200のタイミングチャートである。
【図5】 負論理に対応するデータ線駆動回路200’の回路図である。
【図6】 データ線駆動回路200’のタイミングチャートである。
【図7】 走査線駆動回路100の構成を示すブロック図である。
【図8】 同液晶パネルの構造を説明するための斜視図である。
【図9】 同液晶パネルの構造を説明するための一部断面図である。
【図10】 同液晶装置を適用した電子機器の一例たるビデオプロジェクタの断面図である。
【図11】 同液晶装置を適用した電子機器の一例たるパーソナルコンピュータの構成を示す斜視図である。
【図12】 同液晶装置を適用した電子機器の一例たる携帯電話の構成を示す斜視図である。
【図13】 従来のシフトレジスタの構成を示す回路図である。
【図14】 図20に示すシフトレジスタの動作を示すタイミングチャートである。
【符号の説明】
2……走査線
3……データ線
6……画素電極
50……TFT(スイッチング素子)
SR1〜SRn……サンプリングパルス
100……走査線駆動回路
200……データ線駆動回路
210……シフトレジスタ部(シフト手段)
220……クロック制御部(クロック信号供給手段)
300……タイミング発生回路
Ua1〜Uan+2……シフトレジスタ単位回路(シフト単位回路)
Uc1〜Ucn+2……制御単位回路
Claims (12)
- 複数の走査線と、複数のデータ線と、前記走査線と前記データ線との交差に対応してマトリックス状に配置された画素電極およびスイッチング素子とを有する電気光学パネルを駆動する駆動回路に用いられ、開始パルスを順次シフトすることによって、前記データ線または前記走査線を選択するための選択信号を順次生成するシフトレジスタであって、
クロック信号とこれを反転した反転クロック信号に同期して前記開始パルスを順次シフトして出力信号を出力するとともに転送方向を指示する転送方向信号に基づいて前記開始パルスの転送方向を制御可能な複数のシフト単位回路を縦続接続したシフト手段と、
前記各シフト単位回路に各々対応して設けられ、前記クロック信号および前記反転クロック信号に基づいて第1制御信号および第2制御信号を生成する複数の制御単位回路を有するクロック信号制御手段と、を備え、
前記転送方向信号は、転送方向制御信号と前記転送方向制御信号を反転した反転転送方向制御信号とを含み、
前記シフト単位回路は、前段のシフト単位回路と一方の端子が接続され、中間接続点と他方の端子が接続される第1論理回路と、前記中間接続点と一方の端子が接続され、後段のシフト単位回路と他方の端子が接続される第2論理回路とを備え、前記転送方向信号が前段から後段に向けて前記開始パルスを転送することを指示する場合、前記第1論理回路は前記第1制御信号によって制御されるサンプリング回路として機能するとともに前記第2論理回路は保持回路として機能し、前記転送方向信号が後段から前段に向けて前記開始パルスを転送することを指示する場合、前記第1論理回路は保持回路として機能するとともに前記第2論理回路は前記第2制御信号によって制御されるサンプリング回路として機能し、
前記制御単位回路は、当該制御単位回路と対応するシフト単位回路に対して、前段のシフト単位回路の前記中間接続点における信号電圧と後段のシフト単位回路の前記中間接続点における信号電圧とのうち、いずれか一方がアクティブになる選択期間に、前記クロック信号および前記反転クロック信号を前記第1制御信号または前記第2制御信号として出力し、
前記制御単位回路は、当該制御単位回路と対応するシフト単位回路に対して、前段のシフト単位回路の前記中間接続点における信号電圧と後段のシフト単位回路の前記中間接続点における信号電圧とがともに非アクティブになる選択期間に、前記転送方向制御信号および前記反転転送方向制御信号を前記第1制御信号または前記第2制御信号として出力する、
ことを特徴とするシフトレジスタ。 - 前記シフト単位回路は、中間接続点を介して相互に接続され、制御入力端子に供給される信号がアクティブのときインバータとして動作する一方、当該信号が非アクティブのとき出力端子をハイインピーダンス状態とする第1乃至第4インバータを備え、
前記第1インバータは、入力端子が前段のシフト単位回路と接続され、出力端子が中間接続点と接続され、前記制御単位回路から前記第1制御信号が制御入力端子に供給され、
前記第2インバータは、入力端子が後段のシフト単位回路と接続され、出力端子が前記中間接続点と接続され、前記制御単位回路から前記第2制御信号が制御入力端子に供給され、
前記第3インバータは、入力端子が前記中間接続点と接続され、出力端子が前記第1インバータの入力端子と接続され、前記反転転送方向制御信号が制御入力端子に供給され、
前記第4インバータは、入力端子が前記中間接続点と接続され、出力端子が前記第2インバータの入力端子に接続され、前記転送方向制御信号が制御入力端子に供給され、
前記第1論理回路は、前記第1インバータおよび前記第3インバータを備え、
前記第2論理回路は、前記第2インバータおよび前記第4インバータを備える
ことを特徴とする請求項1に記載のシフトレジスタ。 - 前記クロック信号制御手段を構成する複数の単位制御回路のうち、奇数段の単位制御回路は、前記選択期間に、前記クロック信号を前記第1制御信号として出力するとともに前記反転クロック信号を前記第2制御信号として出力し、偶数段の単位制御回路は、前記選択期間に、前記反転クロック信号を前記第1制御信号として出力するとともに前記クロック信号を前記第2制御信号として出力することを特徴とする請求項1または2に記載のシフトレジスタ。
- 前記シフト手段に含まれる前記シフト単位回路の数および前記クロック信号制御手段に含まれる前記単位制御回路の数は偶数個であることを特徴とする請求項1乃至3のうちいずれか1項に記載のシフトレジスタ。
- 前記制御単位回路は、当該制御単位回路と対応するシフト単位回路に対して、前段のシフト単位回路の前記中間接続点における信号電圧と後段のシフト単位回路の前記中間接続点における信号電圧とに基づいて、各信号電圧のうちいずれか一方がアクティブになる期間にアクティブとなる出力信号を出力する論理回路と、
前記論理回路の出力信号に基づいて、前記クロック信号または前記反転クロック信号を、前記第1インバータに供給する第1トランスファーゲートおよび前記第2インバータに供給する第2トランスファーゲートと、
前記論理回路の出力信号に基づいて、当該出力信号が非アクティブの期間に前記第1インバータの制御入力端子に前記反転転送方向制御信号を供給する第3トランスファーゲートと、
前記論理回路の出力信号に基づいて、当該出力信号が非アクティブの期間に前記第2インバータの制御入力端子に転送方向制御信号を供給する第4トランスファーゲートと
を備えることを特徴とする請求項2乃至4のうちいずれか1項に記載のシフトレジスタ。 - 前記開始パルスはハイレベルでアクティブとなり、前記論理回路はナンド回路で構成される請求項5に記載のシフトレジスタ。
- 前記開始パルスはローレベルでアクティブとなり、前記論理回路はノア回路で構成される請求項5に記載のシフトレジスタ。
- 請求項1乃至7のうちいずれか1項に記載のシフトレジスタを備え、当該シフトレジスタから出力される前記選択信号に基づいて、入力画像信号をサンプリングし、サンプリング結果に基づいて各データ線を駆動するデータ線駆動回路。
- 請求項1乃至7のうちいずれか1項に記載のシフトレジスタを備え、当該シフトレジスタから出力される前記選択信号に基づいて、前記各走査線を駆動する走査線駆動回路。
- 複数の走査線と、複数のデータ線と、前記走査線と前記データ線との交差に対応してマトリックス状に配置された画素電極及びスイッチング素子とを有する画素領域と、
請求項8に記載したデータ線駆動回路と、
前記走査線を駆動するための走査線駆動回路と
を備えたことを特徴とする電気光学パネル。 - 複数の走査線と、複数のデータ線と、前記走査線と前記データ線との交差に対応してマトリックス状に配置された画素電極及びスイッチング素子とを有する画素領域と、
前記データ線を駆動するためのデータ線駆動回路と、
請求項9に記載の走査線駆動回路と
を備えたことを特徴とする電気光学パネル。 - 請求項10または11に記載した電気光学パネルを備えたことを特徴とする電子機器。
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