JP3560398B2 - 歪補償を有する増幅器 - Google Patents
歪補償を有する増幅器 Download PDFInfo
- Publication number
- JP3560398B2 JP3560398B2 JP22416995A JP22416995A JP3560398B2 JP 3560398 B2 JP3560398 B2 JP 3560398B2 JP 22416995 A JP22416995 A JP 22416995A JP 22416995 A JP22416995 A JP 22416995A JP 3560398 B2 JP3560398 B2 JP 3560398B2
- Authority
- JP
- Japan
- Prior art keywords
- amplifier
- compensation coefficient
- distortion compensation
- signal
- input signal
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired - Fee Related
Links
Images
Landscapes
- Amplifiers (AREA)
Description
【発明の属する技術分野】
本発明は、歪み補償を有する増幅器に関する。特に、線形変調信号を増幅する電力増幅器、あるいは線形変調信号の受信機に用いる低雑音増幅器等として使用される歪み補償を有する増幅器に関する。
【0002】
【従来の技術】
線形変調信号を増幅する電力増幅器、あるいは線形変調信号の受信機に用いる低雑音増幅器として、スペクトラム特性や信号の歪みに起因する伝送特性の劣化を抑えるために線形性の高い増幅器が要求される。
【0003】
一方、多くの用途分野において、増幅器には常に高い電力効率が求められる。しかし、増幅器の線形性と効率は一般に相反する特性であり、これを両立させるためにこれまで様々な歪補償方式が提案されている。
【0004】
かかる歪補償方式の一つとしてプリディストータが知られている。プリディストータの原理は、増幅器の入力信号に対して増幅器の歪み特性と逆の特性をあらかじめ付加しておくことにより、増幅器の出力において歪みのない所望信号を得る方式である。
【0005】
図14にプリディストータの従来例を示す。図において、1は直交変調器の出力を増幅する電力増幅器である。入力ベースバンド信号I、Qはそれぞれ歪み補償テーブル8からの補償値ΔI0 、ΔQ0 が加算器6で加算され、直交変調器2に入力される。直交変調信号は電力増幅器1で増幅され歪みが付加される。この歪みは、補償値により打ち消される。
【0006】
増幅器1の出力信号の一部は直交復調器3で復調されI’、Q’のベースバンド信号を得る。この際、ローカル発振器4からのローカル復調信号の位相を、I’、Q’の位相が入力信号I、Qの位相と一致するように移相器5により調整する。
【0007】
得られたI’、Q’を入力ベースバンド信号I、Qと比較器7で比較し、その誤差から歪補償テーブル8の値を更新するように、ΔI1 、ΔQ1 を得て歪み補償テーブル器8に記憶する。
【0008】
以上に説明した従来方式では、増幅器1の歪みを直交座標系での各成分の誤差として求め、その逆特性を各軸の成分に加算することによりプリディストーション(予備補正)が行われる。
【0009】
従って、従来の方式では次のような問題がある。即ち、
(a)増幅器1の歪みは、増幅歪みと位相歪みをもつため、歪補償テーブル8は入力信号I、Qで表される二次元平面の各点に対応した数の補償値をもつことが必要である。このため入力信号I、Qの量子化ビット数をnビットとした場合の容量として、22n×nビットが必要となる。
【0010】
(b)一方、歪補償を極座標系で行う方式では、補償テーブル8は一次元で構成できる。しかし直交変調器2及び、直交復調器3とのインターフェイスに際して、極座標/直交座標、直交座標/極座標の変換演算が必要となる。
【0011】
(c)ベースバンド入力信号I、Qと復調信号I’、Q’は同位相でなければならない。このため直交変調器3である直交検波器のローカル位相を調整する移相器5が必要となる。又、増幅器1の位相回転量は 動作温度、経年変化などで変動するため、ローカル位相を適応的に動作に対応させて、最適状態に保持する機能が必要である。
【0012】
(d)さらに増幅器、フィルタ等により遅延が生じるため、入力信号I、Qと復調信号I’、Q’には時間的なずれがある。このため歪補償テーブル8から入力信号に付加する誤差信号は、入力信号に対して最適とならず、リニアライザとしての特性が劣化する。
【0013】
【発明が解決しようとする課題】
したがって、本発明の目的は、上記従来の問題点を解決する増幅器を提供することにある。
【0014】
更に、本発明の目的は、歪補償テーブルの容量を小さくできる歪み補償機能を有する増幅器を提供することにある。
【0015】
また、 本発明の目的は、 極座標/直交座標、直交座標/極座標の変換演算の必要を解消する歪み補償機能を有する増幅器を提供することにある。
【0016】
更に又、 本発明の目的は、経年変化の少ない歪み補償増幅器を提供することにある。
【0017】
【課題を解決するための手段】
上記の本発明の課題を達成する歪み補償機能を有する増幅器は、 基本的構成として増幅器の入力信号と、該増幅器の出力との誤差信号を求める手段と、誤差信号から増幅器の歪み特性成分を補償する補償係数を適応型アルゴリズムにより生成する手段と、生成された補償係数を該入力信号に対応して出力する手段と、入力信号に対応して出力される補償係数を入力信号に乗積して、増幅器に入力する手段とを有する。
【0018】
更に具体的には、入力信号に対応して出力する手段は、入力信号の振幅に対応した歪補償係数を出力し、入力信号の電力に対応した歪補償係数を出力し、入力信号の振幅の関数に対応した歪補償係数を出力し、あるいは入力信号の電力の関数に対応した歪補償係数を出力する。
【0019】
又、上記適応型アルゴリズムをLMS適応アルゴリズムとし、或いはRLS適応アルゴリズムとする。
【0020】
更に、増幅器の入力側に直交信号変調器と、増幅器の出力側に増幅器から分岐される信号を復調する直交信号復調器を有する構成において、前記適応型アルゴリズムを直交信号復調器からの復調複素信号の象限情報を用いる適応アルゴリズムとする。
【0021】
更に又、補償係数を記憶するテーブルの容量の小型化、あるいはより細かな補償係数の生成を目的として、誤差信号から増幅器の歪み特性成分を補償する補償係数を適応型アルゴリズムにより生成する手段に機能的に接続され、生成された補償係数に基づき、所定関数により補償係数を演算し、演算により求められた補償係数により、生成された補償係数を補間する。
【0022】
また、上記において、一例として所定関数を一次関数とする。
【0023】
更に、歪補償係数の初期値を出力する手段を有し、この手段は、生成された補償係数を入力信号に対応して出力するのに先立って、当該初期値を入力信号に乗積する。これにより、引き込み速度を速くすることが出来る。
【0024】
誤差信号から増幅器の歪み特性成分を補償する補償係数を適応型アルゴリズムにより生成する手段により生成される補償係数の更新と、入力信号に対応して出力される補償係数を該入力信号に乗積して、増幅器に入力する手段における補償係数の該入力信号への乗積とを時間的に独立して行う。このために一例として補償係数の該入力信号への乗積とを時間的に独立して行うように制御する手段として、デュアルポートRAMを有し、デュアルポートRAMへの補償係数の更新書き込みと、該デュアルポートRAMからの該補償係数の読出しが時間的に独立される。これにより系の遅延の影響が回避される。
【0025】
更に、所定振幅値まで漸次増加する波形の信号を発生するトレーニング信号発振器を有し、トレーニング期間に該波形の信号を繰り返し入力し、振幅をスイープして該所定振幅値の範囲で歪み補償係数を推定する。この場合も所定振幅範囲に於いて歪み補償係数の引き込みが速く行える。
【0026】
また、復調系の誤差を補正すべく、増幅器の入力側に直交信号変調器と、増幅器の出力側に分岐される信号を復調する直交信号復調器と更に、直交信号復調器からの復調信号について、その最大値、最少値に基づき、該直交信号復調器を含む系のDCオフセット及び、IチャネルとQチャネルのゲイン偏差を求め、これを補正するする回路を有する。
【0027】
前記DCオフセット及び、IチャネルとQチャネルのゲイン偏差を、直交信号復調器から単位円を出力し、該単位円に基づき該IチャネルとQチャネルの最大値、最少値を検知し、該最大値、最少値に基づき補正する。
【0028】
IチャネルとQチャネルのゲイン偏差を適応アルゴリズムを用いて検知することを特徴とす歪補償を有する増幅器。
【0029】
更に、複素平面での単位円を発生するトレーニング信号発振器を有し、トレーニング期間に該単位円の信号を繰り返し入力し、振幅をスイープして所定振幅値の範囲で歪み補償係数を推定する。
【0030】
【発明の実施の形態】
以下本発明の実施の形態を図面にしたがい説明する。 尚、 図において同一又は類似のものには、同一の参照番号及び記号を付して説明する。 ここで、 本発明のより好ましい理解のために、 先に原理図である図1を参照して説明する。
【0031】
図1において、参照番号1、2、3及び4は、図14に於けると同様にそれぞれ電力増幅器、 直交変調器、直交復調器及びローカル発振器である。更に、図1において、ベースバンド信号は全て複素信号として考える。ベースバンド入力信号X(t) は、乗算器6に於いて適応型アルゴリズムによる推定補償係数生成回路50の歪み補償係数出力と乗積される。
【0032】
ここで本発明の特徴として、適応型アルゴリズムによる推定補償係数生成回路50は、ベースバンド入力信号の振幅に対応した似た歪み補償係数を出力する。かかる歪み補償係数は、増幅器1の振幅歪みと位相歪みの関数であることを利用する。したがって適応型アルゴリズムによる推定補償係数生成回路50は入力信号の振幅、電力あるいはそれらの関数に対応した歪み補償係数を持つ。
【0033】
ある振幅での増幅器1の振幅歪み及び、位相歪みは、一つの複素の値として表現できる。よって各振幅に対応した複素係数を歪み補償係数としてベースバンド入力信号に乗算器6で乗積することでプリディストーションを行う。
【0034】
更に、かかる歪み補償係数の推定に本発明では、適応アルゴリズムを用いる。適応アルゴリズムの例については後に説明する。また必要により、適応型アルゴリズムによる推定補償係数生成回路50の内容の更新と入力信号に対する歪み補償係数の乗積を時間的に独立して行うことも可能である。
【0035】
図1において、9は、歪み補償係数を入力信号に対する何れかのパラメータ、即ち入力電力、振幅あるいはそれらの関数に対応したかにより、それに対応した適応型アルゴリズムによる推定補償係数生成回路50に対するアクセス信号を生成する回路である。
【0036】
上記の原理により、本発明は増幅器1の非線形歪みを適応アルゴリズムを用いて推定し、ディジタル処理によりプリディストーションを行う歪補償方式を特徴とする。歪みは、入力振幅の非線形関数なので、量子化された入力の各値に対して、それぞれ独立に歪みを推定する。この時、適応アルゴリズムを用いて増幅器1の出力信号とリファレンス信号即ち、入力信号との誤差を最小にする補正値を求める。より具体的には、本発明では、適応型アルゴリズムによる推定補償係数生成回路50に蓄積される値を入力振幅あるいは入力電力に対応して持つことにより、一次元の歪補償テーブルとなる。このため、推定補償係数生成回路50の容量が2n ×nビットに削減される。
【0037】
これは、従来方式の1/2n に相当する。歪補償テーブルの容量は、増幅器1の非線形歪特性をどの程度の折れ線グラフで近似するかを意味している。この歪推定の分解能が変調信号の量子化ビット数よりも少なくても良い場合は、推定補償係数生成回路50の容量は更に削減が可能となる。
【0038】
図1に示される通り本発明においては、図14と比較すると極座標/直交座標、直交座標/極座標の変換が不要となる。
【0039】
更に、復調器ローカル位相の調整が不要となる。本発明では複素歪補償係数を乗積することにより増幅器1の歪みの逆特性を付加しているため、0〜2πの位相回転に対して補正する能力をもつ。
【0040】
また歪補償係数を適応アルゴリズムにより推定しているため、復調位相の時間的な変化に対して、復調位相を調整することなく常に最適なプリディストーションが可能となる。
【0041】
更に、推定補償係数生成回路50の更新と入力信号への乗積を時間的に分離する場合、系の遅延の影響を受けずに常に最適なプリディストーションが可能となる。
【0042】
ここで、適応アルゴリズムには一般的に知られた様々な方法があるが、例えば現代工学社(87/9/10発行)の書籍「適応フィルタ入門」S.ヘイキン著等に解説されている。
【0043】
ここでは最小二乗法(LMS)と指数重み付き逐次最小二乗法(RLS)を用いた場合について本発明の実施の形態を説明する。
【0044】
ここで最小二乗法とは、例えば、時刻t1,t2,..tnの時の入力信号を、u(1),u(2)...u(n)とし、x(ti)=u(i) i=1,2,...nで定義される平滑曲線でこの入力信号の集合を近似することを考える。この近似の際に、入力信号u(i)とx(ti)の差の二乗和を最小にすることが最小二乗法の概念である。
【0045】
(a)LMSアルゴリズムによる実施の形態
図2に本発明の一実施の形態のブロック図を示す。尚、図2及び以下の図において説明する実施の形態では変調器および復調器は、図示省略されている。図において、適応アルゴリズムにより推定される歪み補償係数を生成する回路即ち、推定補償係数生成回路50は、歪み補償係数を記憶するテーブル500、加算器501、乗算器502、503、504および複素数変換回路8を含んで構成される。
【0046】
そして、図2において補償すべき歪み量の推定は、以下の数1の演算により行われる。
【0047】
【数1】
【0048】
ここで、x(t)は、入力ベースバンド信号、f(p)は、増幅器1の歪関数、h(p)は、更新される推定歪補償係数およびμは、ステップサイズ・パラメータである。更に、数1において、x、y、f、h、u、eは複素数、*は共役複素数を表す。又、u(t)は、増幅器1の振幅歪みがあまり大きくない(hn−1 (p)h* n−1 (p)〜1)と仮定して近似する。
【0049】
上記の条件において、数1の内容の意味を説明する。式(1)のhn (p)は、更新される推定歪補償係数であり、歪み補償係数を記憶するテーブル500への入力である。増幅器1の出力y(t)から、共役複素数生成回路である複素数変換回路8に於いて、y* (t)を得る。したがって、乗算器504の出力は、一時点前の推定歪補償係数をhn−1 (p)とすると、y* (t)hn−1 (p)となる。
【0050】
乗算器504の出力は、更に乗算器503で比較器7の出力e(t)と乗算され、y* (t)hn−1 (p)e(t)となる。更に、これに、乗算器503でステップサイズ・パラメータμが乗算される。
【0051】
したがって、更新される推定歪補償係数hn (p)は、
hn (p)=μy* (t)hn−1 (p)e(t)+hn−1 (p)となる。
【0052】
ここで、y* (t)hn−1 (p)=U* (t)とすると、数1の式(1)のように表される。
【0053】
また、e(t)は、式(2)に示されるように減算器7の出力であり、入力と出力の誤差である。更に、式(3)のu(t)は、増幅器1の振幅歪みが余り大きくなく、式(4)のように仮定して近似される。したがって、U* (t)の共役複素数U(t)は、式(3)のように表される。
【0054】
ここで、式(6)は、回路9が、入力信号の電力の大きさを求める回路であることを意味する。これを入力の振幅を求める回路とする場合は、式(6)は|x(t)|で表わされる。あるいは電力または振幅の関数とする場合は、それぞれg(|x(t)|2 )、g(|x(t)|)で表わされる。
【0055】
更に、かかる回路9により求められた値は、歪み補償係数を記憶するテーブル500に対する書き込み、読みだし時のアドレスとなる。
【0056】
この書き込み更新と、入力信号への推定歪み補償係数の乗積とは別個に行う場合は、系への遅延の影響なしに常にプリディストーションが可能である。
【0057】
(b)クリップトLMSアルゴリズムによる実施の形態
上記図2においては、式(1)の演算ではhn (p)を更新するために複素乗算が2回(乗算器503、504による乗算)、実数乗算が1回(乗算器502でのμとの乗算)が必要である。この乗算回数を削減する実施の形態が図3に示される。
【0058】
即ち、図3は、更に上記図2の実施の形態の拡張であり、復調複素信号の象限情報を用いた適応アルゴリスムにより歪み補償係数を推定するようにした実施の形態である。構成は、図2の実施の形態の構成に加え、更に象限判定器505、506を有し、且つ乗算器503、504を位相回転器としている。
【0059】
かかる構成において、上記数1の式(1)を、数2の式(7)置き換える。
【0060】
【数2】
【0061】
式(7)を実現するには、図3の回路において、μの乗算は、μ=1/2n としてビットシフトで行う。これにより式(7)の右辺第二項は、e(t)に対する0、±π/2、πの回転演算となる。これを行う位相回転器503、504はハードウェアで構成される場合、正負の符号変換とセレクタで実現できる。
【0062】
更に、数2におけるsgn(R)、sgn(X)は、複素信号の実部と虚部のそれぞれを0を中心として比較する比較器により構成される象限判定器505、506において、求められる。入力複素信号が0より大きい場合は1、小さい場合は−1を出力する。これにより復調複素信号が4つの象限のいずれにあるかが4ビットで表現出来る。
【0063】
(c)指数重み付きRLS(逐次最少二乗法)による実施の形態
図4は、適応アルゴリズムとして指数重み付きRLSを用いた例に対応する構成例ブロック図でる。
【0064】
かかる実施の形態に対応する適応アルゴリズムによる推定歪み補償係数を求める演算は数3に示すように与えられる。
【0065】
【数3】
【0066】
歪み補償係数を記憶するテーブル500に更新される推定歪み補償係数h(i)は、誤差検出器7より得られる誤差信号e(i)に共役複素数変換回路80からのKの共役値K* を乗算したものと、一時点前の歪み補償係数h(i−1)を加算器501で加算したものであり、式(8)に示される。
【0067】
ここで、Kはカルマンベクトルと呼ばれ、数3の式(9)により求められる。式(9)の分母において、vは推定誤差e(i)の分散であり、正の小さな整数たとえば、1である。u* (i)は共役複素数変換回路82の出力であり、u(i)は共役複素数変換回路81及び乗算器507により得られ、数1の式(3)と同様に表される近似値である。したがって、乗算器508でu* (i)とT(i)との積が得られる。これに加算器509でvが加算され、式(9)の分母となる。
【0068】
一方、式(9)の分子であるT(i)は、式(11)の関係になり、式(11)に現れるP(i−1)は、式(10)の関係を持つ。ここで、式(10)のP(i)は、本アルゴリズムにおいて相関行列と呼ばれる。
【0069】
T(i)は、乗算器510の出力であり、u(i)と乗算器511の出力であるλ−1P(i−1)の積で表される。更にP(i)は、乗算器512の出力即ち、共役複素数変換回路83からのu* (i)とカルマン係数Kとの積を、乗算器511の出力即ち、P(i−1)とλの逆数λ−1との積から引き算回路513で引き算した結果である。
【0070】
上記のλは忘却係数であり、0<λ≦1の範囲にあり、λ=1の時、P(i)の値が累積され、0に近くなると、過去の値を消していく即ち、忘却していく。これは、例として増幅器の特性が時間で温度等の要因で変化する場合、過去の状態を全て累積する場合は、収束が遅くなる。したがって、通常は、0.9に近い最適値が選択される。
【0071】
更に、図4に戻ると、514は割り算回路であり、加算器509の出力を分母とし、T(i)を分子として演算を行う。これにより、式(9)のカルマンベクトルKが得られる。
【0072】
図5は、本発明の別の実施の形態ブロック図であり、特に歪み補償係数を記憶するテーブル500の容量を小さく出来るものである。前提として図2、図3に示すLMSアルゴリズムによる構成に適用されているが、これに限定されず、図4のRLSアルゴリズムによる実施の形態等にも適用可能である。
【0073】
図6は、図5の動作を説明する図である。即ち、図5の実施の形態は、推定歪み補償係数を実際の推定値を基に、隣接する時点の推定値を演算により求め補間するようにしたものである。この演算のために図5において、内挿値演算回路530を備えている。
【0074】
今、歪み補償係数を記憶するテーブル500から既に説明したアルゴリズム基づき推定された歪み補償係数について、pn の時hn 、pn+1 の時hn+1 とすると、図6に示すようにpn とpn+1 の間は、一次関数の値h(p)で近似補間する。
【0075】
この時の補間値は、数4に従い内挿値演算回路530で求められる。
【0076】
【数4】
【0077】
即ち、p=pn の時hn とすると、pがpn <p<pn+1 にある時、式(12)で求められる値となる。
【0078】
このようにして求められた、補間値を図5の構成において、スイッチ531で切り換えて、乗算器6に接続するようにしている。かかる構成により、歪み補償係数を記憶するテーブル500の容量を小さくでき、あるいは補償係数テーブル500の容量を同一とすると、より細かな補償係数値を入力信号X(t)に与え、きめ細かな歪み補償を行うことが可能である。
【0079】
図7は、本発明の別の実施の形態ブロック図である。歪み補償係数の初期値を予め用意しておき、状況に応じて適応アルゴリズムにより更新するものである。図7において、図2の実施の形態を基本として歪み補償係数の初期値を保持する初期値テーブル520を有している。
【0080】
521は、切替えスイッチであり、初期値テーブル520に接続し、予め用意した値を歪み補償係数として入力信号に乗積する。状況に応じて、スイッチ521を乗算器501に接続して推定される歪み補償係数値で更新する。かかる構成により、収束速度の向上が期待出来る。
【0081】
尚、図7は、LMSアルゴリズムを用いる例に適用しているが、これに限られず、上記図4で説明したRLSアルゴリズムを用いる場合にも同様に適用可能である。
【0082】
図8は、歪み補償係数を記憶するテーブル500の内容の更新と入力信号に対する歪み補償係数の乗積を時間的に独立して行う場合の実施の形態ブロック図である。図8の構成は、図2のLMSアルゴリズムの構成を前提としているが、これに限定されず、図4のRLSアルゴリズムの構成を前提とすることも勿論可能である。
【0083】
図8において、更に付加回路として、歪み補償係数を記憶するテーブル500と同様の付加歪補償テーブル501を設けている。したがって、歪補償係数値の入力信号に対する乗積は、歪み補償係数を記憶するテーブル500の出力により行い。歪補償係数値の更新は、付加歪補償テーブル501に対して行うようにする。これにより、歪補償係数値の更新と入力信号に対する歪み補償係数の乗積を時間的に独立して行うことが可能である。
【0084】
ここで、歪み補償係数を記憶するテーブル500及び付加歪補償テーブル501として一対のテーブル用メモリを設ける他に、デュアルポートRAMを用いて構成することが可能である。又、図において、10、11は、遅延回路であって、歪補償係数値の更新と入力信号に対する歪み補償係数の乗積のタイミングを所定の時間関係に同期させるためのものである。
【0085】
図9は、本発明の歪み補償回路の適用例である。変調器入力を考慮すると歪み補償係数を更新するに際し、任意の入力振幅値に対して歪み補償係数h(t)を与えることが必要である。このために歪み補償係数h(t)を予め求めておくことが重要である。
【0086】
図9において、(i)に示すトレーニング信号は、0から一定振幅まで上昇する繰り返しの鋸歯状波である。このトレーニング信号を用い、事前に0から一定振幅の範囲で歪み補償係数h(t)を求めておくことが出来る。これにより、適切な歪み補償係数に収束を早めることが出来る。
【0087】
図10は、更に本発明に従う別の実施の形態ブロック図である。本発明によるプリディストータでは上記実施の形態で説明したように、入力振幅に対応した歪み補償係数を用いている。増幅器出力信号を得るための直交復調器3にDCオフセット、I、Qチャネルのゲイン差がある場合、本来同じ補正係数を与えるべきが、正しい補償係数が推定出来ずリニアライザとしての特性が劣化する。
【0088】
したがって、図10の実施の形態は、かかる特性劣化に対応し、復調器のオフセット、ゲインの自動調整を行うものである。特に自動補正は、hn (p)の推定の前に行うため、復調位相は未知である。このため復調位相に依存しない方法でオフセット、ゲイン偏差を測定する。
【0089】
図11は、直交復調器3にDCオフセットがある場合を説明する図である。図11においてIは、正常な場合の複素平面の単位円であり、IIは、DCオフセットがある場合の複素平面の単位円である。
【0090】
今、図11において、数5で表される単位円を出力する。この時のI/Qチャネルのそれぞれの最大値を測定する。これをIチャネルについて、vimax、vimin、Qチャネルについて、vqmax、vqminとすると、オフセットΔvi 、Δvq 、ゲインGi 、Gq がそれぞれ数6、数7のように表される。
【0091】
【数5】
【0092】
【数6】
【0093】
【数7】
【0094】
即ち、オフセットΔvi 、Δvq はそれぞれvimaxとviminの相加平均、vqmaxとvqminの相加平均で表される。また、ゲインの偏差は、IチャネルのゲインGi とQチャネルのゲインGq の比an =Gq /Gi で求められる。a=1の時、ゲイン偏差はなく、単位円は真円となる。
【0095】
ここでIチャネルのゲインGi 、QチャネルのゲインGq は、それぞれ数6に示すように、最大値と最少値の差の半分として求められる。ゲイン偏差の補正は、例えばQチャネルを参照値としてIチャネルのゲインを可変して行う。
【0096】
図10について更に説明すると、上記演算を行う回路として、図1の原理図に対してDCオフセット及びゲイン偏差補正を行う補正部70が設けられている。尚、図1における直交変調器2及び復調検波器3は、他の実施の形態説明図におけると同様に図示省略され、ベースバンド信号のみの構成が示されている。
【0097】
増幅器1から分岐されるI、Qチャネル信号は、それぞれ最大値を検知する回路701、711、最小値を検知する回路702、712に入力される。更にIチャネル側の最大値を検知する回路701と最小値を検知する回路702の出力は、和回路703及び差回路704に入力される。一方、Qチャネル側の最大値を検知する回路711と最小値を検知する回路712の出力は、和回路713及び差回路714に入力される。
【0098】
和回路703、713の出力は、それぞれ1/2乗算回路705、715に入力される。したがって、1/2乗算回路705、715の出力は、数5のオフセットΔVi、ΔVqとなる。
【0099】
このオフセットΔVi 、ΔVq は、それぞれI、Qチャネル信号から減ずるように差回路706、716に入力される。したがって、差回路706、716の出力は、増幅器1の出力からオフセットΔVi 、ΔVq が打ち消されたI、Qチャネル信号となる。
【0100】
一方、差回路704、714の出力は、割り算回路720に入力され、その比即ち、Gq /Gi が求められる。この比Gq /Gi は、上記したように、Qチャネルを参照値としてIチャネルのゲインを可変してゲイン偏差の調整を行うためにIチャネル側の差回路706の出力と乗算器721で乗算される。
【0101】
上記の如くしてオフセット及びゲイン調整がされた増幅器1の出力y(t)は、誤差検出器7において、入力信号x(t)との比較の対象とされる。
【0102】
上記の如く行われる補正後の信号は数8で与えられる。
【0103】
【数8】
【0104】
ここで、上記のゲイン偏差an は、図10に示した如く実際にゲインの除算を行って求めることができ、ゲインの比Gq /Gi を求めるのに割り算回路720を用いている。しかし、デジタル回路により割り算を実行させる場合、一般に複雑な構成となる。
【0105】
したがって、図12は、図10において行っている割り算回路720による実際の除算に代え、Gi とGq の差が0となるようにGq /Gi の推定値an をLMSアルゴリズムで推定するものである。推定値an は、数9により求められ、図12の推定回路730により実行される。
【0106】
【数9】
【0107】
即ち、メモリ機能を有するGq /Gi セットメモリ回路731への入力であるGq /Gi の推定値an は、誤差回路734の出力であり、数9の式(13)で表されるeにステップパラメータμ、差回路704の出力Gi が乗算回路732、733で乗算される。この乗算結果μeGi とGq /Gi セット回路731の出力an−1 が加算回路735で加算される。
【0108】
推定回路730は、誤差回路734の出力eが0となるように動作するので、結局、乗算器721に乗算される補正値anは式(14)の関係からGq /Gi の比と等価の値に出来る。
【0109】
上記図10、図12の実施の形態において、入力信号振幅が一定の場合について説明した。この場合I、Q復調信号の最大値、最小値のみから補正値を求めるため、ランダムな入力信号に対してもその観測時間を長くとることにより適用できる。また上記の測定を複数回行ってその平均値を補正値とすることにより、補正精度を向上することができる。
【0110】
しかし、時間が掛かると言う問題がある。図13は、これに対応する実施の形態であり、単位円をトレーニング信号として出力する回路10を設ける。単位円発生回路10の出力をx(t)の代わりトレーニング期間に入力すれば、単位円を一周する信号が出力されることにより、補正係数が取得出来る。
【0111】
単位円発生回路として、実部、虚部に対応してsine、cosineの値をROMテーブルに記憶し、順次アクセスするようにして構成出来る。
【0112】
【発明の効果】
以上実施の形態にしたがい説明したように、本発明により次の効果が得られる。
(a)ディジタル処理によるプリディストータの歪補償テーブル容量を1/2n (nは入力信号の量子化ビット数)以下に削減することができる。これよりダイナミックレンジの大きな信号に対する用途では、メモリ容量が大きく低減され、従来では実現性に問題のあった回路規模を現実的なものとすることができる。
【0113】
また携帯機端末等のスペース、消費電力の制限が厳しい用途においては、シングルチップLSI、あるいはDSP等の内部RAMの容量で実現可能なリニアライザを構成することが可能となる。
(b)復調位相を調整する移相器あるいは位相回転演算が不要となり、温度、時間変化に対する補正が必要ない。これより常に安定した歪補償特性が得られる。
(c)復調系の不完全性に対する許容範囲が広がるため、ハードウェアのコスト、調整工数を低減することができる。
(d)増幅器、フィルタ等の遅延の影響を受けない理想的なプリディストーションが可能となる。
【図面の簡単な説明】
【図1】本発明の原理を説明する図である。
【図2】本発明の第1の実施の形態ブロック図である。
【図3】本発明の第2の実施の形態ブロック図である。
【図4】本発明の第3の実施の形態ブロック図である。
【図5】本発明の第4の実施の形態ブロック図である。
【図6】図5の動作説明図である。
【図7】本発明の第5の実施の形態ブロック図である。
【図8】本発明の第6の実施の形態ブロック図である。
【図9】本発明の第7の実施の形態ブロック図である。
【図10】本発明の第8の実施の形態ブロック図である。
【図11】図10の動作説明図である。
【図12】本発明の第9の実施の形態ブロック図である。
【図13】本発明の第10の実施の形態ブロック図である。
【図14】本発明の従来例を説明する図である。
【符号の説明】
1 増幅器
2 直交変調器
3 直交復調検波器
4 ローカル信号発振器
5 補償係数メモリ
50 適応型アルゴリズムによる推定補償係数生成回路
500 歪み補償係数を記憶するテーブル
6 乗算器
7 比較器
8 共役複素数
9 アクセス信号を生成する回路
Claims (19)
- 増幅器と、
該増幅器の入力信号と、該増幅器の出力との誤差信号を求める手段と、
該誤差信号から該増幅器の歪み特性成分を補償する補償係数を適応型アルゴリズムにより生成する手段と、
該生成された補償係数を該入力信号に対応して出力する手段と、
該入力信号に対応して出力される補償係数を該入力信号に乗積して、該増幅器に入力する手段とを
有することを特徴とする歪補償を有する増幅器。 - 請求項1において、
該入力信号に対応して出力する手段は、入力信号の振幅に対応した歪補償係数を出力することを特徴とする歪補償を有する増幅器。 - 請求項1において、
該入力信号に対応して出力する手段は、入力信号の電力に対応した歪補償係数を出力することを特徴とする歪補償を有する増幅器。 - 請求項1において、
該入力信号に対応して出力する手段は、入力信号の振幅の関数に対応した歪補償係数を出力することを特徴とする歪補償を有する増幅器。 - 請求項1において、
該入力信号に対応して出力する手段は、入力信号の電力の関数に対応した歪補償係数を出力することを特徴とする歪補償を有する増幅器。 - 請求項1、2、3、4または5において、
該入力信号に対応して出力される補償係数を該入力信号に乗積して、該増幅器に入力する手段は、該入力信号に対して出力された歪補償係数を複素数で乗積することを特徴とする歪補償を有する増幅器。 - 請求項1、2、3、4または5において、
該適応型アルゴリズムをLMS適応アルゴリズムとすることを特徴とする歪補償を有する増幅器。 - 請求項1、2、3、4または5において、
該適応型アルゴリズムをRLS適応アルゴリズムとすることを特徴とする歪補償を有する増幅器。 - 請求項1、2、3、4または5において、
該増幅器の入力側に直交信号変調器と、該増幅器の出力側に該増幅器から分岐される信号を復調する直交信号復調器を有し、且つ該適応型アルゴリズムを該直交信号復調器からの復調複素信号の象限情報を用いる適応アルゴリズムとすることを特徴とする歪補償を有する増幅器。 - 請求項1、2、3、4または5において、
該誤差信号から該増幅器の歪み特性成分を補償する該補償係数を適応型アルゴリズムにより生成する手段に機能的に接続され、生成された補償係数に基づき、所定関数により補償係数を演算し、該演算により求められた補償係数により、該生成された補償係数を補間することを特徴とする歪補償を有する増幅器。 - 請求項10において、
該所定関数を一次関数とすることを特徴とする歪補償を有する増幅器。 - 請求項1、2、3、4または5において、
更に、歪補償係数の初期値を出力する手段を有し、該手段は、該生成された補償係数を該入力信号に対応して出力するのに先立って、該初期値を該入力信号に乗積することを特徴とする歪補償を有する増幅器。 - 請求項1、2、3、4または5において、
該誤差信号から該増幅器の歪み特性成分を補償する補償係数を適応型アルゴリズムにより生成する手段により生成される補償係数の更新と、該入力信号に対応して出力される補償係数を該入力信号に乗積して、該増幅器に入力する手段における該補償係数の該入力信号への乗積とを時間的に独立して行うように制御する手段を有することを特徴とする歪補償を有する増幅器。 - 請求項13において、
該補償係数の該入力信号への乗積とを時間的に独立して行うように制御する手段は、デュアルポートRAMを有し、該デュアルポートRAMへの該補償係数の更新書き込みと、該デュアルポートRAMからの該補償係数の読出しが時間的に独立されることを特徴とする歪補償を有する増幅器。 - 請求項1、2、3、4または5において、
更に、所定振幅値まで漸次増加する波形の信号を発生するトレーニング信号発振器を有し、トレーニング期間に該波形の信号を繰り返し入力し、振幅をスイープして該所定振幅値の範囲で歪み補償係数を推定するようにしたことを特徴とする歪補償を有する増幅器。 - 請求項1、2、3、4または5において、
該増幅器の入力側に直交信号変調器と、該増幅器の出力側に該増幅器から分岐される信号を復調する直交信号復調器と更に、該直交信号復調器からの復調信号について、その最大値、最少値に基づき、該直交信号復調器を含む系のDCオフセット及び、IチャネルとQチャネルのゲイン偏差を求め、これを補正するする回路を有することを特徴とする歪補償を有する増幅器。 - 請求項16において、
該DCオフセット及び、IチャネルとQチャネルのゲイン偏差を、該直交信号復調器から単位円を出力し、該単位円に基づき該IチャネルとQチャネルの最大値、最少値を検知し、該最大値、最少値に基づき補正することを特徴とする歪補償を有する増幅器。 - 請求項17において、
該IチャネルとQチャネルのゲイン偏差を適応アルゴリズムを用いて検知することを特徴とす歪補償を有する増幅器。 - 請求項16において、
更に、複素平面での単位円を発生するトレーニング信号発振器を有し、トレーニング期間に該単位円の信号を繰り返し入力し、振幅をスイープして該所定振幅値の範囲で歪み補償係数を推定するようにしたことを特徴とする歪補償を有する増幅器。
Priority Applications (4)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP22416995A JP3560398B2 (ja) | 1995-08-31 | 1995-08-31 | 歪補償を有する増幅器 |
US08/688,443 US5870668A (en) | 1995-08-18 | 1996-07-30 | Amplifier having distortion compensation and base station for radio communication using the same |
CN96109990.9A CN1084986C (zh) | 1995-08-18 | 1996-08-15 | 带有失真补偿的放大器及使用此放大器的无线通信基站 |
CN01135835.1A CN1214670C (zh) | 1995-08-18 | 2001-10-24 | 带有失真补偿的放大器及使用此放大器的无线通信基站 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP22416995A JP3560398B2 (ja) | 1995-08-31 | 1995-08-31 | 歪補償を有する増幅器 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPH0969733A JPH0969733A (ja) | 1997-03-11 |
JP3560398B2 true JP3560398B2 (ja) | 2004-09-02 |
Family
ID=16809619
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP22416995A Expired - Fee Related JP3560398B2 (ja) | 1995-08-18 | 1995-08-31 | 歪補償を有する増幅器 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP3560398B2 (ja) |
Cited By (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
WO2008120318A1 (ja) | 2007-03-28 | 2008-10-09 | Fujitsu Limited | 歪補正制御装置及び歪補正制御方法 |
WO2008126217A1 (ja) | 2007-03-28 | 2008-10-23 | Fujitsu Limited | 歪補正制御装置及び歪補正制御方法 |
JP2010114655A (ja) * | 2008-11-06 | 2010-05-20 | Japan Radio Co Ltd | プリディストータ |
Families Citing this family (29)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP4597100B2 (ja) * | 1997-09-05 | 2010-12-15 | 富士通株式会社 | 高周波電力増幅器用非線形補償回路 |
US6101224A (en) * | 1998-10-07 | 2000-08-08 | Telefonaktiebolaget Lm Ericsson | Method and apparatus for generating a linearly modulated signal using polar modulation |
US6246286B1 (en) * | 1999-10-26 | 2001-06-12 | Telefonaktiebolaget Lm Ericsson | Adaptive linearization of power amplifiers |
JP4555429B2 (ja) * | 2000-04-03 | 2010-09-29 | 株式会社ケンウッド | プリディストーション型非線形歪み補償回路およびこれを用いたディジタル送信機 |
JP2002026665A (ja) * | 2000-07-07 | 2002-01-25 | Sony Corp | 歪補償装置および歪補償方法 |
WO2002061938A1 (fr) * | 2001-01-31 | 2002-08-08 | Fujitsu Limited | Appareil de compensation de distorsion |
JP4046489B2 (ja) | 2001-07-17 | 2008-02-13 | 富士通株式会社 | 送信増幅器の並列運転システム |
JP3876408B2 (ja) | 2001-10-31 | 2007-01-31 | 富士通株式会社 | 歪補償装置及び歪補償方法 |
JP3874688B2 (ja) | 2002-03-29 | 2007-01-31 | 富士通株式会社 | 歪補償装置 |
JP2004032609A (ja) | 2002-06-28 | 2004-01-29 | Nec Corp | 非線形歪み補償回路 |
KR100489409B1 (ko) * | 2002-10-26 | 2005-05-16 | 텔레시스 인코포레이티드 | 무선 통신시스템의 송수신기 성능을 개선하기 위한 방법 |
JP4175503B2 (ja) * | 2003-04-18 | 2008-11-05 | ソニー・エリクソン・モバイルコミュニケーションズ株式会社 | 歪み補償回路及び送信装置 |
JP2005012540A (ja) | 2003-06-19 | 2005-01-13 | Matsushita Electric Ind Co Ltd | 電力増幅装置 |
US7126999B2 (en) | 2003-08-11 | 2006-10-24 | Telefonaktiebolaget Lm Ericsson (Publ) | Pseudo-polar modulation for radio transmitters |
JP4371830B2 (ja) | 2004-01-27 | 2009-11-25 | 富士通株式会社 | 歪補償増幅装置および基地局 |
WO2007036990A1 (ja) | 2005-09-28 | 2007-04-05 | Fujitsu Limited | 歪補償装置 |
WO2007046370A1 (ja) | 2005-10-17 | 2007-04-26 | Hitachi Kokusai Electric Inc. | 非線形歪検出方法及び歪補償増幅装置 |
JP2007221613A (ja) * | 2006-02-20 | 2007-08-30 | Fujitsu General Ltd | 歪補償方法および装置 |
JP5242024B2 (ja) * | 2006-06-08 | 2013-07-24 | 株式会社東芝 | 歪補償装置、増幅装置、送信装置、歪補償方法 |
JP2010166453A (ja) * | 2009-01-16 | 2010-07-29 | Sumitomo Electric Ind Ltd | 歪補償装置及び無線基地局 |
JP5251565B2 (ja) | 2009-02-05 | 2013-07-31 | 富士通株式会社 | プリディストータ及びその遅延調整方法 |
US20100323641A1 (en) * | 2009-06-22 | 2010-12-23 | Qualcomm Incorporated | Method and apparatus for using pre-distortion and feedback to mitigate nonlinearity of circuits |
JP5459158B2 (ja) | 2010-09-21 | 2014-04-02 | 富士通株式会社 | 送信装置及び歪補償方法 |
JP6207806B2 (ja) | 2011-05-10 | 2017-10-04 | 富士通株式会社 | 歪補償装置及び歪補償方法 |
JP6064374B2 (ja) | 2012-05-30 | 2017-01-25 | 富士通株式会社 | 歪補償装置、および、歪補償方法 |
JP6059003B2 (ja) | 2012-12-26 | 2017-01-11 | パナソニック株式会社 | 歪み補償装置及び歪み補償方法 |
JP6054739B2 (ja) | 2012-12-26 | 2016-12-27 | パナソニック株式会社 | 歪み補償装置及び歪み補償方法 |
JP6235899B2 (ja) | 2013-12-25 | 2017-11-22 | パナソニック株式会社 | 送信装置及び歪み補償方法 |
JP6994656B2 (ja) * | 2019-08-27 | 2022-01-14 | パナソニックIpマネジメント株式会社 | 信号処理装置及び調整方法 |
Family Cites Families (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS63121326A (ja) * | 1986-11-10 | 1988-05-25 | Nec Corp | 送信機 |
JPH0637551A (ja) * | 1992-07-17 | 1994-02-10 | Fujitsu Ltd | 歪み補償回路 |
JP3156439B2 (ja) * | 1993-04-20 | 2001-04-16 | 三菱電機株式会社 | 歪補償回路 |
US5523716A (en) * | 1994-10-13 | 1996-06-04 | Hughes Aircraft Company | Microwave predistortion linearizer |
-
1995
- 1995-08-31 JP JP22416995A patent/JP3560398B2/ja not_active Expired - Fee Related
Cited By (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
WO2008120318A1 (ja) | 2007-03-28 | 2008-10-09 | Fujitsu Limited | 歪補正制御装置及び歪補正制御方法 |
WO2008126217A1 (ja) | 2007-03-28 | 2008-10-23 | Fujitsu Limited | 歪補正制御装置及び歪補正制御方法 |
US7746957B2 (en) | 2007-03-28 | 2010-06-29 | Fujitsu Limited | Distortion correction control apparatus and distortion correction control method |
US7881404B2 (en) | 2007-03-28 | 2011-02-01 | Fujitsu Limited | Distortion correction control apparatus and distortion correction control method |
JP2010114655A (ja) * | 2008-11-06 | 2010-05-20 | Japan Radio Co Ltd | プリディストータ |
Also Published As
Publication number | Publication date |
---|---|
JPH0969733A (ja) | 1997-03-11 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
JP3560398B2 (ja) | 歪補償を有する増幅器 | |
JP5251565B2 (ja) | プリディストータ及びその遅延調整方法 | |
US6567478B2 (en) | Radio apparatus having distortion compensating function | |
JP4574471B2 (ja) | 歪補償直交変調器及び無線送信機 | |
US7486744B2 (en) | Distortion compensation apparatus | |
US6570514B1 (en) | Linearity error compensator | |
JP3707549B2 (ja) | 送信装置 | |
JP4516973B2 (ja) | Dcオフセット補償方法及びdcオフセット補償装置 | |
US20080074186A1 (en) | An Arrangement And A Method Relating To Signal Predistortion | |
JP3874688B2 (ja) | 歪補償装置 | |
GB2408861A (en) | A digital adaptive predistorter for counteracting memory effect in RF power amplifiers | |
KR20070007125A (ko) | 비선형 이득 특성 및 메모리 효과를 가진 rf 전력증폭기를 선형화하기 위한 디지털 전치왜곡 시스템 및 방법 | |
JPH10200594A (ja) | ディジタル復調器におけるシンボルタイミング復元回路 | |
JP2002077285A (ja) | 送信機 | |
JP3268135B2 (ja) | 無線機 | |
JP5303809B2 (ja) | 歪補償装置 | |
KR100654856B1 (ko) | 비선형 왜곡 보상을 위한 적응 전치 왜곡기 | |
JP3221326B2 (ja) | 送信装置 | |
US9172333B2 (en) | Distortion compensation device and distortion compensation method | |
JP2003188747A (ja) | 歪補償送信装置 | |
JP2007525867A (ja) | 送信システム用の適応プレディストーション | |
WO2009011071A1 (en) | Amplifier device with nonlinear-distortion compensation | |
JPWO2007010727A1 (ja) | 適応ディジタルフィルタ、信号処理方法、fm受信機およびプログラム | |
JP3145015B2 (ja) | 送信装置 | |
JP2006295440A (ja) | 歪補償装置および遅延量制御方法 |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
A977 | Report on retrieval |
Free format text: JAPANESE INTERMEDIATE CODE: A971007 Effective date: 20040518 |
|
TRDD | Decision of grant or rejection written | ||
A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 20040525 |
|
A61 | First payment of annual fees (during grant procedure) |
Free format text: JAPANESE INTERMEDIATE CODE: A61 Effective date: 20040525 |
|
R150 | Certificate of patent or registration of utility model |
Free format text: JAPANESE INTERMEDIATE CODE: R150 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20090604 Year of fee payment: 5 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20100604 Year of fee payment: 6 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20110604 Year of fee payment: 7 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20120604 Year of fee payment: 8 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20120604 Year of fee payment: 8 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20130604 Year of fee payment: 9 |
|
LAPS | Cancellation because of no payment of annual fees |