JP2011175085A - 表示駆動回路 - Google Patents
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Abstract
【解決手段】表示駆動回路101は、表示画像データに応答して表示装置105の応答特性を改善するOD駆動信号を生成するOD演算回路114とOD駆動信号を表示装置105に供給可能な駆動出力回路106と圧縮表示データをメモリ110に格納可能な圧縮回路109を具備する。圧縮回路109は、表示画像データの離散コサイン変換を実行するDCT演算部とDCT変換表示データのエントロピー可変長符号化を実行するエントロピー符号化部を含む。好ましくは、表示駆動回路101は、メモリ110から読み出される圧縮表示データの伸張表示データ121をOD演算回路114に供給可能な伸張回路112を更に具備する。
【選択図】図1
Description
MPEG−2と呼ばれる動画像の一般的な圧縮方式は、ISO/IEC 13818−2によって標準化された規格である。MPEG−2は、ビデオストリームから冗長な情報を削除することによってビデオ記憶容量と必要な帯域幅とを削減すると言う原理に基づいている。尚、MPEGは、Moving Picture Experts Groupの略である。
まず、本願において開示される発明の代表的な実施の形態について概要を説明する。代表的な実施の形態についての概要説明で括弧を付して参照する図面の参照符号は、それが付された構成要素の概念に含まれるものを例示するに過ぎない。
次に、実施の形態について更に詳述する。尚、発明を実施するための最良の形態を説明するための全図において、前記の図と同一の機能を有する部品には同一の符号を付して、その繰り返しの説明は省略する。
《表示駆動装置の構成》
図1は、本発明の実施の形態1による表示駆動装置の構成を示す図である。
次に、図1の本発明の実施の形態1による表示駆動装置で実行される圧縮伸張処理動作に関して、説明する。
図2は、図1に示した本発明の実施の形態1による液晶駆動回路101の圧縮ブロック109の構成を示す図である。
図6は、図1に示した本発明の実施の形態1による液晶駆動回路101に含まれた第1伸張ブロック111の構成を示す図である。
図7は、図1に示した本発明の実施の形態1による液晶駆動回路101に含まれた第2伸張ブロック112の構成を示す図である。
図9は、図1に示した本発明の実施の形態1による液晶駆動回路101に含まれたOD演算回路114の構成を示す図である。
以上、図1、図2、図6、図7、図8、図9にてそれぞれ示した構成を採用する本発明の実施の形態1による液晶駆動回路101では、圧縮ブロック109はDCT変換と量子化とエントロピー符号化とによるデータ圧縮を実行して、第1伸張ブロック111は逆量子化とDCT逆変換とによるデータ伸張を実行して、第2伸張ブロック112は逆エントロピー符号化と逆量子化とDCT逆変換とによるデータ伸張を実行するものである。
1 0
010 1
011 2
00100 3
00101 4
00110 5
00111 6
0001000 7
0001001 8
0001010 9
… …
指数ゴロム符号の各数値xが下記(5)式で示されるビット数によって表記される。この下記(5)式で、xは符号番号であり、Ibは指数ゴロム符号のビット数である。
次に図1、図2、図6、図7、図8、図9にそれぞれ示した構成を採用する本発明の実施の形態1による液晶駆動回路101による液晶パネル105での画像表示動作を説明する。
図13は、本発明の実施の形態2による表示駆動装置の構成を示す図である。
101…液晶駆動回路
102…中央処理ユニット(CPU)
103…メモリ
104…内部バス
105…液晶パネル
106…インターフェイス回路
107…ラインメモリ
108…バッファ
109…圧縮ブロック
110…メモリ
111…第1伸張ブロック
112…第2伸張ブロック
113…OD無効化係数設定レジスタ
114…オーバードライブ(OD)演算回路
115…ラインメモリ
116…DAコンバータ
117…入力表示データ
118…第2圧縮データ
119…フレームメモリ終了信号
120…量子化係数
121…1フレーム前の圧縮伸張後の表示データ
122…第1圧縮データ
123…現在のフレームの圧縮伸張後の表示データ
124…量子化係数変更係数設定レジスタ
201…色空間変換部
202…DCT演算部
203…第1量子化部
204…第2量子化部
205…エントロピー符号化回路
206…メモリ書き込み部
207…量子化係数
401…1フレーム前の画像の輝度
402…現在のフレームの画像の輝度
403…1フレーム前の画像の圧縮伸張後の輝度
404…現在のフレーム前の画像の圧縮伸張後の輝度
501…量子化近傍判定データが真となる階調の範囲
601…逆量子化回路
602…DCT逆変換ブロック
603…色空間逆変換回路
701…メモリ読み出し部
702…逆エントロピー符号化回路
703…遅延回路
704…メモリ終了信号
801…表示画面上の位置
802…輝度不足量
803…補正量
804…現在のフレームの階調電圧
805…1フレーム前の階調電圧
806…目標輝度
901…演算器
902…差演算回路
903…比較器
904…ルックアップテーブル(LUT)
905…加算器
906…セレクタ
Claims (9)
- 表示画像データに応答して外部の表示装置の応答特性を改善するためのオーバードライブ駆動信号を生成するオーバードライブ演算回路と前記オーバードライブ駆動信号を前記表示装置に供給可能な駆動出力回路とを具備する表示駆動回路であって、
前記表示駆動回路は、前記表示画像データの圧縮によって生成した圧縮表示データをメモリに格納可能な圧縮回路を更に具備して、
前記圧縮回路は、前記表示画像データの離散コサイン変換を実行可能なDCT演算部と、前記DCT演算部の出力から生成されるDCT変換表示データのエントロピー可変長符号化を実行可能なエントロピー符号化部とを含む
ことを特徴とする表示駆動回路。 - 前記メモリから読み出される前記圧縮表示データの伸張によって生成した伸張表示データを前記オーバードライブ演算回路に供給可能な伸張回路を更に具備して、
前記伸張回路は、前記エントロピー符号化部による前記エントロピー可変長符号化の逆の処理の逆エントロピー符号化を実行可能な逆エントロピー符号化回路と、前記DCT演算部による前記DCT変換の逆の処理のDCT逆変換を実行可能なDCT逆変換部とを含む
ことを特徴とする請求項1に記載の表示駆動回路。 - 前記圧縮回路の前記DCT演算部から生成される他のDCT変換表示データが前記メモリを介することなく供給可能な他の伸張回路を更に具備して、
前記他の伸張回路は、前記DCT演算部による前記DCT変換の逆の処理の他のDCT逆変換を実行可能な他のDCT逆変換部を含むものであり、
前記他の伸張回路の出力から生成される他の伸張表示データは、前記オーバードライブ演算回路に供給可能とされることを特徴とする請求項2に記載の表示駆動回路。 - 現フレームの表示画像データに関して、前記他の伸張回路の前記出力から生成される前記他の伸張表示データが、前記オーバードライブ演算回路に供給可能とされ、
前記メモリから読み出される1フレーム前の表示画像データに関して、前記伸張回路から生成される前記伸張表示データが、前記オーバードライブ演算回路に供給可能とされたことを特徴とする請求項3に記載の表示駆動回路。 - 前記圧縮回路は、前記DCT演算部の出力に接続された第1量子化部と第2量子化部とを含むものであり、
前記第1量子化部の出力から生成される出力信号が、前記メモリを介することなく前記他の伸張回路に供給可能なものであり、
前記第2量子化部の出力から生成される出力信号が、前記エントロピー符号化部の入力に供給可能なものであり、
前記他の伸張回路は、前記他のDCT逆変換部の入力にその出力が接続され、その入力に前記圧縮回路の前記第1量子化部から生成される前記出力信号が供給可能な第1逆量子化部を含むものであり、
前記伸張回路は、前記逆エントロピー符号化回路の出力にその入力が接続され、前記DCT逆変換部の入力にその出力が接続された第2逆量子化部を含むことを特徴とする請求項4に記載の表示駆動回路。 - 前記圧縮回路の前記前記第2量子化部に供給される量子化係数は、前記圧縮回路の前記エントロピー符号化部の1フレーム分の圧縮データのビット数と目標圧縮データ量との比較によって設定されものであり、
前記圧縮回路の前記第1量子化部と前記他の伸張回路の前記第1逆量子化部と前記伸張回路の前記第2逆量子化部とに供給される他の量子化係数は、前記量子化係数の1フレーム分遅延された値である
ことを特徴とする請求項5に記載の表示駆動回路。 - 前記表示駆動回路は、前記表示装置の複数の表示領域の各表示領域で前記他の量子化係数を独立に設定可能である
ことを特徴とする請求項5に記載の表示駆動回路。 - 前記表示装置の前記複数の表示領域の前記各表示領域で前記他の量子化係数を独立に設定するための複数のレジスタを前記圧縮回路が含む
ことを特徴とする請求項7に記載の表示駆動回路。 - 前記他の量子化係数が前記オーバードライブ演算回路にも供給されることによって、前記現フレームの圧縮伸張データとしての前記他の伸張回路の前記出力から生成される前記他の伸張表示データと前記1フレーム前の圧縮伸張データとしての前記伸張回路から生成される前記伸張表示データとの差の絶対値が大きいか小さいかに従って、前記オーバードライブ演算回路から生成される前記オーバードライブ駆動信号を前記オーバードライブ演算回路)の出力として前記オーバードライブ演算回路が選択するか前記現フレームの前記表示画像データを前記オーバードライブ演算回路の出力として前記オーバードライブ演算回路が選択する
ことを特徴とする請求項6に記載の表示駆動回路。
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