JP2010538483A - 基板プレート、殊にdcbセラミック基板プレートを用いる電子的な構成素子の製造方法および接触接続方法 - Google Patents

基板プレート、殊にdcbセラミック基板プレートを用いる電子的な構成素子の製造方法および接触接続方法 Download PDF

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Abstract

本発明は、上面および/または下面にそれぞれ配置されている、固定および/または電気的な接触接続のための少なくとも1つの接触面を備えている、ケーシングされていない少なくとも1つの電子的な構成素子を接触接続させる方法に関する。構成素子が該構成素子の下面を用いて、下面の表面を超えて延在している絶縁性の支持体フィルムに固定され、上面の表面を超えて延在し、成形された3次元構造体を形成しているそれぞれ1つの導電性の導体部に、上面における接触面が固定および/または電気的に接触接続され、支持体フィルムと導体部の3次元構造体との間に絶縁性質量体が形成され、接触面の領域において下面から支持体フィルムが除去され、基板、殊に導体により事前に構造化されたDCBセラミック基板において接触面と対向しているそれぞれ1つの接触面に下面における接触面が固定および/または電気的に接触接続される。

Description

本発明は、独立請求項の上位概念に記載されている方法、ならびに独立請求項の上位概念に記載されているデバイスに関する。
殊にパワーエレクトロニクスにおける、1つまたは複数のケーシングされていないチップおよび/または受動的な構成素子を電気的に接触接続する際に、従来技術においては基板としてDCB(direct copper bonding)セラミックが使用されている。構成素子はその裏面を用いて平坦にDCBセラミック基板プレート上にはんだ付けされている。接触接続は太いワイヤによるボンディングを用いるか、WO 03030247に記載されている、いわゆる平坦接触接続(planar contacting)を用いて行われる。この刊行物の開示内容は本願発明の参考文献とする。太いワイヤによるボンディングとは異なり、平坦接触接続は絶縁フィルムを電子的な構成素子上に積層化し、接触窓を殊にレーザアブレーションにより開き、平坦な接続部を電気めっき金属化によって形成することによって行われる。
本発明の課題は、上面および/または下面における固定および/または電気的な接触接続のための接触面を備えている、殊に1000ボルトよりも高い高電圧領域のためのケーシングされていない少なくとも1つの電子的な構成素子、殊に電力用構成素子または電力用半導体構成素子を廉価に電気的に接触接続させる手段を提供することである。さらには、高集積密度、接触接続の低誘導性特性、高い電流容量、効果的な冷却および/または電気サイクル負荷ならびに熱サイクル負荷に関する高い信頼性が提供されるべきである。
電気サイクル負荷とは、所定回数の負荷の変化で低電力および高電力に交番的にさらされることを意味する。熱サイクル負荷とは、所定回数、例えば100〜1000サイクルの温度変化で、低温、例えば−40℃と、高温、例えば+125℃に交番的にさらされることを意味する。
導体部は高導電性且つ高電流耐性の導体であり、導体は例えば打ち抜きおよび/または曲げによって容易に機械的に加工でき、また塑性に成形可能である。この種の導体部は打ち抜き曲げ部とも称される。例えば、導体部はリードフレーム、殊に銅リードフレームでよい。
接触フレームは導体部を基板の接触面に電気的に接触接続および/または固定するための導体部の曲げられた部分である。
従来技術によれば、DCBセラミックが基板として使用されており、電子的な構成素子はその裏面を用いて平坦にはんだ付けされる。「DCB」とは「Direct Copper Bonding」を意味する。DCBセラミックを形成する場合、セラミックの上面および下面において銅板が圧延され、約1080℃でセラミックと形状結合(formschluessig;形状による束縛)される。続いて、2つの銅面のうちの少なくとも一方が湿式化学的に構造化される。この種のセラミックの既知の製造メーカはCuramik社である。
本発明の課題は、独立請求項に記載されている方法および独立請求項に記載されているデバイスによって解決される。
本発明により提案される解決手段によって、ケーシングされていない電子的な構成素子を基板、殊にDCBセラミック上に非常に廉価に被着およびワイヤ接続することができる。絶縁材料として容易に形成できる射出成形されたプラスチックが使用される。前述の解決手段によって構成素子の低誘導性の接触接続部を提供することができる。
別の有利な実施形態は従属請求項に記載されている。
有利な実施形態によれば、導体部がフィルムの平面にまで延在する少なくとも1つの接触フレームを形成する。同様に、接触フレームの領域における支持体フィルが除去される。接触フレームは基板プレートにおける対向する接触面に固定および/または電気的に接触接続される。このようにして、高電流耐性を高導電性の材料からなる太い接続部によって提供することができる。導体部は、高電流耐性を有し、また例えば打ち抜きおよび/または曲げによって比較的簡単に機械的に加工できる高導電性の材料からなる電気的な接続部に関する実施形態である。材料を塑性に成形することができる。
別の有利な実施形態によれば、導体部がフィルムの平面にまで延在している場合、接触フレームの領域における支持体フィルムが除去され、接触フレームが基板における対向する接触面に固定および/または電気的に接触接続される。
別の有利な実施形態によれば、導体部がはんだにより固定および/または電気的に接触接続される。このようにして、この導体部を容易に従来のやり方で加工することができる。フィルム上に被着された電子的な構成素子は露出された上面において、例えば銅を含有する、相応に成形された導体部を用いてはんだ付けされる。
別の有利な実施形態によれば、絶縁性質量体は射出成形によって形成される。絶縁性の材料では一方の端面がフィルムを形成し、他方の端面が打ち抜き曲げ部の形成に応じて相応に成形された3次元の射出成形ツールを形成する。
別の有利な実施形態によれば、露光により支持体フィルムを容易に除去できるように支持体フィルムが感光性である。支持体フィルムの除去の他の有利で簡単な実現手段はアブレーション、殊にレーザアブレーションである。このようにして、電子的な構成素子の下面、ならびに下方に向かって案内されている接触フレームの領域においては、露光または(レーザなどによる)アブレーションによってフィルム材料が除去されている。この実施形態によれば、支持体フィルムを適切な時点に後続のステップにおいて開放することもできる。アブレーションが行われる場合、支持体フィルムが感光性であってはならない。
別の有利な実施形態によれば、下面における接触面および/または接触フレームと基板プレートのそれぞれの接触面との固定および/または電気的な接触接続は、はんだ付けおよび/または接着により実施される。このようにして、固定および/または電気的な接触接続が簡単に実施される。後続のはんだ付けまたは接着により、準備されたDCB基板プレートと電気的な接触接続部の露出された面とが電気的に接続される。
別の有利な実施形態によれば、構成素子が支持体フィルム上の所定の位置において、形成すべきデバイスの所定の機能構造に応じて固定される。すなわち第1のステップでは、電気的に絶縁された支持体フィルム上の所定の位置において、電子的な構成素子はその下面を用いて固着される。したがって、非常に早い段階でデバイスを設計することができる。
別の有利な実施形態によれば、絶縁性質量体内および/または基板プレート上に冷却用装置、殊に冷却チャネルまたはヒートシンクまたはヒートパイプが配置されている。このようにして、高い冷却能力で冷却を実施することができる。同様に、冷却部を両面に、すなわちDCB基板の下面にも、電子的な構成素子の上面にも形成することができる。
別の有利な実施形態によれば、導体部は高導電性の材料、例えば銅を有する。
別の有利な実施形態によれば、導体部の膨張係数と絶縁性材料の膨張係数は、高い熱サイクル耐性および電気サイクル耐性を生じさせるために相互に適合されている。
別の有利な実施形態によれば、支持体フィルム上に固定されたまま残存する装置が形成される。
以下では本発明を図面に示した実施例に基づき詳細に説明する。
本発明によるデバイスの実施例を示す。 本発明によるデバイスを製造するための本発明による方法の実施例を示す。
図1は、ケーシングされていない2つの電子的な構成素子1、しかも2つの絶縁ゲートバイポーラトランジスタ(IGBT)を示す。上面3にはそれぞれ1つの接触面7が形成されている。下面5にはそれぞれ2つの接触面7が形成されている。全ての接触面7は電子的な構成素子1の固定および/または電気的な接触接続に使用される。電子的な構成素子1は例えば電力用半導体構成素子、また殊に、1000ボルトを上回る電圧用の電子的な構成素子である。構成素子1は下面5を用いて、この下面5の表面を超えて延在している絶縁性の支持体フィルム13上に固定されている。上面3における接触面7には、導電性の導体部15として成形された3次元構造体が固定されて電気的に接触接続されている。導体部15は上面3の表面を超えて延在している。支持体フィルム13と導体部15の3次元構造体との間に絶縁性質量体17が形成されている。例えば、絶縁性質量体17を射出成形によって形成することができる。殊に、絶縁性質量体17の成形のために従来の射出成形ツールを使用することができる。図1によれば、導体部15は支持体フィルム13の平面にまで延在している接触フレーム16を形成する。構成素子1の下面5における接触面7には開口部21を備えた支持体フィルム13が形成されている。支持体フィルム13は接触フレーム16の領域においても同様に除去されており、相応の開口部21を有している。
支持体フィルム13の下方には基板11が形成されており、この基板11は殊に有利にはDCBセラミック基板である。基板11の上面には導体路が事前に構造化されてり、それらの導体路に基板11の接触面9が形成されている。この種の接触面9は構成素子1側の接触面7と対向している。構成素子1は下面5を用いて、2つの接触面7の領域において、基板11上の対している2つの接触面9に固定され、電気的に接触接続されている。接触接続ははんだ19を用いて殊に簡単に行われる。導体部15が支持体フィルム13の平面にまで延在している場合、支持体フィルム13は接触フレーム16の領域において除去されており、また開口部21を有している。接触フレーム16は基板11上の対向している接触面9に固定されており、また電気的に接触接続されている。図1による、基板から離れる方向に延びる下の3つの矢印は、本発明によるデバイスを冷却するためのヒートシンク23の方向に示されている。択一的に、冷却用装置、殊に冷却チャネル、ヒートシンク23および/またはヒートパイプを導体部15上、および/または、絶縁性質量体17内、および/または、基板11上に配置ないし形成することができる。図1において上方に向けられている矢印は、接触面9を備えた基板11と接触面7を備えた電子的な構成素子1との固定および電気的な接触接続を示す。
図2は、上面3および/または下面5上にそれぞれ配置されている、固定および/または電気的な接触接続のための少なくとも1つの接触面7を備えた、少なくとも1つのケーシングされていない電子的な構成素子1、殊に電力用構成素子または電力用半導体構成素子を接触接続させるための本発明による方法の実施例を示す。
ステップS1においては、構成素子1がその下面5を用いて、この下面5の表面を超えて延在している絶縁性の支持体フィルム13上に固定される。ステップS2により、上面3における接触面7が、事前に成形された3次元構造体を形成しており、且つ上面3の表面を超えて延在している導電性の導体部15に固定および/または電気的に接触接続される。ステップS3により、支持体フィルム13と導体部15の3次元構造体との間に絶縁性質量体17が形成される。この際に、従来の射出成形法を適用することができる。殊に、絶縁性質量体17を境界付けるために従来のツールを使用することができる。ステップS4により、支持体フィルム13が接触面7の領域において下面5から除去される。続いてステップS5により、基板11上の導体路25において対応する接触面7に対向している接触面9に下面5における接触面7が固定されて電気的に接触接続される。ここで殊に有利には、DCB(Direct Copper Bonding)セラミック基板プレート11が使用される。
ここで、図1によるデバイスは単に本発明の一実施例に過ぎないことを言及しておく。基本的に、ケーシングされていない任意の電子的な構成素子1を使用することができる。殊に本発明は主電圧領域が1000ボルトよりも高い構成素子に適している。構成素子を支持体フィルム13上の所定の位置において所定の機能構造に応じて固定および/または電気的に接触接続することができる。電子的な構成素子1に関する別の例はダイオード、サイリスタ、トランジスタなどである。同様に、複数の接触フレーム16を使用することができる。接触フレーム16は基本的には必要ない。参照番号25は基板11における導体路構造を表し、DCB基板の場合には導体路25が殊に銅を有する。
基本的に、基板プレート11を備えていない本発明によるデバイスも装置として同様に保護範囲に含まれている。

Claims (18)

  1. 上面(3)および/または下面(5)にそれぞれ配置されている、固定および/または電気的な接触接続のための少なくとも1つの接触面(7)を備えている、ケーシングされていない少なくとも1つの電子的な構成素子(1)、殊に電力用構成素子または電力用半導体構成素子を接触接続させる方法において、
    前記構成素子(1)を該構成素子(1)の下面(5)を用いて、該下面(5)の表面を超えて延在している絶縁性の支持体フィルム(13)に固定し、
    前記上面(3)の表面を超えて延在し、成形された3次元構造体を形成しているそれぞれ1つの導電性の導体部(15)に、前記上面(3)における前記接触面(7)を固定および/または電気的に接触接続させ、
    前記支持体フィルム(13)と前記導体部(15)の前記3次元構造体との間に絶縁性質量体(17)を形成し、
    前記接触面(7)の領域において前記下面(5)から前記支持体フィルム(13)を除去し、
    基板(11)、殊に導体により事前に構造化されたDCBセラミック基板において前記接触面(7)と対向しているそれぞれ1つの接触面(9)に前記下面(5)における前記接触面(7)を固定および/または電気的に接触接続させることを特徴とする、方法。
  2. 前記導体部(15)から、殊に前記支持体フィルムの平面にまで延在する、少なくとも1つの接触フレーム(16)を形成する、請求項1記載の方法。
  3. 導体部(15)が前記支持体フィルムの平面にまで延在する場合、前記接触フレーム(16)の領域における前記支持体フィルム(13)を除去し、前記接触フレーム(16)を前記基板(11)における対向する接触面(9)に固定および/または電気的に接触接続させる、請求項2記載の方法。
  4. 高導電性の材料、殊に銅を有する前記導体路(15)および/または前記構成素子(1)の接触面(7)をはんだ付けないしはんだ(19)により前記基板(11)に固定および/または電気的に接触接続させる、請求項1から3までのいずれか1項または複数項記載の方法。
  5. 前記絶縁性質量体(17)を射出成形により形成する、および/または、前記絶縁性質量体(17)を成形する従来の射出成形ツールを使用する、請求項1から4までのいずれか1項または複数項記載の方法。
  6. 前記支持体フィルム(13)は感光性であり、露光および/またはアブレーション、例えばレーザアブレーションにより前記支持体フィルム(13)を除去するか、前記支持体フィルム(13)内に開口部(21)を形成する、請求項1から5までのいずれか1項または複数項記載の方法。
  7. 前記下面(5)における接触面(7)および/または前記接触フレーム(16)をはんだ付けおよび/または接着により、前記基板(11)のそれぞれの前記接触面(9)に固定および/または電気的に接触接続させる、請求項1ないし3から6までのいずれか1項または複数項記載の方法。
  8. 前記構成素子(1)を前記支持体フィルム(13)上の所定の位置において、所定の機能構造に応じて固定する、請求項1から7までのいずれか1項または複数項記載の方法。
  9. 前記導体部(15)上、および/または、前記絶縁性質量体(17)内、および/または、前記基板(11)上に冷却用装置、殊に冷却チャネル、ヒートシンク(23)および/またはヒートパイプを配置する、請求項1から8までのいずれか1項または複数項記載の方法。
  10. 請求項1から9までのいずれか1項または複数項記載の方法により製造されるデバイスにおいて、
    上面(3)および/または下面(5)にそれぞれ配置されている、固定および/または電気的な接触接続のための少なくとも1つの接触面(7)を備えている、ケーシングされていない少なくとも1つの電子的な構成素子(1)、殊に電力用半導体素子を有し、
    前記構成素子(1)は該構成素子(1)の下面(5)を用いて、前記接触面(7)の領域において、基板(11)、殊にDCBセラミック基板における対向するそれぞれ1つの接触面(9)に固定および/または電気的に接触されており、
    絶縁性の支持体フィルム(13)が前記接触面(7)の領域外で前記下面(5)を超えて、前記構成素子(1)に対向する側における前記基板(11)の上に形成されており、
    前記上面(3)における前記接触面(7)には、成形された3次元構造体を形成するそれぞれ1つの導体部(15)が固定および/または電気的に接触接続されており、前記導体部(15)は前記上面(3)の表面を超えて延在しており、
    前記支持体フィルム(13)と前記導体部(15)の前記3次元構造体との間に絶縁性質量体(17)が形成されていることを特徴とする、デバイス。
  11. 前記導体部(15)から、殊に前記支持体フィルムの平面にまで延在する、少なくとも1つの接触フレーム(16)が形成される、請求項10記載のデバイス。
  12. 導体部(15)が前記支持体フィルムの平面にまで延在する場合、前記接触フレーム(16)の領域においては前記支持体フィルム(13)が除去されており、ないし開口部(21)が形成されており、前記接触フレーム(16)は前記基板(11)における対向する接触面(9)に固定および/または電気的に接触接続されている、請求項11記載のデバイス。
  13. 前記導体部(15)は高導電性の材料、殊に銅を有する、請求項10から12までのいずれか1項または複数項記載のデバイス。
  14. 2つより多くの構成素子(1)では、該構成素子(1)は前記支持体フィルム(13)上の所定の位置において、所定の機能構造に応じて固定されている、請求項10から13までのいずれか1項または複数項記載のデバイス。
  15. 前記導体部(15)上、および/または、前記絶縁性質量体(17)内、および/または、前記基板(11)上に冷却用装置、殊に冷却チャネル、ヒートシンク(23)および/またはヒートパイプが配置されている、請求項10から14までのいずれか1項または複数項記載のデバイス。
  16. 前記導体部(15)の膨張係数および前記絶縁性質量体(17)は高い熱サイクル耐性および電気サイクル耐性を生じさせるために相互に適合されている、請求項10から15までのいずれか1項または複数項記載のデバイス。
  17. 上面(3)および/または下面(5)にそれぞれ配置されている、固定および/または電気的な接触接続のための少なくとも1つの接触面(7)を備えている、ケーシングされていない少なくとも1つの電子的な構成素子(1)、殊に電力用半導体素子を有し、
    前記構成素子(1)は該構成素子(1)の下面(5)を用いて、該下面(5)の表面を超えて延在している絶縁性の支持体フィルム(13)に固定されており、
    前記上面(3)における前記接触面(7)には、成形された3次元構造体を形成するそれぞれ1つの導体部(15)が固定および/または電気的に接触接続されており、前記導体部(15)は前記上面(3)の表面を超えて延在しており、
    前記支持体フィルム(13)と前記導体部(15)の前記3次元構造体との間には絶縁性質量体(17)が形成されていることを特徴とする、装置。
  18. 前記導体部(15)から、殊に前記支持体フィルムの平面にまで延在する、少なくとも1つの接触フレーム(16)が形成されている、請求項17記載の装置。
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Families Citing this family (7)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
ES2594867T3 (es) 2007-03-09 2016-12-23 Alexza Pharmaceuticals, Inc. Unidad de calentamiento para usar en un dispositivo de administración de fármaco
US20100065052A1 (en) * 2008-09-16 2010-03-18 Alexza Pharmaceuticals, Inc. Heating Units
US20120048963A1 (en) 2010-08-26 2012-03-01 Alexza Pharmaceuticals, Inc. Heat Units Using a Solid Fuel Capable of Undergoing an Exothermic Metal Oxidation-Reduction Reaction Propagated without an Igniter
US8941208B2 (en) * 2012-07-30 2015-01-27 General Electric Company Reliable surface mount integrated power module
DE102014203306A1 (de) * 2014-02-25 2015-08-27 Siemens Aktiengesellschaft Herstellen eines Elektronikmoduls
HUE064899T2 (hu) 2015-03-11 2024-04-28 Alexza Pharmaceuticals Inc Antisztatikus anyagok használata a légcsatornában a termális aeroszol kondenzációs folyamat létrehozására
DE102016220553A1 (de) * 2016-10-20 2018-04-26 Robert Bosch Gmbh Leistungsmodul

Citations (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH09116045A (ja) * 1995-10-13 1997-05-02 Dainippon Printing Co Ltd リードフレームを用いたbgaタイプの樹脂封止型半導体装置およびその製造方法
US6306680B1 (en) * 1999-02-22 2001-10-23 General Electric Company Power overlay chip scale packages for discrete power devices
EP1641035A1 (en) * 2004-09-27 2006-03-29 STMicroelectronics S.r.l. Mounting method of electronic power components on printed circuit boards

Family Cites Families (8)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2751450B2 (ja) * 1989-08-28 1998-05-18 セイコーエプソン株式会社 テープキャリアの実装構造及びその実装方法
US5200362A (en) * 1989-09-06 1993-04-06 Motorola, Inc. Method of attaching conductive traces to an encapsulated semiconductor die using a removable transfer film
AU7593300A (en) * 1999-09-24 2001-04-30 Virginia Tech Intellectual Properties, Inc. Low cost 3d flip-chip packaging technology for integrated power electronics modules
JP2005515616A (ja) 2001-09-28 2005-05-26 シーメンス アクチエンゲゼルシヤフト 基板の電気的コンタクト面の接続方法及び電気的コンタクト面を備えた基板からなるデバイス
JP2003204027A (ja) * 2002-01-09 2003-07-18 Matsushita Electric Ind Co Ltd リードフレーム及びその製造方法、樹脂封止型半導体装置及びその製造方法
JP2003341782A (ja) * 2002-05-27 2003-12-03 Oki Electric Ind Co Ltd 電子デバイス収容体、電子デバイスの搬送方法、電子デバイスの実装方法、電子デバイスの収容方法
JP3809168B2 (ja) 2004-02-03 2006-08-16 株式会社東芝 半導体モジュール
DE102004030042B4 (de) 2004-06-22 2009-04-02 Infineon Technologies Ag Halbleiterbauelement mit einem auf einem Träger montierten Halbleiterchip, bei dem die vom Halbleiterchip auf den Träger übertragene Wärme begrenzt ist, sowie Verfahren zur Herstellung eines Halbleiterbauelementes

Patent Citations (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH09116045A (ja) * 1995-10-13 1997-05-02 Dainippon Printing Co Ltd リードフレームを用いたbgaタイプの樹脂封止型半導体装置およびその製造方法
US6306680B1 (en) * 1999-02-22 2001-10-23 General Electric Company Power overlay chip scale packages for discrete power devices
EP1641035A1 (en) * 2004-09-27 2006-03-29 STMicroelectronics S.r.l. Mounting method of electronic power components on printed circuit boards

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US8261439B2 (en) 2012-09-11

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