JP2005341118A - フィルタ回路、論理ic、マルチチップモジュール、フィルタ搭載型コネクタ、伝送装置及び伝送システム - Google Patents
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Abstract
【解決手段】 容量素子やインダクタなどの受動素子で形成されるフィルタ回路において、前記フィルタ回路を形成するインダクタが同一平面の鉛直方向に中心軸を持ち且つそれぞれの中心軸の位置の異なる2つの巻き線で構成されており、2つの前記巻き線が、それぞれに流れる信号電流が反対の回転方向の渦を巻くようにし、且つ外来磁界ノイズにより生じる誘導電流が逆方向に流れるように接続していることを特徴とする。
【選択図】 図1
Description
まず、本発明に係る第1の実施の形態であるフィルタ回路について図面を参照して説明する。
まず、本発明に係るフィルタ回路の実施例1について説明する。
次に、本発明に係るフィルタ回路の実施例2について図3を用いて説明する。図3は、図1に示すフィルタ回路の実施例1における容量素子と入出力端子の電極を共通化した場合のフィルタ回路の実施例2の構成を示す図である。図3のフィルタ回路において、図1と相違する点は、容量素子106を、第2抵抗素子104の他端と接続された外部回路より信号を入力する入力端子107と一方の電極を共通化した容量素子106aと、第3抵抗素子105の他端と接続された外部回路に信号を出力する出力端子108と一方の電極を共通化した容量素子106bとで構成したことである。なお、容量素子106aの他方の電極と容量素子106bの他方の電極とは導体120で接続されて構成される。これにより、入力端子107と出力端子108との間に2つの容量素子106aと容量素子106bとが直列に接続されることになる。このように、容量素子を構成する電極を入出力端子107、108の各々と共通化することにより、図1に示すフィルタ回路に比べてチップサイズを小さくすることができることから、フィルタ回路を含むICのコストを低減でき、伝送装置のコストの増加を抑えることができる。
次に、上記フィルタ回路の実施例1及び2に用いられているインダクタの他の実施例について図4を用いて説明する。図4は、インダクタを構成する伝送路の長さをより短くすることが可能となるインダクタの他の実施例の構成を示す。図4に示すインダクタにおいては、同一平面の鉛直方向に中心軸を持ち且つそれぞれの中心軸の位置の異なる2つの巻き線301a、301bと、それぞれの巻き線301a、301bの中心部に配置した磁性金属302a、302bとで構成される。巻き線301a、301bの中心部に磁性金属302a、302bを配置することで、巻き線の中心部を通過する磁束密度が増加するため、磁性金属を配置していないインダクタに比べて、短い伝送路長さで同等のインダクタンス値を得ることができることから、より高周波の外来磁界ノイズの影響を低減し、且つインダクタから輻射される電磁ノイズの低減効果を大きくすることができる。
次に、上記フィルタ回路の実施例1及び2に用いられているインダクタの更に他の実施例について図5を用いて説明する。図5は、図1及び図3のフィルタ回路におけるインダクタを複数層の巻き線にて構成した場合の一実施例である。本実施例のインダクタは、一端を入力側(図示せず)とした第1巻き線401と、前記第1巻き線401の鉛直方向に位置し、一端を前記第1巻き線401に接続した第2巻き線402と、前記第1巻き線401と同一平面上に位置し、第1巻き線401と異なる位置に中心軸を持ち、一端を前記第2巻き線402に接続した第3巻き線403と、前記第3巻き線403の鉛直方向に位置し、一端を前記第3巻き線403に接続し、他端を出力側(図示せず)とした第4巻き線404とで構成される。ここで、第1巻き線401と第2巻き線402は、それぞれに流れる信号電流が同じ回転方向の渦を巻くように構成し、第3巻き線403と第4巻き線404は、それぞれに流れる信号電流が第1巻き線401あるいは第2巻き線402に流れる信号電流とは反対の回転方向の渦を巻くように構成し、外来磁界ノイズにより、第1巻き線401と第2巻き線402に生じる誘導電流と、第3巻き線403と第4巻き線404に生じる誘導電流が逆方向に流れるように第2巻き線402と第3巻き線403を接続したことを特徴とする。このように2層の巻き線を水平方向に2つ配置してインダクタを構成した場合には、1層の巻き線でインダクタを構成した場合に比べて基板の必要層数は増加するが、より小さな実装面積で同等のインダクタンス値を得ることができる。また、本実施例では、巻き線を2層にした場合のインダクタ構成を示したが、外来磁界ノイズにより生じる誘導電流を相殺し、且つそれぞれの巻き線から輻射される電磁ノイズの総和が小さくなるように巻き線を構成したものであれば、巻き線を3層にして構成したインダクタや、4層にして構成したインダクタにおいても同様の効果を得ることができる。
次に、本発明に係るフィルタ回路の実施例3について図6を用いて説明する。図6は、個別部品のチップコイル、チップコンデンサ、チップ抵抗を用いて構成した本発明のフィルタ回路の一実施例を示す図である。本実施例3に示すフィルタ回路は、一端を接地端子508に接続したチップコイル501と、一端を該チップコイル501に接続した第1チップ抵抗502と、一端を信号を入力する入力端子506に接続し、他端を上記第1チップ抵抗502に接続した第2チップ抵抗503と、一端を信号波形を出力する出力端子507に接続し、他端を上記第1チップ抵抗502に接続した第3チップ抵抗504と、一端を上記入力端子506に接続し、他端を上記出力端子507に接続したチップコンデンサ505とで構成されている。特に、チップコイル501は、上記実施例1〜4で示すように、同一平面の鉛直方向に中心軸を持ち且つ中心軸の位置の異なる2つの巻き線で形成され、2つの巻き線はそれぞれに流れる信号電流が互いに反対の回転方向の渦を巻くように構成され、また、外来磁界ノイズによりそれぞれの巻き線に生じる誘導電流が逆方向に流れるように接続されていることを特徴とする。このように、個別部品を用いてフィルタ回路を構成した場合においても、外来磁界ノイズの影響を受けにくくし且つ輻射電磁ノイズを低減することが可能である。
次に、本発明に係る、伝送路における波形劣化を補償する第1の実施の形態で説明したハイパスフィルタ回路をパッケージ化したフィルタICを、ドライバ回路およびレシーバ回路で構成される伝送装置(伝送システム)に適用した第2の実施の形態について図7を用いて説明する。図7に示す伝送装置(伝送システム)は、10GHz〜1GHz程度あるいはそれ以上の伝送信号を伝送路604へと送信するドライバ回路602と、伝送路604を通して伝送される10GHz〜1GHz程度あるいはそれ以上の伝送信号を受信するレシーバ回路603と、該伝送路604に設けられ、伝送路604における誘電体損失や表皮効果より劣化した伝送波形を改善するフィルタ回路(具体的にはハイパスフィルタ回路)をリード線のあるパッケージ化したフィルタIC601と、伝送信号を伝送する上記伝送路604で構成される。上記ドライバ回路602およびレシーバ回路603の構成の一実施例を図12に示す。ドライバ回路1201(602)は、データを演算処理する論理演算回路1202と、データを送信するための出力バッファ1203で構成される。レシーバ回路1204(603)は、データを受信するための入力バッファ1205と、受信データを演算処理する論理演算回路1206で構成される。
次に、本発明に係る、信号を論理演算処理する論理回路を搭載したダイ上に第1の実施の形態で説明したフィルタ回路を搭載し、パッケージ化した論理ICの第3の実施の形態について図8を用いて説明する。本第3の実施の形態の論理ICは、伝送路における損失を補償し伝送波形を整形するフィルタ回路901と、信号を論理演算処理する論理回路902と、前記フィルタ回路901と前記論理回路902を搭載した(形成した)ダイ903と、前記ダイ903を搭載してパッケージ化されたパッケージ904と、ダイ903とパッケージ904を電気的に接続する例えばボンディングワイア905とで構成される。なお、同じダイ903にフィルタ回路901と論理回路902とを作り込んで搭載する必要がある。そのため、論理回路を製造するプロセスにフィルタ回路特有な製造プロセス(容量や抵抗)を追加する必要がある。そして、フィルタ回路901は、第1の実施の形態で説明した輻射電磁ノイズを低減し、且つ外来磁界ノイズの影響を受けにくいインダクタで構成されていることを特徴とする。外部回路より論理ICに信号を伝送した場合、伝送信号はボンディングワイア905を介してフィルタ回路901に到達する。フィルタ回路901に到達した信号は、フィルタ回路901により波形整形され、論理回路902に伝送される。このとき、フィルタ回路901においては信号電流を伝送した場合においても、電磁ノイズをほとんど輻射せず、また、たとえば論理回路902などの隣接する回路から放射される磁界ノイズにより生じる誘導電流の影響を低減できる。
次に、本発明に係る、第1の実施の形態で説明したフィルタ回路を搭載したダイと論理回路を搭載したダイなどの複数のダイを同一のパッケージ内に混載したマルチチップモジュールの第4の実施の形態について図9を用いて説明する。本第4の実施の形態のマルチチップモジュールは、第1の実施の形態で説明した、伝送路における損失を補償するフィルタ回路(具体的にはハイパスフィルタ回路)を搭載したフィルタ回路ダイ1001と、信号を論理演算処理する論理回路を搭載した論理回路ダイ1002と、前記フィルタ回路ダイ1001と前記論理回路ダイ1002を搭載するパッケージ1003と、ダイ間あるいはダイとパッケージ間を電気的に接続する例えばボンディングワイア1004で構成される。第4の実施の形態において、第3の実施の形態と相違する点は、フィルタ回路を搭載するダイ1001を論理回路を搭載したダイ1002と別にしたことにある。そして、フィルタ回路ダイ1001に搭載したフィルタ回路は、輻射電磁ノイズを低減し、且つ外来磁界ノイズの影響を受けにくいインダクタで構成されていることを特徴とする。このように、本発明に係るフィルタ回路を搭載したフィルタ回路ダイと論理回路ダイを混載してマルチチップモジュールを構成することにより、フィルタ回路において、比較的遠方の外来磁界ノイズのみならず、たとえば同一パッケージに搭載した論理回路といった隣接した回路から輻射される磁界ノイズの影響を低減でき、且つフィルタ回路からの輻射電磁ノイズを低減できることから、データの欠落や論理演算処理時の誤りの発生を低減するマルチチップモジュールを形成することが可能となる
また、第4の実施の形態の場合には、フィルタ回路と論理回路を異なるダイに搭載することにより、論理回路を新たに作製することが不要となる場合が有り、このような場合には、図8に示した第3の実施の形態の論理ICに比べて製造コストを低減することが可能となる。
次に、本発明に係る、第1の実施の形態で説明したフィルタ回路をパッケージ化したフィルタチップをバックプレーンコネクタに搭載したフィルタ搭載型コネクタの第5の実施の形態について図10を用いて説明する。本第5の実施の形態のフィルタ搭載型コネクタは、二つの基板を電気的に接続するバックプレーンコネクタ1101と、第1の実施の形態で説明した伝送路における損失を補償するためのフィルタ回路(具体的にはハイパスフィルタ回路)を搭載しており、バックプレーンコネクタ1101内の伝送路に接続したフィルタチップ1102とで構成される。外部回路から出力され基板(図示せず)を介してマザーボード側ピン1103あるいはドータボード側ピン1104に到達した10GHz〜1GHz程度あるいはそれ以上の伝送信号は、フィルタチップ1102に伝送され、フィルタチップ1102において伝送路の損失を補償し、伝送波形を整形される。整形された伝送信号は、ドータボード側ピン1104あるいはマザーボード側ピン1103を介して他の外部回路(図示せず)に出力される。このとき、本発明に係るフィルタ回路を搭載したフィルタチップ1102は、信号電流を伝送した場合においても、電磁ノイズをほとんど輻射しないことから他の回路や装置に対する影響が小さく、また、隣接する回路や装置から放射される磁界ノイズにより生じる誘導電流の影響を低減できることから、安定して伝送波形の改善効果を得ることが可能となる。
次に、本発明に係る、第1の実施の形態で説明したフィルタ回路を用いた高速信号を送受信する装置の第6の実施の形態について図11を用いて説明する。図11は、光ファイバで送られた伝送信号の転送経路をスイッチングする伝送装置(伝送システム)を示しており、10GHz〜1GHz程度あるいはそれ以上の伝送信号を光−電気信号変換する複数の光モジュール702と、光信号を伝送する複数の光ファイバ701と、伝送信号の転送経路を決定する複数のスイッチIC705と、上記複数の光モジュール702と上記スイッチIC705を実装した複数のスイッチボード703と、複数のスイッチボード703間に信号を伝送するためのバックボード704と、複数のスイッチボード703の各々とバックボード704を電気的に接続する複数のバックプレーンコネクタ706とで構成される。即ち、伝送装置(伝送システム)は、光ファイバ701を接続した複数の光モジュール702と光モジュール702からの10GHz〜1GHz程度あるいはそれ以上の伝送信号の転送経路を切り換えるスイッチIC705とを実装したスイッチボード703の複数(多数)をブレード状にバックボード704にバックブレーンコネクタ706で接続実装して構成される。
Claims (11)
- インダクタ、容量素子及び抵抗素子の受動素子で形成されるフィルタ回路であって、
前記インダクタは、同一平面の鉛直方向に中心軸を持ち且つそれぞれの中心軸の位置の異なる少なくとも2つの巻き線で構成し、前記少なくとも2つの巻き線が、それぞれに流れる信号電流が反対の回転方向の渦を巻くように形成し、且つ外来磁界ノイズにより生じる誘導電流が逆方向に流れるように接続して構成されることを特徴とするフィルタ回路。 - 請求項1記載のフィルタ回路において、前記少なくとも2つの巻き線の中心部に磁性体を有することを特徴とするフィルタ回路。
- インダクタ、容量素子及び抵抗素子の受動素子で形成されるフィルタ回路であって、
前記インダクタは、第1巻き線と、該第1巻き線の鉛直方向に位置し、一端を前記第1巻き線に接続した第2巻き線と、前記第1巻き線と同一平面上に位置し、第1巻き線と異なる位置に中心軸を持ち、一端を前記第2巻き線に接続した第3巻き線と、前記第3巻き線の鉛直方向に位置し、一端を前記第3巻き線に接続した第4巻き線とで構成し、前記第1巻き線と前記第2巻き線は、それぞれに流れる信号電流が同じ回転方向の渦を巻くように形成し、前記第3巻き線と前記第4巻き線は、それぞれに流れる信号電流が前記第1巻き線あるいは前記第2巻き線に流れる信号電流とは反対の回転方向の渦を巻くように形成し、外来磁界ノイズにより、前記第1巻き線と前記第2巻き線に生じる誘導電流と、前記第3巻き線と前記第4巻き線に生じる誘導電流が逆方向に流れるように前記第2巻き線と前記第3巻き線を接続して構成されることを特徴とするフィルタ回路。 - 個別部品のチップコイル、チップコンデンサ及びチップ抵抗を用いて形成したフィルタ回路であって、
前記チップコイルは、同一平面の鉛直方向に中心軸を持ち、且つ中心軸の位置の異なる少なくとも2つの巻き線で形成され、前記少なくとも2つの巻き線はそれぞれに流れる信号電流が互いに反対の回転方向の渦を巻くように形成し、且つ外来磁界ノイズによりそれぞれの巻き線に生じる誘導電流が逆方向に流れるように接続して構成されることを特徴とするフィルタ回路。 - ドライバ回路とレシーバ回路とを伝送路で接続して構成される伝送システムであって、
前記伝送路に、請求項1から請求項4のいずれか一つに記載のフィルタ回路をハイパスフィルタ回路として備えたことを特徴とする伝送システム。 - ドライバ回路とレシーバ回路とを伝送路で接続して構成される伝送システムであって、
前記伝送路に、請求項1から請求項4のいずれか一つに記載のフィルタ回路を前記伝送路における波形劣化を補償するハイパスフィルタ回路としてパッケージ化したフィルタICを備えたことを特徴とする伝送システム。 - 論理演算処理する論理回路を有する論理IC内に、請求項1から請求項4のいずれか一つに記載のフィルタ回路を備えたことを特徴とする論理IC。
- 請求項1から請求項4のいずれか一つに記載のフィルタ回路を搭載したダイと論理回路を搭載したダイとをパッケージ内に混載実装したことを特徴とするマルチチップモジュール。
- 伝送路間を接続するコネクタであって、請求項1から請求項4のいずれか一つに記載のフィルタ回路をチップ化したフィルタチップを内包することを特徴とするフィルタ搭載型コネクタ。
- 光ファイバを接続した光モジュールから得られる伝送信号の転送経路をスイッチICで決定して伝送する伝送装置であって、
前記光モジュールまたは前記スイッチIC内の伝送路に、請求項1から請求項4のいずれか一つに記載のフィルタ回路をハイパスフィルタ回路として備えたことを特徴とする伝送装置。 - 光ファイバを接続した光モジュールと該光モジュールから得られる伝送信号の転送経路を決定するスイッチICとを実装したスイッチボードの複数を、伝送路を形成したバックボードにバックプレーンコネクタで電気的に接続して構成される伝送装置であって、
前記光モジュールまたは前記スイッチICまたは前記バックプレーンコネクタ内の伝送路に、請求項1から請求項4のいずれか一つに記載のフィルタ回路をハイパスフィルタ回路として備えたことを特徴とする伝送装置。
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