JP2004336772A - デジタル・アナログ・コンバータ用の素子単位のリサンプリング - Google Patents
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Abstract
【解決手段】 デジタル入力に応答し、部分アナログ信号を選択的に生成するよう構成されたアナログ出力素子104A、104B、104C、104D、104E、304と、アナログ出力素子104A、104B、104C、104D、104E、304に接続され、前記部分アナログ信号を合わせてアナログ出力を生成するよう構成された加算回路108、208、208A、208Bと、アナログ出力素子104A、104B、104C、104D、104E、304と加算回路108、208、208A、208Bとの間に接続され、アナログ出力素子出力素子104A、104B、104C、104D、104E、304から加算回路108、208、208A、208Bへの前記部分アナログ信号の伝送を調節するよう構成されたスイッチ106、306とを含んでなるデジタル・アナログ・コンバータを提供する。
【選択図】 図1
Description
106、306 スイッチ
108、208、208A、208B 加算回路
316、318 トランジスタ
320 電流源
326 電圧端子
Claims (10)
- デジタル入力に応答し、部分アナログ信号を選択的に生成するよう構成されたアナログ出力素子と、
該アナログ出力素子に接続され、前記部分アナログ信号を合わせてアナログ出力を生成するよう構成された加算回路と、
前記アナログ出力素子と前記加算回路との間に接続され、前記アナログ出力素子から前記加算回路への前記部分アナログ信号の伝送を調節するよう構成されたスイッチと
を含んでなるデジタル・アナログ・コンバータ。 - 前記アナログ出力素子のそれぞれは、前記スイッチ中の異なるスイッチを介して前記加算回路に接続されている請求項1に記載のデジタル・アナログ・コンバータ。
- 前記スイッチは、前記アナログ出力素子から前記加算回路へと前記部分アナログ信号を同時に伝送するためのクロック信号を受信するよう接続されている請求項2に記載のデジタル・アナログ・コンバータ。
- 前記アナログ出力素子は、等価な信号を生成するよう構成されている請求項1から3のいずれかに記載のデジタル・アナログ・コンバータ。
- 前記アナログ出力素子の中の少なくとも1つが、前記スイッチ中の1つの特定のスイッチと電圧端子とに直列に接続されている、トランジスタおよび電流源を含むものである請求項1から4のいすれかに記載のデジタル・アナログ・コンバータ。
- デジタル入力を受信するステップと、
該デジタル入力に応答して部分アナログ信号を生成するステップと、
該部分アナログ信号の伝送を調節するステップと、
該部分アナログ信号を受信して合わせて、前記デジタル入力のアナログ表現であるアナログ出力を生成するステップと
を含んでなるデジタル・アナログ変換方法。 - 前記部分アナログ信号の伝送を調節するステップが、クロック信号を使用して前記部分アナログ信号を同時に伝送することを含む請求項6に記載の方法。
- 前記部分アナログ信号の伝送を調節するステップが、複数のスイッチを作動させて前記部分アナログ信号を伝送することを含むものである請求項6または7に記載の方法。
- 前記部分アナログ信号の伝送を調節するステップが、前記スイッチ中の1つを介して前記部分アナログ信号の中の少なくとも2つを送信する前に、前記部分アナログ信号の中の前記少なくとも2つを合わせることを含む請求項8に記載の方法。
- 前記複数のスイッチを作動させるステップが、前記複数のスイッチを同時に作動させて前記部分アナログ信号を同時に伝送することを含む請求項8または9に記載の方法。
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