JP2001282181A - プラズマディスプレイ装置及びその製造方法 - Google Patents
プラズマディスプレイ装置及びその製造方法Info
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Abstract
イミングのずれや形状のずれのないサステイン回路を有
し、低消費電力で誤動作しないPDP装置の実現。 【解決手段】 隣接して交互に配置された第1の電極
(X)11及び第2の電極(Y)12と、第1の電極及び第
2の電極の伸びる方向と直交する方向に伸びるアドレス
電極13とを有するプラズマディスプレイパネルと、第1
の電極にサステインパルスを供給するXサステイン回路
18と、第2の電極にサステインパルスを供給するYサス
テイン回路19とを備えるプラズマディスプレイ装置にお
いて、Xサステイン回路18とYサステイン回路19は、サ
ステインパルスの変化エッジのタイミングを調整する位
相調整回路51-54 を備える。
Description
レイ装置及びその製造方法に関し、特に消費電力を低減
するためにサステイン回路に電力回収回路を有するプラ
ズマディスプレイ装置、及び複数の第1及び第2の電極
を隣接して配置し、すべての電極間で表示ラインを形成
するALIS(登録商標)方式のプラズマディスプレイ
パネルの駆動方法及びプラズマディスプレイ装置に関す
る。
は、自己発光型であるので視認性がよく、薄型で大画面
表示及び高速表示が可能であることから、CRTに替わ
る表示パネルとして注目されている。基本的なPDPの
構成については、特開平7−160219号公報、特開
平9−160525号公報及び特開平9−325735
号公報などに開示されているので、ここでは詳細な説明
は省略し、本発明に直接関係する点についてのみ説明す
る。
示すブロック図である。PDP10は、n本のX電極1
1とY電極12とを隣接して交互に配置して、n組のX
電極11とY電極12の組を形成し、各組のX電極11
とY電極12の間で表示のための発光を行う。Y電極と
X電極は表示電極と呼ばれるが、維持電極又はサステイ
ン電極とも呼ばれることもある。アドレス電極13は、
表示電極の伸びる方向に垂直な方向に設けら、X電極1
1とY電極12の組との交点部分に表示セルが形成され
る。
されている。スキャンドライバ14にはY電極の本数分
のスイッチ16が設けられており、アドレス期間には走
査信号発生回路15からのスキャンパルスが順に印加さ
れるように切り換えられ、維持放電期間には、Yサステ
イン回路19からのサステインパルスが同時に印加され
るように切り換えられる。X電極11はXサステイン回
路18に共通に接続され、アドレス電極13はアドレス
ドライバ17に接続される。画像信号処理回路21は、
画像信号をPDP装置内部での動作に適した形式に変換
した後、アドレス回路17に供給する。駆動制御回路2
0は、PDP装置の各部を制御する信号を発生して供給
する。
ムチャートである。PDP装置は、1つの表示画面を所
定の周期毎に書き換えながら表示しており、1表示周期
を1フィールドと称する。階調表示を行う場合には、1
フィールドを更に複数のサブフィールドに分割し、表示
セル毎に発光するサブフィールドを組み合わせて表示を
行う。各サブフィールドは、全表示セルを初期化するリ
セット期間と、全表示セルを表示する画像に対応した状
態に設定するアドレス期間と、設定された状態に応じて
各表示セルを発光させる維持放電(サステイン)期間と
で構成される。維持放電期間には、X電極とY電極に交
互に維持(サステイン)パルスが印加され、アドレス期
間に発光するように設定された表示セルで維持放電が行
われ、これが表示のための発光になる。
に最大で200V程度の電圧を高周波数のパルスとして
印加する必要があり、特に、サブフィールド表示で階調
表示を行うものではパルス幅は数μsである。このよう
な高電圧で且つ高周波の信号で駆動するため、一般にP
DP装置の消費電力は大きく、省電力化が要望されてい
る。米国特許第4,070,663 号は、EL(エレクトロルミ
ネッセンス)装置等の容量性表示ユニットの消費電力を
低減するために、表示ユニットの容量と共振回路を構成
するインダクタンス素子を設ける制御方法を開示してい
る。また、米国特許第4,866,349 号と米国特許第5,081,
400 号はインダクタンス素子で構成される電力回収回路
を有するPDPパネル用のサステイン(維持放電)ドラ
イバとアドレスドライバを開示している。更に、特開平
7−160219号公報は、3電極型の表示ニットにお
いて、Y電極側に、Y電極が高電位から低電位に切り換
えられる時に印加されている電力を回収する回収経路を
形成するインダクタンスと、Y電極が低電位から高電位
に切り換えられる時に蓄積した電力を印加する印加経路
を形成するインダクタンスの2つのインダクタンスを設
ける構成を開示している。
た電力を印加する印加経路を分離した電力回収回路を有
するサステイン回路の基本構成例を示す図である。な
お、信号V1〜V4を発生する回路も設けられている
が、ここでは省略してある。参照符号CpはPDPのX
電極とY電極で形成される表示セルの駆動容量を示す。
ここでは、一方の電極のサステイン回路を示したが、他
方の電極も類似のサステイン回路に接続される。図3の
回路で、出力素子(トランジスタ)31と33及びドラ
イブ回路32と34で構成される部分は、電力回収回路
のない場合のサステイン回路であり、出力素子(トラン
ジスタ)37と40、ドライブ回路38と41、インダ
クタンス素子35と43、容量39及びダイオード36
と42で構成される部分が電力回収回路である。信号V
1とV2は、それぞれドライブ回路32と34に入力さ
れ、そこから出力される信号VG1とVG2が出力素子
(トランジスタ)31と33のゲートに印加される。信
号V1が「高(H)」の時には出力素子31がオンし、
Hレベルの信号が電極に印加される。この時、信号V2
は「低(L)」で、出力素子33はオフである。信号V
1がLになって出力素子31がオフすると同時に、信号
V2がHになって出力素子33がオンして電極にはグラ
ンドレベルが印加される。
パルスを印加する時には、信号V1がHになる前に、信
号V2がLになり出力素子33がオフした後、信号V3
がHになって出力素子40がオンして容量39、ダイオ
ード42、インダクタンス43及び容量Cpで共振回路
が形成され、容量39に蓄積された電力が電極に供給さ
れ、電極の電位が上昇する。この電位の上昇が終了する
直前に信号V3がLになって出力素子40がオフし、更
に信号V1がHになって出力素子31がオンし、電極の
電位をVsに固定する。サステインパルスの印加を終了
する時には、まず信号V1がLになり出力素子31がオ
フした後、信号V4がHになって出力素子37がオンし
て容量39、ダイオード36、インダクタンス35及び
容量Cpで共振回路が形成され、容量Cpに蓄積された
電極が容量39に供給され、容量39の電圧が上昇す
る。これにより、電極に印加されたサステインパルスに
より容量Cpに蓄積された電力が容量39に回収され
る。この電極の電位の低下が終了する直前に信号V4が
Lになって出力素子37がオフし、更に信号V2がHに
なって出力素子33がオンし、電極の電位をグランドに
固定する。維持放電期間の間は、サステインパルス数だ
け上記の動作を繰り返す。以上の構成により、維持放電
に伴う消費電力を低減することが可能になる。
ており、特許第2801893号はすべての表示電極間
で表示のための発光を行う方式を開示している。この方
式はALIS(登録商標)方式と呼ばれるので、ここで
もこの語を使用する。ALIS方式の詳細な構成は特許
第2801893号に開示されており、ここでは本発明
に関係する点についてのみ簡単に説明する。
ック図である。図示のように、ALIS方式のPDPで
は、n本のY電極(第2の電極)12−O及び12−E
とn+1本のX電極(第1の電極)11−O及び11−
Eを隣接して交互に配置して、すべての表示電極(Y電
極とX電極)の間で表示発光を行う。従って、2n+1
本の表示電極で、2n本の表示ラインが形成される。つ
まり、ALIS方式は、図1の構成と同等の表示電極数
で2倍の精細度が実現できる。また、放電空間を無駄な
く使用でき、かつ電極などによる遮光が小さいため、高
い開口率が得られるので高輝度が実現できるという特徴
を有する。ALIS方式では、すべての表示電極間を表
示のための放電に利用するが、それらの放電を同時に発
生することはできない。そこで、表示を奇数ラインと偶
数ラインで時間的に分割して行う、いわゆるインターレ
ース走査を行う。奇数フィールドでは奇数番目の表示ラ
インで表示を行い、偶数フィールドでは偶数番目の表示
ラインで表示を行い、全体としては奇数フィールドと偶
数フィールドの表示を合わせた表示が得られる。
ている。スキャンドライバ14にはスイッチ16が設け
られており、アドレス期間には順にスキャンパルスが印
加されるように切り換えられ、維持放電期間には、奇数
Y電極12−Oは第1Yサステイン回路19−Oに、偶
数Y電極12−Eは第2Yサステイン回路19−Eに接
続されるように切り換えられる。奇数X電極11−Oは
第1Xサステイン回路18−Oに、偶数X電極11−E
は第2Xサステイン回路18−Eに接続される。アドレ
ス電極13は、アドレスドライバ17に接続される。画
像信号処理回路21と駆動制御回路20は、図1で説明
したのと同様の動作を行う。
ける駆動波形を示す図であり、図5(A)は奇数フィー
ルドの波形を、図5(B)は偶数フィールドの波形を示
す。奇数フィールドでは、電極Y1とX2に電圧Vsを
印加し、X1とY2をグランドレベルとし、X1とY1
間及びX2とY2間で、すなわち奇数表示ラインで放電
を発生させる。この時、偶数表示ラインのY1とX2の
間の電位差はゼロであり、放電は発生しない。同様に、
偶数フィールドでは、電極X1とY2に電圧Vsを印加
し、Y1とX2をグランドレベルとし、Y1とX2間及
びY2とX1間で、すなわち偶数表示ラインで放電を発
生させる。リセット期間やアドレス期間の駆動波形につ
いての説明は省略する。
力回収回路では、電力の回収と印加を効率的に行うこと
が重要であり、高い電力回収率を実現することが望まれ
ている。高い電力回収率は、出力素子31、33、37
及び40のオン・オフのタイミングに影響される。図6
はこの影響を説明する図であり、図6(A)はクランプ
のタイミングが早くなった場合を示し、図6(B)はク
ランプのタイミングが遅くなった場合を示す。
る時には、出力素子40がオンして容量39に蓄積され
た電力を電極に供給し、電極の電位の上昇が終了する直
前に信号V3がLになって出力素子40がオフすると共
に信号V1がHになって出力素子31がオンし、電極の
電位をVsに固定(クランプ)する。ここで、図6
(A)に示すように、出力素子40がオフする前に出力
素子31がオンすると、容量39に蓄積された電力によ
り電極の電位を上昇させている途中に出力素子31がオ
ンして電極を電圧Vsの電源に接続するため、残りの分
は電源からの電力により上昇することになり、容量39
に蓄積された電力の一部が無駄になる。同様に、サステ
インパルスを印加を終了する時にも、出力素子37がオ
ンして容量39に電力を回収している途中に出力素子3
3がオンすると、十分に電力を回収し終わらないうちに
グランドにクランプされ、電力の回収が不十分になる。
ンパルスを印加する時に出力素子40がオフしてから遅
れて出力素子31がオンすると、容量39に蓄積された
電力によりる電極の電位の上昇が終了し、逆に電極の電
位が低下始めてから出力素子31がオンして電極を電圧
Vsの電源にクランプするため、低下した電位を上昇さ
せる必要がありその分余計な電力が必要となる。同様
に、サステインパルスを印加を終了する時にも、出力素
子37がオフしてから遅れて出力素子33がオンする
と、一旦低下した電位が再び上昇し始めてからグランド
にクランプするため、上昇した電位を低下させる必要が
ありその分余計な電力が必要となる。
31、33、37及び40がオン・オフするタイミング
がずれると電力回収率が低下し、消費電力が増加すると
いう問題を生じる。出力素子31、33、37及び40
がオン・オフするタイミングは、信号V1、V2、V3
及びV4の変化タイミングに、ドライブ回路32、3
4、38及び41の遅延時間と出力素子31、33、3
7及び40の遅延時間を加えたタイミングである。信号
V1、V2、V3及びV4の変化タイミングは、比較的
高精度に設定可能であるが、ドライブ回路32、34、
38及び41の遅延時間と出力素子31、33、37及
び40の遅延時間は、使用する素子の特性のばらつきに
応じてばらつく。そのため、PDP装置毎に電力回収率
がばらつき、理想的な場合に比べて電力回収率が低下
し、消費電力が増加するという問題を生じる。
ばらついて、サステインパルスの形状やタイミングがず
れると、正常な動作が行えなくなる可能性が増加する。
通常、動作電圧Vsの動作可能な最大値Vs(max)
と最小値Vs(min)との差ΔVsを動作マージンと
呼ぶが、回路素子の遅延時間がばらついて、サステイン
パルスの形状やタイミングがずれると、動作マージンΔ
Vsが低下する。これは装置の動作の安定性が低下する
ことを意味する。
される隣接する電極間では放電は生じないが、この印加
タイミングにずれが生じると、表示を行わない表示ライ
ンでも一時的に放電が発生し、アドレス期間に書き込ま
れた壁電荷が減少し、正常な表示が行われないという問
題を生じる場合がある。例えば、図5(A)において、
電極Y1にサステインパルスを印加してから遅延して電
極X2にサステインパルスが印加された場合、一時的に
電極Y1はHで電極X2はLの状態が発生するので、電
極Y1とX2の間で誤放電が発生する可能性がある。こ
のような誤放電は電極X2にサステインパルスが印加さ
れると停止するが、誤放電により電極Y1及びX2の壁
電荷が減少し、正常な表示発光が行われなくなる場合が
ある。
子の遅延時間がばらつき、それに応じてサステインパル
スのオン・オフのタイミングのずれや形状のずれを生
じ、消費電力が増加したり、誤動作するという問題があ
った。本発明は、このような問題を解決するもので、サ
ステインパルスの立ち上り・立ち下りのタイミングのず
れや形状のずれのないサステイン回路の実現し、低消費
電力で誤動作しないPDP装置の実現を目的とする。
め、本発明のPDP装置は、サステイン回路にサステイ
ンパルスの変化エッジのタイミングを調整する位相調整
回路を設ける。位相調整回路を調整して、サステインパ
ルスの変化エッジのタイミングを最適な状態にすれば、
電力回収回路を効率よく動作させることができるので、
消費電力を低減できる。また、各サステイン回路から印
加されるサステインパルスの立ち上り・立ち下りのタイ
ミングが相互に最適な条件になるので、誤動作や誤放電
を生じなくなる。
ン回路を備えるPDP装置や、ALIS方式のPDP装
置に適用すると、特に効果的である。なお、図3に示す
ような電力回収回路を有するサステイン回路の場合に
は、位相調整回路は、第3の出力素子がオンしてから第
1の出力素子がオンするまでの時間差、及び第4の出力
素子がオンしてから第2の出力素子がオンするまでの時
間差を調整可能であることが必要である。
は、誤放電を防止するには、隣接する電極間に印加する
サステインパルスのタイミングが調整可能であればよ
く、第1Xサステイン回路の出力するサステインパルス
と、第1又は第2Yサステイン回路の出力するサステイ
ンパルスとの立ち上がりタイミング又は立ち下がりタイ
ミングの差、及び第2Xサステイン回路の出力するサス
テインパルスと、第1又は第2Yサステイン回路の出力
するサステインパルスとの立ち上がりタイミング又は立
ち下がりタイミングの差が所定値以下、例えば、±30
ns以内になるように調整する。
に実装した状態で行えば、PDPの電極の実際の容量に
応じて最適な状態に設定できる。なお、サステイン回路
に使用する回路要素を遅延時間に応じて分類し、サステ
インパルスの変化エッジのタイミングが所定の誤差範囲
内に入るように、分類した回路素子の組み合わせを選択
し、選択した組合せの回路素子を装着するようにしても
よい。
DP装置に適用した実施例を説明する。本発明の実施例
のPDP装置は、図4に示したような全体構成を有し、
第1及び第2Xサステイン回路18−O、18−Eと第
1及び第2Yサステイン回路19−O、19−Eは、図
7に示す構成を有する。図3の場合と同様に、信号V1
〜V4を発生する回路については図示していない。
構成とは、各ドライブ回路32、34、38、41の前
段に、第1位相調整回路51〜第4位相調整回路54が
設けられている点が異なる。たとえ、出力素子31、3
3、37、40及びドライブ回路32、34、38、4
1の遅延時間がばらついても、第1位相調整回路51〜
第4位相調整回路54における遅延量を調整することに
より、出力素子31、33、37、40のオン・オフす
るタイミングを、図8に示すように最適な状態にするこ
とが可能である。
示す図である。図示のように、サステインパルス数に比
例してサステイン回路における消費電力が増加する。そ
の増加の比例係数は、電力回収回路を使用しない時には
もっとも大きく、図3に示したような電力回収回路を使
用することによりかなり小さくでき、本発明を使用する
ことにより更に小さくでき、消費電力を低減できる。
善効果を示す図である。動作マージンとしては、前述の
動作可能な電圧の最大値Vs(max)と最小値Vs
(min)の差ΔVsを使用した。図示のように、放電
電流が増加するに従って動作マージンが低下するが、本
発明を適用すると、図3の構成に比べて動作マージンの
低下が小さい。
明する。位相調整回路は、信号の遅延時間を調整するも
ので、公知の各種の遅延回路が使用できる。図11から
図13は、位相調整回路の例を示す図である。図11の
(A)は、可変抵抗VRと容量Cを組み合わせた遅延回
路であり、(B)は可変インダクタンスVLと容量Cを
組み合わせた遅延回路であり、(C)は粗調整用の可変
抵抗VR1と微調整用可変抵抗VR2と容量Cを組み合
わせた遅延回路であり、(D)は粗調整用の可変インダ
クタンスVL1と微調整用可変インダクタンスVL2と
容量Cを組み合わせた遅延回路であり、(E)はトリミ
ングにより抵抗値が調整可能な抵抗TRと容量Cを組み
合わせた遅延回路であり、(F)はトリミングによりイ
ンダクタンス値が調整可能なインダクタンスTLと容量
Cを組み合わせた遅延回路であり、(G)は粗調整用の
トリミング抵抗TR1と微調整用トリミング抵抗TR2
と容量Cを組み合わせた遅延回路であり、(H)は粗調
整用のトリミングインダクタンスVL1と微調整用トリ
ミングインダクタンスVL2と容量Cを組み合わせた遅
延回路であり、図12の(I)と(J)は(G)と
(H)の入力部と出力部にバッファ回路B1とB2を設
けた回路であり、(K)は抵抗アレイRAとスイッチア
レイSAを組み合わせて抵抗値を選択できるようにして
容量Cを組み合わせた回路であり、(L)はインダクタ
ンスアレイLAとスイッチアレイSAを組み合わせてイ
ンダクタンス値を選択できるようにして容量Cを組み合
わせた回路であり、図13の(M)は位相制御信号によ
り抵抗値が外部から設定できる電子ボリュームEVRと
容量Cを組み合わせた回路であり、(N)は位相制御信
号により遅延量が選択できるディレイラインDLを使用
した回路であり、(O)はドライブ回路Dの前に位相シ
フト回路PSを設け、出力素子Tの実際の出力Vout
を出力電圧検出回路ODで検出し、位相差検出回路PD
Dで入力信号Vinと出力電圧検出回路ODの検出結果
から位相差を求め、それに応じて位相シフト回路PSの
遅延量を調整する回路であり、(P)は(O)の回路で
出力電圧検出回路ODの代わりにドライブ回路Dの出力
を検出する駆動電圧検出回路DDを設けた点が異なり、
出力素子Tの遅延時間は調整できない。なお、図示して
いないが、容量値が可変の可変容量Cを使用することも
可能である。
の各位相調整回路をどのように調整して設定するかにつ
いて説明する。図14は、位相調整回路の設定処理を示
すフローチャートである。ステップ101では出力素子
の遅延時間を測定し、ステップ102では前記の出力素
子を組み合わせて使用するドライブ(駆動)回路の遅延
時間を測定し、ステップ103では所定の遅延時間から
上記の2つの遅延時間を減算して組み合わせて使用する
位相調整回路の遅延時間を算出し、ステップ104では
算出した遅延時間に基づいて組み合わせて使用する位相
調整回路の遅延時間を設定する。このような処理をすべ
ての組について行う。以上の処理により、各出力素子は
所定のタイミングでオン・オフすることになる。従っ
て、消費電力は最大限に低減され、誤動作や誤放電も発
生しなくなる。
路の遅延時間のばらつきを補正する処理であり、サステ
イン回路をPDP装置に装着する前に行う処理である。
しかし、PDPの電極間の容量も製造によりばらつき、
それにより電力回収回路の共振回路の時定数なども変化
するので、PDPに応じてサステインパルスのタイミン
グを最適な状態に設定するのが望ましい。図15は、サ
ステイン回路で駆動するPDPのばらつきを含めて位相
調整回路の遅延時間を最適値に設定する処理を示すフロ
ーチャートである。
DPを含む装置に装着して組み立てる。なお、完全に組
み立てる必要はなく、動作状態になればよい。ステップ
112では、第1Xサステイン回路18−O、第2Xサ
ステイン回路18−E、第1Yサステイン回路19−
O、第2Yサステイン回路18−Eのいずれを調整対象
とするかを選択する。ステップ113では、選択した回
路のどの組、具体的には第1〜第4位相調整回路51〜
54のいずれを調整対象とするか選択する。ステップ1
14では、PDPの選択した組に関係する駆動波形を測
定し、ステップ115で所定の基準信号に対して許容範
囲内であるかを判定し、範囲外であればステップ116
で位相調整回路を調整して、許容範囲内になるようにス
テップ114から116を繰り返す。
記の処理が終了したかを判定し、残っている組があれば
ステップ118で調整対象の組を変更してステップ11
4に戻る。以上のようにして、調整対象の回路の4つの
位相調整回路の調整が終了し、その回路の出力するサス
テインパルスは所定のタイミングでオン・オフする。更
に、ステップ119ではすべての回路について上記の処
理が終了したかを判定し、残っている回路があればステ
ップ120で調整対象の回路を変更してステップ114
に戻る。以上のようにして、すべての回路の調整が終了
する。
が、サステイン回路に使用する回路要素の遅延時間を測
定し、合計の遅延時間が許容範囲内になるような組合
せ、具体的には出力素子とドライブ回路の遅延時間の合
計が所定値に対して許容範囲内になるような組合せを選
択してPDP装置に装着するようにしても、サステイン
パルスのタイミングを最適にできる。図16は、そのた
めの製造工程における処理を示すフローチャートであ
る。
測定し、ステップ132で遅延時間に応じて分類する。
これらの処理と並行して、ステップ133ではドライブ
回路の遅延時間を測定し、ステップ134で遅延時間に
応じて分類する。以上の処理により、出力素子とドライ
ブ回路が遅延時間に応じてグループに分類される。ステ
ップ135では、合計の遅延時間が同じになる組合せを
作る。ここで、例えば、ALIS方式であれば、1つの
PDP装置には4つのサステイン回路があり、各サステ
イン回路は4つの出力素子とドライブ回路の組がある。
すなわち、1つのPDP装置で、16組の出力素子とド
ライブ回路の組があるので、遅延時間の合計が同じ組を
16組選択する。ステップ136でその組合せの出力素
子とドライブ回路を装着する。
ステイン回路の16組の出力素子とドライブ回路の組は
すべて同じ遅延時間になるように選択されるが、電力回
収率を向上させるためであれば、サステイン回路毎に、
出力素子31と40のオン・オフタイミングと出力素子
33と37のオン・オフタイミングが所定の関係にあれ
ばよい。図17は、そのような場合の製造工程における
処理を示すフローチャートである。
後、ステップ141では合計遅延時間が等しい2組の出
力素子とドライブ回路を選択して、第1の出力素子31
と第1のドライブ回路32及び第3の出力素子40と第
3のドライブ回路53として装着し、ステップ142で
は合計遅延時間が等しい2組の出力素子とドライブ回路
を選択して、第2の出力素子33と第1のドライブ回路
34及び第4の出力素子37と第4のドライブ回路54
として装着する。
めには、隣接する電極にサステインパルスを印加する時
にオン・オフのタイミング差が生じないことが必要であ
る。そのため、第1Xサステイン回路から出力されて奇
数番目のX電極に印加されるサステインパルスと、第1
及び第2Yサステイン回路から出力されて奇数番目及び
偶数番目のY電極に印加されるサステインパルスの間に
タイミングの差がなく、第2Xサステイン回路から出力
されて偶数番目のX電極に印加されるサステインパルス
と、第1及び第2Yサステイン回路から出力されて奇数
番目及び偶数番目のY電極に印加されるサステインパル
スの間にタイミングの差がないことが必要である。これ
は結局のところ、すべてのサステインパルスにタイミン
グ差がないことを意味する。なお、ALIS方式のPD
P装置で、誤放電を生じないタイミング差を調べたとこ
ろでは、隣接する電極に印加するサステインパルスが±
30nsのずれであれば誤放電の発生は低かった。
る場合でも、装着するPDPの容量などのばらつきを考
慮することが望ましい。図18は、そのような場合の製
造工程における処理を示すフローチャートである。ステ
ップ151でサステイン回路が駆動するPDPの容量を
測定し、そこに装着するサステイン回路の最適遅延時間
を算出する。ステップ152では、分類した出力素子と
ドライブ回路から最適遅延時間になる組み合わせを選択
し、ステップ153で装着する。
テインパルスの遅延に関係する回路素子が他にもある場
合には、それらの遅延時間も考慮するのはいうまでもな
い。
サステイン回路におけるドライブ回路の遅延量のばらつ
き及び出力素子の遅延量のばらつきによるサステインパ
ルスのオン・オフタイミング、電力回収回路の出力素子
のオン・オフタイミングが最適な状態に設定できるの
で、電力回収率のPDP装置毎のばらつきを低減して、
平均して消費電力を低減でき、PDPの動作マージンの
ばらつきも向上し、ALIS方式であれば誤放電発生の
可能性を低減できる。
る。
ある。
を示す図である。
ロック図である。
タイムチャートである。
タイムチャートである。
図である。
ャートである。
る。
向上効果を示す図である。
トである。
整する時の設定処理を示すフローチャートである。
回路要素を組み合わせる製造方法を示すフローチャート
である。
造方法を示すフローチャートである。
造方法を示すフローチャートである。
8)
レイ装置及びその製造方法に関し、特に消費電力を低減
するためにサステイン回路に電力回収回路を有するプラ
ズマディスプレイ装置、及び複数の第1及び第2の電極
を隣接して配置し、すべての電極間で表示ラインを形成
するALIS方式のプラズマディスプレイパネルの駆動
方法及びプラズマディスプレイ装置に関する。
ており、特許第2801893号はすべての表示電極間
で表示のための発光を行う方式を開示している。この方
式はALIS方式と呼ばれるので、ここでもこの語を使
用する。ALIS方式の詳細な構成は特許第28018
93号に開示されており、ここでは本発明に関係する点
についてのみ簡単に説明する。
Claims (10)
- 【請求項1】 隣接して交互に配置された第1の電極及
び第2の電極と、該第1の電極及び第2の電極の伸びる
方向と直交する方向に伸びるアドレス電極とを有するプ
ラズマディスプレイパネルと、前記第1の電極にサステ
インパルスを供給するXサステイン回路と、前記第2の
電極にサステインパルスを供給するYサステイン回路と
を備えるプラズマディスプレイ装置において、 前記Xサステイン回路と前記Yサステイン回路は、前記
サステインパルスの変化エッジのタイミングを調整する
位相調整回路を備えることを特徴とするプラズマディス
プレイ装置。 - 【請求項2】 請求項1に記載のプラズマディスプレイ
装置であって、 前記Xサステイン回路と前記Yサステイン回路は、前記
プラズマディスプレイパネルの表示容量との間で形成さ
れる共振回路を有し、前記サステインパルスの印加を解
除する時のエネルギを回収して前記サステインパルスの
次の印加時に使用する電力回収回路を備えるプラズマデ
ィスプレイ装置。 - 【請求項3】 請求項2に記載のプラズマディスプレイ
装置であって、 前記Xサステイン回路と前記Yサステイン回路は、 前記サステインパルスを供給する経路と高電位電源線及
び低電位電源線との間に接続された第1及び第2の出力
素子と、 前記経路と前記電力回収回路の接続状態を、前記電力回
収回路から前記経路に電力を供給する状態に切り換える
第3の出力素子と、前記経路から前記電力回収回路に電
力を回収する状態に切り換える第4の出力素子と、 前記第1乃至第4の出力素子を駆動する第1乃至第4ド
ライブ回路とを備え、 前記位相調整回路は、前記第3の出力素子がオンしてか
ら前記第1の出力素子がオンするまでの時間差、及び前
記第4の出力素子がオンしてから前記第2の出力素子が
オンするまでの時間差を調整可能であるプラズマディス
プレイ装置。 - 【請求項4】 請求項3に記載のプラズマディスプレイ
装置であって、 前記位相調整回路は、前記第1乃至第4ドライブ回路の
前段にそれぞれ設けた第1乃至第4の位相調整回路を備
えるプラズマディスプレイ装置。 - 【請求項5】 請求項1又は2に記載のプラズマディス
プレイ装置であって、 前記プラズマディスプレイパネルは、前記第2の電極の
一方に隣接する前記第1の電極とで第1の表示ラインを
形成し、前記第2の電極の他方に隣接する前記第1の電
極とで第2の表示ラインを形成し、1画面の表示フィー
ルドを複数のサブフィールドで構成し、表示を行うサブ
フィールドを組み合わせることにより階調表示を行い、 前記Xサステイン回路は、前記第1の電極の奇数番目の
電極に前記サステインパルスを供給する第1Xサステイ
ン回路と、偶数番目の電極に前記サステインパルスを供
給する第2Xサステイン回路とを備え、 前記Yサステイン回路は、前記第2の電極の奇数番目の
電極に前記サステインパルスを供給する第1Yサステイ
ン回路と、偶数番目の電極に前記サステインパルスを供
給する第2Yサステイン回路とを備えるプラズマディス
プレイ装置。 - 【請求項6】 請求項5に記載のプラズマディスプレイ
装置であって、 前記第1及び第2Xサステイン回路と、前記第1及び第
2Yサステイン回路は、それぞれ前記位相調整回路を備
え、 前記第1Xサステイン回路の出力するサステインパルス
と、前記第1又は第2Yサステイン回路の出力するサス
テインパルスとの立ち上がりタイミング又は立ち下がり
タイミングの差、及び前記第2Xサステイン回路の出力
するサステインパルスと、前記第1又は第2Yサステイ
ン回路の出力するサステインパルスとの立ち上がりタイ
ミング又は立ち下がりタイミングの差が所定値以下にな
るように調整されているプラズマディスプレイ装置。 - 【請求項7】 請求項6に記載のプラズマディスプレイ
装置であって、 前記所定値は±30nsであるプラズマディスプレイ装
置。 - 【請求項8】 請求項1から7のいずれか1項に記載の
プラズマディスプレイ装置であって、 前記位相調整回路は、前記プラズマディスプレイパネル
の前記第1又は第2の電極に前記サステインパルスを印
加した時の波形を観察して設定されるプラズマディスプ
レイ装置。 - 【請求項9】 隣接して交互に配置された第1の電極及
び第2の電極と、該第1の電極及び第2の電極の伸びる
方向と直交する方向に伸びるアドレス電極とを有するプ
ラズマディスプレイパネルと、前記第1の電極にサステ
インパルスを供給するXサステイン回路と、前記第2の
電極にサステインパルスを供給するYサステイン回路と
を備えるプラズマディスプレイ装置の製造方法におい
て、 前記Xサステイン回路と前記Yサステイン回路を構成す
る回路素子の信号に対する遅延時間を測定し、該遅延時
間に応じて分類し、 前記サステインパルスの変化エッジのタイミングが所定
の誤差範囲内に入るように、分類した回路素子の組み合
わせを選択し、 選択した組合せの回路素子を装着することを特徴とする
プラズマディスプレイ装置の製造方法。 - 【請求項10】 請求項9に記載のプラズマディスプレ
イ装置の製造方法であって、 前記プラズマディスプレイパネルは、前記第2の電極の
一方に隣接する前記第1の電極とで第1の表示ラインを
形成し、前記第2の電極の他方に隣接する前記第1の電
極とで第2の表示ラインを形成し、1画面の表示フィー
ルドを複数のサブフィールドで構成し、表示を行うサブ
フィールドを組み合わせることにより階調表示を行い、
前記Xサステイン回路は、前記第1の電極の奇数番目の
電極に前記サステインパルスを供給する第1Xサステイ
ン回路と、偶数番目の電極に前記サステインパルスを供
給する第2Xサステイン回路とを備え、前記Yサステイ
ン回路は、前記第2の電極の奇数番目の電極に前記サス
テインパルスを供給する第1Yサステイン回路と、偶数
番目の電極に前記サステインパルスを供給する第2Yサ
ステイン回路とを備え、 回路素子の組み合わせを選択する時には、前記第1Xサ
ステイン回路の出力するサステインパルスと、前記第1
又は第2Yサステイン回路の出力するサステインパルス
との立ち上がりタイミング又は立ち下がりタイミングの
差、及び前記第2Xサステイン回路の出力するサステイ
ンパルスと、前記第1又は第2Yサステイン回路の出力
するサステインパルスとの立ち上がりタイミング又は立
ち下がりタイミングの差が所定値以下になるように、前
記第1及び第2Xサステイン回路と前記第1及び第2Y
サステイン回路の回路素子を選択するプラズマディスプ
レイ装置の製造方法。
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Related Child Applications (1)
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TW (1) | TW580676B (ja) |
Cited By (13)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US6781322B2 (en) | 2002-05-16 | 2004-08-24 | Fujitsu Hitachi Plasma Display Limited | Capacitive load drive circuit and plasma display apparatus |
KR100489876B1 (ko) * | 2002-06-29 | 2005-05-17 | 엘지전자 주식회사 | 플라즈마 디스플레이 패널 |
KR100509602B1 (ko) * | 2002-09-27 | 2005-08-23 | 삼성에스디아이 주식회사 | 온도에 기인한 펄스 왜곡이 보상되는 플라즈마 디스플레이패널의 구동 방법 |
KR20050112862A (ko) * | 2004-05-28 | 2005-12-01 | 삼성에스디아이 주식회사 | 플라즈마 디스플레이 패널의 구동 방법 및 그 장치 |
JP2006058799A (ja) * | 2004-08-24 | 2006-03-02 | Fuji Electric Device Technology Co Ltd | 表示装置駆動用集積回路 |
US7015905B2 (en) | 2003-04-10 | 2006-03-21 | Fujitsu Hitachi Plasma Display Limited | Capacitive load driving circuit driving capacitive loads such as pixels in plasma display panels and plasma display apparatus having the capacitive load driving circuit |
US7084839B2 (en) | 2003-02-18 | 2006-08-01 | Fujitsu Hitachi Plasma Display Limited | Pre-drive circuit, capacitive load drive circuit and plasma display apparatus |
KR100704815B1 (ko) | 2004-06-28 | 2007-04-09 | 후지츠 히다찌 플라즈마 디스플레이 리미티드 | 반도체 집적 회로, 구동 회로 및 플라즈마 디스플레이 장치 |
US7211963B2 (en) | 2004-05-18 | 2007-05-01 | Fujitsu Hitachi Plasma Display Limited | Capacitive load driving circuit for driving capacitive loads such as pixels in plasma display panel, and plasma display apparatus |
WO2008044899A1 (en) * | 2006-10-12 | 2008-04-17 | Lg Electronics Inc. | Plasma display apparatus and method of driving thereof |
CN100470616C (zh) * | 2003-11-27 | 2009-03-18 | 三星Sdi株式会社 | 等离子显示板的驱动方法及等离子显示设备 |
WO2010084795A1 (ja) * | 2009-01-21 | 2010-07-29 | 株式会社東芝 | 通信装置 |
JP2011005776A (ja) * | 2009-06-26 | 2011-01-13 | Seiko Epson Corp | 液体噴射装置及び液体噴射型印刷装置 |
Families Citing this family (11)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP3644867B2 (ja) * | 2000-03-29 | 2005-05-11 | 富士通日立プラズマディスプレイ株式会社 | プラズマディスプレイ装置及びその製造方法 |
JP2002215087A (ja) * | 2001-01-19 | 2002-07-31 | Fujitsu Hitachi Plasma Display Ltd | プラズマディスプレイ装置およびその制御方法 |
JP4031971B2 (ja) | 2001-12-27 | 2008-01-09 | 富士通日立プラズマディスプレイ株式会社 | パワーモジュール |
JP4268390B2 (ja) | 2002-02-28 | 2009-05-27 | パイオニア株式会社 | 表示パネルの駆動装置 |
JP2003280574A (ja) * | 2002-03-26 | 2003-10-02 | Fujitsu Hitachi Plasma Display Ltd | 容量性負荷駆動回路及びプラズマディスプレイ装置 |
KR100472372B1 (ko) * | 2002-08-01 | 2005-02-21 | 엘지전자 주식회사 | 플라즈마 디스플레이 패널의 구동방법 |
KR20050081012A (ko) * | 2004-02-12 | 2005-08-18 | 엘지전자 주식회사 | 플라즈마 표시 패널의 구동 장치 |
JP2006017990A (ja) | 2004-07-01 | 2006-01-19 | Fujitsu Hitachi Plasma Display Ltd | 表示装置の動回路及びプラズマディスプレイ装置 |
JP4532244B2 (ja) * | 2004-11-19 | 2010-08-25 | 日立プラズマディスプレイ株式会社 | プラズマディスプレイ装置 |
KR20080048893A (ko) * | 2006-11-29 | 2008-06-03 | 엘지전자 주식회사 | 플라즈마 디스플레이 장치 |
WO2010102125A2 (en) * | 2009-03-05 | 2010-09-10 | Applied Materials, Inc. | Inductively coupled plasma reactor having rf phase control and methods of use thereof |
Family Cites Families (30)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US4067047A (en) * | 1976-03-29 | 1978-01-03 | Owens-Illinois, Inc. | Circuit and method for generating gray scale in gaseous discharge panels |
US4594588A (en) * | 1983-03-07 | 1986-06-10 | International Business Machines Corporation | Plasma display margin control |
JPH04181809A (ja) | 1990-07-23 | 1992-06-29 | Fuji Electric Co Ltd | 集積回路装置の負荷駆動回路 |
KR950003132B1 (ko) * | 1992-03-26 | 1995-04-01 | 삼성전관 주식회사 | 플라즈마 디스플레이 판넬의 구조 및 구동방법 |
JP2770657B2 (ja) | 1992-06-09 | 1998-07-02 | 日本電気株式会社 | プラズマディスプレイの駆動装置 |
JP3279704B2 (ja) * | 1993-03-19 | 2002-04-30 | 富士通株式会社 | フラットパネルディスプレイ装置の駆動方法 |
JP2891280B2 (ja) | 1993-12-10 | 1999-05-17 | 富士通株式会社 | 平面表示装置の駆動装置及び駆動方法 |
JP2888176B2 (ja) | 1995-07-14 | 1999-05-10 | 日本電気株式会社 | プラズマディスプレイ及びその駆動方法 |
US6373452B1 (en) | 1995-08-03 | 2002-04-16 | Fujiitsu Limited | Plasma display panel, method of driving same and plasma display apparatus |
JP2801893B2 (ja) | 1995-08-03 | 1998-09-21 | 富士通株式会社 | プラズマディスプレイパネル駆動方法及びプラズマディスプレイ装置 |
US5642018A (en) * | 1995-11-29 | 1997-06-24 | Plasmaco, Inc. | Display panel sustain circuit enabling precise control of energy recovery |
TW369674B (en) * | 1996-05-15 | 1999-09-11 | Daihen Corp | Plasma processing apparatus |
JP3672669B2 (ja) | 1996-05-31 | 2005-07-20 | 富士通株式会社 | 平面表示装置の駆動装置 |
KR100222203B1 (ko) * | 1997-03-17 | 1999-10-01 | 구자홍 | AC 플라즈마 디스플레이 패널을 위한 에너지 리커버리(recovery) 서스테인 회로 |
JP2771527B2 (ja) * | 1997-03-28 | 1998-07-02 | 株式会社日立製作所 | 表示装置及び表示部駆動用回路 |
US6160530A (en) * | 1997-04-02 | 2000-12-12 | Nec Corporation | Method and device for driving a plasma display panel |
JP2976923B2 (ja) | 1997-04-25 | 1999-11-10 | 日本電気株式会社 | 容量性負荷の駆動装置 |
JP3633761B2 (ja) | 1997-04-30 | 2005-03-30 | パイオニア株式会社 | プラズマディスプレイパネルの駆動装置 |
JPH11327505A (ja) | 1998-05-20 | 1999-11-26 | Fujitsu Ltd | プラズマディスプレイ装置の駆動方法 |
FR2763735B1 (fr) | 1997-05-22 | 1999-08-13 | Sgs Thomson Microelectronics | Etage de sortie de puissance pour la commande de cellules d'ecran a plasma |
JP3897896B2 (ja) * | 1997-07-16 | 2007-03-28 | 三菱電機株式会社 | プラズマディスプレイパネルの駆動方法及びプラズマディスプレイ装置 |
JPH11282416A (ja) | 1998-01-30 | 1999-10-15 | Mitsubishi Electric Corp | プラズマディスプレイパネルの駆動回路、その駆動方法およびプラズマディスプレイパネル装置 |
AU5769299A (en) | 1998-04-13 | 1999-12-06 | Tecstar Power Systems, Inc. | Modular, glass-covered solar cell array |
JP4240163B2 (ja) | 1998-05-21 | 2009-03-18 | 株式会社日立プラズマパテントライセンシング | プラズマディスプレイパネルの駆動方法 |
JP3420938B2 (ja) | 1998-05-27 | 2003-06-30 | 富士通株式会社 | プラズマディスプレイパネル駆動方法および駆動装置 |
KR100277407B1 (ko) * | 1998-06-30 | 2001-01-15 | 전주범 | 플라즈마 디스플레이 패널 텔레비전의 전력 회수방법 및 그 회로 |
TW527576B (en) * | 1998-07-29 | 2003-04-11 | Hitachi Ltd | Display panel driving method and discharge type display apparatus |
JP3630290B2 (ja) * | 1998-09-28 | 2005-03-16 | パイオニアプラズマディスプレイ株式会社 | プラズマディスプレイパネルの駆動方法およびプラズマディスプレイ |
KR20010028539A (ko) * | 1999-09-21 | 2001-04-06 | 구자홍 | 에너지 회수 장치 |
JP3644867B2 (ja) * | 2000-03-29 | 2005-05-11 | 富士通日立プラズマディスプレイ株式会社 | プラズマディスプレイ装置及びその製造方法 |
-
2000
- 2000-03-29 JP JP2000092131A patent/JP3644867B2/ja not_active Expired - Fee Related
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Cited By (15)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US6781322B2 (en) | 2002-05-16 | 2004-08-24 | Fujitsu Hitachi Plasma Display Limited | Capacitive load drive circuit and plasma display apparatus |
KR100489876B1 (ko) * | 2002-06-29 | 2005-05-17 | 엘지전자 주식회사 | 플라즈마 디스플레이 패널 |
KR100509602B1 (ko) * | 2002-09-27 | 2005-08-23 | 삼성에스디아이 주식회사 | 온도에 기인한 펄스 왜곡이 보상되는 플라즈마 디스플레이패널의 구동 방법 |
CN100351881C (zh) * | 2003-02-18 | 2007-11-28 | 富士通日立等离子显示器股份有限公司 | 等离子体显示设备 |
US7084839B2 (en) | 2003-02-18 | 2006-08-01 | Fujitsu Hitachi Plasma Display Limited | Pre-drive circuit, capacitive load drive circuit and plasma display apparatus |
US7015905B2 (en) | 2003-04-10 | 2006-03-21 | Fujitsu Hitachi Plasma Display Limited | Capacitive load driving circuit driving capacitive loads such as pixels in plasma display panels and plasma display apparatus having the capacitive load driving circuit |
CN100470616C (zh) * | 2003-11-27 | 2009-03-18 | 三星Sdi株式会社 | 等离子显示板的驱动方法及等离子显示设备 |
US7211963B2 (en) | 2004-05-18 | 2007-05-01 | Fujitsu Hitachi Plasma Display Limited | Capacitive load driving circuit for driving capacitive loads such as pixels in plasma display panel, and plasma display apparatus |
KR20050112862A (ko) * | 2004-05-28 | 2005-12-01 | 삼성에스디아이 주식회사 | 플라즈마 디스플레이 패널의 구동 방법 및 그 장치 |
KR100704815B1 (ko) | 2004-06-28 | 2007-04-09 | 후지츠 히다찌 플라즈마 디스플레이 리미티드 | 반도체 집적 회로, 구동 회로 및 플라즈마 디스플레이 장치 |
JP2006058799A (ja) * | 2004-08-24 | 2006-03-02 | Fuji Electric Device Technology Co Ltd | 表示装置駆動用集積回路 |
WO2008044899A1 (en) * | 2006-10-12 | 2008-04-17 | Lg Electronics Inc. | Plasma display apparatus and method of driving thereof |
US8026870B2 (en) | 2006-10-12 | 2011-09-27 | Lg Electronics Inc. | Plasma display apparatus with temperature compensation and method of driving thereof |
WO2010084795A1 (ja) * | 2009-01-21 | 2010-07-29 | 株式会社東芝 | 通信装置 |
JP2011005776A (ja) * | 2009-06-26 | 2011-01-13 | Seiko Epson Corp | 液体噴射装置及び液体噴射型印刷装置 |
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