JP2001168238A - 高周波回路用パッケージ - Google Patents

高周波回路用パッケージ

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JP2001168238A
JP2001168238A JP34723499A JP34723499A JP2001168238A JP 2001168238 A JP2001168238 A JP 2001168238A JP 34723499 A JP34723499 A JP 34723499A JP 34723499 A JP34723499 A JP 34723499A JP 2001168238 A JP2001168238 A JP 2001168238A
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Noboru Kubo
昇 久保
Toshishige Yamamoto
利重 山本
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Sumitomo Metal SMI Electronics Device Inc
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Abstract

(57)【要約】 【課題】 高周波回路用パッケージのリード接合部にお
ける特性インピーダンスの不整合によって生じる高周波
信号の反射を少なくする。 【解決手段】 パッケージ21の入出力端子台24に高
周波信号線25とGND線26を形成すると共に、高周
波信号線25とGND線26に信号リード27とGND
リード28を接合する。信号リード27の幅をGNDリ
ード28の幅よりも細くすると共に、信号リード27と
GNDリード28との間隔を他のリードの間隔よりも狭
くすることで、リード接合部近辺におけるGND電流の
経路を短くする。これにより、高周波信号線−GND線
のループインダクタンスが減少すると共に、信号リード
27とGNDリード28との間の容量結合が増加し、こ
れらループインダクタンスの減少と容量結合の増加によ
ってリード接合部における特性インピーダンスの不整合
が少なくなり、高周波信号の反射が少なくなる。

Description

【発明の詳細な説明】
【0001】
【発明の属する技術分野】本発明は、高周波信号の伝送
特性を向上した高周波回路用パッケージに関するもので
ある。
【0002】
【従来の技術】従来の高周波回路用パッケージは、例え
ば図8及び図9に示すように、チップ10を収容したパ
ッケージ11の両側部に高周波信号線用のリード(以下
「信号リード」という)12とグランド線用のリード
(以下「GNDリード」という)13を列設し、各リー
ド12,13を外部回路基板14の配線パターンに接続
するようにしている。この場合、パッケージ11の入出
力端子台15に形成した高周波信号線16の特性インピ
ーダンスを所定の設計値に収めるために、図5(a)に
示すように、高周波信号線16の両側にGND線17を
並行に形成している。従って、信号リード12に隣接し
てGNDリード13が位置している。また、各リード1
2,13のピッチは通常2.54mmとなっている。
【0003】
【発明が解決しようとする課題】近年の電子機器は、高
周波化が進み、例えば10GHz程度の高周波信号を取
り扱う場合がある。しかし、信号の高周波化が進むに従
って、パッケージ11と外部回路基板14とのリード接
合部における特性インピーダンスの不整合の影響が大き
くなり、その影響で、高周波信号の反射が増加して、高
周波信号の伝送特性が悪化する。
【0004】ところで、リード接合部における特性イン
ピーダンスの不整合は、リード12,13のピッチが
2.54mmと大きいことが原因と思われる。つまり、
リード12,13のピッチが大きいと、図5(a)に示
すように、リード接合部近辺におけるGND電流の経路
が長くなるため、高周波信号線−GND線のループイン
ダクタンスが増加すると共に、信号リード12とこれに
隣接するGNDリード13との間の容量結合が低下し、
これらループインダクタンスの増加と容量結合の低下に
よってリード接合部で特性インピーダンスの不整合が発
生するものと考えられる。
【0005】本発明はこのような事情を考慮してなされ
たものであり、従ってその目的は、リード接合部におけ
る特性インピーダンスの不整合による高周波信号の反射
を少なくすることができ、高周波信号の伝送特性を向上
することができる高周波回路用パッケージを提供するこ
とにある。
【0006】
【課題を解決するための手段】上記目的を達成するため
に、本発明の請求項1の高周波回路用パッケージは、高
周波信号線用のリード(信号リード)とグランド線用の
リード(GNDリード)との間隔を他のリードの間隔よ
りも狭くすることで、リード接合部近辺におけるGND
電流の経路を短くしている。これにより、高周波信号線
−GND線のループインダクタンスが減少すると共に、
信号リードとこれに隣接するGNDリードとの間の容量
結合が増加し、これらループインダクタンスの減少と容
量結合の増加によってリード接合部における特性インピ
ーダンスの不整合が少なくなり、高周波信号の反射が少
なくなる。
【0007】更に、請求項2のように、信号リードの幅
をGNDリードの幅よりも細くすると良い。このように
すれば、信号リードのパッド部の特性インピーダンスを
設計値に維持しながら、リードの間隔を狭くすることが
可能となる。
【0008】
【発明の実施の形態】以下、本発明の一実施形態を図1
〜図5に基づいて説明する。まず、図1〜図4に基づい
て高周波回路用パッケージ全体の構成を説明する。パッ
ケージ21は、金属ベース22上に四角枠状のメタルウ
ォール23がろう付け等により固定され、このメタルウ
ォール23の両側部に絶縁体製の入出力端子台24がろ
う付け等により固定されている。入出力端子台24に
は、高周波信号線25とGND線(グランド線)26と
が導体印刷パターンで並行に形成され、これらの高周波
信号線25とGND線26には、それぞれ信号リード2
7とGNDリード28がろう付け等により接合されてい
る。高周波信号線25とGND線26は、パッケージ2
1内に収納されたチップ29にボンディングワイヤ30
によって接続されている。このパッケージ21の信号リ
ード27とGNDリード28は、外部回路基板32の高
周波信号線33とGND線34に接合される。尚、パッ
ケージ21の上面開口はメタルカバー31で封止されて
いる。
【0009】高周波信号線25の特性インピーダンスを
所定の設計値に収めるために、図5(b)に示すよう
に、高周波信号線25の両側にGND線26が並行に形
成されている。従来は、図5(a)に示すように、信号
リード12とこれに隣接するGNDリード13のピッチ
は2.54mmであったが、本実施形態では、図5
(b)に示すように、信号リード27とGNDリード2
8との間隔を他のリードの間隔よりも狭くして、リード
27,28のピッチを例えば0.6〜2.0mm(本実
施形態では1mm)に設定している。更に、信号リード
27の幅をGNDリード28の幅よりも細くして、信号
リード27の幅を例えば0.1〜0.4mmに設定して
いる(GNDリード28の幅は例えば0.5mmであ
る)。
【0010】前述したように、従来は、図5(a)に示
すように、信号リード12とこれに隣接するGNDリー
ド13のピッチが2.54mmと大きいため、リード接
合部近辺におけるGND電流の経路が長くなっていた。
このため、高周波信号線−GND線のループインダクタ
ンスが増加すると共に、信号リード12とこれに隣接す
るGNDリード13との間の容量結合が低下し、これら
ループインダクタンスの増加と容量結合の低下によって
リード接合部で特性インピーダンスの不整合が発生し、
その影響で、高周波信号の反射が増加して、高周波信号
の伝送特性が悪化する欠点があった。
【0011】これに対し、本実施形態では、図5(b)
に示すように、信号リード27の幅をGNDリード28
の幅よりも細くすると共に、信号リード27とGNDリ
ード28との間隔(リードピッチ)を他のリードの間隔
よりも狭くしている。信号リード27の幅をGNDリー
ド28の幅よりも細くすれば、信号リード27とGND
リード28との間隔を狭くしても、信号リード27のパ
ッド部の特性インピーダンスを設計値に維持することが
できる。また、信号リード27とGNDリード28との
間隔を狭くすれば、リード接合部近辺におけるGND電
流の経路が短くなるため、高周波信号線−GND線のル
ープインダクタンスが減少すると共に、信号リード27
とこれに隣接するGNDリード28との間の容量結合が
増加し、これらループインダクタンスの減少と容量結合
の増加によってリード接合部の特性インピーダンスの不
整合が少なくなり、高周波信号の反射が少なくなる。
【0012】本発明者らは、従来構造(リードピッチ
2.54mm)と本実施形態の構造(リードピッチ1m
m)について、高周波信号の反射特性と通過特性を解析
したので、その解析結果を図6及び図7に示す。この解
析結果から明らかなように、本実施形態の構造は、従来
構造と比較して、10GHz以上の高周波数域でも、高
周波信号の反射が大幅に少なくなり、10GHz以上の
高周波信号を損失少なく伝送することができる。
【0013】尚、本実施形態では、高周波信号線25の
両側にGND線26を形成したが、高周波信号線25の
片側のみにGND線26を形成しても良く、また、信号
リード27の幅をGNDリード28の幅と同一としても
良い。その他、本発明は、パッケージ21の構造を変更
しても良い等、要旨を逸脱しない範囲内で種々変更して
実施できる。
【0014】
【発明の効果】以上の説明から明らかなように、本発明
の請求項1では、信号リードとGNDリードとの間隔を
他のリードの間隔よりも狭くしたので、リード接合部近
辺におけるGND電流の経路を短くすることができて、
リード接合部における特性インピーダンスの不整合を少
なくすることができ、高周波信号の反射を少なくして高
周波信号の伝送特性を向上することができる。
【0015】更に、請求項2では、信号リードの幅をG
NDリードの幅よりも細くしたので、リードの間隔を狭
くしても、信号リードのパッド部の特性インピーダンス
を設計値に維持することができる。
【図面の簡単な説明】
【図1】本発明の一実施形態を示す高周波回路用パッケ
ージの平面図
【図2】本実施形態の高周波回路用パッケージの縦断面
【図3】パッケージの分解斜視図
【図4】入出力端子台の拡大斜視図
【図5】(a)は従来構造のリード接続部周辺のGND
電流の経路を示すリード接続部周辺の拡大平面図、
(b)は本実施形態のリード接続部周辺のGND電流の
経路を示すリード接続部周辺の拡大図
【図6】高周波信号の反射特性の解析結果を示す図
【図7】高周波信号の通過特性の解析結果を示す図
【図8】従来の高周波回路用パッケージの平面図
【図9】従来の高周波回路用パッケージの縦断面図
【符号の説明】
21…パッケージ、24…入出力端子台、25…高周波
信号線、26…GND線(グランド線)、27…信号リ
ード、28…GNDリード、29…チップ、32…外部
回路基板、33…高周波信号線、34…GND線。

Claims (2)

    【特許請求の範囲】
  1. 【請求項1】 高周波信号線用のリードとグランド線用
    のリードとを隣接して設けた高周波回路用パッケージに
    おいて、 前記高周波信号線用のリードと前記グランド線用のリー
    ドとの間隔を他のリードの間隔よりも狭くしたことを特
    徴とする高周波回路用パッケージ。
  2. 【請求項2】 前記高周波信号線用のリードの幅を前記
    グランド線用のリードの幅よりも細くしたことを特徴と
    する請求項1に記載の高周波回路用パッケージ。
JP34723499A 1999-12-07 1999-12-07 高周波回路用パッケージ Pending JP2001168238A (ja)

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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2010177364A (ja) * 2009-01-28 2010-08-12 Nippon Telegr & Teleph Corp <Ntt> 半導体パッケージおよびその実装方法

Citations (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH0685155A (ja) * 1992-09-01 1994-03-25 Nec Corp モールド型半導体装置
JPH06196578A (ja) * 1992-12-24 1994-07-15 Shinko Electric Ind Co Ltd 半導体装置
JPH0936617A (ja) * 1995-07-20 1997-02-07 Nippon Telegr & Teleph Corp <Ntt> 高周波モジュール
JPH10107200A (ja) * 1996-10-02 1998-04-24 Hitachi Ltd 半導体集積回路装置

Patent Citations (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH0685155A (ja) * 1992-09-01 1994-03-25 Nec Corp モールド型半導体装置
JPH06196578A (ja) * 1992-12-24 1994-07-15 Shinko Electric Ind Co Ltd 半導体装置
JPH0936617A (ja) * 1995-07-20 1997-02-07 Nippon Telegr & Teleph Corp <Ntt> 高周波モジュール
JPH10107200A (ja) * 1996-10-02 1998-04-24 Hitachi Ltd 半導体集積回路装置

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2010177364A (ja) * 2009-01-28 2010-08-12 Nippon Telegr & Teleph Corp <Ntt> 半導体パッケージおよびその実装方法

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