CN102053413A - 显示设备 - Google Patents

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Abstract

一种显示设备，包括：时序控制器、数据驱动器和显示面板。时序控制器输出多个图像信号、第一控制信号和第二控制信号。数据驱动器响应于第一控制信号将图像信号转换成第一电压，输出所述第一电压，并且响应于第二控制信号以一帧为单位输出在两个不同的电压电平之间变化的第二电压。所述显示面板包括多个像素，多个像素中的每一个接收第一电压和第二电压中的对应的一个，以显示图像。

Description

显示设备
本申请要求2009年10月30日递交的第2009-104260号韩国专利申请的优先权，通过引用将所述韩国专利申请的公开内容全部包含于此。
技术领域
各实施例的发明构思涉及一种显示设备，更具体地说，涉及一种能够实现电稳定性的显示设备。
背景技术
液晶显示器可包括具有红色子像素、绿色子像素和蓝色子像素的像素，所述红色子像素、绿色子像素和蓝色子像素通过根据施加的数据信号而调整其取向的液晶的排列来控制通过子像素的光的透射率。可用经由薄膜晶体管施加到像素电极的数据电压与施加到参考电极的参考电压之间的差分电压对每个子像素充电，以驱动液晶。薄膜晶体管可响应于施加到栅极线的栅极导通电压而导通，从而使像素电极能通过从数据线施加的数据信号而充电。薄膜晶体管可响应于栅极截止电压而截止，从而使像素电极能够保持数据信号的电荷。
然而，当将直流电压施加到参考电极时，难以在不增加参考电压的电平的情况下增加在液晶中充电的差分电压。
发明内容
根据发明的构思的示例性实施例的显示设备包括数据驱动器和具有至少一个像素的显示面板。每当至少一帧显示在显示面板上，数据驱动器将数据电压和在两个不同的电压电平之间交替摇摆的电压输出到显示面板。所述至少一个像素基于对数据电压中对应的一个和摇摆电压的接收来显示图像。
根据本发明的构思的示例性实施例的显示设备包括时序控制器、数据控制器和显示面板。时序控制器输出多个图像信号、数据控制信号和第一控制信号。数据驱动器响应于数据控制信号将图像信号转换成第一电压，输出所述第一电压，并响应于第一控制信号输出以至少一帧为单位在两个不同的电平之间摇摆的第二电压。显示面板包括多个像素，多个像素中的每一个接收第一电压中对应的一个和第二电压，以显示图像。
数据驱动器可包括转换器部和输出缓冲器。转换器部可包括第一转换器，用于将具有n比特的多个图像信号转换成第一电压，第二转换器，用于交替地选择具有n比特的第一参考信号和具有n比特的第二参考信号中的一个，并将所选择的第一参考信号或第二参考信号中的一个转换成第二电压。输出缓冲器可输出从第一转换器输出的第一电压。
根据本发明构思的示例性实施例，数据驱动器包括转换器部和输出缓冲器，转换器部包括：第一转换器，用于将多个图像信号转换成第一电压；第二转换器，用于交替地选择第一参考信号和第二参考信号中的一个，将所选择的第一参考信号或第二参考信号转换成第二电压，输出第二电压。输出缓冲器，所述输出缓冲器输出从第一转换器输出的第一电压。第一转换器和第二转换器可以是D-A转换器。
根据本发明构思的示例性实施例，数据驱动器包括：数据输出部，开关部和缓冲器部。数据输出部接收多个图像信号和模拟驱动电压，并在处于模拟驱动电压和地电压之间的多个灰阶电压中选择分别对应于图像信号的灰阶电压，以将所选择的灰阶电压输出为第一电压。开关部交替地选择模拟驱动电压和地电压中的一个，以输出第二电压和相位与第二电压的相位相反的第三电压。缓冲器部放大第二电压和第三电压。
根据本发明构思的示例性实施例，数据驱动器从时序控制器接收第一和第二控制信号，并交替地产生以一帧为单位摇摆的摇摆电压和相位与所述摆动电压的相位相反的反相电压。数据驱动器可布置在显示设备的显示面板的一侧上。显示设备可包括：具有时序控制器的控制板；连接到数据驱动器的印刷电路板；连接膜，将控制板连接到印刷电路板以将图像信号以及来自时序控制器的第一控制信号和第二控制信号提供给数据驱动器。因此，摆动电压和反相电压可由数据驱动器产生，并在不通过控制板、连接膜和印刷电路板的情况下从数据驱动器施加到显示面板。
附图说明
当结合附图考虑时，通过参照下面的详细描述，本发明的构思将会变得更加清楚，其中：
图1是示出根据本发明构思的示例性实施例的显示设备的框图；
图2是示出根据本发明构思的示例性实施例的可用在图1中的数据驱动器的框图；
图3是示出根据本发明构思的示例性实施例的可用在图1中的数据驱动器的框图；
图4是示出根据本发明构思的示例性实施例的可用在图1中的数据驱动器的框图；
图5A是示出在第q帧中施加到显示面板的第一电压的极性的示例性示意图；
图5B是示出在第q+1帧中施加到显示面板的第一电压的极性的示意图；
图6A是示出施加到图5A和图5B的第一像素的第一电压和第二电压的示例性波形图；
图6B是示出施加到图5A和图5B的第二像素的第一电压和第三电压的示例性波形图；
图7是示出根据本发明的构思的示例性实施例的可用在图1中的时序控制器的框图；
图8是示出图7的信号的示例性时序图；
图9是示出图1的像素的示例性布局图；
图10是沿图9的线I-I’截得的示例性截面图；
图11是根据本发明的构思的示例性实施例的显示设备的平面图。
具体实施方式
应当理解，当元件或层被表述为“在另一元件或层上”、“连接到”或“结合到”另一元件或层时，该元件可直接在另一元件上、直接连接或结合到另一元件或层，或者可存在中间元件或中间层。相同的标号始终指示相同的元件。以下，将参照附图详细解释本发明构思。
图1是示出根据本发明的构思的示例性实施例的显示设备的框图。参照图1，显示设备100包括显示面板110、时序控制器120、数据驱动器130和栅极驱动器140。
显示面板110包括多个像素。由于一个或多个像素具有相同的构造和功能，为了便于解释，仅在图1中示出一个像素。例如，该像素包括栅极线GL、与栅极线GL交叉的第一信号线DL以及基本上与第一信号线DL平行的第二信号线CL。进一步，该像素还包括：第一薄膜晶体管T1，其连接到栅极线GL和第一信号线DL；第二薄膜晶体管T2，其连接到栅极线GL和第二信号线CL；液晶电容CLc，其连接在第一薄膜晶体管T1和第二薄膜晶体管T2之间。
液晶电容CLc可包括：第一像素电极，其电连接到第一薄膜晶体管T1的漏电极；第二像素电极，其电连接到第二薄膜晶体管T2的漏电极；液晶，形成在第一像素电极和第二像素电极之间的电场可使所述液晶倾斜。例如，液晶的取向可被电场改变。
时序控制器120接收多个图像信号I-DATA和控制信号(例如，水平同步信号Hsync，垂直同步信号Vsync，时钟信号MCLK和数据使能信号DE)。时序控制器120将图像信号I-DATA的数据格式转换成适于时序控制器120和数据驱动器130之间的接口的数据格式，并且将经转换的图像信号I-DATA’输出到数据驱动器130。此外，时序控制器120将数据控制信号(例如，输出起动信号TP、水平起动信号STH、水平时钟信号CKH和极性反转信号POL)提供给数据驱动器130，并且将栅极控制信号(例如，垂直起动信号STV、垂直时钟信号CKV和垂直时钟条(vertical clock bar)信号CKVB)提供给栅极驱动器140。
栅极驱动器140接收栅极导通电压Von和栅极截止电压Voff，并且响应于从时序控制器120提供的栅极控制信号(例如，STV，CKV和CKVB)来顺序地输出在栅极导通电压Von和栅极截止电压Voff之间摇摆的(例如，交替的)栅极信号G1～Gn。因此，显示面板110可被栅极信号G1～Gn顺序地扫描。
数据驱动器130接收模拟驱动电压AVDD和地电压VSS。响应于数据控制信号，数据驱动器130在陈列在模拟驱动电压AVDD和地电压VSS之间的灰阶(gray-scale)电压中选择分别对应于图像信号I-DATA’的灰阶电压。数据驱动器130将所选择的灰阶电压输出为第一电压D1～Dm。第一电压D1～Dm被施加到显示面板110。
根据示例性实施例，数据驱动器130还可包括电压发生器135。时序控制器120将第一控制信号CTL和相位与第一控制信号CTL的相位相反的第二控制信号CTLB提供给电压发生器135。
电压发生器135响应于第一控制信号CTL输出在显示设备的至少一帧期间摇摆的(例如，交替的)第二电压VC，并且响应于第二控制信号CTLB输出相位与第二电压VC的相位相反的第三电压VCB。第二电压VC和第三电压VCB被施加到显示面板110。
因此，显示面板110的一个或多个像素可接收第二电压VC或第三电压VCB。例如，两个相邻像素中的一个可接收第二电压VC，两个像素中的剩下一个像素可接收第三电压VCB。
当栅极信号G1～Gn中的对应的栅极信号施加到栅极线GL时，连接到栅极线GL的第一薄膜晶体管T1和第二薄膜晶体管T2响应于对应的栅极信号而导通。当第一电压施加到导通的第一薄膜晶体管T1连接的第一信号线DL时，第一电压通过导通的第一薄膜晶体管T1施加到液晶电容CLc的第一像素电极。进一步，当第二电压VC施加到第二信号线CL时，第二电压VC通过导通的第二薄膜晶体管T2施加到液晶电容CLc的第二像素电极。
因此，可在第一像素电极和第二像素电极之间形成水平电场，液晶的透光率可由水平电场控制，从而在显示面板110上显示具有期望的灰阶的图像。
图2是示出根据本发明构思的示例性实施例的可用于图1中的数据驱动器的框图。参考图2，数据驱动器130包括数据输出部131和电压发生器135。数据输出部131包括移位寄存器131a、锁存器131b、数模(D-A)转换器131c和输出缓冲器131d。
虽然没有在图2中示出，但是移位寄存器131a可包括一个接一个地彼此相连的多个级(stage)，其中，水平时钟信号CKH施加到每个级，水平起动信号STH施加到多个级的第一级。当第一级响应于水平起动信号STH而开始它的工作时，所述多个级响应于水平时钟信号CKH顺序地输出控制信号。
锁存器131b从所述多个级接收控制信号，以存储与图像信号I-DATA’中的一行对应的图像信号。锁存器131b将与所述一行对应的存储的图像信号提供给D-A转换器131c。
D-A转换器131c将由锁存器131b提供的图像信号转换成灰阶电压。D-A转换器131c接收在模拟驱动电压AVDD和地电压VSS之间具有均匀的电平差的2k个灰阶电压。在至少一个示例性实施例中，k代表每个图像信号的比特数且k是大于或等于1的正整数。
作为一个示例，如果每个图像信号具有k＝6比特，则D-A转换器131c接收64个灰阶电压V1～V64(即，26比特＝64)。然而，图像信号可包括更少的或更多的比特数，因此D-A转换器131c可接收更少的或更多的灰阶电压。例如，如果AVDD＝15伏且k＝2，然后可以接收0伏、5伏、10伏和15伏的灰阶电压。D-A转换器131c在对应数目(例如，在使用6比特图像数据时为64)的灰阶电压中选择分别对应于图像信号的灰阶电压，并且将所选择的灰阶电压输出为第一电压D1～Dm。
虽然没有在图2中示出，但是输出缓冲器131d可包括多个运算放大器(OP-amps)以临时存储从D-A转换器131c输出的第一电压D1～Dm，并且响应于输出起动信号TP在相同的时间或基本相同的时间输出第一电压D1～Dm。
虽然没有在图2中示出，但是D-A转换器131c可包括第一灰阶电压组(下文中称为“正极性组”)和第二灰阶电压组(下文中称为“负极性组”)，以使第一电压D1～Dm具有不同的极性。正极性组的灰阶电压具有这样的灰阶：随着灰阶电压从地电压变得越接近模拟驱动电压AVDD，灰阶电压变得越高；负极性组具有这样的灰阶：随着灰阶电压从模拟驱动电压AVDD变得越接近地电压，灰阶电压变得越高。因此，D-A转换器131c可响应于极性反转信号POL(例如，参见图1中示出的POL信号)而从正极性组或负极性组选择与图像信号对应的灰阶电压。
电压发生器135包括开关部135a和缓冲器部135b。开关部135a接收模拟驱动电压AVDD和地电压VSS。开关部135a响应于第一控制信号CTL选择模拟驱动电压AVDD或地电压VSS，以将模拟驱动电压AVDD或地电压VSS输出作为第二电压VC。第一控制信号CTL可以是具有逻辑高和逻辑低状态的两相信号，且第一控制信号CTL可以以一帧为单位在逻辑高状态和逻辑低状态之间摇摆。
开关部135a响应于第二控制信号CTLB选择模拟驱动电压AVDD或地电压VSS，以将模拟驱动电压AVDD或地电压VSS输出为第三电压VCB。第二控制信号CTLB具有与第一控制信号CTL相反的相位。
例如，如果在逻辑高状态的第一控制信号CTL和在逻辑低状态的第二控制信号CTLB在第q帧期间被施加到开关部135a，则开关部135a可将模拟驱动电压AVDD输出作为第二电压VC并将地电压VSS输出作为第三电压VCB。
相反，如果在逻辑低状态的第一控制信号CTL和在逻辑高状态的第二控制信号CTLB在第q+1帧期间施加到开关部135a，则开关部135a可将地电压VSS输出为第二电压VC并将模拟驱动电压AVDD输出为第三电压VCB。
相应地，第二电压VC和第三电压VCB可响应于第一控制信号CTL和第二控制信号CTLB以一帧为单位摆动。
缓冲器部135b从开关部135a接收第二电压VC和第三电压VCB，并且放大第二电压VC和第三电压VCB。例如，当第二电压VC和第三电压VCB中的每一个被一致地施加到显示面板110(如图1中所示)时，可能需要具有更高电压的第二电压VC和第三电压VCB。因此，可以在第二电压VC和第三电压VCB施加到显示面板110之前充分地放大第二电压VC和第三电压VCB。
虽然图2示出了电压发生器135是特定的并与数据输出部131分离的电路构造，但是电压发生器135可安装在数据输出部131内部。
图3是示出根据本发明构思的示例性实施例的可用在图1中的数据驱动器的框图。参照图3，数据驱动器150包括移位寄存器151、锁存器152、转换器部153和输出缓冲器154。移位寄存器151和锁存器152具有与图2的移位寄存器131a和锁存器131b的构造和功能相同的构造和功能。
转换器部153包括第一D-A转换器153a和第二D-A转换器153b。第一D-A转换器153a将多个图像信号I-DATA’转换成多个第一电压D1～Dm。第一D-A转换器153a在一些灰阶电压(例如，V1～V64)中选择对应于图像信号的灰阶电压，并且将所选择的灰阶电压输出为第一电压。每个图像信号可以是k比特，其中k是等于或大于1的正整数。
例如，当k是6且输出具有正极性的第一电压时，第一D-A转换器153a可将图像信号“111111”转换成对应于“V64”的灰阶电压并将图像信号“000000”转换成对应于“V1”的灰阶电压。相反，当输出具有负极性的第一电压时，第一D-A转换器153a可将图像信号“111111”转换成对应于“V1”的灰阶电压并将图像信号“000000”转换成对应于“V64”的灰阶电压。
第二D-A转换器153b交替地选择预定的第一参考信号AHB或预定的第二参考信号ALB，并且响应于第一控制信号CTL输出第一参考信号AHB或第二参考信号ALB。第一参考信号AHB或第二参考信号ALB可具有k比特。进一步，第一参考信号AHB的k比特可在逻辑高状态，第二参考信号ALB的k比特可在逻辑低状态。
例如，在第q帧期间，第二D-A转换器153b响应于在逻辑高状态的第一控制信号CTL而选择第一参考信号AHB，将所选择的第一参考信号AHB转换成对应于“V64”的灰阶电压，并且输出该对应于“V64”的灰阶电压。然后，在第q+1帧期间，第二D-A转换器153b响应于在逻辑低状态的第一控制信号CTL而选择第二参考信号ALB，将所选择的第二参考信号ALB转换成对应于“V1”的灰阶电压，并且输出该对应于“V1”的灰阶电压。
接下来，第二D-A转换器153b响应于第二控制信号CTLB交替地选择第一参考信号AHB或第二参考信号ALB，将所选择的第一参考信号AHB或第二参考信号ALB转换成第三电压VCB，并输出第三电压VCB。因此，当第二D-A转换器153b将第一参考信号AHB转换成第二电压VC时，第二D-A转换器153b将第二参考信号ALB转换成第三电压VCB，并且当第二D-A转换器153b将第二参考信号ALB转换成第二电压VC时，第二D-A转换器153b将第一参考信号AHB转换成第三电压VCB。结果，第三电压VCB可具有与第二电压VC相反的相位。
输出缓冲器154输出从第一D-A转换器153a输出的第一电压D1～Dm。进一步，输出缓冲器154可放大从第二D-A转换器153b输出的第二电压VC和第三电压VCB。
图4是示出根据本发明的构思的示例性实施例的可用在图1中的数据驱动器的框图。在图4中，相同的标号指示与图3中的元件相同的元件，因此将省略对相同元件的详细描述。
参照图4，数据驱动器159包括移位寄存器151、锁存器152、转换器部153、输出缓冲器156和缓冲器部157。移位寄存器151和锁存器152具有与图2中的移位寄存器131a和锁存器131b的电路构造相同的电路构造，转换器部153包括作为图3中示出的转换器部153的第一转换器153a和第二转换器153b。
输出缓冲器156输出从第一D-A转换器153a输出的第一电压D1～Dm。与图3中示出的数据驱动器150不同，图4中示出的数据驱动器159还包括与输出缓冲器156分开的缓冲器部157。
缓冲器部157放大从第二D-A转换器输出的第二电压VC和第三电压VCB。当数据驱动器159还包括与输出缓冲器156分开的缓冲器部157时，可以充分地增大第二电压VC和第三电压VCB。
图5A是示出在第q帧中施加到显示面板的第一电压的极性的示意图，图5B是示出在第q+1帧中施加到显示面板的第一电压的极性的示意图。
参照图5A和图5B，施加到每个像素的第一电压的极性以一帧为单位反转。另外，彼此相邻的两个像素接收具有彼此不同的极性的第一电压。
当第一像素Px在第q帧Fq期间接收具有负极性(-)的第一电压时，第一像素Px在第(q+1)帧Fq+1期间接收具有正极性(+)的第一电压。另外，当与第一像素Px相邻的第二像素Py在第q帧Fq期间接收具有正极性(+)的第一电压时，第二像素Py在第(q+1)帧Fq+1期间接收具有负极性(-)的第一电压。
可以参照施加到每个像素的第二电压VC或第三电压VCB表示第一电压的极性。
图6A是示出施加到图5A和图5B的第一像素的第一电压和第二电压的示例性波形图，图6B是示出施加到图5A和图5B的第二像素的第一电压和第三电压的波形图。
参照图6A，当假定第二电压VC施加到第一像素Px且施加到第一像素Px的第一电压被称为第一像素电压DATAx，第一像素电压DATAx的极性以一帧为单位相对于第二电压VC反转。例如，当第一像素电压DATAx在第q帧Fq期间相对于第二电压VC具有负极性(-)时，第一像素电压DATAx可在第(q+1)帧期间相对于第二电压VC具有正(+)极性。
将具有与第二电压VC相反的相位的第三电压VCB施加到与第一像素Px相邻的第二像素Py。当假定施加到第二像素Py的第一电压被称为第二像素电压DATAy时，第二像素电压DATAy的极性以一帧为单位相对于第三电压VCB反转。换句话说，当第二像素电压DATAy在第q帧Fq期间相对于第三电压VCB具有正(+)极性时，第二像素电压DATAy可在第(q+1)帧Fq+1期间相对于第三电压VCB具有负(-)极性。
图7是示出根据本发明的构思的示例性实施例的图1的时序控制器的框图，图8是示出图7的信号的示例性时序图。参照图7和图8，时序控制器120包括反相器121、延迟器122、逻辑电路123、计数器124和状态转换器125。
反相器121将施加到时序控制器120的控制信号Hsync、Vsync、MCLK和DE中的数据使能信号DE反相以输出反相信号DE1。延迟器122通过预定基准时钟信号CLK中的一个时钟延迟数据使能信号DE，以输出延迟信号DE2。
逻辑电路123对反相信号DE1和延迟信号DE2进行逻辑与运算，以输出标志(flag)信号FLA。如图8中所示，在反相信号DE1和延迟信号DE2处于逻辑高状态的时段，标志信号FLA具有逻辑高状态。
计数器124对标志信号FLA的高时段进行计数并将一帧的最后的高时段输出为结束标志信号E-FLA。例如，当假定n(例如，n是等于或大于1的正整数)个栅极信号G1～Gn在一帧期间顺序地输出时，计数器124在计数值为n时输出结束标志信号E-FLA。
如图8中所示，标志信号FLA的最后的高时段E-FLA被包括在第q帧Fq和第(q+1)帧Fq+1之间的空白时段(blank period)VBLK。
状态转换器125响应于结束标志信号E-FLA转换第一控制信号CTL和第二控制信号CTLB的状态。例如，如图8中所示，第一控制信号CTL的逻辑低状态在标志信号FLA的最后的高时段E-FLA中被转换成逻辑高状态，第二控制信号CTLB的逻辑高状态在标志信号FLA的最后的高时段E-FLA中被转换成逻辑低状态。
因此，由于第一控制信号CTL和第二控制信号CTLB的状态在空白时段VBLK中被转换，第二电压VC和第三电压VCB可在第(q+1)帧Fq+1开始之前被转换。因此，在不增加第二电压VC和第三电压VCB的情况下，可以确保第二电压VC和第三电压VCB的延迟时间裕度(margin)。
图9是示出图1的示例性像素的布局图，图10是沿图9的线I-I’截得的示例性截面图。图1的显示面板110包括多个像素，但是像素中的一个或多个具有相同的布局图。因此，为了易于讨论，在图9中仅仅示出了一个像素的布局。
参照图9，像素包括栅极线GL、第一信号线DL、第二信号线CL、第一薄膜晶体管T1、第二薄膜晶体管T2、包括多个第一像素电极部分的第一像素电极PE和具有多个第二像素电极部分的第二像素电极CE。
栅极线GL在第一方向A1延伸，第一信号线DL和第二信号线CL在第二方向A2延伸，以与栅极线GL交叉，所述第二方向A2基本垂直于第一方向A1。第一信号线DL和第二信号线CL可彼此基本平行且彼此分隔开。第一薄膜晶体管T1、第二薄膜晶体管T2、第一像素电极PE和第二像素电极CE被布置在第一信号线DL和第二信号线CL之间。
第一像素电极PE的第一像素电极部分彼此分隔开，并且第二像素电极CE的第二像素电极部分别被布置在第一像素电极部分之间的空间中。第一像素电极PE的端部彼此电连接，第二像素电极CE的端部彼此电连接。
第一薄膜晶体管T1包括从栅极线GL分支的栅电极，从第一信号线DL分支出的源电极和连接到第一像素电极PE的漏电极。第二薄膜晶体管T2包括从栅极线GL分支出的栅电极、从第二信号线CL分出的源电极和连接到第二像素电极CE的漏电极。
如图10中所示，显示面板110包括阵列基板111、面对阵列基板111的相对基板112以及在阵列基板111和相对基板112之间设置的液晶层113。
第一像素电极PE(例如，第一像素电极部分)和第二像素电极CE(例如，第二像素电极部分)设置在阵列基板111上。阵列基板111还包括在基板基底111a和在基板基底111a上的绝缘层111b。第一像素电极PE和第二像素电极CE布置在绝缘层111b上，第二像素电极CE中的每一个位于两个相邻的第一像素电极PE之间。因此，水平电场形成在彼此相邻的一个第一像素电极和一个第二像素电极之间。
液晶层113可包括扭曲向列型液晶。液晶层113的透光率可通过由水平
电场调整每个液晶的倾斜来控制。虽然图9和图10示出了由水平电场操作的像素的具体形状和构造，但是像素不限于此。
图11是根据本发明构思的示例性实施例的显示设备的平面图。参照图11，显示设备200包括显示面板110、具有时序控制器120的控制板210、具有多个芯片的数据驱动器130、具有多个芯片的栅极驱动器140以及设置在控制板210和显示面板110之间的印刷电路板230。印刷电路板230可分成两部分。
芯片形式的数据驱动器130布置在第一膜上芯片240上，且芯片形式的栅极驱动器140布置在第二膜上芯片250上。第一膜上芯片240附着在显示面板110的一例上，第二膜上芯片250附着在显示面板110的另一侧上。
第一膜上芯片240电连接到印刷电路板230，印刷电路板230经由连接膜220电连接到控制板210。
因此，图像信号I-DATA’(参照图1)和从时序控制器120输出的数据控制信号STH、POL、TP和CKH经由连接膜220、印刷电路板230和第一膜上芯片240提供给数据驱动器130。
进一步，从时序控制器120输出的第一控制信号CTL和第二控制信号CTLB经由连接膜220、印刷电路板230和第一膜上芯片240提供给数据驱动器130。因此，数据驱动器130不仅输出第一电压，而且输出第二电压VC和第三电压VCB。
在本发明构思的至少一个示例性实施例中，第二电压VC和第三电压VCB中的每一个是在0伏和15伏之间摇摆的方波，第一控制信号CTL和第二控制信号CTLB具有大约3.3伏的电压电平。
如上所述，当从数据驱动器130输出第二电压VC和第三电压VCB时，第二电压VC和第三电压VCB可在不通过控制板210、连接膜220和印刷电路板230的情况下施加到显示面板110。因此，第二电压VC和第三电压VCB的电气可以更加稳定，并可以简化显示设备200的电路板的电路设计。
虽然已经描述了本发明的构思的示例性实施例，应当理解本发明的构思不应局限于这些示例性实施例，本领域普通技术人员可以在本公开的精神和范围内作出各种改变和变型。

Claims (20)

1.一种显示设备，包括：
时序控制器，输出多个图像信号、数据控制信号和第一控制信号；
数据驱动器，所述数据驱动器响应于数据控制信号将图像信号转换成第一电压，输出第一电压，并响应于第一控制信号输出以至少一帧为单位在两个不同的电压电平之间摇摆的第二电压；
显示面板，包括多个像素，其中，像素中的至少一个接收第一电压中对应的一个和第二电压，以显示图像。
2.根据权利要求1所述的显示设备，其中，数据驱动器还响应于具有与第一控制信号的相位相反的相位的第二控制信号而输出具有与第二电压的相位相反的相位的第三电压。
3.根据权利要求2所述的显示设备，其中，数据驱动器包括：
数据输出部，接收模拟驱动电压，并在陈列在模拟驱动电压和地电压之间的多个灰阶电压中选择分别对应于图像信号的灰阶电压，以将所选择的灰阶电压输出为第一电压；
电压生成器，交替地选择模拟驱动电压或地电压，以将模拟驱动电压和地电压中的一个输出为第二电压并将模拟驱动电压和地电压中的剩余一个输出为第三电压。
4.根据权利要求3所述的显示设备，其中，数据驱动器还包括缓冲器部，以放大从电压生成器输出的第二电压和第三电压。
5.根据权利要求2所述的显示设备，其中，数据驱动器包括：
转换器部，将具有n比特的图像信号转换成第一电压，交替地选择具有n比特的预定的第一参考信号和具有n比特的预定的第二参考信号中的一个，并将所选择的第一参考信号和第二参考信号中的一个转换成第二电压，将第一参考信号和第二参考信号中的剩下一个转换成第三电压；
输出缓冲器，输出从转换器部输出的第一电压，其中n是等于或大于1的正整数。
6.根据权利要求5所述的显示设备，其中，所选择的第一参考信号和第二参考信号中的一个的n比特处于逻辑高状态，第一参考信号和第二参考信号中的剩下一个的n比特处于逻辑低状态。
7.根据权利要求5所述的显示设备，其中，输出缓冲器放大从转换器部输出的第二电压和第三电压。
8.根据权利要求5所述的显示设备，还包括缓冲器部，所述缓冲器部放大从转换器部输出的第二电压和第三电压。
9.根据权利要求2所述的显示设备，其中，像素中的至少一个包括：
第一信号线，接收第一电压中的对应的一个；
栅极线，其输出栅极信号；
第一晶体管，其连接到栅极线和第一信号线；
第二信号线，其接收第二电压和第三电压中的一个；
第二晶体管，其连接到第二信号线和栅极线；
多个第一像素电极，所述多个第一像素电极连接到第一晶体管的漏电极并且彼此分隔开；
多个第二像素电极，所述多个第二像素电极中的每一个布置在两个相邻的第一像素电极之间并连接到第二晶体管的漏电极。
10.根据权利要求9所述的显示设备，其中，第二电压和第三电压中的每一个以一帧为单位在两个不同的电压电平间摇摆，两个相邻的像素中的一个接收第二电压，两个相邻像素中的剩下一个接收第三电压。
11.根据权利要求9所述的显示设备，其中，显示面板包括阵列基板、与阵列基板相对的相对基板和设置在阵列基板和相对基板之间的液晶层，所述像素布置在阵列基板上。
12.根据权利要求2所述的显示设备，其中，第一控制信号和第二控制信号中的每一个具有逻辑高状态和逻辑低状态中的一种，时序控制器在存在于两个连续帧之间的空白信号期间触发第一控制信号和第二控制信号中的每一个的状态。
13.根据权利要求12所述的显示设备，其中，时序控制器包括：
反相器，其转换数据使能信号，以输出反相信号；
延迟器，其延迟数据使能信号预定参考时段，以输出延迟信号；
逻辑电路，将反相信号与延迟信号进行逻辑与，以输出标志信号；
计数器，其对标志信号的高时段进行计数，以将一帧的最后的高时段输出为结束标志信号；
状态转换器，响应于结束标志信号来触发第一控制信号和第二控制信号的状态。
14.根据权利要求2所述的显示设备，还包括：
控制板，其包括时序控制器；
膜上芯片，其附着在显示面板的一侧上，其中，数据驱动器以芯片形式安装在膜上芯片上；
印刷电路板，其连接在膜上芯片和控制板之间，以将图像信号和从时序控制器输出的第一控制信号和第二控制信号提供给数据驱动器。
15.一种数据驱动器，包括：
转换器部，所述转换器部包括：第一转换器，用于将多个图像信号转换成第一电压；第二转换器，用于交替地选择第一参考信号和第二参考信号中的一个，将所选择的第一参考信号或第二参考信号转换成第二电压，输出所述第二电压；
输出缓冲器，所述输出缓冲器输出从第一转换器输出的第一电压。
16.根据权利要求15所述的数据驱动器，其中，第一参考信号的电压电平与第二参考信号的电压电平相反。
17.根据权利要求15所述的数据驱动器，其中，第二转换器还输出具有与第二电压相反的相位的第三电压。
18.根据权利要求17所述的数据驱动器，其中，所述输出缓冲器放大从第二转换器输出的第二电压和第三电压。
19.根据权利要求17所述的数据驱动器，其中，还包括缓冲器部，所述缓冲器部放大从第二转换器输出的第二电压和第三电压。
20.一种数据驱动器，包括：
数据输出部，接收多个图像信号和模拟驱动电压，并在陈列在模拟驱动电压和地电压之间的多个灰阶电压中选择分别对应于图像信号的灰阶电压，以将所选择的灰阶电压输出为第一电压；
开关部，交替地选择模拟驱动电压和地电压中的一个，以输出第二电压和具有与第二电压的相位相反的相位的第三电压；
缓冲器部，放大第二电压和第三电压。
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