KR890008835A - 메모리 장치 - Google Patents
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- Engineering & Computer Science (AREA)
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- Computer Hardware Design (AREA)
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Abstract
내용 없음
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명 메모리 장치의 한 예를 나타내는 요부 회로도.
제2도는 그 동작을 설명하기 위한 파형도.
Claims (1)
- 메모리 셀이 적어도 2개의 NMOS 트랜지스터로 형성되고 비트선과 그 비트선을 종단하는 부하를 포함하여 그 부하가 가변 저항으로 형성된 메모리 장치에 있어서, 상기 가변 저항은 PMOS 트랜지스터로 형성되고 그 PMOS 트랜지스터 게이트 전위가 데이타의 독출시에는 저레벨로, 데이타 기입시에는 저 레벨과 고 레벨간의 중간 레벨로, 각각 제어되는 것을 특징으로 하는 메모리 장치.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP62299084A JPH01140491A (ja) | 1987-11-27 | 1987-11-27 | メモリ装置 |
JP299084 | 1987-11-27 |
Publications (2)
Publication Number | Publication Date |
---|---|
KR890008835A true KR890008835A (ko) | 1989-07-12 |
KR0168831B1 KR0168831B1 (ko) | 1999-02-01 |
Family
ID=17867971
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
KR1019880014199A KR0168831B1 (ko) | 1987-11-27 | 1988-10-31 | 메모리 장치 |
Country Status (2)
Country | Link |
---|---|
JP (1) | JPH01140491A (ko) |
KR (1) | KR0168831B1 (ko) |
Family Cites Families (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH0750554B2 (ja) * | 1985-09-06 | 1995-05-31 | 株式会社東芝 | スタテイツク型メモリ |
JPS61227288A (ja) * | 1985-03-30 | 1986-10-09 | Toshiba Corp | 半導体記憶装置 |
JPH0823995B2 (ja) * | 1985-12-20 | 1996-03-06 | 日本電気株式会社 | 半導体記憶装置 |
JPS62200595A (ja) * | 1986-02-26 | 1987-09-04 | Sony Corp | メモリ装置 |
-
1987
- 1987-11-27 JP JP62299084A patent/JPH01140491A/ja active Pending
-
1988
- 1988-10-31 KR KR1019880014199A patent/KR0168831B1/ko not_active IP Right Cessation
Also Published As
Publication number | Publication date |
---|---|
JPH01140491A (ja) | 1989-06-01 |
KR0168831B1 (ko) | 1999-02-01 |
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