KR850006745A - 프로세서간 결합방식 - Google Patents

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KR850006745A
KR850006745A KR1019850001042A KR850001042A KR850006745A KR 850006745 A KR850006745 A KR 850006745A KR 1019850001042 A KR1019850001042 A KR 1019850001042A KR 850001042 A KR850001042 A KR 850001042A KR 850006745 A KR850006745 A KR 850006745A
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flip
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료우조우 마애노
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사바 쇼오이찌
가부시끼 가이샤 도오시바
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    • G06—COMPUTING; CALCULATING OR COUNTING
    • G06F—ELECTRIC DIGITAL DATA PROCESSING
    • G06F13/00—Interconnection of, or transfer of information or other signals between, memories, input/output devices or central processing units
    • G—PHYSICS
    • G06—COMPUTING; CALCULATING OR COUNTING
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    • G06F13/00—Interconnection of, or transfer of information or other signals between, memories, input/output devices or central processing units
    • G06F13/14—Handling requests for interconnection or transfer
    • G06F13/36—Handling requests for interconnection or transfer for access to common bus or bus system
    • G—PHYSICS
    • G06—COMPUTING; CALCULATING OR COUNTING
    • G06F—ELECTRIC DIGITAL DATA PROCESSING
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Abstract

내용 없음

Description

프로세서간 결합방식
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명에 다른 정보처리 시스템의 구성예를 도시한 블록도.
제2도는 제1도에 대한 시스템 제어장치의 내부구성 가운데 프로세서장치의 절환 제어를 실행하는 부분만 도시한 실시예이다.
* 도면의 주요부분에 대한 부호의 설명
1,2 : 프로세서장치 3 : 시스템제어장치
4 : CPU버스 5 : PROM
6 : 드라이버 7 : 메모리버스
8 : 주기억장치 9 : 베이스레지스터
10 : 입출력버스 11~14 : 입출력인터페이스장치
31 : D형플립플롭 32,33 : 노아게이드
34 : 제어부 35 : 시프트레지스터
36 : 베타논리회로 37 : RS플립플롭
38 : 카운터 39 : 낸드게이트
40,41 : 노아게이트

Claims (2)

  1. 한번에 어느 하나만이 유효하도록 된 리셋트입력을 갖는 적어도 2개의 프로세서장치가 버스를 매개하여 공통으로 접속되어 구성된 정보처리 시스템에 있어서, 상기 각각의 프로세서장치에 의해 세트/리셋트되는 적어도 한개의 플립플롭을 갖추고, 상기 플립플롭이 지시하는 동작모우드에 따라서 상기 동작모우드에 대응하는 오직 한개의 프로세서 장치의 리셋트를 해제하고 리셋트가 해제된 오직 한개의 상기 프로세서장치가 다른 프로세서장치와 공통으로 사용하고 있는 상기 버스를 전용으로 사용하도록 된 것을 특징으로 하는 프로세서간 결합방식.
  2. 제1항에 있어서, 모우드 플립플롭이 지시하는 내용에 따라 상기 내용에 대응하는 오직 한개의 프로세서 장치의 리셋트를 해제하도록 된 제1의 회로수단과 상기 프로세서 장치에 의해 모우드를 절환할 때 상기 모우드 플립플롭에서 발생하는 상태변화를 검출하는 제2의 회로수단 및 상기 제2의 회로수단에 의해 검출된 출력으로써 하드웨어리소스에 대해 일정시간 동안 초기화출력을 발생시켜 출력하도록 된 제3의 회로 수단을 갖추며, 상기 프로세서 장치에 의해 모우드를 절환시킬 때에 리셋트를 해제시키므로서 해당 프로세서 장치와 함께 상기 공통 하드웨어리소스도 초기화시키는 것을 특징으로 하는 프로세서간 결합방식.
    ※ 참고사항:최초출원 내용에 의하여 공개하는 것임.
KR1019850001042A 1984-02-29 1985-02-19 프로세서간 결합방식 KR900002438B1 (ko)

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JP59-37556 1984-02-29
JP37556 1984-02-29
JP59037556A JPS60181865A (ja) 1984-02-29 1984-02-29 プロセツサ間結合方式
JP59086347A JPS60230261A (ja) 1984-04-28 1984-04-28 マルチプロセツサシステムにおける初期化制御方式
JP86347 1984-04-28
JP59-86347 1984-04-28

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KR900002438B1 (ko) 1990-04-14

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