KR0144733B1 - 드롭 아우트의 검출 회로 - Google Patents

드롭 아우트의 검출 회로

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KR0144733B1
KR0144733B1 KR1019890016454A KR890016454A KR0144733B1 KR 0144733 B1 KR0144733 B1 KR 0144733B1 KR 1019890016454 A KR1019890016454 A KR 1019890016454A KR 890016454 A KR890016454 A KR 890016454A KR 0144733 B1 KR0144733 B1 KR 0144733B1
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Abstract

내용없음

Description

드롭 아우트의 검출 회로
제1도는 본 발명의 일실시예에 대한 계통도
제2도 내지 제7도는 상기 실시예의 설명을 위한 도면
*도면의 주요 부분에 대한 부호의 설명
58:지연회로 62:A/D컨버터
81:형성회로 91내지
94:레벨검출회로
본 발명은 드롭 아우트(drop out)의 검출 회로에 관한 것이다.
본 발명은 드롭 아우트의 검출 회로에 있어서, 유효 비디오 기간과 동기 신호 기간에 드롭 아우트의 검출 레벨을 변경함으로서 드롭 아우트를 적절하게 검출 할 수 있도록 한 것이다.
기록이 가능한 광 비디오 디스크 장치로서 다음과 같은 것이 고려되고 있다.
즉, 제3도는 디스크 장치의 기록계, 제4도는 디스크 장치의 재생계를 도시한다. 또한, 제5a도는 그 기록 재생되는 비디오 신호를 도시하고, 이 도면에서 비디오 신호는 NTSC 방식의 휘도 신호 Y, 적색 색차 신호(R-Y) 및 청색 색차 신호(B-Y)임과 동시에 칼라바(color bar)신호의 경우를 나타낸다.
그래서, 기록계에 있어서, 수평 동기 펄스 Ph 및 수직 동기 펄스 Pv가 단자(41)로부터 신호 형성 회로(42)에 공급되어 기록 처리에 필요한 각종의 타이밍 신호가 펄스 Ph, Pv와 동기하여 형성되며, 이 형성된 신호는 각각의 회로에 공급된다.
또한, 휘도 신호 Y는 단자(11Y)로부터 컷 오프 주파수(cutoff frequency)가 예를 들면 5MHz인 로우패스 필터(12Y)를 통해 A/D 컨버터(13Y)에 공급된 후 수평 주파수 fh의 예컨대 864배의 샘플링 주파수로 A/D변환되며, 그 디지털화된 휘도 신호 Y중, 유효 수평 주사기간인 720T 기간(T는 1샘플링 기간)의 신호가 메모리(14Y)에 기입된다.
또한, 색차 신호(R-Y), (B-Y)는 단자(11R), (11B)에서 컷 오프 주파수가 예컨대 1.25MHz인 로우패스 필터(12R), (12B)를 통해 A/D컨버터(13R), (13B)에 공급되어서 신호 Y의 예컨대 1/4의 샘플링 주파수로 A/D변환되어, 그 디지털화된 신호((R-Y), (B-Y))중의 유효 수평 주사기간의 신호가 메모리(14R), (14B)에 각각 기입된다
이 경우, 메모리(14Y, 14R, 14B)는 이들에 공급된 신호의 시간축을 압축하기 위한 것이며, 이를 위해 메모리(14Y) 내지 (14B)는 FIFO 형식으로 되어있다. 그래서, 메모리(14Y)로부터는 신호 Y가 예컨대 기입될 때의 속도의 1.5배의 속도(주파수)로, 또한, 제5B도에 도시한 바와 같이 각 수평 기간마다 그 수평기간의 후부의 480T 기간에 위치하도록 판독된다. 동일하게, 메모리(14R), (14B)에서는 신호(R-Y), (B-Y)가 예를 들면 기입시의 속도의 6배의 속도로, 또한 상기 제5b도에 도시한 바와 같이 각 수평 기간마다 신호Y의 바로 전의 각 120T 기간에 각각 위치하도록 판독된다
그래서, 이들 판독된 신호 Y, (R-Y), (B-Y)가 멀티플렉서(15)를 통해서 D/A컨버터(16)에 공급되어 컨버터(16)로부터는 상기 제5B도에 도시한 바와 같이 각 수평 기간마다 그 중앙 내지 후측에 아날로그 신호((R-Y), (B-Y), Y)를 1수평 기간몫씩 차례로 갖는 시분할 신호(Sa)가 인출된다. 또한 이 경우 컨버터(13Y 내지 13B)에서 A/D변환시에 신호(Sa)의 중심 레벨은 50IRE이고, 백색측의 최대 레벨은 100IRE이며, 흑색측의 최대 레벨은 0IRE가 된다.
그래서, 이 신호 Sa가, 컷 오프 주파수가 예컨대 7.5MHz인 로우패스 필터(17)을 통해 가산회로(18)로 공급된다.
또한, 좌채널과 우채널의 스테레오 오디오 신호 L, R은 단자 (31)에서 PCM엔코더(32)에 공급되어 1 수평 기간 몫마다 소정의 시간 위치에 위치하는 PCM데이터 Sp로 되어, 이 데이터 Sp가 가산회로(18)에 공급됨과 동시에, 형성회로(42)에서 새로운 수평 동기 펄스 Ps와, 신호(Sp)를 위한 동기 신호 SYNC가 추출되어 가산회로(18)로 공급된다.
따라서, 가산회로(18)에서는 제5c도에 도시한 바와 같이 각 수평 기간마다 동기 펄스 Ps와, 동기 신호 SYNC와, PCM데이터 Sp와, 색차 신호(R-Y), (B-Y)와 휘도 신호Y를 갖는 시분할 신호 St가 추출된다. 또한, 이 경우, 예컨대 페데스탈 레벨(pedestal level;기초 레벨)은 0IRE, 동기 펄스 Ps의 싱크 칩 레벨은 -40IRE, 신호 SYNC, Sp의 레벨은 50IRE를 중심으로 하여 25IRE내지 75IRE로 한다.
그래서, 이 신호 St가 프리엠퍼시스 회로(21)를 통해 FM변조회로(22)로 공급되어, 신호 St가 흑색 레벨쪽인 때에는 낮은 주파수로 되는 극성의 FM신호 Sf로 변환되며, 이 신호 Sf가 기록 앰프(변조수단)(23)를 통해 광학 헤드(24)로 공급됨과 동시에 그 출력광이 광 디스크(1)에 공급되어, 신호 Sf 는 디스크(1)에 나선(spiral) 형상의 트랙으로서 기록된다.
또한, 재생계에 있어서는, 광학 헤드(51)에 의해 디스크(1)에서 신호 Sf가 재생되어, 이 신호 Sf가 재생 앰프(52) 및 리미터(53)를 통해 FM 복조회로(54)에 공급되어 신호 Sf가 복조되며, 이 신호 St가 디엠퍼시스 회로(55)를 통하고 다시 드롭 아우트 보상회로(61)를 통해서 A/D컨버터(62)에 공급되어 신호 St중의 신호 (R-Y), (B-Y), Y가 A/D변환되며, 이 디지털화된 신호 Y, (R-Y), (B-Y)가 메모리(63Y), (63R), (63B)에 각각 기입된다.
이 메모리 (63Y) 내지 (63B)는 FIFO 형식으로 되어 신호 Y 내지 (B-Y)의 시간축 신장을 행하기 위한 것이며, 메모리(63Y) 내지 (63B)에서는 처음의 시간축 길이의 신호 Y 내지 (B-Y)가 판독된다. 그래서 이 판독된 신호 Y 내지 (B-Y)가 D/A컨버터(64Y) 내지 (64B)에 공급되어 처음의 아날로그 신호 Y 내지 (B-Y)로 A/D변환되어, 이 아날로그화된 신호 Y 내지 (B-Y)가 로우패스필터(65Y) 내지 65B)를 통해서 단자(66Y) 내지 (66B)에서 추출된다.
또한, 디엠퍼시스 회로(55)로부터의 신호 St가 PCM 디코더(71)에 공급되어 데이터 Sp에서 처음의 오디오 신호(L, R)가 디코드되고, 이 신호 (L, R)가 단자(72)에서 추출된다.
또한, 디엠퍼시스 회로(55)로부터의 신호 St와 필터(65Y)로부터의 신호 Y가, 신호 형성 회로(81)에 공급되어 신호 St, Y중의 신호 Ps, SYNC 및 Ph에서 신호 Y 내지 (B-Y), L, R의 재생 처리에 필요한 각종의 타이밍의 신호가 신호 Ps, SYNC, Ph와 동기하여 형성되고, 이 신호에 의해 상술한 재생 처리가 행해진다.
이상이 기록 가능한 광 비디오 디스크 장치의 일예이다.
그런데, 상술한 드롭 아우트 보상 회로(61)에 있어서 드롭 아우트의 보상을 행하려면, 먼저, 드롭 아우트를 검출해야만 하는데, 그 검출 방법에는 다음과 같은 방법이 있다.
즉, 제1검출 방법은, 재생 앰프(52)로부터의 FM신호 Sf가, 드롭 아우트 때문에 예컨대 제6A도에서 실선으로 도시한 바와 같은 파형이었다면, 제6B도에 도시한 바와 같이, 신호(Sf)의 제로 크로스(zero cross)점을 검출하여, 이 검출 신호의 주파수를 검사한다. 따라서, FM신호 Sf가 신호 St에 의해 정확하게 FM변조 되었을 때는, 신호 Sf의 주파수가 규정치 이하로 되지 않으므로, 그 검출 신호의 주파수가 규정치 이하로 되면, 드롭 아우트가 발생하였다고 판단하는 것이다.
또한, 제2검출 방법은 FM신호 Sf를 제6a도의 쇄선으로 도시한 바와 같이, 0레벨을 중심으로 한 레벨을 나누어 제6B도에 도시한 바와 같은 구간 출력을 얻어, 이 구간 출력에 의해 제1검출 방법과 마찬가지로 드롭 아우트를 검출하는 것이다.
그리고, 제3검출 방법은 FM복조된 신호 St에 대해서 제7도에 쇄선으로 도시한 바와 같이 클립 레벨(clip level)을 설정한다. 그래서, FM신호 Sf에 드롭 아우트가 발생되었을 때, 그 드롭 아우트 부분에서 신호 Sf의 주파수가 정규 범위에서 벗어나 신호 St의 드롭 아우트 부분에 드롭 아우트 잡음(Nr)이 초래된다. 여기에서, 신호 St의 레벨이 클립 레벨을 초과하면, 이는 드롭 아우트에 의한 것으로 판단되고 그 클립 출력은 드롭 아우트의 검출 출력이 된다.
그러나 제1 및 제2검출 방법에서는 FM신호 Sf의 주파수가 저하되는 바와 같은 드롭 아우트(화면상에서 검게 되는 드롭 아우트)에 대해서는 검출이 가능하나 비디오 디스크(1)의 반사율의 불균일 등에 의해 FM신호 Sf의 주파수가 높아지는 것과 같은 드롭 아우트(화면상에서 백색으로 되는 드롭 아우트)를 발생시켜도 이것은 검출되지 아니한다.
제3검출 방법에 의하면, FM신호 Sf의 주파수가 높아지는 것과 같은 드롭 아우트도 검출된다. 그러나, 이 검출 방법에서는, 신호 St에 있어서, 신호(R-Y) 내지 Y의 최소 레벨(0IRE)과, 동기 펄스 Ps의 싱크 칩 레벨(-40IRE)이 크게 달라지므로, 제7도의 쇄선과 같이 클립 레벨(검출 레벨)을 설정하면, 동기 펄스 Ps가 흑색 레벨측으로 되는 드롭 아우트에 대한 검출 감도는 높아지나, 신호(R-Y) 내지 Y가 흑색 레벨측으로 되는 드롭 아우트에 대해서는 40IRE이상의 불감 레벨이 있어 검출감도가 낮아지게 된다.
이와 동일하게, 신호(R-Y) 내지 Y가 백색 레벨측으로 되는 드롭 아우트에 대해서는 검출 감도가 높아지나, 동기 펄스 Ps가 백색 레벨측으로 되는 드롭 아우트에 대해서는 검출 감도가 낮아지게 된다.
본 발명은 이상과 같은 문제점을 해결하려는 것이다.
이를 위해, 본 발명에 있어서는 기본적 제3검출 방법을 채용함과 동시에 동기 펄스 Ps의 기간과 신호(R-Y) 내지 Y의 기간에서는 검출 레벨을 각각 최적치로 전환하도록 한 것으로, 신호 내용에 적합한 검출 레벨로 드롭 아우트이 검출이 행해진다.
제1도에 있어서, 디엠퍼시스 회로(55)로부터의 신호 St가 지연회로(56)를 통해서 스위치 회로(57)에 공급됨과 동시에 또다시 지연회로(58)를 통해서 스위치 회소(57)에 공급되어 스위치 회로(57)의 출력신호가 A/D컨버터(62)에 공급된다. 이 경우에 지연회로(56)는 드롭 아우트 검출 신호를 얻을 때의 시간 지연에 대응하여 신호(St)를 지연하기 위한 회로이며, 지연회로(58)는 신호 St를 1수평 기간 지연하여 드롭 아우트를 보상하기 위한 보상 회로이다.
또한, 디엠퍼시스 회로(55)로부터의 신호 St가 레벨 검출회로(91) 내지 (94)에 공급된다. 이 경우, 검출회로(91)의 검출 레벨은, 예를 들면 제2a도에 쇄선으로 표시한 바와 같이, 신호(R-Y) 내지 Y의 백색 레벨보다도 예컨대 10IRE만큼 백색 레벨측인 110IRE로 설정되어 신호 St의 레벨이 110IRE 이상으로 되었을 때, 1이 되는 검출신호(S1)를 출력하는 것이다. 또한, 검출회로(92)의 검출 레벨은 신호(R-Y) 내지 Y의 흑색 레벨보다도 예컨대 10IRE 만큼 흑색 레벨측인 -10IRE로 설정되어 신호 St의 레벨이 -10IRE이하로 되었을 때, 1이 되는 검출신호(S2)를 출력하는 것이다. 마찬가지로, 검출회로 (93),(94)의 검출 레벨은 60IRE 및 -50IRE로 되어 신호 St의 레벨이 60IRE이상 및 -50IRE이하로 되었을 때, 각각 1로 되는 검출신호(S2, S4)를 출력하는 것이다.
그래서, 신호 S1, S2가 OR 회로(95)를 통해 스위치 회로(97)에 공급됨과 동시에, 신호 S3, S4가 OR 회로(96)를 통해 스위치 회로(97)에 공급되어, 스위치 회로의 스위치 출력 Sd가 정형회로(98)를 통해 스위치 회로(57)에 제어 신호로서 공급된다.
또한, 형성회로(81)에서 제2b도에 도시한 바와 같이, 동기 펄스 Ps의 기간 Ts에는 1이며, 남은 비디오 신호기간 Tv에는 0으로 되는 신호(Sw)가 추출되어, 이 신호(Sw)가 스위치 회로(97)에 제어 신호로써 공급된다.
이와 같은 구성에 의하면, 비디오 신호기간 Tv에는, Sw=0이므로, 스위치 회로(97)는 도면의 도시와 같은 상태로 되며, 신호(S1, S2)가 신호(Sd)로서 추출되게 된다. 그러나 이때 신호(R-Y) 내지 Y의 레벨은 레벨110IRE 내지 -10IRE의 범위 내에 있으므로, S1=0, S2=0이며, Sd=0이다.
그래서, Sd=0이면, 스위치 회로(57)는 도면의 도시와 같은 상태에 있으므로, 디엠퍼시스 회로(55)로부터의 신호 St가 지연 회로(56) 및 스위치 회로(57)를 통해 그대로 A/D 컨버터(62)에 공급되어, 이후 상술하는 바와 같이 아날로그 비디오 신호 Y 내지 (B-Y)가 추출된다.
그러나, 기간 Tv에 드롭 아우트를 발생시켜 드롭 아우트 잡음 Nr의 레벨이, 레벨 110IRE 내지 -10IRE의 범위를 초과하면, S1=1, S2=1로 되고, Sd=1로 된다.
그러면, 신호 Sd에 의해 스위치 회로(57)가 도면과는 역의 상태로 전환되어 지연회로(58)로부터의 1 수평기간 전의 신호 St가 A/D컨버터(62)에 공급된다.
따라서, 비디오 신호 Y 내지 (B-Y)에 대해서는 레벨 110IRE 및 -10IRE를 검출 레벨로서 드롭 아우트의 검출이 행해짐과 동시에, 그 드롭 아우트의 보상이 행해지게 된다.
또한, 동기 펄스 기간 Ts에는, Sw=1이므로, 스위치 회로(97)는 도면과는 역의 상태로 접속되어, 신호(S3, S4)가 신호(Sd)로서 추출되어, 이하에서 기간 Tv와 마찬가지의 처리가 행해진다.
따라서, 동기 펄스 Ps에 대해서는, 레벨 60IRE 및 -50IRE를 검출 레벨로서 드롭 아우트의 검출이 행해짐과 동시에 그 드롭 아우트의 보상이 행해진다.
이와 같이 본 발명에 의하면, 동기 펄스 Ps 및 비디오 신호(R-Y) 내지 Y에 대해서 각각 예컨대 10IRE의 마진(margin)을 고려한 레벨을 드롭 아우트 검출 레벨로 할 수가 있고, 즉, 동기 펄스 Ps 및 비디오 신호(R-Y) 내지 Y에 대해서 각각 별개로 드롭 아우트의 검출 레벨을 설정할 수 있으므로, 드롭 아우트의 검출 감도를 높게 할 수 있다. 특히, 동기 펄스 Ps에 대한 드롭 아우트의 검출 감도를 높게 할 수 있으므로 재생 화면위에 나타나는 가로 잡음을 대폭적으로 저감할 수 있다.
또한, 신호 St에 있어서 비디오 신호(R-Y) 내지 Y는 시간축이 압축되어 있으므로 드롭 아우트가 발생하면, 이는 재생 화면위에서 그 시간축의 압축에 대응한 비율로 큰 드롭 아우트 잡음으로 되나, 신호 St에 대한 드롭 아우트의 검출 감도를 높게 할 수 있으므로 그 드롭 아우트의 보상이 보다 확실하게 되어 효과가 크다.
또한, 상술한 바에 있어서, 회로(93), (94), (96), (97)를 생략하여, 신호 Sw에 의해 기간 Ts와 Tv로 검출 회로(91), (92)의 검출 레벨을 적정치로 전환하도록 할 수도 있다. 또한, 신호(57, 58)를 설치하는 대신에, 드롭 아우트시에는 신호 Sd에 의해 메모리(63Y 내지 63B)의 기입을 금지하여 1수평기간 전의 대응하는 신호를 판독하여도 좋다.
본 발명에 의하면, 동기 펄스 Ps 및 비디오 신호(R-Y) 내지 Y에 대해 각각 예컨대 10IRE의 마진을 고려한 레벨을 드롭 아우트의 검출 레벨로 할 수가 있고, 즉, 동기 펄스 Ps 및 비디오 신호(R-Y) 내지 Y에 대해서 각각 별개로 드롭 아우트의 검출 레벨을 설정할 수 있으므로, 드롭 아우트의 검출 감도를 높게 할 수 있다. 특히, 동기 펄스 Ps에 대한 드롭 아우트의 검출 감도를 높게 할 수 있으므로 재생 화면 위에 나타나는 가로 잡음을 대폭적으로 저감할 수 있다.
또한, 신호 St에 있어서는 비디오 신호(R-Y) 내지 Y는 시간축 압축되어 있으므로, 드롭 아우트가 있으면, 이것은 재생 화면 위에서는 그 시간축 압축에 대응한 비율로 큰 드롭 아우트 잡음이 되나, 신호 St에 대한 드롭 아우트의 검출 감도를 높게 할 수 있으므로, 그 드롭 아우트의 보상이 보다 확실해지며 효과가 크다.

Claims (1)

  1. 비디오 신호에서 잡음 신호를 검출하기 위한 장치에 있어서, 비디오 정보 부분과 동기 부분을 갖는 입력 비디오 신호를 공급하는 입력 수단으로서, 상기 비디오 정보 부분과 동기 부분 중 하나는 포지티브이며 포지티브 신호를 포함하고, 상기 부분들중 다른 한 부분은 네가티브이며 네가티브 신호를 포함하는 상기 입력 수단과, 상기 입력 수단에 결합되어 제1범위를 한정함으로써 상기 제1범위를 벗어나고 상기 입력 비디오 신호의 포지티브 부분에 포함된 포지티브 잡음 신호와 네가티브 잡음 신호를 검출하는 제1검출 수단과, 상기 입력 수단에 결합되어 제2범위를 한정함으로써 상기 제2범위를 벗어나고 상기 입력 비디오 신호의 네가티브 부분에 포함된 포지티브 잡음 신호와 네가티브 잡음 신호를 검출하는 제2검출 수단 및, 상기 제1검출 수단과 제2검출 수단에 결합되어 상기 입력 비디오 신호의 상기 포지티브 부분에서 검출된 잡음과 상기 네가티브 부분에서 검출된 잡음을 나타내는 출력 잡음 표시를 생성하는 출력 수단을 포함하는 것을 특징으로 하는 잡음 신호 검출 장치.
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