JPS63236088A - パタ−ン表示信号発生装置 - Google Patents
パタ−ン表示信号発生装置Info
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- JPS63236088A JPS63236088A JP62070730A JP7073087A JPS63236088A JP S63236088 A JPS63236088 A JP S63236088A JP 62070730 A JP62070730 A JP 62070730A JP 7073087 A JP7073087 A JP 7073087A JP S63236088 A JPS63236088 A JP S63236088A
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- Japan
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- 230000015654 memory Effects 0.000 claims description 25
- 238000010586 diagram Methods 0.000 description 6
- 239000002131 composite material Substances 0.000 description 5
- 150000001875 compounds Chemical class 0.000 description 2
- 230000000694 effects Effects 0.000 description 2
- 241000277331 Salmonidae Species 0.000 description 1
- 238000006243 chemical reaction Methods 0.000 description 1
Classifications
-
- G—PHYSICS
- G09—EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
- G09G—ARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
- G09G1/00—Control arrangements or circuits, of interest only in connection with cathode-ray tube indicators; General aspects or details, e.g. selection emphasis on particular characters, dashed line or dotted line generation; Preprocessing of data
- G09G1/06—Control arrangements or circuits, of interest only in connection with cathode-ray tube indicators; General aspects or details, e.g. selection emphasis on particular characters, dashed line or dotted line generation; Preprocessing of data using single beam tubes, e.g. three-dimensional or perspective representation, rotation or translation of display pattern, hidden lines, shadows
- G09G1/14—Control arrangements or circuits, of interest only in connection with cathode-ray tube indicators; General aspects or details, e.g. selection emphasis on particular characters, dashed line or dotted line generation; Preprocessing of data using single beam tubes, e.g. three-dimensional or perspective representation, rotation or translation of display pattern, hidden lines, shadows the beam tracing a pattern independent of the information to be displayed, this latter determining the parts of the pattern rendered respectively visible and invisible
-
- G—PHYSICS
- G09—EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
- G09G—ARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
- G09G5/00—Control arrangements or circuits for visual indicators common to cathode-ray tube indicators and other visual indicators
- G09G5/22—Control arrangements or circuits for visual indicators common to cathode-ray tube indicators and other visual indicators characterised by the display of characters or indicia using display control signals derived from coded signals representing the characters or indicia, e.g. with a character-code memory
- G09G5/24—Generation of individual character patterns
- G09G5/28—Generation of individual character patterns for enhancement of character form, e.g. smoothing
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- Engineering & Computer Science (AREA)
- Physics & Mathematics (AREA)
- Computer Hardware Design (AREA)
- General Physics & Mathematics (AREA)
- Theoretical Computer Science (AREA)
- Radar, Positioning & Navigation (AREA)
- Remote Sensing (AREA)
- Controls And Circuits For Display Device (AREA)
- Image Processing (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔概要〕
本発明はパターン表示信号発生装置であって、メモリと
第1及び第2のシフトレジスタと論理回路とにより、回
路構成が簡単でパターンの表示形式の自由度が大きく、
メモリ容量を小とする。
第1及び第2のシフトレジスタと論理回路とにより、回
路構成が簡単でパターンの表示形式の自由度が大きく、
メモリ容量を小とする。
(産業上の利用分野)
本発明はパターン表示信号発/4−装置に関し、表示画
面に例えばキャラクタ等のパターンを表示するための信
号を発生するパターン表示信号発生装置に関する。
面に例えばキャラクタ等のパターンを表示するための信
号を発生するパターン表示信号発生装置に関する。
例えばテレビジョンの表示画面に文字、数字。
記号等のキャラクタ及び図形等のパターンのうらキャラ
クタを表示する場合、キャラクタをそのまま表示する他
に、キャラクタの縁部を強調して表示する縁どり表示が
従来より行なわれている。
クタを表示する場合、キャラクタをそのまま表示する他
に、キャラクタの縁部を強調して表示する縁どり表示が
従来より行なわれている。
従来のパターン表示信号発生装置で、第4図に示すYラ
インのXカラムのドツトを表示するデータに基づいて1
ドツトの縁どり表示を行なう場合、次の操作が行なわれ
る。
インのXカラムのドツトを表示するデータに基づいて1
ドツトの縁どり表示を行なう場合、次の操作が行なわれ
る。
■ Y−1ラインを表示するどきYラインのデータの読
み出しを行ない、Y−1ラインのX−1カラムからX+
1カラムのドツトを表示させる。
み出しを行ない、Y−1ラインのX−1カラムからX+
1カラムのドツトを表示させる。
■ Yラインを表示するときこのYラインのデータを読
み出して、Xカラムの左右のX−1カラム及びX+1カ
ラムのドツトを表示させる。
み出して、Xカラムの左右のX−1カラム及びX+1カ
ラムのドツトを表示させる。
■ Y+1ラインを表示するどきYラインのデータの読
み出しを行ない、Y+1ラインのX−1カラムからX+
1カラムのドツトを表示させる。
み出しを行ない、Y+1ラインのX−1カラムからX+
1カラムのドツトを表示させる。
これによって第4図の斜線を付したドツトが表示され縁
どり表示が行なわれる。
どり表示が行なわれる。
従来装置は、1ドツトの縁どり表示を行なう際に、上下
1ラインを含む3ラインのデータを読み出す必要があり
、回路が非常に複雑となるという問題点があった。
1ラインを含む3ラインのデータを読み出す必要があり
、回路が非常に複雑となるという問題点があった。
また1ドツトの縁どり表示を行なう装置で2ドツトの縁
どり表示を行なうことはできず、キャラクタの表示形式
の自由度が小ざいという問題点があった。
どり表示を行なうことはできず、キャラクタの表示形式
の自由度が小ざいという問題点があった。
上記の問題点を解決するものとして第5図に示すパター
ン発生装置が考えられる。
ン発生装置が考えられる。
第5図に示すメモリ10には通常のキャラクタを表示す
るパターンのデータが記憶され、メモリ11には通常の
キャラクタの縁部を除いた中央部のみのパターン(つま
りキャラクタを構成する線が細にパターン)のデータが
記憶されている。
るパターンのデータが記憶され、メモリ11には通常の
キャラクタの縁部を除いた中央部のみのパターン(つま
りキャラクタを構成する線が細にパターン)のデータが
記憶されている。
メモリ10.11夫々から同時に読み出されたデータは
大々シフトレジスタ12.13でクロック信号φを用い
てパラレル/シリアル変換され、端子14.15夫々よ
り出力される。これと共にシフトレジスタ12’、13
夫々の出力はイクスクルーシブオア回路16に供給され
、ここで縁どり表示用の表示信号が得られ端子17より
出力される。
大々シフトレジスタ12.13でクロック信号φを用い
てパラレル/シリアル変換され、端子14.15夫々よ
り出力される。これと共にシフトレジスタ12’、13
夫々の出力はイクスクルーシブオア回路16に供給され
、ここで縁どり表示用の表示信号が得られ端子17より
出力される。
第5図に示す装置では、メモリ10.11夫々に同一の
文字に対するパターンを記憶しなければならないために
大きなメモリ容量が必要となるという問題点があった。
文字に対するパターンを記憶しなければならないために
大きなメモリ容量が必要となるという問題点があった。
本発明は上記の点に鑑みてなされたものであり、回路構
成が簡単でキャラクタ等のパターンの表示形式の自由度
が大であり、メtり容量が小さくて済むパターン発生装
置を提供することを目的とする。
成が簡単でキャラクタ等のパターンの表示形式の自由度
が大であり、メtり容量が小さくて済むパターン発生装
置を提供することを目的とする。
本発明のパターン表示信号発生装置は、予め複合化され
たパターンデータを複数記憶したメモリ(26)と、 メモリ(26)から読み出されるパターンデータのうち
奇数番目のビットのデータをパラレルに供給され、第1
のクロック信号でシフトしてシリアルに出力する第1の
シフトレジスタ(28)と、メモリ(26)から読み出
されるパターンデータのうち偶数番目のビットのデータ
をパラレルに供給され、第1のクロック信号と逆相の第
2のクロック信号でシフトしてシリアルに出力する第2
のシフトレジスタ(29)と、 第1のシフトレジスタ(28)及び第2のシフトレジス
タ(29)夫々の出力信号を論理演算して、少なくとも
パターンの縁部を強調して表示する縁どり表示用の表示
信号を得る論理回路(32)とを有する。
たパターンデータを複数記憶したメモリ(26)と、 メモリ(26)から読み出されるパターンデータのうち
奇数番目のビットのデータをパラレルに供給され、第1
のクロック信号でシフトしてシリアルに出力する第1の
シフトレジスタ(28)と、メモリ(26)から読み出
されるパターンデータのうち偶数番目のビットのデータ
をパラレルに供給され、第1のクロック信号と逆相の第
2のクロック信号でシフトしてシリアルに出力する第2
のシフトレジスタ(29)と、 第1のシフトレジスタ(28)及び第2のシフトレジス
タ(29)夫々の出力信号を論理演算して、少なくとも
パターンの縁部を強調して表示する縁どり表示用の表示
信号を得る論理回路(32)とを有する。
本発明においては、複合化されたパターンデータを奇数
番目のピッI・のデータ、偶数番目のビットのデータに
分け、夫々を互いに逆相の第1及び第2のクロック信号
でシフトして第1.第2のシフトレジスタ(12,13
)夫々よりシリアル信号とする。
番目のピッI・のデータ、偶数番目のビットのデータに
分け、夫々を互いに逆相の第1及び第2のクロック信号
でシフトして第1.第2のシフトレジスタ(12,13
)夫々よりシリアル信号とする。
これによってパターンデータの隣接する奇、細大々のビ
ットが時間的に重ね合わされ論耶演鋒が可能となり、メ
モリ容量が少なくなる。
ットが時間的に重ね合わされ論耶演鋒が可能となり、メ
モリ容量が少なくなる。
また上記2つのシリアル信号の論理演筒によって縁どり
表示用の信号が得られ、縁どり表示のために表示するラ
インの上下のパターンデータをメモリより読み出す必要
がなく、回路構成が簡単となり、メモリ(26)の複合
化されたパターンデータを変更するだけでパターンの表
示形式を変更できる。
表示用の信号が得られ、縁どり表示のために表示するラ
インの上下のパターンデータをメモリより読み出す必要
がなく、回路構成が簡単となり、メモリ(26)の複合
化されたパターンデータを変更するだけでパターンの表
示形式を変更できる。
第1図は本発明のパターン発生装置の一実施例のブロッ
ク系統図を示す。
ク系統図を示す。
同図中、ライトアドレスカウンタ20.リードアドレス
カウンタ21夫々で発生されたライトアドレス、リード
アドレスはセレクタ22に供給され、ここでコントロー
ラ23よりの制御に応じでいずれか一方が選択されて表
示メモリ24に供給される。
カウンタ21夫々で発生されたライトアドレス、リード
アドレスはセレクタ22に供給され、ここでコントロー
ラ23よりの制御に応じでいずれか一方が選択されて表
示メモリ24に供給される。
表示メモリ24は、例えば文字、数字、記号等のキャラ
クタを表わすキャラクタコードを格納する。端子25よ
り入来するキャラクタ」−ドはライトアドレスの指定に
よって表示メモリ24に読み込まれ、またリードアドレ
スによって表示メモリ24から読み出されたキャラクタ
コードはキャラクタジェネレータ26に供給される。
クタを表わすキャラクタコードを格納する。端子25よ
り入来するキャラクタ」−ドはライトアドレスの指定に
よって表示メモリ24に読み込まれ、またリードアドレ
スによって表示メモリ24から読み出されたキャラクタ
コードはキャラクタジェネレータ26に供給される。
キャラクタジェネレータ26(ま各4=ヤラクタコード
に対応して例えば32ライン×24カラムのドツトで構
成される複合キャラクタデータを記憶したメモリである
。このメモリに記憶されている複合キャラクタデータは
第2図(A)に示す如きパターンである。第2図中、O
印で示すドツトはV Q Yを表わし、・印で示すドツ
トは71vを表わJo 上記のキャラクタジェネレータ26はタイミングジェネ
レータ27よりキャラクタ内のラインを指定する信号を
供給されており、上記の1ヤラクタコードに対応した複
合キャラクタデータのうち指定されたラインのデータが
キャラクタジェネレータ26より読み出される。
に対応して例えば32ライン×24カラムのドツトで構
成される複合キャラクタデータを記憶したメモリである
。このメモリに記憶されている複合キャラクタデータは
第2図(A)に示す如きパターンである。第2図中、O
印で示すドツトはV Q Yを表わし、・印で示すドツ
トは71vを表わJo 上記のキャラクタジェネレータ26はタイミングジェネ
レータ27よりキャラクタ内のラインを指定する信号を
供給されており、上記の1ヤラクタコードに対応した複
合キャラクタデータのうち指定されたラインのデータが
キャラクタジェネレータ26より読み出される。
第3図(A>に示す如き読み出されたデータの奇数番目
のビットのデータはパラレルにシフトレジスタ28に供
給され、偶数番目のビットのデータはパラレルにシフト
レジスタ29に供給される。
のビットのデータはパラレルにシフトレジスタ28に供
給され、偶数番目のビットのデータはパラレルにシフト
レジスタ29に供給される。
シフトレジスタ28.29夫々はタイミングジェネレー
タ27より、互いに逆位相のクロック信号φ1.φ2夫
々を各別に供給されており、供給されたクロック信号に
よって上記奇数番目のビット、偶数番目のビット夫々の
データを各別にシフトし、第3図(B)、(C)に示す
シリアル信号を出力する。
タ27より、互いに逆位相のクロック信号φ1.φ2夫
々を各別に供給されており、供給されたクロック信号に
よって上記奇数番目のビット、偶数番目のビット夫々の
データを各別にシフトし、第3図(B)、(C)に示す
シリアル信号を出力する。
クロック信号φ1.φ2が互いに逆位相であるため、複
合キャラクタデータの隣接する奇、細大々のビットが時
間的に重ね合わされ以阿の論理演算が可能となる。
合キャラクタデータの隣接する奇、細大々のビットが時
間的に重ね合わされ以阿の論理演算が可能となる。
上記シフトレジスタ28.29夫々のシリアル信号は夫
々アンド回路30.オア回路31.イクスクルーシブオ
ア回路32に共通に供給される。
々アンド回路30.オア回路31.イクスクルーシブオ
ア回路32に共通に供給される。
これによってアンド回路30.オア回路31゜イクスク
ルーシブオア回路32夫々は第3図(D>、(E)、(
F)夫々に示す表示信号を生成し端子33.34.35
より各別に出力する。
ルーシブオア回路32夫々は第3図(D>、(E)、(
F)夫々に示す表示信号を生成し端子33.34.35
より各別に出力する。
アンド回路30よりの表示信号で第2図(B)に示すパ
ターンが表示され、このパターンは第5図に示″g装置
のメモリ11に記憶されたパターンと同様のものである
。オア回路31よりの表示信号で第2図(C)に示すパ
ターンが表示され、このパターンは第5図に示す装置の
メモリ10に記憶されたパターンと同様のものである。
ターンが表示され、このパターンは第5図に示″g装置
のメモリ11に記憶されたパターンと同様のものである
。オア回路31よりの表示信号で第2図(C)に示すパ
ターンが表示され、このパターンは第5図に示す装置の
メモリ10に記憶されたパターンと同様のものである。
更にイクスクルーシブオア回路32よりの表示信号で第
2図(0)に示す縁どり表示のパターンが表示され、こ
の表示信号は第5図に示す装置のイクスクルーシブオア
回路16より出力される表示信号と同様のものである。
2図(0)に示す縁どり表示のパターンが表示され、こ
の表示信号は第5図に示す装置のイクスクルーシブオア
回路16より出力される表示信号と同様のものである。
このようにキャラクタジェネレータ26に記憶された複
合キャラクタパターンから3種類の表示信号が生成され
、第5図に示す装置に比してキャラクタジェネレータ2
0のメモリ容量は略1/2に減少する。
合キャラクタパターンから3種類の表示信号が生成され
、第5図に示す装置に比してキャラクタジェネレータ2
0のメモリ容量は略1/2に減少する。
また、シフトレジスタ28.29とアンド回路30、オ
ア回路31.イクスクルーシブオア回路32との簡単な
回路構成であり、−1ヤラクタシ1ネレータ26の1a
合キャラクタデータを占き換えるだけで縁どりのドツト
数を簡単に変更できキャラクタの表示形式の自由度が大
きい。
ア回路31.イクスクルーシブオア回路32との簡単な
回路構成であり、−1ヤラクタシ1ネレータ26の1a
合キャラクタデータを占き換えるだけで縁どりのドツト
数を簡単に変更できキャラクタの表示形式の自由度が大
きい。
上述の如く、本発明のパターン表示信号発生装置によれ
ば、回路構成が簡単で、パターンの表示形式の変更を簡
単に行なうことができその自由度が大きく、また、メモ
リ容量が少なくて済み、実用上きわめて有用である。
ば、回路構成が簡単で、パターンの表示形式の変更を簡
単に行なうことができその自由度が大きく、また、メモ
リ容量が少なくて済み、実用上きわめて有用である。
第1図は本発明装置の一実施例のブロック系統図、
第2図は第1図に示す装置各部のキャラクタパターンを
説明するための図、 第3図は第1図に示す装置各部の信号を説明するための
図、 第4図は従来の縁どり表示を説明するだめの図、第5図
は従来の問題点を解決するために考えられた装置の一例
のブロック系統図である。 = 11− 図面中、 24は表示メモリ、 26はキャラクタジェネレータ、 27はタイミングジョネレータ、 28.29はシフトレジスタ、 30はアンド回路、 31はオア回路、 32はイクスクルーシブオア回路である。 0123456789X)t112131451617
1811IZ)21Z!23012345678910
44121314″5ぢ17M319Olη乙0 +
23456789101112t314516T711
m01234567891)111213%E16Tf
fi19Z)21ηり塙2図 %z明I:示す妓11鱒の肪号r鍵θ用オるノβりの1
4第3図
説明するための図、 第3図は第1図に示す装置各部の信号を説明するための
図、 第4図は従来の縁どり表示を説明するだめの図、第5図
は従来の問題点を解決するために考えられた装置の一例
のブロック系統図である。 = 11− 図面中、 24は表示メモリ、 26はキャラクタジェネレータ、 27はタイミングジョネレータ、 28.29はシフトレジスタ、 30はアンド回路、 31はオア回路、 32はイクスクルーシブオア回路である。 0123456789X)t112131451617
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23456789101112t314516T711
m01234567891)111213%E16Tf
fi19Z)21ηり塙2図 %z明I:示す妓11鱒の肪号r鍵θ用オるノβりの1
4第3図
Claims (1)
- 【特許請求の範囲】 予め複合化されたパターンデータを複数記憶したメモリ
(26)と、 該メモリ(26)から読み出されるパターンデータのう
ち奇数番目のビットのデータをパラレルに供給され、第
1のクロック信号でシフトしてシリアルに出力する第1
のシフトレジスタ(28)と、 該メモリ(26)から読み出されるパターンデータのう
ち偶数番目のビットのデータをパラレルに供給され、該
第1のクロック信号と逆相の第2のクロック信号でシフ
トしてシリアルに出力する第2のシフトレジスタ(29
)と、 該第1のシフトレジスタ(28)及び第2のシフトレジ
スタ(29)夫々の出力信号を論理演算して、少なくと
もパターンの縁部を強調して表示する縁どり表示用の表
示信号を得る論理回路(32)とを有することを特徴と
するパターン表示信号発生装置。
Priority Applications (5)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP62070730A JPH068990B2 (ja) | 1987-03-25 | 1987-03-25 | パタ−ン表示信号発生装置 |
DE8888302453T DE3877994T2 (de) | 1987-03-25 | 1988-03-21 | Generator von musteranzeigesignalen und anzeigegeraet mit verwendung dieser signale. |
EP88302453A EP0284326B1 (en) | 1987-03-25 | 1988-03-21 | Pattern display signal generating apparatus and display apparatus using the same |
KR8803231A KR910005364B1 (en) | 1987-03-25 | 1988-03-25 | Pattern display signal generating apparatus and display apparatus the same |
US07/526,948 US5003304A (en) | 1987-03-25 | 1990-05-23 | Pattern display signal generating apparatus and display apparatus using the same |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP62070730A JPH068990B2 (ja) | 1987-03-25 | 1987-03-25 | パタ−ン表示信号発生装置 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS63236088A true JPS63236088A (ja) | 1988-09-30 |
JPH068990B2 JPH068990B2 (ja) | 1994-02-02 |
Family
ID=13439943
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP62070730A Expired - Fee Related JPH068990B2 (ja) | 1987-03-25 | 1987-03-25 | パタ−ン表示信号発生装置 |
Country Status (5)
Country | Link |
---|---|
US (1) | US5003304A (ja) |
EP (1) | EP0284326B1 (ja) |
JP (1) | JPH068990B2 (ja) |
KR (1) | KR910005364B1 (ja) |
DE (1) | DE3877994T2 (ja) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR100483777B1 (ko) * | 1996-05-21 | 2005-08-29 | 휴렛-팩커드 컴퍼니(델라웨어주법인) | 기본문자로부터의볼드문자형성방법및시스템 |
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JPH073635B2 (ja) * | 1988-12-21 | 1995-01-18 | 富士通株式会社 | 白抜き文字の作成方法 |
KR920010811B1 (ko) * | 1990-05-10 | 1992-12-17 | 주식회사 금성사 | 텔레비젼 수상기에서의 데이타 편집.기억 방법및 그 장치 |
FR2664999B1 (fr) * | 1990-07-23 | 1992-09-18 | Bull Sa | Dispositif d'entree sortie donnees pour l'affichage d'informations et procede mis en óoeuvre par un tel dispositif. |
JP2726951B2 (ja) * | 1990-08-24 | 1998-03-11 | 富士ゼロックス株式会社 | 文字・図形描画装置 |
US5457774A (en) * | 1991-11-15 | 1995-10-10 | Seiko Epson Corporation | Bit map data generation apparatus |
US7551475B2 (en) | 2006-04-03 | 2009-06-23 | International Business Machines Corporation | Data shifting through scan registers |
Family Cites Families (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS57187257A (en) * | 1981-05-15 | 1982-11-17 | Fuji Xerox Co Ltd | Printing system |
US4408198A (en) * | 1981-09-14 | 1983-10-04 | Shintron Company, Inc. | Video character generator |
JPS5850589A (ja) * | 1981-09-21 | 1983-03-25 | 日本電気株式会社 | 表示処理装置 |
US4613856A (en) * | 1983-04-04 | 1986-09-23 | Tektronix, Inc. | Character and video mode control circuit |
US4616336A (en) * | 1983-05-11 | 1986-10-07 | International Business Machines Corp. | Independent image and annotation overlay with highlighting of overlay conflicts |
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1987
- 1987-03-25 JP JP62070730A patent/JPH068990B2/ja not_active Expired - Fee Related
-
1988
- 1988-03-21 EP EP88302453A patent/EP0284326B1/en not_active Expired - Lifetime
- 1988-03-21 DE DE8888302453T patent/DE3877994T2/de not_active Expired - Fee Related
- 1988-03-25 KR KR8803231A patent/KR910005364B1/ko not_active IP Right Cessation
-
1990
- 1990-05-23 US US07/526,948 patent/US5003304A/en not_active Expired - Lifetime
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
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KR100483777B1 (ko) * | 1996-05-21 | 2005-08-29 | 휴렛-팩커드 컴퍼니(델라웨어주법인) | 기본문자로부터의볼드문자형성방법및시스템 |
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EP0284326A3 (en) | 1990-01-10 |
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